JPH0392005A - Power-on mute circuit - Google Patents
Power-on mute circuitInfo
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- JPH0392005A JPH0392005A JP1228262A JP22826289A JPH0392005A JP H0392005 A JPH0392005 A JP H0392005A JP 1228262 A JP1228262 A JP 1228262A JP 22826289 A JP22826289 A JP 22826289A JP H0392005 A JPH0392005 A JP H0392005A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、電源投入時に音声回路の音声出力を消すパワ
ーオンミュート回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a power-on mute circuit that mutes the audio output of an audio circuit when power is turned on.
音声回路は、音声信号を所定レヘルまで増幅して後段の
例えば音声出力段に出力する回路であり、電源が投入さ
れると同時にその電源ラインに電源電圧が印加される。The audio circuit is a circuit that amplifies an audio signal to a predetermined level and outputs it to a subsequent stage, for example, an audio output stage, and a power supply voltage is applied to the power supply line at the same time as the power is turned on.
ところが、通常はその電源電圧の立上りが急峻なために
、その音声回路の信号ラインに音声信号と同様に変化す
る電位が載って、このため耳ぎわリなポップ音が発生ず
ることがあった。However, because the power supply voltage normally rises steeply, a potential that changes in the same way as the audio signal is applied to the signal line of the audio circuit, which can sometimes produce an audible pop sound.
本発明はこのような点に鑑みたものであり、その目的は
、電源オン時に音声信号をミュートして耳ざわりなポン
プ音の発生を防止したパワーオンミュート回路を提供す
ることである。SUMMARY OF THE INVENTION The present invention has been made in view of these points, and an object thereof is to provide a power-on mute circuit that mutes an audio signal when the power is turned on, thereby preventing the generation of an unpleasant pumping sound.
このために本発明は、音声信号ラインと一方の電源ライ
ンとの間に接続したミュート用スイ・７チング素子と、
該ミュート用スイッチング素子のオン／オフを制御する
制ｆｌｉｔスイチング素子と、電源投入直後から上記制
御スイッチング素子を介して上記ミュート用スイソチン
グ素子をオンさせる信号を出力するミュート信号作或回
路と、電源投入時から所定時間経過後に上記制御スイッ
チソング素子をして上記ミュート用スイッチング素子を
オフさせる信号を出力するミュート解除信号作或回路と
からなり、複数の電源ラインの電圧をダイオードで混合
して少なくとも上記ミュート信号作或回路に供給するよ
うにした．
〔実施例〕
以下、本発明の実施例について説明する．第１図はその
回路を示す図である。ＴＲは電源電圧十Ｂ１を発生する
ためのトランス、ＤＩは整流用ダイオード、ＣＩは平滑
用コンデンサである．また端子１には同様のトランス、
ダイオード、コンデンサ等により音声用電源＋８２が印
加される。ダイオードＤ２は十Ｂ２の電圧取り出し用で
ある。To this end, the present invention provides a mute switching element connected between an audio signal line and one power supply line,
a control switching element that controls on/off of the mute switching element; a mute signal generation circuit that outputs a signal that turns on the mute switching element via the control switching element immediately after power is turned on; a mute release signal generation circuit that outputs a signal to turn off the mute switching element by turning off the control switch song element after a predetermined period of time has elapsed from The mute signal is now supplied to the circuit. [Examples] Examples of the present invention will be described below. FIG. 1 is a diagram showing the circuit. TR is a transformer for generating the power supply voltage 1B1, DI is a rectifier diode, and CI is a smoothing capacitor. Also, a similar transformer is connected to terminal 1.
Audio power +82 is applied through a diode, capacitor, etc. The diode D2 is for taking out the voltage of 10B2.
そして、この電源＋８２は、音声回路の増幅器２、３に
印加されている．この増幅器２はＬチャンネル音声信号
を増幅してコンデンサＣ２を介して出力端子４に出力し
、また増幅器３はＲチャンネル音声信号を増幅してコン
デンサＣ３を介して出力端子５に出力する。This power supply +82 is applied to amplifiers 2 and 3 of the audio circuit. The amplifier 2 amplifies the L channel audio signal and outputs it to the output terminal 4 via the capacitor C2, and the amplifier 3 amplifies the R channel audio signal and outputs it to the output terminal 5 via the capacitor C3.
Ａはミュート信号作成回路であり、トランジスタＱｉ
Ｑ２、抵抗Ｒｌ−Ｒ４、およびダイオードＤ３から構威
され、トランジスタＱｌはベース回路の抵抗Ｒ１とコン
デンサＣ４とから決定される時定数ＴＩによりオンする
。A is a mute signal generation circuit, and transistor Qi
Q2, resistors Rl-R4, and diode D3, and transistor Ql is turned on by a time constant TI determined from resistor R1 of the base circuit and capacitor C4.
Ｂはミュート解除信号作成回路であり、トランジスタＱ
３〜Ｑ５、抵抗Ｒ５〜Ｒ９、およびコンデンサＣ５から
構威され、トランジスタＱ３は抵抗Ｒ５とコンデンサＣ
５とから決定される時定数７２ （＞ＴＩ）によりオ
フする。B is a mute release signal generation circuit, and transistor Q
3 to Q5, resistors R5 to R9, and capacitor C5, and transistor Q3 is composed of resistor R5 and capacitor C5.
It is turned off by a time constant 72 (>TI) determined from 5 and 5.
トランジスタＱ６は上記したミュート信号作成回路Ａの
出力によりオン／オフするトランジスタであり、このト
ランジスタＱ６がオンすると、トランジスタＱ７がオン
して、ミュート用信号をＬチャンネル用ミュートトラン
ジスタＱ８およびＲチャンネル用ミュートトランジスタ
Ｑ９に伝達する．Ｒ１０〜Ｒ１６は抵抗、Ｄ４、Ｄ５は
グイオ一ドである。Transistor Q6 is a transistor that is turned on/off by the output of the above-mentioned mute signal generation circuit A. When transistor Q6 is turned on, transistor Q7 is turned on, and the mute signal is transmitted to L channel mute transistor Q8 and R channel mute. Transmitted to transistor Q9. R10 to R16 are resistors, and D4 and D5 are guides.
さてこの回路では、電源が投入されると十Ｂ１、＋Ｂ２
、−Ｂ２が立ち上がって、＋８１、＋８２の内の最も速
く立ち上がる電源により、ａ点の電圧が上昇しミュート
信号作或回路Ａおよびミュート解除信号作成回路Ｂに電
源が供給される。この結果、トランジスタＱ１のベース
には、時定数ＴＩ （＝ＲＩＸＣ４）とａ点の電圧の
上昇時定数とによって電圧が上昇し、ベース・工ξツタ
間の電位が闇値を越えるとオンする．よって、トランジ
スタＱ２オフ、トランジスタＱ６オンとなって、トラン
ジスタＱ７がオンし、ミュート用トラＱ８、Ｑ９がオン
して、増幅器２、３の出力信号がミュートされる。なお
、このミュート開始までの時間は、数μｓｅｃに設定す
る。Now, in this circuit, when the power is turned on, 10B1, +B2
, -B2 rises, the voltage at point a rises by the power supply that rises fastest among +81 and +82, and power is supplied to the mute signal generation circuit A and the mute release signal generation circuit B. As a result, the voltage at the base of the transistor Q1 increases due to the time constant TI (=RIXC4) and the time constant for increasing the voltage at point a, and the transistor Q1 turns on when the potential between the base and the ivy exceeds the dark value. Therefore, the transistor Q2 is turned off, the transistor Q6 is turned on, the transistor Q7 is turned on, the muting transistors Q8 and Q9 are turned on, and the output signals of the amplifiers 2 and 3 are muted. Note that the time until the start of muting is set to several μsec.
一方、トランジスタＱ３は電源の投入により直ちにオン
する．よって、トランジスタＱ４オン、トランジスタ０
５オフとなり、ミュート信号作成回路Ａには影響を与え
ない。On the other hand, transistor Q3 turns on immediately when the power is turned on. Therefore, transistor Q4 is on and transistor 0 is on.
5 is off, and the mute signal generation circuit A is not affected.
しかし、時定数７２ （＝Ｒ５ｘＣ５）で定まる時間が
経過すると、コンデンサＣ５の電位が所定値を越えて、
そのトランジスタＱ３がオフする。However, after the time determined by time constant 72 (=R5xC5) has passed, the potential of capacitor C5 exceeds the predetermined value.
Its transistor Q3 turns off.
よって、トランジスタＱ４オフ、トランジスタＱ５オン
となって、ミュート信号作或回路ＡのトランジスタＱｌ
がオフして、トランジスタＱ２オン、トランジスタＱ６
オフ、トランジスタＱ７オフとなり、トランジスタＱ８
、Ｑ９がオフとなって、ミュートが解除される。Therefore, the transistor Q4 is turned off and the transistor Q5 is turned on, and the transistor Ql of the mute signal generation circuit A is turned off.
turns off, transistor Q2 turns on, transistor Q6
off, transistor Q7 is off, transistor Q8
, Q9 is turned off, and muting is canceled.
以上の動作により、電源投入から時定数Ｔ２で決まる一
定時間の間、音声信号がミュートされることになる．
なお、ここでは、ミュート解除のためにトランジスタＱ
５によりトランジスタＱ１を制御するようにしたが、そ
のトランジスタＱ５によりトランジスタＱ６を直接制御
することもできる。By the above operation, the audio signal is muted for a certain period of time determined by the time constant T2 after the power is turned on. Note that here, the transistor Q is used to release mute.
Although the transistor Q1 is controlled by the transistor Q5, the transistor Q6 can also be directly controlled by the transistor Q5.
また、ミュート信号作威回路Ａには、電源十Ｂ１、＋Ｂ
２をダイオードＤ１、Ｄ２により供給して、その内の最
も立上りの速い方を利用し゛てミュート信号作威してい
るが、３個以上の電源電圧を使用することもできる。In addition, the mute signal production circuit A has power supplies +B1 and +B1.
2 is supplied by diodes D1 and D2, and the mute signal is generated by using the one of them which rises fastest, but three or more power supply voltages can also be used.
以上から本発明によれば、電源投入時に音声信号がミュ
ートされ、ポップ音の発生等を防止することができる。As described above, according to the present invention, the audio signal is muted when the power is turned on, and it is possible to prevent pop sounds and the like from occurring.
また、複数の電源電圧の内の最も立上りの速い電源によ
りミュート信号作成回路を動作させているので、確実な
ミュートを実行させることができる。Furthermore, since the mute signal generation circuit is operated by the power supply that rises fastest among the plurality of power supply voltages, reliable muting can be performed.
第１図は本発明の一実施例の回路図である。
Ａ・・・ミュート信号作威回路、Ｂ・・・ミュート解除
信号作成回路。FIG. 1 is a circuit diagram of an embodiment of the present invention. A: Mute signal generation circuit, B: Mute release signal generation circuit.
Claims (1)
続したミュート用スイッチング素子と、該ミュート用ス
イッチング素子のオン／オフを制御する制御スイチング
素子と、電源投入直後から上記制御スイッチング素子を
介して上記ミュート用スイッチング素子をオンさせる信
号を出力するミュート信号作成回路と、電源投入時から
所定時間経過後に上記制御スイッチンング素子をして上
記ミュート用スイッチング素子をオフさせる信号を出力
するミュート解除信号作成回路とからなり、複数の電源
ラインの電圧をダイオードで混合して少なくとも上記ミ
ュート信号作成回路に供給したことを特徴とするパワー
オンミュート回路。(1) A mute switching element connected between an audio signal line and one power supply line, a control switching element that controls on/off of the mute switching element, and a control switching element that controls the switching element immediately after power is turned on. a mute signal generation circuit that outputs a signal that turns on the mute switching element through the control switching element; and a mute that outputs a signal that causes the control switching element to turn off the mute switching element after a predetermined time has elapsed from power-on. 1. A power-on mute circuit comprising a release signal generation circuit, the power-on mute circuit comprising a diode to mix the voltages of a plurality of power supply lines and supply the mixture to at least the mute signal generation circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1228262A JPH0392005A (en) | 1989-09-05 | 1989-09-05 | Power-on mute circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1228262A JPH0392005A (en) | 1989-09-05 | 1989-09-05 | Power-on mute circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0392005A true JPH0392005A (en) | 1991-04-17 |
Family
ID=16873719
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1228262A Pending JPH0392005A (en) | 1989-09-05 | 1989-09-05 | Power-on mute circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0392005A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003023322A (en) * | 2001-07-06 | 2003-01-24 | Asahi Kasei Microsystems Kk | Mute circuit |
-
1989
- 1989-09-05 JP JP1228262A patent/JPH0392005A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003023322A (en) * | 2001-07-06 | 2003-01-24 | Asahi Kasei Microsystems Kk | Mute circuit |
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