JPH0377408A - マイクロ波発振回路 - Google Patents

マイクロ波発振回路

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Publication number
JPH0377408A
JPH0377408A JP21373589A JP21373589A JPH0377408A JP H0377408 A JPH0377408 A JP H0377408A JP 21373589 A JP21373589 A JP 21373589A JP 21373589 A JP21373589 A JP 21373589A JP H0377408 A JPH0377408 A JP H0377408A
Authority
JP
Japan
Prior art keywords
dielectric resonator
oscillation circuit
box
recessed part
substrate
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Pending
Application number
JP21373589A
Other languages
English (en)
Inventor
Akira Koizumi
暁 小泉
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Fujitsu General Ltd
Original Assignee
Fujitsu General Ltd
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Publication date
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  • Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、誘電体共振器を有するマイクロ波発振回路に
関する。
〔従来の技術〕
例えば、衛星放送の受信電波を12GHz帯からIGH
z帯に周波数変換するコンバータ内には、ローカル発振
回路としてマイクロ波発振回路が使用される。この回路
は、第2図に示すように、GaAsのFETIのドレイ
ンDを高周波的に接地したドレイン接地形の発振回路と
し、ゲート端子Gからゲート線路2の線路長がQの位置
に円柱形の誘電体共振器3を装荷しその線路2と電磁結
合させて発振周波数を制御し、その発振出力をソース端
子S側から取り出している。4は出力整合回路、5は帰
還回路である。
この回路における誘電体共振器3の共振周波数toは、
それ自身の外径寸法とそれを囲む函体の高さで決定され
る。第3図において、函体10の囲み高さをLl、誘電
体共振器3の厚さをLoとすれば、共振周波数foは、
LoとLlとの比で特徴付けられ、Lo / L、 1
 =一定であれば、f。
は一定である。
一方、従来では第4図に示すように、片面にアースパタ
ーンllaを有し他面に上記線路2等を構成するマイク
ロストリップラインllbを有する誘電体基板11の上
面に、誘電体共振器3を支持合12により支持している
。そして、この発振回路の左右側面ならびに上下面を函
体10で囲っている。誘電体共振器1の下面は、アース
パターン面11aが函体10に接するように取りつけて
いる。なお、上面および左右側面の函体部分は省略した
〔発明が解決しようとする課題〕
従って、前述したように共振周波数foがり。
/Llで決定されることから、その函体10の高さLl
を任意に低くすることはできず、その小型化には限界が
あった。
本発明は以上のような点に鑑みてなされたものであり、
その目的は小型化を実現したマイクロ波発振回路を提供
することである。
〔課題を解決するための手段〕
このために本発明は、誘電体共振器を使用したマイクロ
波発振回路において、上記誘電体共振器を装荷する部分
の基板に切除により凹部を形成して、該凹部に上記誘電
体共振器を装荷して構成した。
この発明において、上記基板の下面の函体部分の一部を
、上記基板の切除部分に連続して切除し、そこに上記誘
電体共振器を装荷することができる。
〔実施例〕
以下、本発明の実施例について説明する。第1図はその
一実施例を示す図である。第4図におけるものと同一の
ものには同一の符号を付した。
本実施例では、誘電体基板11の内の誘電体共振器3に
対応する部分を切り抜いて穴11cを形成し、また函体
10の内の誘電体共振器3に対応する部分を削り込んで
凹部10aを形成して、その凹部10aと穴11cを対
応させ、その底に誘電体共振器3を支持台12により支
持した。
このとき、穴11cと凹部10aとによる切除深さをL
2とし、基板11の上面から函体10の天井面までの距
離をL3とすれば、前述の囲み高さLlとの関係では、 L1=L2+L3             ・・・(
1)に設定する。この結果、囲み高さL3は、L3=L
1−L2            ・・・(2)となっ
て、従来よりもL2だけ低くすることができる。
このように、基板11および函体10の同一部分を切除
することにより、L o/L 1を変化させることなく
、実質的な囲み高さを従来よりもL2だけ低くすること
ができる。
〔発明の効果) 以上説明したように本発明によれば、発振回路の函体囲
み高さを低くすることができ、小型化が可能になるとい
う利点がある。
【図面の簡単な説明】
第1図は本発明の一実施例の発振回路部分の断面図、第
2図は発振回路の回路パターン図、第3図は誘電体共振
器と函体との関係を示す図、第4図は従来の発振回路の
断面図である。 1・・・GaAs形FET、2・・・ゲート線路、3・
・・誘電体共振器、4・・・出力整合回路、5・・・帰
還回路、10・・・函体、10a・・・凹部、1工・・
・誘電体基板、11c・・・穴、12・・・誘電体共振
器支持台。

Claims (2)

    【特許請求の範囲】
  1. (1).誘電体共振器を使用したマイクロ波発振回路に
    おいて、上記誘電体共振器を装荷する部分の基板に切除
    により凹部を形成して、該凹部に上記誘電体共振器を装
    荷したことを特徴とするマイクロ波発振回路。
  2. (2).上記基板の下面の函体部分の一部を、上記基板
    の切除部分に連続して切除し、そこに上記誘電体共振器
    を装荷したことを特徴とする特許請求の範囲第1項記載
    のマイクロ波発振回路。
JP21373589A 1989-08-19 1989-08-19 マイクロ波発振回路 Pending JPH0377408A (ja)

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