JPH0344232A - Ｈｄｌｃ回線のモニタ回路 - Google Patents
Ｈｄｌｃ回線のモニタ回路Info
- Publication number
- JPH0344232A JPH0344232A JP1181203A JP18120389A JPH0344232A JP H0344232 A JPH0344232 A JP H0344232A JP 1181203 A JP1181203 A JP 1181203A JP 18120389 A JP18120389 A JP 18120389A JP H0344232 A JPH0344232 A JP H0344232A
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- Japan
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- pattern
- detection circuit
- data signal
- signal
- control pattern
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- Pending
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- 238000001514 detection method Methods 0.000 claims abstract description 48
- 230000005540 biological transmission Effects 0.000 claims abstract description 6
- 238000010586 diagram Methods 0.000 description 12
- 230000000694 effects Effects 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 238000000605 extraction Methods 0.000 description 1
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- 238000005259 measurement Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Data Exchanges In Wide-Area Networks (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はＨＤＬＣ回線のモニタ回路に関し、特にデータ
端末装置とデータ回線終端装置との接続点に接続して送
信データ信号あるいは受信データ信号の制御パターンの
種別を可視的に表示するＨｌ）ＬＣ回線のモニタ回路に
関する。
端末装置とデータ回線終端装置との接続点に接続して送
信データ信号あるいは受信データ信号の制御パターンの
種別を可視的に表示するＨｌ）ＬＣ回線のモニタ回路に
関する。
従来のＨＤＬＣ回線のモニタ回路は、単に送信データ信
号あるいは受信データ信号の制御パターンの種別を知る
ばかりではなく、先頭のフラグパターンから縦続するフ
レーム信号の内容までモニタ可能な専用の測定器として
提供されているものを使用していた。
号あるいは受信データ信号の制御パターンの種別を知る
ばかりではなく、先頭のフラグパターンから縦続するフ
レーム信号の内容までモニタ可能な専用の測定器として
提供されているものを使用していた。
上述した従来のＨＤＬＣ回線のモニタ回路は、専用の測
定器の形態を威してるので形状や大きさ等も、データ通
信装置内に設置することは考慮されていない、そのため
、データ回線が運用状態になると簡単に測定することが
できず、又５測定各自体も高価になるという問題点があ
る。
定器の形態を威してるので形状や大きさ等も、データ通
信装置内に設置することは考慮されていない、そのため
、データ回線が運用状態になると簡単に測定することが
できず、又５測定各自体も高価になるという問題点があ
る。
本発明の目的は、運用状態時にＨＤＬＣ回線上全線上と
通過する送信データ信号あるいは受信データ信号の制御
パターンを知ることを、簡単な回路で可能とするＨＤＬ
Ｃ回線のモニタ回路を提供することにある。
通過する送信データ信号あるいは受信データ信号の制御
パターンを知ることを、簡単な回路で可能とするＨＤＬ
Ｃ回線のモニタ回路を提供することにある。
本発明のＨＤＬＣ回線のモニタ回路は、ＨＤＬＣ回線の
データ端末装置とデータ回線終端装置との接続点に接続
して前記接続点で定義されている送信データ信号あるい
は受信データ信号とクロック信号とを受信し前記送信デ
ータ信号あるいは受信データ信号のフラグパターンを検
出しこのフラグパターンに縦続するフレーム信号を出力
するフラグパターン検出回路と、前記フラグパターン検
出回路の出力するフレーム信号を受信し前記フレーム信
号に含まれるアドレスパターンを除去し制御パターンの
みを検出し出力する制御パターン検出回路と、前記制御
パターン検出回路の出力する前記制御パターンを受信し
前記制御パターンの種別に対応に設けられた複数の表示
器の１つを動作させてパターンの種別を表示する表示回
路とを有する構成である。
データ端末装置とデータ回線終端装置との接続点に接続
して前記接続点で定義されている送信データ信号あるい
は受信データ信号とクロック信号とを受信し前記送信デ
ータ信号あるいは受信データ信号のフラグパターンを検
出しこのフラグパターンに縦続するフレーム信号を出力
するフラグパターン検出回路と、前記フラグパターン検
出回路の出力するフレーム信号を受信し前記フレーム信
号に含まれるアドレスパターンを除去し制御パターンの
みを検出し出力する制御パターン検出回路と、前記制御
パターン検出回路の出力する前記制御パターンを受信し
前記制御パターンの種別に対応に設けられた複数の表示
器の１つを動作させてパターンの種別を表示する表示回
路とを有する構成である。
次に、本発明の実施例について図面を参照して説明する
。
。
第１図は本発明の一実施例のブロック図である。
フラグパターン検出回路（以下ＦＬＧＤＴＣと記す〉１
は、送信データ信号あるいは受信データ信号（以下デー
タ信号と記す〉とクロック信号とを受信し、データ信号
のフラグパターンを検出し、このフラグパターンに縦続
するフレーム信号を出力する０次段の制御パターン検出
回路（以下ＣＴＬＤＴＣと記す）２は、ＦＬＧＤＴＣＩ
の出力するフレーム信号を受信しこのフレーム信号に含
まれるアドレスパターンを除去し制御パターンのみを検
出する。ＬＥＤ表示回路（以下ＬＥＤＤＳＰと記す〉３
は、ＣＴＬＤＴＣ２の出力する制御パターンを受信しこ
の制御パターンの種別に対応に設けられた複数のＬＥＤ
表示器の１つを動作させてパターンの種別を表示する。
は、送信データ信号あるいは受信データ信号（以下デー
タ信号と記す〉とクロック信号とを受信し、データ信号
のフラグパターンを検出し、このフラグパターンに縦続
するフレーム信号を出力する０次段の制御パターン検出
回路（以下ＣＴＬＤＴＣと記す）２は、ＦＬＧＤＴＣＩ
の出力するフレーム信号を受信しこのフレーム信号に含
まれるアドレスパターンを除去し制御パターンのみを検
出する。ＬＥＤ表示回路（以下ＬＥＤＤＳＰと記す〉３
は、ＣＴＬＤＴＣ２の出力する制御パターンを受信しこ
の制御パターンの種別に対応に設けられた複数のＬＥＤ
表示器の１つを動作させてパターンの種別を表示する。
次に本実施例の動作について説明する。
第２図はフラグパターン検出回路（ＦＬＧＤＴＣ）のブ
ロック図である。
ロック図である。
ＦＬＧＤＴＣ１は、データ信号とクロック信号とを第５
図のデータ信号、クロック信号関係図に示すように、デ
ータの列信号をクロックの立上りエツジで検出し、シリ
アルデータビットとして認識している。最初にデータ信
号とクロック信号とを受信するアボートパターン検出回
路４は、前述のシリアルデータビットの並び方がすべて
「１」であるか否かを検出し、「１」でないデータビッ
トを検出すると、次段のフラグパターン検出回路５に非
アボート状態検出信号を送出する。フラグパターン検出
回路５は、非アボート状態検出信号を受信すると、一連
のシリアルデータビットの並び方を監視し、フラグパタ
ーンを検出する。フラグパターン検出回路５は、フラグ
パターンを検出すると、次段のフレーム検出回路６にフ
ラグパターン検出信号を送出する。フレーム検出回路６
は、データ信号からフレーム信号を切出しＣＴＬＤＴＣ
２に送出する。第６図（ａ）はデータ信号がらフレーム
信号を切出した状態を示している。
図のデータ信号、クロック信号関係図に示すように、デ
ータの列信号をクロックの立上りエツジで検出し、シリ
アルデータビットとして認識している。最初にデータ信
号とクロック信号とを受信するアボートパターン検出回
路４は、前述のシリアルデータビットの並び方がすべて
「１」であるか否かを検出し、「１」でないデータビッ
トを検出すると、次段のフラグパターン検出回路５に非
アボート状態検出信号を送出する。フラグパターン検出
回路５は、非アボート状態検出信号を受信すると、一連
のシリアルデータビットの並び方を監視し、フラグパタ
ーンを検出する。フラグパターン検出回路５は、フラグ
パターンを検出すると、次段のフレーム検出回路６にフ
ラグパターン検出信号を送出する。フレーム検出回路６
は、データ信号からフレーム信号を切出しＣＴＬＤＴＣ
２に送出する。第６図（ａ）はデータ信号がらフレーム
信号を切出した状態を示している。
第３図は制御パターン検出回路（ＣＴＬＤＴＣ）のブロ
ック図である。
ック図である。
ＦＬＧＤＴＣＩから受信したフレーム信号をクロック信
号と同時にアドレスパターン検出回路７に入力する。ア
ドレスパターン検出回路７は、第６図（ｂ）に示される
フレーム信号の中のアドレスパターンを検出し、アドレ
スパターン検出信号を次段の制御パターン検出回路８に
送出する。アドレスパターン検出信号を受信した制御パ
ターン検出回路８は、第６図（ｂ）に示されるように、
フレーム信号の中から制御パターンを切出しＬＥＤＤＳ
Ｐ３に送出する。
号と同時にアドレスパターン検出回路７に入力する。ア
ドレスパターン検出回路７は、第６図（ｂ）に示される
フレーム信号の中のアドレスパターンを検出し、アドレ
スパターン検出信号を次段の制御パターン検出回路８に
送出する。アドレスパターン検出信号を受信した制御パ
ターン検出回路８は、第６図（ｂ）に示されるように、
フレーム信号の中から制御パターンを切出しＬＥＤＤＳ
Ｐ３に送出する。
第４図はＬＥＤ表示回路（ＬＥＤＤＳＰ）のブロック図
である。
である。
ＣＴＬＤＴＣ２から受信した制御パターンを受信したシ
リアルパラレル変換回路９は、第６図（Ｃ）に示される
ように、制御パターンの中の最初の８ｂｉｔを、コント
ロールフィルド信号として次段の制御パターン分類回路
■０にパラレル出力する。コントロールフィルド信号を
受信した制御パターン分類回路１０は、コントロールフ
ィルド信号の第１ ｂｉｔが「０」であるか「１」であ
るがを知り、ｒ□、であればＩフレームであると判断す
る０次にコントロールフィルド信号の第１ ｂｉｔが１
１」であれば、さらに第２ｂｉｔが「Ｏ」であるか「１
」であるかを調べ、「ＯＪであればＳフレームであると
判断し、「１」であればＵフレームであると判断する０
次に前述の結果をエフレーム検出信号か、Ｓフレーム検
出信号か、あるいはＵフレーム検出信号として、それぞ
れの検出信号に対応するＬＥＤに対して表示を行わせる
よう出力する０例えば、第６図（ｃ）は、■フレームの
場合を示す。
リアルパラレル変換回路９は、第６図（Ｃ）に示される
ように、制御パターンの中の最初の８ｂｉｔを、コント
ロールフィルド信号として次段の制御パターン分類回路
■０にパラレル出力する。コントロールフィルド信号を
受信した制御パターン分類回路１０は、コントロールフ
ィルド信号の第１ ｂｉｔが「０」であるか「１」であ
るがを知り、ｒ□、であればＩフレームであると判断す
る０次にコントロールフィルド信号の第１ ｂｉｔが１
１」であれば、さらに第２ｂｉｔが「Ｏ」であるか「１
」であるかを調べ、「ＯＪであればＳフレームであると
判断し、「１」であればＵフレームであると判断する０
次に前述の結果をエフレーム検出信号か、Ｓフレーム検
出信号か、あるいはＵフレーム検出信号として、それぞ
れの検出信号に対応するＬＥＤに対して表示を行わせる
よう出力する０例えば、第６図（ｃ）は、■フレームの
場合を示す。
以上説明したように、本発明は、運用状態時にＨＤＬＣ
回線上を刻々と通過する送信データ信号あるいは受信デ
ータ信号の制御パターンを知ることが簡単な回路で可能
となる効果が有る。
回線上を刻々と通過する送信データ信号あるいは受信デ
ータ信号の制御パターンを知ることが簡単な回路で可能
となる効果が有る。
第１図は本発明の一実施例のブロック図、第２図はフラ
グパターン検出回路（ＦＬＧＤＴＣ）のブロック図、第
３図は制御パターン検出回路（ＣＴＬＪ）ＴＣ）のブロ
ック図、第４図はＬＥＤ表示回路（ＬＥＤＤＳＰ）のブ
ロック図、第５図はデータ信号、クロック信号関係図、
第６図はデータ信号の切出し状況説明図である。 １・・・・・・フラグパターン検出回路（ＦＬＧＤＴＣ
）、２・・・・・・制御パターン検出回路（ＣＴＬＤＴ
Ｃ〉、３・・・・・・ＬＥＤ表示回路（ＬＥＤＤＳＰ）
、４・・・・・・アボートパターン検出回路、５・・・
・・・フラグパターン検出回路、６・・・・・・フレー
ム検出回路、７・・・・・・アドレスパターン検出回路
、８・・・・・・制御パターン検出回路、９・・・・・
・シリアルパラレル変換回路、 Ｏ・・・・・・制御パターン分類回路。
グパターン検出回路（ＦＬＧＤＴＣ）のブロック図、第
３図は制御パターン検出回路（ＣＴＬＪ）ＴＣ）のブロ
ック図、第４図はＬＥＤ表示回路（ＬＥＤＤＳＰ）のブ
ロック図、第５図はデータ信号、クロック信号関係図、
第６図はデータ信号の切出し状況説明図である。 １・・・・・・フラグパターン検出回路（ＦＬＧＤＴＣ
）、２・・・・・・制御パターン検出回路（ＣＴＬＤＴ
Ｃ〉、３・・・・・・ＬＥＤ表示回路（ＬＥＤＤＳＰ）
、４・・・・・・アボートパターン検出回路、５・・・
・・・フラグパターン検出回路、６・・・・・・フレー
ム検出回路、７・・・・・・アドレスパターン検出回路
、８・・・・・・制御パターン検出回路、９・・・・・
・シリアルパラレル変換回路、 Ｏ・・・・・・制御パターン分類回路。
Claims (1)
- ＨＤＬＣ回線のデータ端末装置とデータ回線終端装置と
の接続点に接続して前記接続点で定義されている送信デ
ータ信号あるいは受信データ信号とクロック信号とを受
信し前記送信データ信号あるいは受信データ信号のフラ
グパターンを検出しこのフラグパターンに縦続するフレ
ーム信号を出力するフラグパターン検出回路と、前記フ
ラグパターン検出回路の出力するフレーム信号を受信し
前記フレーム信号に含まれるアドレスパターンを除去し
制御パターンのみを検出し出力する制御パターン検出回
路と、前記制御パターン検出回路の出力する前記制御パ
ターンを受信し前記制御パターンの種別に対応に設けら
れた複数の表示器の１つを動作させてパターンの種別を
表示する表示回路とを有することを特徴とするＨＤＬＣ
回線のモニタ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1181203A JPH0344232A (ja) | 1989-07-12 | 1989-07-12 | Ｈｄｌｃ回線のモニタ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1181203A JPH0344232A (ja) | 1989-07-12 | 1989-07-12 | Ｈｄｌｃ回線のモニタ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0344232A true JPH0344232A (ja) | 1991-02-26 |
Family
ID=16096643
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1181203A Pending JPH0344232A (ja) | 1989-07-12 | 1989-07-12 | Ｈｄｌｃ回線のモニタ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0344232A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9485807B2 (en) | 2008-09-01 | 2016-11-01 | Kurita Water Industries Ltd. | Liquid heating apparatus and liquid heating method |
-
1989
- 1989-07-12 JP JP1181203A patent/JPH0344232A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9485807B2 (en) | 2008-09-01 | 2016-11-01 | Kurita Water Industries Ltd. | Liquid heating apparatus and liquid heating method |
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