JPH0331084Y2 - - Google Patents
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- Publication number
- JPH0331084Y2 JPH0331084Y2 JP7220084U JP7220084U JPH0331084Y2 JP H0331084 Y2 JPH0331084 Y2 JP H0331084Y2 JP 7220084 U JP7220084 U JP 7220084U JP 7220084 U JP7220084 U JP 7220084U JP H0331084 Y2 JPH0331084 Y2 JP H0331084Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- constant voltage
- transistors
- transistor
- collector
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000004065 semiconductor Substances 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 3
- 230000005669 field effect Effects 0.000 description 2
- 230000017525 heat dissipation Effects 0.000 description 2
Landscapes
- Amplifiers (AREA)
Description
【考案の詳細な説明】
この考案は、半導体素子、例えばトランジス
タ、電界効果型トランジスタ等を使用した増幅回
路において前記トランジスタや電界効果型トラン
ジスタの放熱を効率的にした増幅回路に関する。
タ、電界効果型トランジスタ等を使用した増幅回
路において前記トランジスタや電界効果型トラン
ジスタの放熱を効率的にした増幅回路に関する。
（従来の技術）
従来、プリアンプ回路に供給する電源はプリア
ンプ回路に対して直列制御方式の定電圧回路を介
して供給されていた。このようなプリアンプ回路
よび定電圧回路に用いられるトランジスタの放熱
は定電圧回路の被制御用トランジスタや、プリア
ンプ回路の終段のトランジスタにそれぞれ放熱器
を取り付けて行うか、これらトランジスタを同一
の放熱器に取り付けて行われていた。近年、プリ
アンプ回路等々においてもダイナミツクレンジの
拡大、Ｓ／Ｎ比の向上等を計るため終段のトラン
ジスタに大きい電流を流すようになり、このため
放熱器も大きいものが必要になつてきた。
ンプ回路に対して直列制御方式の定電圧回路を介
して供給されていた。このようなプリアンプ回路
よび定電圧回路に用いられるトランジスタの放熱
は定電圧回路の被制御用トランジスタや、プリア
ンプ回路の終段のトランジスタにそれぞれ放熱器
を取り付けて行うか、これらトランジスタを同一
の放熱器に取り付けて行われていた。近年、プリ
アンプ回路等々においてもダイナミツクレンジの
拡大、Ｓ／Ｎ比の向上等を計るため終段のトラン
ジスタに大きい電流を流すようになり、このため
放熱器も大きいものが必要になつてきた。
（考案の目的）
この考案の増幅回路は、叙上の事情に鑑みてな
されたものであり、アンプの性能の向上を計りつ
つ大きくなりつつある放熱器を可及的に小さくす
ることを目的になされたものである。
されたものであり、アンプの性能の向上を計りつ
つ大きくなりつつある放熱器を可及的に小さくす
ることを目的になされたものである。
（考案の構成）
この考案の増幅回路は、定電流のソース電流が
それぞれ並列に供給される定電圧回路とアンプ回
路を具備し、前記定電圧回路の被制御半導体素子
とアンプ回路の終段半導体素子が同一の放熱器に
取り付けられていることを特徴とする。
それぞれ並列に供給される定電圧回路とアンプ回
路を具備し、前記定電圧回路の被制御半導体素子
とアンプ回路の終段半導体素子が同一の放熱器に
取り付けられていることを特徴とする。
第１図および第２図はこの考案の実施例を説明
する回路図である。第１図はソース電流が一つの
場合の実施例を説明し、第２図はソース電流が
＋，−の２電流の場合の実施例を説明するもので
ある。第１図において、符号IL1は定電流のソー
ス電流を示し、符号１は定電圧回路を示し、符号
２はプリアンプ回路を示す。符号Q2は定電圧回
路１の被制御トランジスタ、符号Q3およびQ4は
プリアンプ回路２の終段トランジスタである。ト
ランジスタQ2のコレクタ電流をI2、トランジスタ
Q3のコレクタ電流をI3、トランジスタQ4のコレ
クタ電流をI4とすると、 IL1≒I2＋I3 I3≒I4 なる式が成立する。またトランジスタQ2，Q3，
Q4のコレクタ損失は、 Q2；VCC．I2 Q3；１／２VCC．I3 Q4≒１／２VCC．I4 となるから、トランジスタQ2，Q3，Q4のコレク
タ損失の総和P1は、 P1＝VCC（I2＋１／２I3＋１／２I4） ≒VCC（I2＋I3） ＝VCC．IL1 となり一定の値の損失となる。
する回路図である。第１図はソース電流が一つの
場合の実施例を説明し、第２図はソース電流が
＋，−の２電流の場合の実施例を説明するもので
ある。第１図において、符号IL1は定電流のソー
ス電流を示し、符号１は定電圧回路を示し、符号
２はプリアンプ回路を示す。符号Q2は定電圧回
路１の被制御トランジスタ、符号Q3およびQ4は
プリアンプ回路２の終段トランジスタである。ト
ランジスタQ2のコレクタ電流をI2、トランジスタ
Q3のコレクタ電流をI3、トランジスタQ4のコレ
クタ電流をI4とすると、 IL1≒I2＋I3 I3≒I4 なる式が成立する。またトランジスタQ2，Q3，
Q4のコレクタ損失は、 Q2；VCC．I2 Q3；１／２VCC．I3 Q4≒１／２VCC．I4 となるから、トランジスタQ2，Q3，Q4のコレク
タ損失の総和P1は、 P1＝VCC（I2＋１／２I3＋１／２I4） ≒VCC（I2＋I3） ＝VCC．IL1 となり一定の値の損失となる。
また、第２図において、符号４，５はそれぞれ
定電圧回路を示し、符号６はプリアンプ回路を示
す。そして、定電圧回路４はプリアンプ回路６の
正側の電源を制御し、定電圧回路５はプリアンプ
回路６の負側の電源を制御するように接続してあ
る。符号Q6は定電圧回路４の被制御トランジス
タ、符号Q8は定電圧回路５の被制御トランジス
タ、符号Q9およびQ10はプリアンプ回路６の終段
トランジスタである。トランジスタQ6のコレク
タ電流をI6、トランジスタQ8のコレクタ電流を
I8、トランジスタQ9のコレクタ電流をI9、トラン
ジスタQ10のコレクタ電流をI10とすると、 IL1≒I6＋I9 IL2≒I9＋I10 なる式が成立する。またトランジスタQ6，Q8，
Q9Q10のコレクタ損失は、 Q6；VCC．I6 Q8；VCC．I8 Q9；VCC．I9 Q10；VCC．I10 となるから、トランジスタQ6，Q8，Q9，Q10のコ
レクタ損失の総和P2は、 P2＝VCC（I6＋I8＋I9＋I10） ≒2VCC．IL2 となり一定の値の損失になる。
定電圧回路を示し、符号６はプリアンプ回路を示
す。そして、定電圧回路４はプリアンプ回路６の
正側の電源を制御し、定電圧回路５はプリアンプ
回路６の負側の電源を制御するように接続してあ
る。符号Q6は定電圧回路４の被制御トランジス
タ、符号Q8は定電圧回路５の被制御トランジス
タ、符号Q9およびQ10はプリアンプ回路６の終段
トランジスタである。トランジスタQ6のコレク
タ電流をI6、トランジスタQ8のコレクタ電流を
I8、トランジスタQ9のコレクタ電流をI9、トラン
ジスタQ10のコレクタ電流をI10とすると、 IL1≒I6＋I9 IL2≒I9＋I10 なる式が成立する。またトランジスタQ6，Q8，
Q9Q10のコレクタ損失は、 Q6；VCC．I6 Q8；VCC．I8 Q9；VCC．I9 Q10；VCC．I10 となるから、トランジスタQ6，Q8，Q9，Q10のコ
レクタ損失の総和P2は、 P2＝VCC（I6＋I8＋I9＋I10） ≒2VCC．IL2 となり一定の値の損失になる。
このように、コレクタ損失の総和が一定値にな
ることは、プリアンプ回路に入力する信号の振巾
が例えば大きくなつて終段トランジスタのコレク
タ損失が大きくなると、定電圧回路の被制御トラ
ンジスタのコレクタ損失が小さくなつて相殺され
ることを示している。従つて、放熱器の大きさは
プリアンプ回路の終段トランジスタに流すアイド
リング電流によつて定まるコレクタ損失と定電流
回路の被制御トランジスタに流すアイドリング電
流によつて定まるコレクタ損失とを考慮して設定
すればよいことになる。
ることは、プリアンプ回路に入力する信号の振巾
が例えば大きくなつて終段トランジスタのコレク
タ損失が大きくなると、定電圧回路の被制御トラ
ンジスタのコレクタ損失が小さくなつて相殺され
ることを示している。従つて、放熱器の大きさは
プリアンプ回路の終段トランジスタに流すアイド
リング電流によつて定まるコレクタ損失と定電流
回路の被制御トランジスタに流すアイドリング電
流によつて定まるコレクタ損失とを考慮して設定
すればよいことになる。
（考案の効果）
この考案の増幅回路は、叙上に説明したごと
く、放熱器の大きさはアイドリング電流時のコレ
クタ損失の総和を基準に設定すればよいので、従
来例の、トランジスタのアイドリング電流時のコ
レクタ損失より大きい動作時の最大コレクタ損失
を考慮した放熱器の全体の大きさに較べて大変小
さいものとなり、経済的になる。
く、放熱器の大きさはアイドリング電流時のコレ
クタ損失の総和を基準に設定すればよいので、従
来例の、トランジスタのアイドリング電流時のコ
レクタ損失より大きい動作時の最大コレクタ損失
を考慮した放熱器の全体の大きさに較べて大変小
さいものとなり、経済的になる。
第１図はこの考案の実施例を説明する回路図、
第２図はこの考案の他の実施例を説明する回路図
である。 １，４，５……それぞれ定電圧回路、２，６…
…それぞれアンプ回路、３，７……それぞれ終段
のトランジスタ回路、Q2，Q6，Q8……それぞれ
定電圧回路の被制御トランジスタ、Q3，Q4，Q9，
Q10……それぞれ終段のトランジスタ。
第２図はこの考案の他の実施例を説明する回路図
である。 １，４，５……それぞれ定電圧回路、２，６…
…それぞれアンプ回路、３，７……それぞれ終段
のトランジスタ回路、Q2，Q6，Q8……それぞれ
定電圧回路の被制御トランジスタ、Q3，Q4，Q9，
Q10……それぞれ終段のトランジスタ。
Claims (1)
- 定電流のソース電流がそれぞれ並列に供給され
る定電圧回路とアンプ回路を具備し、前記定電圧
回路の被制御半導体素子とアンプ回路の終段半導
体素子が同一の放熱器に取り付けられていること
を特徴とする増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7220084U JPS60183446U (ja) | 1984-05-16 | 1984-05-16 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7220084U JPS60183446U (ja) | 1984-05-16 | 1984-05-16 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60183446U JPS60183446U (ja) | 1985-12-05 |
| JPH0331084Y2 true JPH0331084Y2 (ja) | 1991-07-01 |
Family
ID=30610393
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7220084U Granted JPS60183446U (ja) | 1984-05-16 | 1984-05-16 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60183446U (ja) |
-
1984
- 1984-05-16 JP JP7220084U patent/JPS60183446U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60183446U (ja) | 1985-12-05 |
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