JPH03273767A - Noise reduction circuit - Google Patents
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Abstract
Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野〉
本発明はビデオ信号等に乗っている微小高域ノイズ等を
低減するノイズ低減回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Object of the Invention] (Industrial Field of Application) The present invention relates to a noise reduction circuit that reduces minute high-frequency noise and the like contained in a video signal and the like.
(従来の技術〉
従来この種のノイズ低減回路は第5図に示したような構
成を有している。即ち、入力映像信号100をバイパス
フィルタ1に通し、このフィルタから得られる前記入力
映像信号100の高域成分200をリミッタ回路2に通
して所定レベル以内の高域雑音成分300を抽出する。(Prior Art) Conventionally, this type of noise reduction circuit has a configuration as shown in FIG. 100 high frequency components 200 are passed through the limiter circuit 2 to extract high frequency noise components 300 within a predetermined level.
この抽出された雑音成分300を減算器3にて、元の映
像信号100から減算して、元の映像信号100に乗っ
ていた高域雑音成分を除去し、前記減算器3からは雑音
成分の無い映像信号400が出力される。This extracted noise component 300 is subtracted from the original video signal 100 in the subtracter 3 to remove the high-frequency noise component on the original video signal 100. A video signal 400 that does not exist is output.
しかし、上記のような従来のノイズ低減回路では以下に
述べるような問題点があった。例えば入力映像信号10
0として第6図(A>に示すようなエツジ部イを含んだ
信号が第5図に示したような回路に入力されたとする。However, the conventional noise reduction circuit as described above has the following problems. For example, input video signal 10
Assume that a signal containing an edge portion A as shown in FIG. 6 (A>) is input to a circuit as shown in FIG.
この様な場合、バイパスフィルタlの出力信号200は
第6図(B)の如くなり、入力映像信号100のエツジ
部イではバイパスフィルタ1の出力信号レベルが大きく
なっている。従って、第6図(B)に示すような高域成
分200がリミッタ回路2に入力されると、その出力信
号300は第6図(C)の如く成り、イ部分で有効な高
域雑音成分が抽出できなくなってしまう。従って、減算
器3にて、第6図(A>に示すような入力映像信号10
0から第6図(C)に示すような雑音成分300を減算
すると、第6図(D)で示すような出力信号が得られ、
エツジ部イの部分ではノイズが含まれたままとなってし
まう問題点があった。In such a case, the output signal 200 of the bypass filter 1 becomes as shown in FIG. 6(B), and the output signal level of the bypass filter 1 is high at the edge part A of the input video signal 100. Therefore, when a high-frequency component 200 as shown in FIG. 6(B) is input to the limiter circuit 2, the output signal 300 becomes as shown in FIG. 6(C), and the effective high-frequency noise component is cannot be extracted. Therefore, in the subtracter 3, the input video signal 10 as shown in FIG.
When a noise component 300 as shown in FIG. 6(C) is subtracted from 0, an output signal as shown in FIG. 6(D) is obtained,
There was a problem in that noise was still included in the edge part A.
第7図は上記問題を回避すべくライン相関を利用して映
像信号からノイズを低減するノイズ低減回路の従来例を
示した図である。入力映像信号100は減算器4と減算
器5に入力される。減算器5のもう一方の入力には減算
器4から出力されるノイズの低減された出力映像信号4
00がLH遅延回路6にて上水平走査期間(IH〉に相
当する時間だけ遅延されて入力される。従って、この減
算器5では入力映像信号100から1H遅延された出力
映像信号400が減算されて、ライン差信号eがリミッ
タ回路7に入力される。このライン差信号eは雑音成分
及び相関の無い映像信号部分から成っており、これがリ
ミッタ回路7を通ることによって映像成分のレベルより
小さいレベルの雑音成分eNだけとなる。このリミッタ
回路7から出力される雑音成分eNは減算器4のもう一
方の入力に出力されるため、減算器4では入力映像信号
100から雑音成分eNが減算され、雑音成分が低減さ
れた映像信号400が出力される。FIG. 7 is a diagram showing a conventional example of a noise reduction circuit that uses line correlation to reduce noise from a video signal in order to avoid the above problem. The input video signal 100 is input to a subtracter 4 and a subtracter 5. The other input of the subtracter 5 receives the noise-reduced output video signal 4 output from the subtracter 4.
00 is input to the LH delay circuit 6 after being delayed by a time corresponding to the upper horizontal scanning period (IH).Therefore, in this subtracter 5, the output video signal 400 delayed by 1H is subtracted from the input video signal 100. Then, the line difference signal e is input to the limiter circuit 7. This line difference signal e consists of a noise component and an uncorrelated video signal part, and by passing through the limiter circuit 7, the line difference signal e is reduced to a level lower than the level of the video component. The noise component eN output from the limiter circuit 7 is output to the other input of the subtracter 4, so the subtracter 4 subtracts the noise component eN from the input video signal 100. A video signal 400 with reduced noise components is output.
この第7図に示すようなノイズ低減回路は上記の如くラ
イン相関を利用するため、前後のラインに相関があると
きは問題がないが、相関が無くなる場合は、減算器4に
て入力映像信号100から雑音以外の映像信号部分を引
いてしまうことがあり、画質を劣化させるという問題点
があった。Since the noise reduction circuit shown in FIG. 7 uses line correlation as described above, there is no problem when there is a correlation between the preceding and succeeding lines, but if there is no correlation, the input video signal is reduced by the subtracter 4. There is a problem that video signal parts other than noise may be subtracted from 100, resulting in deterioration of image quality.
(発明が解決しようとする課題〉
上記の如く、第5図に示したような従来のノイズ低減回
路では、入力映像信号のエツジ部分の雑音を除去するこ
とができないという欠点があり、また第7図に示すよう
なノイズ低減回路は入力映像信号のエツジ部分のノイズ
を低減することはできるが、映像信号にライン相関が無
い場合は、画質劣化を生じてしまうという欠点があった
。(Problems to be Solved by the Invention) As described above, the conventional noise reduction circuit as shown in FIG. Although the noise reduction circuit shown in the figure can reduce the noise in the edge portions of the input video signal, it has the disadvantage of causing image quality deterioration if the video signal has no line correlation.
そこで本発明は上記の欠点を除去するもので、入力映像
信号のエツジ部分の雑音を画質を劣化させることなく除
去することができるノイズ低減回路を提供することを目
的としている
〔発明の構成〕
(課題を解決するための手段〉
本発明は第1の入力信号からの高域信号成分を抽出し、
この抽出された前記高域信号成分の中の所定レベル以下
の信号成分を前記第工の入力信号から減算することによ
り、前記入力信号のノイズ成分を低減する第1のノイズ
低減手段と、前記第1のノイズ低減手段の出力信号を遅
延して前記第2の入力信号とする遅延手段と、第2の入
力信号からライン相関を利用して抽出された所定レベル
以下のライン差信号を前記第2の入力信号から減算する
ことにより、前記第2の入力信号のノイズ成分を低減す
る第2のノイズ低減手段と、前記第工の入力信号から抽
出された高域信号成分の中の所定レベル以上の信号成分
のライン相関部分を検出する検出手段と、この検出手段
により前記ライン相関部分が検出されている期間は前記
第2のノイズ低減手段を動作させてこの手段の出力信号
を最終的なノイズ低減信号とし、前記ライン相関部分が
検出されていない期間は前記遅延手段の出力信号を最終
的なノイズ低減信号とするように切り替える切替手段と
を具備した構成を有する。Therefore, the present invention aims to eliminate the above-mentioned drawbacks, and aims to provide a noise reduction circuit that can remove noise in the edge portion of an input video signal without deteriorating the image quality. Means for Solving the Problems> The present invention extracts a high frequency signal component from a first input signal,
a first noise reduction means for reducing the noise component of the input signal by subtracting a signal component below a predetermined level among the extracted high-frequency signal components from the first input signal; delay means for delaying the output signal of the first noise reduction means to obtain the second input signal; and delay means for delaying the output signal of the first noise reduction means to obtain the second input signal; a second noise reduction means for reducing the noise component of the second input signal by subtracting it from the input signal of the first step; a detection means for detecting a line correlation portion of a signal component; and a period when the line correlation portion is detected by the detection means, the second noise reduction means is operated to perform final noise reduction on the output signal of this means. and switching means for switching the output signal of the delay means to be the final noise reduction signal during a period in which the line correlation portion is not detected.
(作用)
本発明のノイズ低減回路において、遅延手段は第工のノ
イズ低減手段の出力信号を遅延して前記第2の入力信号
とする。検出手段は前記第1の入力信号から抽出された
高域信号成分の中の所定レベル以上の信号成分のライン
相関部分を検出する。切替手段は前記検出手段により前
記ライン相関部分が検出されている期間は前記第2のノ
イズ低減手段を動作させてこの手段の出力信号を最終的
なノイズ低減信号とし、前記ライン相関部分が検出され
ていない期間は前記遅延手段の出力信号を最終的なノイ
ズ低減信号とするように切り替える。(Function) In the noise reduction circuit of the present invention, the delay means delays the output signal of the first noise reduction means and uses it as the second input signal. The detection means detects a line correlation portion of a signal component of a predetermined level or higher among the high frequency signal components extracted from the first input signal. The switching means operates the second noise reduction means during the period when the line correlation portion is detected by the detection means, and uses the output signal of this means as the final noise reduction signal, and the switching means operates the second noise reduction means during the period when the line correlation portion is detected by the detection means. During the period when the noise reduction signal is not set, the output signal of the delay means is switched to be the final noise reduction signal.
(実施例)
以下、本発明の一実施例を図面を参照して説明する。第
1図は本発明のノイズ低減回路の一実施例を示したブロ
ック図である。11は入力映像信号100から高域成分
を抽出するバイパスフィルタ、12は設定レベル以上の
入力信号をカットして前記設定レベル以内の入力信号の
みを出力するリミッタ回路、↑3は入力映像信号100
からリミッタ回fi413の出力信号を減算する減算器
、14は減算器↑3の出力信号を後段の回路の動作に対
して時間合わせを行うべく一定時間遅延する遅延回路、
工5は遅延回路14の出力信号からスイッチ回ff!1
9を介して入力される信号を減算して雑音成分が低減さ
れた映像信号を出力する減算器、16は遅延回路14か
ら出力される信号からLH遅延回路17により1H遅延
された遅延信号を減算してライン差信号eを出力する減
算器、17は減算器15から出力される映像信号を1H
遅延する1H遅延回路、18は前記ライン差信号eの中
の所定レベル以内の信号成分を抽出するリミッタ回路、
工9はリミッタ回路上8の出力信号eN1を減算器15
の一方の入力に入切するスイッチ回路、20はバイパス
フィル11から出力される信号200のレベルが予め決
められた設定値を越えると、ハイレベルの信号を出力す
る相関検出用信号生成回路、21は相関検出用信号生成
回路20の出力信号600からバイパスフィルタ11の
出力信号200で相関がある部分を検出する相関検出回
路である。(Example) Hereinafter, an example of the present invention will be described with reference to the drawings. FIG. 1 is a block diagram showing an embodiment of the noise reduction circuit of the present invention. 11 is a bypass filter that extracts high-frequency components from the input video signal 100; 12 is a limiter circuit that cuts input signals above a set level and outputs only input signals that are within the set level; ↑3 is an input video signal 100
14 is a delay circuit that delays the output signal of the subtracter ↑3 for a certain period of time in order to time-align the operation of the subsequent circuit;
The switch ff! 1
A subtracter 16 subtracts the signal inputted through 9 to output a video signal with reduced noise components; 16 subtracts the delayed signal delayed by 1H by the LH delay circuit 17 from the signal output from the delay circuit 14; A subtracter 17 outputs a line difference signal e by converting the video signal output from the subtracter 15 into 1H.
a 1H delay circuit that delays; 18 a limiter circuit that extracts signal components within a predetermined level from the line difference signal e;
Step 9 subtracts the output signal eN1 of limiter circuit 8 from subtracter 15.
20 is a correlation detection signal generation circuit that outputs a high level signal when the level of the signal 200 output from the bypass filter 11 exceeds a predetermined setting value; 21 is a correlation detection circuit that detects a correlated portion of the output signal 200 of the bypass filter 11 from the output signal 600 of the correlation detection signal generation circuit 20.
こにて゛、バイパスフィルす11、リミッタ回路12及
び減算罷工3は第1のノイズ低減手段を、減算罷工5.
16.1H遅延回路17及びリミッタ回FI!118は
第2のノイズ低減手段を構成し、遅延回B14は遅延手
段を、相関検出用信号生成回路20、相関検出回路2↑
は検出手段を、スイッチ回路19は切替手段を構成して
いる。Here, the bypass filter 11, the limiter circuit 12, and the subtraction block 3 function as the first noise reduction means, and the subtraction block 5.
16.1H delay circuit 17 and limiter times FI! 118 constitutes a second noise reduction means, a delay circuit B14 constitutes a delay means, a correlation detection signal generation circuit 20, a correlation detection circuit 2↑
constitutes a detection means, and the switch circuit 19 constitutes a switching means.
次に本実施例の動作について説明する。ます入力映像信
号〈ここでは輝度信号〉100はバイパスフィルタ11
及び減算器13に入力される。バイパスフィルター1は
入力映像信号100から高域信号成分200を抽出して
、これをリミッタ回路12に出力する。リミッタ回路1
2は入力される高域信号成分200の中で、予め設定さ
れているリミッタレベルL1より小さいレベルの信号3
00を抽出して、これを減算器13の一方の入力に出力
する。この減算器13の他方の入力には前述の如く入力
映像信号100が入力されるため、ここで、入力映像信
号100からリミッタ回路12の出力信号300が減算
され、得られた出力信号は遅延回路14に入力される。Next, the operation of this embodiment will be explained. The input video signal (luminance signal here) 100 is the bypass filter 11
and is input to the subtracter 13. The bypass filter 1 extracts a high frequency signal component 200 from the input video signal 100 and outputs it to the limiter circuit 12. Limiter circuit 1
2 is a signal 3 whose level is lower than the preset limiter level L1 among the input high frequency signal components 200.
00 is extracted and outputted to one input of the subtracter 13. Since the input video signal 100 is input to the other input of this subtracter 13 as described above, the output signal 300 of the limiter circuit 12 is subtracted from the input video signal 100, and the obtained output signal is sent to the delay circuit. 14.
遅延回路14にて所定時間遅延された遅延信号500は
減算器15及び減算器16に入力される。但し、この遅
延信号500はそのエツジ部分を除いて高域ノイズ成分
が低減されている。A delayed signal 500 delayed by a predetermined time in the delay circuit 14 is input to a subtracter 15 and a subtracter 16 . However, the high-frequency noise components of this delayed signal 500 are reduced except for its edge portions.
この減算器16の他方の入力には、減算器↑5の出力信
号400がIH遅延回路17によりLH遅延されて入力
されるため、ここで、遅延信号500からLH遅延回路
17から出力される信号が減算され、その結果であるラ
イン差信号e1をリミッタ回818に出力する。リミッ
タ回路18は入力信号の中でレベルL1以内の信号eN
1をスイッチ回路19へ出力する。Since the output signal 400 of the subtracter ↑5 is delayed by LH by the IH delay circuit 17 and input to the other input of the subtracter 16, here, the signal output from the LH delay circuit 17 is input from the delayed signal 500. is subtracted, and the resulting line difference signal e1 is output to the limiter circuit 818. The limiter circuit 18 outputs a signal eN within level L1 among the input signals.
1 is output to the switch circuit 19.
ここで、バイパスフィルタ11から出力された高域成分
200は相関検出用信号生成回F#I20に入力される
。この相関検出用信号生成回路20は前記入力信号20
0が予め設定されている基準レベルL2を越えると、ハ
イレベルの信号を相関検出回路21に出力し、越えてい
ないときはローレベルの信号を相関検出回路21に出力
する。尚、0
基準レベルL2はリミッタ回路18のリミッタレベルL
1と同じか、或いはこのリミッタレベルL1より小さく
設定される。Here, the high frequency component 200 output from the bypass filter 11 is input to the correlation detection signal generation circuit F#I20. This correlation detection signal generation circuit 20 uses the input signal 20
When 0 exceeds a preset reference level L2, a high level signal is output to the correlation detection circuit 21, and when it does not exceed it, a low level signal is output to the correlation detection circuit 21. Note that the 0 reference level L2 is the limiter level L of the limiter circuit 18.
1 or set lower than this limiter level L1.
この相関検出用信号生成回路20にてハイレベルの信号
が生成される過程を第2図を参照して更に詳細に説明す
る。入力映像信号100が第2図(A>に示すような波
形を有していると、バイパスフィルタ11の出力信号は
第2図(B)に示す如くなり、このような波形の信号が
相関検出用信号生成回路20に入力されることになる。The process of generating a high level signal in the correlation detection signal generation circuit 20 will be explained in more detail with reference to FIG. When the input video signal 100 has a waveform as shown in FIG. 2 (A>), the output signal of the bypass filter 11 becomes as shown in FIG. 2 (B), and a signal with such a waveform is used for correlation detection. This signal is input to the signal generation circuit 20 for use.
従って、相関検出用信号検出回路20は前記第2図(B
)に示した信号200がレベルL2を越えた区間で第2
図(D>に示す如くハイレベルの信号600を生成して
、これを相関検出回路21に出力する。Therefore, the signal detection circuit 20 for correlation detection is as shown in FIG.
) in the section where the signal 200 exceeds the level L2.
A high-level signal 600 is generated as shown in FIG.
尚、この場合の減算器13からの出力信号は第2図(C
)に示すような波形となり、エツジ部イではノイズ成分
が低減されていないことがわかる。Note that the output signal from the subtractor 13 in this case is shown in Fig. 2 (C
), and it can be seen that the noise component is not reduced at edge part A.
一方、相関検出回路21は第3図に示す如く、LH遅延
回路201とアンド回路202から戒っている。このた
め、相関検出用信号検出回路201
から入力される第4図(A>で示したような信号600
はIH遅延回路201とアンド回路202の一方の入力
に入力される。アンド回路202の他方の入力には1H
遅延回路201にてLH遅延された信号600が入力さ
れるため、例えばこのLH遅延された信号600が第4
図(B)に示したようなものであれば、これら信号の相
関がある期間中、アンド回路202のアンド条件が成立
して第4図(C)に示すようなハイレベルの制御信号M
がアンド回路202からスイッチ回路1つに出力される
。ところで、スイッチ回路19は入力される制御信号M
がローレベルの間は開路しており、ハイレベルの期間は
閉路するように動作する。On the other hand, the correlation detection circuit 21 is connected to an LH delay circuit 201 and an AND circuit 202, as shown in FIG. Therefore, the signal 600 as shown in FIG.
is input to one input of the IH delay circuit 201 and the AND circuit 202. The other input of the AND circuit 202 is 1H.
Since the LH-delayed signal 600 is input to the delay circuit 201, for example, this LH-delayed signal 600 is
If it is as shown in FIG. 4(B), during the period when these signals are correlated, the AND condition of the AND circuit 202 is satisfied and the high level control signal M as shown in FIG. 4(C) is generated.
is output from the AND circuit 202 to one switch circuit. By the way, the switch circuit 19 receives the input control signal M
The circuit is open while the signal is at a low level, and the circuit is closed while the signal is at a high level.
従って、バイパスフィルタ11の出力信号200に相関
がある期間、即ち第2図のイで示した入力映像信号のエ
ツジ部分では、スイッチ回路1つは閉路されるため、リ
ミッタ回路18から出力される雑音成分eN1がスイッ
チ回路1つを介して減算器15の他方の入力に出力され
る。Therefore, during a period in which the output signal 200 of the bypass filter 11 has a correlation, that is, at the edge portion of the input video signal shown in FIG. Component eN1 is output to the other input of subtracter 15 via one switch circuit.
従って、前記映像信号100のエツジ部分では2
遅延回路14から出力された遅延信号500からエツジ
部分の雑音成分eN1が減算され、エツジ部分の雑音も
低減された映像信号400がこの減算器15から出力さ
れる。しかも、入力映像信号100のエツジ部であって
もライン相関が無い場合、或いは前記エツジ部以外の信
号部分では、スイッチ回路19が開路しているため、減
算器15は遅延信号500から何も減算しないで、この
遅延信号500をそのまま映像信号400として出力す
ることになる。Therefore, at the edge portion of the video signal 100, the noise component eN1 at the edge portion is subtracted from the delayed signal 500 output from the delay circuit 14, and the video signal 400 with the noise at the edge portion also reduced is output from the subtracter 15. be done. Furthermore, if there is no line correlation even at the edge portion of the input video signal 100, or in a signal portion other than the edge portion, the switch circuit 19 is open, so the subtracter 15 subtracts nothing from the delayed signal 500. Instead, this delayed signal 500 is output as is as the video signal 400.
本実施例によれば、入力映像信号100に載っているノ
イズ成分の大部分はバイパスフィルタ11、リミッタ回
路12、減算器13から成る第1のノイズ低減手段にて
取り除き、入力映像信号のエツジ部で相関がある場合の
み、減算器15゜16.1H遅延回路17、リミッタ回
路18から戒るライン相関を利用した第2のノイズ低減
手段を働かせて、前段のノイズ低減手段では取り切れな
かった入力映像信号のエツジ部に残っているノイズ成分
を取り除くため、入力映像信号100に3
乗っている全ての雑音成分を低減することができると共
に、後段のライン相関を利用したノイズ低減手段は、入
力映像信号のエツジ部で且つライン相関がある場合のみ
働くため、入力映像信号100の低レベル部分における
映像信号のデイティールの除去を防止し、画質の劣化を
防止することができる。According to this embodiment, most of the noise components included in the input video signal 100 are removed by the first noise reduction means consisting of the bypass filter 11, the limiter circuit 12, and the subtracter 13, and the edge portions of the input video signal are removed. Only when there is a correlation, the second noise reduction means using the line correlation detected by the subtracter 15° 16.1H delay circuit 17 and limiter circuit 18 is activated, and the input that could not be removed by the previous noise reduction means is activated. In order to remove noise components remaining at the edge portions of the video signal, all the noise components superimposed on the input video signal 100 can be reduced. Since it works only at the edge portion of the signal and when there is a line correlation, it is possible to prevent details of the video signal from being removed in the low level portion of the input video signal 100 and to prevent deterioration of image quality.
以上記述した如く本発明のノイズ低減回路によれば、入
力映像信号のエツジ部分の雑音を画質を劣化させること
なく除去することができる。As described above, according to the noise reduction circuit of the present invention, it is possible to remove the noise in the edge portion of the input video signal without deteriorating the image quality.
第1図は本発明のノイズ低減回路の一実施例を示したブ
ロック図、第2図は第1図に示した相関検出用信号生成
回路の信号生成過程を説明する波形図、第3図は第1図
に示した相関検出回路の詳細例を示した図、第4図は第
1図及び第3図に示した相関検出回路の動作を説明する
波形図、第5図は従来のノイズ低減回路の一例を示した
ブロック図、第6図は第5図に示した回路の動作を説4
明する波形図、第7図は従来のノイズ低減回路の他の例
を示したブロック図である。
工1・・・バイパスフィルタ
12・・・リミッタ回路
13.16・・・減算器
14・・・遅延回路
17・・・LH遅延回路
18・・・リミッタ回路
工9・・・スイッチ回路
20・・・相関検出用信号生成回路
21・・・相関検出回路FIG. 1 is a block diagram showing an embodiment of the noise reduction circuit of the present invention, FIG. 2 is a waveform diagram explaining the signal generation process of the correlation detection signal generation circuit shown in FIG. 1, and FIG. Figure 4 is a diagram showing a detailed example of the correlation detection circuit shown in Figure 1, Figure 4 is a waveform diagram explaining the operation of the correlation detection circuit shown in Figures 1 and 3, and Figure 5 is a conventional noise reduction method. A block diagram showing an example of the circuit, FIG. 6 is a waveform diagram explaining the operation of the circuit shown in FIG. 5, and FIG. 7 is a block diagram showing another example of the conventional noise reduction circuit. . Engineering 1...Bypass filter 12...Limiter circuit 13.16...Subtractor 14...Delay circuit 17...LH delay circuit 18...Limiter circuit Engineering 9...Switch circuit 20...・Correlation detection signal generation circuit 21...Correlation detection circuit
Claims (1)
された前記高域信号成分の中の所定レベル以下の信号成
分を前記第1の入力信号から減算することにより、前記
入力信号のノイズ成分を低減する第1のノイズ低減手段
と、前記第1のノイズ低減手段の出力信号を遅延して前
記第2の入力信号とする遅延手段と、第2の入力信号か
らライン相関を利用して抽出された所定レベル以下のラ
イン差信号を前記第2の入力信号から減算することによ
り、前記第2の入力信号のノイズ成分を低減する第2の
ノイズ低減手段と、前記第一の入力信号から抽出された
高域信号成分の中の所定レベル以上の信号成分のライン
相関部分を検出する検出手段と、この検出手段により前
記ライン相関部分が検出されている期間は前記第2のノ
イズ低減手段を動作させてこの手段の出力信号を最終的
なノイズ低減信号とし、前記ライン相関部分が検出され
ていない期間は前記遅延手段の出力信号を最終的なノイ
ズ低減信号とするように切り替える切替手段とを具備し
たことを特徴とするノイズ低減回路。By extracting a high-frequency signal component from a first input signal and subtracting a signal component below a predetermined level from the extracted high-frequency signal component, a first noise reduction means for reducing noise components; a delay means for delaying the output signal of the first noise reduction means to obtain the second input signal; and a line correlation from the second input signal. a second noise reduction means for reducing a noise component of the second input signal by subtracting a line difference signal below a predetermined level extracted from the second input signal; a detection means for detecting a line correlation portion of a signal component having a predetermined level or higher among the high frequency signal components extracted from the high frequency signal component; and a period during which the line correlation portion is detected by the detection means, the second noise reduction means. switching means for switching to operate the output signal of the means to make the output signal of the means a final noise reduction signal, and to use the output signal of the delay means as the final noise reduction signal during a period in which the line correlation portion is not detected; A noise reduction circuit characterized by comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2072129A JPH03273767A (en) | 1990-03-23 | 1990-03-23 | Noise reduction circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2072129A JPH03273767A (en) | 1990-03-23 | 1990-03-23 | Noise reduction circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03273767A true JPH03273767A (en) | 1991-12-04 |
Family
ID=13480389
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2072129A Pending JPH03273767A (en) | 1990-03-23 | 1990-03-23 | Noise reduction circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03273767A (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58135269A (en) * | 1981-10-15 | 1983-08-11 | ヨ−ゼフ・ガルトナ−・アンド・カンパニ− | Method of installing curtain wall and wall element used therein |
-
1990
- 1990-03-23 JP JP2072129A patent/JPH03273767A/en active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58135269A (en) * | 1981-10-15 | 1983-08-11 | ヨ−ゼフ・ガルトナ−・アンド・カンパニ− | Method of installing curtain wall and wall element used therein |
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