JPH0313117A - ９０度位相差信号発生集積回路装置 - Google Patents
９０度位相差信号発生集積回路装置Info
- Publication number
- JPH0313117A JPH0313117A JP14915589A JP14915589A JPH0313117A JP H0313117 A JPH0313117 A JP H0313117A JP 14915589 A JP14915589 A JP 14915589A JP 14915589 A JP14915589 A JP 14915589A JP H0313117 A JPH0313117 A JP H0313117A
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- Japan
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- flip
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- 239000003990 capacitor Substances 0.000 claims abstract description 15
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 4
- 239000004065 semiconductor Substances 0.000 abstract description 6
- 239000000758 substrate Substances 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 8
- 230000000694 effects Effects 0.000 description 3
- 230000000903 blocking effect Effects 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 230000008054 signal transmission Effects 0.000 description 1
Landscapes
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はマイクロ波通信装置における直交位相変復調器
の搬送波信号に用いられる９０度位相差信号発生回路に
関し、特に半導体基板に集積化した集積回路装置に関す
る。
の搬送波信号に用いられる９０度位相差信号発生回路に
関し、特に半導体基板に集積化した集積回路装置に関す
る。
〔従来の技術］
従来、この種の９０度位相差信号発生回路として、ハイ
ブリッド・トランスや、コイルとコンデンサによる低域
ろ波器型の位相遅延素子が用いられてきた。また、他の
回路として、Ｄフリップフロップのような順序動作の論
理回路を組合わせることにより入力クロック周期の４倍
の周期に対し四分の一周期の時間差を有する二列の信号
、即ち９０度位相差信号を得るこものが提案されている
。
ブリッド・トランスや、コイルとコンデンサによる低域
ろ波器型の位相遅延素子が用いられてきた。また、他の
回路として、Ｄフリップフロップのような順序動作の論
理回路を組合わせることにより入力クロック周期の４倍
の周期に対し四分の一周期の時間差を有する二列の信号
、即ち９０度位相差信号を得るこものが提案されている
。
上述した回路装置のうち、前者のものは半導体基板上に
集積化することが不可能であり、量産効果によって低価
格化することが困難である。一方、後者のものは半導体
集積回路化に適するが、搬送波周波数の４倍周波数を信
号源が必要であり、しかも通常の論理回路ではマイクロ
波通信のＩＦ周波数に用いられるＶＨＦ帯のような高周
波での動作が困難であるという問題がある。
集積化することが不可能であり、量産効果によって低価
格化することが困難である。一方、後者のものは半導体
集積回路化に適するが、搬送波周波数の４倍周波数を信
号源が必要であり、しかも通常の論理回路ではマイクロ
波通信のＩＦ周波数に用いられるＶＨＦ帯のような高周
波での動作が困難であるという問題がある。
本発明はこれらの問題を解消し、マイクロ波帯での使用
に適した集積化した９０度位相差信号発生集積回路装置
を提供することを目的とする。
に適した集積化した９０度位相差信号発生集積回路装置
を提供することを目的とする。
〔課題を解決するための手段］
本発明の９０度位相差信号発生集積回路装置は、２つの
入力端を導通させて入力端子とした第１のアナログ乗算
器と、この第１のアナログ乗算器の出力がコンデンサを
介して２つの入力端に入力される第２のアナログ乗算器
と、この第２のアナログ乗算器の出力がコンデンサを介
してクロック入力端子にそれぞれ入力される第１及び第
２の０７９９７７０７１回路とで構成している。
入力端を導通させて入力端子とした第１のアナログ乗算
器と、この第１のアナログ乗算器の出力がコンデンサを
介して２つの入力端に入力される第２のアナログ乗算器
と、この第２のアナログ乗算器の出力がコンデンサを介
してクロック入力端子にそれぞれ入力される第１及び第
２の０７９９７７０７１回路とで構成している。
そして、第１及び第２の０７９９７７０７１回路の出力
をそれぞれ第１出力、第２出力とすると共に、第１の０
７９９７７０７１回路の出力を第２の０７９９７７０７
１回路の人力とし、かつ第２の０７９９７７０７１回路
の逆極性出力を第１の０７９９７７０７１回路の入力と
して接続を行っている。
をそれぞれ第１出力、第２出力とすると共に、第１の０
７９９７７０７１回路の出力を第２の０７９９７７０７
１回路の人力とし、かつ第２の０７９９７７０７１回路
の逆極性出力を第１の０７９９７７０７１回路の入力と
して接続を行っている。
この構成によれば、第１及び第２のアナログ乗算器によ
り入力の４倍周波数信号が得られ、この信号を利用する
ことで第１及び第２Ｄフリツプフロツプ回路により、９
０度位相差信号が得られる。
り入力の４倍周波数信号が得られ、この信号を利用する
ことで第１及び第２Ｄフリツプフロツプ回路により、９
０度位相差信号が得られる。
次に、本発明を図面を参照して説明する。
第１図は本発明の一実施例のブロック図である。
図において、１はＸ、Ｙ２つの入力端を導通させて入力
端子とした第１のアナログ乗算器、２は前記第１のアナ
ログ乗算器１の出力がコンデンサ５を介してＸ、Ｙの２
つの入力端に入力される第２のアナログ乗算器、３及び
４は前記第２のアナログ乗算器２の出力がコンデンサ６
を介してクロック入力端子にそれぞれ入力される第１及
び第２の０７９９７７０７１回路である。
端子とした第１のアナログ乗算器、２は前記第１のアナ
ログ乗算器１の出力がコンデンサ５を介してＸ、Ｙの２
つの入力端に入力される第２のアナログ乗算器、３及び
４は前記第２のアナログ乗算器２の出力がコンデンサ６
を介してクロック入力端子にそれぞれ入力される第１及
び第２の０７９９７７０７１回路である。
そして、前記第１及び第２の０２９７１７０７１回路３
．４の各出力をそれぞれ第１出力、第２出力とすると共
に、第１の０２９７１７０７１回路３の出力Ｑを第２の
Ｄフリップフロップ回路４の入力とし、また第２のＤフ
リップフロップ回路４の逆極性出力ｑを第１の０２９７
１７０７１回路３の入力として構成している。
．４の各出力をそれぞれ第１出力、第２出力とすると共
に、第１の０２９７１７０７１回路３の出力Ｑを第２の
Ｄフリップフロップ回路４の入力とし、また第２のＤフ
リップフロップ回路４の逆極性出力ｑを第１の０２９７
１７０７１回路３の入力として構成している。
この構成によれば、第１のアナログ乗算器１のＸ及びＹ
入力端子に印加された入力信号周波数の２倍の周波数信
号が出力端子Ｏに得られる。入力信号が同相極性を有す
るので第２図に示すように出力振幅のピーク値だけ直流
動作点が変移する。
入力端子に印加された入力信号周波数の２倍の周波数信
号が出力端子Ｏに得られる。入力信号が同相極性を有す
るので第２図に示すように出力振幅のピーク値だけ直流
動作点が変移する。
コンデンサ５はレベル変化に起因する動作点の変動を除
くために直流分を阻止する。
くために直流分を阻止する。
同様にして、第２のアナログ乗算器２の出力端子０に更
に２倍された４倍周波数信号が得られ、コンデンサ６で
直流分が阻止される。これにより、第１及び第２の０２
９７１７０７１回路３，４のクロック入力端子に印加さ
れた信号周期だけ時間差を有する４倍周期の信号、即ち
９０度位相差信号が第１出力及び第２出力に得られる。
に２倍された４倍周波数信号が得られ、コンデンサ６で
直流分が阻止される。これにより、第１及び第２の０２
９７１７０７１回路３，４のクロック入力端子に印加さ
れた信号周期だけ時間差を有する４倍周期の信号、即ち
９０度位相差信号が第１出力及び第２出力に得られる。
なお、実際にはコンデンサ５．６で結合した後、抵抗ブ
リーダ回路等により次段に直流定常バイアスを印加する
ことが必要とされるが、図示は省略している。
リーダ回路等により次段に直流定常バイアスを印加する
ことが必要とされるが、図示は省略している。
第３図は本発明の第２実施例のブロック図である。
この実施例では、第１及び第２のアナログ乗算器ＩＡ、
２Ａ及び第１及び第２のＤフリップフロップ回路３Ａ、
４Ａの接続は差動両相接続となっている。なお、５Ａ、
６Ａはコンデンサである。
２Ａ及び第１及び第２のＤフリップフロップ回路３Ａ、
４Ａの接続は差動両相接続となっている。なお、５Ａ、
６Ａはコンデンサである。
この実施例では、第１のアナログ乗算器ＩＡの出力波形
は第４図に示すようになり、第１実施例と同様に直流阻
止コンデンサを必要とする。また、ここでは信号の授受
を差動両相相続とすることにより、コレクタ負荷抵抗に
加わる電圧振幅を半分にしても実質的に論理振幅は等化
であり、小電流で高速動作が可能となる。
は第４図に示すようになり、第１実施例と同様に直流阻
止コンデンサを必要とする。また、ここでは信号の授受
を差動両相相続とすることにより、コレクタ負荷抵抗に
加わる電圧振幅を半分にしても実質的に論理振幅は等化
であり、小電流で高速動作が可能となる。
これにより、第１実施例では高速性を得るためにＥＣＬ
回路でコレクタ負荷抵抗の抵抗値を低くしてコレクタ容
量効果を低減し、したがって論理振幅を維持するために
比較的大きな電流を必要としているが、この第２実施例
ではこれが要求されることはない。
回路でコレクタ負荷抵抗の抵抗値を低くしてコレクタ容
量効果を低減し、したがって論理振幅を維持するために
比較的大きな電流を必要としているが、この第２実施例
ではこれが要求されることはない。
なお、第３回に示した差動画相人出力形式のアナログ乗
算器ＩＡ、２Ａの具体的回路例を第５図に示す。同様に
、Ｄフリップフロラ１回路３Ａ。
算器ＩＡ、２Ａの具体的回路例を第５図に示す。同様に
、Ｄフリップフロラ１回路３Ａ。
４Ａの例を第６図に示す。これらの図において、Ｑはト
ランジスタ、Ｄはダイオード、Ｉは定電流源、Ｒは抵抗
を示す。
ランジスタ、Ｄはダイオード、Ｉは定電流源、Ｒは抵抗
を示す。
また、これらの回路素子は何れも半導体基板上に容易に
集積化することが可能である。
集積化することが可能である。
（発明の効果〕
以上説明したように本発明は、第１及び第２のアナログ
乗算器により入力の４倍周波数信号を得るとともに、こ
の信号を利用して第１及び第２Ｄフリンブフロツプ回路
により９０度位相差信号を得ているので、半導体基板上
への集積化が可能となり、小型化及び量産化を可能とす
る。また、差動両相接続構造とすることにより、小電流
でＶＨＦ帯まで動作可能な高速性を得ることができる。
乗算器により入力の４倍周波数信号を得るとともに、こ
の信号を利用して第１及び第２Ｄフリンブフロツプ回路
により９０度位相差信号を得ているので、半導体基板上
への集積化が可能となり、小型化及び量産化を可能とす
る。また、差動両相接続構造とすることにより、小電流
でＶＨＦ帯まで動作可能な高速性を得ることができる。
第１図は本発明の第１実施例のブロック図、第２図はそ
の回路一部の信号波形図、第３図は本発明の第２実施例
のブロック図、第４図はその回路一部の信号波形図、第
５図は差動画相入出力形弐のアナログ乗算器の回路図、
第６図は差動画相入出力形弐のＤフリップフロップ回路
の回路図である。 １、ＩＡ・・・第１のアナログ乗算器、２，２Ａ・・・
第２のアナログ乗算器、′３．３Ａ・・・第１のフリッ
プフロップ回路、４，４Ａ・・・第２のフリソプフロッ
７’ 回１．５．５Ａ・・・コンデンサ、６．６Ａ・・
・コンデンサ。
の回路一部の信号波形図、第３図は本発明の第２実施例
のブロック図、第４図はその回路一部の信号波形図、第
５図は差動画相入出力形弐のアナログ乗算器の回路図、
第６図は差動画相入出力形弐のＤフリップフロップ回路
の回路図である。 １、ＩＡ・・・第１のアナログ乗算器、２，２Ａ・・・
第２のアナログ乗算器、′３．３Ａ・・・第１のフリッ
プフロップ回路、４，４Ａ・・・第２のフリソプフロッ
７’ 回１．５．５Ａ・・・コンデンサ、６．６Ａ・・
・コンデンサ。
Claims (1)
- １、２つの入力端を導通させて入力端子とした第１のア
ナログ乗算器と、この第１のアナログ乗算器の出力がコ
ンデンサを介して２つの入力端に入力される第２のアナ
ログ乗算器と、この第２のアナログ乗算器の出力がコン
デンサを介してクロック入力端子にそれぞれ入力される
第１及び第２のＤフリップフロップ回路とを備え、これ
ら第１及び第２のＤフリップフロップ回路の出力をそれ
ぞれ第１出力、第２出力とすると共に、第１のＤフリッ
プフロップ回路の出力を第２のＤフリップフロップ回路
の入力とし、かつ第２のＤフリップフロップ回路の逆極
性出力を第１のＤフリップフロップ回路の入力として構
成したことを特徴とする９０度位相差信号発生集積回路
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14915589A JPH0313117A (ja) | 1989-06-12 | 1989-06-12 | ９０度位相差信号発生集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14915589A JPH0313117A (ja) | 1989-06-12 | 1989-06-12 | ９０度位相差信号発生集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0313117A true JPH0313117A (ja) | 1991-01-22 |
Family
ID=15468992
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14915589A Pending JPH0313117A (ja) | 1989-06-12 | 1989-06-12 | ９０度位相差信号発生集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0313117A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07283842A (ja) * | 1994-04-13 | 1995-10-27 | Nec Corp | 位相変調器集積回路 |
| JP2009159597A (ja) * | 2007-12-26 | 2009-07-16 | Dongbu Hitek Co Ltd | １／４周期遅延クロック発生器 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5673995A (en) * | 1979-11-20 | 1981-06-19 | Matsushita Electric Ind Co Ltd | Phase shift circuit |
| JPS63144459A (ja) * | 1986-12-09 | 1988-06-16 | Canon Inc | ４逓倍復調装置 |
-
1989
- 1989-06-12 JP JP14915589A patent/JPH0313117A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5673995A (en) * | 1979-11-20 | 1981-06-19 | Matsushita Electric Ind Co Ltd | Phase shift circuit |
| JPS63144459A (ja) * | 1986-12-09 | 1988-06-16 | Canon Inc | ４逓倍復調装置 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07283842A (ja) * | 1994-04-13 | 1995-10-27 | Nec Corp | 位相変調器集積回路 |
| JP2009159597A (ja) * | 2007-12-26 | 2009-07-16 | Dongbu Hitek Co Ltd | １／４周期遅延クロック発生器 |
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