JPH0294874A - Crt display device - Google Patents
Crt display deviceInfo
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- JPH0294874A JPH0294874A JP63246130A JP24613088A JPH0294874A JP H0294874 A JPH0294874 A JP H0294874A JP 63246130 A JP63246130 A JP 63246130A JP 24613088 A JP24613088 A JP 24613088A JP H0294874 A JPH0294874 A JP H0294874A
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Abstract
Description
【発明の詳細な説明】
［発明の１−１的］
（産業上の利用分野）
この発明は、例えばテレビジクン受像機のようなＣＲ’
ｌ’表示装置に係り、特に画質補止ず段の改良に関する
。Detailed Description of the Invention [1-1 of the Invention] (Industrial Application Field) This invention is applicable to CR's such as TV receivers.
The present invention relates to l' display devices, and particularly to improvements in image quality.
（従来の技術）
ｊＸＬ米のＣＲＴ表示装置の表示部は第５図に示Ｊにう
な断面を有する。第５図（ａ）において、１１ｉ、ＩＣ
ＲＴのカソードからＣＲＴ表面の蛍光体に：ｉ′またる
べく偏向及び加速きれた７ｕ子ビームである。(Prior Art) The display section of the XL CRT display device has a curvilinear cross section as shown in FIG. In FIG. 5(a), 11i, IC
This is a 7u beam that has been deflected and accelerated as far as i' from the cathode of the RT to the phosphor on the surface of the CRT.
この電子ビーム１１はシャドウマスク１２に当たり、一
部はシャドウマスク１２の透孔を通過して蛍光体Ｉ３に
当たり、フェイスプレートガラス１４を通してＩＪ ｒ
見光線となる。尚、各蛍光体１３の間にはＣＲＴ表示画
像のコントラスト
マトリクスＩ５が配置される。This electron beam 11 hits the shadow mask 12, a part of which passes through the hole in the shadow mask 12 and hits the phosphor I3, and passes through the face plate glass 14 to the IJ r
It becomes a sight line. Note that a contrast matrix I5 for a CRT display image is arranged between each phosphor 13.
ここで、Ａなる方向からみたときの蛍光体１３からの放
ＩＪ・Ｊ光ｍは、第６図（ｂ）に示す輝度信号がＣＲ′
ｒに供給されているとすると、第６図（ａ）の実１５１
ａで表される曲線のようになる。さて、Ｃ Ｒ ′ｒ
に供給される輝度信号のバイラ、イト部の振幅が大きず
ぎるか、あるいはＣＲＴ側でコントラストを」二げるた
めにビームｆＩｓ流を大きくすると、蛍光体１３からの
放ＩＪ＝１光量は第６図（ａ）中点線すで示す曲線のよ
うになり、白く見える部分ｐの面積がｐ′のように広が
り、黒く見える部分ｑの面積が（１′ のように狭まっ
てしまう。このため、Ａなる方向から見たときの白と黒
のコントラスト比ｐ／ｑが小さくなるので、平均数Ｊ１
１．ｊ光ｍがＣからｄに−にがって白っぽく見え、同１
１１７に解像度が低下したように見える。これはビーム
電流が大きいほど、シャドーマスクの穴ピッチが細かい
ほど、Ｃ Ｒ ′Ｉ”に供給される輝度信号の周波数が
高いほど顕２りとなり、最近の高画質化テレビにおける
細かいデイテール再現の障害となっている。Here, the IJ·J light m emitted from the phosphor 13 when viewed from the direction A has a luminance signal CR' shown in FIG. 6(b).
If it is supplied to r, then the fruit 151 in Fig. 6(a)
It becomes like the curve represented by a. Now, C R ′r
If the amplitude of the bias or light portion of the luminance signal supplied to the phosphor 13 is too large, or if the beam fIs flow is increased to reduce the contrast on the CRT side, the amount of light IJ = 1 emitted from the phosphor 13 will be The dotted line in Figure 6 (a) becomes like the curve already shown, and the area of the part p that looks white expands as p', and the area of the part q that looks black narrows as (1').For this reason, Since the contrast ratio p/q of white and black when viewed from direction A becomes smaller, the average number J1
1. j light m appears whitish from C to d, same as 1
The resolution appears to have decreased to 117. This becomes more obvious as the beam current is larger, the hole pitch of the shadow mask is finer, and the frequency of the luminance signal supplied to C It becomes.
（発明が解決しようとする課題）
以上述べたように従来のＣ １１ ”ｌ゛表示装置では
、コン！・ラストを−１−げるためビーム７１を流を大
きくするほど、シャドーマスクの穴ピッチが細かいほど
、Ｃ Ｒ Ｔに１」（給される輝度信号の周波数が高い
ほどコントラスト
レビにおける細かいデイテールの再現の障害となってい
た。(Problems to be Solved by the Invention) As described above, in the conventional C11"l" display device, the hole pitch of the shadow mask increases as the flow of the beam 71 increases in order to increase the contrast by -1-1. The finer the CRT, the higher the frequency of the supplied luminance signal, the more it becomes an obstacle to reproducing fine details in contrast reproduction.
この発明は上記の問題を解決するためになされたもので
、大きなコントラスト
ール再現を両立させることのできるＣＲＴ表示装置１“
（１“を提はすることを目的とする。This invention was made in order to solve the above problems, and is a CRT display device that is capable of achieving both large contrast reproduction.
(The purpose is to propose 1).
［発明の横！戊］
（課題を解決するだめの手段）
」二記１］的を達成するためにこの発明に係るＣ Ｒ
Ｔ表示装置は、輝度信号の高域成分を抽出する高域通過
フィルタと、前記輝度信号の低域成分を抽出する低域通
過フィルタと、前記高域通過フィルタで抽出された高域
成分から画像の輪郭部を抽出する輪郭部抽出手段と、こ
の輪郭部抽出手段の出力振幅に応じて前記高域通過フィ
ルタ出力の振幅を制御する振幅制御手段と、この振幅制
御子１々の出力と前記低域通過フィルタの出力とを加算
【７てＣＲＴ輝度信号とする加３ヤ手段とを具備して１
１″ｌ−成される。[Next to invention!戊] (Means for solving the problem) In order to achieve the objective of ``2.1'', the CR related to this invention is
The T display device includes a high-pass filter that extracts high-pass components of a luminance signal, a low-pass filter that extracts low-pass components of the luminance signal, and an image from the high-pass components extracted by the high-pass filter. contour extraction means for extracting the contour of the contour, amplitude control means for controlling the amplitude of the high-pass filter output according to the output amplitude of the contour extraction means, The output of the pass-pass filter is added to the CRT luminance signal.
1″l-made.
（作用）
１ユ記４１１１成によるＣＲＴ表示装置では、輝度（ス
一すの高域成分から画像の輪郭部を抽出し、この輪郭部
の振幅に応じて高域成分の振幅を制御するので、輝度信
号の高域成分の極性が正のときは幅が細くなり、負のと
きは幅が太くなる。このため、大きなコントラスト比と
細かなデイテールの再現を両立させることができる。(Function) In the CRT display device constructed according to 1U-4111, the contour of the image is extracted from the high-frequency component of the brightness (sweep), and the amplitude of the high-frequency component is controlled according to the amplitude of this contour. When the polarity of the high-frequency component of the luminance signal is positive, the width becomes narrower, and when it is negative, the width becomes thicker.Therefore, it is possible to achieve both a large contrast ratio and the reproduction of fine details.
（実施例）
以下、第１図乃至第４図を参照してその実施例を：説明
する。(Example) Hereinafter, an example will be described with reference to FIGS. 1 to 4.
第１図はこの発明の第１の実施例を示すもので、２１は
輝度信号が供給される入力端子である。この入力端子２
１に供給された輝度信号は、高域通過フィルタ（ＨＰ１
２２と低域通過フィルタ（ＬＰＦ’）２３に供給され，
る。高域通過フィルタ２２に供給された輝度信号は高域
信号成分Ｙｌｌのみが抽出され、遅延線（ＤＬ）２４、
非線形回路２５及びピーク検出器（ＤＥＴ）２１ｉにイ
」（給される。FIG. 1 shows a first embodiment of the present invention, and 21 is an input terminal to which a luminance signal is supplied. This input terminal 2
The luminance signal supplied to HP1 is passed through a high-pass filter (HP1
22 and a low pass filter (LPF') 23,
Ru. From the luminance signal supplied to the high-pass filter 22, only the high-frequency signal component Yll is extracted, and the delay line (DL) 24,
The signal is supplied to the nonlinear circuit 25 and the peak detector (DET) 21i.
遅延線２４に供給されたＹｌｌ信号は所定期間遅延され
てＹＩＩ［ｌ信号となり、減算器２７の一方の入力端子
に供給される。The Yll signal supplied to the delay line 24 is delayed for a predetermined period and becomes the YII[l signal, which is supplied to one input terminal of the subtracter 27.
一方、非線形回路２５に供給されたＹ１１信号は微小振
幅部が抑圧された後、絶対値回路（ＡＢＳ）２８に入力
されて正方向の振幅のみとなり、減算器２９に１」ｌ、
給される。この減算器２９では絶対値回路２８からの絶
対値とピーク検出器２６からのピーク値との減算力１行
なわれ、その減算結果は係数設定器３゜こｆｊＵ給され
る。この係数設定器３０は例えばＲＯＭ１５のメモリで
構成され、人力したへ＆算値によって係数１りを定める
ものである。ここで定められた係ｆｋ、 Ｋは試算器２
７の他方の入力端子に供給される。On the other hand, the Y11 signal supplied to the non-linear circuit 25 is inputted to the absolute value circuit (ABS) 28 after the small amplitude part is suppressed and has only positive amplitude, and is sent to the subtracter 29 with 1''l,
be provided. This subtracter 29 performs a subtraction between the absolute value from the absolute value circuit 28 and the peak value from the peak detector 26, and the result of the subtraction is supplied to the coefficient setter 3°fjU. The coefficient setter 30 is constituted by, for example, a memory such as a ROM 15, and determines the coefficient 1 by a manually calculated value. The coefficient fk defined here, K is the trial calculator 2
7 is supplied to the other input terminal.
＾ｙ算器２７ではＹＩＩＤ−になる減算がｊ〕われる。The ^y calculator 27 performs subtraction to yield YIID-.
この減算器２７の出力ＹＩＩＤ は加算器３１の一方
の人力Ｄｋｊ子に供給される。The output YIID of the subtracter 27 is supplied to one input Dkj of the adder 31.
一方、低域通過フィルタ２３に人力された輝度（，１号
はθε域信号成分ＹＬのみが抽出され、加算器３１の他
ツノ°の入力端子に供給される。この加算器３１では、
低域通過フィルタ２３からの低域信号成分ＹＬと減算器
２７からの高域信号成分Ｙ ＩＩυ との加算合成がな
され、その加算結果は出力端子３２を介し゛ＣＣＩ工′
ｌ゛（図示せず）のカッ〜ド電極に送られる。On the other hand, only the θε region signal component YL of the luminance input manually input to the low-pass filter 23 (No. 1) is extracted and supplied to the input terminal of the adder 31. In this adder 31,
The low-pass signal component YL from the low-pass filter 23 and the high-frequency signal component Y IIυ from the subtractor 27 are added and synthesized, and the addition result is sent to the ``CCI'' via the output terminal 32.
It is sent to the quad electrode of 1 (not shown).
上記構成において、以下その動作について第２図を参照
して説明する。The operation of the above configuration will be explained below with reference to FIG. 2.
今、入力端子２１に輝ｌ在イ、１号が供給され、高域通
過フィルタ２２から第２図（ａ）に示す高域信号成分Ｙ
ｌｌがｉりられたとする。この高域信号成分Ｙｌ＋は一
方でピーク検出器２６によりピーク１直Ｄｐが検出され
、他方で非線形回路２５により同図（ｂ）に示すように
非線形処理される。この非線形処理された高域信号成分
は、！（！！対対向回路２８絶対値に変換された後（（
ｂ）図中点線で示すようになる）、減算器２９でピーク
検出器２６のピーク検出値Ｄｐがら減３１１されて同図
（Ｃ）に示すようになる。その減算結果は係数設定器３
０に供給され、係数ｌ（を選択する。ここで定められた
係数■（は減算器２７の他〕ｊの入力端子に供給される
。Now, the input terminal 21 is supplied with the signal 1, and the high-pass filter 22 outputs the high-frequency signal component Y shown in FIG. 2(a).
Suppose that ll is removed from i. This high-frequency signal component Yl+ is detected by the peak detector 26 as a peak 1 direct Dp, and on the other hand is subjected to nonlinear processing by the nonlinear circuit 25 as shown in FIG. 2(b). This nonlinearly processed high-frequency signal component is! (!!After being converted to the absolute value of the opposing circuit 28 ((
b) As shown by the dotted line in the figure), the peak detection value Dp of the peak detector 26 is subtracted 311 by the subtracter 29, resulting in the result shown in FIG. The subtraction result is the coefficient setter 3
0, and selects the coefficient l(.The coefficient ■( defined here) is supplied to the input terminal of the subtractor 27 and other j.
一方、遅延線２４に（ｊＬ給されたＹ １１信号は係数
設定器３０−Ｃ係数Ｉ（が選択されるｊ；で遅延されて
Ｙ ＩＩ １１ （＋’ｒ号となる。この遅延した高域
信号成分ＹＩＩＬＩを減算器２７の一方の入力端子に供
給して他方の入力端子に供給される係数ｌくを減算する
と、高域信号成分Ｙ１１の利１１１制御を？ｊなわれ、
第２図（ｄ ）中実線に示すようになる。すなわち、白
側は幅か細くなり、黒側は幅が太くなる。尚、（ｄ）図
において、点線は（ａ）図の高域１．（９成う） Ｙ
１１の遅延（，４°（ｌを示しており、斜線部は係数Ｋ
によって利ｆｊＪ制御が行われたことを示している。こ
のよ・）に利得制御された高域信号成分ＹＩＩＤ は
加算：ｒ：： ３１で低域通過フィルタ２３からのＬＬ
域信号成分ｙＬと加算され、輝度信号としてＣＲＴのカ
ソードｉｌｉ極に（Ｒ給される。On the other hand, the Y 11 signal fed to the delay line 24 (jL is delayed by the coefficient setter 30-C coefficient I(j) and becomes Y II 11 (+'r). If the signal component YIILI is supplied to one input terminal of the subtractor 27 and the coefficient l applied to the other input terminal is subtracted, the gain 111 control of the high frequency signal component Y11 becomes ?j,
It becomes as shown by the solid line in FIG. 2(d). That is, the width becomes narrower on the white side, and wider on the black side. In figure (d), the dotted line indicates the high range 1. of figure (a). (9 become) Y
11 delays (, 4° (l), the shaded area is the coefficient K
This shows that the profit fjJ control was performed. The gain-controlled high-frequency signal component YIID is added to LL from the low-pass filter 23 by adding:r::31.
It is added to the area signal component yL and is fed (R) to the cathode ili of the CRT as a luminance signal.
第２図（ｄ）の実線で表わされる高域信号成分”Ｉ’ｌ
ｌυ を持つ輝度信号は、Ｌで示される白側の部分の幅
が細くなり、Ｍで示される黒側の部分の幅が太くなって
デイテール強；’Ｉ、！Ｊ信号となる。このため、ＣＲ
Ｔ上に両縁を表示すると、例えば第６図（ａ）点線で示
すｐ′及びｑ′をそれぞれｐ及び（ｌにＮｒ Ｌ くす
ることができ、細かなデイテール！盛を出現することが
できる。The high-frequency signal component “I'l” represented by the solid line in Figure 2(d)
In the luminance signal with lυ, the width of the white part indicated by L is narrower, and the width of the black part indicated by M is thicker, so that detail is strong;'I,! It becomes J signal. For this reason, CR
When both edges are displayed on T, for example, p' and q' shown by the dotted lines in Fig. 6(a) can be reduced to p and (l, respectively, and fine details can appear. .
したがって、上記構成のＣＲＴ表示装ｊＮは、大きｌｉ
コントラスト比と細かなデイテール再現を両Ｘ′ｆさせ
ることができる。Therefore, the CRT display device jN having the above configuration has a large li
Both the contrast ratio and fine detail reproduction can be improved.
第３図にこの発明に係る他の実施例を示す。但し、第３
図において第１図と同一部分には同一？〕号をイ・１し
Ｃポしてその説明を省略する。FIG. 3 shows another embodiment of the invention. However, the third
Are the same parts in the figure the same as in Figure 1? ] Please type A and C and omit the explanation.
第３図において、高域通過フィルタ２２で抽出された高
域信号成分Ｙｌ＋は遅延線２４と共に微分回路３３に１
１（給される。遅延線２４に供給されたＹ１１信号は所
定期間遅延されてＹｌｌｌ）信号となり、加算２：り３
４で一定値ＤＣが加算された後、乗算器３５の一ツノの
入力端子に供給される。微分回路３３に供給されたＹ１
１信号は輪郭信号が抽出され、絶対値回路２８により“
θ″から“１”の間の正のｊ１〆ｌのみとなって係数設
定器３０に１」（給される。係数設定器３０では絶λ・
１値回路２８から供給された値によって係数（ＩＩＣ）
を定める。この係数（１−Ｋ ）は乗算器３５の他方の
入力端子に供給される。この乗算器３５ではＹｕ １１
Ｘ （１−Ｋ）なる乗算がなされる。In FIG. 3, the high-frequency signal component Yl+ extracted by the high-pass filter 22 is sent to the differential circuit 33 together with the delay line 24.
1 (supplied. The Y11 signal supplied to the delay line 24 is delayed for a predetermined period and becomes a Ylll) signal, and the addition 2:
After a constant value DC is added in step 4, the resultant signal is supplied to one input terminal of the multiplier 35. Y1 supplied to the differentiating circuit 33
1 signal is a contour signal extracted, and the absolute value circuit 28 outputs “
Only positive j1〆l between θ'' and “1” is supplied to the coefficient setter 30.
The coefficient (IIC) is determined by the value supplied from the one-value circuit 28.
Establish. This coefficient (1-K) is supplied to the other input terminal of multiplier 35. In this multiplier 35, Yu 11
A multiplication of X (1-K) is performed.
この乗算結果は、減算器３６に供給され、先に加算され
た一定値ＤＣが減算される。この減算結果は前記ＹＩＩ
Ｄ 信号として加算器３１の一方の入力端子に１」（
給される。This multiplication result is supplied to a subtracter 36, from which the previously added constant value DC is subtracted. This subtraction result is the YII
1'' (
be provided.
尚、入力端子２１に供給される輝度信号が２’ ｓコ
ンブリメントのディジタル信号の場合、加算器３４ ｋ
’ｔ−び減算器３Ｇはそれぞれ、２″ Ｓコンブリメン
トからストレートバイナリへの変換、ストレート・（イ
ナリから２’ ｓコンプリメン１への変換に首巻えが
ＨＪ Ｉｉｔ２である。Note that if the luminance signal supplied to the input terminal 21 is a 2's combination digital signal, the adder 34 k
't- and subtractor 3G each have HJ Iit2 for conversion from 2''S complement to straight binary and from straight (inary to 2's complement 1).
以１・°、第４図を参照して第３図に示ず構成での動作
を説明する。Hereinafter, the operation of the configuration not shown in FIG. 3 will be explained with reference to FIG. 4.
今、入力端子２日こ輝度信号が入力され、高域通＋Ｉ・
’ａフィルタ２２で第４図（ａ）に示す高域信号成分＼
′１１か抽出されたとすると、このＹｌ＋信号は微分回
路３３で微５）処理されて輪郭が検出され、同図（１つ
）に示す波形となる。この微分信号なる輪郭ｆ１；号は
絶対６１′１回路２８で絶対圃皮換されて同図（ｃ）に
示す波形となり、係数設定器３０に供給される。Now, a luminance signal is input to the input terminal 2, and the high frequency +I signal is input.
'a The high frequency signal component shown in FIG. 4(a) with the filter 22\
'11 is extracted, this Yl+ signal is differentially processed by the differentiating circuit 33 to detect the contour, resulting in the waveform shown in the figure (one). This differential signal, which is the contour f1;, is subjected to absolute conversion in the absolute 61'1 circuit 28, resulting in a waveform shown in FIG.
この係数設定器３０では絶対値回路２８から供給された
値によって（ １ − Ｋ ）を定める。この係数（１
−Ｋ）は乗算器３５の他方の入力端子に供給される。This coefficient setter 30 determines (1-K) based on the value supplied from the absolute value circuit 28. This coefficient (1
-K) is supplied to the other input terminal of the multiplier 35.
−・方、遅延線２４で遅延された’に’ｎｏ信号は加算
Ｘ：４３４で一定値ＤＣが加えられた後、乗算ａ：４３
５に送られる。この亜算器３５でＹ，、ｌ）と（ １
− Ｋ ）の乗算を１１なうことにより、同図（ｄ）に
示すように高域成分Ｙ１１の刊１す制御がなされる。こ
の結果、第２図（ｄ）に示す実線のように白側は幅が細
くなり、出側は幅が太くなって、点線で示す入力輝度信
号の高域信号成分に対して、斜線部の利１り制御が行イ
〕れる。このように利ｉり制御された高域信号成分は減
算器３６で加算器３４にて加算した一定値１） Ｃが減
算されてＹＩＩＤ′信号となり、加算器３１で１１（域
通過フィルタ２３からの低域信号成分ＹＬと加算され、
輝度信号としてＣ ＲＴのカソード電極に供給される。- On the other hand, the 'no signal delayed by the delay line 24 is added with a constant value DC by addition X: 434, and then multiplied by a: 43
Sent to 5. In this subtractor 35, Y,,l) and (1
-K) is multiplied by 11 to control the high frequency component Y11 as shown in FIG. As a result, the width becomes narrower on the white side and thicker on the output side, as shown by the solid line in Figure 2(d), and the width of the diagonally shaded area becomes smaller with respect to the high-frequency signal component of the input luminance signal shown by the dotted line. Yield control is carried out. The high-frequency signal component that has been gain-controlled in this way is subtracted by the constant value 1) C added by the adder 34 in the subtracter 36 to become a YIID' signal, is added to the low frequency signal component YL of
It is supplied as a luminance signal to the cathode electrode of the CRT.
したがって、この構成においても、第１図の回路による
効果と同様な効果が得られ、第４図（ｄ）の実線で表わ
される高域信号成分Ｙｌｌｌ） を持つ輝度１バ号は
、Ｌで示される白側の部分の幅が細くなり、Ｍで示され
る出側の部分の幅が太くなってデイテール強調信号とな
る。このため、Ｃ Ｒ Ｔ １−に画１（りを表示する
と、例えば第４図（ｅ）中点線で示ずＪｉｋ射光量が実
線で示すようになり、細かなデイテール感を再現するこ
とができる。Therefore, in this configuration as well, the same effect as that of the circuit in FIG. The width of the white side portion indicated by M becomes narrower, and the width of the output side portion indicated by M becomes thicker, resulting in a detail emphasis signal. For this reason, when image 1 is displayed on C R T 1-, for example, the amount of light irradiated by Jik is shown as a solid line instead of the dotted line in the middle of FIG. .
［発明の効果］
Ｉｔ Ｊ二のようにこの発明によれば、大きなコントラ
ス、１・比と細かなデイテール遺り現を両立さＵ・るこ
とのできるＣ Ｒ Ｔ表示装置を提供することができる
。[Effects of the Invention] According to the present invention, as in It J2, it is possible to provide a CRT display device that can achieve both large contrast, high ratio, and fine detail reproduction. .
第１図はこの発明に係るＣ Ｒ Ｔ表示装置の一実施例
を示すブロック回路図、第２図は同実施例の動作を説明
するために各部の出力波形を示す波形図、第３図はこの
発明に係る他の実施例を示すブロック回路図、箱４図は
第３図の回路動作を脱走２：：、３１・・・加算器、３
２・・・出力端子、３３・・・微分回路、３４・・・加
算２：り、３５・・・乗算？：り、３６・・・減算器、
Ｙｌｌ・・・高域信号成分、ＹＬ・・・低域信号成分、
Ｉく・・・係数。
出願人代理人 弁理士 鈴江武彦
１１・・・電子ビーム、１２・・・シャドウマスク、１
３・・・蛍光体、１４・・・フェイスプレートガラス、
１５・・・ブラックマトリクス、２１・・・輝度信号入
力端子、２２・・・高域通Ｊｈフィルタ、２３・・・低
域通過フィルタ、２４・・・遅延線、２５・・・非線形
回路、２Ｇ・・・ピーク検出器、２７・・・減算器、２
８・・・絶対値回路、２９・・・減３％ ？：ｒｉ、３
０・・・係数設第
図
第
図
第
図
第
図FIG. 1 is a block circuit diagram showing an embodiment of a CRT display device according to the present invention, FIG. 2 is a waveform diagram showing output waveforms of each part to explain the operation of the same embodiment, and FIG. A block circuit diagram showing another embodiment according to the present invention, Box 4 shows the circuit operation shown in FIG.
2...Output terminal, 33...Differential circuit, 34...Addition 2: Ri, 35...Multiplication? :ri, 36...subtractor,
Yll...high frequency signal component, YL...low frequency signal component,
Iku...coefficient. Applicant's representative Patent attorney Takehiko Suzue 11...Electron beam, 12...Shadow mask, 1
3... Fluorescent material, 14... Face plate glass,
15... Black matrix, 21... Luminance signal input terminal, 22... High pass Jh filter, 23... Low pass filter, 24... Delay line, 25... Nonlinear circuit, 2G ...Peak detector, 27...Subtractor, 2
8...Absolute value circuit, 29...Decrease 3%? :ri, 3
0...Coefficient setting diagram diagram diagram diagram diagram diagram
Claims (4)
と、前記輝度信号の低域成分を抽出する低域通過フィル
タと、前記高域通過フィルタで抽出された高域成分から
画像の輪郭部を抽出する輪郭部抽出手段と、この輪郭部
抽出手段の出力振幅に応じて前記高域通過フィルタ出力
の振幅を制御する振幅制御手段と、この振幅制御手段の
出力と前記低域通過フィルタの出力とを加算してＣＲＴ
輝度信号とする加算手段とを具備することを特徴とする
ＶＲＴ表示装置。(1) A high-pass filter that extracts the high-frequency components of the luminance signal, a low-pass filter that extracts the low-frequency components of the luminance signal, and the contour of the image from the high-pass components extracted by the high-pass filter. a contour extracting means for extracting a contour portion, an amplitude control means for controlling the amplitude of the output of the high-pass filter according to an output amplitude of the contour extracting means, and an amplitude control means for controlling the amplitude of the output of the high-pass filter according to the output amplitude of the contour extracting means; Add the output to the CRT
1. A VRT display device comprising: adding means for converting a luminance signal into a luminance signal.
の微小振幅部を抑圧する非線形回路、この回路出力を絶
対値変換する絶対値回路と、前記高域通過フィルタ出力
の最大値を検出する最大値検出回路と、この回路出力と
前記絶対値回路の出力との差分をとる減算器とを備え、
前記減算器の出力で前記高域通過フィルタ出力の振幅を
制御するようにしたことを特徴とする請求項（１）記載
のＣＲＴ表示装置。(2) The contour extraction means includes a nonlinear circuit that suppresses a minute amplitude portion of the output of the high-pass filter, an absolute value circuit that converts the output of this circuit into an absolute value, and a maximum value of the output of the high-pass filter. comprising a maximum value detection circuit and a subtracter that takes the difference between the output of this circuit and the output of the absolute value circuit,
2. The CRT display device according to claim 1, wherein the amplitude of the output of the high-pass filter is controlled by the output of the subtracter.
分する微分回路と、この回路出力を絶対値変換する絶対
値回路とを備え、この絶対値回路の出力に基づいて前記
高域通過フィルタ出力の振幅を制御することを特徴とす
る請求項（１）記載のＣＲＴ表示装置。(3) The contour extraction means includes a differentiation circuit that differentiates the high-pass filter output, and an absolute value circuit that converts the output of this circuit into an absolute value, and based on the output of the absolute value circuit, the high-pass filter 2. The CRT display device according to claim 1, wherein the amplitude of the output is controlled.
記輪郭抽出手段により輪郭信号を抽出し、前記振幅制御
手段により一定値の加算された該高域成分の振幅制御を
行なった後に、先に加算した一定値を減算することを特
徴とする請求項（１）記載のＣＲＴ表示装置。(4) After adding a constant value to the output of the high-pass filter, extracting a contour signal by the contour extracting means, and controlling the amplitude of the high-frequency component to which the constant value has been added by the amplitude control means, 2. The CRT display device according to claim 1, wherein the previously added constant value is subtracted.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63246130A JPH0294874A (en) | 1988-09-30 | 1988-09-30 | Crt display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63246130A JPH0294874A (en) | 1988-09-30 | 1988-09-30 | Crt display device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0294874A true JPH0294874A (en) | 1990-04-05 |
Family
ID=17143926
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63246130A Pending JPH0294874A (en) | 1988-09-30 | 1988-09-30 | Crt display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0294874A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5748258A (en) * | 1994-12-28 | 1998-05-05 | Sony Corporation | Apparatus and method for processing a video signal |
-
1988
- 1988-09-30 JP JP63246130A patent/JPH0294874A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5748258A (en) * | 1994-12-28 | 1998-05-05 | Sony Corporation | Apparatus and method for processing a video signal |
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