JPH025269A - Multi-track type digital magnetic recording device - Google Patents
Multi-track type digital magnetic recording deviceInfo
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- JPH025269A JPH025269A JP15727188A JP15727188A JPH025269A JP H025269 A JPH025269 A JP H025269A JP 15727188 A JP15727188 A JP 15727188A JP 15727188 A JP15727188 A JP 15727188A JP H025269 A JPH025269 A JP H025269A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、マルチトラック型ディジタル磁気記録装置に
関し、特に、システムの許容スキニー値Ｓｋに対してヘ
ッドのアジマス誤差マージンθ。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a multi-track digital magnetic recording device, and in particular, the azimuth error margin θ of the head with respect to the allowable skinny value Sk of the system.
の許容値を太き（することができるように構成されたマ
ルチトラック型ディジタル磁気記録装置に関するもので
ある。This invention relates to a multi-track digital magnetic recording device configured to allow for a wide tolerance value.
近年、音声等のアナログ信号をディジタル信号に変換し
、さらに所定の変調方式で変調してセルフクロック可能
なディジタル信号を生成し、これを磁気テープ等の磁気
記録媒体に記録し、または再生するディジタル磁気記録
装置が開発されている。このようなディジタル磁気記録
装置では、従来のアナログ磁気記録再生装置に比して非
常に広い帯域を必要とする。そして、■トラック当たり
の記録密度を低減するように、ディジタル信号を複数の
トラックに分配して記録再生できるようにしたものがマ
ルチトラック型ディジタル磁気記録装置である。In recent years, digital signals have been developed that convert analog signals such as audio into digital signals, further modulate them using a predetermined modulation method to generate self-clockable digital signals, and record or reproduce these signals on magnetic recording media such as magnetic tape. Magnetic recording devices have been developed. Such digital magnetic recording devices require a much wider band than conventional analog magnetic recording and reproducing devices. A multi-track digital magnetic recording device is capable of recording and reproducing digital signals by distributing them to a plurality of tracks so as to reduce the recording density per track.
一般に、マルチトラック型ディジタル磁気記録装置では
、ディジタル信号を複数のシンボルからなるブロックに
分割し、各ブロック毎に同期信号を付加して記録媒体に
記録している。In general, in a multi-track digital magnetic recording device, a digital signal is divided into blocks each consisting of a plurality of symbols, and a synchronization signal is added to each block, which is then recorded on a recording medium.
５トラツクのマルチトラック型ディジタル磁気記録装置
を例にとって説明すると、記録回路の信号フォーマット
は、第５図に示すように、フレームの同期信号、データ
、及びパリティで１フレームが構成される。上記記録回
路は、第６図および第７図に示すように、音声等のアナ
ログ信号がＡ／Ｄ変換器１にてディジタル信号に変換さ
れ、記録信号処理回路２にてパリティの生成及び同期信
号の付加がなされる。この後、符号変調回路３において
例えば時分割処理を行い、ＮビットのデータがＭビット
のデータワードａに変換されるようになっている。符号
変調回路３により変換されたＭビットのデータワードａ
は、タイミング信号発生回路４からのシンボルクロック
ｂで送り出され、順次、Ｍビットレジスタ５５・５４・
５３・５２・５１に送られる。Taking a 5-track multi-track digital magnetic recording device as an example, the signal format of the recording circuit is such that one frame is composed of a frame synchronization signal, data, and parity, as shown in FIG. As shown in FIGS. 6 and 7, in the recording circuit, an analog signal such as audio is converted into a digital signal by an A/D converter 1, and a recording signal processing circuit 2 generates a parity and a synchronization signal. is added. Thereafter, the code modulation circuit 3 performs, for example, time division processing to convert the N-bit data into an M-bit data word a. M-bit data word a converted by code modulation circuit 3
are sent out at the symbol clock b from the timing signal generation circuit 4, and are sequentially sent to the M-bit registers 55, 54, and
Sent to 53, 52, 51.
次に、タイミング信号発生回路４のロード信号Ｃにより
、Ｍビットレジスタ５５のデータはＭビットパラレルイ
ン／シリアルアウトレジスタ（以下、ＭビットＰ／Ｓと
いう）６５に、Ｍビットレジスタ５４のデータはＭビッ
トＰ／３６４に、Ｍピットレジスタ５３のデータはＭビ
ットＰ／Ｓ ６３に、Ｍビットレジスタ５２のデータは
ＭビットＰ／Ｓ６２に、Ｍビットレジスタ５１のデータ
はＭビットＰ／Ｓ６１にそれぞれラッチされるように構
成されている。そして、タイミング信号発生回路４のビ
ットクロックｄにより、各々のＭピッ）Ｐ／３６５・６
４・６３・６２・６１は、それぞれに対応するヘッド７
５・７４・７３・７２・７１へ順次データを送り出し、
第５図に示す信号フォーマットに準拠したフォーマット
が形成されることになる。Next, in response to the load signal C of the timing signal generation circuit 4, the data in the M bit register 55 is transferred to the M bit parallel in/serial out register (hereinafter referred to as M bit P/S) 65, and the data in the M bit register 54 is transferred to the M bit parallel in/serial out register (hereinafter referred to as M bit P/S) 65. The data of the M pit register 53 is latched to the M bit P/S 63, the data of the M bit register 52 is latched to the M bit P/S 62, and the data of the M bit register 51 is latched to the M bit P/S 61. is configured to be Then, according to the bit clock d of the timing signal generation circuit 4, each M pi) P/365.6
4, 63, 62, and 61 are the corresponding heads 7
Send data sequentially to 5, 74, 73, 72, and 71,
A format conforming to the signal format shown in FIG. 5 will be formed.
このような従来のマルチトラック型ディジタル磁気記録
装置では、各トラックの位相は整っているが、変調後の
データレジスタとしてトラック数Ｔと同数のＭビットレ
ジスタおよびＭビットＰ／Ｓが必要となるので、その回
路規模がトラック数に比例して増大することになる。In such a conventional multi-track digital magnetic recording device, the phase of each track is aligned, but the same number of M-bit registers and M-bit P/S as the number of tracks T are required as data registers after modulation. , the circuit size increases in proportion to the number of tracks.
そこで、トラック数の増大に対応して大規模になりがち
な回路規模を小さく抑えるために、Ｍビットのデータワ
ードを単位として用い、ディジタル信号を有限のＴトラ
ックに記録するマルチトラック型ディジタル磁気記録装
置において、例えば第８図あるいは第１１図に示すよう
に、ｉ ｎ
を満足する整数！、ｎの最小値をＪ＋ｍｉａ 、ｎ５ｉ
ｎとして、トラック数Ｔと同数のレジスタを有し、各レ
ジスタの容量は、ｉをパラメータとする次式で表わされ
るＡムビットとし、
〔ただし、ＩＮＴ（Ｘ）はＸを超えない最大の整数、ｉ
＝１．２．３．・・・Ｔ） 、Ｍビットのデータワード
をラッチする手段と、上記のＡ！レジスタのデータを各
々対応するトラックに割り当てる手段と、Ｍビットのデ
ータワードを各トラックに出力する手段とを備えたマル
チトラック型ディジタル磁気記録装置が提案されている
。Therefore, in order to keep down the circuit scale, which tends to increase as the number of tracks increases, we use multi-track digital magnetic recording, which uses M-bit data words as units and records digital signals on a finite number of T tracks. In the device, for example as shown in FIG. 8 or FIG. 11, an integer satisfying i n ! , the minimum value of n is J+mia, n5i
As n, there are the same number of registers as the number of tracks T, and the capacity of each register is AM bits expressed by the following formula with i as a parameter, [where INT(X) is the largest integer not exceeding X, i
=1.2.3. ...T), means for latching an M-bit data word, and the above A! A multi-track digital magnetic recording device has been proposed which includes means for allocating register data to respective tracks and means for outputting M-bit data words to each track.
即ち、第８図に示すマルチトラック型ディジタル磁気記
録装置においては、１０ビツトのデータワードａを単位
として、ディジタル信号が５トラツクに記録される。That is, in the multi-track digital magnetic recording apparatus shown in FIG. 8, digital signals are recorded on five tracks in units of 10-bit data words a.
１２ ｎ
の数式で満たされるｊ！ ＋ａｉｎは２、ｎ、ｉは１
（Ｋは５）であり、トラック数と同数のレジスタ９１
・９２・９３・９４・９５の容量ビット数は、Ａｓ ＝
１０− （２ＸＩＮＴ （１−１） ＝１０Ａ４ ＝
１０− （２ＸＩＮＴ （２−１） ＝ ８Ａｓ
＝１０ （２ＸＩＮＴ （３１） −６Ａｘ
＝１０ （２ＸＩＮＴ （４１） ＝ ４Ａ
＋ ＝１０− （２ｘＩＮＴ （５−１） ＝
２とされる。j! filled with the formula 12 n! +ain is 2, n, i is 1
(K is 5), and the number of registers 91 is the same as the number of tracks.
・The capacity bit numbers of 92, 93, 94, and 95 are As =
10- (2XINT (1-1) = 10A4 =
10- (2XINT (2-1) = 8As
=10 (2XINT (31) -6Ax
=10 (2XINT (41) = 4A
+ =10- (2xINT (5-1) =
2.
音声等のアナログ入力は、Ａ／Ｄ変換器１にて例えば８
ビツトのディジタル信号に変換され、記録信号処理回路
２にてパリティの生成及び同期信号の付加がなされる。Analog input such as audio is input to A/D converter 1, for example, 8
The signal is converted into a bit digital signal, and the recording signal processing circuit 2 generates parity and adds a synchronization signal.
この後、例えば符号変調回路３において時分割処理を行
い、８ビツトのデータが１０ビツトのデータワードａに
変換されるようになっている。Thereafter, time-division processing is performed, for example, in the code modulation circuit 3, so that the 8-bit data is converted into a 10-bit data word a.
データワードａは、第８図および第９図に示すように、
順次タイミング信号発生回路８からのシンボルクロック
ｂで送り出される。第１トラックＴＩのデータは１０ビ
ツトレジスタ９１でラッチされ、筆頭から２ビツトの信
号が選択信号ｅ及び選択回路１０に従って第１トラツク
Ｔ１のヘッド７１に出力される。シンボルクロックｂに
よって第１トラツクＴ１のデータが１０ビツトレジスタ
９１にラッチされると、１０ビツトレジスタ９１は先に
出力した２ビツト以外の残りの８ビツトの信号を８ビツ
トレジスタ９２にラッチさせ、８ビツトレジスタ９２に
ラッチされた信号の筆頭から２ビツトの信号が選択信号
ｅ及び選択回路１０に従って第２トラツクＴ２のヘッド
７２に出力される。Data word a is, as shown in FIGS. 8 and 9,
It is sequentially sent out using the symbol clock b from the timing signal generation circuit 8. The data of the first track TI is latched by a 10-bit register 91, and the first 2-bit signal is outputted to the head 71 of the first track T1 in accordance with the selection signal e and the selection circuit 10. When the data of the first track T1 is latched into the 10-bit register 91 by the symbol clock b, the 10-bit register 91 causes the 8-bit register 92 to latch the remaining 8-bit signals other than the previously output 2 bits, and The first two bits of the signals latched in the bit register 92 are output to the head 72 of the second track T2 in accordance with the selection signal e and the selection circuit 10.
このようにして各レジスタ９１・９２・９３・９４・９
５にラッチされたデータの筆頭から２ビツトの信号だけ
を選択信号ｅ及び選択回路１０に従って各トラックＴ１
〜Ｔ５に対応する各ヘッド７１〜７５へ出力し、出力し
たビット以外の残りのビットの信号を次段のレジスタ９
２・９３・９４・９５に順次送り出すことによって、第
１０図に示す信号フォーマットに準拠した信号フォーマ
ットが生成される。In this way, each register 91, 92, 93, 94, 9
According to the selection signal e and the selection circuit 10, only the 2-bit signal from the head of the data latched in T5 is sent to each track T1.
- Output to each head 71 to 75 corresponding to T5, and send signals of remaining bits other than the output bit to the register 9 of the next stage.
By sequentially sending signals 2, 93, 94, and 95, a signal format conforming to the signal format shown in FIG. 10 is generated.
一方、第１１図に示すマルチトラック型ディジタル磁気
記録装置においては、ＩＯビビッのデータワードａを単
位として、ディジタル信号が１０トラツクに記録される
。On the other hand, in the multi-track digital magnetic recording apparatus shown in FIG. 11, digital signals are recorded on 10 tracks in units of data words a of IO bits.
Ｔ
の数式で満たされるｌ ｓｉｙ＋は１、ｎｌいは１ （
Ｋは１０）であり、トラック数と同数のレジスタ１１１
〜１１１０の容量ビット数は、順に、１０．９．８．７
．６．５．４．３．２．１とされる。l siy+ satisfied by the formula of T is 1, nl or 1 (
K is 10), and the number of registers 111 is the same as the number of tracks.
~1110 capacity bit numbers are, in order, 10.9.8.7
．． 6.5.4.3.2.1.
この場合、各部の動作タイミングは第１２図に示す通り
であり、各レジスタ１１１〜１１１０にランチされたデ
ータの筆頭の１ビツトの信号だけを選択信号ｅ及び選択
回路１０に従うて各トラックＴｌＮＴｌ０に対応するヘ
ッド７１〜７１（ｌへ出力し、出力したビット以外の残
りのビットの信号を次段のレジスタ１１２〜１１１０に
順次送り出すことによって、第１３図に示す信号フォー
マントに準拠した信号フォーマントが生成される。In this case, the operation timing of each part is as shown in FIG. 12, and only the first 1-bit signal of the data launched in each register 111 to 1110 is applied to each track TlNTl0 according to the selection signal e and the selection circuit 10. By outputting the signals to the heads 71 to 71 (l) and sequentially sending the signals of the remaining bits other than the output bits to the registers 112 to 1110 in the next stage, a signal formant conforming to the signal formant shown in FIG. generated.
ところが、第８図または第１１図に示す従来例によれば
、第１０図や第１３図に示すような各トラックＴ１〜Ｔ
５あるいはＴ１〜ＴＩＯのデータに一定の位相差があり
、各トラックＴ１〜Ｔ５あるいはＴ１〜ＴＩＯの位相差
が大きい場合、データワードａを第１４図に示すような
同一同期信号群とすると、最大位相誤差（最大スキュー
）は記録ヘッド７１〜７５．７１〜７１０及び図示しな
い再生ヘッドの取付誤差によって大きくなる。However, according to the conventional example shown in FIG. 8 or FIG. 11, each track T1 to T as shown in FIG. 10 or FIG.
5 or T1 to TIO, and when the phase difference of each track T1 to T5 or T1 to TIO is large, if data word a is the same synchronization signal group as shown in Fig. 14, the maximum The phase error (maximum skew) increases due to mounting errors of the recording heads 71 to 75, 71 to 710, and the reproduction head (not shown).
例えば、第１５図に示すように、記録時に各トラックの
位相差がθ、あると、トラック幅（第１トラツクＴ１の
中心から第５あるいは第１０トラツクＴ５・ＴＩＯの中
心までの幅）Ｔｗでの最大スキュー値はＳｏとなる。再
生時のシステムマージンとしてスキニー値をＳｋまで許
容できるとすると、ＰＯ点はＰ、点または２２点まで誤
差を生しることが許容され、００点はＱ、点またはＱｔ
点まで誤差を生じることが許容されるので、アジマス誤
差マージンθ３は次式で表わされる。For example, as shown in FIG. 15, when the phase difference between each track is θ during recording, the track width (width from the center of the first track T1 to the center of the fifth or tenth track T5/TIO) is Tw. The maximum skew value of is So. Assuming that the skinny value can be tolerated up to Sk as a system margin during playback, the PO point is allowed to have an error of up to P, point or 22 points, and the 00 point is Q, point or Qt.
Since an error up to a point is allowed, the azimuth error margin θ3 is expressed by the following equation.
θ、七〇、十０１
Ｔ ｗ Ｔ ｗ
したがって、アジマス誤差マージンθ、がθ１とθ、と
て非対称となり、また、システムの許容スキニー値Ｓｋ
に対してアジマス誤差マージンθ２の許容値が比較的小
さくなるきらいがあるといった問題を生じる。θ, 70, 101 T w T w Therefore, the azimuth error margin θ, is very asymmetric between θ1 and θ, and the system allowable skinny value Sk
A problem arises in that the permissible value of the azimuth error margin θ2 tends to be relatively small.
本発明に係るマルチトラック型ディジタル磁気記録装置
は、上記の課題を解決するために、複数トラックに記録
再生し、記録回路により各々のトラック間の同期信号に
位相差が生じるように記録されるマルチトラック型ディ
ジタル磁気記録再生装置において、上記記録回路が、各
々のトラック間の同期信号群の中の最も位相が進んでい
るトラックと最も位相が遅れているトラックとを互いに
隣接して記録するように構成したことを特徴としている
。In order to solve the above-mentioned problems, a multi-track digital magnetic recording device according to the present invention records and reproduces information on a plurality of tracks, and a recording circuit records a multi-track digital magnetic recording device in such a way that a phase difference occurs in a synchronization signal between each track. In the track-type digital magnetic recording and reproducing device, the recording circuit records a track that is most advanced in phase and a track that is most delayed in phase among a group of synchronization signals between each track adjacent to each other. It is characterized by its composition.
上記の構成により、記録時に各トラックの位相差がθ１
生じるとすれば、トラック幅Ｔｗで最大スキュー値Ｓ０
が発生する。ここで、各々のトラック間の同期信号群の
中の最も位相が進んでいるトラックと最も位相が遅れて
いるトラックとが互いに隣接して記録されるので、トラ
ック間のスキュー値を小さく抑えることができ、これに
より、システムの許容スキュー値Ｓｌｌに対してアジマ
ス誤差マージンθ、の許容値を大きくすることができる
のである。With the above configuration, the phase difference of each track is θ1 during recording.
If it occurs, the maximum skew value S0 at track width Tw
occurs. Here, the track whose phase is most advanced and the track whose phase is most delayed among the synchronization signal group between each track are recorded adjacent to each other, so it is possible to keep the skew value between tracks small. As a result, the permissible value of the azimuth error margin θ can be increased relative to the permissible skew value Sll of the system.
本発明の一実施例を第１図ないし第４図に基づいて説明
すれば、以下の通りである。An embodiment of the present invention will be described below with reference to FIGS. 1 to 4.
このマルチトラック型ディジタル磁気記録装置は、ｌＯ
ビビッのデータワードａを単位として、ディジタル信号
が１０トラツクに記録する記録回路を有し、この記録回
路は、第１図に示すように、音声等のアナログ信号をデ
ィジタル信号に変換するＡ／Ｄ変換器１と、このディジ
タル信号にパリティ及び同期信号を付加する記録信号処
理回路２と、記録信号処理回路２の出力を時分割処理し
て１０ビツトのデータワードａに変換する符号変調回路
３と、１０個のレジスタ１２１〜１２１０と、選択回路
１０と、シンボルクロックｂ及び選択信号ｅを出力する
タイミング信号発生回路８と、各トラックＴ１〜ＴＩＯ
に対応する記録ヘッド７１〜７１０とを備えている。This multi-track digital magnetic recording device has lO
It has a recording circuit that records digital signals on 10 tracks in units of bibli data word a, and as shown in FIG. A converter 1, a recording signal processing circuit 2 that adds parity and synchronization signals to this digital signal, and a code modulation circuit 3 that performs time division processing on the output of the recording signal processing circuit 2 and converts it into a 10-bit data word a. , ten registers 121 to 1210, a selection circuit 10, a timing signal generation circuit 8 that outputs a symbol clock b and a selection signal e, and each track T1 to TIO.
The recording heads 71 to 710 corresponding to the recording heads 71 to 710 are provided.
音声等のアナログ信号は、Ａ／Ｄ変換器１でディジタル
信号に変換され、記録信号処理回路２でパリティ及び同
期信号を付加した後、符号変調回路３で時分割処理して
８ビツトデータから１０ビツトのデータワードａに変換
される。Analog signals such as audio are converted into digital signals by an A/D converter 1, parity and synchronization signals are added by a recording signal processing circuit 2, and then time-division processing is performed by a code modulation circuit 3 to convert 8-bit data into 10-bit data. It is converted into a data word a of bits.
第２図に示すように、データワードａはシンボルクロッ
クｂで順次送り出され、例えばトラックＴ６のｒｌＥＩ
ＨＪを内容とするデータワードａがレジスタ１２１でラ
ッチされ、筆頭の１ビツトの信号ｒＯＪがタイミング信
号発生回路８の選択信号ｅ及び選択回路１０にしたがっ
てトラックＴ６に対応する記録ヘッド７６に出力される
。As shown in FIG. 2, data words a are sent out sequentially with symbol clock b, e.g.
The data word a containing HJ is latched by the register 121, and the first 1-bit signal rOJ is output to the recording head 76 corresponding to the track T6 according to the selection signal e of the timing signal generation circuit 8 and the selection circuit 10. .
さらに、次のシンボルクロックｂでトラックＴ７に対応
するデータワードａがレジスタ１２１でラッチされると
、先に出力されたビット以外の９ビツトの信号がレジス
タ１２２にラッチされ、筆頭の１ビツトの信号「１」が
選択信号ｅ及び選択回路１０にしたがってトラックＴ６
に対応する記録ヘッド７６に出力される一方、レジスタ
１２１でラッチされたトラックＴ７に対応するデータワ
ードａの筆頭の１ビツトの信号が選択信号ｅ及び選択回
路１０にしたがってトラックＴ７に対応する記録ヘッド
７７に出力される。Furthermore, when the data word a corresponding to track T7 is latched in the register 121 at the next symbol clock b, the 9-bit signal other than the previously output bit is latched in the register 122, and the first 1-bit signal “1” is the track T6 according to the selection signal e and the selection circuit 10.
Meanwhile, the first 1-bit signal of the data word a corresponding to track T7 latched by the register 121 is output to the recording head corresponding to track T7 according to the selection signal e and the selection circuit 10. 77.
このようにして、各レジスタ１２１〜１２１０の筆頭の
１ビツトの信号だけを、対応する記録ヘッド７１〜７７
に出力し、出力したビット以外のビットの信号を次段の
レジスタ１２２〜１２１０に送り出すことにより、第３
図に示すように最も位相が進んでいる第６トラツクＴ６
と最も位相が遅れている第５トラツクＴ５とが互いに隣
接する信号フォーマットに準拠したフォーマットが形成
される。このようにして得た記録の各トラックの位相差
がθ１あると、第４図に示すように、トラック幅Ｔｗで
発生する最大スキュー値はＳｏとなる。ここで、本実施
例では、同一フレーム群の最大スキュー値Ｓ０がトラッ
ク幅Ｔｗの中央、即ち、隣接する第５トラツクＴ５と第
６トラックＴ６との間に生じるので、システムマージン
としてスキュー値Ｓｋまで許容できるとすると、第１ト
ラツクＴ１の同期信号位置２１点は２４点あるいは２３
点まで許容でき、第１０トラックＴＩＯの同期信号位ｆ
Ｑ３点は９４点あるいはＱ３点まで許容できることにな
る。In this way, only the first 1-bit signal of each register 121-1210 is transmitted to the corresponding recording head 71-77.
The third
As shown in the figure, the sixth track T6 has the most advanced phase.
A format conforming to a signal format in which the track T5 and the fifth track T5 whose phase is delayed the most are adjacent to each other is formed. If the phase difference between each track of the recording thus obtained is θ1, the maximum skew value occurring in the track width Tw is So, as shown in FIG. Here, in this embodiment, since the maximum skew value S0 of the same frame group occurs at the center of the track width Tw, that is, between the adjacent fifth track T5 and sixth track T6, the system margin is up to the skew value Sk. Assuming that it is permissible, the 21 synchronization signal positions of the first track T1 are 24 points or 23 points.
The synchronization signal position f of the 10th track TIO can be tolerated up to
Q3 points will be allowed up to 94 points or Q3 points.
したがって、アジマス誤差マージンθ８は、３ｍ
ｗ
となり、前記した（１）式で表わされる従来例のアジマ
ス誤差マージンθ８よりも大きくなる。Therefore, the azimuth error margin θ8 is 3m w , which is larger than the azimuth error margin θ8 of the conventional example expressed by the above-mentioned equation (1).
本発明のマルチトラック型ディジタル磁気記録装置は、
以上のように、複数トラックに記録再生し、記録回路に
より各々のトラック間の同期信号に位相差が生じるよう
に記録されるマルチトラック型ディジタル磁気記録再生
装置において、上記記録回路が、各々のトラック間の同
期信号群の中の最も位相が進んでいるトラックと最も位
相が遅れているトラックとを互いに隣接して記録するよ
うに形成されている構成である。The multi-track digital magnetic recording device of the present invention includes:
As described above, in a multi-track digital magnetic recording and reproducing apparatus in which recording is performed on and reproduced from multiple tracks, and the recording circuit performs recording so that a phase difference occurs in the synchronization signal between each track, the recording circuit This configuration is formed so that a track that is most advanced in phase and a track that is most delayed in phase among a group of synchronization signals between them are recorded adjacent to each other.
このように、各々のトラック間の同期信号群の中の最も
位相が進んでいるトラックと最も位相が遅れているトラ
ックとが互いに隣接して記録されるので、トラック間の
スキュー値を小さく抑えることができ、システムの許容
スキュー値に対するヘッドのアジマス誤差の許容値を大
きくすることができるという効果を奏する。In this way, the track that is most advanced in phase and the track that is most delayed in phase among the synchronization signal group between each track are recorded adjacent to each other, so the skew value between tracks can be kept small. This has the effect of increasing the allowable value of the azimuth error of the head relative to the allowable skew value of the system.
第１図ないし第４図は本発明の一実施例を示すものであ
って、第１図はマルチトラック型ディジタル磁気記録装
置における記録回路のブロック回路図、第２図はその信
号タイミング図、第３図はその記録信号フォーマントパ
ターン図、第４図は許容スキニー値に対するアジマス誤
差マージンを概念的に示した説明図である。
第５図ないし第７図は一つの従来例を示すものであって
、第５図はマルチトラック型ディジタル磁気記録装置の
記録信号フォーマットパターン図、第６図はその記録回
路のブロック回路図、第７図はその信号タイミング図で
ある。第８図ないし第１．０図は他の従来例を示すもの
であって、第８図はマルチトラック型ディジタル磁気記
録装置における記録回路のブロック回路図、第９図はそ
の信号タイミング図、第１０図はその記録信号フォーマ
ットパターン図である。第１１図ないし第１３図は更に
他の従来例を示すものであって、第１１図はマルチトラ
ック型ディジタル磁気記録装置における記録回路のブロ
ック回路図、第１２図はその信号タイミング図、第１３
図はその記録信号フォーマットパターン図である。第１
４図および第１５図は、第８図および第１１図の従来例
に共通したマルチトラック型ディジタル磁気記録装置の
説明図であって、第１４図はその記録信号フォーマット
パターン図、第１５図はその許容スキュー値に対するア
ジマス誤差マージンを概念的に示す説明図である。
１はＡ／Ｄ変換器、２は記録信号処理回路、３は符号変
調回路、８はタイミング信号発生回路、１０は選択回路
、７１〜７１０は記録ヘッド、１２１〜１２１０はレジ
スタである。
特許出願人 シャー・プ 株式会社−へ（”）ぐ
ｈΦト。Φ９
飄婉駅六包飄状択匠を暇
第１０図1 to 4 show an embodiment of the present invention, in which FIG. 1 is a block circuit diagram of a recording circuit in a multi-track digital magnetic recording device, FIG. 2 is a signal timing diagram thereof, and FIG. FIG. 3 is a diagram of the recording signal formant pattern, and FIG. 4 is an explanatory diagram conceptually showing the azimuth error margin with respect to the allowable skinny value. 5 to 7 show one conventional example, in which FIG. 5 is a recording signal format pattern diagram of a multi-track digital magnetic recording device, FIG. 6 is a block circuit diagram of the recording circuit, and FIG. FIG. 7 is the signal timing diagram. 8 to 1.0 show other conventional examples, in which FIG. 8 is a block circuit diagram of a recording circuit in a multi-track digital magnetic recording device, FIG. 9 is a signal timing diagram thereof, and FIG. FIG. 10 is a diagram of the recording signal format pattern. 11 to 13 show still other conventional examples, in which FIG. 11 is a block circuit diagram of a recording circuit in a multi-track digital magnetic recording device, FIG. 12 is a signal timing diagram thereof, and FIG.
The figure is a diagram of the recording signal format pattern. 1st
4 and 15 are explanatory diagrams of a multi-track digital magnetic recording device common to the conventional examples shown in FIGS. 8 and 11, in which FIG. 14 is a recording signal format pattern diagram thereof, and FIG. FIG. 3 is an explanatory diagram conceptually showing an azimuth error margin with respect to the allowable skew value. 1 is an A/D converter, 2 is a recording signal processing circuit, 3 is a code modulation circuit, 8 is a timing signal generation circuit, 10 is a selection circuit, 71 to 710 are recording heads, and 121 to 1210 are registers. Patent Applicant: Sha Pu Co., Ltd. - HΦTo. Φ9 Eiwa Station Six Packs Elephant Shape Selection Figure 10
Claims (1)
トラック間の同期信号に位相差が生じるように記録され
るマルチトラック型ディジタル磁気記録再生装置におい
て、 上記記録回路が、各々のトラック間の同期信号群の中の
最も位相が進んでいるトラックと最も位相が遅れている
トラックとを互いに隣接して記録するように形成されて
いることを特徴とするマルチトラック型ディジタル磁気
記録装置。[Claims] 1. A multi-track digital magnetic recording and reproducing device that records and reproduces data on a plurality of tracks, and in which a recording circuit performs recording so that a phase difference occurs in a synchronization signal between each track, the recording circuit comprising: Multi-track type digital magnetism characterized in that it is formed so that a track that is most advanced in phase and a track that is most delayed in phase among a group of synchronization signals between each track are recorded adjacent to each other. Recording device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63157271A JP3031920B2 (en) | 1988-06-23 | 1988-06-23 | Multitrack digital magnetic recording device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63157271A JP3031920B2 (en) | 1988-06-23 | 1988-06-23 | Multitrack digital magnetic recording device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH025269A true JPH025269A (en) | 1990-01-10 |
| JP3031920B2 JP3031920B2 (en) | 2000-04-10 |
Family
ID=15646008
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63157271A Expired - Fee Related JP3031920B2 (en) | 1988-06-23 | 1988-06-23 | Multitrack digital magnetic recording device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3031920B2 (en) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5517850A (en) * | 1978-07-19 | 1980-02-07 | Sanyo Electric Co Ltd | Pcm-system recording device |
| JPS5965906A (en) * | 1982-10-08 | 1984-04-14 | Hitachi Ltd | Multi-channel recording and reproducing device |
-
1988
- 1988-06-23 JP JP63157271A patent/JP3031920B2/en not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5517850A (en) * | 1978-07-19 | 1980-02-07 | Sanyo Electric Co Ltd | Pcm-system recording device |
| JPS5965906A (en) * | 1982-10-08 | 1984-04-14 | Hitachi Ltd | Multi-channel recording and reproducing device |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3031920B2 (en) | 2000-04-10 |
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