JPH0242144U - - Google Patents

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JPH0242144U
JPH0242144U JP11840288U JP11840288U JPH0242144U JP H0242144 U JPH0242144 U JP H0242144U JP 11840288 U JP11840288 U JP 11840288U JP 11840288 U JP11840288 U JP 11840288U JP H0242144 U JPH0242144 U JP H0242144U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を適用したデータ記
憶機能付き電子時計の内部回路を示すブロツク図
、第２図は第１図に示したＲＡＭ３の主な内容を
示す内部構成図、第３図は本実施例の主要な処理
動作を示すフローチヤート、第４図ａ，ｂはそれ
ぞれ第１図に示した表示部１１による現在時刻表
示と電話番号表示の一例を示す図である。 １……ＲＯＭ、３……ＲＡＭ、５……演算回路
、１１……表示部、Ｔ……電話番号記憶レジスタ
、Ｎ……本数レジスタ。

Claims (1)

  1. 【実用新案登録請求の範囲】 複数のデータを記憶可能なデータ記憶手段と、 該データ記憶手段に記憶されたデータを表示す
    る表示手段と、 所定スイツチの操作により前記複数のデータを
    順次前記表示手段で早送り表示させるデータ早送
    り手段と、 前記データ記憶手段に記憶されているデータの
    数が所定の数よりも多いか少ないかを判別するデ
    ータ数判別手段と、 該データ数判別手段で判別されたデータ数に応
    じて前記データ早送り手段によるデータの早送り
    速度を切り換える早送り速度制御手段とを備えた
    ことを特徴とするデータ記憶装置。
JP11840288U 1988-09-09 1988-09-09 Pending JPH0242144U (ja)

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JP11840288U JPH0242144U (ja) 1988-09-09 1988-09-09

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JPH0242144U true JPH0242144U (ja) 1990-03-23

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ID=31362731

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JP11840288U Pending JPH0242144U (ja) 1988-09-09 1988-09-09

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