JPH0235247U - - Google Patents

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JPH0235247U
JPH0235247U JP11341788U JP11341788U JPH0235247U JP H0235247 U JPH0235247 U JP H0235247U JP 11341788 U JP11341788 U JP 11341788U JP 11341788 U JP11341788 U JP 11341788U JP H0235247 U JPH0235247 U JP H0235247U
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JP
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control
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JP11341788U
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【図面の簡単な説明】
第１図は本考案の実施例の構成図、第２図はフ
アイルを排他的に使つている従来のデユプレツク
スシステムの図、第３図はＣＰＵ間で通信しなが
らフアイルを共有する他の従来システム図、第４
図は特殊装置を使つた更に他の従来システム図、
第５図は本考案を説明するためのフアイルのレコ
ード構成図、第６〜１０図は本考案を説明するた
めのロツクテーブル図、第１１図は本考案を説明
するためにデツドロツクとなつた時のロツクテー
ブル図、第１２図は複数資源を管理する本考案の
他の実施例の図、第１３図は第１２図の例を説明
するためのロツクテーブル図である。 ２１，２２……ＣＰＵ、２５……大容量記憶装
置、２６……制御部、２７……大容量記憶装置記
憶部、２８……大容量記憶装置内のフアイル、３
０〜３５，４８，４９……ロツクテーブル。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数台の中央処理装置（以降、ＣＰＵと略す）
    と大容量記憶装置が相互に接続されたシステムに
    おいて、前記大容量記憶装置の制御部に排他・共
    有のためのステータスを管理する機構をもち、複
    数のＣＰＵから同一のフアイルに対するアクセス
    をするときに排他・共有の制御をすることを特徴
    とする大容量記憶装置の制御装置。
JP11341788U 1988-08-31 1988-08-31 Pending JPH0235247U (ja)

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JP11341788U JPH0235247U (ja) 1988-08-31 1988-08-31

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JP11341788U JPH0235247U (ja) 1988-08-31 1988-08-31

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JPH0235247U true JPH0235247U (ja) 1990-03-07

Family

ID=31353233

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JP11341788U Pending JPH0235247U (ja) 1988-08-31 1988-08-31

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