JPH02301286A - Color signal processor - Google Patents
Color signal processorInfo
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- JPH02301286A JPH02301286A JP12261589A JP12261589A JPH02301286A JP H02301286 A JPH02301286 A JP H02301286A JP 12261589 A JP12261589 A JP 12261589A JP 12261589 A JP12261589 A JP 12261589A JP H02301286 A JPH02301286 A JP H02301286A
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- Processing Of Color Television Signals (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、搬送色信号を一旦色差信号に変換して、ノイ
ズ除去処理を施こした後、再び搬送色信号に変調する色
信号処理装置に関する。Detailed Description of the Invention [Field of Industrial Application] The present invention provides a color signal processing device that converts a carrier color signal into a color difference signal, performs noise removal processing, and then modulates the carrier color signal again into a carrier color signal. Regarding.
輝度信号と搬送色信号とにより構成されている複合映像
信号に対し、例えばフィールド・メモリ等を用いて、ノ
イズ低減などのディジタル処理を行う場合には、輝度信
号と色信号などのベースバンド信号に復調して行うのが
便利である。When performing digital processing such as noise reduction on a composite video signal composed of a luminance signal and a carrier chrominance signal using a field memory, etc., it is necessary to perform digital processing such as noise reduction on a composite video signal composed of a luminance signal and a carrier chrominance signal. It is convenient to perform demodulation.
この場合、複合映像信号の復調は、■輝度信号（以下、
Ｙ信号という）と搬送色信号（以下、Ｃ信号という）に
分離し、■Ｃ信号を色信号に復調するという２種類の処
理により行われる。In this case, demodulation of the composite video signal is performed by ■luminance signal (hereinafter referred to as
This is performed by two types of processing: separating the signal into a carrier color signal (hereinafter referred to as a Y signal) and a carrier color signal (hereinafter referred to as a C signal), and demodulating the C signal into a color signal.
そして、上述の処理のうち、処理■では搬送色信号のカ
ラーバースト信号に位相同期した２種類のサンプリング
・クロックによって、当該搬送色信号を直接アナログ・
ディジタル（Ａ／Ｄ）変換する事により、ディジタル信
号形態のベースバンド色差信号を得ている。Of the above-mentioned processes, in process (2), the carrier color signal is directly converted into an analog signal using two types of sampling clocks phase-synchronized with the color burst signal of the carrier color signal.
By performing digital (A/D) conversion, a baseband color difference signal in the form of a digital signal is obtained.
以下、ＮＴＳＣ方式のカラー・テレビジョン信号を例と
して、上述の処理動作を詳細に説明する。The above-mentioned processing operation will be described in detail below using an NTSC color television signal as an example.
ＮＴＳＣ方式のカラー・テレビジョン信号は、まず、Ｙ
／Ｃ分離され、次に分離されたＣ信号はカラーパースト
信号の４倍の周波数のサンプリングクロックにてＡ／Ｄ
変換する。そして、この時、当該サンプリングクロック
がカラーバースト位相の０６，９０°。The NTSC color television signal is first
/C separation, and then the separated C signal is A/Ded with a sampling clock having a frequency four times that of the color burst signal.
Convert. At this time, the sampling clock is at 06.90° of the color burst phase.
１８００及び２７０° に正確に位相同期していれば、
１８０°の位相に同期したタイミングでサンプリングさ
れるサンプル・データをＢ−Ｙ信号、２７０°の位相に
同期したタイミングでサンプリングされるサンプル・デ
ータをＲ−Ｙ信号とみなす事ができる。If the phase is accurately synchronized at 1800° and 270°,
Sample data sampled at a timing synchronized with a 180° phase can be regarded as a BY signal, and sample data sampled at a timing synchronized with a 270° phase can be regarded as an RY signal.
そして、これらのサンプル・データを副搬送波周波数（
ｆｓｃ）のクロックで振り分けることにより、搬送色信
号を２つの色差信号に復調できる。Then, these sample data are divided into subcarrier frequencies (
fsc), the carrier color signal can be demodulated into two color difference signals.
・ また、色差信号成分をＣ信号に変調するには、１８
０’ の位相に同期したす・ンプリングタイミングにて
得られるサンプリング・データを極性反転する事により
Ｏｏ の位相に同期したサンプリングタイミングにて得
られるサンプリング・データを形成し、２７０°の位相
に同期したサンプリングタイミングにて得られるサンプ
リング・データを極性反転する事により９０°の位相に
同期したサンプリングタイミングにて得られるサンプリ
ング・データを形成し、得られるサンプリング・データ
を１８０°。・In addition, in order to modulate the color difference signal component to a C signal, 18
By inverting the polarity of the sampling data obtained at the sampling timing synchronized with the phase of 0', the sampling data obtained at the sampling timing synchronized with the phase of Oo is formed, and the data is synchronized with the phase of 270°. By inverting the polarity of the sampling data obtained at the sampling timing, the sampling data obtained at the sampling timing synchronized with the 90° phase is formed, and the obtained sampling data is 180°.
２７０°、θ°、９０°の位相順序でディジタル・アナ
ログ（Ｄ／Ａ）変換する。Digital-to-analog (D/A) conversion is performed in the phase order of 270°, θ°, and 90°.
例えばＣ信号をＡ／Ｄ変換して得られる１８０゜の位相
に同期したサンプリングタイミングにて得られるサンプ
リング・データをＤ＋ｇｏとすると、極性反転により形
成されるＯｏ の位相に同期したサンプリングタイミン
グにて得られるサンプリング・データＤｏは、
Ｄｏ＝ （ＤＩ８０−Ｄ、）
と表わすことができる。尚、上述の式においてＤ ｃｅ
はＣ信号の直流オフセット値である。For example, if the sampling data obtained at a sampling timing synchronized with the 180° phase obtained by A/D conversion of the C signal is D+go, then the sampling data obtained at the sampling timing synchronized with the phase of Oo formed by polarity inversion is D+go. The sampled data Do can be expressed as Do=(DI80-D,). In addition, in the above formula, D ce
is the DC offset value of the C signal.
ところで、上述の式中のり、の値がＣ信号のディジタル
データの中心値と一致していない場合に、変調したＣ信
号は位相歪が発生したものとなり、変復調処理の過程に
おいて色相の変動が発生し、色信号の劣化が生じてしま
うという欠点があった。By the way, if the value of , in the above equation, does not match the center value of the digital data of the C signal, the modulated C signal will have phase distortion, and hue fluctuation will occur in the process of modulation and demodulation processing. However, there was a drawback that the color signal deteriorated.
そこで、本発明は上述の様な信号の劣化を生じさせずに
色信号に対し、ノイズ除去処理を施こす事ができる色信
号処理装置を提供する事を目的とする。SUMMARY OF THE INVENTION Therefore, an object of the present invention is to provide a color signal processing device that can perform noise removal processing on a color signal without causing signal deterioration as described above.
本発明の色信号処理装置は、搬送色信号をその基準位相
に位相同期したクロック信号を用いて色信号に復調し、
ノイズ除去処理を施こした後、再び搬送色信号に変調す
る装置であって、前記搬送色信号の基準位相に位相同期
したクロック信号に基づいて搬送色信号をサンプリング
し、第１サンプリングデータを出力する第１サンプリン
グ手段と、前記第１サンプリングデータとは逆位相の第
２サンプリングデータを形成し、出力する第２サンプリ
ング手段と、前記第１サンプリングデータと、第２サン
プリングデータとを用いて色差信号を復調し、出力する
色差信号復調手段と、前記色差信号復調手段より出力さ
れる色差信号に対し、該色差信号の相関性を利用してノ
イズ除去処理を施こすノイズ除去手段とを具備したもの
である。The color signal processing device of the present invention demodulates a carrier color signal into a color signal using a clock signal whose phase is synchronized with the reference phase of the carrier color signal,
After performing noise removal processing, the device modulates the carrier color signal again, the device samples the carrier color signal based on a clock signal phase-synchronized with the reference phase of the carrier color signal, and outputs first sampling data. a first sampling means for forming and outputting second sampling data having an opposite phase to the first sampling data; and a second sampling means for forming and outputting second sampling data having an opposite phase to the first sampling data; a color difference signal demodulating means for demodulating and outputting the color difference signal, and a noise removing means for performing noise removal processing on the color difference signal outputted from the color difference signal demodulating means using the correlation of the color difference signal. It is.
上述の構成により、前記搬送色信号の基準位相に位相同
期したクロック信号に基づいて搬送色信号をサンプリン
グする事により得られる第１サンプリングデータと、該
第１サンプリングデータとは逆位相の第２サンプリング
データとを用いて色差信号を復調し、色差信号の相関性
を利用したノイズ除去を行う事により、直流オフセット
により信号を劣化させずに、相関性を利用したノイズ除
去を行う事ができる様になる。With the above configuration, first sampling data obtained by sampling the carrier color signal based on a clock signal whose phase is synchronized with the reference phase of the carrier color signal, and second sampling data having an opposite phase to the first sampling data. By demodulating the color difference signal using data and removing noise using the correlation of the color difference signal, it is possible to remove noise using the correlation without deteriorating the signal due to DC offset. Become.
以下、本発明を本発明の一実施例を用いて説明する。 Hereinafter, the present invention will be explained using one embodiment of the present invention.
第１図は本発明の一実施例としての色信号処理装置の概
略構成を示したブロック図で、また、第２図、第３図及
び第４図は夫々、第１図に示した構成の動作を説明する
為のタイミングチャートである。FIG. 1 is a block diagram showing a schematic configuration of a color signal processing device as an embodiment of the present invention, and FIGS. 2, 3, and 4 respectively show the configuration shown in FIG. 1. It is a timing chart for explaining the operation.
第１図において、ｌはＡ／Ｄ変換器、２ａ〜２ｆはラッ
チ回路、３ａ、 ３ｂは反転出力ラッチ回路、４ａ〜４
ｄは全加算器、５ａ〜５ｄは係数乗算器、６ａ、 ６ｂ
は加算器、７ａ、 ７ｂはＦｉｒｓｔ ＩＮ−Ｆｉｒ
ｓｔ ０ＵＴ（ＦＩＦＯ）フィールドメモリ、ｓａ、
ｓｂはエクスクル−シブオア（ＥＸＯＲ）ゲート、９は
出力切換回路、ｌＯはＤ／Ａ変換器、１１はＰａ５ｅ
ＬｏｃｋｅｄＬｏｏｐ （ＰＬＬ）回路、１２はタイ
ミングコントローラである。In FIG. 1, l is an A/D converter, 2a to 2f are latch circuits, 3a and 3b are inverted output latch circuits, and 4a to 4
d is a full adder, 5a to 5d are coefficient multipliers, 6a, 6b
is an adder, 7a and 7b are First IN-Fir
st 0UT (FIFO) field memory, sa,
sb is an exclusive OR (EXOR) gate, 9 is an output switching circuit, 1O is a D/A converter, 11 is Pa5e
A Locked Loop (PLL) circuit, 12 is a timing controller.
２０はＮＴＳＣ方式のカラーテレビジョン信号等の複合
映像信号より分離されたＣ信号の入力端子、３３は不図
示の同期信号分離回路等より得られる複合同期信号の入
力端子、３４はＣ信号の出力端子である。20 is an input terminal for a C signal separated from a composite video signal such as an NTSC color television signal, 33 is an input terminal for a composite synchronization signal obtained from a synchronization signal separation circuit (not shown), etc., and 34 is an output for the C signal. It is a terminal.
第１図において、入力端子２０より入力されたＣ信号（
第４図（１）参照）はＡ／Ｄ変換器１． ＰＬＬ回路１
１．タイミングコントローラ１２に供給される。In FIG. 1, a C signal (
(See FIG. 4 (1)) is the A/D converter 1. PLL circuit 1
1. The signal is supplied to the timing controller 12.
尚、第４図（１）において実線は例えば奇数フィールド
の搬送色信号２０を表わし、点線は偶数フィールドの搬
送色信号２０′ を表わし、以下第４図においては搬
送色信号２０に対応する信号には“１０１″。In FIG. 4(1), the solid line represents, for example, the carrier color signal 20 of the odd field, and the dotted line represents the carrier color signal 20' of the even field. is “101”.
“２２”等の符番を付し、搬送色信号２０′ に対応
する信号には“１０１’”、“２２′″等の符番を付し
、詳細な説明は省略する。Signals such as "22" are given, and signals corresponding to the carrier color signal 20' are given numbers such as "101'" and "22'", and detailed explanation thereof will be omitted.
一方、ＰＬＬ回路１１には入力端子３３より複合同期信
号が入力されており、ＰＬＬ回路１１では複合同期信号
に従って、Ｃ信号（第２図（１）参照）中のカラーバー
スト信号が付加されている期間のみハイレベルになる分
離パルス（第２図（２）参照）を形成し、該分離パルス
に従ってＣ信号よりカラーバースト信号を分離し、更に
分離されたカラーバースト信号に位相同期し、該カラー
バースト信号の周波数の４倍の周波数を有するクロック
信号２１（第４図（２）参照）をタイミングコントロー
ラ１２に出力する。On the other hand, a composite synchronization signal is input to the PLL circuit 11 from the input terminal 33, and the PLL circuit 11 adds a color burst signal in the C signal (see FIG. 2 (1)) according to the composite synchronization signal. A separation pulse (see FIG. 2 (2)) that is at a high level only during the period is formed, the color burst signal is separated from the C signal according to the separation pulse, and the phase is synchronized with the separated color burst signal, and the color burst signal is A clock signal 21 (see FIG. 4 (2)) having a frequency four times the frequency of the signal is output to the timing controller 12.
そして、タイミングコントローラ１２からはＰＬＬ回路
１１より供給されているクロック信号２１がＡ／Ｄ変換
器ｌに供給され、Ａ／Ｄ変換器ｌではタイミングコント
ローラ１２から供給されるクロック信号２１に従ってＣ
信号をＡ／Ｄ変換し、ディジタルカラーデータ１０１
（第４図（３）参照）を出力する。The clock signal 21 supplied from the PLL circuit 11 is supplied from the timing controller 12 to the A/D converter 1, and the A/D converter 1 outputs a clock signal 21 according to the clock signal 21 supplied from the timing controller 12.
A/D converts the signal and converts it into digital color data 101
(See Figure 4 (3)).
Ａ／Ｄ変換器１より出力されたディジタルカラーデータ
１０１はラッチ回路２ａ、 ２ｂ、反転出力ラッチ回路
３ａ、 ３ｂのデータ人力りに供給される。Digital color data 101 outputted from the A/D converter 1 is supplied to the data outputs of latch circuits 2a, 2b and inverted output latch circuits 3a, 3b.
一方、タイミングコントローラ１２からはＣ信号のカラ
ーバースト信号と夫々異なった４種類の位相差（０’
、 ９０°、 １８０’ 、 ２７０）を持つクロッ
ク信号２２．２３．２４．２５ （第４図（５）、
（６）、 （７）。On the other hand, the timing controller 12 outputs four different phase differences (0'
, 90°, 180', 270).
(6), (7).
（８）参照）が出力されており、これらクロック信号２
２〜２５は第１図に示す様にラッチ回路２ａ、 ２ｂ。(8)) are output, and these clock signals 2
2 to 25 are latch circuits 2a and 2b as shown in FIG.
３ａ、３ｂのクロック入力端子に供給されており、ラッ
チ回路２ａ、 ’２ｂではタイミングコントローラ１２
より供給されるクロック信号２２．２４に従って、Ａ／
Ｄ変換器ｌより供給されるディジタルカラーデータをラ
ッチし、そのま走出力する事によりラッチデータ１０２
． １０４ （第４図（１３）、 （Ｉｓ）参照）と
して全加算器４ａ、 ４ｂに供給され、また、ラッチ回
路３ａ、 ３ｂではタイミングコントローラ１２より
供給されるクロック信号２３． ２５に従って、Ａ／Ｄ
変換器ｌより供給されるディジタルカラーデータをラッ
チし、極性を反転して出力する事によりラッチデータ１
０３，１０５ （第４図（１４）、 （１６）参照）
として、全加算器４ａ、４ｂに供給される。It is supplied to the clock input terminals of the latch circuits 2a and 3b, and the timing controller 12 is supplied to the latch circuits 2a and 2b.
According to the clock signal 22.24 supplied by A/
Latch data 102 is obtained by latching the digital color data supplied from the D converter l and immediately outputting it.
．． The clock signal 23.104 (see FIG. 4 (13), (Is)) is supplied to the full adders 4a, 4b, and the latch circuits 3a, 3b receive the clock signal 23.104 supplied from the timing controller 12. 25, A/D
Latch data 1 is obtained by latching the digital color data supplied from converter l, inverting the polarity, and outputting it.
03,105 (See Figure 4 (14) and (16))
The signal is supplied to the full adders 4a and 4b as follows.
そして、全加算器４ａ、 ４ｂにおいて、ラッチ回路２
ａ、２ｂ、３ａ、３ｂより供給されるラッチデータ１０
２と１０３．１０４と１０５を夫々加算する事により、
ラッチデータ１０２と１０３との差分値、ラッチデータ
１０４と１０５との差分値が色差復調データとして全加
算器４ａ、４ｂより出力される。Then, in the full adders 4a and 4b, the latch circuit 2
Latch data 10 supplied from a, 2b, 3a, 3b
By adding 2 and 103, 104 and 105 respectively,
The difference value between latch data 102 and 103 and the difference value between latch data 104 and 105 are outputted from full adders 4a and 4b as color difference demodulation data.
尚、本実施例ではＡ／Ｄ変換器ｌより出力されるディジ
タルカラーデータ１０１を“２”の補数系とし、この様
にする事により全加算器４ａ、４ｂにおける減算処理は
次の様になる。In this embodiment, the digital color data 101 output from the A/D converter 1 is in the "2" complement system, and by doing so, the subtraction processing in the full adders 4a and 4b is as follows. .
Ｄ ＣＸ 、 ＝ ＣＸ 、 ＋（ｚ ＋ ｔ ）（ｎ
＝・・・−１，０，１，２・・・）上式においてＤＣＸ
、は全加算器４ａ、４ｂより出力される色差復調データ
、Ｃｘｏはラッチデータ１０２あるいは１０４、ＮＣＸ
ｎは該Ｃｘｒｌとは逆極性のラッチデータ１０３あるい
は１０５である。従って、ラッチ回路３ａ、３ｂより出
力されるラッチデータ１０３あるいは１０５を反転して
全加算器４ａ、４ｂに入力し、下位桁から桁上り入力に
“ｌ”を入力する事により上式の演算が行われる。D CX , = CX , +(z + t)(n
=...-1,0,1,2...) In the above formula, DCX
, are color difference demodulated data output from full adders 4a and 4b, Cxo is latch data 102 or 104, and NCX
n is latch data 103 or 105 having a polarity opposite to that of Cxrl. Therefore, by inverting the latch data 103 or 105 output from the latch circuits 3a and 3b and inputting it to the full adders 4a and 4b, and inputting "l" to the carry input from the lower digit, the above equation can be calculated. It will be done.
今、ラッチデータＣＸｎ、ＮＣＸ、を下記の様にＣＸｎ
＝Ｖｃ＋Ｖｏｃ、ＮＣＸｎ＝−Ｖｃ＋Ｖｏｃ（Ｖｃ：デ
ィジタルカラーデータ値、Ｖｏｃ：ディジタルカラーデ
ータの直流オフセット値）と表わすと、色差復調データ
ＤＣＸ、はＤ ＣＸ ｎ” ＣＸ 、 −Ｎ ＣＸ ｎ
＝ ２ Ｖ ｃとなり、ディジタルカラーデータの直流
オフセット値は除去される。Now, change the latch data CXn, NCX, to CXn as shown below.
=Vc+Voc, NCXn=-Vc+Voc (Vc: digital color data value, Voc: DC offset value of digital color data), color difference demodulation data DCX, is D CX n'' CX , -N CX n
= 2 V c, and the DC offset value of the digital color data is removed.
以上の様にして、直流オフセット分が除去された色差復
調データはタイミングコントローラ１２から出力される
ラッチ信号２６（第４図（２１）参照）に従って、ラッ
チ動作を行うラッチ回路２ｃ、 ２ｄによりラッチさ
れ、色差復調データ１０６．１０７（第４図（２２）、
（２３）参照）がラッチされ、係数乗算器５ａ、
５ｃに供給される。As described above, the color difference demodulated data from which the DC offset has been removed is latched by the latch circuits 2c and 2d that perform a latching operation in accordance with the latch signal 26 (see FIG. 4 (21)) output from the timing controller 12. , color difference demodulation data 106.107 (Fig. 4 (22),
(23)) is latched, and the coefficient multiplier 5a,
5c.
第１図において、係数乗算器５ａ〜５ｄ、加算器６ａ。In FIG. 1, coefficient multipliers 5a to 5d and an adder 6a.
６ｂ、フィールドメモリ７ａ、７ｂは信号のフィールド
間相関を利用した周知の一次１１Ｒフィルタを構成して
おり、係数乗算器５ａ、 ５ｃにおいて、係数（１−Ｋ
）が乗算された色差復調データには、フィールドメモリ
７ａ、７ｂより読み出される１フイールド前の色差復調
データが乗算器５ｂ、５ｄにおいて係数Ｋが乗算され、
加算器６ａ、 ６ｂにおいて加算されノイズ成分が除去
された後、ラッチ回路２ｅ。6b and field memories 7a and 7b constitute a well-known first-order 11R filter that utilizes inter-field correlation of signals, and coefficient multipliers 5a and 5c calculate coefficient (1-K
) is multiplied by the coefficient K in multipliers 5b and 5d by the previous color difference demodulated data read from the field memories 7a and 7b, and
After being added in the adders 6a and 6b and noise components removed, the latch circuit 2e.
２ｆに供給されると共に、フィールドメモリ７ａ、 ７
ｂに記憶される。2f, and field memories 7a, 7
b.
ところで、ＮＴＳＣ方式のカラーテレビジョン信号にお
いては搬送色信号の位相がフィールド期間毎に反転して
いる為、奇数フィールド期間も偶数フィールド期間も同
一の位相のサンプリングクロックにてサンプリングした
場合、画面上において奇数フィールド期間のサンプリン
グ点と、偶数フィールド期間のサンプリング点とは垂直
方向に並ばなくなり、この様なサンプリング動作により
得られたサンプリングデータに対し、フィールドメモリ
に一フィールド前のサンプリングデータを記憶しておき
、新たに入力されたサンプリングデータと、フィールド
メモリに記憶されているサンプリングデータとを用いて
、相関性を利用してたノイズ除去を行った場合には入力
されたサンプリングデータと記憶されているサンプリン
グデータとは画面上において垂直方向の相関性が弱い為
、ノイズ除去後の信号の解像度を劣化させてしまう恐れ
がある。By the way, in an NTSC color television signal, the phase of the carrier color signal is reversed for each field period, so if sampling is performed with the same sampling clock in both the odd and even field periods, the difference on the screen will be The sampling points in the odd field period and the sampling points in the even field period are no longer aligned vertically, and in contrast to the sampling data obtained by such sampling operations, the sampling data one field before is stored in the field memory. , If noise removal is performed using correlation using newly input sampling data and sampling data stored in the field memory, the input sampling data and the stored sampling Since the data has a weak correlation in the vertical direction on the screen, there is a risk that the resolution of the signal after noise removal may deteriorate.
そこで、本実施例では各フィールドにおいて近接するサ
ンプル点のうち、互いに位相が反対のものの差分値を色
差復調データとし、その色差復調データに対して、相関
性を利用したノイズ除去を行う様に構成し、ノイズ除去
後の信号の解像度の劣化を防止している。Therefore, in this embodiment, the difference values of sample points having mutually opposite phases among adjacent sample points in each field are used as color difference demodulation data, and the configuration is such that noise removal is performed on the color difference demodulation data using correlation. This prevents the resolution of the signal from deteriorating after noise removal.
すなわち、本実施例の構成によれば、フィールド画面に
おける各色差復調データの位置が各フィールドとも水平
及び垂直方向の同じ位置にある為、フィールドメモリ等
を用いて相関性を利用したノイズ除去を行った場合、解
像度が低下する事がな（なるからである。That is, according to the configuration of this embodiment, since the position of each color difference demodulated data on the field screen is at the same position in the horizontal and vertical directions in each field, noise removal is performed using field memory or the like using correlation. This is because the resolution will not decrease if
また、第１図に示した実施例において、タイミングコン
トローラ１２からはフィールドメモリ７ａ。In the embodiment shown in FIG. 1, the timing controller 12 also includes a field memory 7a.
７ｂに対して、メモリ制御信号３６が供給されている。A memory control signal 36 is supplied to 7b.
タイミングコントローラ１２では入力端子３３より供給
される複合同期信号を入力し、入力された複合同期信号
より、水平同期パルス（第３図（１）参照）と垂直ブラ
ンキングパルス（第３図（２）参照）を分離し、該水平
同期パルスに同期し、該垂直ブランキングパルスを含む
４Ｈ（Ｈは水平同期期間）の間、ローレベルとなるメモ
リ制御信号（第３図（３）参照）を形成し、フィールド
メモリ７ａ。The timing controller 12 inputs the composite synchronization signal supplied from the input terminal 33, and uses the input composite synchronization signal to generate a horizontal synchronization pulse (see Figure 3 (1)) and a vertical blanking pulse (see Figure 3 (2)). ), and forms a memory control signal (see Fig. 3 (3)) that is synchronized with the horizontal synchronization pulse and becomes low level during 4H (H is the horizontal synchronization period) including the vertical blanking pulse. and field memory 7a.
７ｂは該メモリ制御信号がローレベルの期間、書き込み
／読み出し動作を禁止される。7b is inhibited from writing/reading operations while the memory control signal is at a low level.
そして、上述のメモリ制御信号によりフィールドメモリ
の書き込み／読み出し動作を制御する事により、入力さ
れた色差復調データと、フィールドメモリ７ａ、７ｂか
ら読み出される色差復調データとのフィールド画面上の
対応を一致させると共にフィールドメモリ７ａ、 ７ｂ
における色差復調データの記憶量を一定にし、構成を簡
単にしている。By controlling the write/read operations of the field memory using the above-mentioned memory control signal, the correspondence on the field screen between the input color difference demodulated data and the color difference demodulated data read out from the field memories 7a and 7b is matched. together with field memories 7a, 7b
The storage amount of color difference demodulation data is kept constant to simplify the configuration.
次に、上述の様にノイズ除去処理が施こされた色差復調
データを搬送色信号に変調する処理について説明する。Next, a process of modulating the color difference demodulated data subjected to the noise removal process as described above into a carrier color signal will be described.
第１図において加算器６ａ、 ６ｂより出力された２種
類の色差復調データは夫々ラッチ回路２ｅ、 ２ｆのデ
ータ人力りに供給され、ラッチ回路２ｅ、 ２ｆはタイ
ミングコントローラ１２より出力される互いに位相が９
００ 異なったクロック信号２９．３０（第４図（２６
）、 （２７）参照）に従って、供給されている色差
復調データをラッチし、ラッチされた色差復調データを
エクスクル−シブオア（ＥＸＯＲ）ゲー）８ａ、８ｂに
供給する。In FIG. 1, two types of color difference demodulated data output from adders 6a and 6b are supplied to latch circuits 2e and 2f, respectively. 9
00 Different clock signals 29.30 (Fig. 4 (26
), (27)), the supplied color difference demodulation data is latched, and the latched color difference demodulation data is supplied to exclusive OR (EXOR) games 8a and 8b.
また、ＥＸＯＲゲート８ａ、８ｂにはタイミングコント
ローラ１２より出力される前記クロック信号２９゜３０
が供給されており、ＥＸＯＲゲート８ａ、８ｂからはラ
ッチ回路２ｅ、 ：ｌより供給される色差復調データ
の極性をクロック信号２９．３０によって反転しくクロ
ック信号２９． ３０がハイレベルの期間反転、ローレ
ベルの期間否反転）、更に全加算器４ｃ。Further, the clock signal 29°30 outputted from the timing controller 12 is applied to the EXOR gates 8a and 8b.
EXOR gates 8a, 8b invert the polarity of the color difference demodulated data supplied from latch circuits 2e, :l using clock signals 29.30. 30 is a high level period (inversion), a low level period (non-inversion), and a full adder 4c.
４ｄにおいて、ＥＸＯＲゲート８ａ、８ｂより出力され
る色差復調データに対し、不図示のデータ発生器より発
生され、入力端子Ａ、Ｂより供給されるデータ“ｌ”を
加算するか否かをやはり、クロック信号２９．３０に同
期して行う（クロック信号２９゜３０がハイレベルの期
間加算、ローレベルの期間否加算）。4d, it is also determined whether data "l" generated from a data generator (not shown) and supplied from input terminals A and B is added to the color difference demodulated data output from EXOR gates 8a and 8b. This is performed in synchronization with the clock signals 29 and 30 (addition during periods when the clock signals 29 and 30 are at high level, and addition during periods when clock signals 29 and 30 are at low level).
従って、全加算器６ａ、 ６ｂより出力されるデータ１
０８．１０９ （第４図（３０）、 （３１）参照）
をタイミングコントローラ１２より出力されるクロック
信号３１（第４図（３４）参照）に同期して、交互に出
力する事により、出力切換回路９からは第４図（３５）
に示す様なディジタルカラーデータ１１０が出力される
。Therefore, data 1 output from full adders 6a and 6b
08.109 (See Figure 4 (30) and (31))
By alternately outputting the signals in synchronization with the clock signal 31 (see FIG. 4 (34)) output from the timing controller 12, the output switching circuit 9 outputs the signals shown in FIG. 4 (35).
Digital color data 110 as shown in is output.
そして、出力切換回路９より出力されるディジタルカラ
ーデータ１１０はＤ／Ａ変換器１０において、タイミン
グコントローラ１２より出力されるクロック信号３２（
第４図（３７）参照）に同期してアナログ信号に変換さ
れる事により出力端子３４からは搬送色信号が出力され
る。Then, the digital color data 110 outputted from the output switching circuit 9 is converted to a clock signal 32 (
The carrier color signal is outputted from the output terminal 34 by being converted into an analog signal in synchronization with (see FIG. 4 (37)).
以上、説明して来た様に、色差復調データとして、互い
に極性が反対の搬送色信号のサンプリングデータの差分
値を用いる事により、搬送色信号に発生している直流オ
フセット成分に影響される事な（、搬送色信号より色差
復調データを得て、該色差復調データに対し、相関性を
利用したノイズ除去処理を施こした後、再び搬送色信号
に変換する事ができ、搬送色信号の直流成分が変動して
も色相を変動させずに色信号に対し、ノイズ除去処理を
施こす事ができる様になる。As explained above, by using the difference values of sampling data of carrier color signals with opposite polarities as color difference demodulation data, it is possible to avoid being affected by the DC offset component occurring in the carrier color signals. After obtaining color difference demodulated data from the carrier color signal and performing noise removal processing on the color difference demodulated data using correlation, it can be converted back to the carrier color signal, and the carrier color signal It becomes possible to perform noise removal processing on the color signal without changing the hue even if the DC component changes.
以上説明して来た様に、本発明によれば、信号の劣化を
生じさせずに色信号に対し、ノイズ除去処理を施こす事
ができる色信号処理装置を提供する事ができる様になる
。As explained above, according to the present invention, it is possible to provide a color signal processing device that can perform noise removal processing on color signals without causing signal deterioration. .
第１図は本発明の一実施例の色信号処理装置の概略構成
を示したブロック図である。
第２図、第３図、第４図は第１図の動作を説明する為の
タイミングチャートである。
ｌ・・・・・・・・・・・・・・−・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・Ａ／Ｄ変換器２ａ〜２ｆ・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・川
・・・・・・・・・・・・・ラッチ回路３ａ、 ３ｂ
・・・・・・・・・・・・・・・・・・・・・・・・・
・・・・反転出力ラッチ回路４ａ〜４ｄ・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・川・・
・曲曲間曲全加算器５ａ〜５ｄ・・・・・・・・・・・
・・・曲・・・曲・曲・・・・・・曲曲曲・・曲・乗算
器６ａ、６ｂ ・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・曲・
・曲・・・加算器７ａ、７ｂ ・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・フィー
ルドメモリ８ａ、 ８ｂ ・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・−・・
・・・ＥＸＯＲゲート９・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・・
・・・・曲・・曲・・出力切換回路ｌＯ・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・曲・・・Ｄ／Ａ変換器１
１ ・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・ＰＬk回路FIG. 1 is a block diagram showing a schematic configuration of a color signal processing device according to an embodiment of the present invention. FIGS. 2, 3, and 4 are timing charts for explaining the operation of FIG. 1. l・・・・・・・・・・・・・・・・－・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・
......A/D converter 2a to 2f...
・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・・ Latch circuits 3a, 3b
・・・・・・・・・・・・・・・・・・・・・・・・
...Inverted output latch circuits 4a to 4d...
······················river··
・Inter-song full adders 5a to 5d...
...Song...Song,Song...Song,Song,Song,Song,Song,Multipliers 6a, 6b...................................................................
·······················song·
・Song...adders 7a, 7b...
・・・・・・・・・・・・・・・・・・・・・Field memory 8a, 8b ・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・・・・
・・・EXOR Gate 9・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・
...Song...Song...Output switching circuit lO...
・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・Song...D/A converter 1
1 ・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・PLk circuit
Claims (1)
を用いて色信号に復調し、ノイズ除去処理を施こした後
、再び搬送色信号に変調する装置であって、 前記搬送色信号の基準位相に位相同期したクロック信号
に基づいて搬送色信号をサンプリングし、第１サンプリ
ングデータを出力する第１サンプリング手段と、 前記第１サンプリングデータとは逆位相の第２サンプリ
ングデータを形成し、出力する第２サンプリング手段と
、 前記第１サンプリングデータと、第２サンプリングデー
タとを用いて色差信号を復調し、出力する色差信号復調
手段と、 前記色差信号復調手段より出力される色差信号に対し、
該色差信号の相関性を利用してノイズ除去処理を施こす
ノイズ除去手段とを具備した事を特徴とする色信号処理
装置。[Scope of Claims] An apparatus that demodulates a carrier color signal into a color signal using a clock signal phase-synchronized with its reference phase, performs noise removal processing, and then modulates the carrier color signal again into a carrier color signal, comprising: a first sampling means for sampling a carrier color signal based on a clock signal phase-synchronized with a reference phase of the carrier color signal and outputting first sampling data; and second sampling data having an opposite phase to the first sampling data. a second sampling means for forming and outputting a color difference signal; a color difference signal demodulating means for demodulating and outputting a color difference signal using the first sampling data and second sampling data; and a color difference signal demodulating means for demodulating and outputting a color difference signal using the first sampling data and the second sampling data; For the signal,
1. A color signal processing device comprising: noise removal means for performing noise removal processing using the correlation of the color difference signals.
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12261589A JPH02301286A (en) | 1989-05-15 | 1989-05-15 | Color signal processor |
| US07/907,711 US5315379A (en) | 1989-05-15 | 1992-07-02 | Apparatus for the demodulation of a carrier chrominance signal into color difference signals |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12261589A JPH02301286A (en) | 1989-05-15 | 1989-05-15 | Color signal processor |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02301286A true JPH02301286A (en) | 1990-12-13 |
Family
ID=14840338
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12261589A Pending JPH02301286A (en) | 1989-05-15 | 1989-05-15 | Color signal processor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02301286A (en) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61228792A (en) * | 1985-04-03 | 1986-10-11 | Matsushita Electric Ind Co Ltd | Chrominance signal processor |
| JPS6450693A (en) * | 1987-08-21 | 1989-02-27 | Hitachi Ltd | Noise reducer |
| JPH0616028A (en) * | 1991-01-18 | 1994-01-25 | Mazda Motor Corp | Air conditioner for vehicle |
-
1989
- 1989-05-15 JP JP12261589A patent/JPH02301286A/en active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61228792A (en) * | 1985-04-03 | 1986-10-11 | Matsushita Electric Ind Co Ltd | Chrominance signal processor |
| JPS6450693A (en) * | 1987-08-21 | 1989-02-27 | Hitachi Ltd | Noise reducer |
| JPH0616028A (en) * | 1991-01-18 | 1994-01-25 | Mazda Motor Corp | Air conditioner for vehicle |
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