JPH02239078A - Device for transmitting information of elevator - Google Patents
Device for transmitting information of elevatorInfo
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Landscapes
- Indicating And Signalling Devices For Elevators (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はエレベータの情報伝送装置に係り、特にエレベ
ータの制御情報と一般のサービス情報（画像，音声等）
とを時分割多重伝送するのに好適なエレベータの情報伝
送装置に関する。[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to an elevator information transmission device, and particularly relates to elevator control information and general service information (images, audio, etc.).
The present invention relates to an elevator information transmission device suitable for time-division multiplex transmission of information.
エレベータの情報を機械室にシリアル伝送する装置とし
ては、特開昭５２ １５２０５０号及び特開昭５５−
１６８２９号記載のようにかごに関する情報を一定の周
期で伝送する装百と，特開昭６１−６９６７７号及び特
開昭６１−１９４９４３号記載のようにフロアに関する
情報を一定の周期で伝送する装置がある。また、固定情
報と任意情報を混在する方法としては、特開昭６２
２３９６４５号記載のように任意情報の情報量に合オ〕
せてデータ長を可変設定する方式のものや，特開昭６２
−２７９７５３号記載のように要求があれば一定量の特
定情報をフレーム内の所定の位置に挿入して伝送する方
式のものがある．任意情報として画像情報を伝送する場
合、特開昭６２−２７１５８８号記載のように固定情報
を含まない装置や特開昭６２−２６９４３９号記載のよ
うに固定情報と画像情報を切換えて伝送する装置がある
６（発明が解決しようとする課題〕
上記従来技術において，特開昭５２−１５２０５０号，
特開昭５５−１６８２９号、特開昭６１−６９６７７号
，特開昭６１−１９４９４３号では、かご又はフロアと
機械室間のエレベータ情報に対するシリアル伝送につい
て述べており、かご情報とフロア情報の混在だけでなく
、エレベータ情報（固定情報）と一般情報（任意情報）
の混在方法についても配慮されていない。一方，特開昭
６２−２３９６Ｊ５号，特開昭６２−２７９７５３号で
は固定情報と任意情報の混在は可能だが、任意情報を付
加することにより固定情報の伝送周期が長くなり応答速
度の点で問題がある。同様に特開昭６２−２７１５８８
号、特開昭６２−２６９４３９号においても，任意情報
として画像情報の伝送を可能としているが、固定情報と
切換えて伝送する方式のため固定情報の伝送周期が長く
なるという問題がある。Devices for serially transmitting elevator information to the machine room are disclosed in Japanese Patent Application Laid-Open No. 152050/1983 and Japanese Patent Laid-Open No. 15205-1989.
A device that transmits information about cars at a constant cycle as described in No. 16829, and a device that transmits information about a floor at a constant cycle as described in JP-A-61-69677 and JP-A-61-194943. There is. In addition, as a method of mixing fixed information and arbitrary information,
As described in No. 239645, it is suitable for the amount of arbitrary information]
The data length can also be set variably, and the JP-A-62
As described in No. 279753, there is a method in which a certain amount of specific information is inserted into a predetermined position within a frame and transmitted if requested. When transmitting image information as arbitrary information, a device that does not include fixed information as described in JP-A No. 62-271588 or a device that switches between fixed information and image information and transmits it as described in JP-A-62-269439. 6 (Problem to be solved by the invention) In the above-mentioned prior art, Japanese Patent Application Laid-Open No. 52-152050,
JP-A No. 55-16829, JP-A No. 61-69677, and JP-A No. 61-194943 describe serial transmission of elevator information between a car or a floor and a machine room, and the combination of car information and floor information is described. as well as elevator information (fixed information) and general information (optional information)
There is also no consideration given to the method of mixing. On the other hand, in JP-A-62-2396J5 and JP-A-62-279753, it is possible to mix fixed information and arbitrary information, but adding arbitrary information lengthens the transmission cycle of fixed information, causing problems in terms of response speed. There is. Similarly, JP-A No. 62-271588
JP-A No. 62-269439 also makes it possible to transmit image information as arbitrary information, but there is a problem in that the transmission cycle of fixed information becomes long because it is a system in which the transmission is switched with fixed information.
本発明の目的は、」一記問題点に鑑み成され、特にエレ
ベータに必要な制御情報と任意情報（案内情報，交通情
報，天気予報，画豫情報など）をエレベータ制御に影響
を与えることなく混在して伝送可能なエレベータの情報
伝送装置を提供することにある．
〔課題を解決するための手段〕
上記目的を達成するために本発明は、エレベータの号機
制御装置に設けられた情報伝送端末である親局と、各フ
ロアの情報伝送端末であるフロア用子局とを接統する第
１の伝送路と、前記親局と乗りかごの情報伝送端末であ
るかご用子局とを接続する第２の伝送路とを有し、前記
親局がこれらの子局を順次アドレス指定して情報の授受
を行うエレベータの情報伝送装置において、前記第１及
び第２の伝送路を流れる情報の１周期内に、前記エレベ
ータの制御に関する情報を伝送する第１の期間と、該制
御情報以外の任意の情報を伝送する第２の期間とを含む
ことを特徴とするものである。The purpose of the present invention is to provide control information and optional information (guidance information, traffic information, weather forecast, picture information, etc.) necessary for elevators without affecting elevator control. The object of the present invention is to provide an elevator information transmission device that is capable of mixed transmission. [Means for Solving the Problems] In order to achieve the above object, the present invention provides a master station that is an information transmission terminal provided in an elevator car control device, and a floor slave station that is an information transmission terminal for each floor. and a second transmission path that connects the master station and car slave stations that are information transmission terminals for the car, and the master station connects these slave stations. In an elevator information transmission device that sends and receives information by sequentially addressing the elevator, a first period for transmitting information regarding control of the elevator within one cycle of information flowing through the first and second transmission paths; , and a second period in which any information other than the control information is transmitted.
また、前記第１及び第２の伝送路を流れる情報の１周期
内に，前記エレベータの制御に関する全ての情報を一括
伝送する第１の期間と、該制御情報以外の任意の情報を
ブロソクに分割して該ブロックを複数の周期で分割伝送
する第２の期間とを含むことを特徴とするものであり，
前記第１及び第２の伝送路を流れる情報の１周期内に、
前記エレベータの制御に関する情報を伝送する第１の期
間と、該制御情報以外の任意の情報を伝送する第２の期
間とを含み、該任意の情報以外の任意の情報を伝送する
第３の伝送路を、前記号機制御装置と各フロア間に設け
たことを特徴とするものであ７ｌ＋．
そして、画像情報を分割伝送したり、画面内の人数を検
出したり、エレベータの待客状況を検出したリすること
ができる。Furthermore, within one cycle of the information flowing through the first and second transmission paths, there is a first period in which all information regarding the control of the elevator is transmitted all at once, and any information other than the control information is divided into blocks. and a second period in which the block is divided and transmitted in a plurality of cycles,
Within one period of information flowing through the first and second transmission paths,
A third transmission period that includes a first period for transmitting information regarding control of the elevator and a second period for transmitting any information other than the control information, and transmitting any information other than the control information. 7l+. Then, image information can be divided and transmitted, the number of people on the screen can be detected, and the waiting status of elevators can be detected.
（作用〕
上記構成によれば、所定の周期で繰り返し伝送を行うエ
レベータに必要な制御情報の相互間の空き時間を利用し
て任意情報を一括又は分割して伝送する．これにより、
エレベータ制御の応答速度を落とすことなく、且つ、利
用者に対する多種多様なサービスが可能となる。(Operation) According to the above configuration, the arbitrary information is transmitted all at once or in parts by using the free time between the control information necessary for the elevator, which is repeatedly transmitted at a predetermined cycle.
A wide variety of services can be provided to users without reducing the response speed of elevator control.
以下、本発明の実施例について説明する。 Examples of the present invention will be described below.
まず、第１図に示すエレベータ用情報伝送装置の構成に
ついて説明する。First, the configuration of the elevator information transmission device shown in FIG. 1 will be explained.
ビルの機械室に設置され、各エレベータを制御する号機
制御装置１にはエレベータ制御を行う主マイクロプロセ
ッサ２と伝送処理回路３が含まれ，該伝送処理回路３は
伝送処理を行うワンチップマイコン４とデュアルボーｈ
Ｒ Ａ Ｍ （ Ｒａｒ＋ｄｏｍＡｅｅｅｓａ Ｍｅ
ｍｏｒｙ） ５及び２組のシリアル送受信回路６，７か
ら成る。A unit control device 1 that is installed in a machine room of a building and controls each elevator includes a main microprocessor 2 that controls the elevator and a transmission processing circuit 3, and the transmission processing circuit 3 is connected to a one-chip microcomputer 4 that performs transmission processing. and dual bow h
RAM (Rar+domAeeesa Me
5 and two sets of serial transmitting/receiving circuits 6 and 7.
一方、各フロアには，それぞれ伝送処理回路１０．２０
が設置され、前記伝送処理回路３と伝送路４０によりマ
ルチドロップ的に接続される。On the other hand, each floor has transmission processing circuits 10 and 20.
is installed and connected to the transmission processing circuit 3 and the transmission line 40 in a multi-drop manner.
また，かごにも同様に伝送処理回路３０が設置され、前
記伝送処理回路３と伝送路４１により接続される。各伝
送処理回１１０，２０．３０はワンチップマイコン１１
．，２１．３１とシリアル送受信回路１２，２２．３２
及び入出力バッファ回路１３，２３．３３から成り、該
人出力バッファ回路には表示装置１／Ａ，２４，３４、
インジケータ１５，．２５．３５及び呼び釦１６，２６
．３６が接続される。Further, a transmission processing circuit 30 is similarly installed in the car, and is connected to the transmission processing circuit 3 by a transmission line 41. Each transmission processing time 110, 20.30 is a one-chip microcomputer 11
．． , 21.31 and serial transmitter/receiver circuit 12, 22.32
and input/output buffer circuits 13, 23, and 33, and the human output buffer circuit includes display devices 1/A, 24, 34,
Indicator 15, . 25.35 and call buttons 16, 26
．． 36 are connected.
本実施例の情報伝送装置は、号機制御装ｎ１内に設置さ
れる伝送処理回路３を親局（以下、親局３とする）、各
フロア及びかごに設置される伝送処理回路１０，２０．
３０を子局（以下，子局１．ｏ，２０．３０とする）と
し、親局３から、子局１０，２０，３０に対し，順次呼
びかけを行う・ポーリング方式により情報の授受を行う
。The information transmission device of this embodiment includes a transmission processing circuit 3 installed in the car control device n1 as a master station (hereinafter referred to as the master station 3), and transmission processing circuits 10, 20, 20, 20, 20, 20, 20, 30, 30, 30, 30, 30, 30, 30, 30, 30, 30, 30, 30, 30, 30 in each, respectively, installed in a master station (hereinafter referred to as master station 3).
30 is a slave station (hereinafter referred to as slave station 1.o, 20.30), and the master station 3 sequentially calls the slave stations 10, 20, and 30 and sends and receives information by a polling method.
ここで、フロア用子局１０を例にとり、伝送処理回路に
ついて、より詳細に説明する。Here, the transmission processing circuit will be explained in more detail using the floor slave station 10 as an example.
第２図にフロア用子局１０の回路構成を示す。FIG. 2 shows the circuit configuration of the floor slave station 10.
処理を行うワンチップマイコン１１を中心に、伝送用送
受信回路１２、パルストランス１７及び人出力バッファ
回路１３で構成され、ワンチップマイコン１１から出力
される情報伝送に関する信号、すなわち、送信許可信号
ＴＸＥＮ、送信信号ＴＸＤ、シリアルクロックＳ Ｃ
Ｌ Ｋは送受信回路１２に入力し，パルストランス１７
を介して伝送路４０に出力する．一方、伝送路４０から
入力される信号は、逆にパルストランス１７を介して送
受信回路１２に入力され、受信信号ＲＸＤとしてワンチ
ップマイコン１１に人力される。It is composed of a one-chip microcomputer 11 that performs processing, a transmission transmitting/receiving circuit 12, a pulse transformer 17, and a human output buffer circuit 13. Signals related to information transmission output from the one-chip microcomputer 11, that is, a transmission permission signal TXEN, Transmission signal TXD, serial clock SC
LK is input to the transmitter/receiver circuit 12, and the pulse transformer 17
It is output to the transmission line 40 via. On the other hand, the signal inputted from the transmission line 40 is inputted to the transmitting/receiving circuit 12 via the pulse transformer 17, and then inputted to the one-chip microcomputer 11 as a received signal RXD.
また、ワンチップマイコン１１の入出力機器に関する信
号、すなわち、表示器用出力信号ＯＵＴ１、インジケー
タ用出力信号ＯＵＴ２及び呼び釦入力信号ＩＮＩはそれ
ぞれ出力パッファ回路１３ａ，１３ｂ及び入力バソファ
回路１３ｃに接続され、更に出力バソファ回路１３ａの
出力は表示器１４に，出力バッファ回路１３ｌ）の出力
はインジケータ１５と呼び釦１６に並設されている応答
灯１６″に呼び釦１６からの信号は、入カバッファ圓路
１：３０に接続される．
なお、出力バッファ回路１３ａは、Ｗ準的なシリアルイ
ンタフェースであるＲＳ−２３２Ｃ規格の信号に変換す
る回路であり，出力バッファ回路１３ｂは，方向灯、か
ご位置表示灯及び前記応答灯を駆動するためのダーリン
トントランジスタアレイであり、入カバッファ回路１３
０は、電圧比較により接点情報ｋ検出するコンパレー夕
回路である。Further, signals related to the input/output devices of the one-chip microcomputer 11, that is, the display output signal OUT1, the indicator output signal OUT2, and the call button input signal INI are connected to the output buffer circuits 13a, 13b and the input bath sofa circuit 13c, respectively. The output of the output buffer circuit 13a is sent to the indicator 14, the output of the output buffer circuit 13l is sent to the indicator 15, and the signal from the call button 16 is sent to the input buffer circle 1 :30. The output buffer circuit 13a is a circuit that converts signals to RS-232C standard signals, which are W-like serial interfaces. A Darlington transistor array for driving the response light, and an input buffer circuit 13.
0 is a comparator circuit that detects contact information k by voltage comparison.
本回路における送受信回路１２の横成及び動作を第３図
〜第５図により説明する。The configuration and operation of the transmitter/receiver circuit 12 in this circuit will be explained with reference to FIGS. 3 to 5.
まず，第３図により構成を説明する。前記ワンチップマ
イコン１１から出力される送信信号Ｔ×Ｄはインバータ
ＩＮＶＩの入力端子とフリップフロップＦＦＩのＫ端子
に接続され，ＩＮＶＩの出力端子はフリップフロツプＦ
ＦＩのＪ端子と同ＦＦ２のＫ及びＪ端子に接続される。First, the configuration will be explained with reference to FIG. The transmission signal T×D output from the one-chip microcomputer 11 is connected to the input terminal of the inverter INVI and the K terminal of the flip-flop FFI, and the output terminal of INVI is connected to the flip-flop FFI.
It is connected to the J terminal of FI and the K and J terminals of FF2.
また、ワンチップマイコン１１の出力であるシリアルク
ロツクＳＣＬＫは，インバータＩＮＶ２の入力端子に接
続され，該インバータＩＮＶ２の出力端子はインバータ
ＩＮＶ３の入力端子と前記フリップフロップＦＦ２のＣ
Ｋ端子に接続される。Further, the serial clock SCLK which is the output of the one-chip microcomputer 11 is connected to the input terminal of the inverter INV2, and the output terminal of the inverter INV2 is connected to the input terminal of the inverter INV3 and the C of the flip-flop FF2.
Connected to K terminal.
インバータＩＮＶ３の出力端子はインバータＩＮＶ４の
入力端子に接続され，該インバータＩＮＶ４の出力端子
は前記フリッププロップＦ｝？１のＣＫ端子に接続され
る。The output terminal of the inverter INV3 is connected to the input terminal of the inverter INV4, and the output terminal of the inverter INV4 is connected to the flip-flop F}? Connected to the CK terminal of 1.
フリップフロップＦＦＩの非反転出力端７−Ｑは入カナ
ンドＮ Ａ Ｎ Ｄ ．１及びＮ Ａ Ｎ Ｉ） ２の
一方の入力端子に接続され、フリップフロツブＦＦ２の
非反転出力端子Ｑが２人カナンドＮ Ａ Ｎ ｌ’３
２の他の入力端子に、同ＦＦ２の反転出力端ＦＱが２人
力ナンドＮＡＮＤ１の他の人力端子に接続される，前記
２人力ナンドＮＡＮＤ１の出力端子は２人力アンドＡＮ
Ｄ１の入力端子に、２人カナンドＮＡＮＤ２の出力端子
は２人カアンドＡＮＤ２の一方の人力端子に接続され、
ワンチップマイコン１１のもう１本の出力である送信許
可信号ＴＸＥＮが前記２人カアンドＡＮＤ１及びＡＮＤ
２の他の入力端子に共通に接続される。The non-inverting output terminal 7-Q of the flip-flop FFI is connected to the input signal NAND. 1 and N A N I) 2, and the non-inverting output terminal Q of the flip-flop FF2 is
The inverted output terminal FQ of the same FF2 is connected to the other input terminal of the two-man power NAND1, and the output terminal of the two-man power NAND1 is connected to the two-man power AND AN.
The output terminal of the two-person NAND2 is connected to the input terminal of the D1, and the output terminal of the two-person NAND2 is connected to one human power terminal of the two-person AND2.
The transmission permission signal TXEN, which is another output of the one-chip microcomputer 11, is output by the two operators AND1 and AND.
It is commonly connected to the other input terminals of 2 and 2.
２人カアンドＡＮＤＩの出力端子はトランジスタＴｒｌ
のベース端子に、２人カアンドＡＮＤ２の出力端子はト
ランジスタ′ｒ『２のベース端子に接続され，トランジ
スタＴｒｉ及びＴｒ２のエミッタ端子はグランド端子に
接続される。一方、トランジスタＴｒｉのコレクタ端子
はダイオードＤ１のカソード端子に、トランジスタＴｒ
２のコレクタ端子はダイオードＤ２のカソード端子に接
続され、ダイオードＤ１のアノード端子は一次側３＠子
のパルストランス１７ （巻数比Ｎ１ ： Ｎ２ ：
Ｎ３＝１ ： １ ： １）の巻線Ｎｌ側入力端子及び
ダイオードＤ３のアノード端子に、ダイオードＤ２のア
ノード端子は、前記パルストランス１７の一次側巻線Ｎ
２側入力端子及びダイオードＤ４のアノード端子に接続
される。パルストランス１７の一次巻線Ｎ１とＮ２の接
続点である中間端子は抵抗Ｒ１の一端に、該抵抗Ｒ１の
他端は＋５ｖ電源に接続され、パルストランスの二次巻
線Ｎ３の出力端子は伝送路４０に接続される。The output terminal of the two-person ANDI is a transistor Trl.
The output terminal of the two-man AND2 is connected to the base terminal of the transistor 'r'2, and the emitter terminals of the transistors Tri and Tr2 are connected to the ground terminal. On the other hand, the collector terminal of the transistor Tri is connected to the cathode terminal of the diode D1.
The collector terminal of the diode D2 is connected to the cathode terminal of the diode D2, and the anode terminal of the diode D1 is connected to the primary side of the pulse transformer 17 (turns ratio N1:N2:
The anode terminal of the diode D2 is connected to the input terminal of the winding Nl side of the pulse transformer 17 (N3=1:1:1) and the anode terminal of the diode D3.
It is connected to the second side input terminal and the anode terminal of the diode D4. The intermediate terminal that is the connection point between the primary windings N1 and N2 of the pulse transformer 17 is connected to one end of the resistor R1, the other end of the resistor R1 is connected to the +5V power supply, and the output terminal of the secondary winding N3 of the pulse transformer is connected to the transmission terminal. 40.
前記ダイオードＩ）３，Ｄ４のカソード端子は共通にし
て抵抗Ｒ２の一端に接続され、該抵抗Ｒ２の他端は抵抗
Ｒ３の一端、コンデンサＣ１の一端、ダイオードＤ５の
アノード端子及びダイオードＤ６のカソード端子、更に
，コンパレータＣＯＭ ｉの反転入力端子に共通に接続
される。コンパレータＣＯＭＩの非反転入力端子は抵抗
Ｒ４とＲ６の一端に接続され、コンバレータＣＯＭ１の
出力端子は抵抗Ｒ５，Ｒ７の一端及び抵抗Ｒ４の他端に
接続される。抵抗Ｒ７の他端は゛コンデンサＣ２の一端
とインバータＩＮＶ５の入力端了〜に接続され、インバ
ータＩＮＶ５の出力端子は抵抗Ｒ８の一端に接続さわる
。抵抗Ｒ８の他端はコンデンサＣ３の一端とインバータ
ＩＮＶ６の入力端子に接続され、インバータＩＮＶ６の
出力端子は受信侶号Ｒ×Ｄとしてワンチップマイコン１
１に接続される。The cathode terminals of the diodes I)3 and D4 are commonly connected to one end of the resistor R2, and the other end of the resistor R2 is connected to one end of the resistor R3, one end of the capacitor C1, the anode terminal of the diode D5, and the cathode terminal of the diode D6. , further commonly connected to the inverting input terminal of the comparator COM i. A non-inverting input terminal of the comparator COMI is connected to one end of the resistors R4 and R6, and an output terminal of the comparator COM1 is connected to one end of the resistors R5 and R7 and the other end of the resistor R4. The other end of the resistor R7 is connected to one end of the capacitor C2 and the input terminal of the inverter INV5, and the output terminal of the inverter INV5 is connected to one end of the resistor R8. The other end of the resistor R8 is connected to one end of the capacitor C3 and the input terminal of the inverter INV6, and the output terminal of the inverter INV6 is connected to the one-chip microcomputer 1 as the receiver number R×D.
Connected to 1.
前記コンデンサＣｌ，Ｃ２，Ｃ３，抵抗Ｒ３の他端及び
ダイオードＤ６の７ノード端子は共通にしてグランド端
子に，前記ダイオードＤ５のカソード端子は＋１５Ｖ電
源に，前記抵抗Ｒ５，Ｒ６の他端は共通にして＋ＳＶｔ
源に接続される。The other ends of the capacitors Cl, C2, C3, the resistor R3, and the 7-node terminal of the diode D6 are connected to the ground terminal, the cathode terminal of the diode D5 is connected to the +15V power supply, and the other ends of the resistors R5 and R6 are connected to the ground terminal. Te+SVt
connected to the source.
次に、第４図により送信動作を説明する。Next, the transmission operation will be explained with reference to FIG.
ワンチップマイコン１１はデータの送信に先ｑち、まず
，送信許可信号ＴＸＥＮを″゛１″にし，第３図に示す
２人カアンドＡＮＤＩ，ＡＮＤ２を出力町能な状態とす
る。その後、ワンチップマイコン１１からスタートビッ
ト（Ｓ′ｒ）１ビット、データ８ビット（例” ０ １
０ １ ０ １ ０ ０ ” ）、パリティピット（
ＰＴ）１ビット、ストップビット（ＳＰ）１ビットから
なる一連の送信信号ＴＸＤが出力されると、常時出力さ
れているシリアルクロツクＳＣＬＫの立上がりエッジで
ラッチされるＦＦＩＱなる信号がフリップフロツブＦＦ
Ｉから出力され、２人力ナンドＮＡＮＤｌ，ＮＡＮＤ２
に入力される。同様にフリップフロツプＦＦ２からは、
送信信号ＴＸＤが″Ｏ′″の期間のシリアルクロックＳ
ＣＬＫの立上がりエッジで変化する信号ＦＦ２Ｑが出力
され，２人カナンドＮＡＮＤｌ，ＮＡＮＤ２に入力され
る。したがって、２人カナンドＮＡＮＤＩ，ＮＡＮＤ２
は図示のように、送信信号ＴＸＤの“Ｏ Ｉ１に対応し
て、１ビット毎にＩＩ Ｏ Ｉ１を交互に出力する。Prior to transmitting data, the one-chip microcomputer 11 first sets the transmission permission signal TXEN to "1" to make the two-person AND circuits ANDI and AND2 shown in FIG. 3 capable of outputting. After that, the one-chip microcomputer 11 sends 1 bit of start bit (S'r) and 8 bits of data (for example, "0 1
0 1 0 1 0 0”), parity pit (
When a series of transmission signals TXD consisting of 1 bit (PT) and 1 bit (stop bit) is output, a signal called FFIQ, which is latched at the rising edge of the serial clock SCLK that is constantly output, is sent to the flip-flop FF.
Output from I, two-man power NANDl, NAND2
is input. Similarly, from flip-flop FF2,
Serial clock S during the period when the transmission signal TXD is "O'"
A signal FF2Q that changes at the rising edge of CLK is output and input to the two-person circuits NANDl and NAND2. Therefore, two people canand NANDI, NAND2
As shown in the figure, corresponds to "O I1" of the transmission signal TXD, it alternately outputs II O I1 for each bit.
一方、送信許可信号１”ＸＥＮが１１ １ １＋になる
以前の伝送路４０はハイインピーダンス状態Ｚを維持し
ているが，送信許可信号ＴＸＥＮが１１ １ Ｉ＋にな
ると、２人カナンドＮＡＮ’ＤＩ，ＮＡＮＤ２の出力Ｎ
ＤＩＱ及びＮ Ｉ） ２ Ｑの出力は定常的ニ＋ｉ ．
１ ｕであることから、トランジスタＴｒｉ及び′１”
ｒ２は同時に導通状態となり、これによりパルストラン
ス１７が短絡され、伝送路４０は低インピーダンスとな
る。以後，送信信号ＴＸＤの゛Ｉ １． ＋ｔの期間は
同様に低インピーダンスとなり、安定した信号を伝送す
ることができる。On the other hand, the transmission line 40 maintains the high impedance state Z before the transmission permission signal 1" output N
The outputs of DIQ and N I) 2 Q are stationary d+i .
Since it is 1 u, the transistor Tri and '1''
r2 becomes conductive at the same time, thereby shorting the pulse transformer 17 and making the transmission line 40 low impedance. From now on, the transmission signal TXD's I1. During the +t period, the impedance is similarly low and stable signals can be transmitted.
この状態で図示のように、まず２人カナンドＮＡＮＤ２
の出力ＮＤ２Ｑが１′０゜″になるとトランジスタＴｒ
２は非導通状態となり，このため，パルストランス１７
は活性化され，伝送′ｔＰ１４０に＋５Ｖの伝送信号Ｖ
ｓｊｇが出力される。次に、２人カナンドＮＡＮＤ２の
出力ＮＤ２Ｑが１１ １ Ｉ１２人カナンドＮＡＮＤＩ
（７）出力Ｎ Ｄ Ｉ． Ｑが１１ ０ １１になると
、パルストランス１７は、先ほどとは逆極性に励磁され
るため，伝送信号Ｖ ｓｉｇは−５ｖとなり、以下、送
信信号ＴＸＤがＩｔ ０ １＃となる毎に＋５■、−５
Ｖの信号が伝送路４０に交互に出力される。In this state, as shown in the diagram, first two people
When the output ND2Q of becomes 1'0゜'', the transistor Tr
2 becomes non-conducting, and therefore the pulse transformer 17
is activated, and a +5V transmission signal V is applied to the transmission 'tP140.
sjg is output. Next, the output ND2Q of the two-person canand NAND2 is 11 1 I12-person canand NANDI
(7) Output NDI When Q becomes 11 0 11, the pulse transformer 17 is excited with the opposite polarity, so the transmission signal V sig becomes -5V, and henceforth, every time the transmission signal TXD becomes It 0 1#, +5■, -5
V signals are alternately output to the transmission line 40.
続いて，第５図により受信動作を説明する。Next, the reception operation will be explained with reference to FIG.
例えば、図示のような伝送信号Ｖ ｓｉｇが伝送路４０
から入力されると、パルストランス１７を介して得られ
る信号は，ダイオードＤ３，Ｄ４で全波整流され図示ｖ
１のようになる。ここで，余波整流信号ｖ１は、定常時
には電源電圧＋５ｖを抵る電圧になっており、全波整流
された信号は、この電圧に重畳された格好となる，また
，全波整流時のスリットを吸収するため、コンデンサＣ
ｌを設けており、このときの充放電時定数τはτ＝Ｒ２
・Ｃ１で表わされる。For example, if the transmission signal V sig as shown in the figure is
The signal obtained through the pulse transformer 17 is full-wave rectified by the diodes D3 and D4, and the signal is input as shown in the figure.
It will be like 1. Here, the aftereffect rectified signal v1 has a voltage that resists the power supply voltage +5V during normal operation, and the full-wave rectified signal appears to be superimposed on this voltage. Capacitor C to absorb
l is provided, and the charging/discharging time constant τ at this time is τ=R2
- Represented by C1.
この全波整流信号ｖ１はコンバレータＣＯＭＩの反転入
力端子に入力され、抵抗Ｒ４〜Ｒ６で決定され，コンバ
レータＣＯＭ１の非反転入力端子に人力される比較電圧
Ｖｃｏκと比較される。この比較電圧Ｖ ＣＯＮはヒス
テリシス特性を持ち、高電Ｘ５Ｖで表わされる電圧とな
る。This full-wave rectified signal v1 is input to the inverting input terminal of the comparator COMI, determined by resistors R4 to R6, and compared with a comparison voltage Vcoκ manually input to the non-inverting input terminal of the comparator COM1. This comparison voltage V CON has hysteresis characteristics and is a voltage represented by a high voltage X5V.
したがって、コンバレータＣＯＭ．１の＋’ｆｆｉ ｊ
Ｊ Ｖ ２は全波整流信号ｖ１が比較電圧Ｖ ＣＯＭの
高電位ＶＣＯＭ｝ｌを越えた時点で１１ ０ Ｉ１とな
り、低電位ＶｃｏＭ＋−以下となった時点で＃ ｌ Ｉ
Ｉとなる図示のような波形となる。Therefore, converter COM. 1+'ffi j
J V 2 becomes 110 I1 when the full-wave rectified signal v1 exceeds the high potential VCOM}l of the comparison voltage V COM, and becomes # l I when it becomes below the low potential VcoM+-.
A waveform as shown in the figure becomes I.
このコンパレータＣＯＭＩの出力ｖ２は、抵抗Ｒ ７
，コンデンサＣ２及びインバータＩＮＶ５から成る第１
の遁延回路と同構成の抵抗Ｒ８、コンデンサＣ３及びイ
ンバータＩＮＶ６から成る第２の遅延回路を介し、受信
信号ＲＸＤとしてワンチップマイコン１１に入力される
，
以上のような送受信回路を、全ての伝送処理回路に実装
し、情報の授受を行う。The output v2 of this comparator COMI is connected to the resistor R7
, capacitor C2 and inverter INV5.
The transmitting/receiving circuit as described above is inputted to the one-chip microcomputer 11 as the received signal RXD via a second delay circuit consisting of a resistor R8, a capacitor C3, and an inverter INV6, which have the same configuration as the fugitive circuit. It is installed in the processing circuit and sends and receives information.
次に、第６図〜第９図により第１図に示す情報伝送装置
における情報伝送の手順について説明する。Next, the procedure of information transmission in the information transmission apparatus shown in FIG. 1 will be explained with reference to FIGS. 6 to 9.
第６図に情報伝送の手順をフローチャートで示す。号機
制御装置１の主マイクロプロセッサ２は、処理１００に
おいて、各フロア及びかご子局に対する初期送信情報を
求め、この結果を処理１． Ｏ ］により、デュアルボ
ートＲＡＭ５の送信情報テーブルにセットする。ここで
、この送信情報テーブルは第７図に示すように、エレベ
ータの制御情報を格納する領域２００と情報サービスを
行うための一般情報を格納する領域２０１に大別し、更
に、これらの領域は子局単位に分割し、各々は子局アド
レス部２０２〜２０５，情報部２０６〜２０９及びＢＣ
Ｃ （Ｂ］．ｏｅｋ Ｃｈｅｅｋ Ｃｂａｒａｅｔｏｒ
）部２１０〜２１３で構成する．
続いて、処理１０２により親局３のワンチップマイコン
４は、前記送信情報テーブル２００からかご子局アドレ
ス２０２、かご送信情報２０６及びＢ Ｃ Ｃ ２ ．
１ ０を読み出し，かご子局３０に対して送信する．こ
こで、送信情報とは、かご位置、応答灯制御及び方向灯
制御等の情報である。次に処理１０３により、親局３は
かご子局３０から子局の有する情報を受信し，第８図に
示す受信情翰テーブル３００ （構成については送信情
報テーブルと同様のため説明を省鴫する）に格納する。FIG. 6 shows a flowchart of the information transmission procedure. In process 100, the main microprocessor 2 of the car controller 1 obtains initial transmission information for each floor and car slave station, and uses this result in process 1. O ] is set in the transmission information table of the dual port RAM 5. Here, as shown in FIG. 7, this transmission information table is roughly divided into an area 200 for storing elevator control information and an area 201 for storing general information for providing information services. Divided into slave stations, each having slave station address sections 202 to 205, information sections 206 to 209, and BC.
C (B).oek Cheek Cbaraetor
) parts 210 to 213. Subsequently, in process 102, the one-chip microcomputer 4 of the master station 3 retrieves the car slave station address 202, the car transmission information 206, and the car transmission information 206 from the transmission information table 200.
10 is read and transmitted to the car slave station 30. Here, the transmitted information is information such as car position, response light control, direction light control, etc. Next, in process 103, the master station 3 receives information possessed by the child station from the car slave station 30, and creates a reception information table 300 shown in FIG. ).
ここで、受信情報とは、呼び釦の情報である。以下、処
理１０４〜１０７において各階の子局と同様の送受信を
行う。主マイクロプロセッサ２は処理１０８においてデ
ュアルボートＲＡＭ５の受信情報テーブル３００から受
信情報を読み出し，次回の送信情報を決定する。Here, the received information is information on the call button. Thereafter, in processes 104 to 107, the same transmission and reception as with the slave stations on each floor is performed. In process 108, the main microprocessor 2 reads the received information from the received information table 300 of the dual port RAM 5 and determines the next transmission information.
一方、親局３のワンチップマイコン４は、送信情報テー
ブル２０１に送信すべき一般情報が格納されている場合
は処理１０９により、該当する子局に対して例えば“満
員です゛″３階です″といった案内情報を送信し、該当
する子局はこの情報を受信して第１図に示す表示器に表
示する。以下、これら一連の送受信を繰り返す．この時
の伝送路上の信号を第９図に、伝送フォーマットを第１
０図に示す。On the other hand, if the transmission information table 201 stores general information to be transmitted, the one-chip microcomputer 4 of the master station 3 sends a message to the corresponding slave station by processing 109, such as "Full,""Thirdfloor." The corresponding slave station receives this information and displays it on the display shown in Figure 1.The series of transmission and reception is then repeated.The signal on the transmission path at this time is shown in Figure 9. , the transmission format is the first
Shown in Figure 0.
すなわち、第９図のように，親局３から子局に対する送
信情報は伝送路４０，４．１に同時に出力されるが，各
子局は情報の先頭にある子局アドレスを識別し、該当子
局のみ以下の情報を取り込み、該当子局の有する情報を
親局に対して送信する。In other words, as shown in FIG. 9, the transmission information from the master station 3 to the slave stations is simultaneously output to the transmission paths 40 and 4.1, but each slave station identifies the slave station address at the beginning of the information and Only the slave station takes in the following information and transmits the information held by the slave station to the master station.
この場合、かご子局の情報は伝送路４１を、フロア子局
の情報は伝送路４０を介して１！Ａｐｌに伝送される。In this case, the information on the car slave stations is transmitted through the transmission line 41, and the information on the floor slave stations is transmitted through the transmission line 40. Transmitted to Apl.
また、第１０図に示すように、本実施例における伝送周
期′工゛は，各フロアやかご内に設置された呼び釦を操
作してから応答灯の点灯までに不自然さを感じさせない
応答時間（一般に０．１秒以下）を満足するため、４０
＋ｍｓ（応答時間としては８０＋ｍｓ）とし、この中を
前述したかご情報４００（３４ワード）、１６階床分の
フロア情報４０１（１２８ワード）、及び一般情報４０
２に分けて伝送している。Furthermore, as shown in Fig. 10, the transmission period in this embodiment is such that it provides an unnatural response from the time the call button installed on each floor or inside the car is operated until the response light turns on. In order to satisfy the time (generally 0.1 seconds or less), 40
+ms (response time is 80+ms), and includes the above-mentioned car information 400 (34 words), floor information 401 (128 words) for 16 floors, and general information 40.
It is transmitted in two parts.
ここで、本実施例における伝送速度は６４ｋｂｐｓであ
り、これより、かご情報４００の伝送に要する時間は約
６ｍｓ、フロア情報４０１の伝送に要する時間は約２２
ｍｓとなる。したがって、残り１２ｍｓにおいて約７０
ワードの一般情報伝送が可能である．ちなみに、前述し
た″満員です゛′又は″３階です′″といった情報はい
ずれも１０ワード程度で伝送できる。なお，１ワードは
スター１〜ビット４０３、データ４．０４ （８ビット
），パリティビノト４０５，ストップビット４０６の合
計１１ビットから成る。Here, the transmission speed in this embodiment is 64 kbps, which means that the time required to transmit the car information 400 is approximately 6 ms, and the time required to transmit the floor information 401 is approximately 22 kbps.
ms. Therefore, in the remaining 12 ms, approximately 70
It is possible to transmit general information of words. By the way, the aforementioned information such as "Full" or "Third floor" can be transmitted in about 10 words. One word consists of star 1 to bit 403, data 4.04 (8 bits), and parity bit 405. , stop bit 406, totaling 11 bits.
以上述べたように本実施例によれば、エレベータの制御
に必要な情報を伝送するための所定の伝送周期を乱すこ
となく一般情報伝送を可能とし、エレベータ利用者への
サービス向上を図ることができる。As described above, according to this embodiment, it is possible to transmit general information without disturbing the predetermined transmission cycle for transmitting information necessary for elevator control, and it is possible to improve services for elevator users. can.
次に第１１図〜第１７図により本発明の他の実施例につ
いて説明する。Next, other embodiments of the present invention will be described with reference to FIGS. 11 to 17.
本実施例では、前実施例の第１０図に示す一般情報４０
２が１伝送周期内で伝送不町能な情報量となった場合を
画像情報を例にとり説明する。In this embodiment, general information 40 shown in FIG. 10 of the previous embodiment is used.
A case where the amount of information becomes impossible to transmit within one transmission period will be explained using image information as an example.
第１１図に本実施例の構成を示す。図中第１−図と同符
号のものについては同意味のため説明を省略する。FIG. 11 shows the configuration of this embodiment. Components with the same reference numerals as those in FIG.
かご内にカメラ５８を設置し，該カメラ５８の出力はカ
メラ用伝送処理回路５０（以下、カメラｆ局５０とする
）に人力する。該カメラ子局５０はかご子局３０と並列
に伝送路４１に接続する。A camera 58 is installed in the car, and the output of the camera 58 is manually input to a camera transmission processing circuit 50 (hereinafter referred to as camera f station 50). The camera slave station 50 is connected to the transmission line 41 in parallel with the car slave station 30.
一方、号機制御装置１には、親局３と同構成の号機用伝
送処理回路３′（以下、親局３″とする）を設け、伝送
路４２により、管理人室に設置する監視用伝送処理回路
６０（以下、監視子局６０とする）と接続する。該監視
子局６０の出力は、管理人室に設置されるモニターテレ
ビ６７に人力する。On the other hand, the machine control device 1 is equipped with a transmission processing circuit 3' for the machine (hereinafter referred to as the master station 3'') having the same configuration as the master station 3, and a transmission line 42 connects it to a monitoring transmission circuit installed in the manager's room. It is connected to a processing circuit 60 (hereinafter referred to as a monitoring slave station 60).The output of the monitoring slave station 60 is manually supplied to a monitor television 67 installed in the manager's room.
このような構成において、本実施例では、かご内に設置
したカメラ５８で撮影した画像をカメラ子局５０で静止
画とし，親局３、主マイクロブロセノサ２及び親局３′
を介して敷視子局６０に伝送し、モニターテレビ６７に
出力する場合について説明する。In this embodiment, in this embodiment, the image taken by the camera 58 installed in the car is taken as a still image by the camera slave station 50, and the master station 3, the main microprocessor 2, and the master station 3'
A case where the signal is transmitted to the TV station 60 and output to the monitor television 67 will be explained.
第１２図によりカメラ子局５０についてより詳細に説明
する。カメラ５８の出力Ｖｉｎは画像抽出回路５６及び
同期抽出回路５７に並列に入力し、画像抽出回路５６の
出力ＶｉＢはＡ／Ｄ （アナログ／デイジタル）変換回
ｇ５４に入力し、同期抽出回路５７の出力ＶＳＹＮは信
号発生四１５５に入力する。Ａ／Ｄ変換回１５４（７）
出力Ｗ Ｄ Ａ ’ｒは、画像メモリ５３に入力し、信
号発生回路５５の出力ΔＤＣＫは、Ａ／Ｄ変換回銘５４
に、ＷＥ及びＷＡＤＲは画像メモリ５３に入力する。一
方、ワンチップマイコン５１のアドレスバスＭＡＤＨ、
データパスＭＤＡＴを画像メモリ５３に接続する。The camera slave station 50 will be explained in more detail with reference to FIG. The output Vin of the camera 58 is input in parallel to the image extraction circuit 56 and the synchronization extraction circuit 57, the output ViB of the image extraction circuit 56 is input to the A/D (analog/digital) conversion circuit g54, and the output of the synchronization extraction circuit 57 VSYN is input to signal generator 4 155. A/D conversion times 154 (7)
The output WDA'r is input to the image memory 53, and the output ΔDCK of the signal generation circuit 55 is input to the A/D conversion input 54.
Then, WE and WADR are input to the image memory 53. On the other hand, the address bus MADH of the one-chip microcomputer 51,
Connect the data path MDAT to the image memory 53.
以下に、ワンチップマイコン５１、送受信回路５２、パ
ルストランス５９及び伝送路４１については第２図〜第
５図と同様のため説明を省略する。Below, the one-chip microcomputer 51, the transmitting/receiving circuit 52, the pulse transformer 59, and the transmission line 41 are the same as those in FIGS. 2 to 5, and therefore the description thereof will be omitted.
一方、第１３図に示す監視子局６０は、伝送路４２、パ
ルストランス６８、送受信回路６２及びワンチップマイ
コン６１（以上は、第２図〜第５図と同様のため、説明
を省略する）のほかに、画像メモリ６３、Ｄ／Ａ変換回
路６４、信号発生回路６５、同期発生回路６６から成り
、ワンチップマイコン６１のアドレスバスＭＡＤＲ、デ
ータパスＭＤＡＴは画像メモリ６３に接続し、画像メモ
リ６３の出力ＲＤＡＴ及び信号発生回路６５の出力ＤＡ
ＣＫはＤ／Ａ （ディジタル／アナログ）変換回路６４
に入力し、Ｄ／Ａ変換回路６４の出力Ｖｏｕｔはモニタ
ーテレビ６７に入力する。また，同期発生回路６６の出
力Ｖ ｓｖＮは前記信号発生回路６５及びＤ／Ａ変換回
路に入力し、信号発生回路の他の出力ＯＥ及びＲＡＤＲ
は画像メモリ６３に入力する．
本回路の動作を第１４図により説明する。まず、カメラ
子局５０の場合、カメラ５８の出力ｖｊｎが印加される
と、同期抽出回路５７により同期信号Ｖ ｓｖＮが抽出
され信号発生回路５５に入力される。On the other hand, the monitoring slave station 60 shown in FIG. 13 includes a transmission path 42, a pulse transformer 68, a transmitting/receiving circuit 62, and a one-chip microcomputer 61 (the above is the same as that in FIGS. 2 to 5, so the explanation will be omitted). In addition to the above, it also includes an image memory 63, a D/A conversion circuit 64, a signal generation circuit 65, and a synchronization generation circuit 66. The output RDAT of the signal generating circuit 65 and the output DA of the signal generation circuit 65
CK is D/A (digital/analog) conversion circuit 64
The output Vout of the D/A conversion circuit 64 is input to the monitor television 67. Further, the output V svN of the synchronization generation circuit 66 is inputted to the signal generation circuit 65 and the D/A conversion circuit, and the other outputs OE and RADR of the signal generation circuit are inputted to the signal generation circuit 65 and the D/A conversion circuit.
is input to the image memory 63. The operation of this circuit will be explained with reference to FIG. First, in the case of the camera slave station 50, when the output vjn of the camera 58 is applied, the synchronization extraction circuit 57 extracts the synchronization signal VsvN and inputs it to the signal generation circuit 55.
この信号発生回路５５では、同期信号ＶＳＹＮのｑ上が
りエッジに同期したＡ／Ｄ変換用クロック信号ＡＤＣＫ
と画像データを格納する画像メモリ５３のアドレス信号
ＷＡＤＲ及び書込みタイミング信号ＷＥを発生する。This signal generation circuit 55 generates an A/D conversion clock signal ADCK synchronized with the q rising edge of the synchronization signal VSYN.
It generates an address signal WADR and a write timing signal WE for the image memory 53 that stores image data.
一方，画像抽出回路５６から出力される画像信号ＶｉＢ
は．Ａ／Ｄ変換回路５４により、前記Ａ／Ｄ変換用クロ
ックＡＤＣＫに同期したディジタル画像データＷ Ｄ
Ａ Ｔに変換され、前記アドレス信号ＷＡＤＲに対応し
た画像メモリ５３の領域に格納される。マイコン５１は
アドレスバスＭＡＤＲ、データバスＭＤＡＴを介して画
像データを読み出し，伝送路４１を介して親局３に伝送
する９次に、監視子局６０の場合は、前記カメラ子局５
０とは反対に、伝送路４２を介して親局３′から伝送さ
れてくる画像データをマイコン６１が画像メモリ６３に
格納すると、第１４図の（ ）内に示すように，信号発
生回路６６から出力される同期信号ＶＳＹＨの立上がり
ュッジに同期したＤ／Ａ変換用クロック信号ＤＡＣＫ．
読み出し用アドレス信号Ｒ Ａ Ｄ Ｒ及び読み出し夕
゛イミング信号ＯＥにより、画像データＲＤＡＴを順次
アナログの画像信号Ｖｏｕｔに変換し、モニター上に写
し出す。On the other hand, the image signal ViB output from the image extraction circuit 56
teeth. The A/D conversion circuit 54 converts digital image data WD synchronized with the A/D conversion clock ADCK.
AT and stored in the area of the image memory 53 corresponding to the address signal WADR. The microcomputer 51 reads the image data via the address bus MADR and the data bus MDAT, and transmits it to the master station 3 via the transmission line 41.Next, in the case of the monitoring slave station 60, the camera slave station 5
On the contrary, when the microcomputer 61 stores the image data transmitted from the master station 3' via the transmission path 42 in the image memory 63, the signal generation circuit 66 as shown in parentheses in FIG. The D/A conversion clock signal DACK. is synchronized with the rise of the synchronization signal VSYH output from the D/A conversion clock signal DACK.
The image data RDAT is sequentially converted into an analog image signal Vout using the readout address signal R ADR and the readout timing signal OE, and is displayed on the monitor.
このような構成において、情報量の多い画像データをエ
レベータの制御を乱すことなく伝送するため，本実施例
では第１０図に示す伝送フォーマットの一般情報伝送期
間４０２を利用した分割伝送するようにしている。In such a configuration, in order to transmit image data with a large amount of information without disturbing elevator control, in this embodiment, divided transmission is performed using the general information transmission period 402 of the transmission format shown in FIG. There is.
例えば、１画面の構成を第１５図に示すように、水平２
５６画素（Ｈｌ〜Ｈ２５Ｇ）、垂直画素（■１〜Ｖ２５
６）、１画素当たりの分解能を８ｂｉｔとすると、１画
面のデータ量は５ ４ ＫＢｙｔ．ｅとなり，第１０図
に示す１伝送周期Ｔ内で伝送可能なデータ量（ここでは
７０ワード）から１０２４ブロック（Ｂｌ〜Ｂ １ ０
２ ４． ）に分割することにより１画面のデータを
伝送することが可能となる。For example, as shown in Figure 15, one screen has two horizontal
56 pixels (Hl~H25G), vertical pixels (■1~V25
6) If the resolution per pixel is 8 bits, the amount of data for one screen is 54 Kbytes. e, and 1024 blocks (Bl to B 1 0
2 4. ), it becomes possible to transmit data for one screen.
すなわち、第１６図の伝送フォーマットに示すように、
かご情報４００，フロア情報４０１の後に画像データの
ブロック８１〜Ｂｌ０２４を伝送する。このとき、デー
タの先頭にはカメラ子局の子局アドレス！５０１ （１
ワード）とブロックナンバー５０２ （２１ワード）、
その後に画像データ５０３ （６４ワード），最後には
ブロックチェック５０４ （２ワード）を付加した、計
６９ワードのデータ構成として伝送する。That is, as shown in the transmission format of Fig. 16,
After car information 400 and floor information 401, blocks 81 to B1024 of image data are transmitted. At this time, the slave station address of the camera slave station is at the beginning of the data! 501 (1
word) and block number 502 (21 words),
After that, image data 503 (64 words) is added, and block check 504 (2 words) is added at the end, so that the data is transmitted as a total of 69 words.
上記伝送フォーマットにより画像データ伝送を行う際の
主マイクロプロセッサ２、親局３及び親局３′の処理を
第１７図のフローチャートにより説明する。The processing of the main microprocessor 2, the master station 3, and the master station 3' when transmitting image data using the above transmission format will be explained with reference to the flowchart shown in FIG.
通常、親局３″側では処理６１５により管理人室から画
像データ伝送の要求が発生（監視子局６０を介して要求
を発生）するのを待ち、この間、親局３側及び主マイク
ロプロセッサ２側では各々処理６００，処理６０６によ
りエレベータの制御情報に関する処理を実行している。Normally, the master station 3'' side waits for a request for image data transmission to be generated from the manager's room in process 615 (a request is generated via the monitoring slave station 60), and during this time, the master station 3'' side and the main microprocessor On the side, processing related to elevator control information is executed through processing 600 and processing 606, respectively.
ここで，画像データ伝送の要求が発生すると、親局：３
′は、処理６１６によりデュアルボートＲＡＭ５’の画
像データ要求フラグ２の領域７０３に″１′″をセッ１
− Ｌ、要求の発生を知らせる。一方、主マイクロプロ
セッサ２は処理６０７により同領域７０３を定期的に監
視し、領域７０Ｘ３に（Ｌ １ ｎがセツ１〜されると
処理６０８により、デュアルボートＲ Ａ Ｍ５の画像
データ要求フラグ■の領域７００に１１ １ １１をセ
ットし、要求の発生を親局３に知らせる。親局３では同
様に、定期的に同領域７００を監視しており、領域７０
０に１１ １ Ｉ１がセットされると処理６０２により
カメラ子局５０から１ブロック分の画像データを受信し
、デュアルボートＲ Ａ Ｍ ５の画像データ領域７０
１に格納する。更に、処理６０３により１ブロック分の
受信完了を知らせるため、デュアルポートＲＡＭ５の受
信完了フラグ領域７０２に“１′′をセットする。主マ
イクロプロセッサ２は、処理６０８終了後、処理６０９
により、上記領域７０２にｌｊ Ｉ Ｉ１がセットされ
るのを待ち、ａ １ｏがセットされると処理６１０によ
りデュアルボートＲＡＭ５の領域７０１に格納された画
像データをデュアルボードＲＡＭ５’の画像データ領域
７０４に移動（又は複写）する。その後、処理６１１に
よりデュアルポートＲ Ａ Ｍ ５ ’の移動フラグ領
域７０５に″１″′をセットすると共に処理６１２によ
り、デュアルボートＲＡＭ５の受信完了フラグ領域７０
２を“Ｏ ＩＩにリセットする。同様に、親局３′は処
理６１６終了後、処理６１７により，領域７０５に１″
１”がセットされのを待ち，′゛ｌ″′がセットされる
と処理６１８により領域７０４に格納されている１ブロ
ック分の画像データを監視子局６０に送信し，処理６１
９により、デュアルボートＲＡＭ５’の移動フラグ領域
７０５に１１ ０ Ｉｔをリセットする．その後、全画
像データの伝送を完了するまで上記一連の動作を繰り返
すが、親局３の処理６０４で全画像データの受信完了を
検知（伝送フォーマットのブロックナンバーで判断でき
る）すると処理６０５によりデュアルポートＲ Ａ Ｍ
５の画像データ要求フラグ１の領域７００をＩＩ Ｏ
ｌ＋にリセットする。一方、主マイクロプロセッサ２
は、処理６１３において、定期的に同要求フラグ１の領
域７００を監視しており、領域７００がｒｅ Ｏ ｕに
リセットされると、これに従って、処理６１４によりデ
ュアルボートＲＡＭ５’の画像データ要求フラグ２の領
域７０３をＩｊ Ｏ Ｉ＋にリセットする。同様に、親
局３′では，処理６２０により、同要求フラグ２の領域
７０３を監視しており、領域７０３が′゛０”にリセッ
トされると、全画像データの伝送を完了したと判断し、
一連の処理を終ｒする．以上のように，本実施例によれ
ば、画像のように情報量の多いものについてもエレベー
タの制御を正常に行いながら伝送することが可能となる
。Here, when a request for image data transmission occurs, the master station: 3
' is set to "1" in the area 703 of the image data request flag 2 of the dual port RAM 5' by processing 616.
- L, indicates the occurrence of a request. On the other hand, the main microprocessor 2 periodically monitors the same area 703 in process 607, and when (L1n is set 1~) in the area 70X3, in process 608, the image data request flag 11 1 11 is set in the area 700, and the occurrence of the request is notified to the master station 3. Similarly, the master station 3 regularly monitors the same area 700, and
When 11 1 I1 is set to 0, one block of image data is received from the camera slave station 50 in process 602, and the image data area 70 of the dual boat RAM 5 is
Store in 1. Furthermore, in order to notify the completion of reception for one block in process 603, "1'' is set in the reception completion flag area 702 of the dual port RAM 5. After process 608 is completed, the main microprocessor 2 executes process 609.
Waits for lj I I1 to be set in the area 702, and when a 1o is set, the image data stored in the area 701 of the dual board RAM 5 is transferred to the image data area 704 of the dual board RAM 5' in process 610. Move (or copy). Thereafter, in process 611, "1"' is set in the movement flag area 705 of the dual port RAM 5', and in process 612, the reception completion flag area 70 of the dual port RAM 5 is set.
2 to "O II. Similarly, after the process 616 is completed, the master station 3' resets the area 705 to 1" in the process 617.
1'' is set, and when 'l'' is set, one block of image data stored in area 704 is sent to the monitoring slave station 60 in process 618, and process 61 is performed.
9, 11 0 It is reset in the movement flag area 705 of the dual boat RAM 5'. Thereafter, the above series of operations is repeated until the transmission of all image data is completed. When the master station 3 detects the completion of reception of all image data in process 604 (this can be determined by the block number of the transmission format), process 605 R.A.M.
II O
Reset to l+. On the other hand, main microprocessor 2
In the process 613, the area 700 of the same request flag 1 is regularly monitored, and when the area 700 is reset to re O u, the image data request flag 2 of the dual boat RAM 5' is set in the process 614. The area 703 of is reset to Ij O I+. Similarly, the master station 3' monitors the request flag 2 area 703 in process 620, and when the area 703 is reset to '0', it is determined that the transmission of all image data has been completed. ,
Finish the series of processing. As described above, according to this embodiment, it is possible to transmit even a large amount of information such as an image while controlling the elevator normally.
なお、本実施例における１画面の画像データの伝送時間
は約４０秒であるが、伝送時間を短縮したい場合は、単
に伝送速度を大きくする（１２８ｋｈｐｓで約１０秒）
方法のほか、１画素の階調を圧縮する（実用ｊ４ｂｉｔ
階調でも良くこの場合約２０秒）方法や，画素の間引き
、画像圧縮等の方法を用いて高速化を図っても良い。Note that the transmission time for one screen of image data in this example is approximately 40 seconds, but if you wish to shorten the transmission time, simply increase the transmission speed (approximately 10 seconds at 128khps).
In addition to the method, compress the gradation of one pixel (practical j4bit
It is also possible to increase the speed by using a method such as gradation (in this case, approximately 20 seconds), pixel thinning, image compression, or the like.
また、本実施例ではカメラ子局５０を伝送路４１に接続
したが、制御情報と分離するため、第１８図に示すよう
に別の伝送路４３と送受信回路８としても良いし、第１
９図に示すように、任意情報用として他の親局３″を設
けても良い。Further, in this embodiment, the camera slave station 50 is connected to the transmission line 41, but in order to separate it from the control information, it may be connected to another transmission line 43 and the transmitting/receiving circuit 8 as shown in FIG.
As shown in FIG. 9, another master station 3'' may be provided for arbitrary information.
更に、第１図，第１８図，第１９図では親局３内に伝送
路に対応した複数組の送受信回路を設けているが、送受
信回路を１組とし、伝送路を送受信回路の入「】で接続
しても良い。Furthermore, in FIGS. 1, 18, and 19, multiple sets of transmitting/receiving circuits corresponding to the transmission paths are provided in the master station 3, but one set of transmitting/receiving circuits is used, and the transmission path is connected to the input of the transmitting/receiving circuit. ] You can also connect.
また、親局３，３′及び３″′は耐ノイズ性の向−１−
、低コスト化の点でエレベータ制御を行う主マイクロプ
ロセッサ２と同一基板内に設けることが望ましいが、別
にしても良い．
〔発明の効果〕
上述のとおり本発明によれば，情報伝送の１伝送周期内
で、エレベータの制御に必要な情報ばかりでなく、様々
な一般情報を伝送することができるので、エレベータ利
用者に対するサービス向上を図ることができる．In addition, the master stations 3, 3' and 3'' are designed for noise resistance.
From the viewpoint of cost reduction, it is desirable to provide the main microprocessor 2 on the same board as the main microprocessor 2 that controls the elevator, but it may be provided separately. [Effects of the Invention] As described above, according to the present invention, not only information necessary for elevator control but also various general information can be transmitted within one transmission period of information transmission, so that it is possible to transmit various general information to elevator users. It is possible to improve the service.
第１図ないし第３図は本発明の一実旅例を示す構成図，
第４図及び第５図は本実施例の動作を示すタイムチャー
ト、第６図ないし第１０図は本実施例の伝送手ｊ須説明
図，第１１図ないし第１３図は本発明の他の実施例を示
す構成図、第１４図は他の実施例の動作を示すタイム・
チャート、第１５図は１画面のブロック構成図、第１６
図及び第］７図は他の実施例の伝送手順説明図、第１８
図及び第１９図は他の実施例の変形構成図である。
１・・号機制御装置，２・・・主マイクロプロセッサ，
３・・・親局、４，１１，２１．３１・・・伝送処理用
ワンチップマイコン、５・・・デュアルボートＲＡＭ、
６，７，１２，２２．３２・・・送受信回路、１０．２
０・・・フロア子局、３０・・かご子局、５０・・・カ
メラ子局，６０・・・監視子局、４０〜４３・・・伝送
路。Figures 1 to 3 are configuration diagrams showing an example of the present invention;
Figures 4 and 5 are time charts showing the operation of this embodiment, Figures 6 to 10 are explanatory diagrams of the transmission method of this embodiment, and Figures 11 to 13 are diagrams showing other methods of the present invention. A configuration diagram showing an embodiment, and FIG. 14 is a time diagram showing the operation of another embodiment.
Chart, Figure 15 is a block diagram of one screen, Figure 16
FIG. 7 is an explanatory diagram of the transmission procedure of another embodiment, and FIG.
This figure and FIG. 19 are modified configuration diagrams of another embodiment. 1... Unit control device, 2... Main microprocessor,
3... Master station, 4, 11, 21. 31... One-chip microcomputer for transmission processing, 5... Dual boat RAM,
6, 7, 12, 22.32...transmission/reception circuit, 10.2
0...Floor slave station, 30...Car slave station, 50...Camera slave station, 60...Monitoring slave station, 40-43...Transmission path.
Claims (1)
末である親局と、各フロアの情報伝送端末であるフロア
用子局とを接続する第１の伝送路と、前記親局と乗りか
ごの情報伝送端末であるかご用子局とを接続する第２の
伝送路とを有し、前記親局がこれらの子局を順次アドレ
ス指定して情報の授受を行うエレベータの情報伝送装置
において、前記第１及び第２の伝送路を流れる情報の１
周期内に、前記エレベータの制御に関する情報を伝送す
る第１の期間と、該制御情報以外の任意の情報を伝送す
る第２の期間とを含むことを特徴とするエレベータの情
報伝送装置。 ２、エレベータの号機制御装置に設けられた情報伝送端
末である親局と、各フロアの情報伝送端末であるフロア
用子局とを接続する第１の伝送路と、前記親局と乗りか
ごの情報伝送端末であるかご用子局とを接続する第２の
伝送路とを有し、前記親局がこれらの子局を順次アドレ
ス指定して情報の授受を行うエレベータの情報伝送装置
において、前記第１及び第２の伝送路を流れる情報の１
周期内に、前記エレベータの制御に関する全ての情報を
一括伝送する第１の期間と、該制御情報以外の任意の情
報をブロックに分割して該ブロックを複数の周期で分割
伝送する第２の期間とを含むことを特徴とするエレベー
タの情報伝送装置。 ３、請求項１又は２記載の情報伝送装置において、前記
第２の期間では画像情報を分割伝送することを特徴とす
るエレベータの情報伝送装置。 ４、請求項３記載の情報伝送装置において、前記画像情
報の一画面から該画面内に存在する人の数を検出する検
出手段が設けられているエレベータの情報伝送装置。 ５、請求項１又は２記載の情報伝送装置において、前記
エレベータの制御情報は、前記フロアにおけるエレベー
タ待客状況に関する情報を含むものであるエレベータの
情報伝送装置。 ６、請求項５記載の情報伝送装置において、前記エレベ
ータ待客状況を検出する検出手段は、画像又は赤外線に
基づくものであるエレベータの情報伝送装置。 ７、エレベータの号機制御装置に設けられた情報伝送端
末である親局と、各フロアの情報伝送端末であるフロア
用子局とを接続する第１の伝送路と、前記親局と乗りか
ごの情報伝送端末であるかご用子局とを接続する第２の
伝送路とを有し、前記親局がこれらの子局を順次アドレ
ス指定して情報の授受を行うエレベータの情報伝送装置
において、前記第１及び第２の伝送路を流れる情報の１
周期内に、前記エレベータの制御に関する情報を伝送す
る第１の期間と、該制御情報以外の任意の情報を伝送す
る第２の期間とを含み、該任意の情報以外の任意の情報
を伝送する第３の伝送路を、前記号機制御装置と各フロ
ア間に設けたことを特徴とするエレベータの情報伝送装
置。 ８、請求項７記載の情報伝送装置において、前記号機制
御装置内に、任意情報専用の第２の親局を設けたもので
あるエレベータの情報伝送装置。[Scope of Claims] 1. A first transmission path connecting a master station, which is an information transmission terminal provided in an elevator car control device, and a floor slave station, which is an information transmission terminal on each floor; A second transmission line connecting a master station and a car slave station which is an information transmission terminal for a car, and the master station sequentially addresses these slave stations to send and receive information. In the information transmission device, one piece of information flowing through the first and second transmission paths
An elevator information transmission device characterized in that a period includes a first period for transmitting information regarding control of the elevator, and a second period for transmitting arbitrary information other than the control information. 2. A first transmission path connecting a master station, which is an information transmission terminal provided in the elevator car control device, and a floor slave station, which is an information transmission terminal on each floor, and a first transmission path connecting the master station and the car. and a second transmission line connecting a car slave station which is an information transmission terminal, and in which the master station sequentially addresses these slave stations to send and receive information, 1 of the information flowing through the first and second transmission paths
A first period in which all information related to the control of the elevator is collectively transmitted within a period, and a second period in which any information other than the control information is divided into blocks and the blocks are divided and transmitted in a plurality of periods. An information transmission device for an elevator, comprising: 3. The information transmission device for an elevator according to claim 1 or 2, wherein the image information is transmitted in parts during the second period. 4. The information transmission device for an elevator according to claim 3, further comprising a detection means for detecting the number of people present within one screen of the image information. 5. The information transmission device for an elevator according to claim 1 or 2, wherein the elevator control information includes information regarding the elevator waiting status on the floor. 6. The information transmission device for an elevator according to claim 5, wherein the detection means for detecting the elevator waiting status is based on images or infrared rays. 7. A first transmission path connecting a master station, which is an information transmission terminal provided in the elevator car control device, and a floor slave station, which is an information transmission terminal on each floor; and a second transmission line connecting a car slave station which is an information transmission terminal, and in which the master station sequentially addresses these slave stations to send and receive information, 1 of the information flowing through the first and second transmission paths
The cycle includes a first period in which information regarding control of the elevator is transmitted and a second period in which arbitrary information other than the control information is transmitted, and any information other than the arbitrary information is transmitted. An information transmission device for an elevator, characterized in that a third transmission path is provided between a front symbol machine control device and each floor. 8. An information transmission device for an elevator according to claim 7, wherein a second master station exclusively for arbitrary information is provided in the front symbol machine control device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1057063A JP2700404B2 (en) | 1989-03-09 | 1989-03-09 | Elevator information transmission equipment |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1057063A JP2700404B2 (en) | 1989-03-09 | 1989-03-09 | Elevator information transmission equipment |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02239078A true JPH02239078A (en) | 1990-09-21 |
| JP2700404B2 JP2700404B2 (en) | 1998-01-21 |
Family
ID=13044986
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1057063A Expired - Lifetime JP2700404B2 (en) | 1989-03-09 | 1989-03-09 | Elevator information transmission equipment |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2700404B2 (en) |
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Also Published As
| Publication number | Publication date |
|---|---|
| JP2700404B2 (en) | 1998-01-21 |
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