JPH021983Y2 - - Google Patents
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- JPH021983Y2 JPH021983Y2 JP1983025024U JP2502483U JPH021983Y2 JP H021983 Y2 JPH021983 Y2 JP H021983Y2 JP 1983025024 U JP1983025024 U JP 1983025024U JP 2502483 U JP2502483 U JP 2502483U JP H021983 Y2 JPH021983 Y2 JP H021983Y2
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- JP
- Japan
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- emitting element
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- 238000003491 array Methods 0.000 claims description 10
- 238000010586 diagram Methods 0.000 description 8
- 230000003287 optical effect Effects 0.000 description 4
- 230000000087 stabilizing effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 108091008695 photoreceptors Proteins 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
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- Printers Or Recording Devices Using Electromagnetic And Radiation Means (AREA)
- Fax Reproducing Arrangements (AREA)
- Facsimile Image Signal Circuits (AREA)
- Control By Computers (AREA)
Description
【考案の詳細な説明】
（技術分野）
本考案は光プリンタ用の発光素子駆動回路に関
する。
する。
（従来技術）
発光素子（例えばLED）を128個程度モノリシ
ツクに集積化した発光素子アレイ（例えばLED
アレイ）を複数個用いることにより、光プリンタ
の光源とすることができる。このようなLEDア
レイは製造ロツトの相異等に原因して輝度特性が
異なり、又同一特性のものを選択することも難し
い。
ツクに集積化した発光素子アレイ（例えばLED
アレイ）を複数個用いることにより、光プリンタ
の光源とすることができる。このようなLEDア
レイは製造ロツトの相異等に原因して輝度特性が
異なり、又同一特性のものを選択することも難し
い。
このような欠点を補うために、LEDアレイ単
位に発光時間を制御し光プリンタの感光体に与え
る光量をほぼ一定となるようなLED駆動方法が
考えられる。第１図に従来のLED駆動回路を示
す。第１図において、１1〜１10は夫々128個の
LEDからなるLEDアレイ、２1〜２10は夫々安定
化抵抗ＲとトランジスタTraの128対からなる電
流増幅器、３1〜３10はその電流供給端子、４は
1280段のシフトレジスタcm2である。
位に発光時間を制御し光プリンタの感光体に与え
る光量をほぼ一定となるようなLED駆動方法が
考えられる。第１図に従来のLED駆動回路を示
す。第１図において、１1〜１10は夫々128個の
LEDからなるLEDアレイ、２1〜２10は夫々安定
化抵抗ＲとトランジスタTraの128対からなる電
流増幅器、３1〜３10はその電流供給端子、４は
1280段のシフトレジスタcm2である。
第２図は第１図のLED駆動回路の信号図であ
る。
る。
第１図での動作を第２図を用いて説明する。記
録開始信号S1の後、極く短かいデータ書込時間S2
の間に画信号Ｑがシフトレジスタ４に記憶され
る。その後直ちに記録時間S3となり、この時間S3
内において各LEDアレイに対応した時間幅t1〜
t10を持つ電源電流E1〜E10が電流供給端子３1〜
３10へ与えられる。従つて、各LEDアレイ１1〜
１10のLEDは電源電流E1〜E10とシフトレジスタ
４からの画信号Q1〜Q1280に応じて発光し、電源
電流E1〜E10における時間幅t1〜t10を各LEDアレ
イ１1〜１10の輝度と逆比例させることによつて、
光量を均一化しようとするものである。
録開始信号S1の後、極く短かいデータ書込時間S2
の間に画信号Ｑがシフトレジスタ４に記憶され
る。その後直ちに記録時間S3となり、この時間S3
内において各LEDアレイに対応した時間幅t1〜
t10を持つ電源電流E1〜E10が電流供給端子３1〜
３10へ与えられる。従つて、各LEDアレイ１1〜
１10のLEDは電源電流E1〜E10とシフトレジスタ
４からの画信号Q1〜Q1280に応じて発光し、電源
電流E1〜E10における時間幅t1〜t10を各LEDアレ
イ１1〜１10の輝度と逆比例させることによつて、
光量を均一化しようとするものである。
しかし、このような回路構成においてはLED
アレイ単位での光量の均一化はできるが各LED
発光素子単位での均一化は不可能である。
アレイ単位での光量の均一化はできるが各LED
発光素子単位での均一化は不可能である。
（考案の目的）
本考案の目的は各発光素子アレイ内の発光素子
単位での駆動時間を制御することにより光プリン
タの感光体に与える光量を均一となし、輝度特性
を揃える場合と同一の効果を得ようとするもので
あり、以下詳細に説明する。
単位での駆動時間を制御することにより光プリン
タの感光体に与える光量を均一となし、輝度特性
を揃える場合と同一の効果を得ようとするもので
あり、以下詳細に説明する。
（考案の構成）
第３図は本考案の一実施例を示す発光素子駆動
回路のブロツク図、第４図はその各部の信号図で
ある。
回路のブロツク図、第４図はその各部の信号図で
ある。
第３図において、５1〜５10は夫々128個のLED
からなるLEDアレイ、６1〜６10は夫々安定化抵
抗ＲとトランジスタTraの128対からなる電流増
巾器、７は電流供給端子、８1〜８10は夫々128ビ
ツトのデータラツチ回路、９は比較回路、１０は
画素メモリ、１１はカウンタ、１２はLEDアレ
イ５1〜５10の各LED素子の個々の発光時間調整
用データ群W1〜W10を記憶するメモリ（以下
ROMと称する）であり、この発光時間調整用デ
ータ群W1〜W10は各LED素子の輝度と逆比例さ
せ、輝度と発光時間との積が一定値になるよう
に、各LED素子の発光時間を決定するもので、
タイミングT1〜T10に対応して設けられている。
Ｖは直流電圧を示す。
からなるLEDアレイ、６1〜６10は夫々安定化抵
抗ＲとトランジスタTraの128対からなる電流増
巾器、７は電流供給端子、８1〜８10は夫々128ビ
ツトのデータラツチ回路、９は比較回路、１０は
画素メモリ、１１はカウンタ、１２はLEDアレ
イ５1〜５10の各LED素子の個々の発光時間調整
用データ群W1〜W10を記憶するメモリ（以下
ROMと称する）であり、この発光時間調整用デ
ータ群W1〜W10は各LED素子の輝度と逆比例さ
せ、輝度と発光時間との積が一定値になるよう
に、各LED素子の発光時間を決定するもので、
タイミングT1〜T10に対応して設けられている。
Ｖは直流電圧を示す。
第５図はROM１２に格納された各LED素子の
発光時間調整用データ群W1〜W10を示すもので、
各発光時間調整用データ群W1〜W10はそれぞれ
各LEDアレイ５1〜５10に対応した10個の発光時
間調整用データから構成されており、各データに
おいて１はLED素子を発光状態としもしくは発
光状態を保持し、ＯはLED素子を失光状態とす
る情報である。又、アドレスはLEDアレイの番
号に対応し、即ちアドレス１，１１，２１，…９
１はLEDアレイ５1に、アドレス２，１２，２２，
…９２はLEDアレイ５2に、………、アドレス１
０，２０，…１００はLEDアレイ５10にそれぞれ
対応した発光時間調整用データが格納される。
又、各発光時間調整用データにおける各ビツト１
〜１２８のデータは指定さたアドレス番号に対応
するLEDアレイ内のそのビツト番号に対応した
各LED素子のデータを示す。
発光時間調整用データ群W1〜W10を示すもので、
各発光時間調整用データ群W1〜W10はそれぞれ
各LEDアレイ５1〜５10に対応した10個の発光時
間調整用データから構成されており、各データに
おいて１はLED素子を発光状態としもしくは発
光状態を保持し、ＯはLED素子を失光状態とす
る情報である。又、アドレスはLEDアレイの番
号に対応し、即ちアドレス１，１１，２１，…９
１はLEDアレイ５1に、アドレス２，１２，２２，
…９２はLEDアレイ５2に、………、アドレス１
０，２０，…１００はLEDアレイ５10にそれぞれ
対応した発光時間調整用データが格納される。
又、各発光時間調整用データにおける各ビツト１
〜１２８のデータは指定さたアドレス番号に対応
するLEDアレイ内のそのビツト番号に対応した
各LED素子のデータを示す。
第３図での動作を第４図、第５図を用いて説明
する。記録開始信号S4の後、データ書込時間S5の
間に1280ビツトの画素データＱが画素メモリ１０
に記憶される。その後直ちに記録時間S6となり、
この時間S6はタイミングT1〜T10に分割される。
カウンタ１１はタイミングT1〜T10に対応したク
ロツク信号S7を受け、このクロツク信号を受ける
毎にROM１２の発光時間調整用データ群W1〜
W10を読み出すためのアドレス信号S8を出力す
る。即ち、タイミングT1時に発光時間調整用デ
ータ群W1の各発光時間調整用データを、タイミ
ングT2時に発光時間調整用データ群W2の各発光
時間調整用データを、以下同様にして、各タイミ
ングT3〜T10にそれぞれ発光時間調整用データ群
W3〜W10の各発光時間調整用データを、それぞ
れ読み出すためのアドレス信号S8を出力する。こ
の各発光時間調整用データ群W1〜W10はそれぞ
れ各LEDアレイ５1〜５10に対応した10個のデー
タを持つているので、アドレス信号S8はクロツク
S7を受ける毎に10個のアドレス信号（例えばアド
レス１，２，３，…１０）を出力する。
する。記録開始信号S4の後、データ書込時間S5の
間に1280ビツトの画素データＱが画素メモリ１０
に記憶される。その後直ちに記録時間S6となり、
この時間S6はタイミングT1〜T10に分割される。
カウンタ１１はタイミングT1〜T10に対応したク
ロツク信号S7を受け、このクロツク信号を受ける
毎にROM１２の発光時間調整用データ群W1〜
W10を読み出すためのアドレス信号S8を出力す
る。即ち、タイミングT1時に発光時間調整用デ
ータ群W1の各発光時間調整用データを、タイミ
ングT2時に発光時間調整用データ群W2の各発光
時間調整用データを、以下同様にして、各タイミ
ングT3〜T10にそれぞれ発光時間調整用データ群
W3〜W10の各発光時間調整用データを、それぞ
れ読み出すためのアドレス信号S8を出力する。こ
の各発光時間調整用データ群W1〜W10はそれぞ
れ各LEDアレイ５1〜５10に対応した10個のデー
タを持つているので、アドレス信号S8はクロツク
S7を受ける毎に10個のアドレス信号（例えばアド
レス１，２，３，…１０）を出力する。
まずタイミングT1に対応するクロツク信号S7
を受けるとカウンタ１１はカウント開始し、アド
レス信号S8としてアドレス番号１，２，３，…１
０を順次出力する。このアドレス信号S8により
ROM１２よりアドレス１，２，３，…１０の発
光時間調整用データ群W1の各発光時間調整用デ
ータが順次読み出され比較回路９に入力される。
このアドレス１，２，３，…１０の各発光時間調
整用データはそれぞれLEDアレイ５1，５2，５3，
…５10に対応する。ROM１２よりの発光時間調
整用データ群W1の各発光時間調整用データの読
み出しと並行して画素メモリ１０に格納された画
素データＱのうち、各LEDアレイ５1〜５10のそ
れぞれに対応する128ビツトのデータが前記アド
レス信号S8に同期して画素メモリ１０より出力さ
れ、比較回路９に出力される。比較回路９は128
回路設けられ、画素メモリ１０より読み出された
画素データ１２８ビツトと、ROM１２より読み
出された発光時間調整用データ１２８ビツトとの
論理積をとり、比較結果を出力する。この比較結
果は前記128ビツトの画素データに対応するデー
タラツチ回路、例えば画素データがLEDアレイ
５1に対応のものであればデータラツチ回路８1に
ラツチされ、LEDアレイ５10対応のものであれば
データラツチ回路８10にラツチされるように制御
される。タイミングT1に対応する発光時間調整
用データ群W1の全ての発光時間調整用データの
全てのビツトはすべて１にセツトされ、画素メモ
リ１０より読み出される画素データの内容に変化
を与えない。即ち、比較回路９の入力Ａと出力Ｃ
とが全く同一の値となるように設定されている。
従つてタイミングT1では画素メモリの画素デー
タそのものがデータラツチ回路８1〜８10に順次
書き込まれ、電流増幅器６1〜６10を介して画素
データに応じてLEDアレイ５1〜５10の各LED素
子が発光開始する。カウンタ１１は次のクロツク
S7を受けるとタイミングT2に対応したカウント
動作を行なう。
を受けるとカウンタ１１はカウント開始し、アド
レス信号S8としてアドレス番号１，２，３，…１
０を順次出力する。このアドレス信号S8により
ROM１２よりアドレス１，２，３，…１０の発
光時間調整用データ群W1の各発光時間調整用デ
ータが順次読み出され比較回路９に入力される。
このアドレス１，２，３，…１０の各発光時間調
整用データはそれぞれLEDアレイ５1，５2，５3，
…５10に対応する。ROM１２よりの発光時間調
整用データ群W1の各発光時間調整用データの読
み出しと並行して画素メモリ１０に格納された画
素データＱのうち、各LEDアレイ５1〜５10のそ
れぞれに対応する128ビツトのデータが前記アド
レス信号S8に同期して画素メモリ１０より出力さ
れ、比較回路９に出力される。比較回路９は128
回路設けられ、画素メモリ１０より読み出された
画素データ１２８ビツトと、ROM１２より読み
出された発光時間調整用データ１２８ビツトとの
論理積をとり、比較結果を出力する。この比較結
果は前記128ビツトの画素データに対応するデー
タラツチ回路、例えば画素データがLEDアレイ
５1に対応のものであればデータラツチ回路８1に
ラツチされ、LEDアレイ５10対応のものであれば
データラツチ回路８10にラツチされるように制御
される。タイミングT1に対応する発光時間調整
用データ群W1の全ての発光時間調整用データの
全てのビツトはすべて１にセツトされ、画素メモ
リ１０より読み出される画素データの内容に変化
を与えない。即ち、比較回路９の入力Ａと出力Ｃ
とが全く同一の値となるように設定されている。
従つてタイミングT1では画素メモリの画素デー
タそのものがデータラツチ回路８1〜８10に順次
書き込まれ、電流増幅器６1〜６10を介して画素
データに応じてLEDアレイ５1〜５10の各LED素
子が発光開始する。カウンタ１１は次のクロツク
S7を受けるとタイミングT2に対応したカウント
動作を行なう。
即ち、アドレス信号S8としてアドレス番号１
１，１２，…２０を順次出力する。このアドレス
信号S8によりROM１２のアドレスを指定し、ア
ドレス１１，１２，…，２０の発光時間調整用デ
ータ群W2の各発光時間調整用データが順次読み
出され比較回路９に入力される。これと並行して
画素メモリ１０に格納された画素データのうち各
LEDアレイ５1〜５10のそれぞれに対応する128ビ
ツトのデータが前記アドレス信号S8に同期して再
び画素メモリ１０より出力され比較回路９に入力
される。比較回路９では画素メモリ１０より読み
出された画素データ128ビツトとROM１２より
読み出された発光時間調整用データ128ビツトと
の論理積をとり、比較結果を所定のデータラツチ
回路に入力する。この際画素データが１であつて
も発光時間調整用データが０にセツトされている
LED素子は失光する。
１，１２，…２０を順次出力する。このアドレス
信号S8によりROM１２のアドレスを指定し、ア
ドレス１１，１２，…，２０の発光時間調整用デ
ータ群W2の各発光時間調整用データが順次読み
出され比較回路９に入力される。これと並行して
画素メモリ１０に格納された画素データのうち各
LEDアレイ５1〜５10のそれぞれに対応する128ビ
ツトのデータが前記アドレス信号S8に同期して再
び画素メモリ１０より出力され比較回路９に入力
される。比較回路９では画素メモリ１０より読み
出された画素データ128ビツトとROM１２より
読み出された発光時間調整用データ128ビツトと
の論理積をとり、比較結果を所定のデータラツチ
回路に入力する。この際画素データが１であつて
も発光時間調整用データが０にセツトされている
LED素子は失光する。
すなわち、各LED素子対応の発光時間調整用
データの中で輝度と発光時間との積が一定値にな
つたLED素子はそのタイミング以降失光するよ
うにデータとして０が設定されている。
データの中で輝度と発光時間との積が一定値にな
つたLED素子はそのタイミング以降失光するよ
うにデータとして０が設定されている。
以下同様にタイミングT3〜T10においてもタイ
ミングT2と同様の処理がなされる。この結果、
各LED素子はその輝度特性に応じてタイミング
T2〜T10のうちいずれかのタイミングで失光され
るが、各LED素子の輝度と発光時間との積はほ
ぼ均一の値となるものである。尚、発光時間調整
用データ群W10だけは全ての発光時間調整用デー
タの全ビツトがすべて０にセツトされていて、タ
イミングT10では全てのLED素子を失光状態とす
るように設定されている。以上から各LEDアレ
イ５1〜５10の各LED素子は、画素メモリ１０に
応じて発光あるいは失光状態が決まり同時に各
LED素子の輝度と逆比例するように発光時間調
整用データ群W1〜W10をあらかじめ書き込まれ
ているROM１２を用いて最適な発光時間が決ま
り素子単位での光量を均一とすることが出来る。
ミングT2と同様の処理がなされる。この結果、
各LED素子はその輝度特性に応じてタイミング
T2〜T10のうちいずれかのタイミングで失光され
るが、各LED素子の輝度と発光時間との積はほ
ぼ均一の値となるものである。尚、発光時間調整
用データ群W10だけは全ての発光時間調整用デー
タの全ビツトがすべて０にセツトされていて、タ
イミングT10では全てのLED素子を失光状態とす
るように設定されている。以上から各LEDアレ
イ５1〜５10の各LED素子は、画素メモリ１０に
応じて発光あるいは失光状態が決まり同時に各
LED素子の輝度と逆比例するように発光時間調
整用データ群W1〜W10をあらかじめ書き込まれ
ているROM１２を用いて最適な発光時間が決ま
り素子単位での光量を均一とすることが出来る。
以上、本実施例では画素データに応じて同一の
タイミングT1において、各LED素子を発光させ、
しかる後に各LED素子の輝度特性に応じて失光
させるようにしたものであるが、これとは逆に各
LED素子の輝度特性に応じて発光開始のタイミ
ングを制御し、同一のタイミングT10で各LED素
子を失光させるように制御することもできる。
タイミングT1において、各LED素子を発光させ、
しかる後に各LED素子の輝度特性に応じて失光
させるようにしたものであるが、これとは逆に各
LED素子の輝度特性に応じて発光開始のタイミ
ングを制御し、同一のタイミングT10で各LED素
子を失光させるように制御することもできる。
（考案の効果）
本考案は、各発光素子の輝度特性に応じて発光
時間を調整するメモリを有しているので輝度と発
光時間との積すなわち、光量を均一にできる利点
があり、記録濃度が均一な光プリントヘツド及び
LEDデイスプレイ等に利用することができる。
時間を調整するメモリを有しているので輝度と発
光時間との積すなわち、光量を均一にできる利点
があり、記録濃度が均一な光プリントヘツド及び
LEDデイスプレイ等に利用することができる。
第１図と第２図は従来のLED駆動回路結線図
とその説明図、第３図は本考案の一実施例を示す
回路結線図、第４図はその各部の信号説明図、第
５図はROM１２の内容を示した図である。 １1〜１10……LEDアレイ、２1〜２10……電流
増巾器、４……シフトレジスタ、５1〜５10……
LEDアレイ、６1〜６10……電流増巾器、７……
電源供給端子、８1〜８10……データラツチ回路、
９……比較回路、１０……画素メモリ、１１……
カウンタ、１２……ROM、S8……基準時刻のカ
ウント値、Ｗ……発光時間調整用データ群。
とその説明図、第３図は本考案の一実施例を示す
回路結線図、第４図はその各部の信号説明図、第
５図はROM１２の内容を示した図である。 １1〜１10……LEDアレイ、２1〜２10……電流
増巾器、４……シフトレジスタ、５1〜５10……
LEDアレイ、６1〜６10……電流増巾器、７……
電源供給端子、８1〜８10……データラツチ回路、
９……比較回路、１０……画素メモリ、１１……
カウンタ、１２……ROM、S8……基準時刻のカ
ウント値、Ｗ……発光時間調整用データ群。
Claims (1)
- 【実用新案登録請求の範囲】 夫々複数の発光素子を有する複数の発光素子ア
レイ５ｉ（ここで、ｉ＝１〜ｍ）の各発光素子を
駆動するための発光素子駆動回路であつて、 前記各発光素子アレイ５ｉに対応して設けられ
且つ前記各発光素子アレイ５ｉ内の各発光素子対
応に電源電流を供給し得る複数の電流増幅器６ｉ
（ここで、ｉ＝１〜ｍ）と、 前記各電流増幅器６ｉに対応して設けられ且つ
前記各発光素子アレイ５ｉ内の各発光素子対応に
前記各電流増幅器６ｉの駆動状態を設定、保持し
得る複数のデータラツチ回路８ｉ（ここで、ｉ＝
１〜ｍ）と、 データ書込時間S5の間に入力される全ての発光
素子の画素データＱを記憶する画素メモリ１０
と、 各発光素子の発光時間長を制御する発光時間制
御手段とを備え、当該発光時間制御手段は、 前記データ書込時間S5の後に設定される最大記
録時間S6をＮ分割する各タイミングTj（ここで、
ｊ＝１〜Ｎ）に対応したクロツク信号S7を受け、
当該クロツク信号S7を受けるたび毎に前記各タイ
ミングTj及び前記各発光素子アレイ５ｉに対応
したアドレス信号S8を発生するカウンタ１１と、 各発光素子の輝度特性に応じて発光素子単位で
の駆動時間を制御するための発光時間調整用デー
タ群Wj（ここで、ｊ＝１〜Ｎ）を格納するもので
あつて、当該発光時間調整用データ群Wjは、前
記各発光素子アレイ５ｉの各発光素子対応に設け
られた複数のビツト情報からなる発光時間調整用
データを発光素子アレイ５ｉの個数分設けて１組
の発光時間調整用データ群となし、さらに当該発
光時間調整用データ群の組を前記各タイミング
Tjに対応したW1〜WNの複数組として構成される
ものであり、前記各タイミングTj毎に前記カウ
ンタ１１から出力されるアドレス信号S8に応じて
前記各発光時間調整用データ群Wj内の各発光素
子アレイ５ｉに対応した発光時間調整用データを
順次出力するメモリ１２と、 前記メモリ１２から出力される各発光素子アレ
イ５ｉに対応した発光時間調整用データと、前記
画素メモリ１０から出力される各発光素子アレイ
５ｉの画素データとを逐次比較し且つその比較出
力を前記各発光素子アレイ５ｉに対応して設けら
れた前記各データラツチ回路８ｉに入力せしめる
比較回路９とを含むことを特徴とした発光素子駆
動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2502483U JPS59132276U (ja) | 1983-02-24 | 1983-02-24 | 発光素子駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2502483U JPS59132276U (ja) | 1983-02-24 | 1983-02-24 | 発光素子駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59132276U JPS59132276U (ja) | 1984-09-05 |
| JPH021983Y2 true JPH021983Y2 (ja) | 1990-01-18 |
Family
ID=30156030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2502483U Granted JPS59132276U (ja) | 1983-02-24 | 1983-02-24 | 発光素子駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59132276U (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007050597A (ja) * | 2005-08-18 | 2007-03-01 | Seiko Epson Corp | 発光装置、画像形成装置、および表示装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5374830A (en) * | 1976-12-13 | 1978-07-03 | Western Electric Co | Facsimile receiver |
-
1983
- 1983-02-24 JP JP2502483U patent/JPS59132276U/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5374830A (en) * | 1976-12-13 | 1978-07-03 | Western Electric Co | Facsimile receiver |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59132276U (ja) | 1984-09-05 |
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