JPH0218517A - Video clock signal generating method for laser plotter - Google Patents
Video clock signal generating method for laser plotterInfo
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Abstract
Description
【発明の詳細な説明】
し産業上の利用分野]
本発明は、レーザプロッタにおけるビデオブタの発生タ
イミングを決定するビデオクロック信号の発生方法に関
するものである。DETAILED DESCRIPTION OF THE INVENTION FIELD OF INDUSTRIAL APPLICATION The present invention relates to a method for generating a video clock signal that determines the timing of generation of a video pig in a laser plotter.
[従来の技術]
従来よりレーザプロッタにおいては、光ビームを回転ミ
ラー等の偏向手段(以下回転ミラーとして説明する)に
より偏向して記録材上を走査するものであるため、回転
ミラーの回転とビデオクロック信号の発生とを同期させ
な(Jれば、印字位置にばらつきが生じてしまう。[Prior Art] Conventionally, in a laser plotter, a light beam is deflected by a deflecting means such as a rotating mirror (hereinafter referred to as a rotating mirror) to scan a recording material. If the generation of the clock signal is not synchronized, variations will occur in the printing position.
そこで従来は第4図に示すように、記録材1の印字領域
aの印字始点側に隣接する位置に光検出器2を設け、こ
の光検出器2に走査線3を形成するための光ビーム4が
照射されたことを検出すると、これに基づいて所定周波
数のビデオクロック信号を発生するように設定した原点
パルス方式があった。Therefore, conventionally, as shown in FIG. 4, a photodetector 2 is provided at a position adjacent to the printing start point side of the printing area a of the recording material 1, and a light beam for forming a scanning line 3 is directed to the photodetector 2. There is an origin pulse method that is set to generate a video clock signal of a predetermined frequency based on the detection of the irradiation of 4.
またこのほか第5図に示すように、所定の間隔で多数の
スリットを配したグレーティングスリット6を、印字領
域とは異なる領域に設り、このグレーティングスリット
6を印字用の光ビームと同期して走査する走査光8で走
査し、グレーティングスリット透過光から得られる信号
を基にしてPし[(フェイズロックドループ)逓倍回路
等でビデオクOツク信号を発生させるグレーティング方
式もあった。In addition, as shown in FIG. 5, a grating slit 6, which has a large number of slits arranged at predetermined intervals, is provided in an area different from the printing area, and this grating slit 6 is synchronized with the printing light beam. There was also a grating method in which scanning was performed using scanning light 8, and a video clock signal was generated using a (phase-locked loop) multiplier circuit or the like based on the signal obtained from the light transmitted through the grating slit.
[発明が解決しようとする問題点]
しかし上記原点パルス方式では、第6図に示したラスタ
走査線群R8のように、始点側の位置精度は良くても、
終点側に向かうにつれて回転ミラー10を駆動するモー
タの回転ムラによる影響を受け、走査方向の位置の揃い
に比較的にゆっくりとした揺ぎが生じるという問題点が
あった。[Problems to be Solved by the Invention] However, in the above origin pulse method, even if the positional accuracy on the starting point side is good, as in the raster scanning line group R8 shown in FIG.
There is a problem in that as the rotating mirror 10 is moved toward the end point, it is affected by uneven rotation of the motor that drives the rotating mirror 10, and relatively slow fluctuations occur in the alignment of the positions in the scanning direction.
また、後者のグレーティング方式では、印字領域に相当
した幅の広い高精度なグレーティングスリット6を設け
る必要があり、またこのグレーティングスリット6に対
応する幅の広い検出器も必要であった。Furthermore, in the latter grating method, it is necessary to provide a wide and highly accurate grating slit 6 corresponding to the printing area, and a wide detector corresponding to the grating slit 6 is also required.
さらにこのグレーティング方式においては、光学系もグ
レーティングスリット用と印字用の2つの光学系が必要
であり、全体的に装置が高価になるという問題点があっ
た。Furthermore, this grating method requires two optical systems, one for grating slits and one for printing, which poses a problem in that the overall apparatus becomes expensive.
本発明は上記した従来の問題点に鑑み、又、高速回転す
る回転ミラーの回転ムラが比較的に緩慢な変化であるこ
とに着目し、回転ミラー等の偏向手段を用いたレーザプ
ロッタにおける走査方向の印字品質の悪化を防止するビ
デオクロック信号の発生方法を提供することを目的とす
る。The present invention has been developed in view of the above-mentioned conventional problems, and by focusing on the fact that rotational unevenness of a rotating mirror that rotates at high speed changes relatively slowly. An object of the present invention is to provide a method for generating a video clock signal that prevents deterioration of print quality.
[課題を解決するための手段]
本発明のレーザプロッタのビデオクロック信号発生方法
は、走査区間の始点、及び、終点に至るまでの任意の中
間点(以下の説明では終点を例に述べる)を、印字のた
めの走査光と同じ走査光、又は該走査光に同期して走査
する別途の走査光(以下の説明では印字のための走査光
と同じ走査光を例示する)を用いて検出し、始点の検出
に同期して一定のクロックパルス数からなるビデオクロ
ック信号を発生させると共に、終点検出時におけるビデ
オクロック信号の最終クロックパルスの位相比較を行な
い、この位相比較結果に基づいて次の走査線を走査する
時のビデオクロック信号の周波数を微小に可変させるフ
ィードバックをかけるものである。[Means for Solving the Problems] A video clock signal generation method for a laser plotter according to the present invention uses the start point of a scanning section and any intermediate point up to the end point (the end point will be described as an example in the following explanation). , detection using the same scanning light as the scanning light for printing, or a separate scanning light that scans in synchronization with the scanning light (in the following explanation, the same scanning light as the scanning light for printing is exemplified). , generates a video clock signal consisting of a fixed number of clock pulses in synchronization with the detection of the start point, and compares the phase of the final clock pulse of the video clock signal when detecting the end point, and starts the next scan based on the result of this phase comparison. This applies feedback to minutely vary the frequency of the video clock signal when scanning a line.
特に本発明においては、ビデオクロック信号の周波数を
可変させるのに、ベースとなる基本発振周波数f と、
この周波数f□よりも僅かに低い■
周波数f を随時作成し、この周波数fNとf。In particular, in the present invention, in order to vary the frequency of the video clock signal, the basic oscillation frequency f, which is the base,
A frequency f slightly lower than this frequency f□ is created at any time, and this frequency fN and f.
[
とを選択的に組み合わせ、その選択の比率を適宜変えて
ビデオクロック信号を発生することにより、所定数のビ
デオクロック信号の最終パルスと走査区間の終点検出を
同期させている。By selectively combining and appropriately changing the selection ratio to generate a video clock signal, the final pulse of a predetermined number of video clock signals and the detection of the end point of the scanning section are synchronized.
[実施例] 以下本発明を実施例に基づいて説明する。[Example] The present invention will be explained below based on examples.
第1図は本発明を応用したレーザプロッタのビデオクロ
ック信号発生装置の回路構成を示す図である。FIG. 1 is a diagram showing a circuit configuration of a video clock signal generating device for a laser plotter to which the present invention is applied.
ビデオデータ発生部12には、本発明方法によって発生
したビデオクロック信号f が供給さUT
れている。そしてこのビデオデータ発生部12は、別途
図示していない画像情報に基づいて前記ビデオクロック
信号f。ooに同期したビデオ信号を出力し、これを光
変調器14に供給する。光変調器14はビデオ信号に基
づいて変調された印字(露光)用の光ビームを生成し、
この光ビームを回転ミラー18等の偏向走査系を介して
記録材上に投影し走査する。The video data generator 12 is supplied with a video clock signal f generated by the method of the present invention. The video data generating section 12 generates the video clock signal f based on image information not shown separately. A video signal synchronized with oo is output and supplied to the optical modulator 14. The light modulator 14 generates a light beam for printing (exposure) modulated based on the video signal,
This light beam is projected and scanned onto the recording material via a deflection scanning system such as a rotating mirror 18.
検出タイミング発生部16は、前記回転ミラー18の回
転位置を検出することによって、偏向された光ビームが
所定の区間内を走査可能な状態になっているか否かを検
出し、前記ビデオデータ発生部12に出力する。例えば
、後述する検出器20を走査できるような状態に回転ミ
ラー18が位置したことを検出すると、前記ビデオデー
タ発生部12は、画像情報によって変調されたビデオ信
・号ではなく、単に前記検出器20を照射するのに必要
な光ビームを発生させるための信号を出力する。このよ
うに検出タイミング発生部16の出力に基づいて、夫々
所定の区間に所定の光ビームを走査させると共に、回転
ミラー18が露光不用の区間に位置している間は光変調
器14等を休止させるようになっている。The detection timing generating section 16 detects whether or not the deflected light beam is in a state where it can scan within a predetermined section by detecting the rotational position of the rotating mirror 18, and Output to 12. For example, when it is detected that the rotating mirror 18 is positioned in a state where it can scan a detector 20 (described later), the video data generating section 12 simply sends a video signal to the detector 20, rather than a video signal modulated by image information. It outputs a signal for generating the light beam necessary to illuminate 20. In this way, based on the output of the detection timing generator 16, a predetermined light beam is scanned in each predetermined section, and the optical modulator 14 etc. are stopped while the rotating mirror 18 is located in a section where no exposure is required. It is designed to let you do so.
20.22はそれぞれスタート位置検出器とストップ位
置検出器であり、通常、光ビーム検出用フォトダイオー
ドからなる。Reference numerals 20 and 22 denote a start position detector and a stop position detector, respectively, which usually consist of a photodiode for detecting a light beam.
このスタート位置検出器20とストップ位置検出器22
は、光ビーム24を受光して印字開始と印字終了のタイ
ミングを検出するものであり、印字領域aの外側でかつ
記録材26に隣接した所にそれぞれ設置されている。This start position detector 20 and stop position detector 22
are for detecting the timing of the start and end of printing by receiving the light beam 24, and are respectively installed outside the printing area a and adjacent to the recording material 26.
2日はスタート位置検出器20からのスタート検出信号
とストップ位置検出器22からのストップ検出信号をそ
れぞれSET端子とRESET端子に入力し、出力Qか
らスタートストップ信号Aを出力するフリップフロップ
(以下rFFJと略称する)である。On the 2nd, the start detection signal from the start position detector 20 and the stop detection signal from the stop position detector 22 are input to the SET terminal and the RESET terminal, respectively, and a flip-flop (hereinafter referred to as rFFJ) which outputs the start/stop signal A from the output Q is used. ).
30は前記スタート位置検出器20からのスタート検出
信号をSET端子に入力し、後述するクロックカウンタ
34からの信号CをRESET端子に入力して、出力Q
から発振器スタート信号Bを出力するFFである。30 inputs the start detection signal from the start position detector 20 to the SET terminal, inputs the signal C from the clock counter 34 (described later) to the RESET terminal, and outputs Q.
This is an FF that outputs an oscillator start signal B from.
32は可変周波数同期発振器である。この可変周波数同
期発振器32は、前記FF30からの発振器スタート信
号Bが高レベルになると、後述する周波数選択信号Fで
選択指令された周波数のビデオクロック信号f。Ulを
出力し、またこの信号Bが低レベルになるとそのビデオ
クロック信号fOUTの出力を停止する。32 is a variable frequency synchronous oscillator. When the oscillator start signal B from the FF 30 becomes high level, the variable frequency synchronous oscillator 32 generates a video clock signal f of a frequency selected and instructed by a frequency selection signal F, which will be described later. When this signal B becomes low level, the output of the video clock signal fOUT is stopped.
なおこの可変周波数同期発振器32は、後に詳細に述べ
るようにクロック信号出力の周期(周波数)をデジタル
的に制御することができるようになっている。Note that this variable frequency synchronous oscillator 32 is capable of digitally controlling the cycle (frequency) of the clock signal output, as will be described in detail later.
34は、前記可変周波数同期発振器32からのビデオク
ロック信号f。U工のパルス数をカウントするクロック
カウンタであり、そのカウント値がパルス数設定スイッ
チ36に予め設定した数に到達すると信号Cを出力する
。34 is a video clock signal f from the variable frequency synchronous oscillator 32; This is a clock counter that counts the number of pulses of the U-work, and outputs a signal C when the count value reaches the number preset in the pulse number setting switch 36.
38は位相比較器であり、FF28からのスタートスト
ップ信号AとFF30からの発振器スタート信号Bを入
力して両信号の立ち下がりエツジのタイミングを比較し
、信号Aに対して信号Bが進んでいるのか遅れているの
かを示す信号りと、その位相差の絶対値に対応した数の
パルス信号Eを出力する。38 is a phase comparator which inputs the start/stop signal A from the FF 28 and the oscillator start signal B from the FF 30 and compares the timing of the falling edge of both signals, so that the signal B is ahead of the signal A. It outputs a signal indicating whether there is a delay or a delay, and a number of pulse signals E corresponding to the absolute value of the phase difference.
40は、1つの走査線上において、クロック周波数fH
で走査する区間と周波数f、で走査する区間の配置パタ
ーンを、種々の伸縮倍率(補正率)について予め記憶し
た読出し専用メモリ(以下では倍率演算ROMと言う)
であり、伸縮倍率に関する情報および走査線上の現在走
査位置を示す情報が読出しアドレスとして使用される。40 is the clock frequency fH on one scanning line
A read-only memory (hereinafter referred to as a magnification calculation ROM) that stores in advance the arrangement patterns of the section to be scanned at f and the section to be scanned at frequency f for various expansion/contraction magnifications (correction factors).
The information regarding the expansion/contraction magnification and the information indicating the current scanning position on the scanning line are used as the read address.
本実施例においては、基本発振周波数fI+をベースと
して、周波数f をこの周波数fI+よりもし
僅かに低い周波数に設定しており、この周波数f、とf
、を選択的に組み合わせ、その選択の比率を適宜変えた
ビデオクロック信号を可変周波数同期発振器32から発
生させることにより当該クロック信号の進みあるいは遅
れを補正するものである。In this embodiment, based on the fundamental oscillation frequency fI+, the frequency f is set to a slightly lower frequency than this frequency fI+, and this frequency f and f
, and the variable frequency synchronous oscillator 32 generates a video clock signal in which the selected ratio is appropriately changed, thereby correcting the lead or lag of the clock signal.
このため、この倍率演算ROM40は、1走査線中にお
ける周波数f。とf、の配置を後に述べる方式により予
め記憶すると共に、1走査線中における周波数f とf
、の比率をも記憶しており、■
別途指定されたアドレスによって読み出したその記憶値
を周波数選択信号Fとして可変周波数同期発振器32に
供給している。Therefore, this magnification calculation ROM 40 has a frequency f in one scanning line. The arrangement of and f is stored in advance by a method described later, and the frequencies f and f in one scanning line are
, and supplies the stored value read out at a separately specified address to the variable frequency synchronous oscillator 32 as a frequency selection signal F.
また、この倍率演算ROM40の読出しアドレスは、上
位ビットと下位ビットに二分されており、下位ビットア
ドレスはクロックカウンタ34の現在カウント値の出力
から、又、上位ビットアドレスは後述する可変周波数同
期発振器制御カウンタ42の出力の下位ビットから供給
されている。The read address of this multiplication calculation ROM 40 is divided into upper bits and lower bits, and the lower bit address is obtained from the output of the current count value of the clock counter 34, and the upper bit address is obtained from the variable frequency synchronous oscillator control described later. It is supplied from the lower bit of the output of the counter 42.
この可変周波数同期発振器制御カウンタ42(以下「カ
ウンタ」と略称する)は、位相比較器38からの位相差
を示す信号りおよびEを夫々アップダウン端子U/Dと
クロック端子に入力している。This variable frequency synchronous oscillator control counter 42 (hereinafter abbreviated as "counter") inputs the signals I and E indicating the phase difference from the phase comparator 38 to an up/down terminal U/D and a clock terminal, respectively.
そしてこのカウンタ42の出力の上位ビット信号は、前
記可変周波数同期発振器32に対する基本発振周波数f
。の指示信号として供給される。The upper bit signal of the output of this counter 42 is the fundamental oscillation frequency f for the variable frequency synchronous oscillator 32.
. is supplied as an instruction signal.
また、前記カウンタ42の下位ビット出力は、前記上位
ビット信号で指示した基本発振周波数f1で全走査区間
を走査した場合に予想される位相差の補正率(所望伸縮
倍率)を示す信号として使用され、前記倍率演算ROM
40に対する読出しアドレスの上位ビットとして供給さ
れる。Further, the lower bit output of the counter 42 is used as a signal indicating the correction rate (desired expansion/contraction magnification) of the phase difference expected when the entire scanning section is scanned at the basic oscillation frequency f1 indicated by the upper bit signal. , the magnification calculation ROM
It is supplied as the upper bit of the read address for 40.
尚、上記の説明からも明らかなように、前記基本発振周
波数f1自体のデジタル的な最小制御量をより細かくす
るためには、前記カウンタ42がら可変周波数同期発振
器32へ供給される上位ビットのビット数を増加させな
ければならない。逆に、前記カウンタ42の下位出力ビ
ットの数を増加させることによって、前記したf。とf
、との組み合わせによる補正をより細かく多段階に実施
することが可能となる。As is clear from the above explanation, in order to make the digital minimum control amount of the basic oscillation frequency f1 itself more fine, the bits of the upper bits supplied from the counter 42 to the variable frequency synchronous oscillator 32 The number must be increased. Conversely, by increasing the number of lower output bits of the counter 42, the above f. and f
, it becomes possible to perform correction in more detail and in multiple stages.
次に、上記構成からなるビデオクロック信号発生装置の
動作を第1図及び第2図〈タイムチャート)を用いて説
明する。Next, the operation of the video clock signal generator having the above configuration will be explained using FIG. 1 and FIG. 2 (time chart).
第1図において、光ビームは回転ミラー18により偏向
され、図中左から右方向へ記録材26上及びその近傍を
走査する。In FIG. 1, the light beam is deflected by a rotating mirror 18 and scans on and near the recording material 26 from left to right in the figure.
印字開始時にこの光ビームは、スタート位置検出器20
を照射し、その後印字領域aを走査する。At the start of printing, this light beam is transmitted to the start position detector 20.
is irradiated, and then the printing area a is scanned.
スタート位置検出器20は、光ビームを受けると光ビー
ムが始点に来たことを検出し、スタート検出信号にパル
スを1つ発生させる。When the start position detector 20 receives the light beam, it detects that the light beam has reached the starting point, and generates one pulse in the start detection signal.
スタート検出信号をSET端子への入ノ〕信号とするF
F28.30は、このスタート検出信号パルスの立ち上
りに応答して、その出力Qからのスタートストップ信号
Aおよび発振器スタート信号Bをそれぞれ高レベルにす
る。F that uses the start detection signal as the input signal to the SET terminal
F28.30 sets the start/stop signal A and the oscillator start signal B from its output Q to high level in response to the rising edge of the start detection signal pulse.
この発振器スタート信号Bが高レベルになると、これに
応答して可変周波数同期発振器32は発振器スタート信
号Bが高レベルの間、前記カウンタ42から指示された
周波数のビデオクロック信号fOtlTを出力する。When the oscillator start signal B goes high, in response, the variable frequency synchronous oscillator 32 outputs the video clock signal fOtlT at the frequency specified by the counter 42 while the oscillator start signal B goes high.
このビデオクロック信号’ OUTは、ビデオデータ発
生部12に供給されると共に、クロックカウンタ34に
も供給される。This video clock signal 'OUT is supplied to the video data generating section 12 and also to the clock counter 34.
このクロックカウンタ34は、ビデオクロック信号f
に発生ずるクロックパルスの数をカラUT
ントし、パルス数指令スイッチ36の操作により設定さ
れた数だけカウントすると、通常高レベルにある信号C
を一定時間低レベルにする。This clock counter 34 receives a video clock signal f
When the number of clock pulses generated at UT is counted by the number set by operating the pulse number command switch 36, the signal
to a low level for a certain period of time.
この信号Cが低レベルになると、FF30はこの立ち下
がりに応答してリセットされ、その出力Qからの発振器
スタート信号Bを低レベルにする。When this signal C goes low, FF 30 is reset in response to this fall, causing the oscillator start signal B from its output Q to go low.
この発振器スタート信号Bが低レベルになると可変周波
数同期発振器32は発振動作を停止する。When this oscillator start signal B becomes low level, the variable frequency synchronous oscillator 32 stops its oscillation operation.
一方、印字領域aを走査した光ビーム24がストップ位
置検出器22に達すると、ストップ位置検出器22はこ
れを検出し、ストップ検出信号にパルスを1つ発生させ
る。On the other hand, when the light beam 24 that scanned the print area a reaches the stop position detector 22, the stop position detector 22 detects this and generates one pulse in the stop detection signal.
このストップ検出信号をRESET端子に入力するFF
28は、この信号の立ち上りに応答してその出力である
スタートストップ信号Aを低レベルにする。FF that inputs this stop detection signal to the RESET terminal
28 responds to the rising edge of this signal and sets its output, the start/stop signal A, to a low level.
このスタートストップ信号AとFF30がらの発振器ス
タート信号Bを入力する位相比較器38は、これら両信
号の立ち下がりエツジを比較し、位相差が生じると、こ
の位相差の絶対値に対応した数のパルスを信号Eに発生
させ、またスター1へストップ信号Aに対する発振器ス
タート信号Bの進みあるいは遅れに対応して信号りの状
態を高あるいは低レベルに切り変える。The phase comparator 38 inputting this start/stop signal A and the oscillator start signal B from the FF 30 compares the falling edges of these two signals, and if a phase difference occurs, a number of signals corresponding to the absolute value of this phase difference are input. A pulse is generated in signal E, and the state of signal E is switched to high or low level in response to the lead or lag of oscillator start signal B with respect to stop signal A to star 1.
この信号E、Dを入力するカウンタ42は、信号りによ
りアップダウンが決定され、さらに信号Eに発生するパ
ルスをアップ又はダウンカウントする。The counter 42 to which the signals E and D are input is determined to be up or down depending on the signal, and further counts up or down the pulses generated in the signal E.
例えば、信号Eにパルスが5個発生し、信号りが高レベ
ルであると、カウンタ42はそのカウントを「5」アッ
プカウントする。この結果、前記倍率演算ROM40の
上位読出しアドレス及び可変周波数同期発振器32の基
本発振周波数がカウンタ42からの信号により切り変わ
る。この状態のときに再び前述した動作と同様にして走
査が始まると、今度は発振器スタート信号Bが高レベル
になっている時間が前回の走査時よりも5XT。For example, if five pulses occur in signal E and signal E is at a high level, counter 42 increments its count by "5". As a result, the upper read address of the magnification calculation ROM 40 and the basic oscillation frequency of the variable frequency synchronous oscillator 32 are switched by the signal from the counter 42. In this state, when scanning starts again in the same manner as described above, the time period during which the oscillator start signal B is at a high level is 5XT longer than during the previous scanning.
(T、:調整用微小デイレイ時間)だけ長くなり、この
結果スタートストップ信号Aと発振器スタート信号Bの
立ち下がりの位相差が縮まることになる。(T: minute delay time for adjustment), and as a result, the phase difference between the falling edges of the start/stop signal A and the oscillator start signal B is reduced.
このときに、可変周波数同期発振器32は、倍率演算R
OM40からの周波数選択信号Fにより制御される。At this time, the variable frequency synchronous oscillator 32 performs a magnification calculation R
It is controlled by the frequency selection signal F from OM40.
、14
即ち、この選択信号Fが低レベルの時には基本発振周波
数fllの信号を出力し、選択信号Fが低レベルの時に
は調整用周波数f、の信号を出力する。, 14 That is, when the selection signal F is at a low level, a signal with the basic oscillation frequency fll is output, and when the selection signal F is at a low level, a signal with the adjustment frequency f is output.
従って、この周波数選択信号Fを高レベルにするタイミ
ング、及び、その持続時間により可変周波数同期発振器
32が所定数のクロックパルスを出力するのに要する時
間を可変することができ、その結果として発振器スター
ト信号Bが高レベルになる時間が可変されることになる
。Therefore, the time required for the variable frequency synchronous oscillator 32 to output a predetermined number of clock pulses can be varied by changing the timing at which the frequency selection signal F is set to high level and its duration, and as a result, the oscillator starts. The time during which signal B becomes high level will be varied.
上記のようなフィードバックループが走査毎に形成され
ることにより、光ビーム24が印字領域aを走査する間
にビデオクロック信号f。UTに発生するクロックパル
スの数を変えることなく、そのクロックパルスが光ビー
ム24がスタート位置とストップ位置に達するのに同期
してそれぞれ発生及び停止するように制御することがで
きる。By forming a feedback loop as described above for each scan, the video clock signal f is generated while the light beam 24 scans the printing area a. Without changing the number of clock pulses generated at the UT, the clock pulses can be controlled to occur and stop in synchronization with the light beam 24 reaching the start and stop positions, respectively.
本実施例においては、各走査線毎に1本前の走査線にお
ける誤差を検出して位相差を補正しているが、複数本以
上前の走査線で誤差を検出して利用したり、複数本毎に
前述したフィードバックを実施することも可能である。In this embodiment, the phase difference is corrected by detecting the error in the previous scanning line for each scanning line. It is also possible to implement the feedback described above for each book.
また、印字走査が終了した段階で補正のための処理をし
ており、印字速度が遅くなることはない。Furthermore, since the correction process is performed at the stage when the printing scan is completed, the printing speed will not be slowed down.
特に時間に余裕がある場合や、シグナルプロセッサのよ
うな高速演算素子を用いることが出来る場合には、前記
倍率演算ROM40からのデータの読出しを、CPUに
よるデジタル倍率演算処理に代えることも可能である。Especially when there is plenty of time or when a high-speed calculation element such as a signal processor can be used, it is also possible to replace the reading of data from the magnification calculation ROM 40 with digital magnification calculation processing by the CPU. .
なお上記実施例における可変周波数同期発振器32は、
例えば第3図に示すようなデイレイラインを用いたリン
グオシレータを使用して実現している。Note that the variable frequency synchronous oscillator 32 in the above embodiment is
For example, this is realized using a ring oscillator using a delay line as shown in FIG.
そこで次にこのリングオシレータを用いた実施例とその
制御方法について説明する。Next, an embodiment using this ring oscillator and its control method will be described.
従来より安定性に優れた発振器として水晶発振器が用い
られていた。しかしこの水晶発振器は外部から制御可能
な発振周波数の範囲が狭いという欠点があり、また従来
から様々な方法が提案されているように発振の開始及び
停止制御が難しいという欠点もあった。Conventionally, crystal oscillators have been used as oscillators with excellent stability. However, this crystal oscillator has the drawback that the range of oscillation frequencies that can be controlled externally is narrow, and it is also difficult to control the start and stop of oscillation, as various methods have been proposed in the past.
このため前述した本実施例の可変周波数1’ii1期発
振器32の場合では、発振の開始と停止を繰り返し、か
つ発振周波数の範囲を広くとる必要があるのでこの水晶
発振器を用いることができず、第3図に示すようなリン
グオシレータを用いている。For this reason, in the case of the variable frequency 1'ii1 period oscillator 32 of the present embodiment described above, this crystal oscillator cannot be used because it is necessary to repeat the start and stop of oscillation and to widen the range of oscillation frequency. A ring oscillator as shown in FIG. 3 is used.
第3図に示すようにこのリングオシレータは、発振開始
を指示する信号を一入力端に入力するナントゲート44
と、その出力信号を一定時間(例えば50nSEC)遅
延する基本デイレイライン46と、その出力信号をさら
にそれぞれ所定時間(例えば0.1’n5EC)遅延す
る、連なった複数の微小デイレイラインからなる微小デ
イレイライン群48と、デイレイ時間可変指令SELに
入力した信号に応じて基本デイレイライン46及び各微
小デイレイラインの出力を選択出力し、かつその出力信
号をナントゲート44の伯の入力端に供給するマルチプ
レクサ50とから構成されている。As shown in FIG. 3, this ring oscillator has a Nant gate 44 which inputs a signal instructing the start of oscillation to one input terminal.
, a basic delay line 46 that delays the output signal by a certain period of time (for example, 50nSEC), and a microderailleur consisting of a plurality of connected microdelay lines that further delay the output signal by a predetermined period of time (for example, 0.1'n5EC). A multiplexer that selects and outputs the output of the basic delay line 46 and each minute delay line according to the signal input to the input group 48 and the variable delay time command SEL, and supplies the output signal to the input terminal of the Nants gate 44. It consists of 50.
このリングオシレータは次のように動作する。This ring oscillator operates as follows.
はじめに、ナンドゲ−1〜44の一入力端に高レベルの
発振器スタート信号Bが供給されると、通常他端には高
レベルの信号が供給されているためナントゲート44の
出力信号は低レベルになる。First, when a high level oscillator start signal B is supplied to one input terminal of the NAND gates 1 to 44, the output signal of the NAND gate 44 becomes a low level because a high level signal is normally supplied to the other terminal. Become.
この低レベルの出力信号は、基本デイレイライン46に
て50nSEC遅延され、微小デイレイライン群48及
びマルチプレクサ50に供給される。This low level output signal is delayed by 50 nSEC in the basic delay line 46 and is supplied to the micro delay line group 48 and the multiplexer 50.
このマルチプレクサ50は、デイレイ時間可変指令SE
Lに印加されたデジタル信号に基づいて前記各デイレイ
ラインからの信号を選択出力する。This multiplexer 50 is connected to the variable delay time command SE.
The signals from each of the delay lines are selectively output based on the digital signal applied to L.
例えば、基本デイレイライン46の出力信号が選択され
れば、その出力信号がマルチプレクサ50の出力に発生
し、発振出力信号となり、以後50nSEC毎にナント
ゲート44の出力信号の状態が切り変わる。For example, when the output signal of the basic delay line 46 is selected, that output signal is generated at the output of the multiplexer 50 and becomes an oscillation output signal, and thereafter the state of the output signal of the Nant gate 44 changes every 50 nSEC.
また、微小デイレイライン48bの出力信号が選択され
ると、基本デイレイライン46、及び、微小デイレイラ
イン48a、48bにて、50+0.1+0.1=50
.2 (nsEc)遅延された信号が発振出力信号とし
て出力される。Furthermore, when the output signal of the minute delay line 48b is selected, the basic delay line 46 and the minute delay lines 48a and 48b receive 50+0.1+0.1=50
.. The signal delayed by 2 (nsEc) is output as an oscillation output signal.
この発振出力状態は、発振器スタート信号Bが高レベル
のあいだ継続し、この信号が低レベルになると停止する
。前述したように本実施例においては、位相差を補正す
るためにベースとなる周波数f1とこれにより僅かに低
い調整用周波、Il[f 。This oscillation output state continues while the oscillator start signal B is high and stops when this signal goes low. As described above, in this embodiment, the base frequency f1 for correcting the phase difference and the slightly lower adjustment frequency Il[f.
を用いている。この周波数f 、f は、上記りL
ングオシレータにおいて適宜に選択指令した任意所定の
遅延時間を周波数fHに関する周期T、に設定し、かつ
微小デイレイライン群48の各微小遅延時開を調整用微
小デイレイ時間T、に設定すれば、上記リングオシレー
タのデイレイ時間可変指令SELへの供給信号を切り変
えるだけで前述した動作より、
1/T、=fH(Hz)
1/ (TB +To)=f、()lz)を作成するこ
とができる。is used. These frequencies f and f are set by setting the arbitrary predetermined delay time appropriately selected and commanded in the above-mentioned L ring oscillator to the period T with respect to the frequency fH, and adjusting the opening time of each minute delay of the minute delay line group 48. If the delay time is set to T, then by simply switching the signal supplied to the variable delay time command SEL of the ring oscillator, the operation described above will be as follows: 1/T, = fH (Hz) 1/ (TB +To) = f, ()lz) can be created.
また、印字全長を走査するのに要する時間をP丁として
、クロックカウンタ340カウント数を印字全長に必要
なりロックパルス数NALLに設定し、リングオシレー
タが出力する信号の周波数f、のクロックパルス数をN
H1周波数f1のクロックパルス数をN、とすると、時
間PTは次の式で表わされる。In addition, the time required to scan the entire printing length is P, the clock counter 340 count number is set to NALL, which is the number of lock pulses required for the entire printing length, and the number of clock pulses at the frequency f of the signal output by the ring oscillator is set to NALL. N
Assuming that the number of clock pulses at the H1 frequency f1 is N, the time PT is expressed by the following equation.
時間 PT=T8xNH+ (TB+To)xN[
従って、N=N+N であると、このN■ALL
HL
とN、の比率を変えることにより時間PTを可変するこ
とができる。Time PT=T8xNH+ (TB+To)xN [Therefore, if N=N+N, this N■ALL
The time PT can be varied by changing the ratio of HL and N.
即ち、クロックパルス個々の周波数をfH9fLのいず
れにするかリングオシレータ内のマルチプレクサ50を
制御することにより、実際に光ビームが印字領域上を走
査するのに要する時間に相当する時間内に所定数のクロ
ックパルスが発生する信号を発生させることができる。That is, by controlling the multiplexer 50 in the ring oscillator to set the frequency of each clock pulse to one of fH9fL, a predetermined number of clock pulses are generated within a time corresponding to the time required for the light beam to actually scan the printing area. A signal can be generated that generates a clock pulse.
さらに、周波数f1あるいは周波数fLのり0ツクパル
スが複数連続して発生すると、周波数f の区間と周波
数f、の区間で印字物の累積数■
差が生ずる。このため、周波数fHと周波数f。Furthermore, if a plurality of pulses of 0 at frequency f1 or frequency fL occur in succession, a difference in the cumulative number of printed objects occurs between the interval of frequency f and the interval of frequency f. Therefore, the frequency fH and the frequency f.
の各クロックパルスを印字全長全体に分散して交互に発
生させることが好ましい。It is preferable that the clock pulses are distributed over the entire print length and generated alternately.
本実施例においては、全体のクロックパルス内の2個を
周波数f、にする場合には全体を2分割してその切れ目
にこのクロックパルスを入れ、3個の場合には3分割の
切れ目に入れるような倍率演算方式を採用しており、そ
の演算処理結果を予め倍率演算ROM40に記憶させて
そこから必要な周波数選択信号Fを読出し出力する。In this embodiment, if two of the total clock pulses are to have the frequency f, the entire clock pulse is divided into two and the clock pulse is inserted into the cut, and if there are three clock pulses, the clock pulse is inserted into the cut between the two. The arithmetic processing result is stored in advance in the magnification calculation ROM 40, from which the necessary frequency selection signal F is read and output.
上記のように第3図に示すリングオシレータを用いるこ
とにより、第1図に示ず可変周波数同期発振器32の動
作を実行することができる。By using the ring oscillator shown in FIG. 3 as described above, the operation of the variable frequency synchronous oscillator 32 not shown in FIG. 1 can be performed.
即ち、このリングオシレータのナントゲート44にFF
30からの発振器スタート信号Bを発振開始信号として
供給し、またマルチプレクサ50のデイレイ時間可変指
令SELにカウンタ42と倍率演算ROM40の出力信
号を供給すればよい。That is, the FF is connected to the Nant gate 44 of this ring oscillator.
It is sufficient to supply the oscillator start signal B from 30 as the oscillation start signal, and also supply the output signals of the counter 42 and the magnification calculation ROM 40 to the delay time variable command SEL of the multiplexer 50.
これにより、発振器スタート信号Bが高レベルの閤この
リングオシレータは発振し、カウンタ42の出り信号に
よりマルチプレクサ50から出力される信号の周波数が
決定され、さらに倍率演算ROM40からの信号により
マルチプレクサ50から出力される信号の周波数が微小
に切り変わることになる。As a result, the ring oscillator whose oscillator start signal B is at a high level oscillates, the frequency of the signal output from the multiplexer 50 is determined by the output signal of the counter 42, and the frequency of the signal output from the multiplexer 50 is further determined by the signal from the multiplication calculation ROM 40. The frequency of the output signal changes minutely.
[発明の効果コ
本発明によれば、回転ミラーの回転ムラ等により、実際
に光ビームが走査する時間とビデオクロック信号の発生
時間との間に差が生じたとしても、1本またはそれ以上
前の走査線でこれを検出して補正することができ、印字
始点側だけでなく終点側における印字品質をも向上させ
ることができる。[Effects of the Invention] According to the present invention, even if there is a difference between the actual scanning time of the light beam and the generation time of the video clock signal due to uneven rotation of the rotating mirror, one or more This can be detected and corrected in the previous scanning line, and the print quality can be improved not only at the printing start point side but also at the end point side.
第1図は本発明を応用したレーザプロッタのビデオクロ
ック信号発生装置の回路構成を示す図、第2図は第1図
に示す信号のタイムチャート、第3図は第1図に示す可
変周波数同期発振器の実施例であるリングオシレータを
示す図、第4図及び第5図は従来例を示す図、第6図は
第4図に示す従来例により印字した場合の例を示す図で
ある。
20・・・スタート位置検出器
22・・・ストップ位置検出器
28゜
32 ・
34 ・
36 ・
38 ・
40 ・
42 ・
30・・・フリップフロップ
・・可変周波数同期発振器
・・クロックカウンタ
・・パルス指令スイッチ
・・位相比較器
・・倍率演算ROMFigure 1 is a diagram showing the circuit configuration of a video clock signal generator for a laser plotter to which the present invention is applied, Figure 2 is a time chart of the signals shown in Figure 1, and Figure 3 is the variable frequency synchronization shown in Figure 1. 4 and 5 are diagrams showing a conventional example, and FIG. 6 is a diagram showing an example of printing using the conventional example shown in FIG. 4. 20...Start position detector 22...Stop position detector 28° 32 ・ 34 ・ 36 ・ 38 ・ 40 ・ 42 ・ 30 ・ Flip-flop ・ Variable frequency synchronous oscillator ・ Clock counter ・ Pulse command Switch, phase comparator, magnification calculation ROM
Claims (1)
それぞれ検出し、始点の検出に同期して一定のクロック
パルス数からなるビデオクロック信号を発生させ、終点
検出時における前記ビデオクロック信号の最終クロック
パルスの位相比較を行ない、この比較結果に基づいて後
の走査線のビデオクロック信号の周波数を微小に可変さ
せるフィードバックをかけてビデオクロック信号の停止
を終点検出に同期させることを特徴とするレーザプロッ
タのビデオクロック信号発生方法。It detects that the light beam reaches the start point and the end point of the main scanning section, generates a video clock signal consisting of a fixed number of clock pulses in synchronization with the detection of the start point, and A laser characterized in that a phase comparison of clock pulses is performed, and based on the comparison result, feedback is applied to minutely vary the frequency of the video clock signal of a subsequent scanning line to synchronize the stop of the video clock signal with end point detection. How to generate a video clock signal for a plotter.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63169273A JPH0218517A (en) | 1988-07-07 | 1988-07-07 | Video clock signal generating method for laser plotter |
KR1019890002311A KR940002357B1 (en) | 1988-07-07 | 1989-02-25 | Video clock signal generation method for laser plotter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63169273A JPH0218517A (en) | 1988-07-07 | 1988-07-07 | Video clock signal generating method for laser plotter |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0218517A true JPH0218517A (en) | 1990-01-22 |
Family
ID=15883452
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63169273A Pending JPH0218517A (en) | 1988-07-07 | 1988-07-07 | Video clock signal generating method for laser plotter |
Country Status (2)
Country | Link |
---|---|
JP (1) | JPH0218517A (en) |
KR (1) | KR940002357B1 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6163334A (en) * | 1997-10-31 | 2000-12-19 | Sharp Kabushiki Kaisha | Image forming device |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5492769A (en) * | 1977-12-30 | 1979-07-23 | Fujitsu Ltd | Correction method of scanning light modulation clock |
-
1988
- 1988-07-07 JP JP63169273A patent/JPH0218517A/en active Pending
-
1989
- 1989-02-25 KR KR1019890002311A patent/KR940002357B1/en not_active IP Right Cessation
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS5492769A (en) * | 1977-12-30 | 1979-07-23 | Fujitsu Ltd | Correction method of scanning light modulation clock |
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US6163334A (en) * | 1997-10-31 | 2000-12-19 | Sharp Kabushiki Kaisha | Image forming device |
Also Published As
Publication number | Publication date |
---|---|
KR900002210A (en) | 1990-02-28 |
KR940002357B1 (en) | 1994-03-23 |
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