JPH02162969A - Contour correction circuit for video signal - Google Patents
Contour correction circuit for video signalInfo
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、例えばテレビジョン受像機においてカラー画
像の輪郭部を強調するのに使用して好適な映像信号の輪
郭補正回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a video signal contour correction circuit suitable for use in, for example, a television receiver to emphasize the contours of a color image.
本発明は、例えばテレビジョン受像機においてカラー画
像の輪郭部を強調するのに使用して好適な映像信号の輪
郭補正回路において、原信号を遅延させる第１の遅延手
段と、この第１の遅延手段の出力信号を遅延させる第２
の遅延手段と、その原信号並びにその第１及び第２の遅
延手段の夫々の出力信号を加減算して第１．第２及び第
３の輪郭補正信号を形成する加減算回路と、その第１゜
第２及び第３の輪郭補正信号より第４の輪郭補正信号を
形成する論理演算回路とを設け、その第４の輪郭補正信
号のゲインを調整してなる信号とその第１の遅延手段の
出力信号とを加算することにより、その原信号の変化部
分を補正するようにしたことにより、輝度信号と色差信
号とのいずれでも立上り及び立下りが良好に鮮鋭化され
、画質を損なうことなく画像の輪郭強調が行えるように
したものである。The present invention provides a video signal contour correction circuit suitable for use in, for example, a television receiver to emphasize the contours of a color image, including a first delay means for delaying an original signal; a second delaying the output signal of the means;
, the original signal, and the respective output signals of the first and second delay means are added and subtracted to obtain the first . An addition/subtraction circuit for forming second and third contour correction signals, and a logic operation circuit for forming a fourth contour correction signal from the first, second and third contour correction signals are provided. By adding the signal obtained by adjusting the gain of the contour correction signal and the output signal of the first delay means to correct the changing part of the original signal, the difference between the luminance signal and the color difference signal is corrected. In either case, the rising edge and the falling edge are sharpened well, and the outline of the image can be emphasized without degrading the image quality.
従来、ＮＴＳＣ方式の複合カラー映像信号は、輝度信号
の信号帯域幅（４，２ＮＨ４）に比較して色差信号の信
号帯域幅（０，５ＮＨ２）か狭く設定されていた。この
ため、この映像信号が高速に変化する領域に対応する部
分である画像の輪郭部において、輝度の変化に色の変化
が追従できなくなり、輪郭が不鮮明となり画質が劣化す
る不都合があった。このため、輪郭強調回路により輪郭
強調を行うことが考えられていた。Conventionally, in the composite color video signal of the NTSC system, the signal bandwidth of the color difference signal (0.5NH2) has been set narrower than the signal bandwidth (4.2NH4) of the luminance signal. For this reason, in the contour part of the image, which corresponds to an area where the video signal changes rapidly, the change in color cannot follow the change in brightness, resulting in an inconvenience that the contour becomes unclear and the image quality deteriorates. For this reason, it has been considered to perform edge enhancement using an edge enhancement circuit.
ところが、例えば特開昭６１−２２４７８３号公報にお
いて開示されている従来の輪郭強調回路は、常に輪郭部
のレベル差を明確にさせるために輪郭部の前後にプリシ
ュート及び／又はオーバシュートを付けるものであるた
め、輝度信号の場合には輪郭部が目立っである程度の効
果が得られるが、色差信号の場合には輪郭部の色相がず
れて不自然な画像となり、かえって画質が悪くなってし
まう場合があった。However, the conventional contour enhancement circuit disclosed in, for example, Japanese Patent Application Laid-Open No. 61-224783 always adds preshoot and/or overshoot before and after the contour in order to clarify the level difference between the contours. Therefore, in the case of a luminance signal, the contours stand out and a certain degree of effect can be obtained, but in the case of a color difference signal, the hue of the contours shifts, resulting in an unnatural image, and the image quality may deteriorate. was there.
本発明は斯かる点に鑑み、輝度信号と色差信号とのいず
れでも立上り及び立下りが良好に鮮鋭化され、画質を損
なうことなく画像の輪郭強調が行われる映像信号の輪郭
補正回路を提案することを目的とする。In view of the above, the present invention proposes a video signal contour correction circuit in which the rising and falling edges of both luminance signals and color difference signals are sharpened well, and image contours are enhanced without deteriorating image quality. The purpose is to
本発明による映像信号の輪郭補正回路は、例えば第１図
に示す如く、原信号Ａを遅延させる第１の遅延手段（２
Ａ）と、この第１の遅延手段（２Ａ）の出力信号Ｂを遅
延させる第２の遅延手段（２Ｂ）と、その原信号Ａ並び
にその第１及び第２の遅延手段の夫々の出力信号Ｂ及び
Ｃを加減算して第１．第２及び第３の輪郭補正信号、例
えばＢ−Ａ、Ｂ−Ｃ及び２Ｂ−（Ａ＋Ｃ）を形成する加
減算回路（３） 、 （４）。The video signal contour correction circuit according to the present invention includes a first delay means (2) for delaying the original signal A, as shown in FIG.
A), a second delay means (2B) that delays the output signal B of the first delay means (2A), and the original signal A and the output signals B of the first and second delay means. and C by adding and subtracting the first. Addition/subtraction circuits (3), (4) forming second and third contour correction signals, e.g. B-A, B-C and 2B-(A+C).
（５）と、その第１．第２及び第３の輪郭補正信号より
第４の輪郭補正信号Ｗを形成する論理演算回路（６）と
を設け、その第４の輪郭補正信号Ｗのゲインを調整して
なる信号ＫＸＷとその第１の遅延手段（２Ａ）の出力信
号Ｂとを加算することにより、その原信号Ａの変化部分
を補正するようにしたものである。(5) and the first one. A logic operation circuit (6) that forms a fourth contour correction signal W from the second and third contour correction signals is provided, and a signal KXW obtained by adjusting the gain of the fourth contour correction signal By adding the output signal B of the first delay means (2A), the changing portion of the original signal A is corrected.
斯かる本発明によれば、その原信号Ａ並びにその第１及
び第２の遅延手段（２Ａ）及び（２Ｂ）の夫々の出力信
号Ｂ及びＣを加減算することにより、その原信号Ａの変
化部分の近傍でのみ変化する第１゜第２及び第３の輪郭
補正信号、例えばＢ−Ａ、Ｂ−Ｃ及び２Ｂ−（Ａ＋Ｃ）
が生成される。そして、それら第１〜第３の輪郭補正信
号をさらに演算することにより、その原信号Ａの変化部
分の状態を補正するための第４の輪郭補正信号Ｗが容易
に生成される。According to the present invention, by adding and subtracting the original signal A and the respective output signals B and C of the first and second delay means (2A) and (2B), the changing portion of the original signal A is The first, second and third contour correction signals that change only in the vicinity of , e.g. B-A, B-C and 2B-(A+C)
is generated. By further calculating these first to third contour correction signals, a fourth contour correction signal W for correcting the state of the changing portion of the original signal A is easily generated.
さらに、その第４の輪郭補正信号Ｗのゲインを調整して
第１の遅延手段（２Ａ）の出力信号Ｂに加算するように
しているので、その原信号Ａの変化部分の補正量を容易
に増減することができる。Furthermore, since the gain of the fourth contour correction signal W is adjusted and added to the output signal B of the first delay means (2A), the amount of correction for the changing portion of the original signal A can be easily adjusted. It can be increased or decreased.
〔実施例］
以下、本発明映像信号の輪郭補正回路の一実施例につき
図面を参照して説明しよう。本例はデジタル回路を用い
て構成したものであるが、本発明はアナログ回路を用い
ても実現できるものであるため、便宜上アナログ回路的
に説明する。[Embodiment] Hereinafter, an embodiment of the video signal contour correction circuit of the present invention will be described with reference to the drawings. Although this example is configured using a digital circuit, the present invention can also be realized using an analog circuit, so for convenience, the explanation will be given in terms of an analog circuit.
第１図は本例の輪郭補正回路を示し、この第１図におい
て（１）は入力端子であり、この入力端子（１）に外部
より輝度信号Ｙ又は色差信号Ｒ−Ｙ若しくはＢ−Ｙをデ
ジタル化してなる原信号Ａを入力する。この原信号Ａを
シフトレジスタ等よりなる第１の遅延回路（２Ａ）及び
第１の減算回路（３）に夫々供給し、その第１の遅延回
路（２Ａ）より出力される遅延信号Ｂ（青信号を示すＢ
とは異なる）を第２の遅延回路（２Ｂ）並びに第１の減
算回路（３）及び第２の減算回路（４）に夫々供給する
。また、その第２の遅延回路（２Ｂ）より出力される遅
延信号Ｃをその第２の減算回路（４）に供給する。これ
ら第１及び第２の遅延回路（２Ａ）及び（２Ｂ）は、そ
の原信号Ａが輝度信号Ｙのときには遅延時１７１Ｔを例
えば５６０ｎｓに夫々設定し、その原信号Ａが色差信号
Ｒ−Ｙ又はＢ−Ｙのときには遅延時間Ｔを例えば１４０
ｎｓに夫々設定する。FIG. 1 shows the contour correction circuit of this example. In this FIG. Input the digitized original signal A. This original signal A is supplied to a first delay circuit (2A) and a first subtraction circuit (3) each consisting of a shift register, etc., and the delayed signal B (blue signal) is output from the first delay circuit (2A). B showing
) are supplied to the second delay circuit (2B), the first subtraction circuit (3), and the second subtraction circuit (4), respectively. Further, the delay signal C output from the second delay circuit (2B) is supplied to the second subtraction circuit (4). These first and second delay circuits (2A) and (2B) each set the delay time 171T to, for example, 560 ns when the original signal A is the luminance signal Y, and when the original signal A is the color difference signal R-Y or When B-Y, set the delay time T to 140, for example.
ns respectively.
その第１の減算回路（３）は原信号Ａと遅延信号Ｂとの
差信号Ｂ−Ａを加算回路（５）及び論理演算回路（６）
に供給し、その第２の減算回路（４）は遅延信号Ｂと遅
延信号Ｃとの差信号Ｂ−Ｃを加算回路（５）及び論理演
算回路（６）に供給し、その加算回路（５）はその２つ
の差信号Ｂ−Ａ及びＢ−Ｃを加算してなる信号２Ｂ−（
Ａ＋Ｃ）を論理演算回路（６）に供給する。The first subtraction circuit (3) outputs a difference signal B-A between the original signal A and the delayed signal B to an addition circuit (5) and a logic operation circuit (6).
The second subtraction circuit (4) supplies the difference signal B−C between the delayed signal B and the delayed signal C to the addition circuit (5) and the logic operation circuit (6). ) is a signal 2B-(
A+C) is supplied to the logic operation circuit (6).
原信号Ａとして第２図Ａに示すような立上り期間Ｔ、及
び立下り期間Ｔ２の台形波を仮定すると、遅延信号Ｂ〜
信号２Ｂ−（Ａ＋Ｃ）は夫々第２図Ｂ〜第２図Ｆに示す
如くなる。この場合、論理演算回路（６）はそれら差信
号Ｂ−Ａ、Ｂ−Ｃ及び信号２Ｂ−（Ａ十Ｃ）より第２図
Ｇに示す如き輪郭補正信号Ｗを生成して乗算回路（１４
）に供給する。この輪郭補正信号Ｗは遅延信号Ｂの立上
り期間Ｔ、の間で０レベルを中心に「０→負→０→正→
０」と変化する如くなし、遅延信号Ｂの立下り期間Ｔ２
の間で「０→正→０→負→０」と変化する如くなす。Assuming that the original signal A is a trapezoidal wave with a rising period T and a falling period T2 as shown in FIG. 2A, the delayed signal B~
Signals 2B-(A+C) are as shown in FIGS. 2B to 2F, respectively. In this case, the logic operation circuit (6) generates a contour correction signal W as shown in FIG.
). During the rising period T of the delayed signal B, this contour correction signal W is centered around the 0 level and is
0”, the falling period T2 of the delayed signal B
The change is made as follows: 0→Positive→0→Negative→0.
さらに、例えば期間Ｔ１での信号Ｗの立下りの傾き角の
絶対値は遅延信号Ｂの立上りの傾き角の絶対値よりも小
さくなる如くなす。従って、その補正信号Ｗは例えば第
２図Ｇに破線（讐４）で示すような特性であってもよい
。Further, for example, the absolute value of the slope angle of the fall of the signal W in the period T1 is made smaller than the absolute value of the slope angle of the rise of the delayed signal B. Therefore, the correction signal W may have a characteristic as shown by the broken line (line 4) in FIG. 2G, for example.
乗算回路（１４）はその輪郭補正信号Ｗに所定の係数Ｋ
（０≦に≦１）を乗じて得た信号ＫＸＷを加算回路（１
５）の一方の入力端子に供給し、この加算回路（１５）
の他方の入力端子には第１の遅延回路（２Ａ）より出力
される遅延信号Ｂを供給する。この加算回路（１５）は
信号ＫＸＷと遅延信号Ｂとを加算して出力信号Ｚを形成
し、この出力信号Ｚを出力端子（１６）に供給する。即
ち、
Ｚ＝Ｂ＋ （ＫＸＷ） −・・・・−（１）が成
立している。The multiplication circuit (14) applies a predetermined coefficient K to the contour correction signal W.
The signal KXW obtained by multiplying (0≦≦1) is added to the adding circuit (1
5) to one input terminal of the adder circuit (15).
The other input terminal of the delay signal B output from the first delay circuit (2A) is supplied. This adder circuit (15) adds the signal KXW and the delayed signal B to form an output signal Z, and supplies this output signal Z to an output terminal (16). That is, Z=B+ (KXW) -...-(1) holds true.
原信号Ａ及び輪郭補正信号Ｗとして夫々第２図Ａ及びＧ
に示す如き信号を仮定して、乗算回路（１４）における
係数にの値を１に設定すると、出力信号Ｚは第２図Ｈに
示す如くなり、原信号Ａと比較して立上り及び立下りが
鮮鋭化されプリシュートもオーバシュートも生じること
なく輪郭が強調されていることが分かる。同様にその輪
郭補正信号Ｗとして第２図Ｇの破線Ｗ４を仮定すると、
出力信号Ｚの波形は第２図Ｈの破線（Ｚ４）で示す如く
なり、輪郭は強調されている。2 A and G as the original signal A and the contour correction signal W, respectively.
Assuming a signal as shown in FIG. 2 and setting the value of the coefficient in the multiplier circuit (14) to 1, the output signal Z becomes as shown in FIG. It can be seen that the image is sharpened and the outline is emphasized without any preshoot or overshoot. Similarly, assuming the broken line W4 in FIG. 2G as the contour correction signal W,
The waveform of the output signal Z is as shown by the broken line (Z4) in FIG. 2H, and the outline is emphasized.
このように本例によれば、プリシュートもオーバシュー
トも生じることなく原信号の変化部分が鮮鋭化されるの
で、その原信号に対応する画像の輪郭が自然な形で強調
される利益がある。さらにデジタル回路で構成した場合
には、回路規模を比較的小さくまとめることができると
共に、特性の劣化や部品の特性のバラツキによる誤差な
どの問題がない利益がある。In this way, according to this example, the changing part of the original signal is sharpened without causing any preshoot or overshoot, so there is an advantage that the outline of the image corresponding to the original signal is emphasized in a natural manner. . Furthermore, when configured with a digital circuit, the circuit scale can be made relatively small, and there is an advantage that there are no problems such as deterioration of characteristics or errors due to variations in characteristics of components.
第１図例の中の論理演算回路（６）は例えばマイクロコ
ンピュータのソフトウェアで実現することも可能である
が、ハードウェア的に構成した例を第３図に示す。この
第３図において、（６）は全体として論理演算回路を示
し、この論理演算回路（６）は極性反転回路（７）、
（８）、最小値回路（９Ａ）〜（９Ｄ）、最大値回路（
ＩＯＡ）〜（１００）及び加算回路（１１） 、 （１
２） 、 （１３）より構成する。この場合、最小値回
路（９Ａ）〜（９Ｄ）は夫々２つの入力信号の内の小さ
い方を出力する回路であり、最大値回路（ＩＯＡ）〜（
１００）は夫々２つの入力信号の内の大きい方を出力す
る回路である。Although the logical operation circuit (6) in the example of FIG. 1 can be realized by, for example, software of a microcomputer, FIG. 3 shows an example of a hardware configuration. In this FIG. 3, (6) shows the logic operation circuit as a whole, and this logic operation circuit (6) includes a polarity inversion circuit (7),
(8), minimum value circuit (9A) to (9D), maximum value circuit (
IOA) to (100) and addition circuits (11), (1
2) and (13). In this case, the minimum value circuits (9A) to (9D) are circuits that output the smaller of the two input signals, and the maximum value circuits (IOA) to (
100) are circuits that each output the larger of the two input signals.
第３図において、第１の減算回路（３）より出力される
差信号Ｂ−Ａを極性反転回路（７）を介して最小値回路
（９Ａ）及び最大値回路（１０Ｂ）の夫々の一方の入力
端子に供給し、第２の減算回路（４）より出力される差
信号Ｂ−Ｃを極性反転回路（８）を介して最大値回路（
ＩＯＡ）及び最小値回路（９Ｂ）の夫々一方の入力端子
に供給し、加算回路（５）より出力される信号２Ｂ−（
Ａ＋Ｃ）を最小値回路（９Ａ） 、 （９Ｂ）及び最大
値回路（１０＾） 、 （ＩＯＢ）の夫々の他方の入力
端子に供給する。また、最大値回路（１０４） 、 （
ＩＯＢ）及び最小値回路（９Ａ） 、 （９Ｂ）の夫々
の出力信号り、Ｐ及びＭ、Ｎを夫々最小値回路（９Ｇ）
、 （９Ｄ）及び最大値回路（ＩＯＣ） 。In FIG. 3, the difference signal B-A output from the first subtraction circuit (3) is sent to one of the minimum value circuit (9A) and maximum value circuit (10B) via the polarity inversion circuit (7). The difference signal B-C supplied to the input terminal and output from the second subtraction circuit (4) is sent to the maximum value circuit (
IOA) and the minimum value circuit (9B), respectively, and the signal 2B-(
A+C) is supplied to the other input terminal of each of the minimum value circuits (9A), (9B) and the maximum value circuits (10^), (IOB). In addition, the maximum value circuit (104), (
IOB) and the output signals of the minimum value circuits (9A) and (9B), P, M, and N are respectively output from the minimum value circuit (9G).
, (9D) and maximum value circuit (IOC).
（１００）の一方の入力端子に供給し、値が０の信号を
共通に最小値回路（９Ｃ） 、 （９Ｄ）及び最大値回
路（ＩＯＣ） 、 （１００）の夫々の他方の入力端子
に供給する。(100), and a signal with a value of 0 is commonly supplied to the other input terminal of each of the minimum value circuits (9C), (9D) and maximum value circuits (IOC), (100). do.
さらに、最小値回路（９Ｃ）の出力信号Ｑ及び最大値回
路（ＩＯＣ）の出力信号Ｒを夫々加算回路（１１）に供
給し、最大値回路（１００）の出力信号Ｓ及び最小値回
路（９Ｄ）の出力信号Ｔを夫々加算回路（１２）に供給
して、この加算回路（１１）の出力信号Ｕ及び加算回路
（１２）の出力信号Ｖを夫々加算回路（１３）に供給す
る。そして、この加算回路（１３）の出力信号を輪郭補
正信号Ｗとなして、この輪郭補正信号Ｗを乗算回路（１
４）に供給する如くなす。これ以外の構成は第１図例と
共通である。上述した各出力信号の関係式を以下にまと
めて示す。Further, the output signal Q of the minimum value circuit (9C) and the output signal R of the maximum value circuit (IOC) are respectively supplied to the adder circuit (11), and the output signal S of the maximum value circuit (100) and the output signal R of the minimum value circuit (9D) are supplied to the adder circuit (11). ) are respectively supplied to an adder circuit (12), and the output signal U of the adder circuit (11) and the output signal V of the adder circuit (12) are respectively supplied to an adder circuit (13). Then, the output signal of this adder circuit (13) is made into a contour correction signal W, and this contour correction signal W is applied to the multiplier circuit (13).
4). The configuration other than this is the same as the example shown in FIG. The relational expressions for each output signal described above are summarized below.
ＬＪＡＸ ［Ｃ−８，２Ｂ−（Ａ＋Ｃ） ］ 、 Ｍ＝
ＭＩＮ ［Ａ−Ｂ、 ２Ｂ−（Ａ＋Ｃ） ］・・・・（
２）ＮＪＩＮ ［Ｃ−８，２Ｂ−（Ａ＋Ｃ） ］ 、
Ｐ＝ＭＡＸ ［Ａ−８，２Ｂ−（Ａ＋Ｃ） ］ ＝ ・
・（３）Ｑ＝ＭＩＮ［Ｌ、Ｏ］、 Ｒ＝ＭＡＸ［Ｍ、Ｏ
］ ・−・（４）Ｓ＝ＭＡＸ ［Ｎ、
０１ 、 Ｔ＝ＭＩＮ ［Ｐ、 ０］
・−・・（５）ＩＪ＝Ｑ＋Ｒ，Ｖ＝Ｓ＋Ｔ、 Ｗ＝
Ｕ＋Ｖ −・−（６）第３図例の動
作を説明するに、原信号Ａとして第４図Ａに示す如く時
点ｔ、から時点ｔ、まで立上り時点ｔ％から時点ｔ、ま
で立下る台形波を仮定して、その時点ｔ、とｔ！の間隔
及び時点ｔ、とｔ、との間隔は夫々遅延回路（２Ａ）に
おける遅延時間Ｔの２倍である２Ｔとする。この場合、
遅延信号Ｂは第４図Ｂに示す如く、時点ｔ、から時点ｔ
、まで立上り時点ｔ６から時点ｔｓまで立下る台形波と
なり、遅延信号Ｃ〜輪郭補正信号Ｗは夫々第４図Ｃ〜第
４図Ｑに示す如（なる。その輪郭補正信号Ｗは時点ｔ、
から時点ｔ、にかけて「Ｏ→負→０→正→０」と変化し
て、時点ｔ、から時点ｔ、にかけて「Ｏ→正→０→負→
Ｏ」と変化する如くなる。LJAX [C-8, 2B-(A+C)], M=
MIN [A-B, 2B-(A+C)]...(
2) NJIN [C-8, 2B-(A+C)],
P=MAX [A-8, 2B-(A+C)] = ・
・(3) Q=MIN[L,O], R=MAX[M,O
] ・-・(4) S=MAX [N,
01, T=MIN [P, 0]
・・・(5) IJ=Q+R, V=S+T, W=
U+V -・- (6) To explain the operation of the example in FIG. 3, the original signal A is a trapezoidal wave that rises from time t to time t and falls from time t% to time t, as shown in FIG. 4A. Assuming that, at the time t, and t! The interval between and the interval between times t and t are each 2T, which is twice the delay time T in the delay circuit (2A). in this case,
The delayed signal B is transmitted from time t to time t, as shown in FIG. 4B.
, it becomes a trapezoidal wave that rises from time t6 to time ts and falls as shown in FIGS. 4C to 4Q, respectively.
From time t to time t, it changes as "O → negative → 0 → positive → 0", and from time t to time t, it changes as "O → positive → 0 → negative →
It seems to change to "O".
また、出力信号２は第４図Ｑの輪郭補正信号Ｗに係数Ｋ
を乗じた信号ＫＸＷに第４図Ｂの遅延信号Ｂを加算した
信号であるため、係数に＝１である場合には第４図Ｒの
実線Ｚ１で示す信号となる。Furthermore, the output signal 2 is added to the contour correction signal W in FIG. 4 by a coefficient K.
Since it is a signal obtained by adding the delayed signal B in FIG. 4B to the signal KXW multiplied by , when the coefficient is 1, the signal becomes the signal shown by the solid line Z1 in FIG. 4R.
そして、係数に＝１／２又はに＝０である場合には、出
力信号Ｚは夫々第４図Ｒの破線Ｚ２又は−点鎖線ｚ３で
示す信号となる。第４図Ｒより、係数にの値を０から１
に増加するにつれに、出力信号Ｚの立上り及び立下りが
次第に鋭くなることが分かる。従って、本例のように乗
算回路（１４）を設けて輪郭補正信号Ｗに一種のゲイン
調整を施した場合には、その乗算回路（１４）での係数
にの値を変えるだけで容易に原信号Ａに対応する画像の
輪郭の強調の程度を調整できる利益がある。When the coefficient is 1/2 or 0, the output signal Z becomes a signal indicated by a broken line Z2 or a -dotted chain line z3 in FIG. 4R, respectively. From Figure 4 R, set the value of the coefficient from 0 to 1.
It can be seen that as the value increases, the rising and falling edges of the output signal Z become gradually sharper. Therefore, when a multiplier circuit (14) is provided as in this example to perform a kind of gain adjustment on the contour correction signal W, the original value can be easily adjusted by simply changing the value of the coefficient in the multiplier circuit (14). There is an advantage that the degree of enhancement of the outline of the image corresponding to signal A can be adjusted.
さらに、その乗算回路（１４）における係数にの値が０
≦に≦１である場合には出力信号Ｚにプリシュート及び
オーバシュートは生じることがなく画像の輪郭を自然に
強調できる利益がある。Furthermore, the value of the coefficient in the multiplication circuit (14) is 0.
When ≦≦1, there is an advantage that no preshoot or overshoot occurs in the output signal Z, and the outline of the image can be naturally emphasized.
次に、本発明映像信号の輪郭補正回路の応用例につき第
５図及び第６図を参照して説明しよう。Next, an application example of the video signal contour correction circuit of the present invention will be explained with reference to FIGS. 5 and 6.
第５図は本発明の輪郭補正回路を組込んだデジタルカラ
ー受像機を示し、この第５図において、（１７）はＮＴ
ＳＣ方式の合成カラーテレビ信号が供給される入力端子
、（１８）はアナログＹ／Ｃ分離回路であり、このアナ
ログＹ／Ｃ分離回路（１８）はその供給された合成カラ
ーテレビ信号を輝度信号Ｙと色信号Ｃとに分離すると共
に色信号Ｃを復調して色差信号Ｒ−Ｙ、Ｂ−Ｙを生成し
、得られた輝度信号Ｙ及び色差信号Ｒ−Ｙ、Ｂ−Ｙを夫
々Ｄ／Ａ変換器（１９Ａ） 、 （１９Ｂ） 、 （１
９Ｇ）に供給する。また、Ａ／Ｄ変換器（１９Ａ）〜（
１９Ｃ）より出力されるデジタル信号を夫々本発明によ
る第１図例の輪郭補正回路（２ＯＡ）〜（２０Ｃ）に供
給して、信号の立上り及び立下りの鮮鋭度を増加させる
。この場合、輪郭補正回路（２０Ａ） 。FIG. 5 shows a digital color receiver incorporating the contour correction circuit of the present invention, and in this FIG.
The input terminal (18) to which the SC system composite color television signal is supplied is an analog Y/C separation circuit, and this analog Y/C separation circuit (18) converts the supplied composite color television signal into a luminance signal Y. and a color signal C, and demodulates the color signal C to generate color difference signals R-Y and BY.The obtained luminance signal Y and color difference signals R-Y and BY are respectively D/A Converter (19A), (19B), (1
9G). In addition, A/D converter (19A) ~ (
19C) are respectively supplied to the contour correction circuits (2OA) to (20C) of the example shown in FIG. 1 according to the present invention to increase the sharpness of the rising edge and falling edge of the signal. In this case, a contour correction circuit (20A).
（２０Ｂ） 、 （２０Ｃ）は１個の輪郭補正回路を時
分割的に分けて使用することにより共通化してもよい。(20B) and (20C) may be made common by dividing and using one contour correction circuit in a time-sharing manner.
これら輪郭補正回路（２０Ａ）〜（２０Ｃ）の出力信号
を夫々信号処理回路（２１）に供給し、この信号処理回
路（２１）において例えばノイズリダクシッン、補間信
号の生成等の処理を施して得られた輝度信号Ｙ及び色差
信号Ｒ−Ｙ、Ｂ−Ｙを夫々Ｄ／Ａ変換器（２２Ａ） 、
（２２Ｂ） 、 （２２Ｃ）を介してＲＧＢマドリス
ク（２３）に供給する。このＲＧＢマドリスク（２３）
からは三原色信号Ｒ，Ｇ、Ｂがカラー受像管（２４）に
供給される。The output signals of these contour correction circuits (20A) to (20C) are respectively supplied to a signal processing circuit (21), and the signal processing circuit (21) performs processing such as noise reduction and generation of an interpolation signal. The obtained luminance signal Y and color difference signals R-Y and B-Y are respectively sent to a D/A converter (22A),
(22B) and (22C) to the RGB Madrisk (23). This RGB Madrisk (23)
The three primary color signals R, G, and B are supplied to a color picture tube (24).
第５図例によれば、輝度信号Ｙだけでなく色差信号Ｒ−
Ｙ、Ｂ−Ｙの立上り及び立下りが改善されてブ、リシュ
ートもオーバシュートも生じることなく鮮鋭度が増すの
で、カラー画像の輪郭が自然な形で強調される利益があ
る。さらに、輪郭補正回路（２０Ａ）〜（２０Ｃ）を共
通化して時分割で使用することにより、回路規模を小さ
くできる利益がある。According to the example in FIG. 5, not only the luminance signal Y but also the color difference signal R-
Since the rise and fall of Y and B-Y are improved and the sharpness is increased without causing reshoot or overshoot, there is the benefit that the contours of the color image are emphasized in a natural manner. Furthermore, by making the contour correction circuits (20A) to (20C) common and using them in a time-sharing manner, there is an advantage that the circuit scale can be reduced.
また、信号処理回路（２１）において補間等を行うこと
により容易にカラー画像の輪郭を強調した上で高解像テ
レビジョン（Ｉ ＤＴＶ 、 ＨＤＴＶなど）を実現す
ることができる。Further, by performing interpolation or the like in the signal processing circuit (21), it is possible to easily emphasize the outline of a color image and realize high-resolution television (IDTV, HDTV, etc.).
尚、第５図例においてはアナログＹ／Ｃ分離回路（１８
）を使用していたが、第６図に示す如くデジタルＹ／Ｃ
分離回路（２６）を使用してもよい。第６図例において
は、入力端子（１７）に入力された合成カラーテレビ信
号をＡ／Ｄ変換器（２５）を介してデジタルＹ／Ｃ分離
回路（２６）に供給し、このデジタルＹ／Ｃ分離回路に
より得られた輝度信号Ｙ及び色差信号ＲＹ、Ｂ−Ｙを夫
々輪郭補正回路（２０Ａ） 、 （２０Ｂ） 、 （２
０Ｃ）に供給する。他の構成は第５図例と同様である。In the example in Fig. 5, the analog Y/C separation circuit (18
), but as shown in Figure 6, digital Y/C
A separation circuit (26) may also be used. In the example in FIG. 6, the composite color television signal input to the input terminal (17) is supplied to the digital Y/C separation circuit (26) via the A/D converter (25), and the digital Y/C The luminance signal Y and color difference signals RY and B-Y obtained by the separation circuit are sent to contour correction circuits (20A), (20B), and (2), respectively.
0C). The other configurations are the same as the example shown in FIG.
このように、本発明は上述実施例に限定されず、本発明
の要旨を逸脱しない範囲で変更することができるのは勿
論である。例えば、本発明はアナログ回路で構成しても
よい。As described above, the present invention is not limited to the above-described embodiments, and it goes without saying that changes can be made without departing from the gist of the present invention. For example, the present invention may be configured with an analog circuit.
本発明の映像信号の輪郭補正回路によると、原信号が輝
度信号と色差信号とのいずれであっても、２個の遅延手
段による簡単な構成で輪郭部に相当する原信号の輪郭強
調が画質を損ねることな（良好に行われる利益がある。According to the video signal contour correction circuit of the present invention, regardless of whether the original signal is a luminance signal or a color difference signal, the contour enhancement of the original signal corresponding to the contour portion can improve the image quality with a simple configuration using two delay means. There are benefits to doing well (without detriment).
第１図は本発明映像信号の輪郭補正回路の一実施例を示
す構成図、第２図は第１図例のタイミングチャート図、
第３図は第１図例の論理演算回路の一例を示す構成図、
第４図は第３図例のタイミングチャート図、第５図及び
第６図は夫々本発明の応用例を示す構成図である。
（２Ａ） 、 （２Ｂ）は夫々遅延回路、（３）、 （
４）は夫々減算回路、（５）は加算回路、（６）は論理
演算回路、（１４）は乗算回路、（１５）は加算回路で
ある。FIG. 1 is a configuration diagram showing an embodiment of the video signal contour correction circuit of the present invention, FIG. 2 is a timing chart diagram of the example shown in FIG.
FIG. 3 is a configuration diagram showing an example of the logical operation circuit of the example shown in FIG.
FIG. 4 is a timing chart diagram of the example shown in FIG. 3, and FIGS. 5 and 6 are configuration diagrams showing applied examples of the present invention, respectively. (2A) and (2B) are delay circuits, (3) and (
4) is a subtraction circuit, (5) is an addition circuit, (6) is a logic operation circuit, (14) is a multiplication circuit, and (15) is an addition circuit.
Claims (1)
手段の出力信号を遅延させる第２の遅延手段と、上記原
信号並びに上記第１及び第２の遅延手段の夫々の出力信
号を加減算して第１、第２及び第３の輪郭補正信号を形
成する加減算回路と、上記第１、第２及び第３の輪郭補
正信号より第４の輪郭補正信号を形成する論理演算回路
とを設け、上記第４の輪郭補正信号のゲインを調整して
なる信号と上記第１の遅延手段の出力信号とを加算する
ことにより、上記原信号の変化部分を補正するようにし
たことを特徴とする映像信号の輪郭補正回路。a first delay means for delaying the original signal; a second delay means for delaying the output signal of the first delay means; and a first delay means for delaying the output signal of the first delay means; an addition/subtraction circuit that adds and subtracts to form first, second, and third contour correction signals; and a logic operation circuit that forms a fourth contour correction signal from the first, second, and third contour correction signals. and adding the signal obtained by adjusting the gain of the fourth contour correction signal and the output signal of the first delay means to correct the changing portion of the original signal. Contour correction circuit for video signals.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63318274A JPH02162969A (en) | 1988-12-16 | 1988-12-16 | Contour correction circuit for video signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63318274A JPH02162969A (en) | 1988-12-16 | 1988-12-16 | Contour correction circuit for video signal |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02162969A true JPH02162969A (en) | 1990-06-22 |
Family
ID=18097375
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63318274A Pending JPH02162969A (en) | 1988-12-16 | 1988-12-16 | Contour correction circuit for video signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02162969A (en) |
-
1988
- 1988-12-16 JP JP63318274A patent/JPH02162969A/en active Pending
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