JPH0129455B2 - - Google Patents
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- JPH0129455B2 JPH0129455B2 JP58061523A JP6152383A JPH0129455B2 JP H0129455 B2 JPH0129455 B2 JP H0129455B2 JP 58061523 A JP58061523 A JP 58061523A JP 6152383 A JP6152383 A JP 6152383A JP H0129455 B2 JPH0129455 B2 JP H0129455B2
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- H04W88/185—Selective call encoders for paging networks, e.g. paging centre devices
- H04W88/187—Selective call encoders for paging networks, e.g. paging centre devices using digital or pulse address codes
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- Mobile Radio Communication Systems (AREA)
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Abstract
Description
【発明の詳細な説明】
本発明は、バツテリー電力の消費を低減せしめ
るためのバツテリーセービング方式を採用した個
人選択呼出受信機に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a personal selection call receiver that employs a battery saving method to reduce battery power consumption.
従来、この種のバツテリーセービング方式とし
て、例えば、特願昭52―112052号「無線個別呼出
受信機」に開示された方式がある。このバツテリ
ーセービング方式では、受信機が予め定められた
第1周期で間欠に動作するようにしておく。そし
て、前記受信機は、基地局から送出された、該第
1周期よりも長い時間幅に設定されたバツテリー
セービング解除信号を、受信し検出すると、検出
に引き続き一定時間(この時間は、基地局から送
出される前記解除信号及び呼出符号からなる信号
列の時間幅よりも長い時間に設定される。)に渡
つて信号受信可能な状態を維持する。そして、前
記受信機は、該一定時間終了後、再び前記第1周
期からなる間欠動作へと移る。 Conventionally, as a battery saving method of this type, there is a method disclosed in Japanese Patent Application No. 112052/1988 entitled "Radio Individual Paging Receiver". In this battery saving method, the receiver is made to operate intermittently at a predetermined first cycle. When the receiver receives and detects a battery saving cancel signal transmitted from the base station and set to a time width longer than the first cycle, the receiver transmits the signal for a certain period of time (this time is (The time width is set to be longer than the time width of the signal string consisting of the release signal and the call code sent from the call code.) After the predetermined period of time has ended, the receiver returns to the intermittent operation of the first cycle.
この従来方式では、各受信機の前記第1周期
は、一般に、システム上最繁時の処理を前提に設
定される。このため、例えば夜間の如く、受信機
への呼の数が昼に比べ少なく、従つて基地局から
有用な受信機呼出番号を送出する頻度の希な状態
に於いても、各受信機は、前記第1周期で繰り返
し間欠動作するので、各受信機はバツテリー電力
を無駄に消費するという欠点を有していた。この
ため従来は電源スイツチにより夜間等に受信機電
源を断とする操作が行なわれていた。 In this conventional method, the first cycle of each receiver is generally set on the premise of processing during the busiest time on the system. Therefore, even in conditions such as nighttime, when the number of calls to the receiver is smaller than during the day, and therefore the base station rarely transmits useful receiver calling numbers, each receiver Since each receiver repeatedly operates intermittently in the first cycle, each receiver has the disadvantage of wasting battery power. For this reason, conventionally, an operation was performed to turn off the power to the receiver at night or the like using a power switch.
本発明の目的は、バツテリー電力の消費をより
低減できる個人選択呼出受信機を提供することに
ある。 SUMMARY OF THE INVENTION An object of the present invention is to provide a personal selection call receiver that can further reduce battery power consumption.
本発明の具体的な目的は、バツテリーセービン
グ周期を複数設定しうるシステムを構成し、基地
局より受信機呼出頻度の状況に応じてバツテリー
セービング周期選択信号を送出し、受信機のバツ
テリーセービング周期をシステム稼動状況に応じ
て最適化し、消費電力を低減することにより、電
源スイツチを削除可能にした、小形の個人選択呼
出受信機を提供することにある。 A specific object of the present invention is to configure a system that can set a plurality of battery saving cycles, and to transmit a battery saving cycle selection signal from a base station according to the receiver call frequency to set the battery saving cycle of the receiver. An object of the present invention is to provide a small-sized personal selection call receiver that is optimized according to system operating conditions and reduces power consumption, thereby making it possible to eliminate a power switch.
本発明によれば、バツテリーセービング切替信
号又は個別選択信号(呼出番号信号)で変調され
た無線波を受信するバツテリーセービング機能を
有する個人選択呼出受信機において、バツテリー
と、該無線波を受信復調する受信部と、該受信部
出力に接続された信号選択回路と、該信号選択回
路の出力端子に接続されたバツテリーセービング
周期を少なくとも2つ有するパルサー回路と、該
パルサー回路出力と前記バツテリーに接続された
スイツチ手段と、前記信号選択回路の別の出力端
子に接続された呼出報知手段とを有し、前記信号
選択回路は、前記パルサー回路が第1バツテリー
セービング周期で動作している場合に、バツテリ
ーセービング周期切替信号を受信検出すると前記
パルサー回路に検出信号を出力して、該パルサー
回路のバツテリーセービング周期を第1周期より
も長い第2周期へ切替え、前記スイツチ手段は、
該パルサー回路出力により断続された前記バツテ
リー電力を少なくとも前記受信部へ供給すること
を特徴とする個人選択呼出受信機が得られる。 According to the present invention, in a personal selection calling receiver having a battery saving function that receives radio waves modulated with a battery saving switching signal or an individual selection signal (calling number signal), the battery and the radio waves are received and demodulated. a receiving section, a signal selection circuit connected to the output of the receiving section, a pulser circuit having at least two battery saving cycles connected to an output terminal of the signal selection circuit, and a pulser circuit connected to the output of the pulser circuit and the battery. a switch means connected to another output terminal of the signal selection circuit; Upon receiving and detecting a saving cycle switching signal, the switching means outputs a detection signal to the pulser circuit to switch the battery saving cycle of the pulser circuit to a second cycle longer than the first cycle, and the switching means:
There is obtained a personal selection call receiver characterized in that the battery power, which is intermittent by the output of the pulser circuit, is supplied to at least the receiver section.
次に本発明の実施例について図面を参照して説
明する。 Next, embodiments of the present invention will be described with reference to the drawings.
第1図は、本発明の基地局の構成を示す図であ
る。加入者電話機1は、電話交換機2を経て、符
号化装置3内のトランク31へ接続される。レジ
スタ33は、トランク31から入力されるダイヤ
ルパルスを計数し、加入者電話機1により送出さ
れた個人呼出受信機呼出番号をBCD(Binary―
Coded Decimal)番号に変換する。また、呼出
設定スイツチ32は、オペレーターによる手動操
作でレジスタ33へ受信機番号を入力させること
ができるものである。記憶回路35は、レジスタ
33からのBCD番号を記憶する。符号変換器3
6は、記憶回路35からのBCD番号を2元番号
に変換する。そして、符号化回路41は、符号変
換器36からの出力信号にパリテイチエツクビツ
トをつけ加え、巡回符号を出力する。 FIG. 1 is a diagram showing the configuration of a base station of the present invention. The subscriber telephone 1 is connected via a telephone exchange 2 to a trunk 31 within the encoding device 3 . The register 33 counts the dial pulses input from the trunk 31 and converts the personal calling receiver calling number sent by the subscriber telephone 1 into a BCD (Binary).
Coded Decimal) number. Further, the call setting switch 32 allows an operator to manually input a receiver number into the register 33. The storage circuit 35 stores the BCD number from the register 33. Code converter 3
6 converts the BCD number from the storage circuit 35 into a binary number. Then, the encoding circuit 41 adds parity check bits to the output signal from the code converter 36 and outputs a cyclic code.
前置信号発生器37は、前置信号として、予め
決められた第1時間(本例では9回繰返し時間)
又は第2時間(本例では1025回繰返し時間)、ユ
ニークワードを繰返し発生する。同期信号発生器
38は、ユニークワードに引き続く同期信号を発
生する。バツテリーセービング周期切替信号発生
器39は、同期信号に引き続くバツテリーセービ
ング周期切替信号を発生する。終了信号発生器4
0は、終了信号を発生する。タイミング回路34
は、回路35,36,37,38,39,40,
41、ORゲート42,43及びNANDゲート4
4,45を個々に制御し、NANDゲート46か
ら符号化装置出力信号を出力させる。 The pre-signal generator 37 generates a predetermined first time (9 repetition time in this example) as a pre-signal.
Or, for a second time (1025 repetition time in this example), a unique word is repeatedly generated. A synchronization signal generator 38 generates a synchronization signal following the unique word. The battery saving cycle switching signal generator 39 generates a battery saving cycle switching signal following the synchronization signal. Termination signal generator 4
0 generates a termination signal. timing circuit 34
are circuits 35, 36, 37, 38, 39, 40,
41, OR gates 42, 43 and NAND gate 4
4 and 45 individually to cause the NAND gate 46 to output the encoder output signal.
送信機5は、FSK変調器51と、周波数変換
器52と、電力増幅器53と、空中線54とから
成る。 The transmitter 5 includes an FSK modulator 51, a frequency converter 52, a power amplifier 53, and an antenna 54.
ここで、第2図を参照し、基地局の動作を詳細
に説明する。 Here, the operation of the base station will be explained in detail with reference to FIG.
通常の電話加入者から個人呼出受信機(第3図
を参照して後述する。以下受信機と記す。)を呼
び出す場合、電話加入者の電話機1から受信機に
割り当てられた呼出番号をダイヤルする。ダイヤ
ル信号は変換機2を経てトランク31へ入力さ
れ、更にレジスタ33へ入力される。オペレータ
が手動で呼出設定スイツチ32を操作することに
より、呼出番号をレジスタ33へ入力することを
出来る。レジスタ33は、呼を予め定められた数
(例えば4コール)だけ受けると、記憶回路35
へ、BCD番号に変換した呼出番号をすべて転送
する。記憶回路35は呼出番号をタイミング回路
34からの読み出し信号が来るまで記憶する。記
憶回路35の容量は本例では80コールである。 When a regular telephone subscriber calls a personal calling receiver (described later with reference to FIG. 3; hereinafter referred to as the receiver), the calling number assigned to the receiver is dialed from the telephone subscriber's telephone 1. . The dial signal is input to the trunk 31 via the converter 2, and further input to the register 33. By manually operating the call setting switch 32, the operator can enter the call number into the register 33. When the register 33 receives a predetermined number of calls (for example, 4 calls), the register 33 stores the memory circuit 35.
, transfer all the calling numbers converted to BCD numbers. The storage circuit 35 stores the calling number until a read signal from the timing circuit 34 is received. The capacity of the memory circuit 35 is 80 calls in this example.
タイミング回路34は、記憶回路35に番号が
入力されると、前置信号発生器37を起動し、前
置信号をORゲート42、NANDゲート44及び
46を経て、送信機5へ送出させる。前置信号の
送出時間は、第2図AやBのPで示す如く、9ワ
ード(即ち155mSEC×9=1395mSEC)で、各1ワ
ード(以下、ユニークワードとする。)は第2図
Dで示す如く31ビツトの符号パターンから成る。
前置信号発生器37は、タイミング回路34の出
力信号によつて起動される31ビツトカウンタと、
ユニークワード送出カウンタと、第2図Dの符号
パターンを予め設定したROM(Read―Only―
Memory、例えばNEC製μPD501D)とを有し、
31ビツトカウンタの出力信号でROMの内容を読
み出し、更にユニークワード送出カウンタで設定
された回数繰返しROMの内容を読み出す。前置
信号P(9ワード)の送出が終了すると、タイミ
ング回路34は、同期信号発生器38を起動し、
第2図Eの符号パターンから成る同期信号を第2
図Bの#1ワードの位置で送出させる。更にタイ
ミング回路34は、同期信号終了に引き続き、記
憶回路35へ読み出し信号を送出すると同時に、
符号変換器36、符号化回路41、NANDゲー
ト45を動作させる。この時間は、第2図Bに示
す如く最大80ワード分(155mSEC×80=12.4SEC以
下)である。今、記憶回路35に呼出番号が格納
されていれば、呼出番号はタイミング回路34か
らの読み出し信号によつて格納順に番号単位で符
号変換器36へ、記憶回路35が空になるまで転
送される。符号変換器36はBCD番号を21ビツ
トピユアバイナリー符号に変換する。符号化回路
41は、10ビツトのパリテイチエツクビツトを前
記21ビツトの情報符号に付加し、巡回符号の
BCH(31、21)からなる1ワードの受信機呼出番
号(以下アドレス番号とする。)を、NANDゲー
ト45,46を経て送信機5へ送出する。アドレ
ス番号の符号パターンの一例を第2図Gに示す。
第2図Bに図示する如く、#2から#81ワードへ
の順で最大80ワードのアドレス番号が連続送出さ
れる。この符号化回路41は、Wesley Peterson
著“Error Correcting Codes”pp149〜152、
1961The M.I.T.Pressにより開示されたシフトレ
ジスタと加算器とを用いた回路で構成される。記
憶回路35は格納が空になると、出力信号をタイ
ミング回路34へ送出する。タイミング回路34
はこの信号に応答し、回路35,36,41の動
作を停止すると同時に、終了信号発生器40を起
動し、第2図A,Bに図示する如く終了信号E
を、ORゲート42,43及びNANDゲート4
4,46を経て、送信機5へ送出させる。終了信
号Eの1ワードの符号パターンを第2図Hに示
す。本符号パターンは31ビツトから成るPNパタ
ーンである。終了信号発生器40は、前述の前置
信号発生器37と同様に構成され、2ワード
(155mSEC×2=310mSEC)で信号送出を終了す
る。 When the number is input to the storage circuit 35, the timing circuit 34 activates the pre-signal generator 37 and sends the pre-signal to the transmitter 5 via the OR gate 42, NAND gates 44 and 46. The transmission time of the prefix signal is 9 words (i.e. 155m SEC x 9 = 1395m SEC), as shown by P in Figure 2 A and B, and each word (hereinafter referred to as a unique word) is 9 words (i.e. 155m SEC x 9 = 1395m SEC ), and each word (hereinafter referred to as a unique word) is It consists of a 31-bit code pattern as shown by D.
The pre-signal generator 37 includes a 31-bit counter activated by the output signal of the timing circuit 34;
A unique word sending counter and a ROM (Read-Only-
Memory, for example μPD501D manufactured by NEC),
The contents of the ROM are read out using the output signal of the 31-bit counter, and the contents of the ROM are read out repeatedly the number of times set by the unique word sending counter. When the sending of the prefix signal P (9 words) is completed, the timing circuit 34 starts the synchronization signal generator 38,
The synchronization signal consisting of the code pattern shown in Fig. 2E is
It is sent at the #1 word position in Figure B. Further, the timing circuit 34 sends out a read signal to the storage circuit 35 following the completion of the synchronization signal, and at the same time,
The code converter 36, encoding circuit 41, and NAND gate 45 are operated. This time is for a maximum of 80 words (155 m SEC x 80 = 12.4 SEC or less) as shown in Fig. 2B. If a call number is currently stored in the memory circuit 35, the call number is transferred number by number to the code converter 36 in the order in which it was stored, by the read signal from the timing circuit 34, until the memory circuit 35 is empty. . A code converter 36 converts the BCD number to a 21-bit pure binary code. The encoding circuit 41 adds a 10-bit parity check bit to the 21-bit information code and converts it into a cyclic code.
A one-word receiver calling number (hereinafter referred to as address number) consisting of BCH (31, 21) is sent to the transmitter 5 via NAND gates 45 and 46. An example of the address number code pattern is shown in FIG. 2G.
As shown in FIG. 2B, address numbers of up to 80 words are successively transmitted in the order from word #2 to word #81. This encoding circuit 41 is a Wesley Peterson
Author “Error Correcting Codes” pp149-152,
It is composed of a circuit using a shift register and an adder disclosed by The MITPress in 1961. When the storage circuit 35 becomes empty, it sends an output signal to the timing circuit 34. timing circuit 34
In response to this signal, it stops the operation of circuits 35, 36, and 41, and at the same time activates termination signal generator 40 to generate termination signal E as shown in FIGS. 2A and 2B.
, OR gates 42, 43 and NAND gate 4
4 and 46, and then sent to the transmitter 5. The code pattern of one word of the end signal E is shown in FIG. 2H. This code pattern is a PN pattern consisting of 31 bits. The termination signal generator 40 is configured in the same manner as the pre-signal generator 37 described above, and terminates signal transmission after two words (155m SEC x 2 = 310m SEC ).
タイミング回路34は、終了信号発生器40で
信号送出が終了すると、内蔵するタイマーを起動
する。このタイマー設定時間は本例では2分
38.72秒(1024ワード×155mSEC)である。この時
間内に記憶回路35からの新たな番号格納信号が
有れば、タイミング回路34はこの信号によつて
前述の一連の動作を繰り返す。この時の信号列を
第2図Aに示す。 The timing circuit 34 starts a built-in timer when the end signal generator 40 finishes sending the signal. In this example, the timer setting time is 2 minutes.
It took 38.72 seconds (1024 words x 155m SEC ). If there is a new number storage signal from the storage circuit 35 within this time, the timing circuit 34 repeats the series of operations described above in response to this signal. The signal train at this time is shown in FIG. 2A.
他方、タイミング回路34内のタイマーがタイ
ムアウトすると、タイミング回路34は、前置信
号発生器37を起動し、第2図BのPと同様の9
ワードのユニークワードを送出させ、引き続き同
期信号発生器38を起動し、第2図Eで示した1
ワードの同期信号を送出させる。更に引き続き、
タイミング回路34はバツテリーセービング切替
信号発生器39を起動し、少なくとも1ワードの
第2図Fで示す31ビツトパターンからなるバツテ
リーセービング切替信号を送出させ、引き続き終
了信号発生器40を起動し、第2図のHの終了信
号を2ワード送出させる。タイミング回路34
は、記憶回路35への新たな番号入力が無い限り
何等出力信号を発生しない。 On the other hand, when the timer within timing circuit 34 times out, timing circuit 34 activates pre-signal generator 37 and activates 9, similar to P in FIG. 2B.
1, as shown in FIG.
Send word synchronization signal. Continuing further,
The timing circuit 34 activates the battery saving switching signal generator 39 to transmit a battery saving switching signal consisting of at least one word of the 31-bit pattern shown in FIG. Sends 2 words of the end signal H in the figure. timing circuit 34
does not generate any output signal unless a new number is input to the memory circuit 35.
新たに記憶回路35が番号入力を受けると、タ
イミング回路34は、前置信号発生器37を起動
すると同時に、ユニークワード送出カウンタ切替
信号を、接続線47を経て前置信号発生器37に
供給して前置信号発生器37内のユニークワード
送出カウンタを9から1025に切替え、前置信号発
生器37から1025ワードのユニークワード(第2
図cのP′)を送出させる。タイミング回路34
は、この後9ワード間信号送出を停止し、再び前
置信号発生器37を起動すると同時に、ユニーク
ワード送出カウンタ切替信号を供給して前置信号
発生器37内のユニークワード送出カウンタを
1025から9に変更し、前述の第2図Bの一連の信
号列を送出させる。上述した信号列を第2図cに
図示する。 When the storage circuit 35 receives a new number input, the timing circuit 34 activates the prefix signal generator 37 and at the same time supplies a unique word sending counter switching signal to the prefix signal generator 37 via the connection line 47. The unique word sending counter in the pre-signal generator 37 is switched from 9 to 1025, and the 1025-word unique word (second
P') in Figure c is sent. timing circuit 34
After that, stops the signal transmission for 9 words, starts the pre-signal generator 37 again, and at the same time supplies the unique word sending counter switching signal to start the unique word sending counter in the pre-signal generator 37.
1025 to 9, and the series of signal strings shown in FIG. 2B described above are sent out. The signal sequence described above is illustrated in FIG. 2c.
送信機5は、符号化装置3から受けた出力信号
列により変調された無線搬送波を空中線54より
送出する。 The transmitter 5 transmits a radio carrier wave modulated by the output signal sequence received from the encoding device 3 from the antenna 54.
第3図は本発明の受信機の回路図である。第4
図のタイムチヤート図を参照してこの受信機の動
作を説明する。 FIG. 3 is a circuit diagram of the receiver of the present invention. Fourth
The operation of this receiver will be explained with reference to the time chart shown in the figure.
基地局側送信機5から送出された被変調搬送波
をアンテナ100でピツクアツプし、受信部20
0で受信復調しベースバンド信号に変換する。こ
のベースバンド信号は波形整形回路300で矩形
波に波形整形され信号選択回路400に供給され
る。上述の動作は、もちろん、受信機が、第4図
bに示すバツテリーセービングOFF時間2t、バツ
テリーセービングON時間5t(ここで、tは1ワ
ード)の同期からなるバツテリーセービング動作
OFF時間にあるとき、実行される。 The modulated carrier wave sent out from the base station transmitter 5 is picked up by the antenna 100 and sent to the receiver 20.
0 and demodulates the reception and converts it to a baseband signal. This baseband signal is waveform-shaped into a rectangular wave by the waveform shaping circuit 300 and supplied to the signal selection circuit 400. Of course, the above operation is a battery saving operation in which the receiver synchronizes a battery saving OFF time of 2t and a battery saving ON time of 5t (here, t is 1 word) as shown in FIG. 4b.
Executed when in OFF time.
さて、受信機が、第4図aで示すタイミングで
被変調波を受信すると、ビツト同期回路410
は、復調信号にビツト同期したクロツク信号を再
生し、ライン900を経て、前置信号検出器42
0、同期信号検出器430、終了信号検出器44
0及びアドレス信号検出器450へ供給する。波
形整形回路300の出力信号は、前置信号検出器
420の入力に、アンドゲート486を介し供給
される。このアンドゲート486のもう一方の入
力はパルサー回路700内のフリツプフロツプ
(F/F)730の出力に接続されている。こ
のF/F730はバツテリーセービング動作モー
ド時のみが“H”でバツテリーセービング非動
作モード時は後述する如く“L”となる。従つ
て、前置信号検出器420への信号はバツテリー
セービング動作モード時のみとなつている。 Now, when the receiver receives the modulated wave at the timing shown in FIG. 4a, the bit synchronization circuit 410
reproduces a clock signal bit-synchronized with the demodulated signal and passes it through line 900 to pre-signal detector 42.
0, synchronization signal detector 430, end signal detector 44
0 and address signal detector 450. The output signal of waveform shaping circuit 300 is provided to the input of pre-signal detector 420 via AND gate 486 . The other input of this AND gate 486 is connected to the output of a flip-flop (F/F) 730 within the pulser circuit 700. This F/F 730 is "H" only in the battery saving operation mode, and is "L" in the battery saving non-operation mode as will be described later. Therefore, a signal is sent to the front signal detector 420 only in the battery saving operation mode.
前置信号検出器420は、前置信号を検出する
と、第4図cの検出パルスをライン901に出力
する。この検出パルスによつて、パルサー回路7
00のF/F730がセツトされ、このF/F7
30のQ出力がNORゲート740を介してスイ
ツチングトランジスタ750をONに保持する。
一方、F/F730の出力は“L”となり、ア
ンドゲート486を禁止状態にする。第4図cに
示したライン901のパルスは、更に、タイマー
460を起動し、ライン900からのクロツク信
号により、タイマー460は時間カウントを開始
する。このタイマー460の設定時間(第3時
間)は第4図bに示す9tである。 When the pre-signal detector 420 detects the pre-signal, it outputs the detection pulse shown in FIG. 4c onto the line 901. This detection pulse causes the pulser circuit 7
00 F/F730 is set, and this F/F7
The Q output of 30 holds switching transistor 750 ON via NOR gate 740.
On the other hand, the output of the F/F 730 becomes "L", and the AND gate 486 is inhibited. The pulse on line 901 shown in FIG. 4c also starts timer 460, and the clock signal from line 900 causes timer 460 to begin counting time. The set time (third time) of this timer 460 is 9t shown in FIG. 4b.
今、仮にこの9t時間内に同期信号(第4図aの
#1)が検出されないと、タイムアウト信号がラ
イン902へ出力され、ORゲート490を介し
てF/F730をリセツトする。この結果、F/
F730のQ出力が“L”となり、この信号が
NORゲート740を介してスイツチングトラン
ジスタ750をOFFさせ、バツテリーセービン
グ動作モードへ復帰させる。一方、F/F730
の出力が“H”となるので、アンドゲート48
6が接状態となる。 Now, if the synchronization signal (#1 in FIG. 4a) is not detected within this 9t time, a timeout signal is output to line 902 and resets F/F 730 via OR gate 490. As a result, F/
The Q output of F730 becomes “L” and this signal
The switching transistor 750 is turned off via the NOR gate 740 to return to the battery saving operation mode. On the other hand, F/F730
Since the output of the AND gate 48 becomes “H”,
6 is in contact state.
前記9t中に、同期信号検出器430により同期
信号(第4図a#1)が検出されると、ライン9
03に検出パルスを第4図dの通り出力する。こ
のパルスはライン903を経て、タイマー460
をリセツトすると共に、タイマー470を起動
し、タイマー470に時間カウントを開始させ
る。タイマー470の設定時間(第4時間)は第
4図bの80tである。このタイマー470がタイ
ムアウトした時の動作は、前記タイマー460の
場合と同様で、スイツチングトランジスタ750
をOFFさせる。 During the above 9t, when the synchronization signal (a#1 in FIG. 4) is detected by the synchronization signal detector 430, the line 9
03, a detection pulse is output as shown in FIG. 4d. This pulse is passed through line 903 to timer 460.
At the same time, the timer 470 is started and the timer 470 starts counting time. The set time (fourth time) of the timer 470 is 80t in FIG. 4b. The operation when the timer 470 times out is the same as that of the timer 460, and the switching transistor 750
Turn off.
ここで、前置信号検出器420、同期信号検出
器430、終了信号検出器440の回路構成は同
様であり、代表して同期信号検出器430につい
て説明する。第2図Eの同期信号は、31ビツトの
シフトレジスタ434へ入力される。シフトレジ
スタ434の31ビツトの出力のうち、同期信号の
“L”レベルに対応するビツトのみ、インバータ
431,432,433,…を介し、同期信号の
“H”レベルに対応するビツトは直接、31入力の
アンドゲート435に接続されている。シフトレ
ジスタ434が同期信号31ビツトを全て取り込ん
だ時のみ、アンドゲート435は“H”レベルの
検出パルス(第4図d)をライン903に出力す
る。前置信号検出器420、同期信号検出器43
0、終了信号検出器440で互に異なるのは、第
2図D,E,Hに示す信号パターンの“L”レベ
ルに合わせて設けられるインバータの位置のみで
ある。 Here, the circuit configurations of the pre-signal detector 420, the synchronizing signal detector 430, and the end signal detector 440 are the same, and the synchronizing signal detector 430 will be described as a representative. The synchronization signal of FIG. 2E is input to a 31-bit shift register 434. Of the 31 bits output from the shift register 434, only the bits corresponding to the "L" level of the synchronizing signal are passed through the inverters 431, 432, 433, etc., and the bits corresponding to the "H" level of the synchronizing signal are directly transmitted. It is connected to the input AND gate 435. Only when the shift register 434 takes in all 31 bits of the synchronizing signal, the AND gate 435 outputs an "H" level detection pulse (FIG. 4d) to the line 903. Pre-signal detector 420, synchronization signal detector 43
The only difference between the 0 and end signal detectors 440 is the position of the inverter provided in accordance with the "L" level of the signal patterns shown in FIG. 2D, E, and H.
次に、本受信機のアドレス信号(第2図Gのも
のとする)が、第4図aの#81ワード目に基地局
から送出されたとすると、アドレス信号検出器4
50により第4図eに示す検出パルスがライン9
04に出力され、警報音発生器500へ供給さ
れ、これを起動する。警報音発生回路500は第
4図fに示す如く連続的に警報出力を発生するよ
う動作し、スピーカ600を駆動し、本受信機の
携行者に呼び出されたことを報知する。第4図f
のαはリセツトスイツチ501がプツシユされ、
警報音がリセツトされたことを示す。 Next, if the address signal of this receiver (assumed to be the one in FIG. 2 G) is sent from the base station at word #81 in FIG. 4 a, then the address signal detector 4
50, the detection pulse shown in FIG.
04 and is supplied to the alarm sound generator 500 to start it. The alarm sound generating circuit 500 operates to continuously generate an alarm output as shown in FIG. Figure 4 f
α is when the reset switch 501 is pushed,
Indicates that the alarm tone has been reset.
ここで、アドレス信号検出器450の詳細動作
を説明する。 Here, the detailed operation of address signal detector 450 will be explained.
ライン903の同期信号検出パルス(第4図d
参照)により、リードパルス発生器454が起動
される。リードパルス発生器454は、ライン9
00からのクロツク信号に同期したリードパルス
を、第3図の454に図示する#1〜#31の各ビ
ツト対応出力端子に順次出力し、これを巡回的に
繰り返す。プログラマブル・リード・オンリ・メ
モリ(PROM)453には、予め受信機に割り
あてたアドレス信号を書き込んであり、PROM
の形状はいわゆるコードプラグとなつている。リ
ードパルス発生器454はシフトレジスタで構成
されている。リードパルス発生器454の#1か
らのリードパルスによりPROM453のデータ
が読み出され、2入力のエクスクルーシブNOR
ゲート451の一入力端子に供給される。エクス
クルーシブNORゲート451の他の入力端子に
は波形整形回路300からの入力信号が印加され
ており、エクスクルーシブNORゲート451は、
両入力が一致すれば“H”、不一致であれば“L”
を出力する。この“H”出力をカウンタ452で
計数する。カウンタ452はライン900からの
クロツク信号を供給されているので、次に#2の
PROM453の出力データと波形整形回路30
0の入力信号とが同様にエクスクルーシブNOR
ゲート451にて照合された結果一致すれば、カ
ウンタ452は、計数をアツプし、以下順次#31
ビツトまで進め、31ビツト全てが一致すれば、検
出パルス(第4図e)をライン904へ出力す
る。そして、カウンタ452は#31のリードパル
スの立下りでリセツトされ、後続するワード毎の
カウントに備える。 Synchronization signal detection pulse on line 903 (Fig. 4d)
), the read pulse generator 454 is activated. Read pulse generator 454 is connected to line 9
Read pulses synchronized with the clock signal starting from 00 are sequentially outputted to the output terminals corresponding to the bits #1 to #31 shown at 454 in FIG. 3, and this is repeated cyclically. The programmable read-only memory (PROM) 453 has the address signal assigned to the receiver written in advance, and the PROM
The shape is what is called a cord plug. Read pulse generator 454 is composed of a shift register. The data of the PROM 453 is read by the read pulse from #1 of the read pulse generator 454, and the 2-input exclusive NOR
It is supplied to one input terminal of gate 451. The input signal from the waveform shaping circuit 300 is applied to the other input terminal of the exclusive NOR gate 451, and the exclusive NOR gate 451
“H” if both inputs match, “L” if they do not match
Output. This "H" output is counted by a counter 452. Since counter 452 is being fed the clock signal from line 900, it will now receive the clock signal from #2.
PROM453 output data and waveform shaping circuit 30
0 input signal is also exclusive NOR
If the result of the comparison at the gate 451 matches, the counter 452 counts up the count, and then sequentially #31.
If all 31 bits match, a detection pulse (FIG. 4e) is output to line 904. Then, the counter 452 is reset at the falling edge of the #31 read pulse, and prepares for counting each subsequent word.
次に、第5図のタイムチヤートを参照して、バ
ツテリーセービング周期切替時の一連動作につき
説明する。 Next, with reference to the time chart of FIG. 5, a series of operations when switching the battery saving period will be described.
第5図aは基地局から送出する被変調搬送波を
示す。今、基地局の符号化装置3に、電話交換機
2からの呼出番号信号が前述の一定時間(1024ワ
ード)内に4個入力されないと、基地局は、9ワ
ード(9t)の前置信号(第5図aのP)を送信機
5から送出し、続いて、1ワードの同期信号(第
5図aの1)、1ワードのバツテリーセービング
切替信号(第5図aの2)、2ワードの終了信号
(第5図aのE)を送信機5から発射し、その後、
符号化装置3内の記憶回路35に4個の呼出番号
が登録されるまで送信機5からの被変調波発射は
休止する。4個の呼出番号が登録されると、第2
図cで説明した通り、送信機5から第5図aに図
示する如く被変調波が発射される。 FIG. 5a shows a modulated carrier wave transmitted from a base station. Now, if four calling number signals from the telephone exchange 2 are not input to the encoding device 3 of the base station within the above-mentioned fixed time (1024 words), the base station will receive a 9-word (9t) prefix signal ( P) in Fig. 5a is sent from the transmitter 5, followed by a 1-word synchronization signal (1 in Fig. 5a), a 1-word battery saving switching signal (2 in Fig. 5a), and 2 words. The end signal (E in Figure 5a) is emitted from the transmitter 5, and then,
The modulated wave emission from the transmitter 5 is stopped until four calling numbers are registered in the storage circuit 35 in the encoding device 3. When four calling numbers are registered, the second
As explained in FIG. 5c, a modulated wave is emitted from the transmitter 5 as shown in FIG. 5a.
この第5図aの被変調波に対応する第3図の受
信機のバツテリーセービング動作を示す図が第5
図bである。受信部200や波形整形回路300
は、第5図bの如く、パルサー回路700によ
り、バツテリセービングOFF(2t)及びON(5t)
を、繰り返している。受信部200や波形整形回
路300がバツテリセービングOFFの2t期間内に
ある時に、前置信号Pが前置信号検出器420に
よつて検出されると、第5図cのc1′時点で検出
パルスが発生される。この時、第4図cについて
説明した通り、タイマー460によつて、バツテ
リセービングOFF時間が第5図bの如く9t(第3
時間)に設定される。そして、同期信号が、第4
図dで説明した通り、第5図dのd1′時点で検出
され、タイマー470によつて、バツテリーセー
ビングOFF時間が80t(第4時間)に設定される。
ここで、第5図aの2で示すバツテリーセービン
グ切替信号が切替信号検出器480によつて検出
され、第5図eの検出パルスがライン905に出
力される。ライン905のパルスはORゲート4
85を介しタイマー470をリセツトし、更に
ORゲート490を介しF/F730をリセツト
し、そのQ出力を“L”に反転する。そして、
NORゲート740を介し、スイツチングトラン
ジスタ750をOFFする。 Figure 5 shows the battery saving operation of the receiver in Figure 3 corresponding to the modulated wave in Figure 5a.
Figure b. Receiving section 200 and waveform shaping circuit 300
As shown in Fig. 5b, the battery saving is turned OFF (2t) and ON (5t) by the pulser circuit 700.
is repeated. When the prefix signal P is detected by the prefix signal detector 420 while the receiving section 200 and the waveform shaping circuit 300 are in the 2t period of battery saving OFF, it is detected at time c 1 ' in FIG. 5c. A pulse is generated. At this time, as explained with reference to FIG. 4c, the timer 460 determines that the battery saving OFF time is 9t (the third
time). Then, the synchronization signal
As explained in FIG. d, it is detected at time d 1 ' in FIG. 5d, and the battery saving OFF time is set to 80t (fourth time) by the timer 470.
Here, the battery saving switching signal shown at 2 in FIG. 5a is detected by the switching signal detector 480, and the detection pulse shown in FIG. The pulse on line 905 is OR gate 4
85 to reset the timer 470, and
The F/F 730 is reset via the OR gate 490, and its Q output is inverted to "L". and,
The switching transistor 750 is turned off via the NOR gate 740.
ここで、ライン905の検出パルスはフリツプ
フロツプ(F/F)760をセツトし、出力Q,
Qを反転する。F/F760の出力,Qはそれ
ぞれアンドゲート780,770に接続されてお
り、アンドゲート780を禁止、770を接状態
に保持する。アンドゲート770の他の入力端子
には第5図bにβ2で示す制御信号が繰返し入力さ
れる。又、アンドゲート780の他の入力端子に
は第5図bにβ1で示す制御信号が繰返し入力され
る。これら制御信号は、発振器710の出力を分
周し所要の制御信号β1,β2を発生する制御信号発
生器720から供給される。この制御信号発生器
720をリセツトし初期設定するパルスは、F/
F730の出力Qをインバータ790により反転
して得られる。このため、ナンドゲート740は
アンドゲート770の出力信号によつて制御さ
れ、β2の周期でスイツチングトランジスタ750
を繰返し断続させる。 Here, the detection pulse on line 905 sets a flip-flop (F/F) 760 and outputs Q,
Invert Q. The output and Q of the F/F 760 are connected to AND gates 780 and 770, respectively, and the AND gate 780 is inhibited and the gate 770 is kept connected. A control signal indicated by β 2 in FIG. 5b is repeatedly input to the other input terminal of the AND gate 770. Further, a control signal indicated by β 1 in FIG. 5b is repeatedly input to the other input terminal of the AND gate 780. These control signals are provided by a control signal generator 720 which divides the output of oscillator 710 and generates the required control signals β 1 , β 2 . The pulse that resets and initializes this control signal generator 720 is
It is obtained by inverting the output Q of F730 using an inverter 790. Therefore, the NAND gate 740 is controlled by the output signal of the AND gate 770, and the switching transistor 750 is controlled with a period of β 2 .
is repeatedly intermittent.
ここで、バツテリーセービングの周期変更によ
る効果を説明する、受信部200及び波形整形部
300の消費電流が3mA、信号選択回路400
及びパルサー回路700の消費電流が150μAであ
るので、平均消費電流は、バツテリーセービング
周期β1のときは、
2t×3000+5t×150/7t≒964μA
であり、バツテリーセービング周期β2のときは、
2t×3000+1021t×150/1023t≒155μA
である。従つて、消費電流低減効果はβ1からβ2へ
の切替なしに比較し、わずか16%と極めて大であ
る。 Here, to explain the effect of changing the cycle of battery saving, the current consumption of the receiving section 200 and the waveform shaping section 300 is 3 mA, and the current consumption of the signal selection circuit 400 is
Since the current consumption of the pulser circuit 700 is 150μA, the average current consumption is 2t×3000+5t×150/7t≒964μA when the battery saving cycle is β 1 , and 2t× when the battery saving cycle is β2 . 3000+1021t×150/1023t≒155μA. Therefore, the effect of reducing current consumption is only 16%, which is extremely large compared to not switching from β 1 to β 2 .
次に基地局から第5図aのP′で示す1025tの時
間長からなる前置信号が送出されると、前置信号
検出器420は第5図cのc2′時点で検出パルス
をライン901に出力する。ライン901のパル
スはF/F760をリセツトし、Q,出力を反
転する。このため、アンドゲート780が禁止か
ら接へ、アンドゲート770が接から禁止状態へ
と切替えられ、バツテリーセービング周期がβ2か
らβ1へ切替えられることとなる。ライン901の
パルスは(第5図cのc2′時点)は第5図cの
c1′時点で説明したのと同様の動作を引き起すの
で、バツテリーセービングは9tの時間解除され
る。この時間内に図示の通り同期信号は検出され
ないので、再びタイマー460からのタイムアウ
ト信号によりバツテリーセービングへと復帰す
る。基地局側の前置信号P′とPとの間の休止時間
9tは、受信機が同期信号を待受けている9t時間に
P′に続くPが連続して送られる場合に起きるバツ
テリーセービング解除不能の状態を避ける為に設
けている。 Next, when the base station sends out a pre-signal having a time length of 1025t as indicated by P' in FIG . Output to 901. The pulse on line 901 resets F/F 760 and inverts the Q output. Therefore, the AND gate 780 is switched from prohibited to closed, the AND gate 770 is switched from closed to prohibited, and the battery saving cycle is switched from β 2 to β 1 . The pulse on line 901 (at time c 2 ' in Figure 5c) is
Battery saving is canceled for a time of 9t, causing an operation similar to that described at time c 1 ′. Since no synchronization signal is detected within this time as shown, the timeout signal from timer 460 returns to battery saving mode. Pause time between prefix signals P′ and P on the base station side
9t is the 9t time when the receiver is waiting for the synchronization signal.
This is provided to avoid a situation where battery saving cannot be canceled which occurs when P following P' is sent continuously.
次に、第5図cのc3′時点で前置信号Pを検出
し、第5図dのd2′時点で同期信号を検出する動
作過程は、第4図c,dと同様である。 Next, the operation process of detecting the prefix signal P at time c 3 ' in Figure 5 c and detecting the synchronizing signal at time d 2 ' in Figure 5 d is the same as in Figures 4 c and d. .
尚、終了信号E(第2図H参照)をアドレス信
号に後続し送出するのは、受信機がバツテリーセ
ービング解除期間80tとなつたとき、基地局から
のアドレス信号送出が80t以下の場合に不要な受
信動作をしないように、終了信号検出器440で
検出し、検出パルスをORゲート485及び49
0を介してF/F730をリセツトし、バツテリ
ーセービングに復帰させるためである。 Note that it is unnecessary to send the end signal E (see Figure 2 H) after the address signal when the receiver reaches the battery saving cancellation period of 80t and the address signal sent from the base station is less than 80t. The end signal detector 440 detects the pulse, and the detected pulse is passed through the OR gates 485 and 49 so as not to perform a receiving operation.
This is to reset the F/F 730 via 0 and return to battery saving mode.
以上の実施例に於いては、前置信号として第2
図Dの符号パターンのみを使用した場合について
記載したが、前置信号は、同期信号、バツテリー
セービング切替信号、終了信号、アドレス信号と
異なる符号であれば、その符号に置き換え可能な
ことは勿論である。 In the above embodiment, the second signal is used as the prefix signal.
Although we have described the case where only the code pattern in Figure D is used, it goes without saying that the prefix signal can be replaced with a different code from the synchronization signal, battery saving switching signal, termination signal, and address signal. be.
又、アドレス番号容量は221=2097152であるの
で、例えばこれを1万番号毎にグループ化し、
200グループとし、それぞれのグループの前置信
号を別々に設定すること、更には、基地局で、呼
出番号対グループ変換器をトランク31とレジス
タ33の間に挿入し、各グループ毎にレジスタ3
3以降の符号化装置構成回路を設け、送信機5へ
の変調信号出力用NANDゲート46に後続して
各グループ変調信号整列回路を設ける事により、
バツテリーセービング周期がβ2となる期間を大き
くとれることは明白である。この場合、受信機の
前置信号検出器420の回路構成はアドレス信号
検出器450同様に構成することで同期信号設定
をコードプラグ形式とすることができ、しかも同
期信号とアドレス番号設定のPROMを同一コー
ドプラグに収容することで実用上の取扱い困難性
を解決することができる。 Also, since the address number capacity is 2 21 = 2097152, for example, group this by 10,000 numbers,
There are 200 groups, and the prefix signal for each group is set separately.Furthermore, in the base station, a calling number to group converter is inserted between the trunk 31 and the register 33, and the register 3 is set for each group.
3 and subsequent encoding device configuration circuits, and each group modulation signal alignment circuit is provided subsequent to the NAND gate 46 for outputting the modulation signal to the transmitter 5.
It is clear that the period in which the battery saving cycle is β 2 can be increased. In this case, by configuring the circuit configuration of the front signal detector 420 of the receiver in the same manner as the address signal detector 450, the synchronization signal setting can be made into a code plug format, and the PROM for the synchronization signal and address number setting can be set. By accommodating them in the same cord plug, the difficulty of practical handling can be solved.
本発明は以上説明したように、バツテリーセー
ビング周期を複数種設定しうるシステムを構成す
ることにより、端末機である受信機の電力消費を
大幅に改善でき、かつ受信機の電源スイツチを削
除できるため、機器の小形化並びに操作性の改善
をも得ることができ、実用上の効果は極めて大で
ある。 As explained above, the present invention can significantly improve the power consumption of a receiver, which is a terminal device, by configuring a system that can set multiple types of battery saving cycles, and can also eliminate the power switch of the receiver. , the device can be made smaller and its operability can be improved, and the practical effects are extremely large.
第1図は本発明に従う基地局の構成を示すブロ
ツク図、第2図は第1図の基地局の動作を説明す
るためのタイムチヤート図、第3図は本発明の一
実施例の受信機のブロツク図、第4図は第3図の
受信機の動作を説明するためのタイムチヤート
図、第5図は第3図の受信機のバツテリーセービ
ング周期切替時の動作を説明するためのタイムチ
ヤート図である。
1…加入者電話機、2…電話交換機、3…符号
化装置、31…トランク、32…呼出設定スイツ
チ、33…レジスタ、34…タイミング回路、3
5…記憶回路、36…符号変換器、37…前置信
号発生器、38…同期信号発生器、39…バツテ
リーセービング切替信号発生器、40…終了信号
発生器、41…符号化回路、5…送信機、51…
FSK変調器、52…周波数変換器、53…電力
増幅器、54…空中線、100…アンテナ、20
0…受信部、300…波形整形回路、400…信
号選択回路、410…ビツト同期回路、420…
前置信号検出器、430…同期信号検出器、44
0…終了信号検出器、450…アドレス信号検出
器、460及び470…タイマー、500…警報
音発生器、501…スイツチ、600…スピー
カ、700…パルサー回路、710…発振器、7
20…制御信号発生器、750…スイツチングト
ランジスタ。
FIG. 1 is a block diagram showing the configuration of a base station according to the present invention, FIG. 2 is a time chart for explaining the operation of the base station in FIG. 1, and FIG. 3 is a receiver according to an embodiment of the present invention. 4 is a time chart for explaining the operation of the receiver in FIG. 3, and FIG. 5 is a time chart for explaining the operation of the receiver in FIG. 3 when switching the battery saving cycle. It is a diagram. DESCRIPTION OF SYMBOLS 1... Subscriber telephone, 2... Telephone exchange, 3... Encoder, 31... Trunk, 32... Call setting switch, 33... Register, 34... Timing circuit, 3
5... Storage circuit, 36... Code converter, 37... Pre-signal generator, 38... Synchronization signal generator, 39... Battery saving switching signal generator, 40... End signal generator, 41... Encoding circuit, 5... Transmitter, 51...
FSK modulator, 52... Frequency converter, 53... Power amplifier, 54... Antenna, 100... Antenna, 20
0... Receiving section, 300... Waveform shaping circuit, 400... Signal selection circuit, 410... Bit synchronization circuit, 420...
Pre-signal detector, 430... Synchronization signal detector, 44
0... End signal detector, 450... Address signal detector, 460 and 470... Timer, 500... Alarm sound generator, 501... Switch, 600... Speaker, 700... Pulser circuit, 710... Oscillator, 7
20... Control signal generator, 750... Switching transistor.
Claims (1)
信号で変調された無線波を受信するバツテリーセ
ービング機能を有する個人選択呼出受信機におい
て、バツテリーと、該無線波を受信復調する受信
部と、該受信部出力に接続された信号選択回路
と、該信号選択回路の出力端子に接続されたバツ
テリーセービング周期を少なくとも2つ有するパ
ルサー回路と、該パルサー回路出力と前記バツテ
リーに接続されたスイツチ手段と、前記信号選択
回路の別の出力端子に接続された呼出報知手段と
を有し、前記信号選択回路は、前記パルサー回路
が第1バツテリーセービング周期で動作している
場合に、バツテリーセービング周期切替信号を受
信検出すると前記パルサー回路に検出信号を出力
して、該パルサー回路のバツテリーセービング周
期を第1周期よりも長い第2周期へ切替え、前記
スイツチ手段は、該パルサー回路出力により断続
された前記バツテリー電力を少なくとも前記受信
部へ供給することを特徴とする個人選択呼出受信
機。 2 前置信号とバツテリーセービング切替信号又
は個別選択信号との直列信号で変調された無線波
を受信するバツテリーセービング機能を有する個
人選択呼出受信機において、バツテリーと、該無
線波を受信復調する受信部と、該受信部出力に接
続された信号選択回路と、該信号選択回路の第1
及び第2の出力端子に接続されたバツテリーセー
ビング周期を少なくとも2つ有するパルサー回路
と、該パルサー回路出力と前記バツテリーに接続
されたスイツチ手段と、前記信号選択回路の第3
の出力端子に接続された呼出報知手段とを有し、
前記信号選択回路は、前記パルサー回路が第1バ
ツテリーセービング周期で動作している場合に、
前置信号とバツテリーセービング切替信号との直
列信号を受信検出すると、前置信号検出信号を第
1の出力端子に、バツテリーセービング切替信号
検出信号を第2の出力端子に出力し、該パルサー
回路のバツテリーセービング動作を第1周期より
も長い第2周期へ切替え、更に、前記信号選択回
路は、前記パルサー回路が第2バツテリーセービ
ング周期で動作している場合に、前置信号と個別
選択信号との直列信号を受信検出すると、前置信
号検出信号を第1の出力端子に出力して、該パル
サー回路のバツテリーセービング周期を第2周期
から第1周期に切替え、かつ、個別選択信号検出
信号を第3の出力端子に出力して、前記呼出報知
手段を動作させ、前記スイツチ手段は、該パルサ
ー回路出力により断続された前記バツテリー電力
を少なくとも前記受信部へ供給することを特徴と
する個人選択呼出受信機。[Scope of Claims] 1. A personal selection call receiver having a battery saving function that receives radio waves modulated with a battery saving switching signal or an individual selection signal, comprising: a battery; a receiving unit that receives and demodulates the radio waves; a signal selection circuit connected to the receiver output; a pulser circuit having at least two battery saving cycles connected to the output terminal of the signal selection circuit; and a switch means connected to the pulser circuit output and the battery. , a call notification means connected to another output terminal of the signal selection circuit, and the signal selection circuit receives a battery saving cycle switching signal when the pulser circuit is operating in a first battery saving cycle. When a detection signal is received and detected, the switching means outputs a detection signal to the pulser circuit to switch the battery saving cycle of the pulser circuit to a second cycle longer than the first cycle, and the switching means A personal selection call receiver, characterized in that power is supplied to at least the receiving section. 2. In a personal selection calling receiver with a battery saving function that receives radio waves modulated with a serial signal of a prefix signal and a battery saving switching signal or an individual selection signal, a battery and a receiving section that receives and demodulates the radio waves are provided. , a signal selection circuit connected to the receiver output, and a first signal selection circuit of the signal selection circuit.
and a pulser circuit having at least two battery saving cycles connected to a second output terminal, a switch means connected to the output of the pulser circuit and the battery, and a third pulser circuit of the signal selection circuit.
and a call notification means connected to the output terminal of the
The signal selection circuit, when the pulser circuit is operating in a first battery saving cycle,
When the serial signal of the prefix signal and the battery saving switching signal is received and detected, the prefix signal detection signal is outputted to the first output terminal, the battery saving switching signal detection signal is outputted to the second output terminal, and the pulser circuit is activated. The battery saving operation is switched to a second period which is longer than the first period, and further, the signal selection circuit is configured to switch between the prefix signal and the individual selection signal when the pulser circuit is operating in the second battery saving period. When a serial signal is received and detected, a pre-signal detection signal is output to the first output terminal, the battery saving cycle of the pulser circuit is switched from the second cycle to the first cycle, and the individual selection signal detection signal is switched to the first output terminal. 3, to operate the call notification means, and the switch means supplies the battery power interrupted by the output of the pulser circuit to at least the receiving section. Machine.
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58061523A JPS59188248A (en) | 1983-04-09 | 1983-04-09 | Receiver for individual selective call |
US06/597,788 US4745408A (en) | 1983-04-09 | 1984-04-06 | Radio paging system and receiver therefor |
EP84103948A EP0124788B1 (en) | 1983-04-09 | 1984-04-09 | Radio paging system and receiver therefor |
CA000451546A CA1231390A (en) | 1983-04-09 | 1984-04-09 | Radio paging system and receiver therefor |
DE8484103948T DE3473369D1 (en) | 1983-04-09 | 1984-04-09 | Radio paging system and receiver therefor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58061523A JPS59188248A (en) | 1983-04-09 | 1983-04-09 | Receiver for individual selective call |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59188248A JPS59188248A (en) | 1984-10-25 |
JPH0129455B2 true JPH0129455B2 (en) | 1989-06-12 |
Family
ID=13173536
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58061523A Granted JPS59188248A (en) | 1983-04-09 | 1983-04-09 | Receiver for individual selective call |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59188248A (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2503946B2 (en) * | 1993-04-28 | 1996-06-05 | 日本電気株式会社 | Selective call receiver |
-
1983
- 1983-04-09 JP JP58061523A patent/JPS59188248A/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS59188248A (en) | 1984-10-25 |
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