JPH01272140A - 半導体装置 - Google Patents
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- JPH01272140A JPH01272140A JP63100309A JP10030988A JPH01272140A JP H01272140 A JPH01272140 A JP H01272140A JP 63100309 A JP63100309 A JP 63100309A JP 10030988 A JP10030988 A JP 10030988A JP H01272140 A JPH01272140 A JP H01272140A
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- Production Of Multi-Layered Print Wiring Board (AREA)
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置に関し、特に、半導体チップの大型
化、高消費電力化(高パワー化)により、パッケージベ
ースなどとの膨張係数差の解消やより一層良好な放熱性
が必要とされるが、これらの要求に答え、かつ、これら
の要求を低価格で実現することができる技術に関する。
化、高消費電力化(高パワー化)により、パッケージベ
ースなどとの膨張係数差の解消やより一層良好な放熱性
が必要とされるが、これらの要求に答え、かつ、これら
の要求を低価格で実現することができる技術に関する。
半導体チップは益々大型化し、高パワー化するので、半
導体パッケージにあっては大型チップの搭載に充分対拠
でき、放熱特性が良好であることが従来に比して求めら
れ工いる。それも、シンプルな構造で実現することが必
要である。
導体パッケージにあっては大型チップの搭載に充分対拠
でき、放熱特性が良好であることが従来に比して求めら
れ工いる。それも、シンプルな構造で実現することが必
要である。
A/、0.などに比して低熱膨張係数で高熱伝導性であ
ることを生かしてパッケージベースにSiCを使用した
ものがあるが、SiC基板は直接配線を表面に作ること
は伝送特性上不利であったり、内層配線を作ることが不
可能であったり、また、他のパッケージ材料である封止
剤ガラスやリードフレームも低熱膨張係数のものを必要
としたり、さらに、製造コストがやや高かったりする。
ることを生かしてパッケージベースにSiCを使用した
ものがあるが、SiC基板は直接配線を表面に作ること
は伝送特性上不利であったり、内層配線を作ることが不
可能であったり、また、他のパッケージ材料である封止
剤ガラスやリードフレームも低熱膨張係数のものを必要
としたり、さらに、製造コストがやや高かったりする。
特に、半導体チップをマルチに搭載して高密度実装を実
現しようとする場合、内層配線や薄膜表面配線を形成で
きないことは配線の引き回し等に難点を有することにな
る。
現しようとする場合、内層配線や薄膜表面配線を形成で
きないことは配線の引き回し等に難点を有することにな
る。
なお、SiCを用いたパッケージについて述べた文献の
例としては、日経マグロウヒル社刊「日経エレクトロニ
クスJ 1984年9月2日号p265〜294があげ
られる。
例としては、日経マグロウヒル社刊「日経エレクトロニ
クスJ 1984年9月2日号p265〜294があげ
られる。
本発明は、従来に比してより重層チップの大型化に対拠
でき、高パワー化しても放熱特性が良く、かつその放熱
特進を複雑化しなくても済む技術を低価格で提供するこ
とを目的とする。
でき、高パワー化しても放熱特性が良く、かつその放熱
特進を複雑化しなくても済む技術を低価格で提供するこ
とを目的とする。
本発明の前記ならびにそのほかの目的と新規な特徴は、
本明細書の記述および添付図面からあきらかになるであ
ろう。
本明細書の記述および添付図面からあきらかになるであ
ろう。
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、下記のとおりである。
を簡単に説明すれば、下記のとおりである。
本発明では、マルチチップモジュールやマイクロチップ
キャリアやピングリッドアレイパッケージやフラットパ
ックパッケージにおいて、当該パッケージを構成するペ
ースを、窒化アルミニウム(AIN)よりなる、グリー
ンシート法による多層基板の形成が可能で、内層配線や
その表面における薄膜多層配線の形成が可能な基板とし
、さらに、当該AINベース上に取着するキャップも当
該AINにより構成するようにした。
キャリアやピングリッドアレイパッケージやフラットパ
ックパッケージにおいて、当該パッケージを構成するペ
ースを、窒化アルミニウム(AIN)よりなる、グリー
ンシート法による多層基板の形成が可能で、内層配線や
その表面における薄膜多層配線の形成が可能な基板とし
、さらに、当該AINベース上に取着するキャップも当
該AINにより構成するようにした。
上記においてAJ!01セラミックとした場合グリーン
シート法が可能で内層配線などの形成が可能であるが、
熱膨張係数が比較的大でチップとの熱膨張係数差が大き
く、応力歪を生じ、チップクラックが発生したりして信
頼性を劣化させ、また、熱伝導率が比較的小さく、放熱
性に問題があり、大型・高パワーのチップを搭載するに
不充分で、一方、SiCの場合、グリーンシート法が不
可能で内層配線の形成が不可能で、加工性に難もあり、
SiCは低熱膨張係数であるが他のパッケージ材である
封止用ガラスやリードフレームも低熱膨張係数の特殊な
ものが必要となる。
シート法が可能で内層配線などの形成が可能であるが、
熱膨張係数が比較的大でチップとの熱膨張係数差が大き
く、応力歪を生じ、チップクラックが発生したりして信
頼性を劣化させ、また、熱伝導率が比較的小さく、放熱
性に問題があり、大型・高パワーのチップを搭載するに
不充分で、一方、SiCの場合、グリーンシート法が不
可能で内層配線の形成が不可能で、加工性に難もあり、
SiCは低熱膨張係数であるが他のパッケージ材である
封止用ガラスやリードフレームも低熱膨張係数の特殊な
ものが必要となる。
上記の如(、AA’Nによりパッケージベースな構成す
ることにより、A l t Osと同様にグリーンシー
ト法による多層基板の形成が可能で内部配線や薄膜の多
層表面配線が可能で、特に、微細なスルーホール導体を
高精度で形成でき、熱伝導率が大なることから放熱のた
めの熱伝導性が良くなり、チップとの熱膨張係数をマツ
チングさせることができ、信頼性も同上し、リードフレ
ームや封止用ガラスにも特殊なものは使用しなくても済
む。この場合、ベースに加えてキャップもAA’N製ま
たはLライト製とすることにより、キャップを介して放
熱性をより一層回上できるし、キャップの加工も楽にな
り、製造上の利点も大となる。
ることにより、A l t Osと同様にグリーンシー
ト法による多層基板の形成が可能で内部配線や薄膜の多
層表面配線が可能で、特に、微細なスルーホール導体を
高精度で形成でき、熱伝導率が大なることから放熱のた
めの熱伝導性が良くなり、チップとの熱膨張係数をマツ
チングさせることができ、信頼性も同上し、リードフレ
ームや封止用ガラスにも特殊なものは使用しなくても済
む。この場合、ベースに加えてキャップもAA’N製ま
たはLライト製とすることにより、キャップを介して放
熱性をより一層回上できるし、キャップの加工も楽にな
り、製造上の利点も大となる。
次に、本発明の実施例を図面に基づいて説明する。
以下の実施例においては、AJNペースとし、AINま
たはLライトキャップとするに適した半導体装置を例示
してあり、また、かかるA[Nベース、AINまたはL
ライトキャップとする際の配線構造に工夫を施しである
例を示しである。
たはLライトキャップとするに適した半導体装置を例示
してあり、また、かかるA[Nベース、AINまたはL
ライトキャップとする際の配線構造に工夫を施しである
例を示しである。
〔実施例1〕
第1図に本発明を適用した半導体装置(マルチチップモ
ジュール)の−例断面図を示す。
ジュール)の−例断面図を示す。
第1図にて、1はパッケージベース、2は当該ペース内
に形成された内層配線、3は薄膜多層配線でペース1表
面上に絶縁膜3Aと薄膜導体3Bにより多層薄膜回路が
形成されている。また、4はチップ、5は突起電極、6
はピン、7はキャップ、8はスルーホール導体である。
に形成された内層配線、3は薄膜多層配線でペース1表
面上に絶縁膜3Aと薄膜導体3Bにより多層薄膜回路が
形成されている。また、4はチップ、5は突起電極、6
はピン、7はキャップ、8はスルーホール導体である。
パッケージ1はAINよりなり、グリーンシート法によ
り例えば次のようにして製せられる。
り例えば次のようにして製せられる。
すなわち、klN粉末を液状のバインダーやCaCO5
などと混練し、グリーンシートとし必要枚数重層し、圧
着焼結する。
などと混練し、グリーンシートとし必要枚数重層し、圧
着焼結する。
グリーンシートにプレスによりスルーホールをあけ、パ
ターンを印刷し、上記工程による重層焼結を行うと内部
配線2を形成することができる。
ターンを印刷し、上記工程による重層焼結を行うと内部
配線2を形成することができる。
上記絶縁膜3Aとしては、AIN膜やポリイミド系合成
樹脂膜であってもよいが、気相法(CvD)による薄膜
ダイヤモンドを使用することがよい。
樹脂膜であってもよいが、気相法(CvD)による薄膜
ダイヤモンドを使用することがよい。
上記スルーホール導体8は、信号線の他に熱伝導スルー
ホールとなる。
ホールとなる。
AA’NまたはLライトよりなるキャップ7を取着する
ことにより、従来のセラミックパッケージにおいて必要
としていたキャップ上の水冷シャットを不要とすること
ができる。
ことにより、従来のセラミックパッケージにおいて必要
としていたキャップ上の水冷シャットを不要とすること
ができる。
〔実施例2〕
第2図に本発明をフラットパックパッケージに適用した
例を示す。なお、以下の実施例において各図と共通する
符号は同一の機能を示す。
例を示す。なお、以下の実施例において各図と共通する
符号は同一の機能を示す。
第2図にて、9は枠部材、10は封止剤ガラス、11は
ボンディングワイヤ、12はリードフレームである。
ボンディングワイヤ、12はリードフレームである。
当該パッケージに於いて、SiCベースとする場合、封
止用ガラスに大きな引張歪がかかるのに対し、AINペ
ース1とすることにより当該歪を小さくすることができ
る。枠部材9としてもAIN製とすることが同様に当該
引張歪を小さくするし、また、キャップ7もAA’N製
とすることにより同様となり、封止強度の高い信頼性の
同上したフラットバックパッケージを得ることができる
。
止用ガラスに大きな引張歪がかかるのに対し、AINペ
ース1とすることにより当該歪を小さくすることができ
る。枠部材9としてもAIN製とすることが同様に当該
引張歪を小さくするし、また、キャップ7もAA’N製
とすることにより同様となり、封止強度の高い信頼性の
同上したフラットバックパッケージを得ることができる
。
〔実施例3〕
第3図に本発明をビングリッドアレイ(PGA)パッケ
ージに適用した例を示す。
ージに適用した例を示す。
第3図にて、13は表面配線である。
AINベース1にAINキャップ7を取着することによ
り放熱フィンを不要とする。
り放熱フィンを不要とする。
〔実施例4〕
第4図に本発明をマルチチップモジュールに適用した例
を示す。
を示す。
当該モジュールの組立は例えば次のようにして行うこと
ができる。
ができる。
先ず、AJN基板1にSi配線基板14の接着用パッド
のメタライゼーシ嘗ンを施し、封止用ガラス10でリー
ドフレーム12とAIN枠部柱部材9着する。あらかじ
め、チップ4をフェイスダウンボンディングしたSi配
線基板14を、AJN基板1上のパッドにハンダ付けす
る。Si配線基板14上の端子とリードフレーム12を
ボンディングワイヤllICより接続後、AJNキャッ
プ7を接着する。
のメタライゼーシ嘗ンを施し、封止用ガラス10でリー
ドフレーム12とAIN枠部柱部材9着する。あらかじ
め、チップ4をフェイスダウンボンディングしたSi配
線基板14を、AJN基板1上のパッドにハンダ付けす
る。Si配線基板14上の端子とリードフレーム12を
ボンディングワイヤllICより接続後、AJNキャッ
プ7を接着する。
〔実施例5〕
第5図に本発明をマイクロチップキャリアに適用した例
を示す。
を示す。
第5図にて、15は下部電極(外部接続端子)である。
以上の実施例において、チップ4は例えばシリコン単結
晶基板から成り、周知の技術によってこのチップ内には
多数の回路素子が形成され、1つの回路機能が与えられ
ている。回路素子の具体例は、例えばMOS)ランジス
タから成り、これらの回路素子によって、例えば論理回
路およびメモリの回路機能が形成されている。
晶基板から成り、周知の技術によってこのチップ内には
多数の回路素子が形成され、1つの回路機能が与えられ
ている。回路素子の具体例は、例えばMOS)ランジス
タから成り、これらの回路素子によって、例えば論理回
路およびメモリの回路機能が形成されている。
ボンディングワイヤ11は、例えばAu線やAI線によ
り構成される。
り構成される。
本発明によればAINベース1とし、かつ、klNキャ
ップ7とすることにより、チップ4が大型化してもチッ
プ4とペース1との熱膨張係数差が少な(、応力歪がか
からず、チップ4にクラツクが発生せず、高信頼性のパ
ッケージを提供することができ、また、チップ4・が高
パワー化しても、AINベース1やAINキャップ7を
伝わって良好に逃がすことができ、放熱性に優れ、また
、SiCに比して加工性が良く、さらに、内部配線2を
グリーンシート法で作ることができた。
ップ7とすることにより、チップ4が大型化してもチッ
プ4とペース1との熱膨張係数差が少な(、応力歪がか
からず、チップ4にクラツクが発生せず、高信頼性のパ
ッケージを提供することができ、また、チップ4・が高
パワー化しても、AINベース1やAINキャップ7を
伝わって良好に逃がすことができ、放熱性に優れ、また
、SiCに比して加工性が良く、さらに、内部配線2を
グリーンシート法で作ることができた。
以上本発明者によってなされた発明を実施例にもとづき
具体的に説明したが、本発明は上記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
具体的に説明したが、本発明は上記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
本願において開示される発明のうち代表的なものによっ
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
本発明によれば放熱特性が良く、高信頼性の各種パッケ
ージを提供することができた。
ージを提供することができた。
第1図は本発明の実施例を示すマルチチップモジュール
の断面図、 第2図は本発明の実施例を示すフラットパックパッケー
ジの断面図、 第3図は本発明の実施例を示すビングリッドアレイパッ
ケージの断面図、 第4図は本発明の実施例を示すマルチチップモジー−ル
の断面図、 第5図は本発明の実施例を示すマイクロチップキャリア
の断面図である。 1・・・パンケージベース、2・・・内層配線、3・・
・薄膜多層配線、3A・・・絶縁膜、3B・・・薄膜導
体、4・・・チップ、5・・・突起電極、6・・・ビン
、7・・・キャップ、8・・・スルーホール導体、9・
・・枠部材、10・・・対土用ガラス、11・・・ボン
ディングワイヤ、12・・・リードフレーム、13・・
・表面配線、14・・・SiC第1図 第2図
の断面図、 第2図は本発明の実施例を示すフラットパックパッケー
ジの断面図、 第3図は本発明の実施例を示すビングリッドアレイパッ
ケージの断面図、 第4図は本発明の実施例を示すマルチチップモジー−ル
の断面図、 第5図は本発明の実施例を示すマイクロチップキャリア
の断面図である。 1・・・パンケージベース、2・・・内層配線、3・・
・薄膜多層配線、3A・・・絶縁膜、3B・・・薄膜導
体、4・・・チップ、5・・・突起電極、6・・・ビン
、7・・・キャップ、8・・・スルーホール導体、9・
・・枠部材、10・・・対土用ガラス、11・・・ボン
ディングワイヤ、12・・・リードフレーム、13・・
・表面配線、14・・・SiC第1図 第2図
Claims (1)
- 【特許請求の範囲】 1、グリーンシート法による多層基板の形成が可能な窒
化アルミニウム基板をパッケージベースとして、当該ベ
ース上に半導体チップまたは該チップを突起電極により
接合したシリコン配線基板を固着し、当該ベース上に窒
化アルミニウムまたはLライトよりなるキャップを封止
剤により取着封止して成ることを特徴とするマルチチッ
プモジュール、マイクロチップキャリア、ピングリッド
アレイパッケージおよびフラットパックパッケージより
成る群から選択された半導体装置。 2、チップと外部接続端子とを窒化アルミニウム基板よ
りなるパッケージベースの内部配線を介して接続して成
る、特許請求の範囲第1項記載のマルチチップモジュー
ル、ピングリッドアレイパッケージまたはマイクロチッ
プキャリア。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63100309A JPH01272140A (ja) | 1988-04-25 | 1988-04-25 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63100309A JPH01272140A (ja) | 1988-04-25 | 1988-04-25 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01272140A true JPH01272140A (ja) | 1989-10-31 |
Family
ID=14270573
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63100309A Pending JPH01272140A (ja) | 1988-04-25 | 1988-04-25 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01272140A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5703397A (en) * | 1991-11-28 | 1997-12-30 | Tokyo Shibaura Electric Co | Semiconductor package having an aluminum nitride substrate |
US9041182B2 (en) | 2012-03-29 | 2015-05-26 | Kabushiki Kaisha Toshiba | Semiconductor package and method of manufacturing the same |
-
1988
- 1988-04-25 JP JP63100309A patent/JPH01272140A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5703397A (en) * | 1991-11-28 | 1997-12-30 | Tokyo Shibaura Electric Co | Semiconductor package having an aluminum nitride substrate |
US9041182B2 (en) | 2012-03-29 | 2015-05-26 | Kabushiki Kaisha Toshiba | Semiconductor package and method of manufacturing the same |
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