JPH01137468A - Digital signal restoring circuit - Google Patents
Digital signal restoring circuitInfo
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- JPH01137468A JPH01137468A JP29521187A JP29521187A JPH01137468A JP H01137468 A JPH01137468 A JP H01137468A JP 29521187 A JP29521187 A JP 29521187A JP 29521187 A JP29521187 A JP 29521187A JP H01137468 A JPH01137468 A JP H01137468A
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Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、磁気記録再生装置などに記録されたディジタ
ル信号を復元する装置に係り、特に伝送系において、直
流遮断により生ずる直流変動および振幅変動が生じた場
合にも正確にディジタル信号を復元するのに好適なディ
ジタル信号の復元回路に関する。[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to a device for restoring digital signals recorded in a magnetic recording/reproducing device, etc., and particularly in a transmission system, it is possible to reduce DC fluctuations and amplitude fluctuations caused by DC interruption. The present invention relates to a digital signal restoration circuit suitable for accurately restoring a digital signal even when a problem occurs.
ディジタル信号を磁気記録再生装置などで記録再生した
場合、再生系の波形等化器において波形等化された後の
信号が、伝送系において直流遮断により生ずる直流変動
および振幅変動を有さないときには、上記波形等化後の
信号を一定レベルの閾値電圧でレベル比較することによ
り、「１」。When a digital signal is recorded and reproduced using a magnetic recording/reproducing device, etc., if the signal after waveform equalization in the waveform equalizer of the reproduction system does not have DC fluctuations and amplitude fluctuations caused by DC interruption in the transmission system, "1" by comparing the level of the signal after the waveform equalization with a constant level threshold voltage.
「０」のディジタル信号を容易に復元することができる
。しかし、上記波形等化後の信号が直流変動および振幅
変動を有するときには、一定レベルの閾値電圧でレベル
比較したのでは、ｒｌＪ、ｒＯＪのディジタル信号を正
確に復元することができない。A digital signal of "0" can be easily restored. However, when the signal after waveform equalization has DC fluctuations and amplitude fluctuations, the digital signals of rlJ and rOJ cannot be accurately restored by comparing the levels using a constant threshold voltage.
上記波形等化後の信号が直流変動および振幅変動を有す
るときには、ｒｌＪ、ｒＯＪのディジタル信号を復元で
きる回路として、特開昭５５−１５０６４５に記載の回
路が公知である。上記回路は。When the signal after waveform equalization has DC fluctuations and amplitude fluctuations, a circuit described in Japanese Patent Laid-Open No. 55-150645 is known as a circuit capable of restoring the digital signals of rlJ and rOJ. The above circuit is.
正ピークホールド回路および負ピークホールド回路によ
り、上記波形等化後の信号の正のエンベロープと負のエ
ンベロープを検出し、これら正および負のエンベロープ
を平均した信号を閾値電圧と・してレベル比較するもの
である。A positive peak hold circuit and a negative peak hold circuit detect the positive envelope and negative envelope of the signal after waveform equalization, and compare the levels using the signal obtained by averaging these positive and negative envelopes as a threshold voltage. It is something.
しかし、上記回路では上記波形等化後の信号のエンベロ
ープを高速且つ正確に検出するという点において、必ず
しも十分な配慮がなされていなかった。However, in the above circuit, sufficient consideration has not necessarily been given to detecting the envelope of the signal after waveform equalization at high speed and accurately.
上記従来技術では、上記放電時定数によりエンベロープ
検出特性が決定される。このため、上記波形等化後の信
号の周波数が低すぎるときには、放電が上記波形等化後
の信号そのものに追従してしまい、エンベロープ波形が
得られなくなり、逆に、上記波形等化後の信号の周波数
が高すぎるときには、放電がエンベロープに追従しなく
なるという本質的な問題を有する。In the prior art described above, the envelope detection characteristic is determined by the discharge time constant. Therefore, if the frequency of the signal after waveform equalization is too low, the discharge will follow the signal itself after waveform equalization, making it impossible to obtain an envelope waveform. When the frequency is too high, the essential problem is that the discharge no longer follows the envelope.
本発明の目的は、簡易な回路で高速且つ安定に上記波形
等化後の信号よりディジタル信号を復元する回路を提供
することにある。An object of the present invention is to provide a circuit that quickly and stably restores a digital signal from the waveform equalized signal using a simple circuit.
上記目的は以下のようにして達成される。すなわち、上
記波形等化器の後段に直列コンデンサおよび互いに極性
が逆になるように並列接続された２つのダイオードで構
成されるリミッタとコンパレータとを縦続に接続するこ
とにより達成される。The above objective is achieved as follows. That is, this is achieved by cascade-connecting a limiter and a comparator, which are formed of a series capacitor and two diodes connected in parallel so that their polarities are opposite to each other, after the waveform equalizer.
上記波形等化器は、磁気記録再生装置で記録したディジ
タル信号が伝送系で受けた波形ひずみを補償する。上記
波形等化器において波形等化された後の直流変動や振幅
変動を有する信号は、上記リミッタで直流変動や振幅変
動が低減された後、コンパレータで元のディジタル信号
に復元されるので、高速且つ安定にディジタル信号を復
元することができる。The waveform equalizer compensates for waveform distortion that a digital signal recorded by a magnetic recording/reproducing device receives in a transmission system. After the waveform equalization is performed by the waveform equalizer, the signal having DC fluctuations and amplitude fluctuations is reduced by the limiter, and then restored to the original digital signal by the comparator. Moreover, the digital signal can be stably restored.
以下、本発明の実施例を詳細に説明する。 Examples of the present invention will be described in detail below.
第１図は、本発明の一実施例も示す回路のブロック図で
あり、１は信号の入力端子、２は信号の出力端子、１０
は波形等化器、２０はリミッタ、２１はコンデンサ、２
２．２３はダイオ−・ド、３０はコンパレータである。FIG. 1 is a block diagram of a circuit showing an embodiment of the present invention, in which 1 is a signal input terminal, 2 is a signal output terminal, and 10 is a circuit block diagram showing an embodiment of the present invention.
is a waveform equalizer, 20 is a limiter, 21 is a capacitor, 2
2.23 is a diode, and 30 is a comparator.
第２図は、第１図における波形等イヒ器１０の一例を示
す回路のブロック図であり、１１は高域強調回路、１２
は積分回路である。第３図は、第１図に示した回路の動
作説明用の波形図である。FIG. 2 is a block diagram of a circuit showing an example of the waveform equalizer 10 in FIG.
is an integrating circuit. FIG. 3 is a waveform diagram for explaining the operation of the circuit shown in FIG. 1.
第１図において、−例として、端子１より入力される信
号を磁気記録再生装置からの再生信号として、第１図に
示した実施例を説明する。In FIG. 1, as an example, the embodiment shown in FIG. 1 will be explained by assuming that a signal input from terminal 1 is a reproduction signal from a magnetic recording/reproducing device.
端子１より入力された磁気記録再生装置からの再生信号
ｖＬは、波形等化器１０に入力される６波形等化器１０
では、上記再生信号■ｉに対して記録再生過程で生φる
帯域制限特性や微分特性を補償する。波形等化器１０は
、具１体的には第２図に示すように、高域強調回路１１
（例えば、トランスバーサルフィルタ）と積分回路１２
（例えば、１次のＲＣ低域通過フィルタ）で構成される
。上記高域強調回路１１は上記帯域制限特性を補償する
回路であり、上記積分回路１２は上記微分特性を補償す
る回路である。しかし、上記微分特性により失なわれた
直流成分は、理想積分特性を実現できないために積分回
路１２により復元されず。The reproduced signal vL from the magnetic recording/reproducing device inputted from the terminal 1 is inputted to the waveform equalizer 10.
Now, the band-limiting characteristics and differential characteristics generated during the recording and reproducing process are compensated for the reproduced signal ■i. Specifically, the waveform equalizer 10 includes a high frequency emphasizing circuit 11 as shown in FIG.
(for example, a transversal filter) and an integrating circuit 12
(For example, a first-order RC low-pass filter). The high-frequency emphasis circuit 11 is a circuit that compensates for the band-limiting characteristic, and the integrating circuit 12 is a circuit that compensates for the differential characteristic. However, the DC component lost due to the above-mentioned differential characteristic is not restored by the integrating circuit 12 because the ideal integral characteristic cannot be realized.
上記波形等化器１０から出力される波形等化後の信号ｖ
ｉは、第３図（ａ）に示すように振幅変動とともに直流
変動を有する。尚、第３図（ａ）において、ｖｏは波形
等化後の信号Ｖユが有する固定直流電圧である。第１図
において、波形等化器１ｏがら出力された上記信号Ｖユ
は、波形等化器の後段に縦続に接続されたリミッタ２０
に入力される。Signal v after waveform equalization output from the waveform equalizer 10
i has DC fluctuations as well as amplitude fluctuations, as shown in FIG. 3(a). In FIG. 3(a), vo is a fixed DC voltage of the signal V after waveform equalization. In FIG. 1, the signal VU output from the waveform equalizer 1o is transmitted to a limiter 20 connected in series after the waveform equalizer 1o.
is input.
リミッタ２０は、第１＠に示すように、直列コンデンサ
２１．互いに極性が逆になるように並列接続された２つ
のダイオード２２．２３で構成される。リミッタ２０に
入力された第３図（ａ）に示した波形等化後の信号ｖ１
は、コンデンサ２１により上記固定直流電圧■。が遮断
された信号ｖｉ′（第３ｒＪ！Ｉ（ａ）テｖ８＝０〔ｖ
〕とした信号）になる。As shown in the first @, the limiter 20 includes a series capacitor 21. It is composed of two diodes 22 and 23 connected in parallel so that their polarities are opposite to each other. Signal v1 after waveform equalization shown in FIG. 3(a) input to limiter 20
is the above fixed DC voltage ■ by the capacitor 21. is blocked signal vi′ (3rd rJ!I(a) tev8=0[v
] becomes the signal).
これと同時に、上記信号Ｖ工″の信号レベルがｖＩ。At the same time, the signal level of the signal V'' becomes vI.
（ダイオード２２．２３の順方向遮断電圧）より大であ
る場合には、ダイオード２２はＯＦＦ状態となり、ダイ
オード２３はＯＮ状態になる。このため、この場合には
、ダイオード２３により上記信号ｖ１′の信号レベルが
Ｖ、より大きくならないようにピーククランプされる。(forward cutoff voltage of diodes 22 and 23), diode 22 is in the OFF state and diode 23 is in the ON state. Therefore, in this case, the diode 23 peak-clamps the signal v1' so that the signal level does not exceed V.
他方、上記信号Ｖ工′の信号レベルが−Ｖ、より小であ
る場合には。On the other hand, if the signal level of the signal V' is less than -V.
ダイオード２２はＯＮ状態となり、ダイオード２３はＯ
ＦＦ状態になる。このため、この場合には、ダイオード
２２により上記信号ｖｉ′の信号レベルが＝ｖＦより小
さくならないようにピーククランプされる。第３図（ｂ
）はリミッタ２０から出力される信号ｖ２であるが、上
記正負両方向のピーククランプ動作により上記信号Ｖ、
″の正負両方向のエンベロープの平均電位はアース電位
に相当し、上記信号ｖ２はこのアース電位を中心に±ｖ
Ｆに振幅制限される。従って、リミッタ２０では。Diode 22 is in the ON state, and diode 23 is in the O state.
It becomes FF state. Therefore, in this case, the diode 22 peak-clamps the signal vi' so that the signal level does not become smaller than =vF. Figure 3 (b
) is the signal v2 output from the limiter 20, but due to the peak clamping operation in both the positive and negative directions, the signal V,
The average potential of the envelope in both the positive and negative directions of '' corresponds to the ground potential, and the above signal v2 is ±v centered around this ground potential.
The amplitude is limited to F. Therefore, in the limiter 20.
上記正負両方向のピーククランプ動作により等測的に直
流再生が行われ、伝送系の有する直流遮断がもたらす直
流変動が大幅に低減される。また、振幅変動も同時に除
去される。リミッタ２０から出力される信号Ｖａ（第３
図（ｂ）はコンパレータ３０に入力される。上記信号ｖ
２は、直流変動および振幅変動をほとんど有さないので
、コンパレータ３ｏにおいて、アース電位とレベル比較
することにより記録したディジタル信号を復元すること
ができる。そして、コンパレータ３０の出力信号である
第３図（ｃ）に示した上記復元されたディジタル信号は
端子２に出力される。DC regeneration is performed isometrically by the peak clamping operation in both the positive and negative directions, and DC fluctuations caused by DC interruption in the transmission system are significantly reduced. Moreover, amplitude fluctuations are also removed at the same time. Signal Va output from limiter 20 (third
Figure (b) is input to the comparator 30. The above signal v
2 has almost no direct current fluctuations or amplitude fluctuations, so the recorded digital signal can be restored by comparing the level with the ground potential in the comparator 3o. The restored digital signal shown in FIG. 3(c), which is the output signal of the comparator 30, is outputted to the terminal 2.
以上のように、波形等化器１０の後段にリミッタ回路２
０を縦続接続した簡易な回路構成で、リミッタ回路２０
を正負両方向のピーククランプ回路として動作させるこ
とにより、波形等化後の信号Ｖ工が有する直流変動およ
び振幅変動を大幅に低減でき、上記信号ｖ１が直流変動
および振幅変動を有している場合にも記録したディジタ
ル信号を安定に復元できる。加えて、第１図に示した回
路の信号処理速度は、ダイオード２２．２３のスイッチ
チング速度あるいはコンパレータ３０の動作速度で決定
されるので、高伝送レートのディジタル信号も復元でき
る。As described above, the limiter circuit 2 is installed after the waveform equalizer 10.
The limiter circuit 20 has a simple circuit configuration in which 0 is connected in cascade.
By operating as a peak clamp circuit in both positive and negative directions, it is possible to significantly reduce the DC fluctuations and amplitude fluctuations of the signal V after waveform equalization, and when the signal v1 has DC fluctuations and amplitude fluctuations, can also stably restore recorded digital signals. In addition, since the signal processing speed of the circuit shown in FIG. 1 is determined by the switching speed of the diodes 22, 23 or the operating speed of the comparator 30, it is possible to restore digital signals at high transmission rates.
以上の実施例では、第１図の端子１より入力される信号
を磁気記録再生装置からの再生信号としたが、本発明は
これに限定されるものではない。In the above embodiments, the signal inputted from the terminal 1 in FIG. 1 is the reproduction signal from the magnetic recording/reproduction device, but the present invention is not limited thereto.
本発明によれば、波形等化後の信号が有する直流変動お
よび振幅変動を大幅に低減でき、高速に信号処理できる
ので、ディジタル信号を高速且つ安定に復元することが
できる。According to the present invention, DC fluctuations and amplitude fluctuations of a signal after waveform equalization can be significantly reduced, and signal processing can be performed at high speed, so that a digital signal can be restored quickly and stably.
第１図は本発明の一実施例を示す回路図、第２図は第１
図における波形等化器の一例を示す回路図、第３図は第
１図に示した回路の動作を説明する波形図である。
１０・・・波形等化器、２０・・・リミッタ、２１・・
・コンデンサ、２２．２３・・・ダイオード、３０・・
・コンパレータ。
高 １ 図
１２；ネ貢分回：１ｊｌｒ−３ｂ： フンバし−ク２
０ニ フミ―リク
第 ２図Fig. 1 is a circuit diagram showing one embodiment of the present invention, and Fig. 2 is a circuit diagram showing an embodiment of the present invention.
FIG. 3 is a circuit diagram showing an example of the waveform equalizer in the figure, and FIG. 3 is a waveform diagram illustrating the operation of the circuit shown in FIG. 10... Waveform equalizer, 20... Limiter, 21...
・Capacitor, 22.23...Diode, 30...
·comparator. High 1 Figure 12; Negative division: 1jlr-3b: Funbashiku 2
0 Ni Humilik Figure 2
Claims (1)
置において、記録媒体から再生された信号を波形等化す
る波形等化器の後段に、コンデンサと極性を互いに逆に
して並列接続された２つのダイオードとを直列に接続し
て構成される回路を縦続に接続し、上記回路の出力信号
をコンパレータに入力し、所定の基準電位とレベル比較
することを特徴とするディジタル信号の復元回路。1. In a device that reproduces digital signals recorded on a recording medium, two capacitors and a capacitor are connected in parallel with opposite polarities after the waveform equalizer that equalizes the waveform of the signal reproduced from the recording medium. 1. A digital signal restoration circuit characterized in that circuits configured by connecting diodes in series are connected in cascade, the output signal of the circuit is input to a comparator, and the level is compared with a predetermined reference potential.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29521187A JPH01137468A (en) | 1987-11-25 | 1987-11-25 | Digital signal restoring circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29521187A JPH01137468A (en) | 1987-11-25 | 1987-11-25 | Digital signal restoring circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01137468A true JPH01137468A (en) | 1989-05-30 |
Family
ID=17817641
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29521187A Pending JPH01137468A (en) | 1987-11-25 | 1987-11-25 | Digital signal restoring circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01137468A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03201265A (en) * | 1989-09-22 | 1991-09-03 | Sony Corp | Signal reproducing device |
| JPH04232659A (en) * | 1990-12-27 | 1992-08-20 | Nec Corp | Recorded information reproducing device |
-
1987
- 1987-11-25 JP JP29521187A patent/JPH01137468A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03201265A (en) * | 1989-09-22 | 1991-09-03 | Sony Corp | Signal reproducing device |
| JPH04232659A (en) * | 1990-12-27 | 1992-08-20 | Nec Corp | Recorded information reproducing device |
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