JPH01123285A - 画面表示装置 - Google Patents
画面表示装置Info
- Publication number
- JPH01123285A JPH01123285A JP62281693A JP28169387A JPH01123285A JP H01123285 A JPH01123285 A JP H01123285A JP 62281693 A JP62281693 A JP 62281693A JP 28169387 A JP28169387 A JP 28169387A JP H01123285 A JPH01123285 A JP H01123285A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- display
- data
- rom
- character
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
Landscapes
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、TV画面にキャラクタを表示する画面表示
装置に関するものである。
装置に関するものである。
第2図は、従来の画面表示装置を示すブロック図であり
、第2図において、1はキャラクタのパターンを記憶し
ているキャラクタROM回路、2はキャラクタROM回
路のパターンデータの番号を記憶している、書換え可能
な表示RAM回路、3は本表示装置の出力状態を指定す
る、書換え可能なレジスタ回路、4はキャラクタROM
回路1より出力されたパターンデータを表示器(TV画
面)に対し出力する出力回路、5は表示RAM回路2及
びレジスタ回路3にデータを書込む入力回路である。
、第2図において、1はキャラクタのパターンを記憶し
ているキャラクタROM回路、2はキャラクタROM回
路のパターンデータの番号を記憶している、書換え可能
な表示RAM回路、3は本表示装置の出力状態を指定す
る、書換え可能なレジスタ回路、4はキャラクタROM
回路1より出力されたパターンデータを表示器(TV画
面)に対し出力する出力回路、5は表示RAM回路2及
びレジスタ回路3にデータを書込む入力回路である。
次に動作について説明する。入力回路5より表示したい
キャラクタと同数かつ表示したい順に入力したデータは
表示RAM回路2に記憶される。
キャラクタと同数かつ表示したい順に入力したデータは
表示RAM回路2に記憶される。
また入力回路5より入力した、出力状態を決定するため
のデータはレジスタ回路3に記憶される。
のデータはレジスタ回路3に記憶される。
この制御とは別に表示RAM回路2より続出したデータ
がそれに対応したキャラクタROM回路1のパターンデ
ータを指定する。キャラクタROM回路1の指定したパ
ターンデータは出力回路4によりTV画面上に出力され
る。またレジスタ回路3からの信号は出力回路4の出力
状態を指定する。
がそれに対応したキャラクタROM回路1のパターンデ
ータを指定する。キャラクタROM回路1の指定したパ
ターンデータは出力回路4によりTV画面上に出力され
る。またレジスタ回路3からの信号は出力回路4の出力
状態を指定する。
この状態でTV画面に表示している1つのキャラクタを
書換えようとすると、書換えたいキャラクタを表示して
いる場所に対応した表示RAM回路2のデータを入力回
路5を介して書換えればよい、また2倍角等に表示の状
態を変えようとすると、入力回路1を介してレジスタ回
路3を書換えればよい。
書換えようとすると、書換えたいキャラクタを表示して
いる場所に対応した表示RAM回路2のデータを入力回
路5を介して書換えればよい、また2倍角等に表示の状
態を変えようとすると、入力回路1を介してレジスタ回
路3を書換えればよい。
従来の画面表示装置は、以上のように構成されているの
で、表示したいキャラクタがあれば、それと同じだけの
データを入力する必要があり、TV画面全体にキャラク
タを表示させるには多くのデータを入力しなければなら
ず、コントロールする側の負荷が重くなる。また多くの
データを送るには多くのデータを記憶する必要があり、
画面表示装置の外に設けた記憶回路の容量が増えること
となる。またデータ転送に多くの時間がかかる等の問題
点があった。
で、表示したいキャラクタがあれば、それと同じだけの
データを入力する必要があり、TV画面全体にキャラク
タを表示させるには多くのデータを入力しなければなら
ず、コントロールする側の負荷が重くなる。また多くの
データを送るには多くのデータを記憶する必要があり、
画面表示装置の外に設けた記憶回路の容量が増えること
となる。またデータ転送に多くの時間がかかる等の問題
点があった。
この発明は、上記のような従来のものの問題点を解決す
るためになされたもので、少ないデータ入力で多くのキ
ャラクタをTV画面に表示できるとともにコントロール
する側の負荷を軽減でき、入力時間も少なく抑えること
のできる画面表示装置を得ることを目的とする。
るためになされたもので、少ないデータ入力で多くのキ
ャラクタをTV画面に表示できるとともにコントロール
する側の負荷を軽減でき、入力時間も少なく抑えること
のできる画面表示装置を得ることを目的とする。
この発明に係る画面表示装置は、画面に表示すべきキャ
ラクタを表示順に表示ROM回路で記憶し、又、これと
は別に表示するキャラクタの変更を可能とするための表
示RAM回路を用意し、表示ROM回路の出力データの
うちの1ビツトの情報で、直接にキャラクタROM回路
をアクセスするかあるいは表示RAM回路を介してキャ
ラクタROM回路をアクセスするかを定め、これとは別
に表示ROM回路はレジスタ回路に入力すべき数通りの
データを記憶し、入力回路からの1命令をページレジス
タ回路に書込むことで表示ROM回路を介してレジスタ
回路に値をセットし、キャラクタROMのデータを出力
回路に出力するとともに、レジスタ回路及び表示RAM
回路を入力回路を介して直接書換えできるように構成し
たものである。
ラクタを表示順に表示ROM回路で記憶し、又、これと
は別に表示するキャラクタの変更を可能とするための表
示RAM回路を用意し、表示ROM回路の出力データの
うちの1ビツトの情報で、直接にキャラクタROM回路
をアクセスするかあるいは表示RAM回路を介してキャ
ラクタROM回路をアクセスするかを定め、これとは別
に表示ROM回路はレジスタ回路に入力すべき数通りの
データを記憶し、入力回路からの1命令をページレジス
タ回路に書込むことで表示ROM回路を介してレジスタ
回路に値をセットし、キャラクタROMのデータを出力
回路に出力するとともに、レジスタ回路及び表示RAM
回路を入力回路を介して直接書換えできるように構成し
たものである。
この発明においては、表示ROM回路を装置に内蔵する
ようにしたので、表示RAM回路の容量を減少でき、I
C化する場合チップ面積を小さくでき、またこの表示R
OM回路内のデータを指定するためのページレジスタを
設けるようにしたので、ページレジスタに1命令をセッ
トするだけで画面全部の表示を行うことができ、コント
ロールが簡単になる。
ようにしたので、表示RAM回路の容量を減少でき、I
C化する場合チップ面積を小さくでき、またこの表示R
OM回路内のデータを指定するためのページレジスタを
設けるようにしたので、ページレジスタに1命令をセッ
トするだけで画面全部の表示を行うことができ、コント
ロールが簡単になる。
〔実施例〕
以下、この発明の実施例を図について説明する。
第1図は、本発明の一実施例による画面表示装置を示し
、図において、1はキャラクタのパターンデータを記憶
しているキャラクタROM回路、20はキャラクタRO
Mのパターンデータの番号を記憶する、書換え可能な表
示RAM回路、3は出力状態を指定する書換え可能なレ
ジスタ回路、4はキャラクタROM回路より出力された
パターンデータを出力する出力回路、5は表示RAM回
路、レジスタ回路およびページレジスタ回路にデータを
書込む入力回路、6はキャラクタROM回路1表示RO
M回路1表示RAM回路をアクセスし又レジスタ回路に
特定の値をセットする表示ROM回路、7は表示ROM
回路の任意のデータを指定するページレジスタ回路であ
る。
、図において、1はキャラクタのパターンデータを記憶
しているキャラクタROM回路、20はキャラクタRO
Mのパターンデータの番号を記憶する、書換え可能な表
示RAM回路、3は出力状態を指定する書換え可能なレ
ジスタ回路、4はキャラクタROM回路より出力された
パターンデータを出力する出力回路、5は表示RAM回
路、レジスタ回路およびページレジスタ回路にデータを
書込む入力回路、6はキャラクタROM回路1表示RO
M回路1表示RAM回路をアクセスし又レジスタ回路に
特定の値をセットする表示ROM回路、7は表示ROM
回路の任意のデータを指定するページレジスタ回路であ
る。
次に動作について説明する。第1図において、入力回路
5を介してデータをページレジスタ回路7にセットする
。このデータはページを示し、表示ROM回路6の特定
の範囲を指定する。表示ROM回路6はまずレジスタ回
路3の値をセットする。次いで表示する順番にキャラク
タROM回路1中のパターンデータを指定するか、ある
いは表示RAM回路20のアドレスを指定するデータを
出力する。この場合、表示ROM回路6から出力される
データ中の1ビツトはキャラクタROM回路1あるいは
表示RAM回路20のどちらをアクセスするかを選択す
るためのものである。表示RAM回路20のアドレスを
指定した場合は、指定したアドレスのデータでキャラク
タROM回路1のパターンデータを指定する0表示RO
M回路6又は表示RAM回路で指定されたキャラクタR
OM回路lのパターンデータは出力回路4より出力され
、その出力する状態はレジスタ回路3により決定される
。
5を介してデータをページレジスタ回路7にセットする
。このデータはページを示し、表示ROM回路6の特定
の範囲を指定する。表示ROM回路6はまずレジスタ回
路3の値をセットする。次いで表示する順番にキャラク
タROM回路1中のパターンデータを指定するか、ある
いは表示RAM回路20のアドレスを指定するデータを
出力する。この場合、表示ROM回路6から出力される
データ中の1ビツトはキャラクタROM回路1あるいは
表示RAM回路20のどちらをアクセスするかを選択す
るためのものである。表示RAM回路20のアドレスを
指定した場合は、指定したアドレスのデータでキャラク
タROM回路1のパターンデータを指定する0表示RO
M回路6又は表示RAM回路で指定されたキャラクタR
OM回路lのパターンデータは出力回路4より出力され
、その出力する状態はレジスタ回路3により決定される
。
従って、入力回路5よりページレジスタに1命令をセッ
トするだけで、表示ROM回路6内に記憶された、TV
I画面画面中ャラクタの順序を示すデータが次々に読出
されるので、外部に大容量のメモリを設けなくてもキャ
ラクタが所定の順序で次々に表示される。
トするだけで、表示ROM回路6内に記憶された、TV
I画面画面中ャラクタの順序を示すデータが次々に読出
されるので、外部に大容量のメモリを設けなくてもキャ
ラクタが所定の順序で次々に表示される。
また入力回路5を介して表示RAM回路20およびレジ
スタ回路のデータ書換えが可能であるので、例えば、表
示しているキャラクタの内1つのキャラクタを書換えた
い場合は、表示されているキャラクタの位置に対応する
表示RAM回路20のデータを書換えることで実現でき
る。この書換えは出力状態においてもレジスタ回路3の
データを書換えることにより簡単に実行できる。
スタ回路のデータ書換えが可能であるので、例えば、表
示しているキャラクタの内1つのキャラクタを書換えた
い場合は、表示されているキャラクタの位置に対応する
表示RAM回路20のデータを書換えることで実現でき
る。この書換えは出力状態においてもレジスタ回路3の
データを書換えることにより簡単に実行できる。
なお、上記実施例では表示ROMにレジスタ回路3に入
力するデータを含んでいるが、そのデータを別途違った
新しい記憶回路に持たせるようにしてもよい。
力するデータを含んでいるが、そのデータを別途違った
新しい記憶回路に持たせるようにしてもよい。
また出力回路は、入力データをシリアルデータに直して
出力する回路であるが、本実施例と同様に出力できるな
らどのような構成のものでもよい。
出力する回路であるが、本実施例と同様に出力できるな
らどのような構成のものでもよい。
〔発明の効果〕
以上のように、この発明に係る画面表示装置によれば、
表示すべきキャラクタの順序を示すROMを内蔵するよ
うにしたので、RAM容量を軽減でき、チップサイズを
縮小できる。しかも、ROMの内容を指定するためのペ
ージレジスタ回路を設けたので、ページ指定のデータで
表示内容とレジスタとを同時にセントでき、一画面の表
示のコントロールを最小限にでき外部のコントローラか
らの制御が容易となる効果がある。
表示すべきキャラクタの順序を示すROMを内蔵するよ
うにしたので、RAM容量を軽減でき、チップサイズを
縮小できる。しかも、ROMの内容を指定するためのペ
ージレジスタ回路を設けたので、ページ指定のデータで
表示内容とレジスタとを同時にセントでき、一画面の表
示のコントロールを最小限にでき外部のコントローラか
らの制御が容易となる効果がある。
第1図は本発明の一実施例による画面表示装置を示すブ
ロック図、第2図は従来の画面表示装置を示すブロック
図である。 図において、1はキャラクタROM回路、20は表示R
AM回路、3はレジスタ回路、4は出力回路、5は入力
回路、6は表示ROM回路、7はページレジスタ回路で
ある。
ロック図、第2図は従来の画面表示装置を示すブロック
図である。 図において、1はキャラクタROM回路、20は表示R
AM回路、3はレジスタ回路、4は出力回路、5は入力
回路、6は表示ROM回路、7はページレジスタ回路で
ある。
Claims (4)
- (1)複数個の画素を1ドットとして使用し、複数ドッ
トで1キャラクタを構成して、キャラクタを表示する画
面表示装置において、 複数の文字のパターンデータを記憶するキャラクタRO
M回路と、 該キャラクタROM回路の任意のパターンデータを指定
するための表示RAM回路と、 上記キャラクタROM回路から出力したパターンデータ
を表示器に対し出力する出力回路と、該出力回路の出力
状態を指定するためのレジスタ回路と、 該レジスタ回路にデータを入力するかあるいは上記キャ
ラクタROM回路内の任意のパターンデータを直接指定
するかまたは上記表示RAM回路を介して指定するため
の表示ROM回路と、該表示ROM回路内の任意のデー
タを指定するためのページレジスタ回路と、上記表示R
AM回路、上記レジスタ回路あるいは上記ページレジス
タ回路にデータを入力するための入力回路とを備えたこ
とを特徴とする画面表示装置。 - (2)装置全体が、集積回路化されていることを特徴と
する特許請求の範囲第1項記載の画面表示装置。 - (3)上記表示ROM回路は、 表示器に表示すべきキャラクタを示すデータ、上記レジ
スタ回路の出力状態を示すデータ、上記キャラクタRO
M回路あるいは表示RAM回路のいずれをアクセスする
かを示すデータを記憶することを特徴とする特許請求の
範囲第1項または第2項記載の画面表示装置。 - (4)上記キャラクタの順序を示すデータは、表示器1
画面分のキャラクタの順序を示すこと特徴とする特許請
求の範囲第3項記載の画面表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62281693A JPH01123285A (ja) | 1987-11-07 | 1987-11-07 | 画面表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62281693A JPH01123285A (ja) | 1987-11-07 | 1987-11-07 | 画面表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01123285A true JPH01123285A (ja) | 1989-05-16 |
Family
ID=17642666
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62281693A Pending JPH01123285A (ja) | 1987-11-07 | 1987-11-07 | 画面表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01123285A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6362801B1 (en) | 1998-06-17 | 2002-03-26 | Engineer Lighting, Inc. | Display apparatus |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62240994A (ja) * | 1986-04-11 | 1987-10-21 | 三菱電機株式会社 | 表示制御装置 |
-
1987
- 1987-11-07 JP JP62281693A patent/JPH01123285A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62240994A (ja) * | 1986-04-11 | 1987-10-21 | 三菱電機株式会社 | 表示制御装置 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6362801B1 (en) | 1998-06-17 | 2002-03-26 | Engineer Lighting, Inc. | Display apparatus |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5598526A (en) | Method and system for displaying images using a dynamically reconfigurable display memory architecture | |
JPS5952286A (ja) | ビデオram書込み制御方式 | |
US5293483A (en) | Combined image and control data image memory device | |
JPH01123285A (ja) | 画面表示装置 | |
KR100472478B1 (ko) | 메모리 억세스 제어방법 및 장치 | |
JPH01296292A (ja) | 画面表示装置 | |
JPS6116076B2 (ja) | ||
JPS6024987B2 (ja) | 画像処理用記憶装置 | |
JP2547256B2 (ja) | Dma装置 | |
JP3131918B2 (ja) | メモリ装置 | |
JPH09106374A (ja) | 画像メモリ装置 | |
JPH03116194A (ja) | ディスブレイ制御装置 | |
JPS5990887A (ja) | ビツトマツプメモリ装置 | |
JPS60128493A (ja) | 表示制御方式 | |
JPH11134248A (ja) | 画像データ記憶用集積回路、その画像データ記憶方法および画像データ記憶装置 | |
JPH03288194A (ja) | カーソル記憶制御回路 | |
JPS61143835A (ja) | デ−タ表示方式 | |
JPS63235985A (ja) | 文字パタ−ン発生装置 | |
JPH06131519A (ja) | Icカード | |
JPH0736105B2 (ja) | 表示制御装置 | |
JPH01172994A (ja) | 表示装置 | |
JPH0659966A (ja) | メモリ装置 | |
JPH01193893A (ja) | Crtディスプレイ装置 | |
JPH0427571B2 (ja) | ||
JPH02166547A (ja) | 情報処理装置 |