JP7296686B1 - 通信装置、通信方法、通信プログラム及び通信システム - Google Patents
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Abstract
Description
k=log2m+j
で求めることができる。
N=L/2
とすればよい。
i=k+log2N2
で表現される。
k=log2m+j
で求めることができる。
N3=L/2
としてもよい。FIRディジタルフィルタ18のタップ数N2とFIRディジタルフィルタ30のタップ数N3とを合わせることで、パケット単位の加算処理にかかる時間と、ビット単位の加算処理にかかる時間とを合わせることができる。
i=k+log2N3
で表現される。
2 受信装置
3 送信器
4 受信器
5 パケット
6 受信信号
7 加算処理部
8 クロックパターン再現部
9 再現クロック
10 クロック再生部
11 メインサンプリングクロック
12 加算処理部
13 同期ワード検出及びデータ抽出部
14 受信データ
15 パケット一次メモリ
16 パケット受信バッファ
17 パケット二次メモリ
18 FIRディジタルフィルタ
19 出力データ
20 プリアンブル
21 同期ワード
22 ペイロード
23 ポストアンブル
24 同期ワード探索バッファ
25 参照ワード
26 相関器
27 ビット一次メモリ
28 ビット受信バッファ
29 ビット二次メモリ
30 FIRディジタルフィルタ
31 位相周波数比較器
32 ディジタルループフィルタ
33 数値制御発振器
34 非同期高速クロック
35 N分周器
36 分周クロック
37 再生サンプリングクロック
38 非同期サンプリングクロック
39 サンプリングクロック切替器
40 ロック信号
Claims (9)
- 繰り返し到来したパケットが通信速度のN1倍の周波数のクロックでサンプリングされたデータを、前記パケットが到来するごとに一つ前の前記パケットまでの加算結果との加算を行う第1加算部と、
前記第1加算部の加算結果を保持する第1保持部と、
前記第1保持部が保持した加算結果をサンプリングクロックと同期して処理するN2個(N2は2以上N1以下の整数)のタップの第1ディジタルフィルタと、
前記第1ディジタルフィルタの処理結果を保持する第2保持部と、
を備える、通信装置。 - 前記第1ディジタルフィルタで処理された結果と、同期ワードとの相関をとる相関部と、
前記相関部による相関が強くなるタイミングで、前記第1ディジタルフィルタで処理された結果からデータを取り出すデータ取得部と、
をさらに備える、請求項1に記載の通信装置。 - 到来した前記パケットを構成する各ビットを通信速度の前記N1倍の周波数のクロックでサンプリングしたデータを、次のビットが到来するごとに一つ前のビットまでの加算を行う第2加算部と、
前記第2加算部の加算結果を保持する第3保持部と、
前記第3保持部が保持した加算結果を前記サンプリングクロックと同期して処理するN3個(N3は2以上N1以下の整数)のタップの第2ディジタルフィルタと、
前記第2ディジタルフィルタにて処理した結果を保持する第4保持部と、
前記第4保持部で保持されたデータから、ビットデータに含まれるクロック波形を再現するクロックパターン再現部と、
前記クロックパターン再現部が再現したクロック波形から、到来した前記パケットに同期したサンプリングクロックを再生するクロック再生部と、
をさらに備える、請求項1に記載の通信装置。 - 前記クロック再生部は、
別のクロックで駆動される数値制御発振器と、
前記クロックパターン再現部が再現したクロック波形を二値化した再現クロックと、再生するサンプリングクロックの分周クロックとを比較して、位相及び周波数差に応じた信号を出力する位相周波数比較器と、
前記位相周波数比較器の出力信号から前記数値制御発振器を制御する制御信号を生成するループフィルタと、
を備える、請求項3に記載の通信装置。 - 前記N2の値と前記N3の値とは同一である、請求項3に記載の通信装置。
- 前記クロック再生部が再生したサンプリングクロックの周波数と位相とが安定していることを検出したらロック信号を有効にするロック信号生成部と、
前記ロック信号が有効でない場合は、内部動作クロックから生成されるサンプリングクロックに切り替え、前記ロック信号が有効である場合は、前記クロック再生部が再生したサンプリングクロックに切り替えるクロック切替部と、
をさらに備える、請求項3に記載の通信装置。 - プロセッサが、
繰り返し到来したパケットが通信速度のN1倍の周波数のクロックでサンプリングされたデータを、前記パケットが到来するごとに一つ前の前記パケットまでの加算結果との加算を行い、
前記加算の結果を第1メモリに保持させ、
前記第1メモリに保持した加算結果をサンプリングクロックと同期してN2個(N2は2以上N1以下の整数)のタップのディジタルフィルタに処理させ、
前記ディジタルフィルタの処理結果を第2メモリに保持させる、
処理を行う、通信方法。 - コンピュータに、
繰り返し到来したパケットが通信速度のN1倍の周波数のクロックでサンプリングされたデータを、前記パケットが到来するごとに一つ前の前記パケットまでの加算結果との加算を行い、
前記加算の結果を第1メモリに保持させ、
前記第1メモリに保持した加算結果をサンプリングクロックと同期してN2個(N2は2以上N1以下の整数)のタップのディジタルフィルタに処理させ、
前記ディジタルフィルタの処理結果を第2メモリに保持させる、
処理を実行させる、通信プログラム。 - 送信側の通信装置と、
受信側の通信装置と、
を備え、
前記送信側の通信装置は、一つのパケットを繰り返し送信する送信部を備え、
前記受信側の通信装置は、
前記送信側の通信装置から繰り返し到来した前記パケットが通信速度のN1倍の周波数のクロックでサンプリングされたデータを、前記パケットが到来するごとに一つ前の前記パケットまでの加算結果との加算を行う第1加算部と、
前記第1加算部の加算結果を保持する第1保持部と、
前記第1保持部が保持した加算結果をサンプリングクロックと同期して処理するN2個(N2は2以上N1以下の整数)のタップの第1ディジタルフィルタと、
前記第1ディジタルフィルタの処理結果を保持する第2保持部と、
を備える、通信システム。
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Patent Citations (4)
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