JP7076515B2 - アクティブ測距システムのための記憶 - Google Patents
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Description
102 記憶アレイ
104 フォトダイオード
106 タイミング制御回路
108 検出回路
110 スイッチ制御回路
112 サンプルテーブル回路
114 アナログ対デジタル変換器(ADC)
116 マルチプレクサ
118 記憶素子
200 記憶アレイ
202 マルチプレクサ
204 マルチプレクサ
302 記憶素子
304 接続部
306 接続部
Claims (9)
- 放出光パルスによって引き出されている光信号を受信するための飛行時間ウィンドウに対応する光受信器内での感知値を記憶するためのシステムであって、
受信光信号を示す出力信号を生成するように構成されている少なくとも1つの光検出器と、
複数の記憶素子を備え、飛行時間受信ウィンドウの少なくとも一部分に対応する前記少なくとも1つの光検出器から前記出力信号を受信し、および記憶するように接続されている記憶アレイと、
前記記憶アレイによって出力信号値の記憶を制御するように構成されている制御回路であって、
前記複数の記憶素子の第1のサブセットに前記出力信号値を書き込み、および上書きし、
書き込まれた前記出力信号値に基づいてイベントを検出し、かつ、
前記イベントの検出に応答して、前記複数の記憶素子のうちの少なくとも前記第1のサブセットを構成するそれぞれの記憶素子にデータを保持するように構成されている、制御回路と
を備える、システム。 - 前記制御回路が、放出光パルスの戻りパルスとして直ちに前記イベントを検出するように構成されている検出回路を備える、請求項1に記載のシステム。
- 前記制御回路が、前記複数の記憶素子によって記憶された値に基づいて、前記飛行時間受信ウィンドウが完了した後に前記イベントを検出し、前記複数の記憶素子の前記第1のサブセットが含まれる検出ウィンドウを決定するように構成されている、請求項1に記載のシステム。
- 前記複数の記憶素子が、各々が少なくとも1つのコンデンサを備える、アナログ記憶素子であり、前記システムが、前記複数の記憶素子の前記第1のサブセットの前記書き込み出力値を変換するように構成されているアナログ対デジタル変換器回路をさらに備える、請求項1~3のいずれか一項に記載のシステム。
- 前記複数の記憶デバイスが、複数のアレイに配置され、前記複数のうちの第1のアレイが、前記複数の記憶素子の前記第1のサブセットを備え、前記制御回路が、前記イベントの検出に続いて、前記複数のうちの第2のアレイに前記出力信号値を書き込み、および上書きするようにさらに構成されている、請求項1~3のいずれか一項に記載のシステム。
- 前記制御回路が、前記出力信号値が前記複数の記憶素子に書き込まれる、周波数を制御するように構成されているタイミング回路を備える、請求項1に記載のシステム。
- 前記制御回路が、
第1の周波数で前記複数の記憶素子の前記第1のサブセットに前記出力信号値を書き込み、および上書きし、
前記飛行時間ウィンドウの第1の時間周期に続いて、前記第1の周波数とは異なる第2の周波数で前記複数の記憶素子の第2のサブセットに前記出力信号値を書き込み、および上書きするようにさらに構成されている、請求項6に記載のシステム。 - 前記制御回路が、アナログまたはデジタル回路を使用して構成され、前記イベントに関するタイムスタンプ情報、および前記複数の記憶素子の前記第1のサブセットのための識別子を記憶するように構成されているサンプルテーブル回路をさらに備える、請求項1に記載のシステム。
- 放出された光パルスによって引き出されている光信号を受信するための飛行時間ウィンドウに対応する光受信器内での感知値を記憶するための方法であって、
少なくとも1つの光検出器によって、受信光信号を示す出力信号を生成することと、
飛行時間受信ウィンドウの少なくとも一部分の間に記憶アレイの複数の記憶素子の第1のサブセットに前記出力信号を書き込み、および上書きすることと、
書き込まれた前記出力信号に基づいてイベントを検出することと、
前記イベントの検出に応答して、前記複数の記憶素子のうちの少なくとも前記第1のサブセットを構成するそれぞれの記憶素子にデータを保持することと、
を含む、方法。
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