JP6895116B2 - Thin film capacitor, manufacturing method of thin film capacitor - Google Patents
Thin film capacitor, manufacturing method of thin film capacitor Download PDFInfo
- Publication number
- JP6895116B2 JP6895116B2 JP2017073667A JP2017073667A JP6895116B2 JP 6895116 B2 JP6895116 B2 JP 6895116B2 JP 2017073667 A JP2017073667 A JP 2017073667A JP 2017073667 A JP2017073667 A JP 2017073667A JP 6895116 B2 JP6895116 B2 JP 6895116B2
- Authority
- JP
- Japan
- Prior art keywords
- electrode
- thin film
- film capacitor
- dielectric film
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 239000003990 capacitor Substances 0.000 title claims description 67
- 239000010409 thin film Substances 0.000 title claims description 63
- 238000004519 manufacturing process Methods 0.000 title claims description 22
- 239000010408 film Substances 0.000 claims description 59
- 239000000758 substrate Substances 0.000 claims description 15
- 239000000919 ceramic Substances 0.000 claims description 14
- 238000000034 method Methods 0.000 claims description 14
- 238000003466 welding Methods 0.000 claims description 4
- 230000003247 decreasing effect Effects 0.000 description 4
- 239000004020 conductor Substances 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 230000008054 signal transmission Effects 0.000 description 2
- 239000003989 dielectric material Substances 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000002844 melting Methods 0.000 description 1
- 230000008018 melting Effects 0.000 description 1
Images
Landscapes
- Ceramic Capacitors (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
Description
本発明は、例えば高周波デバイスに用いられる薄膜コンデンサとその薄膜コンデンサの製造方法に関する。 The present invention relates to, for example, a thin film capacitor used in a high frequency device and a method for manufacturing the thin film capacitor.
特許文献1には、頂部電極の一部をエネルギビーム装置で除去することにより電気容量を変化させることができるモノリシックコンデンサが開示されている。特許文献2には、誘電体を、内部の電極とレーザーによりトリミング可能な上部電極とで挟んで容量を形成し、かつ上部電極の形成する表面には外部引き出し電極の露出を持たないレーザートリマブルコンデンサが開示されている。
特許文献1、2に開示されている高周波デバイス用薄膜コンデンサは、容量を減らすことはできたが、容量を増加させることはできない。そのため、容量を自在に増減できる薄膜コンデンサが求められていた。
The thin film capacitors for high-frequency devices disclosed in
本発明は、上述のような課題を解決するためになされたもので、容量を自在に増減できる薄膜コンデンサとその薄膜コンデンサの製造方法を提供することを目的とする。 The present invention has been made to solve the above-mentioned problems, and an object of the present invention is to provide a thin film capacitor whose capacity can be freely increased or decreased and a method for manufacturing the thin film capacitor.
本願の発明に係る薄膜コンデンサは、セラミック基板と、該セラミック基板を囲む接地用電極と、該接地用電極の上に形成された誘電体膜と、該誘電体膜の上に形成された回路電極と、該誘電体膜の上に形成された複数の容量調整電極と、を備え、該複数の容量調整電極のうち少なくとも1つと該回路電極は、該誘電体膜の上で接続され、該回路電極の側面と、該複数の容量調整電極の各々の側面が対向していることを特徴とする。 The thin film capacitor according to the present invention includes a ceramic substrate, a grounding electrode surrounding the ceramic substrate, a dielectric film formed on the grounding electrode, and a circuit electrode formed on the dielectric film. And a plurality of capacitance adjusting electrodes formed on the dielectric film, and at least one of the plurality of capacitance adjusting electrodes and the circuit electrode are connected on the dielectric film, and the circuit is provided. The side surface of the electrode and the side surface of each of the plurality of capacitance adjusting electrodes are opposed to each other .
本願の発明に係る薄膜コンデンサの製造方法は、セラミック基板と、該セラミック基板を囲む接地用電極と、該接地用電極の上に形成された誘電体膜と、該誘電体膜の上に形成された回路電極と、該誘電体膜の上に形成され該回路電極と離れた複数の容量調整電極と、を備え、該回路電極の側面と該複数の容量調整電極の各々の側面が対向している薄膜コンデンサを製造する製造工程と、該製造工程の後に、該複数の容量調整電極のうち少なくとも1つと該回路電極とを該誘電体膜の上で接触させる接触工程と、を備えたことを特徴とする。
The method for manufacturing a thin film capacitor according to the present invention is a ceramic substrate, a grounding electrode surrounding the ceramic substrate, a dielectric film formed on the grounding electrode, and a dielectric film formed on the dielectric film. The circuit electrode is provided with a plurality of capacitance adjusting electrodes formed on the dielectric film and separated from the circuit electrode, and the side surfaces of the circuit electrode and the side surfaces of the plurality of capacitance adjusting electrodes face each other. It is provided with a manufacturing process for manufacturing a thin film capacitor, and a contact step for bringing at least one of the plurality of capacitance adjusting electrodes and the circuit electrode into contact with each other on the dielectric film after the manufacturing step. It is a feature.
本発明のその他の特徴は以下に明らかにする。 Other features of the present invention will be clarified below.
本発明によれば、誘電体膜の上に回路電極と容量調整電極とを形成することで、薄膜コンデンサの容量を自在に増減できる。 According to the present invention, the capacitance of the thin film capacitor can be freely increased or decreased by forming the circuit electrode and the capacitance adjusting electrode on the dielectric film.
本発明の実施の形態に係る薄膜コンデンサと薄膜コンデンサの製造方法について図面を参照して説明する。同じ又は対応する構成要素には同じ符号を付し、説明の繰り返しを省略する場合がある。 The thin film capacitor and the method for manufacturing the thin film capacitor according to the embodiment of the present invention will be described with reference to the drawings. The same or corresponding components may be designated by the same reference numerals and the description may be omitted.
実施の形態1.
図1は、実施の形態1に係る薄膜コンデンサの断面図である。この薄膜コンデンサは、 セラミック基板1と、セラミック基板1を囲む接地用電極2を備えている。接地用電極2はセラミック基板1を取り巻く導体である。接地用電極2は少なくともセラミック基板1の上面全体に形成されている。接地用電極2の上には誘電体膜3が形成されている。誘電体膜3の上には回路電極4aが形成されている。回路電極4aは薄膜コンデンサの上面電極として機能する導体である。誘電体膜3の上には、回路電極4aに加えて、容量調整電極4bが形成されている。容量調整電極4bは、回路電極4aと離れることも接することもできる電極である。
FIG. 1 is a cross-sectional view of the thin film capacitor according to the first embodiment. This thin film capacitor includes a
図2は、実施の形態1に係る薄膜コンデンサの平面図である。回路電極4aと容量調整電極4bは誘電体膜3の上に設けられている。回路電極4aは横方向に長く形成されている。容量調整電極4bは複数形成することが好ましい。図2には、回路電極4aとは離れている6つの容量調整電極4bが示されている。容量調整電極4bの側面と回路電極4aの側面が対向している。
FIG. 2 is a plan view of the thin film capacitor according to the first embodiment. The
回路電極4aの一端に第1ワイヤW1が接続されている。そして、回路電極4aの他端に第2ワイヤW2が接続されている。周知のとおり、薄膜コンデンサの容量は、電極の面積と、誘電体膜の厚さと、誘電体膜の誘電率によって決定される。
The first wire W1 is connected to one end of the
図3は、実施の形態1に係る薄膜コンデンサの実装例を示す断面図である。実装基板10には、例えばトランジスタなどの半導体素子12、接地用パターン14および信号伝送用パターン16が形成されている。第1ワイヤW1は半導体素子12に接続され、第2ワイヤW2は信号伝送用パターン16に接続されている。薄膜コンデンサの接地用電極2は接地用パターン14に接続されている。薄膜コンデンサは、例えば高周波回路のインピーダンス整合のために用いられるものであるが、別の用途で用いてもよい。
FIG. 3 is a cross-sectional view showing a mounting example of the thin film capacitor according to the first embodiment. A
本発明の実施の形態1に係る薄膜コンデンサは、回路電極4aと容量調整電極4bを接触させるか、離すかによって、容量を自在に増減できるものである。図2に示される状態ではすべての容量調整電極4bが回路電極4aから離れているので、回路電極4aだけが上部電極として機能する。よって容量は比較的小さい。これに対し、回路電極4aと容量調整電極4bを接触させると、回路電極4aと容量調整電極4bが上部電極として機能するので、容量を高めることができる。
The thin film capacitor according to the first embodiment of the present invention can freely increase or decrease the capacitance depending on whether the
図4は、回路電極4aと、2つの容量調整電極4bを接触させたことを示す薄膜コンデンサの平面図である。例えば回路電極4aと容量調整電極4bを加熱することで、回路電極4aと容量調整電極4bが接する接触部20を形成する。図4には接触部20を2箇所に形成することで回路電極4aと2つの容量調整電極4bを接触させたことが示されている。これにより、回路電極4aと2つの容量調整電極4bが薄膜コンデンサの上部電極として機能するので、回路電極4aだけが上部電極として機能する場合と比べて容量を増加させることができる。また、回路電極4aに1つの容量調整電極4bを接触させたり、回路電極4aに3つ以上の容量調整電極4bを接触させたりすることで、容量の調整が可能となる。
FIG. 4 is a plan view of a thin film capacitor showing that the
本発明の実施の形態に係る薄膜コンデンサの製造方法を説明する。まず、図1、2に示す薄膜コンデンサを製造する。すなわち、セラミック基板1を囲む接地用電極2上に誘電体膜3を形成し、誘電体膜3の上に回路電極4aと、回路電極4aと離れた容量調整電極4bとを形成する。複数の容量調整電極4bを設けることが好ましい。このように、回路電極と容量調整電極4bが離れている薄膜コンデンサを製造する工程を製造工程と称する。
A method for manufacturing a thin film capacitor according to an embodiment of the present invention will be described. First, the thin film capacitors shown in FIGS. 1 and 2 are manufactured. That is, the
製造工程により、最小の容量を有する薄膜コンデンサが完成する。次いで、溶接により回路電極4aと容量調整電極4bを接触させる。具体的には、回路電極4aと容量調整電極4bの少なくとも一方を加熱して溶融させることで、回路電極4aと容量調整電極4bを接続する。例えばレーザービームで回路電極4aと容量調整電極4bの少なくとも一方を加熱することができる。レーザービーム以外の周知の溶接方法を採用してもよい。このように、製造工程の後に回路電極4aと容量調整電極4bを接触させる工程を接触工程と称する。
The manufacturing process completes a thin film capacitor with the smallest capacitance. Next, the
接触工程では、任意の数の容量調整電極4bを回路電極4aに接触させる。これにより、薄膜コンデンサの容量を増加させることができる。薄膜コンデンサを高周波デバイス部品として用いる場合には、薄膜コンデンサの容量を測定しながら、任意の周波数で所望のインピーダンスが得られるように薄膜コンデンサの容量を調整することが可能となる。すなわち、薄膜コンデンサのインピーダンスを増減できることで、薄膜コンデンサを高周波デバイス用の整合調整コンデンサとして利用することができる。なお、製造工程直後の薄膜コンデンサが有する容量を使用する場合は、接触工程は省略できる。
In the contacting step, an arbitrary number of
このように、本発明の実施の形態1に係る薄膜コンデンサは、回路電極4aと容量調整電極4bの接続有無によって容量を自在に増減できるものである。実施の形態1に係る薄膜コンデンサと薄膜コンデンサの製造方法は、この特徴を逸脱しない範囲で任意の変形が可能である。例えば、容量調整電極4bの数は必要に応じて決定することができる。複数の容量調整電極4bを設けた場合には、すべての容量調整電極4bを回路電極4aから離した場合に容量が最小になる。そして、複数の容量調整電極4bのうち少なくとも1つを回路電極4aに接触させることで、容量を高めることができる。すべての容量調整電極4bを回路電極4aに接触させた場合に容量が最大になる。容量調整電極4bは複数設けることが好ましいが1つでもよい。
As described above, the thin film capacitor according to the first embodiment of the present invention can freely increase or decrease the capacitance depending on whether or not the
実施の形態1で説明したワイヤによる接続は例示である。回路電極4aをコンデンサの電極として使用するあらゆる電気的接続を採用することができる。接触工程において回路電極4aと容量調整電極4bを容易につなぐことができるように、製造工程では、回路電極4aと容量調整電極4bはタイル状に設けることが好ましい。回路電極4aと容量調整電極4bの分布は、必要とする容量が得られることと、接触工程が容易になることを考慮して、変形することができる。さらに、接触工程では溶接以外の方法を利用して回路電極4aと容量調整電極4bを接触させてもよい。例えば導電材料を介在させて回路電極4aと容量調整電極4bを接触させてもよい。上述した変形は以下の実施の形態に係る薄膜コンデンサと薄膜コンデンサの製造方法にも応用することができる。なお、以下の実施の形態に係る薄膜コンデンサと薄膜コンデンサの製造方法は、実施の形態1との共通点が多いので実施の形態1との相違点を中心に説明する。
The wire connection described in
実施の形態2.
図5は、実施の形態2に係る薄膜コンデンサの平面図である。誘電体膜3は、接地用電極2の上に形成された第1誘電体膜3Aと、接地用電極2の上に形成された第2誘電体膜3Bを備えている。第2誘電体膜3Bの誘電率は第1誘電体膜3Aの誘電率とは異なる。例えば、第1誘電体膜3Aの誘電率と第2誘電体膜3Bの誘電率の比が10:1となるように、第1誘電体膜3Aと第2誘電体膜3Bの材料を選択する。
FIG. 5 is a plan view of the thin film capacitor according to the second embodiment. The
3つの容量調整電極4bが第1誘電体膜3Aの上に形成され、別の3つの容量調整電極4bが第2誘電体膜3Bの上に形成されている。そのため、第1誘電体膜3Aの上に形成された容量調整電極4bを回路電極4aに接触させたときと、第2誘電体膜3Bの上に形成した容量調整電極4bを回路電極に接触させたときとで、容量の増加量を変えることができる。第1誘電体膜3Aの誘電率と第2誘電体膜3Bの誘電率の比を10:1とした場合、第1誘電体膜3Aの上の容量調整電極4bを回路電極4aに接続することで容量を大きく増加させることができ、第2誘電体膜3Bの上の容量調整電極4bを回路電極4aに接続することで容量を小さく増加させることができる。
Three
図5には、接触部20が2箇所に形成されることで、2つの容量調整電極4bが回路電極4aに接続されたことが示されている。しかしながら、必要な容量に応じて、任意の数の容量調整電極4bを回路電極4aに接続することができる。複数の容量調整電極4bのうち少なくとも1つは第1誘電体膜3Aの上に形成し、複数の容量調整電極4bのうち少なくとも1つは第2誘電体膜3Bの上に形成することで上記の効果を得ることができる。つまり、複数の容量調整電極4bのうち少なくとも1つを回路電極4aに接触させることで容量を増加させることができる。
FIG. 5 shows that the two
図5の変形例として、回路電極4aを第1誘電体膜3Aの上だけに形成し、複数の容量調整電極4bを第2誘電体膜3Bの上に形成してもよい。2つの誘電率が異なる誘電体膜に対してどのように電極を分布させるかは、必要とする容量と、必要とする容量の増加量に応じて決定する。また、3つ以上の誘電率が異なる誘電体膜を接地用電極2の上に形成してもよい。
As a modification of FIG. 5, the
実施の形態3.
図6は、実施の形態3に係る薄膜コンデンサの断面図である。誘電体膜3は、第1部分3aと、第1部分3aより厚い第2部分3bを有している。第2部分3bの厚さは例えば第1部分3aの厚さの2倍である。容量調整電極4bのうち少なくとも1つは第1部分3aの上に形成され、容量調整電極4bのうち少なくとも1つは第2部分3bの上に形成されている。第1部分3aの上の容量調整電極4bを回路電極4aに接続した場合は容量を大きく増加させることができる。これに対し、第2部分3bの上の容量調整電極4bを回路電極4aに接続した場合は、第2部分3bが第1部分3aより厚いので、容量を小さく増加させることになる。
FIG. 6 is a cross-sectional view of the thin film capacitor according to the third embodiment. The
必要な容量に応じて、任意の数の容量調整電極4bを回路電極4aに接続することができる。複数の容量調整電極4bのうち少なくとも1つは第1部分3aの上に形成し、複数の容量調整電極4bのうち少なくとも1つは第2部分3bの上に形成することで上記の効果を得ることができる。つまり、複数の容量調整電極4bのうち少なくとも1つを回路電極4aに接触させることで容量を増加させることができる。
An arbitrary number of
2つの厚さが異なる誘電体に対してどのように電極を分布させるかは、必要とする容量と、必要とする容量の増加量に応じて決定する。また、3つ以上の厚みの異なる部分を有する誘電体膜を形成してもよい。なお、ここまでで説明した各実施の形態の特徴は組み合わせて用いてもよい。 How the electrodes are distributed to the two dielectrics having different thicknesses is determined according to the required capacitance and the amount of increase in the required capacitance. Further, a dielectric film having three or more portions having different thicknesses may be formed. The features of each embodiment described so far may be used in combination.
1 セラミック基板、 2 接地用電極、 3 誘電体膜、 4a 回路電極、 4b 容量調整電極 1 Ceramic substrate, 2 Grounding electrode, 3 Dielectric film, 4a circuit electrode, 4b Capacity adjustment electrode
Claims (11)
前記セラミック基板を囲む接地用電極と、
前記接地用電極の上に形成された誘電体膜と、
前記誘電体膜の上に形成された回路電極と、
前記誘電体膜の上に形成された複数の容量調整電極と、を備え、
前記複数の容量調整電極のうち少なくとも1つと前記回路電極は、前記誘電体膜の上で接続され、
前記回路電極の側面と、前記複数の容量調整電極の各々の側面が対向していることを特徴とする薄膜コンデンサ。 With a ceramic substrate
The grounding electrode surrounding the ceramic substrate and
A dielectric film formed on the grounding electrode and
The circuit electrodes formed on the dielectric film and
A plurality of capacitance adjusting electrodes formed on the dielectric film are provided.
At least one of the plurality of capacitance adjusting electrodes and the circuit electrode are connected on the dielectric film .
A thin film capacitor characterized in that the side surface of the circuit electrode and the side surface of each of the plurality of capacitance adjusting electrodes face each other.
前記複数の容量調整電極のうち少なくとも1つは前記第2誘電体膜の上に形成されたことを特徴とする請求項3に記載の薄膜コンデンサ。 At least one of the plurality of capacity adjusting electrode is formed on the first dielectric film,
At least one thin film capacitor according to claim 3, characterized in that formed on the second dielectric layer of the plurality of capacity adjusting electrode.
前記複数の容量調整電極のうち少なくとも1つは前記第2部分の上に形成されたことを特徴とする請求項6に記載の薄膜コンデンサ。 At least one of the plurality of capacity adjusting electrode is formed on the first portion,
At least one thin film capacitor according to claim 6, characterized in that formed on the second portion of the plurality of capacity adjusting electrode.
前記回路電極の他端に接続された第2ワイヤと、を備えたことを特徴とする請求項1〜8のいずれか1項に記載の薄膜コンデンサ。 The first wire connected to one end of the circuit electrode and
The thin film capacitor according to any one of claims 1 to 8 , further comprising a second wire connected to the other end of the circuit electrode.
前記製造工程の後に、前記複数の容量調整電極のうち少なくとも1つと前記回路電極とを前記誘電体膜の上で接触させる接触工程と、を備えたことを特徴とする薄膜コンデンサの製造方法。 On the ceramic substrate, the grounding electrode surrounding the ceramic substrate, the dielectric film formed on the grounding electrode, the circuit electrode formed on the dielectric film, and the dielectric film. and manufacturing process are formed and a plurality of capacity adjustment electrodes spaced with the circuit electrode, to produce a thin film capacitor each side of the side surface and the plurality of capacitance adjusting electrode of said circuit electrodes is opposed,
A method for manufacturing a thin film capacitor, comprising: after the manufacturing step, a contact step of bringing at least one of the plurality of capacitance adjusting electrodes and the circuit electrode into contact with each other on the dielectric film.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017073667A JP6895116B2 (en) | 2017-04-03 | 2017-04-03 | Thin film capacitor, manufacturing method of thin film capacitor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017073667A JP6895116B2 (en) | 2017-04-03 | 2017-04-03 | Thin film capacitor, manufacturing method of thin film capacitor |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018181879A JP2018181879A (en) | 2018-11-15 |
JP6895116B2 true JP6895116B2 (en) | 2021-06-30 |
Family
ID=64275957
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017073667A Active JP6895116B2 (en) | 2017-04-03 | 2017-04-03 | Thin film capacitor, manufacturing method of thin film capacitor |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP6895116B2 (en) |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5968916A (en) * | 1982-10-13 | 1984-04-19 | 松下電器産業株式会社 | Laminated condenser |
JPH05243086A (en) * | 1992-02-27 | 1993-09-21 | Murata Mfg Co Ltd | Capacitor network |
JPH06295772A (en) * | 1993-04-09 | 1994-10-21 | Mitsubishi Materials Corp | Noise filter block and connector having the block |
JPH0963839A (en) * | 1995-08-28 | 1997-03-07 | Res Inst Electric Magnetic Alloys | Thin film filter |
JP2751918B2 (en) * | 1996-05-17 | 1998-05-18 | 日本電気株式会社 | Semiconductor device |
JP4937495B2 (en) * | 2003-12-25 | 2012-05-23 | 新光電気工業株式会社 | Capacitor device, electronic component mounting structure, and method of manufacturing capacitor device |
JP2017059597A (en) * | 2015-09-14 | 2017-03-23 | Koa株式会社 | Chip resistor |
-
2017
- 2017-04-03 JP JP2017073667A patent/JP6895116B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2018181879A (en) | 2018-11-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10446487B2 (en) | Interface structures and methods for forming same | |
US6046409A (en) | Multilayer microelectronic circuit | |
US6970341B1 (en) | Integrated broadband ceramic capacitor array | |
US9024202B2 (en) | Electronic chip component and board having the same mounted thereon | |
US6587327B1 (en) | Integrated broadband ceramic capacitor array | |
US7307829B1 (en) | Integrated broadband ceramic capacitor array | |
CN105702453B (en) | Laminated ceramic capacitor | |
US7075776B1 (en) | Integrated broadband ceramic capacitor array | |
US11756989B2 (en) | Capacitor integrated structure | |
US20070217122A1 (en) | Capacitor | |
US20090002121A1 (en) | Chip resistor and method for fabricating the same | |
JP2001210544A (en) | Chip multilayer ceramic capacitor | |
JP6895116B2 (en) | Thin film capacitor, manufacturing method of thin film capacitor | |
JPS63248112A (en) | Thick film capacitor | |
JP4409428B2 (en) | Integrated capacitor structure set, especially integrated grid capacitor | |
TWI778214B (en) | Electronic products having embedded porous dielectric, related semiconductor products, and their methods of manufacture | |
US10897003B2 (en) | Laminated ceramic electronic component and electronic component assembly | |
EP1058337B1 (en) | Delay line | |
JP6680404B2 (en) | Circuit module | |
JPH03203212A (en) | Compound chip parts and manufacture thereof | |
US20090000811A1 (en) | Chip resistor and method for fabricating the same | |
JPH0744083Y2 (en) | Dielectric filter | |
JP3060389B2 (en) | condenser | |
JP2663270B2 (en) | Resonator and manufacturing method thereof | |
JPS628040B2 (en) |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20191219 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20200928 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20201006 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20201126 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20210209 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20210329 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20210507 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20210520 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6895116 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |