JP6753132B2 - Signal source - Google Patents
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Description
本発明は、無線通信装置またはレーダシステムに用いられる信号源に関するものである。 The present invention relates to signal sources used in wireless communication devices or radar systems.
信号源は、任意の信号波形または任意の周波数の信号を生成できる回路である。例えば、信号源は、特許文献1に示すように、PLL(Phase Locked Loop)回路またはDDS(Direct Digital Synthesizer)などを用いて構成される。
A signal source is a circuit that can generate a signal with an arbitrary signal waveform or an arbitrary frequency. For example, as shown in
PLL回路は、電圧制御発振器(VCO:Voltage Controlled Oscillator)、分周器、LF(Loop Filter)、位相周波数比較器(PFD:Phase Frequency Detector)、基準信号源を備え、分周されたVCOの出力信号の位相と、基準信号源の位相とを比較し、その誤差に相当する電流もしくは電圧を、LFを通してVCOにフィードバックすることで、VCOの発振周波数を安定させる回路である。 The PLL circuit includes a voltage controlled oscillator (VCO), a frequency divider, an LF (Loop Filter), a phase frequency comparator (PFD), and a reference signal source, and outputs a divided VCO. It is a circuit that stabilizes the oscillation frequency of the VCO by comparing the phase of the signal with the phase of the reference signal source and feeding back the current or voltage corresponding to the error to the VCO through the LF.
図12は、特許文献1における信号源の構成を示す構成図である。
特許文献1の信号源は、異なる基準信号の周波数に対応するために、DDS102とPLL回路とを直列接続したDDS駆動PLLにおいて、PLL回路の帰還路にミクサ108を設け、分周器110及びミクサ111によって、基準信号を周波数変換してミクサ108のLO(Local Oscillator)波としている。この信号源は、基準信号源101の出力周波数によらず、DDS102の出力信号の周波数及びフィルタ112の出力信号の周波数をほぼ一定にすることで、どのような基準信号の周波数であっても、一定の周波数foutを出力する。
FIG. 12 is a configuration diagram showing a configuration of a signal source in
The signal source of
しかしながら、従来の信号源では、基準信号の周波数変換を行なうミクサ111の出力信号は、高周波帯であり、周波数混合によって所望信号の近傍の周波数にスプリアスが発生してしまうことから、フィルタ112は高周波帯で急峻な特性が求められる。このようなフィルタを実現するためには、過度のハードウェア量やコストの増大を招いてしまうという欠点を有する。 However, in the conventional signal source, the output signal of the mixer 111 that performs frequency conversion of the reference signal is in the high frequency band, and spurious is generated in the frequency near the desired signal due to frequency mixing, so that the filter 112 has a high frequency. A steep characteristic is required in the band. In order to realize such a filter, there is a drawback that an excessive amount of hardware and an increase in cost are caused.
以上のように、従来の信号源は、高周波帯で急峻な特性をもつフィルタが必要であり、そのようなフィルタを実現するためには過度にハードウェア量やコストが増大するという課題があった。 As described above, the conventional signal source requires a filter having steep characteristics in the high frequency band, and there is a problem that the amount of hardware and the cost increase excessively in order to realize such a filter. ..
本発明は、上記のような課題を解決するためになされたもので、高周波帯で急峻な特性をもつフィルタを必要としない信号源を提供することを目的とする。 The present invention has been made to solve the above problems, and an object of the present invention is to provide a signal source that does not require a filter having steep characteristics in a high frequency band.
本発明における信号源は、制御信号に応じた周波数の信号を出力する発振器と、基準信号に同期して、第1の信号を生成する第1の周波数変換回路と、基準信号に同期した複数の信号が入力され、複数の信号を混合し、周波数変換を行なう第1の混合器と、第1の混合器に接続され、第1のスプリアスを含む第1の混合器の出力信号が入力され、第1の混合器の出力信号と発振器が出力した信号とを混合し、周波数変換する第2の混合器と、第1の周波数変換回路が生成した第1の信号と第2の混合器が周波数変換した信号との位相差を検出し、位相差に応じた信号を出力する位相周波数比較器と、発振器、第2の混合器、及び位相周波数比較器とともに、閉ループの伝達特性を用いて、位相周波数比較器の出力信号に含まれる、第1のスプリアスに起因する第2のスプリアスを抑圧し、第2のスプリアスを抑圧した信号を制御信号として発振器に出力するループフィルタとを備え、前記第1の混合器と前記第2の混合器との間に前記第1のスプリアスを抑圧するフィルタが接続されていないことを特徴とする。 The signal source in the present invention includes an oscillator that outputs a signal having a frequency corresponding to the control signal, a first frequency conversion circuit that generates a first signal in synchronization with the reference signal, and a plurality of signals synchronized with the reference signal. A signal is input, a plurality of signals are mixed, a first mixer that performs frequency conversion, and an output signal of a first mixer that is connected to the first mixer and contains a first sprias are input. A second mixer that mixes the output signal of the first mixer and the signal output by the oscillator and converts the frequency, and the first signal and the second mixer generated by the first frequency conversion circuit have frequencies. Phase using a closed-loop transmission characteristic together with a phase frequency comparator that detects the phase difference from the converted signal and outputs a signal according to the phase difference, an oscillator, a second mixer, and a phase frequency comparator. The first is provided with a loop filter that suppresses the second sprias caused by the first sprias included in the output signal of the frequency mixer and outputs the signal in which the second sprias is suppressed to the oscillator as a control signal . It is characterized in that a filter that suppresses the first sprias is not connected between the mixer of the above and the second mixer .
本発明によれば、高周波帯で急峻な特性をもつフィルタを必要としない信号源を提供することができる。 According to the present invention, it is possible to provide a signal source that does not require a filter having steep characteristics in a high frequency band.
実施の形態1.
図1は、この発明の実施の形態1に係る信号源の一構成例を示す構成図である。
本信号源は、基準信号源1、周波数変換回路2(第1の周波数変換回路の一例)、周波数変換回路3、周波数変換回路4、ミクサ5(第1の混合器の一例)、PFD6(位相周波数比較器の一例)、LF7(ループフィルタの一例)、VCO8(発振器の一例)、ミクサ9(第2の混合器の一例)、及びフィルタ10を備える。図1において、fCLKは、基準信号源1が出力する基準信号の周波数であり、f1は、周波数変換回路2が出力する信号の周波数、f2は、周波数変換回路3が出力する信号の周波数であり、f3は、周波数変換回路4が出力する信号の周波数であり、foutは、VCO8が出力する信号の周波数である。
FIG. 1 is a configuration diagram showing a configuration example of a signal source according to the first embodiment of the present invention.
This signal source includes a
基準信号源1は、本信号源の基準信号を出力する発振器である。基準信号源1の出力端子は、周波数変換回路2の入力端子と周波数変換回路3の入力端子と周波数変換回路4の入力端子とに接続される。基準信号源1は、fCLKにて発振し、その出力信号を周波数変換回路2と周波数変換回路3と周波数変換回路4とに出力する。基準信号源1は、正確な周波数を出力できる発振器であればどのような構成の発振器を用いても良い。例えば、基準信号源1には、正確な周波数を出力できる水晶発振器、PLL回路などが用いられる。
The
周波数変換回路2は、外部から入力された基準信号に同期して、周波数f1の信号を生成する周波数変換回路である。周波数変換回路2の入力端子は、基準信号源1の出力端子に接続され、周波数変換回路2の出力端子は、PFD6の基準信号入力端子に接続される。周波数変換回路2は、基準信号源1が出力した基準信号に同期して、基準信号とは異なる周波数f1の信号を生成し、PFD6に出力する。例えば、周波数変換回路2には、DDSや分周器、ミクサを用いることができる。更に、DDS、分周器、及びミクサを組み合わせて用いても良く、それらを複数個用いても良い。なお、周波数変換回路2にDDSを用いる場合は、周波数制御データを外部から入力し、ミクサを用いる場合は、LO波を外部から入力する。ここで、周波数制御データは、DDSの出力周波数を示すディジタルデータである。また、周波数f1は、基準信号の周波数fCLKと同じでも良く、この場合、周波数変換回路2は、スルー線路となる。
The
図2は、この発明の実施の形態1に係る周波数変換回路2の一構成例を示す構成図である。
図2では周波数変換回路2として、DDS11を用いている。
FIG. 2 is a configuration diagram showing a configuration example of the
In FIG. 2, the
DDS11は、基準信号源1が出力した基準信号をクロックとして、周波数f1の正弦波の連続信号を生成する回路である。例えば、DDS11は、加算器、ラッチ、ROM、DACから構成される。DDS11のクロック端子は、周波数変換回路2の入力端子を介して基準信号源1の出力端子に接続され、DDS11の出力端子は、周波数変換回路2の出力端子を介してPFD6の基準信号入力端子に接続される。DDS11は、基準信号源1からのクロック信号に同期して、周波数f1の信号を生成し、PFD6に出力する。
The
DDS11の出力信号には、周波数f1の信号の他に、f1の周波数の整数倍の成分をもつ高調波、または第一のナイキストゾーン内に折り返された高調波のイメージ波のスプリアスが含まれるため、図2には記載していないが、DDS11の出力端子とPFD6の基準信号入力端子の間に、DDS11が出力するスプリアスを抑圧するフィルタを設けても良い。
This is because the output signal of the
周波数変換回路3は、外部から入力された基準信号に同期して、周波数f2の信号を生成する周波数変換回路である。周波数変換回路3の入力端子は、基準信号源1の出力端子に接続され、周波数変換回路3の出力端子は、ミクサ5の第1の入力端子(LO端子)に接続される。周波数変換回路3は、基準信号源1が出力した基準信号に同期して、基準信号とは異なる周波数f2の信号を生成し、ミクサ5に出力する。例えば、周波数変換回路3には、DDSや分周器、ミクサを用いることができる。更に、DDSや分周器、ミクサを組み合わせて用いても良く、それらを複数個用いても良い。なお、周波数変換回路3にDDSを用いる場合は、周波数制御データを外部から入力し、ミクサを用いる場合は、LO波を外部から入力する。また、周波数f2は基準信号の周波数fCLKと同じでも良く、この場合、周波数変換回路3はスルー線路となる。
The
図3は、この発明の実施の形態1に係る周波数変換回路3の一構成例を示す構成図である。
図3では周波数変換回路3として、分周器21を用いている。
FIG. 3 is a configuration diagram showing a configuration example of the
In FIG. 3, a
分周器21は、入力された信号の周波数をA分周し、分周した信号を出力する分周器である。Aは、2以上の整数である。分周器21の入力端子は、周波数変換回路3の入力端子を介して基準信号源1の出力端子に接続され、分周器21の出力端子は、周波数変換回路3の出力端子を介してミクサ5の第1の入力端子(LO端子)に接続される。分周器21には、例えば、高速にディジタル信号の演算処理を行うことができるFPGA(Field−Programmable Gate Array)を用いることができる。分周器21は、入力された信号の周波数の1/Aの周波数をもつ信号を出力できれば、どのような構成を用いても良く、固定分周器でも可変分周器であっても良い。なお、分周器21が可変分周器である場合は、外部から入力された分周数を示す制御信号に従って、入力された信号の周波数をA分周する。
The
周波数変換回路4は、外部から入力された基準信号に同期して、周波数f3の信号を生成する周波数変換回路である。周波数変換回路4の入力端子は、基準信号源1の出力端子に接続され、周波数変換回路4の出力端子は、ミクサ5の第2の入力端子(IF端子)に接続される。周波数変換回路4は、基準信号源1が出力した基準信号に同期して、基準信号と異なる周波数f3の信号を生成し、ミクサ5に出力する。例えば、周波数変換回路4には、DDSや分周器、ミクサを用いることができる。更に、DDSや分周器、ミクサを組み合わせて用いても良く、それらを複数個用いても良い。なお、周波数変換回路4にDDSを用いる場合は、周波数制御データを外部から入力し、ミクサを用いる場合は、LO波を外部から入力する。また、周波数f3は、基準信号の周波数fCLKと同じでも良く、この場合、周波数変換回路4はスルー線路となる。
The
図4は、この発明の実施の形態1に係る周波数変換回路4の一構成例を示す構成図である。
図4では、周波数変換回路4として分周器31を用いている。
FIG. 4 is a configuration diagram showing a configuration example of the
In FIG. 4, a
分周器31は、入力された信号の周波数をB分周し、分周した信号を出力する分周器である。Bは、2以上の整数である。分周器31の入力端子は、周波数変換回路4の入力端子を介して基準信号源1の出力端子に接続され、分周器31の出力端子は、周波数変換回路4の出力端子を介してミクサ5の第2の入力端子(IF端子)に接続される。分周器31には、例えば、高速にディジタル信号の演算処理を行うことができるFPGAを用いることができる。分周器31は、入力された信号の周波数の1/Bの周波数をもつ信号を出力できれば、どのような構成を用いても良く、固定分周器でも可変分周器であっても良い。なお、分周器31が可変分周器である場合は、外部から入力される分周数を示す信号に従って、入力された信号の周波数を分周する。
The
ミクサ5は、入力された2つの信号を混合し、その混合信号を出力する混合器である。ミクサ5の第1の入力端子(LO端子)は周波数変換回路3の出力端子に接続され、ミクサ5の第2の入力端子(IF端子)は、周波数変換回路4の出力端子に接続され、ミクサ5の出力端子(RF端子)は、ミクサ9の第1の入力端子(RF端子)に接続される。ミクサ5は、周波数変換回路3が出力した信号と周波数変換回路4が出力した信号とを混合することで周波数変換し、周波数変換した混合信号をミクサ9に出力する。例えば、ミクサ5は、ダイオードの非線形性を利用して混合を行うダイオードミクサが用いられる。
The
PFD6は、入力された2つの信号の位相を比較し、その位相差に対応する信号を出力するPFDである。PFD6の基準信号入力端子は、周波数変換回路2の出力端子に接続され、PFD6の同期信号入力端子は、フィルタ10の出力端子に接続され、PFD6の出力端子は、LF7の入力端子に接続される。例えば、PFD6には、ミクサを用いることができる。
The
LF7は、PFD6が出力した信号を平滑化し、制御電圧としてVCO8に出力するフィルタである。LF7の入力端子は、PFD6の出力端子に接続され、LF7の出力端子は、VCO8の入力端子に接続される。例えば、LF7は、容量と抵抗などから構成されるローパスフィルタが用いられる。また、LF7は、必要とする利得に合わせて、オペアンプを組み込んだフィルタを用いても良い。
The LF 7 is a filter that smoothes the signal output by the
VCO8は、制御電圧により発振周波数を制御する発振器である。VCO8の入力端子は、LF7の出力端子に接続され、VCO8の出力端子は、ミクサ9の第2の入力端子(LO端子)と本信号源の出力端子に接続される。VCO8には、例えば、可変容量ダイオードで発振周波数を変化させる発振器が用いられる。可変容量ダイオードは、印加する電圧によって容量を変化させる。これによって、可変容量ダイオードを含む共振回路の共振周波数が変化し、発振周波数が変化する。
The VCO 8 is an oscillator whose oscillation frequency is controlled by a control voltage. The input terminal of the VCO 8 is connected to the output terminal of the LF 7, and the output terminal of the VCO 8 is connected to the second input terminal (LO terminal) of the
ミクサ9は、入力された2つの信号を混合し、その混合信号を出力する混合器である。ミクサ9の第1の入力端子(RF端子)は、ミクサ5の出力端子(RF端子)に接続され、ミクサ9の第2の入力端子(LO端子)は、VCO8の出力端子に接続され、ミクサ9の出力端子(IF端子)は、フィルタ10の入力端子に接続される。ミクサ9は、VCO8が出力した信号とミクサ5が出力した信号とを混合することで周波数変換し、周波数変換した混合信号をフィルタ10に出力する。例えば、ミクサ9は、ダイオードの非線形性を利用して混合を行うダイオードミクサが用いられる。なお、ミクサ9は、VCO8が出力する信号の周波数を下げるためのものであるため、VCO8の出力端子からフィルタ10の入力端子までのPLLの帰還路内にミクサ9の代わりに、もしくはミクサ9に加えて、さらに周波数を下げる周波数変換器を設けても良い。例えば、周波数変換器には、ミクサや分周器などが用いられる。
The
フィルタ10は、所定の通過帯域を有し、入力された信号のうち通過帯域内にある信号を通過させ、通過帯域外の周波数帯域にある信号を抑圧するフィルタである。フィルタ10の入力端子は、ミクサ9の出力端子(IF端子)に接続され、フィルタ10の出力端子は、PFD6の同期信号入力端子に接続される。例えば、フィルタ10は、チップインダクタ、チップキャパシタ等を用いて実装される。また、フィルタ10は、通過させる周波数帯や必要な抑圧量に応じて、マイクロストリップ型の共振器や、同軸共振器等の共振器を用いて構成しても良い。
The
次に、この発明の実施の形態1に係る信号源の動作について説明する。
まず、基準信号源1は、周波数変換回路2、周波数変換回路3、及び周波数変換回路4にそれぞれ周波数fCLKの基準信号を出力する。
Next, the operation of the signal source according to the first embodiment of the present invention will be described.
First, the
周波数変換回路2は、DDS11で構成されているため、DDS11は、基準信号源1が出力した基準信号に同期するとともに、外部から入力された周波数制御データに基づいて、周波数f1の信号を生成し、PFD6に出力する。したがって、周波数f1は、基準信号の周波数fCLKによらず、ほぼ一定となる。なお、周波数f1は、周波数制御データに応じて変更が可能である。
Since the
周波数変換回路3は、分周器21で構成されているため、基準信号源1が出力した基準信号の周波数をA分周して周波数fCLK/Aの信号を生成し、ミクサ5に出力する。したがって、f2=fCLK/Aとなる。なお、Aは、一般的には2以上の整数であるが、仮にAが1の場合、分周器21をバイパスすることと同じである。
Since the
周波数変換回路4は、分周器31で構成されているため、基準信号源1が出力した基準信号の周波数をB分周して周波数fCLK/Bの信号を生成し、ミクサ5に出力する。したがって、f3=fCLK/Bとなる。なお、Bは、一般的には2以上の整数であるが、仮にBが1の場合、分周器31をバイパスすることと同じである。
Since the
ミクサ5は、周波数変換回路3が出力した周波数f2の信号と、周波数変換回路4が出力した周波数f3の信号とを混合し、混合信号をミクサ9に出力する。一般的に、ミクサに入力される2つの周波数をfin1、fin2とすると、出力周波数は、以下の式(1)及び式(2)で表せる。
The
ここで、m及びnは、正の整数である。ミクサ5において、2つの入力周波数は、f2及びf3であり、所望信号の周波数は、f2+f3である。しかし、式(1)及び式(2)より、ミクサ5の出力信号には、所望信号の他に、多数のスプリアスが含まれる。以降、説明を簡単にするため、ミクサ5の出力信号に含まれるスプリアスは、式(1)及び式(2)において、n=1もしくは2、かつm=1で表されるスプリアスとする。
Here, m and n are positive integers. In the
図5は、この発明の実施の形態1に係るミクサ5の出力信号の周波数スペクトルを示す図である。
横軸は、周波数であり、縦軸は、電力である。ミクサ5は、周波数f2+f3の所望信号(以降、RF信号と示す。)の他に、スプリアスとして、周波数|f2−f3|(以降、SP1と示す。)、周波数f2+2f3(以降、SP2と示す。)、周波数|f2−2f3|(以降、SP3と示す。)を出力する。ミクサ5の出力信号は、高周波帯であり、所望信号の周波数近傍にスプリアスが存在する。
FIG. 5 is a diagram showing a frequency spectrum of an output signal of the
The horizontal axis is frequency and the vertical axis is electric power. In addition to the desired signal of frequency f2 + f3 (hereinafter referred to as RF signal), the
なお、ミクサ5の出力信号の周波数は、基準信号の周波数fCLKによらずほぼ一定値になり、基準信号に同期している。また、ミクサ5の出力信号の周波数f2+f3は、VCO8の出力信号の周波数foutと異なる値である。
The frequency of the output signal of the
ミクサ9は、VCO8が出力した周波数foutの信号と、スプリアスを含んだミクサ5の出力信号とを混合し、混合信号をフィルタ10に出力する。ミクサ9の出力周波数は、式(1)及び式(2)において、fin2をミクサ5が出力したRF信号、SP1、SP2、もしくはSP3の周波数とし、fin1をfoutとすることで表せる。ミクサ9も、ミクサ5と同様に、出力信号に多数のスプリアスが含まれる。以降、説明を簡単にするため、ミクサ9の出力信号に含まれるスプリアスは、式(2)において、n=m=1で表されるスプリアスとする。
The
図6は、この発明の実施の形態1に係るミクサ9の出力信号の周波数スペクトルを示す図である。
横軸は、周波数であり、縦軸は電力である。ミクサ9は、周波数|f2+f3−fout|の所望信号(以降、ミクサ9の所望信号と示す。)の他に、スプリアスとして、周波数||f2−f3|−fout|(SP1とfoutとの混合信号)、周波数|f2+2f3−fout|(SP2とfoutとの混合信号)、||f2−2f3|−fout|(SP3とfoutとの混合信号)を出力する。ミクサ5から出力されたスプリアスは、ミクサ9における混合によって、ミクサ9の所望信号の近傍に存在する。
FIG. 6 is a diagram showing a frequency spectrum of the output signal of the
The horizontal axis is frequency and the vertical axis is electric power. In addition to the desired signal of frequency | f2 + f3-fout | (hereinafter referred to as the desired signal of mixer 9), the
フィルタ10は、ミクサ9の出力信号から、フィルタ10の通過帯域外に存在するスプリアスを抑圧して、PFD6に出力する。フィルタ10は、ローパスフィルタである。ここでは説明を簡単にするために省略したが、ミクサ9の出力信号には、図6に示すスプリアス以外にも広帯域にわたって多数のスプリアスが含まれている。フィルタ10は、PFD6に多数のスプリアスが入力されることによる誤動作や、高い電力のスプリアスが入力されることによる故障を防止するために設けられている。フィルタ10は、低周波帯の信号を通過させて高周波帯にある多数のスプリアスを抑圧すれば良いため、急峻な特性は必要ない。
The
図7は、この発明の実施の形態1に係るフィルタ10の出力信号の周波数スペクトルを示す図である。
横軸は、周波数であり、縦軸は電力である。フィルタ10の出力信号には、周波数|f2+2f3−fout|のスプリアス(以降、SP4と示す。)が含まれているが、SP4は、フィルタ10の出力信号よりも電力レベルが低いため、PFD6は、誤動作を起こさない。
FIG. 7 is a diagram showing a frequency spectrum of an output signal of the
The horizontal axis is frequency and the vertical axis is electric power. The output signal of the
PFD6は、周波数変換回路1が出力した周波数f1の信号の位相とフィルタ10が出力した信号の位相とを比較し、その位相差に対応する制御信号をLF7に出力する。本実施の形態では、PFD6は、ミクサであるとする。PFD6の出力周波数は、式(1)及び式(2)において、fin1をf1とし、fin2をフィルタ10の出力信号もしくはSP4の周波数とすることで表すことができる。以降、説明を簡単にするため、PFD6の出力信号に含まれるスプリアスは、式(2)において、n=m=1で表されるスプリアスとする。
The
図8は、この発明の実施の形態1に係るPFD6の出力信号の周波数スペクトルを示す図である。
横軸は、周波数であり、縦軸は、電力である。PFD6に入力される2つの信号において位相同期が確立している場合、2つの信号の周波数は等しいため、PFD6の出力信号は周波数0(DC)となる。この他に、f1とSP4との混合信号である、周波数||f2+2f3−fout|−f1|のスプリアス(以降、SP5と示す。)が含まれる。閉ループ伝達特性で抑圧するSP5は、DCに最も近いスプリアスである。
本実施の形態の信号源において、PFD6からLF7、VCO8、ミクサ9、及びフィルタ10を介してPFD6に帰還する経路は、PLL回路を形成している。ここで、PLL回路の閉ループ伝達関数は、以下の式(3)で表される。
FIG. 8 is a diagram showing a frequency spectrum of the output signal of the
The horizontal axis is frequency and the vertical axis is electric power. When phase synchronization is established between the two signals input to the
In the signal source of the present embodiment, the path returning from the
ここで、Kpは、PFD6の検波感度であり、入力された2つの信号の位相差が1rad変化した際に出力する電圧もしくは電流がどの程度変化するかを示す指標である。単位は、PFD6が電圧出力型PFDであれば、V/radであり、電流出力型PFDであれば、A/radである。F(s)は、LF7の伝達関数であり、sは、複素周波数である。Kvは、VCO8の同調感度であり、入力された電圧が1V変化した際に出力する周波数がどの程度変化するかを示す指標である。単位は、Hz/Vである。Nは、PLL回路の帰還路における分周器の分周数であり、図1に示す構成の場合は、N=1である。
Here, K p is the detection sensitivity of PFD6, and is an index showing how much the output voltage or current changes when the phase difference between the two input signals changes by 1 rad. The unit is V / rad if the
式(3)より、PLL回路の閉ループ伝達関数は、ローパスフィルタと同等の伝達特性を有している。本実施の形態では、ミクサ5で生成され、ミクサ9及びPFD6によって周波数変換されたスプリアスSP5は、このPLL回路の閉ループ伝達特性を用いて抑圧する。
From the equation (3), the closed loop transfer function of the PLL circuit has the same transfer characteristics as the low-pass filter. In the present embodiment, the spurious SP5 generated by the
式(3)で示される伝達関数によってSP5を抑圧する方法として、例えば、SP5の周波数よりも、式(3)で示される伝達関数の3dB帯域を小さくする方法がある。3dB帯域とは、利得が最大値となる周波数から3dB低下する周波数までの周波数帯域幅である。このとき、SP5の周波数をfSP5とおくと、以下の式(4)が成り立つ。 As a method of suppressing SP5 by the transfer function represented by the formula (3), for example, there is a method of making the 3 dB band of the transfer function represented by the formula (3) smaller than the frequency of SP5. The 3 dB band is a frequency bandwidth from the frequency at which the gain becomes the maximum value to the frequency at which the gain decreases by 3 dB. At this time, if the frequency of SP5 is set to f SP5 , the following equation (4) holds.
式(4)を満たすように、PFD6の検波感度、LF7の伝達関数、及びVCO8の同調感度を決定することによって、SP5を抑圧する。 SP5 is suppressed by determining the detection sensitivity of PFD6, the transfer function of LF7, and the tuning sensitivity of VCO8 so as to satisfy equation (4).
LF7は、PFD6から出力された電圧信号(制御電圧)を平滑化して、電圧信号をVCO8に出力する。VCO8は、LF7から出力された電圧信号に基づいて、周波数foutで発振し、出力信号として出力端子から出力するとともに、出力信号をミクサ9に出力する。
The LF 7 smoothes the voltage signal (control voltage) output from the
図9は、この発明の実施の形態1に係るLF7の出力信号の周波数スペクトルを示す図である。
横軸は、周波数であり、縦軸は、電力である。PLL回路の閉ループ伝達関数の3dB帯域をスプリアスSP5の周波数より低くすることでSP5を抑圧できる。
FIG. 9 is a diagram showing a frequency spectrum of the output signal of the LF 7 according to the first embodiment of the present invention.
The horizontal axis is frequency and the vertical axis is electric power. SP5 can be suppressed by making the 3 dB band of the closed loop transfer function of the PLL circuit lower than the frequency of the spurious SP5.
例えば、LF7として容量と抵抗などから構成されるローパスフィルタを用いている場合は、容量値、抵抗値、及びフィルタの次数を変えることによって、伝達関数F(s)を変化させることができる。同様にして、PFD6としてミクサを使用している場合は、使用するダイオードを変えることによって検波感度を変化させることができ、VCO8は、可変容量ダイオードを変えることによって、同調感度を変えることができる。これらは、過度にハードウェア量を増やすことなく、容易に行うことができる。ループフィルタの特性は、周波数切り替え時間などPLL回路に求められる特性によって決定し、閉ループ伝達特性は、DCに最も近いスプリアスが抑圧できるように決定する。 For example, when a low-pass filter composed of a capacitance and a resistor is used as the LF 7, the transfer function F (s) can be changed by changing the capacitance value, the resistance value, and the order of the filter. Similarly, when a mixer is used as the PFD6, the detection sensitivity can be changed by changing the diode used, and the VCO8 can change the tuning sensitivity by changing the variable capacitance diode. These can be easily done without excessively increasing the amount of hardware. The characteristics of the loop filter are determined by the characteristics required for the PLL circuit such as the frequency switching time, and the closed loop transmission characteristics are determined so that the spurious closest to DC can be suppressed.
例えば、一般的に高速な周波数切り替え時間を実現する場合には、ループフィルタのカットオフ周波数を大きくする。これは、カットオフ周波数と時定数とは反比例の関係にあるので、カットオフ周波数が大きいほど時定数が小さくなり、切り替えに掛かる時間が短くなるためである。切り替え時間を短くした場合、ループフィルタのカットオフ周波数よりも、スプリアスの周波数が小さくなってしまい、出力信号にスプリアスが含まれてしまう。このような場合であっても、本信号源では、閉ループ伝達特性をスプリアスが抑圧できるように決定するため、高速な周波数切り替え時間と低スプリアスの両立が図れる。 For example, in general, when a high frequency switching time is realized, the cutoff frequency of the loop filter is increased. This is because the cutoff frequency and the time constant are inversely proportional to each other, and the larger the cutoff frequency, the smaller the time constant and the shorter the time required for switching. If the switching time is shortened, the spurious frequency becomes smaller than the cutoff frequency of the loop filter, and the output signal contains spurious. Even in such a case, in this signal source, since the closed loop transmission characteristic is determined so that the spurious can suppress it, it is possible to achieve both a high frequency switching time and a low spurious.
以上のように、実施の形態1によれば、ミクサ5の出力信号に含まれるスプリアスをPLL回路の閉ループ伝達特性で抑圧するため、ミクサ5とミクサ9との間に高周波帯で急峻な特性をもつバンドバスフィルタを設ける必要がない。これにより、過度のハードウェア量やコストの増大を招くことのない信号源を実現することができる。
As described above, according to the first embodiment, in order to suppress the spurious contained in the output signal of the
なお、以上の説明では、ミクサ5の出力信号のうち、周波数f2+f3の成分を所望信号としているが、周波数混合によって生じる他の周波数成分を所望信号としても良い。
同様に、ミクサ9の出力信号のうち、周波数|f2+f3−fout|の成分を所望信号としているが、周波数混合によって生じる他の周波数成分を所望信号としても良い。
In the above description, among the output signals of the
Similarly, among the output signals of the
また、DDS11の出力のうち、周波数f1の成分を所望信号としているが、DDS11から生じる他の信号を所望信号とし、所望信号を通過させるフィルタを備えるようにしても良い。
Further, although the component of the frequency f1 of the output of the
周波数変換回路2、周波数変換回路3、及び周波数変換回路4は、周波数fCLKの基準信号源1の出力信号を入力信号としているが、外部から基準信号源1の出力信号に同期した信号を入力するようにしても良い。また、周波数変換回路2の入力信号として、VCO8の出力信号を用いても良い。
The
図10は、この発明の実施の形態1に係る信号源の他の構成例を示す構成図である。
図1と比較すると、周波数変換回路4を削除し、周波数変換回路4の出力信号(f3)の代わりに周波数変換回路2の出力信号(f1)を用いる構成である。ミクサ5は、fCLKを周波数変換したf1の信号とf2の信号とを混合することにより、周波数変換し、周波数変換した信号をミクサ9に出力する。ミクサ9以降の動作は図1と同様である。図10の構成では、図1と比較すると、周波数変換回路4が不要となるため、より小形化でより低消費電力にできるという効果がある。
FIG. 10 is a configuration diagram showing another configuration example of the signal source according to the first embodiment of the present invention.
Compared with FIG. 1, the
図11は、この発明の実施の形態1に係る信号源の他の成例を示す構成図である。図11は、図1と比較して、ミクサ5とミクサ9の間に分周器41を挿入した構成である。
分周器41は、その分周数をB(Bは、正の自然数。)とすると、入力された信号に含まれるスプリアスのレベルを20log10(B)下げる効果がある。つまり、分周器41は、所望信号のレベルを下げずに、スプリアスを下げる。これは、所望信号の近傍の周波数において、周波数逓倍の効果により周波数がX倍になると、位相雑音もスプリアスも20log10(X)増加する特性を逆に利用したものである。分周器41を設けることで、所望信号とスプリアスとのレベル比を20log10(B)改善できる。したがって、ミクサ5の出力信号に含まれるスプリアスのレベルを下げることができ、スプリアスを低減した信号をミクサ9に入力できる。このため、ミクサ9の出力信号が入力されるPFD6において、PFD6の出力信号のスプリアスのレベルを下げることができるという効果がある。
FIG. 11 is a configuration diagram showing another example of the signal source according to the first embodiment of the present invention. FIG. 11 shows a configuration in which the frequency divider 41 is inserted between the
Assuming that the number of divisions is B (B is a positive natural number), the frequency divider 41 has an effect of lowering the level of spurious contained in the input signal by 20 log 10 (B). That is, the frequency divider 41 lowers the spurious without lowering the level of the desired signal. This utilizes the property that the phase noise and spurious increase by 20 log 10 (X) when the frequency is multiplied by X due to the effect of frequency multiplication at the frequency near the desired signal. By providing the frequency divider 41, the level ratio between the desired signal and the spurious can be improved by 20 log 10 (B). Therefore, the level of spurious contained in the output signal of the
1 基準信号源、2 周波数変換回路、3 周波数変換回路、4 周波数変換回路、5 ミクサ、6 PFD、7 LF、8 VCO、9 ミクサ、10 フィルタ、11 DDS、21 分周器 31 分周器、41 分周器、101 基準信号源、102 DDS、103 フィルタ、104 分周器、105 PFD、106 LF、107 VCO、108 ミクサ、109 フィルタ、110 分周器、111 ミクサ、112 フィルタ。
1 Reference signal source, 2 Frequency conversion circuit, 3 Frequency conversion circuit, 4 Frequency conversion circuit, 5 Mixer, 6 PFD, 7 LF, 8 VCO, 9 Mixer, 10 Filter, 11 DDS, 21
Claims (5)
基準信号に同期して、第1の信号を生成する第1の周波数変換回路と、
前記基準信号に同期した複数の信号が入力され、前記複数の信号を混合し、周波数変換を行なう第1の混合器と、
前記第1の混合器に接続され、第1のスプリアスを含む前記第1の混合器の出力信号が入力され、前記第1の混合器の出力信号と前記発振器が出力した信号とを混合し、周波数変換する第2の混合器と、
前記第1の周波数変換回路が生成した前記第1の信号と前記第2の混合器が周波数変換した信号との位相差を検出し、前記位相差に応じた信号を出力する位相周波数比較器と、
前記発振器、前記第2の混合器、及び前記位相周波数比較器とともに、閉ループの伝達特性を用いて、前記位相周波数比較器の出力信号に含まれる、前記第1のスプリアスに起因する第2のスプリアスを抑圧し、前記第2のスプリアスを抑圧した信号を前記制御信号として前記発振器に出力するループフィルタと、
を備え、
前記第1の混合器と前記第2の混合器との間に前記第1のスプリアスを抑圧するフィルタが接続されていないことを特徴とする信号源。 An oscillator that outputs a signal with a frequency corresponding to the control signal,
A first frequency conversion circuit that generates a first signal in synchronization with the reference signal,
A first mixer in which a plurality of signals synchronized with the reference signal are input, the plurality of signals are mixed, and frequency conversion is performed, and
The output signal of the first mixer connected to the first mixer and containing the first spurious is input, and the output signal of the first mixer and the signal output by the oscillator are mixed. A second mixer that converts frequencies and
A phase frequency comparator that detects the phase difference between the first signal generated by the first frequency conversion circuit and the signal frequency-converted by the second mixer and outputs a signal corresponding to the phase difference. ,
A second spurious caused by the first spurious contained in the output signal of the phase frequency comparator using the closed-loop transmission characteristic together with the oscillator, the second mixer, and the phase frequency comparator. And a loop filter that outputs a signal that suppresses the second spurious to the oscillator as the control signal.
Equipped with
A signal source characterized in that a filter for suppressing the first spurious is not connected between the first mixer and the second mixer .
20log|1/((fsp5/(Kp・F(fsp5)・Kv))+1)|<3dBを満たすことを特徴とする請求項2に記載の信号源。 The transfer function of the loop filter (F (s), s is a complex frequency), the tuning sensitivity of the oscillator (Kv), the detection sensitivity of the phase frequency comparator (Kp), and the frequency of the second spurious (fsp5). In, the transfer characteristic of the closed loop is
The signal source according to claim 2, wherein 20 log | 1 / ((fsp5 / (Kp · F (fsp5) · Kv)) +1) | <3 dB is satisfied.
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