JP6744609B2 - 半導体材料、導電性層にキャリアを生じさせる方法、熱電変換素子、及びスイッチング素子 - Google Patents
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Description
熱電材料を利用した素子としては、例えば熱エネルギーを電気エネルギーに変換する技術として、熱電素子に圧電素子を組み込んだ熱電変換素子が知られている。
例えば、国際公開第2013/103009号公報には、熱発電及び振動発電を併用して発電する発電装置が開示されている。
また、特開2010−16974号公報には、可撓性を有するバンド基材の上面側に複数の圧電素子モジュールおよびシート状に形成された複数の太陽電池素子アレイを備え、バンド基材の背面側に複数の圧電素子モジュールおよびシート状に形成された複数の熱電変換素子アレイを備えるリストバンドが開示されている。
また、特開2000−12916号公報には、圧電材料からなる圧電基板と、圧電基板と対向してP型熱電エレメントとN型熱電エレメントとを挾持する基板と、P型熱電エレメント及びN型熱電エレメントを交互に直列に接続するために基板上に設けられた電極と、圧電基板の電極が形成された面とは反対側の面に形成された対向電極を有する熱電素子と、を備える発電装置が開示されている。
また、国際公開第2011/104772号公報には、第1の部分と第2の部分との温度差によって発電する熱電発電モジュールと、熱電発電モジュールに、熱的に、かつ機械的に結合し、熱電発電モジュールの振動によって変形を生じる圧電材料板を含む圧電発電モジュールとを有する発電装置が開示されている。
しかし、国際公開第2013/103009号公報に記載の発電装置は、熱電素子への熱の伝達を別途設けた熱伝導体を介して行っているため、熱電性能が低下する傾向がある。
また、特開2010−16974号公報に記載の発電装置(リストバンド)は、熱電機能、圧電機能及び光電変換機能の機能を有するが、各機能が個別に発現される構造である。
また、特開2000−12916号公報に記載の発電装置は、熱電素子に圧電素子を一体的に付設した構造を有し、補助的な電力を得ることができるとされている。しかし、特許文献3の発電装置は、圧電素子と、熱電素子(P型熱電エレメント及びN型熱電エレメント)とが電極を介して個別に設けられた構造となっているため、圧電素子に生じた分極は熱電素子の熱電層に直接影響を及ぼすものではない。そのため、熱電性能の最適化の検討は十分行われていないといえる。
さらに、国際公開第2011/104772号公報に記載の発電装置は、熱電発電モジュールの上に圧電発電モジュールが積層された構造であり、構造が複雑な上、熱電機能及び圧電機能が個別に発現される構造である。
熱電性能を最適化する手法としては、熱電層のキャリア密度を調整する方法がある。従来、熱電層のキャリア密度を調整する観点から、熱電層に不純物を添加したり、電界効果を利用して例えば電界効果トランジスタ(FET)によりキャリアを注入することが行われてきた。
しかし、熱電層に不純物を添加する方法では、不純物の存在により熱電性能が低下することがある。また、電界効果を利用したキャリアの注入方法では、不純物を注入せずにキャリアを注入することが可能となるが、キャリアの注入に電力を消費するため、電力の利用効率が低下してしまうことがある。
また、本発明は、外部から電圧印加せずに導電性層にキャリアが生じる半導体材料を備えたスイッチング素子を提供することを課題とする。
<1> 圧電材料を含む圧電層と、
導電性材料を含み、前記圧電層に接触させて又は他の層を介して設けられた導電性層と、
を有し、
前記圧電層に外部刺激を付与することで生じた分極によって前記導電性層にキャリアが生じる半導体材料。
<2> 前記導電性材料は、半導体又は導電性高分子である<1>に記載の半導体材料。
<3> 前記半導体及び前記導電性高分子は、熱電変換する熱電材料である<2>に記載の半導体材料。
<4> 前記外部刺激は、物理力、磁力、熱、電圧及び光から選ばれる少なくとも1つである<1>〜<3>の何れか1項に記載の半導体材料。
<5> 前記圧電材料は、ポリフッ化ビニリデン系樹脂、ポリアミノボラン系樹脂、ポリシアン化ビニリデン系樹脂、ポリウレア系樹脂、ポリ乳酸樹脂、及びナイロン樹脂から選ばれる少なくとも1つである<1>〜<4>の何れか1項に記載の半導体材料。
<6> 前記導電性材料は、ポリチオフェン系樹脂である<1>〜<5>の何れか1項に記載の半導体材料。
<7> 前記導電性層は、黒リン原子膜である<1>に記載の半導体材料。
<8> <1>〜<7>の何れか1項に記載の半導体材料を有する熱電変換素子。
<9> <1>〜<7>の何れか1項に記載の半導体材料の少なくとも一対を有し、
前記一対の半導体材料の一方は、前記導電性層に電子が生じるn型半導体であり、
前記一対の半導体材料の他方は、前記導電性層に正孔が生じるp型半導体である、熱電変換素子。
<10> 圧電材料を含む圧電層と、導電性材料を含み、前記圧電層に接触させて又は他の層を介して設けられた導電性層と、を有する半導体材料に対し、前記圧電層に外部刺激を付与することにより分極を生じさせ、生じた分極によって前記導電性層にキャリアを生じさせる方法。
<11> 前記導電性材料は、半導体又は導電性高分子である<10>に記載の方法。
<12> 前記半導体及び前記導電性高分子は、熱電変換する熱電材料である<11>に記載の方法。
<13> 前記外部刺激は、物理力、磁力、熱、電圧及び光から選ばれる少なくとも1つである<10>〜<12>の何れか1項に記載の方法。
<14> 前記圧電材料は、ポリフッ化ビニリデン系樹脂、ポリアミノボラン系樹脂、ポリシアン化ビニリデン系樹脂、ポリウレア系樹脂、ポリ乳酸樹脂、及びナイロン樹脂から選ばれる少なくとも1つである<10>〜<13>の何れか1項に記載の方法。
<15> 前記導電性材料は、ポリチオフェン系樹脂である<10>〜<14>の何れか1項の何れか1項に記載の方法。
<16> 前記導電性層は、黒リン原子膜である<10>に記載の方法。
<17> <1>〜<7>の何れか1項に記載の半導体材料を有するスイッチング素子。
<18> <1>〜<7>の何れか1項に記載の半導体材料と、
前記半導体材料の圧電層の側に配置されたゲート電極と、
前記半導体材料の導電性層に電気的に接続されるソース電極及びドレイン電極と、
を有し、
前記ゲート電極に電圧を印加したときに、前記ドレイン電極及び前記ソース電極が、前記導電性層を介して電気的に接続されるスイッチング素子。
また、本発明によれば、外部から電圧印加せずに導電性層にキャリアが生じる半導体材料を備えたスイッチング素子が提供される。
本発明の半導体材料は、圧電材料を含む圧電層と、導電性材料を含み、圧電層に接触させて又は他の層を介して設けられた導電性層と、を有し、圧電層に外部刺激を付与することで生じた分極によって導電性層にキャリアが生じる。
本発明では、以下の理由により導電性層にキャリアが生じると推察される。
まず、外部刺激によって、圧電層に歪みが生じ、その歪みに応じて圧電分極(圧電効果)が生じる。次いで、圧電分極によって圧電層の導電性層の側(好ましくは導電性層との界面付近)に正又は負の分極が誘起される(つまり正又は負の電荷が誘起される)。なお、圧電分極によって圧電層の導電性層の側に誘起される分極(正又は負)の選択は、圧電材料の選択により行うことができる。
これにより、導電性層の圧電層の側に、前記正又は負の電荷とは反対の符号を持つキャリアが引き寄せられる。この結果、導電性層にキャリアとしての電子又は正孔が生じる。このようにして本発明の半導体材料は、n型半導体材料又はp型半導体材料となる。
さらに、圧電材料として強誘電体を用いた場合、圧電層には圧電材料の自発分極も生じるため、導電性層に前記正又は負の電荷とは反対の符号を持つキャリアがより引き寄せられる。この結果、導電性層に電子又は正孔がより生じやすくなる。
物理力としては、例えば、圧力、振動、引っ張り力、圧縮力、曲げ力、せん断力、回転力が挙げられる。
なお、前記外部刺激は、さらに外部から電圧印加する刺激を含んでもよい。
D:電束密度[C/m2]
ε:誘電率[F/m]
E:電界[V/m]
P:自発分極[C/m2]
e:圧電定数[C/m2]
x:歪み[−]
本発明は、上記式(1)の右辺第2項、及び右辺第3項の2つの分極に着目し、右辺第3項の「圧電層の歪みxに応じた圧電分極ex」を利用して、好ましくは右辺第2項の「圧電材料の自発分極P」と組み合わせて、導電性層に誘起される電束密度D(つまり導電性層のキャリア密度)を調整する。
このように導電性層のキャリア密度を調整することは、半導体材料の導電性能(熱電層を有する場合は熱電性能)を向上させる上で有効である。また、半導体の性質を最適化する上でも有効である。さらに、本発明は、上記「圧電分極ex」を、外部から電圧印加せずに外部刺激を用いて生じさせるため、低消費電力の観点からも有効である。
なお、導電性層のキャリア密度の調整においては、本発明の目的を損なわない限りにおいて、上記式(1)の右辺第1項の電界効果を利用して、導電性層のキャリア密度を調整してもよい。
本発明では、半導体材料をこのような「単一構造体」とすることで、導電性層にキャリアが生じやすくなる。より詳細には、上記「圧電分極ex」(既述の式(1)の右辺第3項参照)によって圧電層の導電性層の側に正又は負の分極が誘起され、導電性層に前記正又は負の電荷とは反対の符号を持つキャリアが引き寄せられる。これにより、導電性層にキャリアが生じやすくなる。
さらに、本発明の半導体材料では、上記「圧電分極ex」を外部刺激によって生じさせる。これにより、低消費電力で導電性層にキャリアが生じる。また、導電性層にキャリアが生じることで導電性層のキャリア密度が調整される。
以上のことから、本発明によれば、低消費電力で、かつ導電性能(熱電層を有する場合は熱電性能)が向上した半導体材料が実現される。
また、本発明では、圧電材料として強誘電体を用いた場合、圧電層に生じる分極は、上記「圧電分極ex」と、圧電材料の「自発分極P」(既述の式(1)の右辺第2項参照))の双方となる。これにより、導電性層に引き寄せられるキャリア数が増えるため(つまり導電性層に生じるキャリア数が増えるため)、導電性層のキャリア密度の調整が容易になる。この結果、導電性能(熱電層を有する場合は熱電性能)がさらに向上した半導体材料が実現される。
圧電層と導電性層との間に他の層が設けられる場合、他の層としては、本発明の目的を損なわない限りにおいて制限されないが、例えば金属層が挙げられる。
さらに、本発明では、導電性層(導電性層が熱電性能を有する場合は熱電層)にキャリアとして電子が生じる場合には、一般的に難しいとされているn型導電性層(導電性層が熱電性能を有する場合はn型熱電層)の作製、つまりn型半導体の作製も実現可能となる。
・圧電層の歪みxに応じた圧電分極ex(既述の式(1)の右辺第三項参照)
本実施形態では、圧電層に外部刺激を付与することで、圧電層に歪みxが生じ、その歪みxに応じた圧電分極exが発生する。
「圧電層の歪みxに応じた圧電分極ex」の測定は以下のように行う。
圧電層(例えば圧電性フィルム)からなる試験片を準備して、試験片の両面に電極(導電層)を形成し、さらに、電極の両面にチャージアンプを形成する。
次いで、電極及びチャージアンプが形成された前記試験片の電荷量Q1(以下「初期の電荷量Q1」と称する)を測定する。
次いで、前記試験片に対し、圧電層の面外方向、面内方向、せん断方向に対し、外部刺激を付与して圧電層に歪みxを生じさせる。この際に圧電層の歪みxとして測定される歪み(有効な歪み)は、圧電層に含まれる圧電材料の結晶対称性によって決定される力学テンソルに基づいて決定される。
その後、初期の電荷量Q1と同様の方法により、圧電層に歪みxが生じたときに発生する圧電層の電荷量Q2(以下「歪みが生じたときの電荷量Q2」と称する)を測定する。
次いで、歪みが生じたときの電荷量Q2と初期の電荷量Q1との差を算出することにより、「圧電層の歪みxに応じた圧電分極ex」に相当する電荷量Q3を求める。
電荷量Q3と、圧電分極exとの関係は、以下の式(2)で表されるため、式(2)を用いて、「圧電層の歪みxに応じた圧電分極ex」が求められる。
Dex:電束密度[C/m2]
Q3:歪みxに応じた圧電分極exに相当する電荷量[C]
S:電極面積[m2]
e:圧電定数[C/m2]
x:歪み[−]
よって、上述の方法により、圧電層の圧電材料、厚み、ポーリング処理の有無、外部刺激の種類等を変えたときの「圧電層の歪みxに応じた圧電分極ex」を予め測定しておくことで、導電性層(導電性層が熱電性能を有する場合は熱電層)に生じるキャリア数(導電性層のキャリア密度)を推測することが可能となる。
本実施形態では、圧電材料が強誘電体の場合、圧電層に圧電材料の自発分極Pが発生する。
圧電材料の自発分極Pの測定は以下のように行う。
圧電層(例えば圧電性フィルム)からなる試験片を準備して、試験片の両面に電極(導電層)を形成し、さらに、電極の両面にチャージアンプを形成する。
次いで、電極及びチャージアンプが形成された前記試験片の電荷量Qを測定し、自発分極Pに相当する電荷量Qを測定する。
自発分極Pに相当する電荷量Qと、自発分極Pとの関係は、以下の式(3)で表されるため、式(3)を用いて、自発分極Pが求められる。
DP:電束密度[C/m2]
Q:自発分極Pに相当する電荷量[C]
S:電極面積[m2]
P:自発分極[C/m2]
なお、自発分極Pは、圧電層に対し、ポーリング処理(分極処理)を施すことで、その大きさを調整することができる。
よって、上述の方法により、圧電層の圧電材料、厚み、ポーリング処理の有無及びポーリング処理の条件等を変えたときの「自発分極P」を予め測定しておくことで、導電性層(導電性層が熱電性能を有する場合は熱電層)に生じるキャリア数(導電性層のキャリア密度)を推測することが可能となる。
圧電層は圧電材料を含む。
圧電材料としては、特に制限されないが、強誘電体であることが好ましい。これにより、圧電層に圧電材料の自発分極が生じるため、上記DPを高めることができ、導電性層(導電性層が熱電性能を有する場合は熱電層)にキャリアがより生じやすくなる。これにより、導電性層(導電性層が熱電性能を有する場合は熱電層)のキャリア密度を調整しやすくなる。
圧電材料は、有機圧電材料であっても無機圧電材料であってもよいが、圧電層の変形のしやすさの観点から、有機圧電材料であることが好ましい。圧電材料は、1種類単独で用いてもよいし、2種以上を併用してもよい。
フッ化ビニリデンと他のモノマーとを共重合させた共重合体としては、フッ化ビニリデン(VDF)と三フッ化エチレン(TrFE)との共重合体(VDF/TrFE);フッ化ビニリデン(VDF)と四フッ化エチレン(TeFE)との共重合体(VDF/TeFE);などが挙げられる。ポリフッ化ビニリデン系樹脂の中でも、自発分極が生じやすくなる観点からフッ化ビニリデンの単独重合体(ポリフッ化ビニリデン(PVDF))、フッ化ビニリデン(VDF)と三フッ化エチレン(TrFE)との共重合体(VDF/TrFE)が好ましい。
ポリアミノボラン系樹脂としては、アミノボランの単独重合体(ポリアミノボラン(PAB))、又はアミノボランと他のモノマーとを共重合させた共重合体が挙げられる。
アミノボランと他のモノマーとを共重合させた共重合体としては、ポリアミノジフルオロボラン(PADFB)などが挙げられる。
ポリシアン化ビニリデン系樹脂としては、シアン化ビニリデンの単独重合体(ポリシアン化ビニリデン(PVDCN))、又はシアン化ビニリデンと他のモノマーとを共重合させた共重合体が挙げられる。
シアン化ビニリデンと他のモノマーとを共重合させた共重合体としては、シアン化ビニリデン(VDCN)と酢酸ビニル(Vac)との共重合体(VDCN/Vac);シアン化ビニリデン(VDCN)と三フッ化エチレン(TrFE)と1−クロロ−1−フルオロエチレン(CFE)との共重合体(VDCN/TrFE/CFE);などが挙げられる。
ポリウレア系樹脂としては、ポリウレア樹脂、ポリチオウレア樹脂などが挙げられる。
ポリ乳酸樹脂としては、L型ポリ乳酸樹脂(PLLA)、D型ポリ乳酸樹脂(PDLA)などが挙げられる。
ナイロン樹脂としては奇数ナイロンが好ましい。奇数ナイロンとしては、ナイロン5、ナイロン7、ナイロン9、ナイロン11、ナイロン13などが挙げられる。
圧電層の厚みは、外部刺激による変形のしやすさ、及び導電性層(導電性層が熱電性能を有する場合は熱電層)へのキャリアの発生のしやすさの観点から、例えば、0.01μm以上1000μm以下が好ましく、0.1μm以上300μm以下がより好ましく、1μm以上100μm以下がさらに好ましい。
圧電層の作製方法としては、従来一般的に用いられている公知の方法が適宜使用できる。例えば、圧電層を塗布法で作製する場合、圧電層を作製するための材料(圧電材料、必要に応じて添加剤等)を溶媒に分散または溶解した塗布液(圧電層作製用塗布液)を、例えば基材上に塗布することで作製することができる。
塗布液の塗布方法としては、例えばスピンコート法、ディップコート法、スプレーコート、インクジェット法、キャスト法、スクリーン印刷法が挙げられる。
また、圧電層を作製するための材料(圧電材料、必要に応じて添加剤等)を混練して組成物を作製し、この組成物を押出成形法、射出成形法、延伸成形法、圧縮成形法等の公知の方法により成形してもよい。
なお、圧電層は市販品(例えば圧電性フィルム)を使用してもよい。
導電性層は導電性材料を含む。
導電性材料は、圧電分極の状態(負の分極又は正の分極)に応じて適宜選択することが好ましい。導電性材料としては、導電性層にキャリアが生じることにより導電性能(熱電層を有する場合は熱電性能)を発現するものであれば特に制限されない。導電性能を発現する導電性材料としては、例えば無機材料、有機材料、有機−無機ハイブリッド材料が挙げられる。
無機材料としては、例えば無機半導体;無機導電性高分子;Bi−Te系、Co−Sb系、Zn−Sb系、Pb−Te系、Ag−Sb−Ge−Te系、Mg−Si系、酸化物系、硫化物系等の化合物;が挙げられる。また、無機材料として、カーボン材料(カーボンナノチューブ(シングル・マルチ・ウォールいずれでもよい)、グラフェン・酸化グラフェン等を用いてもよい。
また、無機材料として黒リンを用いてもよい。無機材料が黒リンの場合、導電性層は黒リン原子膜であることがよい。黒リン原子膜の詳細については後述する。
有機材料としては、例えば有機半導体、有機導電性高分子が挙げられる。
有機−無機ハイブリッド材料としては、ポリ(3,4−エチレンジオキシチオフェン)及びポリスチレンスルホン酸の混合樹脂(PEDOT/PSS)とカーボンナノチューブとの有機−無機ハイブリッド材料;ポリ(3,4−エチレンジオキシチオフェン)及びポリスチレンスルホン酸の混合樹脂(PEDOT/PSS)とBi−Te系ナノ粒子との有機−無機ハイブリッド材料;等が挙げられる。
これらの導電性材料は、1種類単独で用いてもよいし、2種以上を併用してもよい。
導電性材料の中でも、導電性能(熱電層を有する場合は熱電性能)がより向上する観点から、半導体、導電性高分子が好ましい。
また、半導体及び導電性高分子は、熱電変換する熱電材料であることが好ましい。これにより、熱電性能がさらに向上した半導体材料が実現される。
以下、半導体、導電性高分子について順に説明する。
半導体は、有機半導体であっても、無機半導体であってもよく、またp型半導体又はn型半導体であってもよい。中でも、柔軟性を確保する観点から、有機半導体であることが好ましい。
p型の有機半導体の中でも、導電性層(導電性層が熱電性能を有する場合は熱電層)にキャリアとしての正孔が生じやすくなる観点から、ポリチオフェン系樹脂が好ましく、特に、ポリ(3,4−エチレンジオキシチオフェン)(PEDOT);ポリ(3,4−エチレンジオキシチオフェン)/ポリスチレンスルホン酸(PEDOT/PSS);ポリ(3,4−エチレンジオキシチオフェン)/p−トルエンスルホン酸(PEDOT/TOS);ポリ(3,4−エチレンジオキシチオフェン)/ポリビニルスルホン酸(PEDOT/PVS);が好ましい。なお、ポリチオフェン系樹脂のドーパントは特に制限されない。
フラーレン系化合物としては、C60フラーレン、C70フラーレン、C76フラーレン、C78フラーレン、C84フラーレン、C240フラーレン、C540フラーレン、ミックスドフラーレン、フラーレンナノチューブ、およびこれらの一部が水素原子、ハロゲン原子、アルキル基、アルケニル基、アルキニル基、アリール基、ヘテロアリール基、シクロアルキル基、シリル基、エーテル基、チオエーテル基、アミノ基、シリル基等によって置換されたフラーレン誘導体を挙げることができる。
導電性高分子は、有機導電性高分子であっても、無機導電性高分子であってもよい。導電性高分子としては、例えばアニリン系化合物、ピロール系化合物、パラフェニレン系化合物、アセン系化合物、アセチレン系化合物、p−フェニレンエチニレン系化合物、p−フルオレニレンビニレン系化合物、ポリアセン系化合物、ポリフェナントレン系化合物、p−キシリレン系化合物、ビニレンスルフィド系化合物、m−フェニレン系化合物、ナフタレンビニレン系化合物、p−フェニレンオキシド系化合物、フェニレンスルフィド系化合物、フラン系化合物、セレノフェン系化合物、アゾ系化合物、金属錯体系化合物、これらの共重合体等が挙げられる。
無機材料が黒リンの場合、導電性層は黒リン原子膜であることがよい。また。黒リン原子膜は、熱電層であることが好ましい。
このようにして得られる黒リンの原子膜(単原子膜又は多層原子膜)を、圧電層上に、圧電層と接触させて又は他の層を介して設けることにより、導電性層と圧電層とを有する積層体を得ることができる。
黒リン原子膜が単原子膜である場合、単原子膜の結晶構造の伸張の度合いは、好ましくは2%〜10%、より好ましくは4%〜10%である。この範囲であると、熱電変換性能が向上する。伸張の度合いが10%以下であると、黒リン単原子膜に破れや亀裂が生じにくい。
また、黒リン原子膜が2層以上の黒リン多層原子膜の場合でも、黒リン単原子膜と同様に、ジグザグ軸方向及びアームチェア軸方向の少なくとも一方に対して、2%〜10%伸張させることが可能である。但し、黒リン原子膜が多層原子膜である場合には、同じ伸張率に伸張させるための応力を要するため、その伸張度合いは、好ましくは2%〜8%未満の範囲であり、より好ましくは2%〜6%の範囲である。また、伸張のし易さの点で、多層原子膜の層数は、好ましくは2層以上6層以下、より好ましくは2層以上4層以下である。
バルクの黒リンから剥離した黒リン単原子膜は、図13A〜図13Cに示すような結晶構造を形成している。図13Cは、黒リン単原子膜の結晶構造の平面図である。また、図13Aは、図13Cのアームチェア軸方向に沿って切断した結晶構造の断面図であり、図13Bは、図1Cのジグザグ軸方向に沿って切断した結晶構造の断面図である。
なお、図13A〜図13Cにおいて、(z)は、アームチェア軸方向及びジグザグ軸方向に対して垂直な軸方向を表す。
ここで、図13Cにおいて、a辺とb辺で囲まれた領域を結晶構造中の単位胞(以下、「ユニットセル」ということがある)という。また、黒リン単原子膜は2つの結晶軸を有しており、本明細書において、a辺に沿う方向と平行な結晶軸方向をジグザグ軸方向(Zigzag direction)、及びb辺に沿う方向と平行な結晶軸方向をアームチェア軸方向(Armchair direction)という。
一般に、熱電材料の性能を評価するための指標として、性能指数Zが使用される。性能指数Zが高いほど、熱電変換性能が高い材料である。ここで、Zは以下の式Aによって表される。また、式A中のPはパワーファクター(熱電出力因子)であり、以下の式Bによって表される。なお、式Bにおいて、Sはゼーベック係数、σは電気伝導率を表し、式Aにおいて、λは熱伝導率を表す。
未伸張の黒リン単原子膜に比べて、伸張された結晶構造を有する黒リン単原子膜のパワーファクターが向上する。これにより、伸張した結晶構造を有する伸張された結晶構造を有する黒リン単原子膜は、熱電材料として優れた性能を示す。また、伸張率によって、パワーファクターに変化がみられることから、伸張度合いに応じて熱電変換性能を変調できる。
伸張された結晶構造を有する2層の黒リン多層原子膜の場合も、未伸張の場合に比べて、パワーファクターが向上することがわかる。これにより、伸張した結晶構造を有する黒リン原子膜は、2層以上の多層原子膜の場合であっても、熱電材料として優れた性能が得られる。また、2層の黒リン多層原子膜は、単原子膜の場合と同様に、伸張率によって、パワーファクターに変化がみられることから、伸張度合いに応じて熱電変換性能変調できる黒リン原子膜が得られる。したがって、黒リン多層原子膜も、黒リン単原子膜と同様の使用方法が期待される。
したがって、導電性層として黒リン原子膜(単原子膜、多層原子膜のいずれも)を適用した半導体材料においては、以下の作用が生じると考えられる。
まず、圧電層に外部刺激を付与することで生じた分極によって、黒リン原子膜にキャリアが生じる。特に外部刺激が物理力の場合は、物理力の付与によって黒リンの結晶構造はジグザグ軸方向及びアームチェア軸方向の少なくとも一方に伸張されるので、黒リン原子膜には、圧電材料の分極により生じたキャリアと、黒リン原子膜の伸張により生じたキャリアの双方が発生する。これにより、導電性層として黒リン原子膜を適用した半導体材料では、黒リン原子膜に生じるキャリア量を、圧電材料の分極及び黒リン原子膜の伸張の双方から調整することができる。その結果、少ない力で大きな電流を得られやすくなり、ゼーベック係数が増加しやすくなる。
また、黒リン原子膜が黒リン単原子膜である場合、この単原子膜を例えばジグザグ軸方向に伸張させると、単原子膜のユニットセルにおけるa辺の格子定数aが伸びるとともに、b辺の格子定数bが縮まるので(国際公開第2016/056661号公報の表1参照)、導電性層に生じたキャリアが移動しやすくなり、ゼーベック係数が増加しやすくなる。
したがって、圧電層と黒リン原子膜との積層構造を有する半導体材料では、圧電層への外部刺激と黒リン原子膜の伸張の双方を利用して黒リン原子膜にキャリアを生じさせるので、かかる半導体材料を、例えば熱電変換素子に搭載した場合には、熱電変換性能の向上が期待され、スイッチング素子に搭載した場合には、電流のスイッチング機能の向上が期待される。
導電性層(黒リン原子膜以外の導電性層)の総厚みは、キャリアが生じやすくなる観点から、例えば、0.00034μm以上100μm以下が好ましく、0.00034μm以上1μm以下がより好ましく、0.001μm以上0.01μm以下がさらに好ましい。
導電性層が黒リン原子膜(単原子膜、多層原子膜のいずれも)である場合の導電性層の総厚みは、キャリアの生じやすさ及び伸張のしやすさの観点から、例えば、0.00036μm以上100μm以下が好ましく、0.00036μm以上1μm以下がより好ましく、0.00036μm以上0.01μm以下がさらに好ましい。
上述のように、半導体材料の導電性能(熱電層を有する場合は熱電性能)を向上させるためには、導電性層(導電性層が熱電性能を有する場合は熱電層)のキャリア密度を特定の範囲となるように調整することが好ましい。導電性層のキャリア密度は、キャリア面密度として、例えば、1013/cm2以上1015/cm2未満が好ましい。
導電性層(黒リン原子膜以外の導電性層であって、導電性層が熱電性能を有する場合は熱電層)を作製する方法としては、圧電層と同様の方法が挙げられる。
なお、導電性層は市販品(例えば導電性フィルム、熱電性フィルム)を使用してもよい。
また、導電性層が黒リン原子膜である場合における導電性層の作製方法は前述の通りである。なお、黒リン原子膜は市販品であってもよい。
本実施形態に係る半導体材料は、基材を有してもよい。この態様の場合、圧電層は基材上に形成されるため、外部刺激による圧電層の変形は基板と共に生じることとなる。よって、例えば、基板として柔軟性を有する部材を用いることで、圧電層の変形が生じやすくなり、圧電分極(圧電効果)が生じやすくなる。
また、半導体材料が基材を有する態様の場合、基材の変形によって圧電層が変形してもよい。つまり、基材の変形によって圧電層が二次的に変形を促されて変形してもよい。
基材としては、外部刺激によって変形を生じるものであれば特に制限されず、無機材料であっても有機材料であってもよい。
無機材料としては、例えば、多結晶Si、アモルファスSiおよびSiO2、Si3N4、SiCなどのSi化合物;Al2O3、ZrO2、TiO2、Ta2O5、ZnO、Y2O3などの酸化物;AlN、TiNなどの窒化物;これらの複合化合物;が挙げられる。
また、外部刺激が電圧である場合、基材としては、電気伝導性材料を含有してもよい。電気伝導性材料としては、例えば、金属、金属化合物(例えばインジウムスズ酸化物(ITO)、酸化亜鉛)が挙げられる。
また、外部刺激が光である場合、液晶材料を含有する基材用いて液晶の体積変化により基材を変形させてもよい。
上述のように、導電性層(導電性層が熱電性能を有する場合は熱電層)に求められる最適なキャリア密度は、キャリア面密度として、好ましくは1013/cm2以上1015/cm2未満である。
キャリア面密度を前記範囲に調整しやすい圧電材料としては、以下の有機圧電材料、無機圧電材料がよい。
・PVDF:ポリフッ化ビニリデン
・VDF/TrFE:フッ化ビニリデンと三フッ化エチレンとの共重合体
・VDF/TeFE:フッ化ビニリデンと四フッ化エチレンとの共重合体
・PAB:ポリアミノボラン
・PADFB:ポリアミノジフルオロボラン
・VDCN/Vac:シアン化ビニリデンと酢酸ビニルとの共重合体
・VDCN/TrFE/CFE:シアン化ビニリデンと三フッ化エチレンと1−クロロ−1−フルオロエチレンとの共重合体
・Polyurea:ポリウレア
・PLLA:L型ポリ乳酸
・Odd−Nylon:奇数ナイロン
・PZT:チタン酸ジルコン酸鉛
・BiFeO3:鉄酸ビスマス
・LiNbO3:ニオブ酸リチウム
・BaTiO3:チタン酸バリウム
・KH2PO4:リン酸二水素カリウム
・PMN−PT:マグネシウム酸ニオブ酸チタン酸鉛
・KNN:ニオブ酸カリウムナトリウム
導電性層が黒リン原子膜以外である場合、半導体材料の厚みは、外部刺激による変形のしやすさ、及び導電性層(導電性層が熱電性能を有する場合は熱電層)へのキャリアの発生のしやすさの観点から、例えば、0.00034μm以上100μm以下が好ましく、0.00034μm以上10μm以下がより好ましい。
導電性層が黒リン原子膜(単原子膜、多層原子膜のいずれも)である場合、半導体材料の厚みは、外部刺激による変形のしやすさ、導電性層(導電性層が熱電性能を有する場合は熱電層)へのキャリアの発生のしやすさ、及び黒リン原子膜伸張のしやすさの観点から、例えば、0.00036μm以上100μm以下が好ましく、0.00036μm以上1μm以下がより好ましい。
なお、半導体材料の厚みとは、半導体材料が、例えば基材を含む場合は基材を含む厚みをいう。つまり、上記半導体材料の厚みとは、半導体材料の総厚みのことをいう。
図1に、キャリア発生前の半導体材料を示す。
図1に示すように、キャリア発生前の半導体材料10aは、圧電材料を含む圧電層12aと、熱電材料を含み、圧電層12aに接触して設けられた熱電層14aと、を有する。
また、半導体材料10aは、圧電層12aに外部刺激が付与されると、圧電層12aに歪みが生じ、その歪みにより圧電分極(圧電効果)が生じる。次いで、生じた圧電分極によって、熱電層14aにキャリアが生じるように構成されている。
図2に示すように、本実施形態の半導体材料10は、半導体材料10Aと半導体材料10Bとからなる一対の半導体材料で構成されている。
具体的には、図3に示すように、半導体材料10Aは、外部刺激によって、圧電層12Aに生じた圧電分極によって圧電層12Aの熱電層14Aの側に正の分極が誘起され、この結果、熱電層14Aにキャリアとしての電子が引き寄せられて生じたものである。つまり、半導体材料10Aはn型半導体材料である。
一方、図4に示すように、半導体材料10Bは、外部刺激によって、圧電層12Bに生じた圧電分極によって圧電層12Bの熱電層14Bの側に負の分極が誘起され、この結果、熱電層14Bにキャリアとしての正孔が引き寄せられて生じたものである。つまり、半導体材料10Bはp型半導体材料である。
このように、第1実施形態の半導体材料10は、n型半導体材料10Aと、p型半導体材料10Bと、を少なくとも一対有するため、例えば、後述する発電装置の熱電変換モジュールを構成する半導体(熱電変換素子の第2実施形態);後述する熱電変換素子を構成する半導体(熱電変換素子の第1実施形態及び第3実施形態);各種センサーの温度検出、応力検出;無線モジュール;等に適用することができる。
−半導体材料の作製方法−
第1実施形態の半導体材料の作製方法は、塗布法により圧電層と熱電層(但し、黒リン原子膜以外の熱電層)とを積層させることで半導体材料を得る。以下、図5を参照して説明する。
まず、基材16を準備する。
次いで、圧電材料と、必要に応じて添加剤等とを溶媒に分散または溶解させた圧電層作製用塗布液を調製する。また、並行して、熱電材料と、必要に応じて添加剤等とを溶媒に分散または溶解させた熱電層作製用塗布液を調製する。
次いで、図5Aに示すように、圧電層作製用塗布液を基材16上に塗布して当該塗布液を乾燥させる。これにより、圧電層12aを得る。
次いで、図5Bに示すように、熱電層作製用塗布液を圧電層12a上に塗布して当該塗布液を乾燥させる。これにより、熱電層14aを得る。
このようにして、基材16と、圧電層12aと、熱電層14aとをこの順に有する半導体材料10aを作製する。
まず、基材16を準備する。
次いで、圧電材料と、熱電材料と、必要に応じて添加剤等とを溶媒に分散または溶解させた塗布液(以下「圧電熱電層作製用塗布液」と称する)を調製する。なお、圧電熱電層作製用塗布液は、上述のように、圧電層を作製するための材料(圧電材料、必要に応じて添加剤等)と、熱電層を作製するための材料(熱電材料、必要に応じて添加剤等)とを一括して混合して得た塗布液であってもよいし、圧電層作製用塗布液と、熱電層作製用塗布液とをそれぞれ調製し、これらを混合して得た塗布液であってもよい。
次いで、図6Aに示すように、圧電熱電層作製用塗布液を基材16上に塗布して混合層(以下「圧電熱電層前駆体膜」とも称する)18を作製し、圧電熱電層前駆体膜18を乾燥させる。
図6Bに示すように、圧電熱電層前駆体膜18を乾燥させる過程において、圧電熱電層前駆体膜18は、圧電層12aと熱電層14aとに二層分離する。
このようにして、基材16と、圧電層12aと、熱電層14aとをこの順に有する半導体材料10aを作製する。
また、圧電熱電層前駆体膜を、圧電層と熱電層とを二層分離しやすくするためには、圧電熱電層前駆体膜の乾燥条件(乾燥雰囲気、温度、時間等)を調整すればよい。
また、上記形態で得られた半導体材料には、圧電層にポーリング処理(分極処理)を施すことが好ましい。分極処理により圧電材料の分極の向きが揃えられるため、圧電層に自発分極が生じる。この場合、圧電層の熱電層の側に正又は負の分極が誘起されやすくなるため、熱電層にキャリアとしての電子又は正孔がより引き寄せられる。これにより、熱電層にキャリアがより生じやすくなり、熱電層のキャリア密度の調整が容易になる。
まず、入手した圧電性フィルムに分極処理を施す。
分極処理により圧電性フィルムの表面に正の分極が誘起された場合、正の分極が誘起された圧電性フィルムの表面に、別途調製した熱電層作製用塗布液を塗布し、当該塗布液を乾燥させて熱電層を作製する。これにより、キャリア発生前のn型半導体材料が得られる。
一方、分極処理により圧電性フィルムの表面に負の分極が誘起された場合、負の分極が誘起された圧電性フィルムの表面に、別途調製した熱電層作製用塗布液を塗布し、当該塗布液を乾燥させて熱電層を作製する。これにより、キャリア発生前のp型半導体材料が得られる。
また、熱電層は、入手した熱電性フィルムであってもよい。この場合、圧電性フィルムに必要に応じて分極処理を施した後、圧電性フィルムの一方の面に熱電性フィルムを貼り合わせるだけでキャリア発生前のn型半導体材料又はp型半導体材料が得られる。
本発明の半導体材料は、圧電層に外部刺激を付与することで生じた分極によって導電性層にキャリアが生じるので、その生じたキャリアを利用する用途に用いることができる。例えば、半導体材料の導電性層の面方向に温度差を設けることによって、導電性層に生じた起電力を取り出す熱電変換素子又は熱電変換素子用スイッチング素子に搭載して利用することができる。また、導電性層に生じた上記起電力を利用する各種デバイス(各種センサー、無線モジュール等)又は各種デバイス用スイッチング素子に搭載して利用することもできる。
−発電用途のスイッチング素子−
以下の使用方法により、発電量を切り替えることができる発電用途のスイッチング素子が実現され得る。
例えば、外気の方が暖かい夏の場合と、外気の方が寒い冬の場合では、室内との温度差を活用した熱電変換素子の発電電圧の極性が反転することが知られている。この外環境の変化(例えば温度変化)に応じて所定の量のキャリアを導電性層に注入することによって、夏でも冬でも正電圧で一定して出力することができるようになる。
以下の使用方法により、ヒーターやクーラーの使い方を切り替えることができる加熱冷却用途のスイッチング素子が実現され得る。
例えば、外部刺激として正電圧を印加して加熱動作している場合に、その加熱動作を導電性層へのキャリア注入によって冷却動作に切り替えることができる。この場合、外部刺激として負電圧を印加すれば冷却動作が可能になるとも考えられるが、負電圧が活用できない環境下も想定される。このような環境下(正負両極の電圧が活用できない環境下)では特に有用な作用である。
本発明の導電性層にキャリアを生じさせる方法は、圧電材料を含む圧電層と、導電性材料を含み、圧電層に接触させて又は他の層を介して設けられた導電性層と、を有する半導体材料に対し、圧電層に外部刺激を付与することにより分極を生じさせ、生じた分極によって導電性層にキャリアを生じさせる。
外部刺激とは、圧電層を変形させるために外部から付与される刺激をいう。外部刺激としては、既述の半導体材料の圧電層に付与される外部刺激と同様のものが挙げられる。
なお、前記外部刺激は、さらに外部から電圧印加する刺激を含んでもよい。
半導体材料の構成(圧電層及び導電性層等の構成)は、既述の半導体材料の構成と同様である。
圧電材料としては、既述の圧電層に用いられる圧電材料と同様のものが挙げられ、好ましい例も同様のものが挙げられる。
導電性材料としては、既述の導電性層に用いられる導電性材料と同様のものが挙げられ、好ましい例も同様のものが挙げられる。
また、上記方法における導電性層は、黒リン原子膜である態様も含む。黒リン原子膜は、熱電層であることが好ましい。なお、導電性層が黒リン原子膜である態様は既述の態様と同様である。
図7Bに示すように、圧力Fが、半導体材料に対してその垂直方向から加えられると、半導体材料が変形する。この半導体材料の変形に伴い、基材、圧電層及び熱電層も変形する。つまり、圧電層に歪みが生じる。
次いで、圧電層の歪みにより圧電層に12Aに圧電分極が生じ、生じた圧電分極によって圧電層12Aの熱電層14Aの側に正の分極が誘起される。これにより、熱電層14Aにキャリアとしての電子が引き寄せられる。
このようにして、熱電層14Aにキャリアとして電子が生じ、半導体材料10Aはn型半導体材料となる。
また、上記実施形態において、圧電分極や自発分極によって熱電層にキャリアとして正孔が生じた場合、半導体材料はp型半導体材料となる。
また、上記実施形態では、圧力Fによって、基材16、圧電層12a及び熱電層14aが共に変形する態様を説明したが、少なくとも圧電層12aが変形すればよい。
本発明の熱電変換素子は、本発明の半導体材料を有する。
また、本発明の熱電変換素子は、本発明の半導体材料の少なくとも一対を有することが好ましい。具体的には、一対の半導体材料の一方は、導電性層に電子が生じるn型半導体であり、一対の半導体材料の他方は、導電性層に正孔が生じるp型半導体であることが好ましい。
本発明の熱電変換素子は、外部から電圧印加せずに導電性層(導電性層が熱電性能を有する場合は熱電層)にキャリアが生じるため、低消費電力で駆動し、かつ導電性能(熱電層を有する場合は熱電性能)が向上した熱電変換素子となる。また、本発明の熱電変換素子は、本発明の「単一構造体」で構成される半導体材料を有するため、デバイスの小型化も図れる。
なお、本発明の半導体材料は、圧電層に外部刺激を付与することで生じた圧電分極によって導電性層(導電性層が熱電性能を有する場合は熱電層)にキャリアが生じるものであるが、前記外部刺激は、さらに外部から電圧印加する刺激を含んでもよい。
以下、図2〜図4を参照して、本発明の熱電変換素子の第1実施形態について具体的に説明する。第1実施形態では、「導電性層」が「熱電材料を含む熱電層」である場合である。但し、本発明においては、以下に示す実施形態に制限されるものではない。
第1実施形態の熱電変換素子は、図2に示すように、前記n型半導体材料10A及び前記p型半導体材料10Bからなる一対の半導体材料10と、n型半導体材料10Aの熱電層14A上に配置された配線(図示省略)と、p型半導体材料10Bの熱電層14B上に配置された配線(図示省略)と、を有する。
このような構成の熱電変換素子は、n型半導体材料10A及びp型半導体材料10Bの長手方向の一方の側を高温側とし、n型半導体材料10A及びp型半導体材料10Bの長手方向の前記一方の側とは反対の他方の側を低温側とすることで、n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端に温度差が生じ、ゼーベック効果により起電力が生じる。
また、一対の半導体材料10に外部刺激を付与すると、圧電分極が生じ、生じた圧電分極によって、n型半導体材料10Aでは圧電層12Aの熱電層14Aの側に正の分極が誘起され、熱電層14Aにキャリアとしての電子が引き寄せられる。これにより、熱電層14Aにキャリア(電子)が生じる。
同様にしてp型半導体材料10Bでは圧電層12Bの熱電層14Bの側に負の分極が誘起され、熱電層14Bにキャリアとしての正孔が引き寄せられる。これにより、熱電層14Bにキャリア(正孔)が生じる。
この結果、熱電層14A,14Bのキャリア密度が調整され、前記起電力はより大きくなる。前記起電力により生じた電流は、n型半導体材料10Aの熱電層14A上に配置された配線(図示省略)と、p型半導体材料10Bの熱電層14B上に配置された配線(図示省略)とを経て外部に電力として取り出される。
なお、上記第1実施形態では、圧電層の変形をより生じやすくする観点から、n型半導体材料10A及びp型半導体材料10Bを基材上に形成してもよい。
以下、図8及び図9を参照して、本発明の熱電変換素子の第2実施形態について具体的に説明する。第2実施形態の熱電変換素子は、発電装置の半導体モジュールに適用されている。第2実施形態では、「導電性層」が「熱電材料を含む熱電層」であり、外部刺激として圧力Fによって圧電層を変形させる態様について説明する。但し、本発明においては、以下に示す実施形態に制限されるものではない。
まず、半導体モジュール100について説明する。
図8及び図9に示すように、半導体モジュール100は、n型半導体材料10A及びp型半導体材料10Bからなる一対の半導体材料10を複数有する半導体積層体群と、複数の配線22と、基材として基板20A,20Bと、を有する。半導体モジュール100は、第2実施形態の熱電変換素子である。
半導体モジュール100を構成するn型半導体材料10A及びp型半導体材料10Bは、交互に配置され直列に配線されたπ型構造を成しており、n型半導体材料10A及びp型半導体材料10Bの長手方向の両端は、基板20A,20B上において配線22を介してそれぞれ電気的に接続されている。また、基板20B上の端部の配線22には、半導体モジュール100の起電力により生じた電流Iを外部に取り出すための端子24が2つ設けられており、これらの端子24は接合部26により配線22に接合されている(図8及び図9の右側)。
半導体モジュール100は、n型半導体材料10A及びp型半導体材料10Bの長手方向の一方の側が高温側(吸熱側)とされ、n型半導体材料10A及びp型半導体材料10Bの長手方向の前記一方の側とは反対の他方の側が低温側(放熱側)とされ、n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端の温度差(ゼーベック効果)により起電力が生じるように構成されている。
n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端に温度差が生じると、ゼーベック効果により起電力が生じる。
一方、図8及び図9に示すように、半導体モジュール100に対して、垂直方向から外部刺激として圧力Fがかかると、圧電分極(正圧電効果)が生じ、生じた圧電分極によって、n型半導体材料10Aでは圧電層12Aが変形して、圧電層12Aの熱電層14Aの側に正の分極が誘起され、熱電層14Aにキャリアとしての電子が引き寄せられる。これにより、熱電層14Aにキャリア(電子)が生じる。
同様にして、p型半導体材料10Bでは圧電層12Bが変形して、圧電層12Bの熱電層14Bの側に負の分極が誘起され、熱電層14Bにキャリアとしての正孔が引き寄せられる。これにより、熱電層14Bにキャリア(正孔)が生じる。
熱電層14A,14Bに生じたキャリアは、半導体モジュール100に伝熱された熱を、高温側(吸熱側)から低温側(放熱側)に運ぶ役割を担う。このため、熱電層14A,14Bにキャリアが生じることで、n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端に配置された配線22間の温度差はより大きくなり、半導体モジュール100で発生する起電力はより大きくなる。次いで、発生した起電力により電流Iが生じ、生じた電流Iは、図8に示す電流Iの矢印の方向に端子24を経て外部に電力として取り出される。
さらに圧電材料として強誘電体を用いれば、圧電材料の自発分極も生じるため、圧電層12A,12Bの熱電層14A,14Bの側に誘起された正又は負の分極とは反対の符号を持つキャリアが、熱電層14A,14Bにより引き寄せられる。これにより、熱電層14A,14Bにキャリア(電子、正孔)がより生じやすくなり、熱電層14A,14Bのキャリア密度の調整が容易になる。この結果、半導体モジュール(熱電変換素子)100の熱電性能はさらに向上する。
さらに、本実施形態の半導体モジュール100によれば、圧電層12A,12Bと熱電層14A,14Bとを接触して積層させた「単一構造体」からなる半導体材料10A,10Bを複数有することで、構造が複雑にならず、デバイスの小型化が実現される。
図8及び図9に示す発電装置200は、基板20Aが吸熱基板で構成され、基板20Bが放熱基板で構成されている。
このような発電装置200では、基板20A(吸熱基板)が熱源等から吸熱すると、基板20Aの熱は基板20Aから配線22を経て半導体モジュール100に伝熱される。半導体モジュール100では、上述した作用により、n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端に温度差が生じ、ゼーベック効果により起電力が生じる。さらに、基板20B側から、外部刺激として圧力Fがかかると、圧電層に圧電分極(正圧電効果)が生じ、生じた圧電分極によって、上述のように熱電層14A,14Bにキャリアが生じるため、半導体モジュール100で発生する起電力はより大きくなる。
以下、図10を参照して、本発明の熱電変換素子の第3実施形態について具体的に説明する。第3実施形態の熱電変換素子は、プレーナ型の熱電変換素子に適用されている。第3実施形態では、「導電性層」が「熱電材料を含む熱電層」であり、「圧電層」が「強誘電体を含む圧電層」であり、かつ外部刺激として圧力Fによって圧電層を変形させる態様について説明する。但し、本発明においては、以下に示す実施形態に制限されるものではない。
まず、熱電変換素子300について説明する。
図10A及び図10Bに示すように、熱電変換素子300は、n型半導体材料10A及びp型半導体材料10Bが対をなす複数の半導体材料10と、複数の配線30と、を有する。
n型半導体材料10A及びp型半導体材料10Bが対をなす複数の半導体材料10は、直列に接続されており、両端に位置する2つの半導体材料には、外部回路(図示省略)に接続される端子32がそれぞれ設けられている。
また、複数の半導体材料10を構成するn型半導体材料10A及びp型半導体材料10Bは、各々の半導体材料の長手方向の端部において、隣り合う半導体材料のうち、一方の半導体材料と配線30を介して接続されている。つまり、第3実施形態の熱電変換素子300は、複数の半導体材料10が直列に接続されたプレーナ型構造を成している。
このような構成の熱電変換素子300は、複数の半導体材料10が直列に接続された方向と直交する方向の一方の側が高温側とされ、他方の側が低温側とされ、n型半導体材料10A及びp型半導体材料10Bの各々の長手方向の両端に温度差を生じさせること(ゼーベック効果)により起電力が生じるように構成されている。
なお、上記熱電変換素子300では、半導体材料10の長手方向の一方の端部及び他方の端部において、配線30を介さず、n型半導体材料10A及びp型半導体材料10Bの端部同士を直接接続して、n型半導体材料10Aとp型半導体材料10Bとが鋭角に交わる所謂ジグザグ形状を有するプレーナ型構造を構成してもよい。
また、上記熱電変換素子300では、圧電層12A,12Bの変形をより生じやすくする観点から、n型半導体材料10A及びp型半導体材料10Bを基材上に形成してもよい。
一方、図10Bに示すように、熱電変換素子300に対して、垂直方向から外部刺激として圧力Fがかかると、圧電層12A,12Bが変形して、圧電分極(正圧電効果)が生じる。また、第3実施形態では、圧電層が強誘電体を含むため、圧電層12A,12Bに圧電材料の自発分極も生じる。
次いで、これらの分極によって、n型半導体材料10Aでは圧電層12Aの熱電層14Aの側に正の分極が誘起され、熱電層14Aにキャリアとしての電子が引き寄せられる。これにより、熱電層14Aにキャリア(電子)が生じる。
同様にして、p型半導体材料10Bでは圧電層12Bの熱電層14Bの側に負の分極が誘起され、熱電層14Bにキャリアとしての正孔が引き寄せられる。これにより、熱電層14Bにキャリア(正孔)が生じる。
熱電層14A,14Bに生じたキャリア(電子、正孔)は、熱電変換素子300の高温側(吸熱側)の熱を低温側(放熱側)に運ぶ役割を担うため、熱電層14A,14Bにキャリアが生じることで、熱電層14A,14Bの熱電性能は向上する。これにより、熱電変換素子300で発生する起電力はより大きくなる。次いで、発生した起電力により電流が生じ、生じた電流は、外部回路(図示省略)に接続される端子32を経て電力として取り出される。
さらに、熱電変換素子300によれば、n型半導体材料10A及びp型半導体材料10Bが対をなす複数の半導体材料10が直列に接続されたプレーナ型構造を成しているため、熱電変換素子300の形状は、シート状(フィルム状を含む)となる。このような形状の熱電変換素子300は、シート状のまま使用することもできるし、複数の半導体材料10が直列に接続された方向に丸めて円筒状に変形して使用することもできる。
以上のように、第3実施形態では、熱電変換素子300の更なる軽量化かつ小型化が実現可能であり、使用用途の拡大も期待することができる。
本発明のスイッチング素子は、本発明の半導体材料を有する。
本発明のスイッチング素子としては特に制限されないが、例えば、熱電変換素子用スイッチング素子;各種デバイス(各種センサー、無線モジュール等)用スイッチング素子;発電量を切り替えることができる発電用途のスイッチング素子;ヒーターやクーラーの使い方を切り替えることができる加熱冷却用途のスイッチング素子;等が挙げられる。
中でも、熱電変換素子用スイッチング素子が好ましい。
すなわち、上記好ましい形態のスイッチング素子は、電界効果トランジスタ(例えば薄膜トランジスタ(以下、「TFT」とも称する))を備えることが好ましい。また、電界効果トランジスタ自体がスイッチング素子として機能してもよい。電界効果トランジスタは、トップゲート型でも、ボトムゲート型でもよい。
図14に示すように、スイッチング素子400は、基板42と、導電性層14Cと、圧電層12Cとをこの順に備え、導電性層14Cと圧電層12Cとの間には、ソース電極44及びドレイン電極46が所定の間隔を空けて配置されている。
また、スイッチング素子400は、ヒーター(図示省略)によって、ソース電極44の側が、TA℃(高温)に調整され、ドレイン電極46の側がTB℃(低温)に調整されるように構成されている(TA>TB)。
まず、ゲート電極48に、外部刺激として正の電圧が印加されると、その外部刺激によって圧電層12Cに分極が生じ、生じた分極によって、熱電層14Cにキャリアとしての電子が生じる。すなわち、本実施形態では、圧電層12C及び熱電層14Cからなる積層体はn型半導体材料として機能する。
さらに、本実施形態のスイッチング素子400には、熱電層14Cの面方向に温度差が設けられているため(TA>TB)、この温度差によって熱電層14Cに起電力が生じる。これにより、ソース電極44及びドレイン電極46の間に電流が流れ、電極間が電気的に接続される。そして、熱電層14Cに生じた電流は、端子(図示省略)を経て電力として取り出される。
また、本実施形態のスイッチング素子400は、熱電層14Cに生じた起電力を電力として取り出せるので、熱電変換素子としても機能する。
以下に示す方法により熱電変換素子を作製した。
ガラス基板(厚み1mm)を準備した。圧電層として70mm×50mmの圧電性PVDFフィルム(圧電性ポリフッ化ビニリデンフィルム)(クレハ社製:KFポリマー、厚み100μm)を、ガラス基板上に貼り付けた。
次いで、スピンコート法にて熱電層作製用塗布液としてPEDOT/PSS水溶液(ポリ(3,4−エチレンジオキシチオフェン)/ポリ(スチレンスルホン酸)水溶液)(Clevios社製:PH1000)を、圧電性PVDFフィルム上に、2000rpmで120秒間塗布し、塗布したPEDOT/PSS水溶液を70℃で3分間、乾燥させてPEDOT/PSS膜(熱電層)を得た。次いで、ガラス基板から、圧電性PVDFフィルム及びPEDOT/PSS膜からなる積層体を剥離した。
このようにして半導体材料(1)(つまり積層体)を得た。得られた半導体材料(1)をSEM観察したところ、PEDOT/PSS膜の厚みは1μm、半導体材料(1)の総厚は101μmであった。
次いで、半導体材料(1)の作製において、熱電層作製用塗布液が塗布された圧電性PVDFフィルムの面とは反対の面に熱電層作製用塗布液を塗布したこと以外は半導体材料(1)と同様の方法により、半導体材料(1’)を得た。
次いで、半導体材料(1)のPEDOT/PSS膜と、半導体材料(1’)のPEDOT/PSS膜とを導電性テープを用いて接続した。このようにして一対の半導体材料からなる熱電変換素子を作製した。
図11Aに、半導体材料(1)の平面視での写真を示し、図11Bに、図11AのD−D’線断面図を示す。図11A及び図11Bにおいて、「PVDF」は、圧電性PVDFフィルムを表し、「PEDOT/PSS」は、PEDOT/PSS膜を表している。
また、図11Aに示す一対の半導体材料は、例えば図10A及び図10Bに示す熱電変換素子300を構成する一対の半導体材料10(半導体材料10B及び半導体材料10A)として適用することができる。
具体的に、例えば半導体材料(1)は、図10A及び図10B中のn型半導体材料10Aに相当する。半導体材料(1’)は、図10A及び図10B中のp型半導体材料10Bに相当する。圧電性PVDFフィルムは、図10B中の圧電層12A,12Bに相当し、PEDOT/PSS膜は、図10B中の熱電層14A,14Bに相当する。また、導電性テープは、図10A及び図10B中の配線30に相当する。
以下に示す方法により半導体材料(2)を作製した。
ガラス製フラットシャーレを準備した。圧電材料としてVDF/TrFE共重合体(クレハ社製:フッ化ビニリデン/三フッ化エチレン共重合体、75/25mol%)を、DMF溶液(ジメチルホルムアミド溶液)に混合し、1質量%の圧電層作製用塗布液を調製した。この圧電層作製用塗布液と、熱電層作製用塗布液としてPEDOT/PSS水溶液(Clevios社製:PH1000)と、をそれぞれ10mlずつ混ぜ、150℃で1時間、マグネチックスターラーで撹拌させながら混合し、圧電熱電層作製用塗布液を調製した。この圧電熱電層作製用塗布液をガラス製フラットシャーレに注ぎ、圧電熱電層前駆体膜を作製した。その後、圧電熱電層前駆体膜を真空オーブン中で70℃1時間乾燥させて圧電熱電層を得た。次いで、ガラス製フラットシャーレから、圧電熱電層を剥離した。
なお、得られた圧電熱電層中におけるVDF/TrFE共重合体の含有量は固形分換算で0.5gであり、PEDOT/PSSの含有量は50mgであった。
また、得られた圧電熱電層をSEM観察したところ、圧電熱電層は、VDF/TrFE共重合体膜とPEDOT/PSS膜とに二層分離しており、VDF/TrFE共重合体膜の厚みは30μm、PEDOT/PSS膜の厚みは10μm、圧電熱電層の総厚は40μmであった。このようにして半導体材料(2)(つまり圧電熱電層)を得た。
図12に半導体材料(2)の断面写真を示す。なお、図12において、「VDF/TrFE」は、VDF/TrFE共重合体膜(圧電層)を表し、「PEDOT/PSS」は、PEDOT/PSS膜(熱電層)を表している。
実施例2において、圧電層作製用塗布液10mlと、PEDOT/PSS水溶液(熱電層作製用塗布液)5mlと、を混ぜたこと以外は実施例2と同様にして半導体材料を作製し、これを半導体材料(3)とした。
なお、得られた圧電熱電層中におけるVDF/TrFE共重合体の含有量は固形分換算で1.0gであり、PEDOT/PSSの含有量は50mgであった。
実施例2において、ガラス製フラットシャーレをポリイミド基板(厚み125μm)に変更したこと、及び、熱電層作製用塗布液のみをポリイミド基板に注いだこと以外は実施例2と同様にして、ポリイミド基板上に熱電層を作製し、これを半導体材料(1C)とした。
また、得られた半導体材料(1C)をSEM観察したところ、PEDOT/PSS膜の厚みは17μmであった。
石英ガラス基板(厚み0.5mm)を準備した。次いで、この基板をセミコクリーン、アセトン、及びエタノールで10分間超音波洗浄し、基板表面に対しUVオゾン(UV照度11mW/cm2)にて10分間親水化処理を施した。その後、スピンコーター(共和理研社製:K359SD−1 Spinner)を用いて、スピンコート法にて熱電層作製用塗布液としてPEDOT/PSS(Clevios社製:PH1000、質量比:PEDOT/PSS=1/2.5)のDMSO(ジメチルスルホキシド)5wt%溶液を基板上に1000rpmで2分間塗布し、塗布した熱電層作製用塗布液を150℃で1時間、ホットプレートで乾燥させてPEDOT/PSS膜(熱電層)を作製した。
次いで、真空蒸着装置(日本電子社製:JEE−400)を用いて、熱電層上にソース電極としてのAu電極と、ドレイン電極としてのAu電極とを両電極間の距離が4.0mmとなるように真空蒸着法にて作製した。
次いで、圧電材料としてVDF/TrFE共重合体(クレハ社製:フッ化ビニリデン/三フッ化エチレン共重合体、75/25mol%)を、DEC溶液(炭酸ジエチル溶液)に混合し、5質量%の圧電層作製用塗布液を調製した。その後、上記スピンコーターを用いて、スピンコート法にて、この圧電層作製用塗布液をAu電極が作製された熱電層上に1500rpmで2分間塗布し、塗布した圧電層作製用塗布液を140℃で1時間乾燥させた。その後、再度同じ条件で圧電層作製用塗布液を塗布して(2度目)140℃で1時間乾燥させた。これにより、VDF/TrFE共重合体膜(圧電層)を作製した。
次いで、VDF/TrFE共重合体膜(圧電層)上に、ゲート電極としてのAl電極を蒸着によって作製した。
このようにして、薄膜トランジスタ(TFT)を得た。得られたTFTをSEM観察したところ、PEDOT/PSS膜の厚みは0.1μm、VDF/TrFE共重合体膜の厚みは0.6μmであった。
なお、得られたTFTにおいて、石英ガラス基板は、図14中の基板42に相当する。PEDOT/PSS膜は、図14中の熱電層14Cに相当し、VDF/TrFE共重合体は、図14中の圧電層12Cに相当する。また、PEDOT/PSS膜及びVDF/TrFE共重合体からなる積層体は、図14中の半導体材料10Cに相当する。2つのAu電極は、それぞれ図14中のソース電極44及びドレイン電極46に相当する。Al電極は、図14中のゲート電極48に相当する。
<半導体材料のゼーベック係数>
実施例2、3及び比較例1で得た半導体材料(2)、(3)及び半導体材料(1C)を用いて、ゼーベック係数を熱電特性評価装置(アルバック理工社製:ZEM−3)にて測定した。
まず、測定温度の設定を50℃、70℃、90℃、110℃とし、各温度に対する温度差の設定を15℃、20℃、25℃、30℃とした。この条件にて各温度におけるゼーベック係数を測定し(四端子法)、その平均値をゼーベック係数として算出した。
結果を図15に示す。図15は、VDF/TrFE共重合体の含有量とゼーベック係数との関係を示すグラフである。
したがって、圧電材料が有する自発分極がゼーベック係数の増加に寄与すること、及び、圧電材料の含有量によってゼーベック係数が増減することがわかる。
すなわち、半導体材料の圧電材料の含有量を調整することによって起電力を制御でき、ひいては熱電変換性能(発電量)を制御できることが示唆された。
実施例4で作製したTFTを用いて、電流−電圧(IDS−VDS)特性を測定した。
具体的には、TFTのゲート電極に、外部刺激として−1Vから+1Vまでの電圧を印加したときのIDS−VDS特性を室温(25℃)で測定した。なお、測定装置は、YOKOGAWA Hewlett Packard社製の4140B pA METER/DC VOLTAGE SOURCEを用いた。結果を図16に示す。図16は、IDS−VDS特性を示すグラフである。
図16に示すように、ゲート電極に、上記電圧を印加することで、ソース電極及びドレイン電極簡に電流が流れることがわかる。これにより、圧電層に分極が生じ、生じた分極によって熱電層にキャリアが生じたことがわかる。
実施例4で作製したTFTを用いて、電束密度−電界強度(D−E)ヒステリシス曲線を測定した。具体的には、TFTのゲート電極に対して、外部刺激として−100MV/mから+100MV/mまでの電界を印加したときのD−Eヒステリシス曲線を室温(25℃)で測定した。なお、周波数は10Hzとした。測定装置は、Toyo Corporation社製のModel 6252 Rev. Cを用いた。結果を図17に示す。図17は、D−Eヒステリシス曲線を示すグラフである。
図17に示すように、ゲート電極に、上記電界を印加すると、圧電材料(VDF/TrFE共重合体)が分極反転することがわかる。また、残留分極値(Pr)は、±7.5μC/cm2であり、十分な分極反転電流が得られたことがわかる。これにより、ゲート電圧によって圧電材料の分極を制御できることがわかる。
実施例4で作製したTFTを用いて、電流−電圧(IDS−VG)特性を測定した。
具体的には、TFTのゲート電極に、外部刺激として−50Vから+50Vまでの電圧を印加したときのIDS−VG特性を室温(25℃)で、各サンプルあたり10回測定した。なお、ソース電極及びドレイン電極間の電圧は0.1V(一定)とし、スイープ速度は0.01V/秒とした。測定装置は、YOKOGAWA Hewlett Packard社製の4140B pA METER/DC VOLTAGE SOURCEを用いた。結果を図18に示す。図18は、IDS−VG特性を示すグラフである。なお、図18に示すプロットは、10回の測定の平均値である。
図18に示すように、ゲート電極に、上記電圧を印加すると、圧電材料(VDF/TrFE共重合体)の分極向きに応じて、熱電層に生じたキャリアが増加して電流が増え、また、その分極向きが反転すると、熱電層に生じたキャリアが減少して電流も減少することが確認された。
なお、電流の変化を抵抗値に換算すると10kΩの変化に相当する。このことから、熱電層に比較的多くのキャリアが生じ、キャリア注入が有効に行われていることが推測される。
実施例4で作製したTFTを用いて、圧電材料の分極方向が変化するようにゲート電極に電圧を印加し、かつ温度を変化させたときのゼーベック係数を熱電特性評価装置(アルバック理工社製:ZEM−3)にて測定した。
まず、TFTの熱電層の面方向に対し、熱電層の両側の温度が56℃〜57℃になるようにTFTを加熱し、ゼーベック係数を測定した。以下、上記両側の温度を初期温度と称する。
次いで、熱電層の面方向に対し、一方の側を初期温度に保持したまま、他方の側を、初期温度に対して15℃、20℃、25℃、30℃高くなるように昇温していき、それぞれの温度におけるゼーベック係数を測定した。各温度にて測定されたゼーベック係数の平均値をゼーベック係数として算出した。そして、上記操作を計3回行った。
なお、TFTの熱電層の面方向に対して温度差を15℃設けた場合、熱電特性評価装置の温度測定用プローブ間の温度差が1.5℃となる。したがって、他方の側の温度が初期温度に対して15℃、20℃、25℃、30℃高くなったときの上記プローブ間の温度差は、それぞれ1.5℃、2.0℃、2.5℃、3.0℃と算出される。
次いで、初期温度を72℃〜72.5℃に変更して上記と同様の操作を行った。その後、初期温度を90℃〜92℃に変更して上記と同様の操作を行った。
結果を図19に示す。図19は、温度とゼーベック係数との関係を示すグラフである。測定条件は以下の通りである。
なお、図19には、3回の操作のばらつきも示した。図19中、「polarization direction↓」とは、ゲート電極に正の電圧(+100V)を印加したときに、圧電材料の正の分極の向きが圧電層の側から熱電層の側へ向かうことを指す。また、「polarization direction↑」とは、ゲート電極に負の電圧(−100V)を印加したときに圧電材料の正の分極の向きが、熱電層の側から圧電層の側へ向かうことを指す。また、「no polarization」とは、ゲート電極に、電圧を印加していないことを指す。
測定方法:四端子法
温度測定用プローブの間隔:8.3mm
したがって、ゲート電圧を制御することによって、圧電材料の分極方向及びTFTのゼーベック係数(熱電層に生じるキャリア量)を制御でき、ひいては熱電変換性能(発電量)を制御できることがわかる。
また、例えば熱電変換素子用スイッチング素子に、本発明の半導体材料を搭載すれば、上記発電量を制御することもできると考えられる。
本明細書に記載された全ての文献、特許出願及び技術規格は、個々の文献、特許出願及び技術規格が参照により取り込まれることが具体的かつ個々に記された場合と同程度に、本明細書中に参照により取り込まれる。
また、本発明の導電性層にキャリアを生じさせる方法は、半導体の性質を最適化する上で産業上利用できる。
Claims (3)
- 強誘電体である圧電材料を含み、厚さが0.01μm以上100μm以下の圧電層と、熱電材料を含み、前記圧電層に接触させて又は他の層を介して設けられた厚さが0.001μm以上10μm以下の熱電層と、を有し、前記圧電層に、外部刺激として物理力を付与することで生じた分極によって前記熱電層に、キャリア面密度が1013/cm2以上1015/cm2未満のキャリアが生じる半導体材料を有し、
前記半導体材料の一端と他端の間に温度差を生じさせることにより起電力が生じる、熱電変換素子。 - 前記半導体材料が、少なくとも一対の半導体材料であり、
前記一対の半導体材料の一方は、前記熱電層に電子が生じるn型半導体であり、
前記一対の半導体材料の他方は、前記熱電層に正孔が生じるp型半導体である、請求項8に記載の熱電変換素子。 - 前記圧電材料は、フッ化ビニリデンの単独重合体、フッ化ビニリデン及び三フッ化エチレンの共重合体、フッ化ビニリデン及び四フッ化エチレンの共重合体からなる群から選択される少なくとも1種であり、
前記熱電材料は、ポリ(3,4−エチレンジオキシチオフェン)及びポリスチレンスルホン酸の混合樹脂、ポリ(3,4−エチレンジオキシチオフェン)及びp−トルエンスルホン酸の混合樹脂、ポリ(3,4−エチレンジオキシチオフェン)及びポリビニルスルホン酸の混合樹脂、並びに、ポリ(3,4−エチレンジオキシチオフェン)からなる群から選択される少なくとも1種の樹脂である、請求項8又は請求項9に記載の熱電変換素子。
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