JP6654465B2 - 入出力制御装置、入出力制御方法、及び、入出力制御プログラム - Google Patents
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Description
図1は、本願発明の第1の実施の形態に係る入出力制御装置10を概念的に示すブロック図である。入出力制御装置10は、例えば、サーバ装置等のホスト装置(情報処理装置)に搭載された、IOカード20との間で送受信するデータを処理するIOコントローラである。IOカード20は、例えば、PCI Expressカードであり、ストレージ装置等の周辺装置(不図示)を当該ホスト装置に接続する。IOカード20は、PCI Expressとは異なる仕様のIOインタフェースを制御するデバイスであってもよい。
この場合、「推奨値−1」が格納されるエントリ3、8、9における送信側プリセット値140−0−2は「0001」(−3.5db)となる。同様に、「推奨値+1」が格納されるエントリ2、6、7における送信側プリセット値140−0−2は「0011」(−2.5db)となる。
状態管理テーブル140−0の方が多い場合(ステップS143でYes)、制御部15は、状態管理テーブル140−0における温度Tに関して、ステータス情報が「01」であるいずれかのエントリの運用中フラグを「1」に設定する。制御部15は、当該エントリの送信側/受信側プリセット値を送受信プリセットレジスタ141に設定する。制御部15は、リトレーニングフラグ144を「1」から「0」に設定する。制御部15は、ポート選択フラグ145を「1」から「0」に設定し(ステップS144)、全体の処理は終了する。
図6は、第2の実施形態に係る入出力制御装置30の構成を概念的に示すブロック図である。
上述した各実施形態において図1、及び、図6に示した入出力制御装置における各部は、専用のHW(HardWare)(電子回路)によって実現することができる。また、図1及び図6において、少なくとも、下記構成は、ソフトウェアプログラムの機能(処理)単位(ソフトウェアモジュール)と捉えることができる。
・IOカード接続部12及び32における接続制御機能、
・判定部13及び33、
・記憶部14及び34における記憶制御機能、
・制御部15及び35。
・CPU(Central_Processing_Unit)901、
・ROM(Read_Only_Memory)902、
・RAM(Random_Access_Memory)903、
・ハードディスク(記憶装置)904、
・外部装置との通信インタフェース905、
・バス906(通信線)、
・CD−ROM(Compact_Disc_Read_Only_Memory)等の記録媒体907に格納されたデータを読み書き可能なリーダライタ908、
・入出力インタフェース909。
11 通信処理実行部
110 専用リクエスト発行部
111 リクエスト切り替え部
112 トランザクション層処理部
113 データリンク層処理部
114 物理層処理部
12 IOカード接続部
120及び121 ポート選択部
13 判定部
130 OR回路
131 送信エラーカウンタ
132 受信エラーカウンタ
133 エラー閾値格納部
134 比較回路
135 比較回路
136 OR回路
14 記憶部
140−0及び140−1 状態管理テーブル
140−0−1 エントリ番号
140−0−2 送信側プリセット値
140−0−3 受信側プリセット値
140−0−4 ステータス情報
140−0−5 運用中フラグ
141 送受信プリセットレジスタ
141−1 送信プリセットレジスタ
141−2 受信プリセットレジスタ
1411 送信プリセット値一覧表
1412 受信プリセット値一覧表
142 診断指示フラグ
143 専用リクエスト有効フラグ
144 リトレーニング指示フラグ
145 ポート選択フラグ
15 制御部
16 タイマー部
160 リンクチェックタイマー
161 専用リクエストタイマー
162 エラーカウンタタイマー
17 温度センサ
20 IOカード
30 入出力制御装置
31 通信処理実行部
32 IOカード接続部
33 判定部
34 記憶部
340−1乃至340−n 状態管理情報
40 IOカード
900 情報処理装置
901 CPU
902 ROM
903 RAM
904 ハードディスク(記憶装置)
905 通信インタフェース
906 バス
907 記録媒体
908 リーダライタ
909 入出力インタフェース
Claims (10)
- IOカードを介して外部装置との通信処理を実行する通信処理実行手段と前記IOカードとを、互いに信号の伝送特性が異なる複数の通信経路の何れかを、前記通信経路が確立される際に外部からの指示により選択することによって通信可能に接続するIOカード接続手段と、
前記複数の通信経路の何れかによって前記通信処理実行手段と前記IOカードとが接続されているときに、前記通信処理におけるエラーの発生状況を取得して、前記発生状況が所定の条件を満たすか否かを判定する判定手段と、
前記通信経路ごとに、前記判定手段による判定実績を表す状態管理情報を記憶する記憶手段と、
前記記憶手段に記憶された前記状態管理情報に基づいて、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記通信経路を選択するように前記IOカード接続手段を制御する制御手段と、
を備える入出力制御装置。 - 前記IOカード接続手段は、互いに長さが異なる前記複数の通信経路の何れかを選択する、
請求項1に記載の入出力制御装置。 - 前記判定手段は、前記通信処理に関する動作環境を示す設定情報が前記通信処理実行手段に対して設定されている場合に、前記発生状況が所定の条件を満たすか否かを判定し、
前記記憶手段は、前記設定情報の内容と、前記判定実績とを関連付けた前記状態管理情報を記憶し、
前記制御手段は、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記設定情報を、前記通信経路が確立される際に、前記通信処理実行手段に設定する、
請求項1または2に記載の入出力制御装置。 - 自装置内の温度を測定する温度測定手段をさらに備え、
前記記憶手段は、前記判定手段が前記発生状況が所定の条件を満たすか否かを判定したときの、前記温度測定手段による温度測定結果と、前記判定実績とを関連付けた前記状態管理情報を記憶し、
前記制御手段は、前記通信経路が確立される際に温度測定手段によって測定された温度において、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記通信経路を選択するように前記IOカード接続手段を制御する、
請求項3に記載の入出力制御装置。 - 前記制御手段は、前記通信経路が確立される際に温度測定手段によって測定された温度において、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記設定情報を、前記通信経路が確立される際に、前記通信処理実行手段に設定する、
請求項4に記載の入出力制御装置。 - 前記制御手段は、前記判定手段が前記所定の条件を満たす前記通信処理におけるエラーが発生したと判定した場合に、前記IOカード接続手段に対して前記通信経路を順次変更するように制御するとともに、前記IOカードに内容が異なる前記設定情報を順次設定することによって、前記通信経路と前記設定情報の内容との組み合わせごとに、前記通信処理実行手段に前記通信処理を行うように制御し、
前記記憶手段は、前記通信経路と前記設定情報の内容との組み合わせごとに、前記判定手段による判定結果を、前記温度測定手段による温度測定結果と関連付けて、前記状態管理情報として記憶する、
請求項5に記載の入出力制御装置。 - 前記制御手段は、前記記憶手段に記憶された前記状態管理情報において、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記通信経路と前記設定情報の内容との組み合わせを選択し、選択した組み合わせについて、前記通信処理実行手段に前記通信処理を行うように制御する、
請求項6に記載の入出力制御装置。 - 前記判定手段は、送信機能及び受信機能ごとに前記設定情報が設定された前記IOカードと前記通信処理実行手段とが接続されている場合に、前記送信機能及び前記受信機能ごとに前記発生状況が所定の条件を満たすか否かを判定し、
前記記憶手段は、前記送信機能及び前記受信機能ごとに、前記設定情報と、前記判定実績と、を関連付けた前記状態管理情報を記憶する、
請求項3乃至7のいずれか一項に記載の入出力制御装置。 - 情報処理装置によって、
IOカードを介して外部装置との通信処理を実行する通信処理実行手段と前記IOカードとを、互いに信号の伝送特性が異なる複数の通信経路の何れかを、前記通信経路が確立される際に選択することによって通信可能に接続し、
前記複数の通信経路の何れかによって前記通信処理実行手段と前記IOカードとが接続されているときに、前記通信処理におけるエラーの発生状況を取得して、前記発生状況が所定の条件を満たすか否かを判定し、
前記通信経路ごとに、前記発生状況に関する判定実績を表す状態管理情報を記憶手段に記憶し、
前記記憶手段に記憶された前記状態管理情報に基づいて、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記通信経路を、前記通信経路が確立される際に選択する、
入出力制御方法。 - IOカードを介して外部装置との通信処理を実行する通信処理実行手段と前記IOカードとを、互いに信号の伝送特性が異なる複数の通信経路の何れかを、前記通信経路が確立される際に外部からの指示により選択することによって通信可能に接続するIOカード接続処理と、
前記複数の通信経路の何れかによって前記通信処理実行手段と前記IOカードとが接続されているときに、前記通信処理におけるエラーの発生状況を取得して、前記発生状況が所定の条件を満たすか否かを判定する判定処理と、
前記通信経路ごとに、前記判定処理による判定実績を表す状態管理情報を記憶手段に記憶する記憶処理と、
前記記憶手段に記憶された前記状態管理情報に基づいて、前記通信処理におけるエラーの発生状況が前記所定の条件を満たすことが発生していない前記通信経路を選択するように前記IOカード接続処理を制御する制御処理と、
をコンピュータに実行させるための入出力制御プログラム。
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JP2016033049A JP6654465B2 (ja) | 2016-02-24 | 2016-02-24 | 入出力制御装置、入出力制御方法、及び、入出力制御プログラム |
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