JP6175805B2 - 受信装置 - Google Patents
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Description
(付記1)
Nを2以上の整数として、入力信号をN個の分配信号に分配する分配回路と、
前記N個の分配信号を受け取ってそれぞれ処理するN個の内部回路と、
前記N個の内部回路からのN個の出力信号を受け取って平均化し、平均化信号を出力する平均化回路と、を有する、
ことを特徴とする受信装置。
前記分配回路は、それぞれが異なる電力となるように、前記入力信号を前記N個の分配信号に分配する、
ことを特徴とする付記1に記載の受信装置。
前記分配回路は、N−1個の分配器を含み、
前記各分配器は、それぞれ入力された被分配信号を、所定の分配率に従って電力が異なる2つの分配信号に分配する、
ことを特徴とする付記2に記載の受信装置。
Nが3以上の整数のとき、N−1段目の分配器は、N−2段目の分配器により分配された2つの分配信号の一方を前記被分配信号として受け取る、
ことを特徴とする付記3に記載の受信装置。
前記N個の内部回路は、同等の回路であり、
前記所定の分配率は、前記各内部回路のダイナミックレンジに等しい、
ことを特徴とする付記3または付記4に記載の受信装置。
前記各分配器は、マイクロストリップ線路分配器である、
ことを特徴とする付記3乃至付記5のいずれか1項に記載の受信装置。
前記平均化回路は、
前記N個の出力信号を切り替えるスイッチと、
前記スイッチにより切り替えた信号を受け取って高域を濾波して低域を通過させる低域通過フィルタと、を含む、
ことを特徴とする付記1乃至付記6のいずれか1項に記載の受信装置。
前記スイッチは、前記N個の出力信号における1周期の1/Nよりも短く、前記入力信号のキャリア信号の1周期よりも長いタイミングで切り替えられる、
ことを特徴とする付記7に記載の受信装置。
前記低域通過フィルタは、前記スイッチを切り替え制御する切り替えクロックの周波数を遮断可能である、
ことを特徴とする付記8に記載の受信装置。
前記N個の内部回路は、第1内部回路および第2内部回路の2つである、
ことを特徴とする付記1乃至付記9のいずれか1項に記載の受信装置。
前記平均化回路は、差動増幅器およびインバータを含み、
前記差動増幅器は、前記第1内部回路から出力される第1出力信号を前記インバータにより反転した信号と、前記第2内部回路から出力される第2出力信号とを、差動入力端子で受け取る、
ことを特徴とする付記10に記載の受信装置。
さらに、
前記N個の内部回路の前段にそれぞれ設けられたN個の増幅器を、有する、
ことを特徴とする付記1乃至付記11のいずれか1項に記載の受信装置。
前記各内部回路は、検波器である、
ことを特徴とする付記1乃至付記12のいずれか1項に記載の受信装置。
前記各内部回路は、混合器である、
ことを特徴とする付記1乃至付記12のいずれか1項に記載の受信装置。
前記入力信号は、10GHz以上の信号である、
ことを特徴とする付記1乃至付記14のいずれか1項に記載の受信装置。
3 分配回路(電力分配器,カップラ)
31〜3(N-1) 分配器(電力分配器,カップラ)
4 平均化回路
11,12,11〜1N,101 検波器(ダイオード検波器:包絡線検波器)
11a,12a,101a,101b 増幅器(アンプ)
41 スイッチ
42 低域通過フィルタ(ローパスフィルタ)
43 差動増幅器
44 インバータ
51,52 混合器(ミキサ)
100 アンテナ
101c アッテネータ(抵抗)
Claims (8)
- Nを2以上の整数として、入力信号をN個の分配信号に分配する分配回路と、
前記N個の分配信号を受け取ってそれぞれ処理するN個の内部回路と、
前記N個の内部回路からのN個の出力信号を受け取って平均化し、平均化信号を出力する平均化回路と、を有し、
前記分配回路は、前記入力信号を、前記各内部回路のダイナミックレンジと等しい分配率で前記N個の分配信号に分配する、
ことを特徴とする受信装置。 - 前記分配回路は、それぞれが異なる電力となるように、前記入力信号を前記N個の分配信号に分配する、
ことを特徴とする請求項1に記載の受信装置。 - 前記分配回路は、N−1個の分配器を含み、
前記各分配器は、それぞれ入力された被分配信号を、前記分配率に従って電力が異なる2つの分配信号に分配する、
ことを特徴とする請求項2に記載の受信装置。 - 前記N個の内部回路は、同等の回路である、
ことを特徴とする請求項3に記載の受信装置。 - 前記平均化回路は、
前記N個の出力信号を切り替えるスイッチと、
前記スイッチにより切り替えた信号を受け取って高域を濾波して低域を通過させる低域通過フィルタと、を含む、
ことを特徴とする請求項1乃至請求項4のいずれか1項に記載の受信装置。 - 前記スイッチは、前記N個の出力信号における1周期の1/Nよりも短く、前記入力信号のキャリア信号の1周期よりも長いタイミングで切り替えられる、
ことを特徴とする請求項5に記載の受信装置。 - 前記N個の内部回路は、第1内部回路および第2内部回路の2つである、
ことを特徴とする請求項1乃至請求項6のいずれか1項に記載の受信装置。 - 前記平均化回路は、差動増幅器およびインバータを含み、
前記差動増幅器は、前記第1内部回路から出力される第1出力信号を前記インバータにより反転した信号と、前記第2内部回路から出力される第2出力信号とを、差動入力端子で受け取る、
ことを特徴とする請求項7に記載の受信装置。
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