JP6078916B2 - Power supply device and lighting apparatus using the power supply device - Google Patents

Power supply device and lighting apparatus using the power supply device Download PDF

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Description

本発明は、電源装置および該電源装置を用いた照明器具に関するものである。   The present invention relates to a power supply device and a lighting fixture using the power supply device.

従来から、インダクタと、このインダクタへの外部の直流電源からの電力の入力をオンオフするスイッチング素子と、このスイッチング素子をオンオフ駆動する駆動回路とを有するDC−DCコンバータを備える電源装置が提供されている。上記のDC−DCコンバータは、スイッチング素子のオンオフに伴ってインダクタへのエネルギーの蓄積と蓄積されたエネルギーの解放(回生)とが交互に繰り返されることで、所定の直流電力を出力する。上記のようなDC−DCコンバータとしては、バックコンバータやブーストコンバータなどが知られている。   Conventionally, a power supply device including a DC-DC converter having an inductor, a switching element that turns on and off the input of power from an external DC power supply to the inductor, and a drive circuit that drives the switching element to be turned on and off has been provided. Yes. The DC-DC converter outputs predetermined DC power by alternately repeating the accumulation of energy in the inductor and the release (regeneration) of the accumulated energy as the switching element is turned on / off. As the DC-DC converter as described above, a buck converter, a boost converter, and the like are known.

上記のスイッチング素子は、オンされた後には、スイッチング素子に流れる電流が所定の程度まで増加したタイミングでオフされる。すなわち、上記の駆動回路は、スイッチング素子に直列に接続された抵抗の両端電圧(以下、「検出電圧」と呼ぶ。)を入力され、この検出電圧が所定の基準電圧に達したタイミングでスイッチング素子をオフする。   After the switching element is turned on, the switching element is turned off at a timing when the current flowing through the switching element increases to a predetermined level. That is, the drive circuit receives the voltage across the resistor connected in series with the switching element (hereinafter referred to as “detection voltage”), and at the timing when the detection voltage reaches a predetermined reference voltage. Turn off.

さらに、上記のDC−DCコンバータの出力電圧により発光ダイオードを点灯させる照明器具において、検出電圧が基準電圧よりも高い状態に維持されることでスイッチング素子がオフされたままとなる状態(以下、「バーストオフ状態」と呼ぶ。)を周期的に作り出すことで発光ダイオードを間欠点灯させるものがある(例えば、特許文献1参照)。人の目に点滅として認識されない程度に十分に短い周期で上記の間欠点灯が行われることで、人の目から見た発光ダイオードの明るさは、上記の間欠点灯のオンデューティに応じた明るさとなる。   Furthermore, in the lighting fixture that turns on the light emitting diode by the output voltage of the DC-DC converter, the switching element remains turned off by maintaining the detection voltage higher than the reference voltage (hereinafter, “ Some light-emitting diodes are intermittently lit by periodically creating a “burst-off state” (see, for example, Patent Document 1). Since the above intermittent lighting is performed with a sufficiently short period not to be recognized as blinking to the human eye, the brightness of the light emitting diode viewed from the human eye is the brightness according to the on-duty of the above intermittent lighting. Become.

特開2012−28048号公報JP 2012-28048 A

電源装置としては、外部から入力される信号に応じて動作するものもある。この種の電源装置においては、出力の停止中(照明器具においては消灯中)にも信号の入力を受け付けるために、入力された信号に応じて出力を停止させる際には外部の電源からの給電を停止させない。この場合、スイッチ等により外部の電源からの給電を停止させる場合と違って、出力の停止中にも信号の入力の受付が可能となる代わりに、待機電力が発生する。   Some power supply devices operate in response to externally input signals. In this type of power supply device, since the signal input is accepted even when the output is stopped (when the lighting apparatus is turned off), when the output is stopped according to the input signal, power is supplied from an external power source. Do not stop. In this case, unlike the case where power supply from an external power supply is stopped by a switch or the like, standby power is generated instead of being able to accept a signal input even while the output is stopped.

外部の電源からの給電を停止させずに出力を停止する具体的な動作としては、上記のバーストオフ状態を継続するという動作が考えられる。しかしながら、バーストオフ状態では検出電圧を基準電圧よりも高く維持するために電力が消費される。従って、長時間継続して出力が停止される場合にバーストオフ状態を維持すると、待機電力が比較的に多くなってしまう。   As a specific operation for stopping the output without stopping the power supply from the external power source, an operation of continuing the above-described burst-off state can be considered. However, in the burst-off state, power is consumed to keep the detection voltage higher than the reference voltage. Therefore, if the burst off state is maintained when the output is stopped for a long time, the standby power becomes relatively large.

本発明は、上記事由に鑑みて為されたものであり、その目的は、待機電力の低減が可能な電源装置および該電源装置を用いた照明器具を提供することにある。   This invention is made | formed in view of the said reason, The objective is to provide the lighting fixture using the power supply device which can reduce standby power, and this power supply device.

本発明の電源装置は、インダクタと、直流電源から前記インダクタへの電力の供給をオンオフするスイッチング素子と、前記スイッチング素子に流れる電流に比例した電圧を出力する電流検出部と、前記スイッチング素子をオンオフ駆動する駆動回路と、前記駆動回路を制御する制御回路とを備え、前記駆動回路は、所定の条件でトリガーを生成するトリガー生成部と、前記電流検出部の出力電圧が検出電圧として入力され前記検出電圧と基準電圧とを比較する比較部と、前記トリガー生成部が生成したトリガーと前記比較部での比較結果とに応じて前記スイッチング素子をオンオフ駆動する駆動部とを有し、前記駆動部は、前記トリガー生成部がトリガーを生成したときに前記スイッチング素子をオンし、前記比較部での比較において前記検出電圧が前記基準電圧以上となったときに前記スイッチング素子をオフするものであって、前記制御回路は、外部から入力される信号に応じて、前記検出電圧と前記基準電圧との少なくとも一方を変更することで前記スイッチング素子をオフ状態に維持する第1オフ動作と、前記駆動回路の少なくとも一部への電力の供給を停止させることで前記スイッチング素子をオフ状態に維持する第2オフ動作とを行うことを特徴とする。   The power supply device according to the present invention includes an inductor, a switching element that turns on and off the supply of power from a DC power supply to the inductor, a current detection unit that outputs a voltage proportional to a current flowing through the switching element, and an on / off switch for the switching element. A driving circuit for driving and a control circuit for controlling the driving circuit, the driving circuit generating a trigger under a predetermined condition, and an output voltage of the current detection unit being input as a detection voltage; A comparison unit that compares a detected voltage with a reference voltage; and a drive unit that drives the switching element on and off according to a trigger generated by the trigger generation unit and a comparison result of the comparison unit, and the drive unit Turns on the switching element when the trigger generation unit generates a trigger, and the comparison in the comparison unit When the output voltage becomes equal to or higher than the reference voltage, the switching element is turned off, and the control circuit outputs at least one of the detection voltage and the reference voltage according to a signal input from the outside. A first off operation for maintaining the switching element in an off state by changing, and a second off operation for maintaining the switching element in an off state by stopping the supply of power to at least a part of the drive circuit; It is characterized by performing.

上記の電源装置において、前記制御回路は、前記第1オフ動作において、前記検出電圧を前記基準電圧以上に維持することで前記スイッチング素子をオフ状態に維持することが望ましい。   In the power supply device described above, it is preferable that the control circuit maintain the switching element in an off state by maintaining the detection voltage at the reference voltage or higher in the first off operation.

上記の電源装置において、前記制御回路は、前記第2オフ動作において、前記駆動回路の全体への電力の供給を停止させることが望ましい。   In the power supply device described above, it is preferable that the control circuit stops supplying power to the entire drive circuit in the second off operation.

上記の電源装置において、前記制御回路は、前記第2オフ動作を開始する前に前記第1オフ動作を開始し、前記第2オフ動作の開始後に前記第1オフ動作を終了することが望ましい。   In the above power supply device, it is preferable that the control circuit starts the first off operation before starting the second off operation, and ends the first off operation after the second off operation starts.

上記の電源装置において、前記制御回路は、前記第2オフ動作を終了する前に前記第1オフ動作を開始し、前記第2オフ動作の終了後に前記第1オフ動作を終了することが望ましい。   In the above power supply apparatus, it is preferable that the control circuit starts the first off operation before ending the second off operation, and ends the first off operation after the second off operation.

本発明の照明器具は、上記いずれかの電源装置と、前記電源装置の出力により点灯する発光ダイオードとを備えることを特徴とする。   The lighting fixture of the present invention includes any one of the power supply devices described above and a light emitting diode that is turned on by an output of the power supply device.

本発明によれば、出力が長時間停止される場合には、第2オフ動作において駆動回路の少なくとも一部への電力の供給が停止されることで、第1オフ動作が継続される場合に比べて待機電力の低減が可能となる。   According to the present invention, when the output is stopped for a long time, the supply of power to at least a part of the drive circuit is stopped in the second off operation, so that the first off operation is continued. In comparison, standby power can be reduced.

本発明の実施形態の要部を示す回路ブロック図である。It is a circuit block diagram which shows the principal part of embodiment of this invention. 同上を示す回路ブロック図である。It is a circuit block diagram which shows the same as the above. バースト信号のLレベルの継続時間が比較的に長い場合における同上の動作を示す説明図である。It is explanatory drawing which shows the operation | movement same as the above when the duration of the L level of a burst signal is comparatively long. バースト信号のLレベルの継続時間が比較的に短い場合における同上の動作を示す説明図である。It is explanatory drawing which shows the operation | movement same as the above when the duration of the L level of a burst signal is comparatively short. 第2オフ動作へ移行する際の同上の動作を示す説明図である。It is explanatory drawing which shows the operation | movement same as the above at the time of transfering to 2nd OFF operation | movement. 第2オフ動作から復帰する際の同上の動作を示す説明図である。It is explanatory drawing which shows the operation | movement same as the above at the time of returning from 2nd OFF operation | movement. 同上の変更例の要部を示す回路ブロック図である。It is a circuit block diagram which shows the principal part of the example of a change same as the above. 同上の別の変更例を示す回路ブロック図である。It is a circuit block diagram which shows another example of a change same as the above. 第2オフ動作へ移行する際の図8の例の動作を示す説明図である。It is explanatory drawing which shows operation | movement of the example of FIG. 8 at the time of transfering to 2nd OFF operation | movement. 第2オフ動作から復帰する際の図8の例の動作を示す説明図である。It is explanatory drawing which shows operation | movement of the example of FIG. 8 at the time of returning from 2nd OFF operation | movement. 同上の更に別の変更例を示す回路ブロック図である。It is a circuit block diagram which shows another example of a change same as the above. 図11の例の動作の一例を示す説明図である。It is explanatory drawing which shows an example of operation | movement of the example of FIG. 図11の例において第2オフ動作へ移行する際の動作の一例を示す説明図である。It is explanatory drawing which shows an example of the operation | movement at the time of transfering to 2nd OFF operation | movement in the example of FIG.

本発明の電源装置は、インダクタL2と、直流電源(ブーストコンバータ1)からインダクタL2への電力の供給をオンオフするスイッチング素子Q2と、スイッチング素子Q2に流れる電流に比例した電圧を出力する電流検出部(抵抗R2)とを備える。また、本発明の電源装置は、スイッチング素子Q2をオンオフ駆動する駆動回路(第2駆動回路20)と、駆動回路(第2駆動回路20)を制御する制御回路31とを備える。駆動回路(第2駆動回路20)は、所定の条件でトリガーを生成するトリガー生成部(第2比較部CP2)と、電流検出部(抵抗R2)の出力電圧が検出電圧Vdとして入力され検出電圧Vdと基準電圧(第1基準電圧Vr1)とを比較する比較部(第1比較部CP1)とを備える。また、駆動回路(第2駆動回路20)は、トリガー生成部(第2比較部CP2)が生成したトリガーと比較部(第1比較部CP1)での比較結果とに応じてスイッチング素子Q2をオンオフ駆動する駆動部(ドライバDR)を有する。駆動部(ドライバDR)は、トリガー生成部(第2比較部CP2)がトリガーを生成したときにスイッチング素子Q2をオンする。また、駆動部(ドライバDR)は、比較部(第1比較部CP1)での比較において検出電圧Vdが基準電圧(第1基準電圧Vr1)以上となったときにスイッチング素子Q2をオフする。制御回路31は、外部から入力される信号に応じて、検出電圧Vdと基準電圧(第1基準電圧Vr1)との少なくとも一方を変更することでスイッチング素子Q2をオフ状態に維持する第1オフ動作を行う。また、制御回路31は、外部から入力される信号に応じて、駆動回路(第2駆動回路20)の少なくとも一部への電力の供給を停止させることでスイッチング素子Q2をオフ状態に維持する第2オフ動作を行う。   The power supply device of the present invention includes an inductor L2, a switching element Q2 that turns on and off the supply of power from the DC power supply (boost converter 1) to the inductor L2, and a current detection unit that outputs a voltage proportional to the current flowing through the switching element Q2. (Resistor R2). In addition, the power supply device of the present invention includes a drive circuit (second drive circuit 20) that drives the switching element Q2 on and off, and a control circuit 31 that controls the drive circuit (second drive circuit 20). The drive circuit (second drive circuit 20) receives the output voltage of the trigger generation unit (second comparison unit CP2) that generates a trigger under a predetermined condition and the current detection unit (resistor R2) as the detection voltage Vd. A comparison unit (first comparison unit CP1) that compares Vd with a reference voltage (first reference voltage Vr1) is provided. The drive circuit (second drive circuit 20) turns on / off the switching element Q2 according to the trigger generated by the trigger generation unit (second comparison unit CP2) and the comparison result in the comparison unit (first comparison unit CP1). It has a drive unit (driver DR) for driving. The drive unit (driver DR) turns on the switching element Q2 when the trigger generation unit (second comparison unit CP2) generates a trigger. The drive unit (driver DR) turns off the switching element Q2 when the detection voltage Vd becomes equal to or higher than the reference voltage (first reference voltage Vr1) in the comparison in the comparison unit (first comparison unit CP1). The control circuit 31 changes the at least one of the detection voltage Vd and the reference voltage (first reference voltage Vr1) according to a signal input from the outside, thereby maintaining the switching element Q2 in the off state. I do. In addition, the control circuit 31 stops the supply of power to at least a part of the drive circuit (second drive circuit 20) in accordance with a signal input from the outside, thereby maintaining the switching element Q2 in the off state. 2-off operation is performed.

制御回路31は、第1オフ動作において、検出電圧Vdを基準電圧(第1基準電圧Vr1)以上に維持することで前記スイッチング素子をオフ状態に維持することが好ましい。   In the first off operation, the control circuit 31 preferably maintains the switching element in an off state by maintaining the detection voltage Vd at a reference voltage (first reference voltage Vr1) or higher.

制御回路31は、第2オフ動作において、駆動回路(第2駆動回路20)の全体への電力の供給を停止させることが好ましい。   In the second off operation, the control circuit 31 preferably stops the supply of power to the entire drive circuit (second drive circuit 20).

制御回路31は、第2オフ動作を開始する前に第1オフ動作を開始し、第2オフ動作の開始後に第1オフ動作を終了することが好ましい。   The control circuit 31 preferably starts the first off operation before starting the second off operation, and ends the first off operation after the second off operation starts.

制御回路31は、第2オフ動作を終了する前に第1オフ動作を開始し、第2オフ動作の終了後に第1オフ動作を終了することが好ましい。   It is preferable that the control circuit 31 starts the first off operation before ending the second off operation, and ends the first off operation after the second off operation.

本発明の照明器具は、上記の電源装置と、電源装置の出力により点灯する発光ダイオード(発光ダイオードアレイ5)とを備える。   The lighting fixture of this invention is equipped with said power supply device and the light emitting diode (light emitting diode array 5) lighted by the output of a power supply device.

以下、本発明を実施するための最良の形態について、図面を参照しながら説明する。   The best mode for carrying out the present invention will be described below with reference to the drawings.

本実施形態の電源回路は、図2に示すように、外部の交流電源ACから入力された交流電力を直流電力に変換して発光ダイオードアレイ5に出力することで発光ダイオードアレイ5を点灯させるものであり、発光ダイオードアレイ5とともに照明器具を構成する。発光ダイオードアレイ5は、複数個(図2では4個)の発光ダイオードからなる直列回路である。   As shown in FIG. 2, the power supply circuit of the present embodiment turns on the light emitting diode array 5 by converting AC power input from an external AC power supply AC into DC power and outputting it to the light emitting diode array 5. And constitutes a lighting fixture together with the light-emitting diode array 5. The light emitting diode array 5 is a series circuit composed of a plurality (four in FIG. 2) of light emitting diodes.

詳しく説明すると、本実施形態は、ヒューズFUとアクロスザラインコンデンサCxとコモンモードチョークCcとを介して交流電源ACから入力された交流電流を全波整流するダイオードブリッジDBを備える。ダイオードブリッジDBの直流出力端間にはコンデンサ(以下、「入力コンデンサ」と呼ぶ。)C0が接続されており、この入力コンデンサC0によりダイオードブリッジDBの直流出力(脈流出力)が平滑化される。ダイオードブリッジDBの低電圧側の直流出力端は、グランドに接続されている。   More specifically, this embodiment includes a diode bridge DB that full-wave rectifies an alternating current input from an alternating current power supply AC via a fuse FU, an across the line capacitor Cx, and a common mode choke Cc. A capacitor (hereinafter referred to as “input capacitor”) C0 is connected between the DC output terminals of the diode bridge DB, and the DC output (pulse output) of the diode bridge DB is smoothed by the input capacitor C0. . The DC output terminal on the low voltage side of the diode bridge DB is connected to the ground.

また、本実施形態は、ダイオードブリッジDBの出力端間に接続された直流電源としてのブーストコンバータ1と、ブーストコンバータ1が出力した直流電圧を降圧して発光ダイオードアレイ5に出力するバックコンバータ2とを備える。すなわち、発光ダイオードアレイ5は、バックコンバータ2の出力により点灯される。   The present embodiment also includes a boost converter 1 as a DC power source connected between the output terminals of the diode bridge DB, and a buck converter 2 that steps down the DC voltage output from the boost converter 1 and outputs it to the light emitting diode array 5. Is provided. That is, the light emitting diode array 5 is turned on by the output of the buck converter 2.

ブーストコンバータ1は、ダイオードブリッジDBの高電圧側の出力端に一端を接続されたインダクタL1と、このインダクタL1の他端にアノードを接続されたダイオードD1と、このダイオードD1のカソードとグランドとの間に接続されたコンデンサ(以下、「第1出力コンデンサ」と呼ぶ。)C1とを備える。第1出力コンデンサC1の両端が、ブーストコンバータ1の出力端となる。   The boost converter 1 includes an inductor L1 having one end connected to an output terminal on the high voltage side of the diode bridge DB, a diode D1 having an anode connected to the other end of the inductor L1, and a cathode and a ground of the diode D1. And a capacitor C <b> 1 (hereinafter referred to as “first output capacitor”) connected therebetween. Both ends of the first output capacitor C1 are output ends of the boost converter 1.

また、ブーストコンバータ1は、インダクタL1とダイオードD1との接続点とグランドとの間に接続されたスイッチング素子Q1と、スイッチング素子Q1をオンオフ駆動する第1駆動回路10とを備える。スイッチング素子Q1は、電界効果トランジスタからなり、ドレインがインダクタL1とダイオードD1との接続点に接続され、ゲートが抵抗を介して第1駆動回路10に接続されている。また、スイッチング素子Q1のソースは、電流検出用の抵抗R1を介してグランドに接続されている。   The boost converter 1 includes a switching element Q1 connected between a connection point between the inductor L1 and the diode D1 and the ground, and a first drive circuit 10 that drives the switching element Q1 on and off. The switching element Q1 is composed of a field effect transistor, the drain is connected to the connection point between the inductor L1 and the diode D1, and the gate is connected to the first drive circuit 10 via a resistor. The source of the switching element Q1 is connected to the ground via a current detection resistor R1.

第1駆動回路10は、第1出力コンデンサC1の両端電圧(すなわちブーストコンバータ1の出力電圧)が抵抗R15,R16で分圧された電圧が入力されるFB端子を有する。そして、第1駆動回路10は、FB端子に入力された上記の電圧を所定の目標電圧とするようにフィードバック動作する。このフィードバック動作により、ブーストコンバータ1の出力電圧(すなわち第1出力コンデンサC1の両端電圧)は一定に維持される。   The first drive circuit 10 has an FB terminal to which a voltage obtained by dividing the voltage across the first output capacitor C1 (that is, the output voltage of the boost converter 1) by resistors R15 and R16 is input. The first drive circuit 10 performs a feedback operation so that the voltage input to the FB terminal is set to a predetermined target voltage. By this feedback operation, the output voltage of the boost converter 1 (that is, the voltage across the first output capacitor C1) is kept constant.

バックコンバータ2は、カソードがブーストコンバータ1の高電圧側の出力端に接続されたダイオードD2と、ダイオードD2のカソードに一端が接続されたコンデンサ(以下、「第2出力コンデンサ」と呼ぶ。)C2とを備える。第2出力コンデンサC2の他端とダイオードD2のアノードとの間にはインダクタL2が接続されており、ダイオードD2と第2出力コンデンサC2とインダクタL2とでループが構成されている。また、第2出力コンデンサC2の両端が、バックコンバータ2の出力端として発光ダイオードアレイ5の両端に接続されている。   The buck converter 2 has a diode D2 whose cathode is connected to the output terminal on the high voltage side of the boost converter 1, and a capacitor (hereinafter referred to as “second output capacitor”) C2 whose one end is connected to the cathode of the diode D2. With. An inductor L2 is connected between the other end of the second output capacitor C2 and the anode of the diode D2, and the diode D2, the second output capacitor C2, and the inductor L2 form a loop. Further, both ends of the second output capacitor C <b> 2 are connected to both ends of the light emitting diode array 5 as output ends of the buck converter 2.

さらに、バックコンバータ2は、ダイオードD2のアノードとグランドとの間に接続されたスイッチング素子Q2と、スイッチング素子Q2をオンオフ駆動する第2駆動回路20とを備える。スイッチング素子Q2は電界効果トランジスタからなり、ドレインがダイオードD2のアノードに接続され、ゲートが抵抗R21を介して第2駆動回路20に接続されている。また、スイッチング素子Q2のソースは、電流検出部としての抵抗R2を介してグランドに接続されている。   Further, the buck converter 2 includes a switching element Q2 connected between the anode of the diode D2 and the ground, and a second drive circuit 20 that drives the switching element Q2 on and off. The switching element Q2 is composed of a field effect transistor, the drain is connected to the anode of the diode D2, and the gate is connected to the second drive circuit 20 via the resistor R21. The source of the switching element Q2 is connected to the ground via a resistor R2 as a current detection unit.

また、本実施形態は、制御を指示する信号が外部から入力される信号入力回路30と、信号入力回路に入力された信号に応じて各駆動回路10,20を制御する制御回路31とを備える。   In addition, the present embodiment includes a signal input circuit 30 to which a signal for instructing control is input from the outside, and a control circuit 31 for controlling the drive circuits 10 and 20 in accordance with the signal input to the signal input circuit. .

信号入力回路30に入力される信号は、無線信号であってもよいし、電気信号であってもよい。無線信号の媒体としては電波や光などが考えられる。また、信号入力回路30に入力される電気信号としては、指示の内容を電圧値によって示す電圧信号や、指示の内容をオンデューティによって示す矩形波(いわゆるPWM信号)や、IEC60929に規定されたDALI(Digital Addressable Lighting Interface)規格に従った電気信号などが考えられる。いずれの場合にも信号入力回路30は周知技術で実現可能であるので、詳細な図示並びに説明は省略する。   The signal input to the signal input circuit 30 may be a radio signal or an electric signal. A radio signal medium may be radio waves or light. The electric signal input to the signal input circuit 30 includes a voltage signal indicating the content of the instruction with a voltage value, a rectangular wave (so-called PWM signal) indicating the content of the instruction with an on-duty, and DALI defined in IEC 60929. An electrical signal in accordance with the (Digital Addressable Lighting Interface) standard is conceivable. In any case, since the signal input circuit 30 can be realized by a well-known technique, detailed illustration and description thereof are omitted.

また、本実施形態は、各駆動回路10,20の電源電圧VCC1や制御回路31の電源電圧VCC2を生成する制御電源回路4を備える。制御電源回路4は、入力コンデンサC0から電力を供給されて所定の直流電力を生成する集積回路からなるレギュレータ40を備える。また、制御電源回路4は、レギュレータ40の出力端と制御電源回路4の出力端との間に接続されたインダクタL4と、制御電源回路4の出力端に並列に接続されたコンデンサC4とを備える。さらに、制御電源回路4は、アノードをグランドに接続されてカソードをインダクタL4とレギュレータ40との接続点に接続されたダイオードD4を備える。上記のような制御電源回路4は周知であるので、詳細な説明は省略する。   In addition, the present embodiment includes a control power supply circuit 4 that generates the power supply voltage VCC1 of each of the drive circuits 10 and 20 and the power supply voltage VCC2 of the control circuit 31. The control power supply circuit 4 includes a regulator 40 formed of an integrated circuit that is supplied with power from the input capacitor C0 and generates predetermined DC power. Further, the control power circuit 4 includes an inductor L4 connected between the output terminal of the regulator 40 and the output terminal of the control power circuit 4, and a capacitor C4 connected in parallel to the output terminal of the control power circuit 4. . Further, the control power supply circuit 4 includes a diode D4 having an anode connected to the ground and a cathode connected to a connection point between the inductor L4 and the regulator 40. Since the control power supply circuit 4 as described above is well known, detailed description thereof is omitted.

ここで、第1駆動回路10と第2駆動回路20とには、互いに共通の回路構成を有する集積回路が用いられている。各駆動回路10,20は、それぞれ、制御電源回路4から電源電圧VCC1を入力されるVCC端子と、抵抗R11,R21を介してスイッチング素子Q1,Q2に接続されるOUT端子と、インダクタL1,L2に設けられた二次巻線の両端電圧が抵抗R19,R29を介して接続されるZCD端子とを有する。VCC端子からのノイズの流入を抑えるため、VCC端子は、コンデンサ(いわゆるバイパスコンデンサ)C10,C20を介してグランドに接続されている。また、各駆動回路10,20は、それぞれ、電流検出用の抵抗R1,R2の両端電圧が別の抵抗R12,R22を介して入力されるIS端子を有する。   Here, an integrated circuit having a common circuit configuration is used for the first drive circuit 10 and the second drive circuit 20. Each of the drive circuits 10 and 20 includes a VCC terminal to which the power supply voltage VCC1 is input from the control power supply circuit 4, an OUT terminal connected to the switching elements Q1 and Q2 via the resistors R11 and R21, and inductors L1 and L2. And a ZCD terminal to which the both-ends voltage of the secondary winding provided in is connected via resistors R19 and R29. In order to suppress inflow of noise from the VCC terminal, the VCC terminal is connected to the ground via capacitors (so-called bypass capacitors) C10 and C20. Each of the drive circuits 10 and 20 has an IS terminal to which the voltage across the current detection resistors R1 and R2 is input via the other resistors R12 and R22.

第2駆動回路20の概略について図1を用いて説明する。第2駆動回路20は、電流検出用の抵抗R2の両端電圧がIS端子を通じて検出電圧Vdとして非反転入力端子に入力されたコンパレータからなる第1比較部CP1を備える。第1比較部CP1の反転入力端子には、所定の第1基準電圧Vr1が入力されている。また、第2駆動回路20は、インダクタL2に設けられた二次巻線の両端電圧が抵抗R29とZCD端子とを通じてゼロクロス電圧Vzとして反転入力端子に入力されたコンパレータからなる第2比較部CP2を備える。第2比較部CP2の非反転入力端子には、所定の第2基準電圧Vr2が入力されている。すなわち、インダクタL2に流れる電流(以下、「インダクタ電流」と呼ぶ。)IL2の減少が停止したときには、第2比較部CP2の出力がLレベルからHレベルとなる。つまり、第2比較部CP2は、インダクタ電流IL2のゼロクロスが検出されたという条件でトリガーを生成するトリガー生成部である。また、第2駆動回路20は、RS型のフリップフロップFFと、フリップフロップFFの出力電圧をスイッチング素子Q2の駆動に適した電圧Voに変換して抵抗R21を介してスイッチング素子Q2のゲートに入力する駆動部としてのドライバDRとを備える。第2比較部CP2の出力端子はフリップフロップFFのセット端子Sに接続され、第1比較部CP1の出力端子は遅延回路DLを介してフリップフロップFFのリセット端子Rに接続されている。   An outline of the second drive circuit 20 will be described with reference to FIG. The second drive circuit 20 includes a first comparison unit CP1 including a comparator in which the voltage across the current detection resistor R2 is input to the non-inverting input terminal as the detection voltage Vd through the IS terminal. A predetermined first reference voltage Vr1 is input to the inverting input terminal of the first comparison unit CP1. Further, the second drive circuit 20 includes a second comparison unit CP2 including a comparator in which the voltage across the secondary winding provided in the inductor L2 is input to the inverting input terminal as the zero cross voltage Vz through the resistor R29 and the ZCD terminal. Prepare. A predetermined second reference voltage Vr2 is input to the non-inverting input terminal of the second comparison unit CP2. That is, when the current flowing through the inductor L2 (hereinafter referred to as “inductor current”) IL2 stops decreasing, the output of the second comparison unit CP2 changes from L level to H level. That is, the second comparison unit CP2 is a trigger generation unit that generates a trigger on the condition that the zero crossing of the inductor current IL2 is detected. The second drive circuit 20 converts the RS-type flip-flop FF and the output voltage of the flip-flop FF into a voltage Vo suitable for driving the switching element Q2, and inputs the voltage Vo to the gate of the switching element Q2 via the resistor R21. And a driver DR as a driving unit. The output terminal of the second comparison unit CP2 is connected to the set terminal S of the flip-flop FF, and the output terminal of the first comparison unit CP1 is connected to the reset terminal R of the flip-flop FF via the delay circuit DL.

次に、第2駆動回路20の動作の一例を、図3を用いて説明する。なお、ノイズの影響を抑えるため、各比較部CP1,CP2はそれぞれヒステリシス特性を有し、第1比較部CP1とフリップフロップFFとの間には遅延回路DLが設けられているが、以下の説明ではヒステリシス特性や遅延回路DLの影響は無視している。図3におけるタイミングt4〜t5のように駆動回路20からスイッチング素子Q2への入力電圧(以下、「駆動電圧」と呼ぶ。)VoがHレベルである期間には、スイッチング素子Q2がオンされる。スイッチング素子Q2がオンされている期間には、インダクタL2にエネルギーが蓄積され、スイッチング素子Q2に流れる電流の増加に伴って検出電圧Vdが徐々に上昇する。やがて図3におけるタイミングt5のように検出電圧Vdが第1基準電圧Vr1に達すると、第1比較部CP1からフリップフロップFFのリセット端子RにHレベルの電圧が入力されることで、駆動電圧VoがLレベルとなってスイッチング素子Q2がオフされる。すると、インダクタL2に蓄積されたエネルギーの解放が開始され、インダクタ電流IL2が低下に転じることで、ゼロクロス電圧Vzが第2基準電圧Vr2よりも高くなる。やがて図3におけるタイミングt6のようにインダクタL2からのエネルギーの解放が完了してインダクタ電流IL2が0になると、インダクタ電流IL2の減少が停止することで、ゼロクロス電圧Vzが第2基準電圧Vr2を下回る。すると、第2比較部CP2からフリップフロップFFのセット端子SにHレベルの電圧が入力されることで、駆動電圧VoがHレベルとなってスイッチング素子Q2がオンされる。通常は、上記の一連の動作が繰り返されることで、バックコンバータ2の出力電流が一定に維持される。   Next, an example of the operation of the second drive circuit 20 will be described with reference to FIG. In order to suppress the influence of noise, each of the comparison units CP1 and CP2 has a hysteresis characteristic, and a delay circuit DL is provided between the first comparison unit CP1 and the flip-flop FF. However, the influence of hysteresis characteristics and delay circuit DL is ignored. The switching element Q2 is turned on during a period in which the input voltage (hereinafter referred to as “driving voltage”) Vo from the drive circuit 20 to the switching element Q2 is at the H level at timings t4 to t5 in FIG. During the period when the switching element Q2 is on, energy is accumulated in the inductor L2, and the detection voltage Vd gradually increases as the current flowing through the switching element Q2 increases. When the detection voltage Vd reaches the first reference voltage Vr1 at time t5 in FIG. 3, an H level voltage is input from the first comparison unit CP1 to the reset terminal R of the flip-flop FF, so that the drive voltage Vo Becomes L level and the switching element Q2 is turned off. Then, release of the energy accumulated in the inductor L2 is started, and the inductor current IL2 starts to decrease, so that the zero cross voltage Vz becomes higher than the second reference voltage Vr2. When the release of the energy from the inductor L2 is completed and the inductor current IL2 becomes 0 as shown in timing t6 in FIG. 3, the zero cross voltage Vz falls below the second reference voltage Vr2 by stopping the decrease of the inductor current IL2. . Then, when the H level voltage is input from the second comparison unit CP2 to the set terminal S of the flip-flop FF, the drive voltage Vo becomes H level and the switching element Q2 is turned on. Normally, the output current of the buck converter 2 is kept constant by repeating the above series of operations.

また、信号入力回路30に入力された信号が、定常点灯より低い光出力での発光ダイオードアレイ5の点灯(いわゆる調光点灯)を指示するものである場合、制御回路31は、スイッチング素子Q2をオフ状態に維持する第1オフ動作を間欠的に行う。これにより、発光ダイオードアレイ5は間欠点灯する。発光ダイオードアレイ5の間欠点灯の周波数(つまり第1オフ動作の繰り返しの周波数)は、上記の間欠点灯が人の目に点滅として認識されない程度に十分に高い周波数とされる。   In addition, when the signal input to the signal input circuit 30 instructs to turn on the light emitting diode array 5 with a light output lower than steady lighting (so-called dimming lighting), the control circuit 31 switches the switching element Q2 on. A first off operation for maintaining the off state is intermittently performed. Thereby, the light emitting diode array 5 is intermittently lit. The frequency of intermittent lighting of the light-emitting diode array 5 (that is, the frequency at which the first off operation is repeated) is set to a sufficiently high frequency such that the intermittent lighting is not recognized as blinking by human eyes.

第1オフ動作は、具体的には、Hレベルでの電圧が第1基準電圧Vr1よりも高い矩形波状の電圧信号(以下、「バースト信号」と呼ぶ。)BRにより、検出電圧Vdを第1基準電圧Vr1よりも高い電圧に維持するものである。バースト信号BRは、抵抗R36,R25を介して、第2駆動回路20のIS端子に入力される。また、ノイズの影響を抑えるため、バースト信号BRの経路はコンデンサC23を介してグランドに接続されている。図2ではバースト信号BRの経路において上記のコンデンサC23が接続された箇所の両側に抵抗R36,R25を設けているが、これらの抵抗R36,R25の一方は省略してもよい。また、フリップフロップFFはリセット端子Rへの入力をセット端子Sへの入力よりも優先する。すなわち、図3におけるタイミングt2のように、検出電圧Vdが第1基準電圧Vr1を上回っている状態でゼロクロス電圧Vzが第2基準電圧Vr2を下回っても、スイッチング素子Q2はオンされない。信号入力回路30に入力された信号によって指示された光出力が低いほど、バースト信号BRのオンデューティが高くされることで、発光ダイオードアレイ5の間欠点灯のオンデューティは低くされる。   Specifically, in the first off operation, the detection voltage Vd is set to the first level by a rectangular wave voltage signal (hereinafter referred to as “burst signal”) BR whose voltage at the H level is higher than the first reference voltage Vr1. The voltage is maintained higher than the reference voltage Vr1. The burst signal BR is input to the IS terminal of the second drive circuit 20 via the resistors R36 and R25. In order to suppress the influence of noise, the path of the burst signal BR is connected to the ground via the capacitor C23. In FIG. 2, the resistors R36 and R25 are provided on both sides of the location where the capacitor C23 is connected in the path of the burst signal BR, but one of these resistors R36 and R25 may be omitted. Further, the flip-flop FF gives priority to the input to the reset terminal R over the input to the set terminal S. That is, the switching element Q2 is not turned on even when the zero-cross voltage Vz is lower than the second reference voltage Vr2 in a state where the detection voltage Vd is higher than the first reference voltage Vr1 as at the timing t2 in FIG. The lower the light output indicated by the signal input to the signal input circuit 30, the higher the on-duty of the burst signal BR, so that the on-duty of intermittent lighting of the light-emitting diode array 5 is reduced.

さらに、制御回路31は、始動時や、図3に示すタイミングt3のような第1オフ動作の終了時(すなわちバースト信号BRがLレベルとされるとき)には、第2基準電圧Vr2よりも高い電圧値のパルス信号(以下、「リスタート信号」と呼ぶ。)RSを、ダイオードD22と抵抗R28とを介して第2駆動回路20のZCD端子に出力する。インダクタ電流IL2が0の状態では、図3に示すタイミングt4のようなリスタート信号RSの立ち下がりにより、第2比較部CP2の出力がHレベルとなってスイッチング素子Q2がオン駆動される。   Further, the control circuit 31 has a voltage higher than that of the second reference voltage Vr2 at the time of starting or at the end of the first off operation such as timing t3 shown in FIG. 3 (that is, when the burst signal BR is set to L level). A high voltage pulse signal (hereinafter referred to as “restart signal”) RS is output to the ZCD terminal of the second drive circuit 20 via the diode D22 and the resistor R28. In the state where the inductor current IL2 is 0, the output of the second comparison unit CP2 becomes H level and the switching element Q2 is turned on by the falling of the restart signal RS at the timing t4 shown in FIG.

第2駆動回路20の動作の別の例を図4に示す。図4の例では、バースト信号BRのLレベルの継続時間が非常に短いことにより、インダクタ電流IL2が0に達するタイミングt6では常にバースト信号BRにより検出電圧Vdが基準電圧Vr1以上となっている。この結果、スイッチング素子Q2のオン制御がリスタート信号RSによってのみ行われている。また、バースト信号BRが立ち下がったタイミングt3の後、検出電圧Vdが低下しきる前に、再びバースト信号BRが立ち上がるタイミングt0となる。これにより、バースト信号BRが立ち上がってから検出電圧Vdが第1基準電圧Vr1に達するまでの時間t0〜t5が図3の例よりも短くなり、従ってリスタート信号RSによるオン状態の継続時間t4〜t5も短くなっている。図4の例のように、検出電圧Vdが第1基準電圧Vr1に達する前にゼロクロス電圧Vzが立ち下がるのであれば、バースト信号BRのLレベルの継続時間t3〜t0がリスタート信号RSのパルス幅t3〜t4よりも短くても、出力が完全に停止されることはない。   Another example of the operation of the second drive circuit 20 is shown in FIG. In the example of FIG. 4, since the duration of the L level of the burst signal BR is very short, the detection voltage Vd is always equal to or higher than the reference voltage Vr1 by the burst signal BR at the timing t6 when the inductor current IL2 reaches zero. As a result, the ON control of the switching element Q2 is performed only by the restart signal RS. In addition, after the timing t3 when the burst signal BR falls, the timing t0 when the burst signal BR rises again before the detection voltage Vd is fully reduced. As a result, the time t0 to t5 from when the burst signal BR rises until the detection voltage Vd reaches the first reference voltage Vr1 is shorter than that in the example of FIG. t5 is also shortened. If the zero cross voltage Vz falls before the detection voltage Vd reaches the first reference voltage Vr1 as in the example of FIG. 4, the durations t3 to t0 of the L level of the burst signal BR are pulses of the restart signal RS. Even if it is shorter than the widths t3 to t4, the output is not completely stopped.

また、図1における図示は省略されているが、各駆動回路10,20は、それぞれ、グランドに接続されるGND端子と、抵抗R13,R23を介してグランドに接続されるRT端子と、コンデンサC11,C21を介してグランドに接続されるCOMP端子とを有する。RT端子はオン状態の継続時間(以下、「オン幅」と呼ぶ。)の上限(以下、「最大オン幅」と呼ぶ。)を設定するための端子である。すなわち、各駆動回路10,20は、スイッチング素子Q1,Q2のオン幅が、RT端子とグランドとの間の抵抗R13,R23に応じた最大オン幅に達したときにも、スイッチング素子Q1,Q2をオフする。また、COMP端子に接続されたコンデンサC11,C21は、電源電圧VCC1が所定値(例えば9V)を下回ったときに放電され、電源電圧VCC1が所定値(例えば13V)を上回ったときに充電を開始される。また、各駆動回路10,20は、COMP端子の電圧が低いほど、スイッチング素子Q1,Q2の最大オン幅を小さくする。以上により、電源がオンされた直後には、スイッチング素子Q1,Q2の最大オン幅が徐々に大きくされるというソフトスタートが達成される。また、各駆動回路10,20は、COMP端子への入力電圧が所定電圧よりも低いときには、他の端子への入力電圧に関わらずスイッチング素子Q1,Q2をオフ状態に維持する。   Although not shown in FIG. 1, each of the drive circuits 10 and 20 includes a GND terminal connected to the ground, an RT terminal connected to the ground via resistors R13 and R23, and a capacitor C11. , And a COMP terminal connected to the ground via C21. The RT terminal is a terminal for setting an upper limit (hereinafter referred to as “maximum ON width”) of the ON state duration (hereinafter referred to as “ON width”). That is, each of the drive circuits 10 and 20 includes the switching elements Q1 and Q2 even when the ON width of the switching elements Q1 and Q2 reaches the maximum ON width according to the resistors R13 and R23 between the RT terminal and the ground. Turn off. The capacitors C11 and C21 connected to the COMP terminal are discharged when the power supply voltage VCC1 falls below a predetermined value (for example, 9V), and charging starts when the power supply voltage VCC1 exceeds a predetermined value (for example, 13V). Is done. In addition, each of the drive circuits 10 and 20 decreases the maximum ON width of the switching elements Q1 and Q2 as the voltage at the COMP terminal is lower. As described above, the soft start in which the maximum ON width of the switching elements Q1, Q2 is gradually increased immediately after the power is turned on is achieved. In addition, when the input voltage to the COMP terminal is lower than the predetermined voltage, each of the drive circuits 10 and 20 maintains the switching elements Q1 and Q2 in the off state regardless of the input voltage to the other terminals.

また、第2駆動回路20のFB端子には電源電圧VCC1が分圧抵抗R26,R27によって分圧された電圧が入力されている。さらに、第2駆動回路20のFB端子は、スイッチング素子(以下、「待機用スイッチング素子」と呼ぶ。)Q21を介してグランドに接続されている。待機用スイッチング素子Q21は例えばNPNトランジスタからなり、ベースが抵抗R24を介して制御回路31に接続されている。制御回路31は、抵抗R24を介して待機用スイッチング素子Q21に接続された端子から出力する電圧信号(以下、「待機信号」と呼ぶ。)ENにより、待機用スイッチング素子Q21をオンオフ制御する。   A voltage obtained by dividing the power supply voltage VCC1 by the voltage dividing resistors R26 and R27 is input to the FB terminal of the second drive circuit 20. Furthermore, the FB terminal of the second drive circuit 20 is connected to the ground via a switching element (hereinafter referred to as “standby switching element”) Q21. The standby switching element Q21 is made of, for example, an NPN transistor, and its base is connected to the control circuit 31 via a resistor R24. The control circuit 31 performs on / off control of the standby switching element Q21 by a voltage signal (hereinafter referred to as “standby signal”) EN output from a terminal connected to the standby switching element Q21 via the resistor R24.

さらに、第2駆動回路20は、FB端子への入力電圧が反転入力端子に入力され所定の第3基準電圧Vr3が非反転入力端子に入力されたコンパレータからなる第3比較部CP3を備える。また、第2駆動回路20は、第3比較部CP3の出力がHレベルとなったときに第1比較部CP1や第2比較部CP2への電力の供給を停止させるデバイスコントローラSCを備える。すなわち、第1駆動回路10のように、出力電圧を分圧抵抗R15,R16で分圧した電圧がFB端子に入力されてフィードバック動作が行われる場合において、低電圧側の分圧抵抗R15の短絡や、高電圧側の分圧抵抗R16の開放が発生した場合であっても、デバイスコントローラSCの上記動作により、上記のフィードバック動作で出力電圧が過剰に高くなることが防止される。待機用スイッチング素子Q21がオフされた状態での第2駆動回路20のFB端子への入力電圧(つまり、電源電圧VCC1が分圧抵抗R26,R27によって分圧された電圧)は、第3基準電圧Vr3よりも高くされている。すなわち、待機用スイッチング素子Q21がオフされている期間には第3比較部CP3の出力はLレベルとなり、待機用スイッチング素子Q21がオンされると第3比較部CP3の出力はHレベルとなる。   Further, the second drive circuit 20 includes a third comparison unit CP3 including a comparator in which an input voltage to the FB terminal is input to the inverting input terminal and a predetermined third reference voltage Vr3 is input to the non-inverting input terminal. The second drive circuit 20 includes a device controller SC that stops supplying power to the first comparison unit CP1 and the second comparison unit CP2 when the output of the third comparison unit CP3 becomes H level. That is, as in the first drive circuit 10, when a voltage obtained by dividing the output voltage by the voltage dividing resistors R15 and R16 is input to the FB terminal and a feedback operation is performed, a short circuit of the voltage dividing resistor R15 on the low voltage side is performed. Even when the high voltage side voltage dividing resistor R16 is opened, the operation of the device controller SC prevents the output voltage from becoming excessively high in the feedback operation. The input voltage to the FB terminal of the second drive circuit 20 in a state where the standby switching element Q21 is turned off (that is, the voltage obtained by dividing the power supply voltage VCC1 by the voltage dividing resistors R26 and R27) is the third reference voltage. It is higher than Vr3. That is, when the standby switching element Q21 is off, the output of the third comparison unit CP3 is at L level, and when the standby switching element Q21 is on, the output of the third comparison unit CP3 is at H level.

以下、本発明の特徴である、第2オフ動作について説明する。   Hereinafter, the second off operation, which is a feature of the present invention, will be described.

制御回路31には、入力コンデンサC0の両端電圧が分圧抵抗R51,R52によって分圧された電圧が入力されており、この電圧に基いて制御回路31は停電を検出する。制御回路31は、消灯を指示する信号が信号入力回路30に入力されたとき、及び、停電が検出されたときに、第1比較部CP1や第2比較部CP2への電力の供給が停止される第2オフ動作への移行を開始する。第2オフ動作への移行の際には、制御回路31は、まず、図5におけるタイミングt7のようにバースト信号BRをHレベルとして第1オフ動作を開始する。次に、制御回路31は、図5におけるタイミングt8のように待機信号ENをHレベルとして待機用スイッチング素子Q21をオンすることでFB端子の電圧を低下させ、第3比較部CP3の出力をHレベルとする。これにより、第1比較部CP1や第2比較部CP2への電力の供給が停止される第2オフ動作が開始される。また、制御回路31は、図5におけるタイミングt9のように、第2オフ動作の開始後に、バースト信号BRをLレベルとして第1オフ動作を終了することで、バースト信号BRによる電力消費を停止させる。制御回路31は、バースト信号BRをLレベルとして第1オフ動作を終了する際、上記のタイミングt9のように第2オフ動作中であれば(つまり待機信号ENがHレベルであれば)リスタート信号RSを出力しない。   A voltage obtained by dividing the voltage across the input capacitor C0 by the voltage dividing resistors R51 and R52 is input to the control circuit 31, and the control circuit 31 detects a power failure based on this voltage. The control circuit 31 stops supplying power to the first comparison unit CP1 and the second comparison unit CP2 when a signal to turn off is input to the signal input circuit 30 and when a power failure is detected. The transition to the second off operation is started. At the time of shifting to the second off operation, the control circuit 31 first sets the burst signal BR to the H level and starts the first off operation at the timing t7 in FIG. Next, the control circuit 31 lowers the voltage of the FB terminal by turning on the standby switching element Q21 by setting the standby signal EN to the H level as shown at timing t8 in FIG. 5, and the output of the third comparison unit CP3 is set to H. Level. Thereby, the second off operation in which the supply of power to the first comparison unit CP1 and the second comparison unit CP2 is stopped is started. Further, the control circuit 31 stops the power consumption by the burst signal BR by ending the first off operation by setting the burst signal BR to the L level after the start of the second off operation, as at the timing t9 in FIG. . When the control circuit 31 ends the first off operation by setting the burst signal BR to the L level, the control circuit 31 restarts if the second off operation is in progress as in the timing t9 (that is, if the standby signal EN is at the H level). The signal RS is not output.

第2オフ動作中であって停電が検出されていない状態で、点灯を指示する信号が信号入力回路30に入力された場合、制御回路31は第2オフ動作からの復帰を開始する。第2オフ動作から復帰する際には、制御回路31は、まず、図6におけるタイミングt10のようにバースト信号BRをHレベルとして第1オフ動作を開始する。その後、制御回路31は、図6におけるタイミングt11のように、待機信号ENをLレベルとして待機用スイッチング素子Q21をオフし第2オフ動作を終了する。その後、制御回路31は、図6におけるタイミングt12のようにバースト信号BRをLレベルとして第1オフ動作を終了するとともに、リスタート信号RSを出力する。   When a signal instructing lighting is input to the signal input circuit 30 in a state where the second off operation is being performed and no power failure has been detected, the control circuit 31 starts returning from the second off operation. When returning from the second off operation, the control circuit 31 first sets the burst signal BR to the H level and starts the first off operation as shown at timing t10 in FIG. Thereafter, as shown at timing t11 in FIG. 6, the control circuit 31 sets the standby signal EN to the L level to turn off the standby switching element Q21 and ends the second off operation. Thereafter, the control circuit 31 sets the burst signal BR to the L level as shown at timing t12 in FIG. 6 to complete the first off operation and outputs the restart signal RS.

また、ブーストコンバータ1において、第1駆動回路10のCOMP端子はスイッチング素子Q11を介してグランドに接続されている。上記のスイッチング素子Q11はNPNトランジスタからなり、上記のスイッチング素子Q11のベースには、待機信号ENが抵抗R14を介して入力される。すなわち、第2オフ動作中には、上記のスイッチング素子Q11がオンされることで、第1駆動回路10のCOMP端子の電圧が低下することにより、ブーストコンバータ1のスイッチング素子Q1はオフ状態に維持される。   In the boost converter 1, the COMP terminal of the first drive circuit 10 is connected to the ground via the switching element Q11. The switching element Q11 is composed of an NPN transistor, and a standby signal EN is input to the base of the switching element Q11 via a resistor R14. That is, during the second off operation, the switching element Q11 is turned on, so that the voltage at the COMP terminal of the first drive circuit 10 decreases, so that the switching element Q1 of the boost converter 1 is maintained in the off state. Is done.

上記構成によれば、出力が長時間停止される場合には、検出電圧Vdの変更による第1オフ動作ではなく、第2オフ動作が行われる。第2オフ動作中には、第1比較部CP1や第2比較部CP2への電力の供給が停止される。また、本実施形態においては、待機信号ENによる消費電力は、バースト信号BRによる消費電力よりも少ない。従って、第1オフ動作が継続される場合に比べ、待機電力が低減される。   According to the above configuration, when the output is stopped for a long time, the second off operation is performed instead of the first off operation by changing the detection voltage Vd. During the second off operation, the supply of power to the first comparison unit CP1 and the second comparison unit CP2 is stopped. In the present embodiment, the power consumption by the standby signal EN is less than the power consumption by the burst signal BR. Therefore, the standby power is reduced as compared with the case where the first off operation is continued.

また、制御回路31は、第2オフ動作を開始する際には、まず第1オフ動作を開始してから、第1オフ動作中に第2オフ動作を開始する。第2オフ動作のみでスイッチング素子Q2をオフする際にかかる時間のばらつきが、第1オフ動作のみでスイッチング素子Q2をオフする際にかかる時間のばらつきよりも大きい場合、上記動作により、スイッチング素子Q2がオフされるタイミングのばらつき(つまり発光ダイオードアレイ5の消灯のタイミングのばらつき)が抑えられる。また、第2オフ動作の開始直後の消費電力の低下速度よりも第1オフ動作の開始直後の消費電力の低下速度のほうが速い場合、上記動作により、第1オフ動作を開始せずに第2オフ動作を開始する場合に比べ、より高速に消費電力を低下させることができる。特に、制御回路31が不揮発性メモリを有し、停電が検出されたことで第2オフ動作を開始する際に不揮発性メモリ内のデータを書き換える場合、データの書き換えに必要な電力を確保するためには、上記のように高速に消費電力が低下されることが望ましい。   Further, when starting the second off operation, the control circuit 31 first starts the first off operation and then starts the second off operation during the first off operation. When the variation in time taken to turn off the switching element Q2 only by the second off operation is larger than the time variation taken to turn off the switching element Q2 only by the first off operation, the above operation causes the switching element Q2 to turn off. Variation in timing at which the light emitting diode is turned off (that is, variation in timing of turning off the light emitting diode array 5) is suppressed. In addition, when the power consumption decrease rate immediately after the start of the first off operation is faster than the power consumption decrease rate immediately after the start of the second off operation, the above operation causes the second off without starting the first off operation. The power consumption can be reduced at a higher speed than when the off operation is started. In particular, when the control circuit 31 has a nonvolatile memory and the data in the nonvolatile memory is rewritten when the second off operation is started due to the detection of a power failure, the power necessary for the data rewriting is ensured. Therefore, it is desirable that the power consumption is reduced at a high speed as described above.

さらに、制御回路31は、第2オフ動作を終了する際には、まず第1オフ動作を開始してから、第1オフ動作中に第2オフ動作を終了する。第2オフ動作を終了してからスイッチング素子Q2をオンするまでに必要な時間のばらつきが、第1オフ動作を終了してからスイッチング素子Q2をオンするまでに必要な時間のばらつきよりも大きい場合、上記動作により、第2オフ動作の終了後にスイッチング素子Q2がオンされるタイミングのばらつき(つまり発光ダイオードアレイ5の点灯のタイミングのばらつき)が抑えられる。   Furthermore, when ending the second off operation, the control circuit 31 first starts the first off operation and then ends the second off operation during the first off operation. When the variation in time required from the end of the second off operation to turning on the switching element Q2 is greater than the variation in time required from the end of the first off operation to turning on the switching element Q2 By the above operation, variation in timing when the switching element Q2 is turned on after the second off operation is completed (that is, variation in lighting timing of the light emitting diode array 5) is suppressed.

なお、第1オフ動作としては、上記のように検出電圧Vdを変更するものに代えて、第1基準電圧Vr1を変更するものも考えられる。具体的には、制御回路31は、第1オフ動作の際には第1基準電圧Vr1を0とし、少なくとも第1オフ動作中には所定のオフセット電圧を検出電圧Vdに重畳する。上記のオフセット電圧は、第1比較部CP1の出力を確実にHレベルとするためのものであり、例えば数百mVである。ただし、上記のように第1基準電圧Vr1を可変とするために第2駆動回路20に端子を追加すると、第2駆動回路20へのノイズの進入の経路が増加することにより第2駆動回路20がノイズの影響を受けやすくなってしまう。従って、第1オフ動作は、検出電圧Vdを第1基準電圧Vr1よりも高くするものであることが望ましい。   Note that, as the first off operation, it is also possible to change the first reference voltage Vr1 instead of changing the detection voltage Vd as described above. Specifically, the control circuit 31 sets the first reference voltage Vr1 to 0 during the first off operation, and superimposes a predetermined offset voltage on the detection voltage Vd at least during the first off operation. The offset voltage is for surely setting the output of the first comparison unit CP1 to the H level, and is several hundred mV, for example. However, when a terminal is added to the second drive circuit 20 in order to make the first reference voltage Vr1 variable as described above, the path of noise intrusion into the second drive circuit 20 is increased, and thus the second drive circuit 20 is increased. Becomes susceptible to noise. Therefore, it is desirable that the first off operation is to make the detection voltage Vd higher than the first reference voltage Vr1.

また、第2オフ動作は、上記のようにFB端子をグランドに短絡するものに限られない。例えば、第2駆動回路20が、COMP端子への入力電圧が所定値よりも低い場合に第1比較部CP1や第2比較部CP2への電力供給が停止されるような回路構成を有する場合、第2オフ動作はCOMP端子をグランドに短絡するものであってもよい。具体的には、図7に示すように、待機用スイッチング素子Q21をFB端子ではなくCOMP端子に接続する。つまり、待機用スイッチング素子Q21は、第2オフ動作において制御回路31からの待機信号ENによりオン制御され、COMP端子をグランドに短絡する。この場合、COMP端子に接続されたコンデンサC21は第2オフ動作中に放電されるから、第2オフ動作の終了直後には、電源がオンされた直後と同様のソフトスタートが行われる。   Further, the second off operation is not limited to short-circuiting the FB terminal to the ground as described above. For example, when the second drive circuit 20 has a circuit configuration in which power supply to the first comparison unit CP1 and the second comparison unit CP2 is stopped when the input voltage to the COMP terminal is lower than a predetermined value, The second off operation may short-circuit the COMP terminal to the ground. Specifically, as shown in FIG. 7, the standby switching element Q21 is connected to the COMP terminal instead of the FB terminal. That is, the standby switching element Q21 is ON-controlled by the standby signal EN from the control circuit 31 in the second OFF operation, and shorts the COMP terminal to the ground. In this case, since the capacitor C21 connected to the COMP terminal is discharged during the second off operation, the same soft start as that immediately after the power is turned on is performed immediately after the end of the second off operation.

さらに、第2オフ動作としては、上記のように駆動回路10,20の一部(第1比較部CP1等)への電力供給を停止させるもの以外に、駆動回路10,20の全体への電力供給を停止させるものが考えられる。具体的には例えば、図8に示すように、制御電源回路4において、主に各駆動回路10,20の電源となるコンデンサ(以下、「第1電源コンデンサ」と呼ぶ。)C41を、主に制御回路31の電源となるコンデンサ(以下、「第2電源コンデンサ」と呼ぶ。)C42とは別途に設ける。さらに、制御回路31からの待機信号ENに従ってレギュレータ40から第1電源コンデンサC41への充電をオンオフするスイッチング素子Q4を設ける。上記のスイッチング素子Q4は、例えばベースが制御回路31とエミッタとにそれぞれ抵抗R40,R41を介して接続されたPNPトランジスタからなる。すなわち、上記のスイッチング素子Q4は、待機信号ENがLレベルである期間中にはオン状態となり、待機信号ENがHレベルである期間中にはオフ状態となる。この場合、図9に示すように、第2オフ動作の開始後に第1オフ動作を終了する(すなわちバースト信号BRをLレベルとする)タイミングt9は、第1電源コンデンサC41の両端電圧VCC1が0まで低下したタイミングt13よりも後とされる。また、図10に示すように、第2オフ動作の終了後に第1オフ動作を終了する(バースト信号BRをLレベルとする)タイミングt12は、第1電源コンデンサC41の両端電圧VCC1が安定したタイミングt14よりも後とされる。上記構成を採用すれば、第2オフ動作では各駆動回路10,20の全体への電力供給が停止されるから、図1の例や図7の例のように各駆動回路10,20の一部(第3比較部CP3やデバイスコントローラSCなど)への電力供給が継続される場合と比べ、第2オフ動作における消費電力が低減される。これにより、さらに待機電力を低減することができる。   Further, as the second off operation, the power to the entire drive circuits 10 and 20 other than the power supply to a part of the drive circuits 10 and 20 (such as the first comparison unit CP1) as described above is stopped. The thing which stops supply can be considered. Specifically, for example, as shown in FIG. 8, in the control power supply circuit 4, a capacitor (hereinafter referred to as “first power supply capacitor”) C <b> 41 mainly serving as a power supply for the drive circuits 10 and 20 is mainly used. A capacitor (hereinafter referred to as a “second power supply capacitor”) C42 serving as a power source for the control circuit 31 is provided separately. Further, a switching element Q4 for turning on / off charging from the regulator 40 to the first power supply capacitor C41 according to the standby signal EN from the control circuit 31 is provided. The switching element Q4 includes, for example, a PNP transistor whose base is connected to the control circuit 31 and the emitter via resistors R40 and R41, respectively. That is, the switching element Q4 is turned on during the period when the standby signal EN is at the L level, and is turned off while the standby signal EN is at the H level. In this case, as shown in FIG. 9, at the timing t9 when the first off operation is finished after the second off operation is started (that is, when the burst signal BR is set to the L level), the voltage VCC1 across the first power supply capacitor C41 is 0. It is after the timing t13 when the time has decreased. As shown in FIG. 10, the timing t12 at which the first off operation ends (the burst signal BR is set to the L level) after the second off operation ends is a timing at which the voltage VCC1 across the first power supply capacitor C41 is stabilized. It is after t14. If the above configuration is adopted, since the power supply to the entire drive circuits 10 and 20 is stopped in the second off operation, one of the drive circuits 10 and 20 as in the example of FIG. 1 or the example of FIG. The power consumption in the second off operation is reduced compared to the case where the power supply to the units (the third comparison unit CP3, the device controller SC, etc.) is continued. Thereby, standby power can be further reduced.

また、図11に示すように、1個のブーストコンバータ1の出力端に、複数個(図11では3個)のバックコンバータ2を互いに並列に接続してもよい。図11の例では、リスタート信号RSは全てのバックコンバータ2で共通とされる一方で、バースト信号BR1,BR2,BR3はバックコンバータ2毎に個別に入力されている。これにより、図12に示すように、第1オフ動作の終了のタイミングt3を全てのバックコンバータ2で共通としつつ、第1オフ動作の開始のタイミングt15,t16,t17をバックコンバータ2毎に異ならせることが可能となっている。そして、第1オフ動作の開始のタイミングt15,t16,t17が早いバックコンバータ2ほど、バースト信号BR1,BR2,BR3がHレベルとされる期間が長くなり、駆動電圧Vo1,Vo2,Vo3が出力される期間が短くなる。また、図13に示すように、第2オフ動作への移行が開始されたタイミングt7では、その時点で第1オフ動作を行っていない全て(図13の例では2個)のバックコンバータ2に対して同時にバースト信号BR1,BR2の出力が開始される。   As shown in FIG. 11, a plurality (three in FIG. 11) of buck converters 2 may be connected in parallel to the output terminal of one boost converter 1. In the example of FIG. 11, the restart signal RS is common to all the buck converters 2, while the burst signals BR 1, BR 2, and BR 3 are individually input for each buck converter 2. Accordingly, as shown in FIG. 12, the timing t3 of the end of the first off operation is common to all the buck converters 2, and the timings t15, t16, and t17 of the start of the first off operation are different for each back converter 2. It is possible to make it. Then, as the buck converter 2 with the earlier timings t15, t16, and t17 of the first off operation starts, the period during which the burst signals BR1, BR2, and BR3 are set to the H level becomes longer, and the drive voltages Vo1, Vo2, and Vo3 are output. The period to be shortened. In addition, as shown in FIG. 13, at the timing t7 when the transition to the second off operation is started, all (two in the example of FIG. 13) buck converters 2 that have not performed the first off operation at that time. At the same time, output of burst signals BR1 and BR2 is started.

さらに、トリガー生成部がトリガーを生成する条件としては、上記のようにインダクタ電流IL2のゼロクロスが検出されたという条件に代えて、以前にトリガーが生成されてから一定時間が経過したという条件を採用することも考えられる。この場合、トリガー生成部は、上記の一定時間おきに周期的にトリガーを生成する回路となる。このようなトリガー生成部は周知技術で実現可能であるので、詳細な図示並びに説明は省略する。   Furthermore, as a condition for the trigger generating unit to generate a trigger, a condition that a certain time has elapsed since the trigger was previously generated is adopted instead of the condition that the zero crossing of the inductor current IL2 is detected as described above. It is also possible to do. In this case, the trigger generation unit is a circuit that periodically generates a trigger at regular intervals. Since such a trigger generation unit can be realized by a well-known technique, detailed illustration and description thereof will be omitted.

1 ブーストコンバータ(直流電源)
5 発光ダイオードアレイ
20 第2駆動回路
31 制御回路
CP1 第1比較部
CP2 第2比較部(トリガー生成部)
DR ドライバ(駆動部)
L2 インダクタ
Q2 スイッチング素子
R2 抵抗(電流検出部)
Vd 検出電圧
Vr1 第1基準電圧
1 Boost converter (DC power supply)
5 Light-Emitting Diode Array 20 Second Drive Circuit 31 Control Circuit CP1 First Comparison Unit CP2 Second Comparison Unit (Trigger Generation Unit)
DR driver (drive unit)
L2 Inductor Q2 Switching element R2 Resistance (current detector)
Vd detection voltage Vr1 first reference voltage

Claims (6)

インダクタと、
直流電源から前記インダクタへの電力の供給をオンオフするスイッチング素子と、
前記スイッチング素子に流れる電流に比例した電圧を出力する電流検出部と、
前記スイッチング素子をオンオフ駆動する駆動回路と、
前記駆動回路を制御する制御回路とを備え、
前記駆動回路は、所定の条件でトリガーを生成するトリガー生成部と、前記電流検出部の出力電圧が検出電圧として入力され前記検出電圧と基準電圧とを比較する比較部と、前記トリガー生成部が生成したトリガーと前記比較部での比較結果とに応じて前記スイッチング素子をオンオフ駆動する駆動部とを有し、
前記駆動部は、前記トリガー生成部がトリガーを生成したときに前記スイッチング素子をオンし、前記比較部での比較において前記検出電圧が前記基準電圧以上となったときに前記スイッチング素子をオフするものであって、
前記制御回路は、外部から入力される信号に応じて、
前記検出電圧と前記基準電圧との少なくとも一方を変更することで前記スイッチング素子をオフ状態に維持する第1オフ動作と、
前記駆動回路の少なくとも一部への電力の供給を停止させることで前記スイッチング素子をオフ状態に維持する第2オフ動作とを行うことを特徴とする電源装置。
An inductor;
A switching element for turning on and off the supply of power from a DC power source to the inductor;
A current detector that outputs a voltage proportional to the current flowing through the switching element;
A drive circuit for driving the switching element on and off;
A control circuit for controlling the drive circuit,
The drive circuit includes: a trigger generation unit that generates a trigger under a predetermined condition; a comparison unit that receives an output voltage of the current detection unit as a detection voltage and compares the detection voltage with a reference voltage; and the trigger generation unit According to the generated trigger and the comparison result in the comparison unit, the drive unit for driving the switching element on and off,
The drive unit turns on the switching element when the trigger generation unit generates a trigger, and turns off the switching element when the detected voltage becomes equal to or higher than the reference voltage in the comparison by the comparison unit. Because
The control circuit, in accordance with a signal input from the outside,
A first off operation for maintaining the switching element in an off state by changing at least one of the detection voltage and the reference voltage;
And a second off operation for maintaining the switching element in an off state by stopping the supply of power to at least a part of the drive circuit.
前記制御回路は、前記第1オフ動作において、前記検出電圧を前記基準電圧以上に維持することで前記スイッチング素子をオフ状態に維持することを特徴とする請求項1記載の電源装置。   2. The power supply device according to claim 1, wherein the control circuit maintains the switching element in an off state by maintaining the detection voltage equal to or higher than the reference voltage in the first off operation. 前記制御回路は、前記第2オフ動作において、前記駆動回路の全体への電力の供給を停止させることを特徴とする請求項1又は請求項2記載の電源装置。   3. The power supply device according to claim 1, wherein the control circuit stops supply of power to the entire drive circuit in the second off operation. 4. 前記制御回路は、前記第2オフ動作を開始する前に前記第1オフ動作を開始し、前記第2オフ動作の開始後に前記第1オフ動作を終了することを特徴とする請求項1〜3のいずれか1項に記載の電源装置。   The control circuit starts the first off operation before starting the second off operation, and ends the first off operation after starting the second off operation. The power supply device according to any one of the above. 前記制御回路は、前記第2オフ動作を終了する前に前記第1オフ動作を開始し、前記第2オフ動作の終了後に前記第1オフ動作を終了することを特徴とする請求項1〜4のいずれか1項に記載の電源装置。   5. The control circuit starts the first off operation before ending the second off operation, and ends the first off operation after the second off operation ends. The power supply device according to any one of the above. 請求項1〜5のいずれか1項に記載の電源装置と、前記電源装置の出力により点灯する発光ダイオードとを備えることを特徴とする照明器具。   An illumination fixture comprising: the power supply device according to any one of claims 1 to 5; and a light emitting diode that is turned on by an output of the power supply device.
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