JP5900727B2 - 発振回路、発振器、電子機器及び発振器の起動方法 - Google Patents
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Description
図1は、第1実施形態の発振回路の構成例を示す図である。本実施形態の発振回路1は、SAW共振子10、増幅回路20、NMOSスイッチ30、インバーター回路40、遅延回路50を含んで構成されている。ただし、本実施形態の発振回路1は、これらの要素の一部を省略したり、他の要素を追加した構成としてもよい。特に、遅延回路50は、発振回路1の外部に設けてもよい。
図4は、第2実施形態の発振回路の構成例を示す図である。第2実施形態の発振回路1は、可変容量ダイオード202とSAW共振子10の間に伸長コイル220が設けられている点のみが図1に示した第1実施形態の発振回路1と異なる。図4において、図1と同じ構成には同じ符号を付しており、その説明を省略する。
図6は、第3実施形態の発振回路の構成例を示す図である。第3実施形態の発振回路1は、伸長コイル200と並列に抵抗230が接続されるとともに、伸長コイル220と並列に抵抗240が接続されている点のみが図4に示した第2実施形態の発振回路1と異なる。図6において、図4と同じ構成には同じ符号を付しており、その説明を省略する。
Claims (10)
- 共振子の一端から他端へ向かう帰還経路、前記帰還経路中に設けられている第1のインダクタンス素子、および前記第1のインダクタンス素子と直列に接続されている可変容量素子、を有している増幅回路と、
前記第1のインダクタンス素子と前記可変容量素子との直列接続回路に対して並列に接続されているスイッチング素子と、
を含んでいることを特徴とする発振回路。 - 請求項1において、
前記スイッチング素子の動作を制御する信号が入力され、該入力された信号を遅延させて前記スイッチング素子に出力する遅延回路をさらに含むことを特徴とする発振回路。 - 請求項1または2において、
前記増幅回路は、前記第1のインダクタンス素子に対して並列又は直列に接続されている第1の抵抗をさらに含むことを特徴とする発振回路。 - 請求項1乃至3のいずれか一項において、
前記増幅回路は、前記共振子の出力信号を増幅する増幅素子を含み、
前記増幅素子と前記スイッチング素子とは、1つの集積回路チップに内蔵されていることを特徴とする発振回路。 - 請求項1乃至4のいずれか一項において、
前記増幅回路は、前記帰還経路上に、前記直列接続回路と直列に接続されている第2のインダクタンス素子を含むことを特徴とする発振回路。 - 請求項5において、
前記第2のインダクタンス素子は、前記第1のインダクタンス素子よりもインダクタンス値が小さいことを特徴とする発振回路。 - 請求項5または6において、
前記増幅回路は、前記第2のインダクタンス素子と並列又は直列に設けられている第2の抵抗をさらに含むことを特徴とする発振回路。 - 請求項1乃至7のいずれか一項に記載の発振回路と、共振子と、を含むことを特徴とする発振器。
- 請求項1乃至7のいずれか一項に記載の発振回路を含むことを特徴とする電子機器。
- 共振子と、前記共振子の一端から他端への帰還経路を有し、前記帰還経路においてインダクタンス素子と可変容量素子とが直列に接続されている増幅回路と、を含む発振器の起動方法であって、
電源を投入後、所定期間は、前記インダクタンス素子と前記可変容量素子との直列接続回路の両端を短絡させ、
前記所定期間経過後、前記直列接続回路の短絡を解除することを特徴とする発振器の起動方法。
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