JP5802014B2 - Signal processing apparatus and signal processing method - Google Patents

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Description

本発明は、リアルタイムに複数のストリームの信号処理を行う信号処理装置等に関するものである。   The present invention relates to a signal processing apparatus that performs signal processing of a plurality of streams in real time.

従来、リアルタイムに複数のストリームの信号処理を行う装置(特許文献1参照)や、FPGA(Field−Programmable Gate Array)などで回路構成を切り替えて使用する場合に、各構成の内部状態を保存する装置(特許文献2参照)等が開発されている。   2. Description of the Related Art Conventionally, a device that performs signal processing of a plurality of streams in real time (see Patent Document 1), and a device that stores an internal state of each component when the circuit configuration is switched using an FPGA (Field-Programmable Gate Array) or the like (See Patent Document 2) and the like have been developed.

特開2009−100206号公報JP 2009-100206 A 特許3520810号公報Japanese Patent No. 3520810

しかしながら、従来の信号処理装置においては、複数ストリームの時分割処理を行う場合、各ストリームの中断、再開に備えて、回路の内部状態をストリームごとに保存する機能が必要であるが、このような場合、メモリへの内部状態の書き込み、読み出しのオーバーヘッドにより、処理の効率が低下するという課題があった。   However, in the conventional signal processing apparatus, when performing time-sharing processing of a plurality of streams, a function for storing the internal state of the circuit for each stream is necessary in preparation for suspension and resumption of each stream. In this case, there is a problem that the processing efficiency is reduced due to the overhead of writing and reading the internal state into the memory.

本第一の発明の信号処理装置は、複数のストリームを受け付けるストリーム受付手段と、ストリーム受付手段が受け付けた複数のストリームを信号処理する信号処理手段と、ストリーム受付手段が受け付けた複数のストリームを時分割で切り替えて信号処理するように信号処理手段に指示する制御手段と、信号処理手段が信号処理した結果を出力する出力手段とを具備する信号処理装置である。   The signal processing apparatus according to the first aspect of the present invention includes a stream receiving unit that receives a plurality of streams, a signal processing unit that performs signal processing on the plurality of streams received by the stream receiving unit, and a plurality of streams received by the stream receiving unit. The signal processing apparatus includes a control unit that instructs the signal processing unit to perform signal processing by switching in division, and an output unit that outputs a result of signal processing performed by the signal processing unit.

このような構成により、複数のストリームをリアルタイムに処理することができる。   With such a configuration, a plurality of streams can be processed in real time.

また、本第二の発明の信号処理装置は、第一の発明に対して、ストリームの信号処理に関する情報である内部状態を保存し得る複数の保存手段をさらに具備し、制御手段は、時分割で、一のストリームの信号処理を中断し、他のストリームの信号処理を行うように信号処理手段に指示する場合に、一のストリームの信号処理に関する内部状態を複数の保存手段のうちの一の保存手段に保存し、一のストリームの信号処理を再開する場合に、一の保存手段に保存した内部状態を復元し、信号処理手段は、制御手段の指示に従って、一のストリームの信号処理を再開する場合に、制御手段が復元した内部状態を利用して一にストリームの信号処理を続行する信号処理装置である。   The signal processing apparatus according to the second aspect of the present invention further comprises a plurality of storage means capable of storing an internal state, which is information relating to stream signal processing, with respect to the first invention. When the signal processing unit is instructed to interrupt the signal processing of one stream and perform the signal processing of the other stream, the internal state relating to the signal processing of the one stream is set to one of the plurality of storage units. When the signal processing is saved in the storage means and the signal processing of one stream is resumed, the internal state saved in the one storage means is restored, and the signal processing means resumes the signal processing of one stream according to the instruction of the control means. In this case, the signal processing apparatus continues the signal processing of the stream by using the internal state restored by the control means.

このような構成により、内部状態を保存しながら、複数のストリームをリアルタイムに処理することができる。   With such a configuration, it is possible to process a plurality of streams in real time while preserving the internal state.

また、本第三の発明の信号処理装置は、第二の発明に対して、保存手段は、ストリームの数だけ存在し、制御手段は、一のストリームの信号処理に関する内部状態をストリームに対応する一の保存手段に保存する信号処理装置である。   Further, in the signal processing device of the third invention, in contrast to the second invention, there are as many storage means as the number of streams, and the control means corresponds to the internal state relating to the signal processing of one stream to the stream. This is a signal processing device for storing in one storage means.

このような構成により、処理の中断、再開に掛かるオーバーヘッドを軽減することができる。   With such a configuration, it is possible to reduce overhead required for interruption and resumption of processing.

また、本第四の発明の信号処理装置は、第二または第三の発明に対して、制御手段は、一のストリームの内部状態のうち、予め決められた復元に必要な1以上の内部状態のみを一の保存手段に保存する信号処理装置である。   In the signal processing device according to the fourth aspect of the present invention, in contrast to the second or third aspect of the invention, the control means includes one or more internal states necessary for a predetermined restoration among the internal states of one stream. Is a signal processing apparatus that stores only the data in one storage means.

このような構成により、保存する内部状態の容量を削減することができる。   With such a configuration, the capacity of the internal state to be saved can be reduced.

本発明による信号処理装置等によれば、効率よく、複数ストリームの時分割処理を行うことができる。   According to the signal processing apparatus and the like according to the present invention, it is possible to efficiently perform time division processing of a plurality of streams.

実施の形態における信号処理装置1のブロック図Block diagram of signal processor 1 in an embodiment 同信号処理装置1の構成例を示す図The figure which shows the structural example of the signal processing apparatus 1 同信号処理装置1の構成例を示す図The figure which shows the structural example of the signal processing apparatus 1

以下、本発明による信号処理装置等の実施形態について図面を参照して説明する。なお、実施の形態において同じ符号を付した構成要素は同様の動作を行うので、再度の説明を省略する場合がある。   Hereinafter, embodiments of a signal processing apparatus and the like according to the present invention will be described with reference to the drawings. In addition, since the component which attached | subjected the same code | symbol in embodiment performs the same operation | movement, description may be abbreviate | omitted again.

(実施の形態)
図1は、本実施の形態による信号処理装置のブロック図である。信号処理装置1は、ストリーム受付手段11、制御手段12、信号処理手段13、保存手段14、出力手段15を備える。
(Embodiment)
FIG. 1 is a block diagram of a signal processing apparatus according to this embodiment. The signal processing apparatus 1 includes a stream receiving unit 11, a control unit 12, a signal processing unit 13, a storage unit 14, and an output unit 15.

ストリーム受付手段11は、複数のストリームを受け付ける。ストリームとは、ストリーム信号のことであり、例えば、テレビ信号や、映像信号、音声信号、動画などである。また、ストリーム受付手段11は、通常、受け付けたストリームを任意の保存用メモリに保存する。   The stream receiving unit 11 receives a plurality of streams. A stream is a stream signal, for example, a television signal, a video signal, an audio signal, a moving image, or the like. In addition, the stream reception unit 11 normally stores the received stream in an arbitrary storage memory.

ストリーム受付手段11は、通常、IC等の集積回路で実現され得る。   The stream receiving means 11 can be usually realized by an integrated circuit such as an IC.

制御手段12は、後述の信号処理手段13に対して、複数のストリームを時分割で切り替えて信号処理する旨を指示する。ここで、信号処理の対象となるストリームは、ストリーム受付手段11が受け付けたストリームである。また、信号処理とは、テレビ信号や映像信号などの様々な信号を、数値的に処理することである。信号処理は、例えば、高画質化や、フォーマット変換、解像度変換などである。   The control unit 12 instructs the signal processing unit 13 described later to perform signal processing by switching a plurality of streams in a time division manner. Here, the stream subjected to signal processing is a stream received by the stream receiving unit 11. The signal processing is to numerically process various signals such as television signals and video signals. The signal processing includes, for example, high image quality, format conversion, resolution conversion, and the like.

高画質化とは、ビットレートの低い音声、映像等を、ビットレートの高い音声、映像等に変換することや、フレームレートの低い映像等を、フレームレートの高い映像等に変換することなどである。また、フォーマット変換とは、一の音声、映像等の形式(フォーマット)を、他の音声、映像等の形式に変換することなどである。また、解像度変換とは、低い解像度の映像を高い解像度の映像に変換することや、高い解像度の画像を低い解像度の画像に変換することなどである。   High image quality means converting low-bit-rate audio, video, etc. to high-bit-rate audio, video, etc., converting low-frame-rate video, etc., to high-frame-rate video, etc. is there. Also, format conversion refers to converting a format (format) of one sound, video, or the like into another audio, video, or the like format. The resolution conversion includes converting a low-resolution video into a high-resolution video, converting a high-resolution image into a low-resolution image, and the like.

また、制御手段12は、信号処理手段13が制御手段12からの指示に従い、一のストリームの信号処理を中断し、他のストリームの信号処理を開始する際に、中断直後の信号処理手段13の内部状態を、後述の複数の保存手段14のうちの一の保存手段14に保存する。「開始」には、「再開」の意味も含まれる。内部状態を保存する保存手段14は、通常、入力手段11が受け付けるストリームごとに予め決められている。つまり、入力手段11が受け付けるストリームに対して、信号処理手段13の内部状態を保存する保存手段14が対応付けられているということである。例えば、入力手段11が受け付けるストリームがA、Bの2つであり、信号処理装置1が保存手段aと保存手段bを備えている場合、制御手段12は、ストリームAを信号処理したときの信号処理手段13の内部状態を保存手段aに保存し、ストリームBを信号処理したときの信号処理手段13の内部状態を保存手段bに保存する。なお、ストリームと保存手段14との対応関係は、通常、制御手段12が保持しているものとする。   Further, the control means 12, when the signal processing means 13 interrupts the signal processing of one stream and starts the signal processing of another stream in accordance with the instruction from the control means 12, The internal state is stored in one storage unit 14 among a plurality of storage units 14 described later. “Start” includes the meaning of “resume”. The storage unit 14 that stores the internal state is usually predetermined for each stream received by the input unit 11. That is, the storage unit 14 that stores the internal state of the signal processing unit 13 is associated with the stream received by the input unit 11. For example, when the input unit 11 accepts two streams A and B, and the signal processing apparatus 1 includes the storage unit a and the storage unit b, the control unit 12 outputs a signal when the stream A is signal-processed. The internal state of the processing unit 13 is stored in the storage unit a, and the internal state of the signal processing unit 13 when the stream B is signal-processed is stored in the storage unit b. Note that the correspondence between the stream and the storage unit 14 is normally held by the control unit 12.

また、制御手段12は、内部状態の保存の際には、予め決められた復元に必要な1以上の内部状態のみを一の保存手段14に保存する。例えば、信号処理手段13の内部状態が4ビットのビット列で表現される場合であって、信号処理手段13が信号処理を行っている間、2ビット目と4ビット目のみが変化する場合、制御手段12は、変化しない1ビット目と3ビット目は保存せず、変化する2ビット目と4ビット目のみを保存手段14に保存する。   In addition, when storing the internal state, the control unit 12 stores only one or more internal states necessary for a predetermined restoration in the single storage unit 14. For example, when the internal state of the signal processing unit 13 is expressed by a 4-bit bit string, and only the second and fourth bits change while the signal processing unit 13 performs signal processing, the control is performed. The means 12 does not save the first and third bits that do not change, and saves only the second and fourth bits that change in the storage means 14.

また、制御手段12は、信号処理手段13が制御手段12からの指示に従い、一のストリームの信号処理を中断し、他のストリームの信号処理を開始する際に、保存手段14に保存されている内部状態を、信号処理手段13に対して復元する。例えば、上記のような場合、制御手段12は、保存手段14から2ビット目と4ビット目の内部状態を取得し、信号処理手段13の内部状態を表現するビット列の2ビット目と4ビット目に上書きする。   The control means 12 is stored in the storage means 14 when the signal processing means 13 interrupts signal processing of one stream and starts signal processing of another stream in accordance with an instruction from the control means 12. The internal state is restored to the signal processing means 13. For example, in the above case, the control unit 12 acquires the internal state of the second and fourth bits from the storage unit 14, and the second and fourth bits of the bit string representing the internal state of the signal processing unit 13. Overwrite to.

制御手段12は、通常、IC等の集積回路で実現され得るが、ソフトウェアで実現してもよい。   The control means 12 can be usually realized by an integrated circuit such as an IC, but may be realized by software.

信号処理手段13は、制御手段12の指示に従い、複数のストリームの信号処理を行う。ここで、信号処理を行うストリームは、ストリーム受付手段11が受け付けたストリームである。また、信号処理手段13は、一のストリームの信号処理を開始する際は、制御手段12が復元した内部状態を利用して、信号処理を開始する。そして、信号処理手段13は、ストリームを信号処理した結果を、任意の保存用メモリに保存する。   The signal processing means 13 performs signal processing of a plurality of streams in accordance with instructions from the control means 12. Here, the stream on which signal processing is performed is the stream received by the stream receiving unit 11. In addition, when starting signal processing of one stream, the signal processing unit 13 starts signal processing using the internal state restored by the control unit 12. The signal processing means 13 stores the result of signal processing of the stream in an arbitrary storage memory.

信号処理手段13は、通常、IC等の集積回路で実現され得るが、ソフトウェアで実現してもよい。   The signal processing means 13 can be usually realized by an integrated circuit such as an IC, but may be realized by software.

保存手段14は、信号処理手段13の内部状態を保存し得る。また、保存手段14は、通常、受付手段11が受け付けるストリームの数だけ存在し得るものとする。例えば、受付手段11が受け付けるストリームの数が2つである場合、保存手段14は2つ存在する。また、受付手段11が受け付けるストリームの数が3つである場合、保存手段14は3つ存在する。   The storage unit 14 can store the internal state of the signal processing unit 13. In addition, it is assumed that the storage unit 14 can normally exist as many as the number of streams received by the receiving unit 11. For example, when the number of streams received by the receiving unit 11 is two, there are two storage units 14. If the number of streams received by the receiving unit 11 is 3, there are three storage units 14.

保存手段14は、通常、IC等の集積回路で実現され得る。   The storage unit 14 can be usually realized by an integrated circuit such as an IC.

出力手段15は、信号処理手段13が信号処理した結果を出力する。出力手段15は、通常、IC等の集積回路で実現され得る。   The output means 15 outputs the result of signal processing by the signal processing means 13. The output means 15 can be usually realized by an integrated circuit such as an IC.

(具体例1)
本具体例において、信号処理回路の内部状態を2つの内部状態保存回路に保存しながら、時分割で、2つのストリームの信号処理を行う信号処理装置について説明する。図2は、本具体例における信号処理装置の構成例を示す図である。信号処理装置2は、入力処理回路211、212、信号保存用メモリ220、制御回路230、切替回路240、信号処理回路250、内部状態保存回路261、262、出力処理回路271、272を備える。また、制御回路230は、入力用キュー2310と、出力用キュー2321、2322を備える。なお、入力処理回路211、212は、図1のストリーム受付手段11に相当する。制御回路230と切替回路240は、図1の制御手段12に相当する。信号処理回路250は、図1の信号処理手段13に相当する。内部状態保存回路261、262は、図1の保存手段14に相当する。出力処理回路271、272は、図1の出力手段15に相当する。
(Specific example 1)
In this specific example, a signal processing apparatus that performs signal processing of two streams in a time-division manner while storing the internal state of the signal processing circuit in two internal state storage circuits will be described. FIG. 2 is a diagram illustrating a configuration example of the signal processing device according to the present specific example. The signal processing device 2 includes input processing circuits 211 and 212, a signal storage memory 220, a control circuit 230, a switching circuit 240, a signal processing circuit 250, internal state storage circuits 261 and 262, and output processing circuits 271 and 272. The control circuit 230 includes an input queue 2310 and output queues 2321 and 2322. The input processing circuits 211 and 212 correspond to the stream receiving unit 11 in FIG. The control circuit 230 and the switching circuit 240 correspond to the control unit 12 in FIG. The signal processing circuit 250 corresponds to the signal processing means 13 in FIG. The internal state storage circuits 261 and 262 correspond to the storage unit 14 of FIG. The output processing circuits 271 and 272 correspond to the output unit 15 in FIG.

入力処理回路211、212には、信号処理の対象となるストリームが入力される。なお、入力処理回路211、212に入力されたストリームを、以下、入力ストリームとする。信号保存用メモリ220には、入力ストリームや、信号処理回路250が入力ストリームを信号処理した結果である信号処理結果などが保存される。制御回路230は、切替回路240、信号処理回路250、出力処理回路271、272の制御を行う。切替回路240は、信号処理回路250と内部状態保存回路261、262の接続の切り替えを行う。信号処理回路250は、制御回路230からの制御信号に応じて、入力ストリームの信号処理を行う。内部状態保存回路261、262には、信号処理回路250の内部状態が保存される。出力処理回路271、272は、信号処理結果を出力する。   The input processing circuits 211 and 212 are input with a stream to be subjected to signal processing. The streams input to the input processing circuits 211 and 212 are hereinafter referred to as input streams. In the signal storage memory 220, an input stream, a signal processing result that is a result of signal processing of the input stream by the signal processing circuit 250, and the like are stored. The control circuit 230 controls the switching circuit 240, the signal processing circuit 250, and the output processing circuits 271 and 272. The switching circuit 240 switches the connection between the signal processing circuit 250 and the internal state storage circuits 261 and 262. The signal processing circuit 250 performs signal processing of the input stream according to the control signal from the control circuit 230. The internal state storage circuits 261 and 262 store the internal state of the signal processing circuit 250. The output processing circuits 271 and 272 output signal processing results.

入力処理回路211、212にストリームが入力されると、入力処理回路211、212は、入力ストリームを信号保存用メモリ220に保存する。このとき、入力処理回路211、212は、信号処理回路250が処理する処理単位ごとに保存する。処理単位は、通常、フィールドである。保存が完了すると、入力処理回路211、212は、処理リクエスト信号と、入力ストリーム保存アドレスと、入力処理回路識別IDとを、制御回路230に送信する。処理リクエスト信号とは、信号処理の要求を示す制御信号である。また、入力ストリーム保存アドレスとは、入力ストリームの信号保存用メモリ220上の保存場所を示すアドレスである。また、入力処理回路識別IDとは、入力処理回路211、212のそれぞれに割り振られたIDである。なお、入力処理回路211、212は、処理単位ごとに入力ストリームを保存するため、保存された処理単位ごとの入力ストリーム保存アドレスを、制御回路230に送信する。   When a stream is input to the input processing circuits 211 and 212, the input processing circuits 211 and 212 store the input stream in the signal storage memory 220. At this time, the input processing circuits 211 and 212 store each processing unit processed by the signal processing circuit 250. The processing unit is usually a field. When the storage is completed, the input processing circuits 211 and 212 transmit the processing request signal, the input stream storage address, and the input processing circuit identification ID to the control circuit 230. The processing request signal is a control signal indicating a request for signal processing. The input stream storage address is an address indicating a storage location on the signal storage memory 220 of the input stream. The input processing circuit identification ID is an ID assigned to each of the input processing circuits 211 and 212. The input processing circuits 211 and 212 transmit the stored input stream storage address for each processing unit to the control circuit 230 in order to store the input stream for each processing unit.

制御回路230は、処理リクエスト信号と、入力ストリーム保存アドレスと、入力処理回路識別IDを、入力処理回路211、212から受信する。そして、制御回路230は、受信したこれらを、入力用キュー2310に保存する。   The control circuit 230 receives the processing request signal, the input stream storage address, and the input processing circuit identification ID from the input processing circuits 211 and 212. Then, the control circuit 230 stores the received data in the input queue 2310.

次に、制御回路230は、信号処理回路250が信号処理を行っていないか否かを判断する。そして、信号処理回路250が信号処理を行っていない場合、制御回路230は、入力用キュー2310に保存されている先頭のリクエストを実行するための制御を行う。具体的には、制御回路230は、入力処理回路識別IDを切替回路240に送信し、処理開始信号と、入力ストリーム保存アドレスとを、信号処理回路250に送信する。なお、処理開始信号とは、信号処理の開始を示す制御信号である。また、信号処理を行っていないか否かの判断は、信号処理を行っていないことを示す制御信号である非処理中信号を、信号処理回路250が出力しているか否かで判断する。   Next, the control circuit 230 determines whether or not the signal processing circuit 250 is performing signal processing. When the signal processing circuit 250 is not performing signal processing, the control circuit 230 performs control for executing the first request stored in the input queue 2310. Specifically, the control circuit 230 transmits an input processing circuit identification ID to the switching circuit 240 and transmits a processing start signal and an input stream storage address to the signal processing circuit 250. The process start signal is a control signal indicating the start of signal processing. Whether or not signal processing is being performed is determined based on whether or not the signal processing circuit 250 is outputting a non-processing signal that is a control signal indicating that signal processing is not being performed.

また、制御回路230は、処理完了信号と、処理結果保存アドレスとを、信号処理回路250から受信する。処理完了信号とは、信号処理の完了を示す制御信号である。また、処理結果保存アドレスとは、信号処理結果の信号保存用メモリ220上の保存場所を示すアドレスである。そして、制御回路230は、受信した処理結果保存アドレスを、出力用キュー2321、2322に保存する。   In addition, the control circuit 230 receives a processing completion signal and a processing result storage address from the signal processing circuit 250. The processing completion signal is a control signal indicating completion of signal processing. The processing result storage address is an address indicating a storage location on the signal storage memory 220 of the signal processing result. The control circuit 230 stores the received processing result storage address in the output queues 2321 and 2322.

また、制御回路230は、出力リクエスト信号を、出力処理回路271、272から受信する。出力リクエスト信号とは、信号処理結果の出力の要求を示す制御信号である。そして、制御回路230は、出力リクエスト信号を受信すると、出力用キュー2321、2322のいずれかに保存されている処理結果保存アドレスを、出力処理回路271、272のいずれかに送信する。具体的には、制御回路230は、出力処理回路識別IDに応じて出力用キュー2321、2322のいずれかを選択し、選択した出力用キューから処理結果保存アドレスを読み出し、当該処理結果保存アドレスを、出力処理回路識別IDにより識別される出力処理回路271、272のいずれかに送信する。なお、出力処理回路識別IDとは、出力処理回路271、272のそれぞれに割り振られたIDである。   In addition, the control circuit 230 receives an output request signal from the output processing circuits 271 and 272. The output request signal is a control signal indicating a request for outputting a signal processing result. When receiving the output request signal, the control circuit 230 transmits the processing result storage address stored in one of the output queues 2321 and 2322 to one of the output processing circuits 271 and 272. Specifically, the control circuit 230 selects one of the output queues 2321 and 2322 according to the output processing circuit identification ID, reads the processing result storage address from the selected output queue, and sets the processing result storage address as And transmitted to any one of the output processing circuits 271 and 272 identified by the output processing circuit identification ID. The output processing circuit identification ID is an ID assigned to each of the output processing circuits 271 and 272.

切替回路240は、入力処理回路識別IDを、制御回路230から受信する。そして、入力処理回路識別IDにより識別される入力処理回路に対応する内部状態保存回路261、262のいずれかと、信号処理回路250との接続の切り替えを行う。例えば、入力処理回路識別IDが入力処理回路211を識別するものである場合、切替回路240は、内部状態保存回路261と、信号処理回路250とを接続する。また、例えば、入力処理回路識別IDが入力処理回路212を識別するものである場合、切替回路240は、内部状態保存回路262と、信号処理回路250とを接続する。なお、入力処理回路に対応する内部状態保存回路は、通常、予め決められている。また、この対応関係は、通常、切替回路240が保持しているが、制御回路230が保持していてもよい。また、内部状態保存回路261、262には、信号処理回路250の内部状態が保存される。そして、切替回路240は、信号処理回路250と接続した内部状態保存回路261、262のいずれかに保存されている信号処理回路250の内部状態を読み出し、信号処理回路250に送信する。   The switching circuit 240 receives the input processing circuit identification ID from the control circuit 230. Then, the connection between the signal processing circuit 250 and one of the internal state storage circuits 261 and 262 corresponding to the input processing circuit identified by the input processing circuit identification ID is switched. For example, when the input processing circuit identification ID identifies the input processing circuit 211, the switching circuit 240 connects the internal state storage circuit 261 and the signal processing circuit 250. For example, when the input processing circuit identification ID identifies the input processing circuit 212, the switching circuit 240 connects the internal state storage circuit 262 and the signal processing circuit 250. Note that the internal state storage circuit corresponding to the input processing circuit is usually predetermined. This correspondence is normally held by the switching circuit 240, but may be held by the control circuit 230. The internal state storage circuits 261 and 262 store the internal state of the signal processing circuit 250. Then, the switching circuit 240 reads the internal state of the signal processing circuit 250 stored in one of the internal state storage circuits 261 and 262 connected to the signal processing circuit 250 and transmits the internal state to the signal processing circuit 250.

信号処理回路250は、処理開始信号と、入力ストリーム保存アドレスとを、制御回路230から受信する。また、信号処理回路250は、内部状態を切替回路240から受信し、自身の内部状態として上書きする。そして、信号処理回路250は、受信した入力ストリーム保存アドレスで示される信号保存用メモリ220上の保存場所に保存されている入力ストリームを読み出し、信号処理を開始する。なお、信号処理を開始し、信号処理を行っている間、信号処理回路250は、処理中信号を制御回路230に送信する。処理中信号とは、信号処理を行っていることを示す制御信号である。   The signal processing circuit 250 receives the processing start signal and the input stream storage address from the control circuit 230. The signal processing circuit 250 receives the internal state from the switching circuit 240 and overwrites it as its own internal state. Then, the signal processing circuit 250 reads the input stream stored in the storage location on the signal storage memory 220 indicated by the received input stream storage address, and starts signal processing. Note that the signal processing circuit 250 transmits the in-process signal to the control circuit 230 while starting the signal processing and performing the signal processing. The in-process signal is a control signal indicating that signal processing is being performed.

また、信号処理回路250は、信号処理が完了すると、切替回路240を介して、接続されている内部状態保存回路261、262のいずれかに、自身の内部状態を保存する。このとき、信号処理回路250の内部状態の一部は、常に初期値に戻るため、信号処理回路250は、初期値に戻らない内部状態のみを保存する。これにより、内部状態保存回路261、262に保存するデータ量を削減することができる。また、信号処理回路250は、信号処理結果を、信号保存用メモリ220に保存する。そして、信号処理回路250は、処理結果保存アドレスと、非処理中信号とを、制御回路230に送信する。なお、信号処理回路250は、信号処理を行っていない間は、非処理中信号を制御回路230に送信し続ける。   Further, when the signal processing is completed, the signal processing circuit 250 stores its internal state in any of the connected internal state storage circuits 261 and 262 via the switching circuit 240. At this time, since a part of the internal state of the signal processing circuit 250 always returns to the initial value, the signal processing circuit 250 stores only the internal state that does not return to the initial value. As a result, the amount of data stored in the internal state storage circuits 261 and 262 can be reduced. The signal processing circuit 250 stores the signal processing result in the signal storage memory 220. Then, the signal processing circuit 250 transmits the processing result storage address and the non-processing signal to the control circuit 230. The signal processing circuit 250 continues to transmit a non-processing signal to the control circuit 230 while signal processing is not being performed.

出力処理回路271、272は、出力リクエスト信号を、制御回路230に送信する。そして、出力処理回路271、272は、当該出力リクエスト信号に応じた処理結果保存アドレスを制御回路230から受信する。そして、出力処理回路271、272は、当該処理結果保存アドレスにより示される信号保存用メモリ220上の保存場所に保存されている信号処理結果を読み出し、出力フォーマットに応じて出力する。出力フォーマットは、通常、制御回路230からの制御信号により指示される。   The output processing circuits 271 and 272 transmit an output request signal to the control circuit 230. Then, the output processing circuits 271 and 272 receive the processing result storage address corresponding to the output request signal from the control circuit 230. Then, the output processing circuits 271 and 272 read out the signal processing result stored in the storage location on the signal storage memory 220 indicated by the processing result storage address, and outputs it according to the output format. The output format is usually instructed by a control signal from the control circuit 230.

(具体例2)
本具体例において、信号処理回路の内部状態を3つの内部状態保存回路に保存しながら、時分割で、3つのストリームの信号処理を行う信号処理装置について説明する。図3は、本具体例における信号処理装置の構成例を示す図である。信号処理装置3は、入力処理回路311、312、313、信号保存用メモリ320、制御回路330、切替回路340、341、信号処理回路350、351、内部状態保存回路361、362、363、出力処理回路371、372、373を備える。また、制御回路330は、入力用キュー3310と、出力用キュー3321、3322、3323を備える。なお、入力処理回路311、312、313は、図1のストリーム受付手段11に相当する。制御回路330と切替回路340、341は、図1の制御手段12に相当する。信号処理回路350、351は、図1の信号処理手段13に相当する。内部状態保存回路361、362、363は、図1の保存手段14に相当する。出力処理回路371、372、373は、図1の出力手段15に相当する。
(Specific example 2)
In this specific example, a signal processing apparatus that performs signal processing of three streams in a time-division manner while storing the internal state of the signal processing circuit in three internal state storage circuits will be described. FIG. 3 is a diagram illustrating a configuration example of the signal processing device according to the present specific example. The signal processing device 3 includes input processing circuits 311, 312, and 313, a signal storage memory 320, a control circuit 330, switching circuits 340 and 341, signal processing circuits 350 and 351, internal state storage circuits 361, 362, and 363, and output processing. Circuits 371, 372, and 373 are provided. The control circuit 330 includes an input queue 3310 and output queues 3321, 3322, and 3323. Note that the input processing circuits 311, 312, and 313 correspond to the stream receiving unit 11 in FIG. 1. The control circuit 330 and the switching circuits 340 and 341 correspond to the control unit 12 in FIG. The signal processing circuits 350 and 351 correspond to the signal processing means 13 in FIG. The internal state storage circuits 361, 362, 363 correspond to the storage unit 14 in FIG. The output processing circuits 371, 372, and 373 correspond to the output unit 15 in FIG.

入力処理回路311、312、313には、信号処理の対象となるストリームが入力される。信号保存用メモリ320には、入力ストリームや、信号処理結果などが保存される。制御回路330は、切替回路340、341、信号処理回路350、351、出力処理回路371、372、373の制御を行う。切替回路340、341は、信号処理回路350、351と内部状態保存回路361、362、363の接続の切り替えを行う。信号処理回路350、351は、制御回路330からの制御信号に応じて、入力ストリームの信号処理を行う。内部状態保存回路361、362、363には、信号処理回路350、351の内部状態が保存される。出力処理回路371、372、373は、信号処理結果を出力する。   The input processing circuits 311, 312, and 313 receive a stream that is a signal processing target. The signal storage memory 320 stores an input stream, a signal processing result, and the like. The control circuit 330 controls the switching circuits 340 and 341, the signal processing circuits 350 and 351, and the output processing circuits 371, 372, and 373. The switching circuits 340 and 341 switch connection between the signal processing circuits 350 and 351 and the internal state storage circuits 361, 362, and 363. The signal processing circuits 350 and 351 perform input stream signal processing in accordance with a control signal from the control circuit 330. The internal states of the signal processing circuits 350 and 351 are stored in the internal state storage circuits 361, 362, and 363. The output processing circuits 371, 372, and 373 output signal processing results.

入力処理回路311、312、313にストリームが入力されると、入力処理回路311、312、313は、入力ストリームを信号保存用メモリ320に保存する。このとき、入力処理回路311、312、313は、信号処理回路350、351が処理する処理単位ごとに保存する。保存が完了すると、入力処理回路311、312、313は、処理リクエスト信号と、入力ストリーム保存アドレスと、入力処理回路識別IDとを、制御回路330に送信する。なお、入力処理回路311、312、313は、処理単位ごとに入力ストリームを保存するため、保存された処理単位ごとの入力ストリーム保存アドレスを、制御回路330に送信する。   When a stream is input to the input processing circuits 311, 312, and 313, the input processing circuits 311, 312, and 313 store the input stream in the signal storage memory 320. At this time, the input processing circuits 311, 312, and 313 store each processing unit processed by the signal processing circuits 350 and 351. When the storage is completed, the input processing circuits 311, 312, and 313 transmit the processing request signal, the input stream storage address, and the input processing circuit identification ID to the control circuit 330. The input processing circuits 311, 312, and 313 transmit the stored input stream storage address for each processing unit to the control circuit 330 in order to store the input stream for each processing unit.

制御回路330は、処理リクエスト信号と、入力ストリーム保存アドレスと、入力処理回路識別IDを、入力処理回路311、312、313から受信する。そして、制御回路330は、受信したこれらを、入力用キュー3310に保存する。   The control circuit 330 receives the processing request signal, the input stream storage address, and the input processing circuit identification ID from the input processing circuits 311, 312, and 313. Then, the control circuit 330 stores the received data in the input queue 3310.

次に、制御回路330は、信号処理回路350、351のいずれかが信号処理を行っていないか否かを判断する。そして、信号処理回路350、351のいずれかが信号処理を行っていない場合、制御回路330は、入力用キュー3310に保存されている先頭のリクエストを実行するための制御を行う。具体的には、制御回路330は、入力処理回路識別IDを切替回路340、341のいずれかに送信し、処理開始信号と、入力ストリーム保存アドレスとを、信号処理回路350、351のいずれかに送信する。なお、入力処理回路識別IDの送信は、信号処理を行っていない信号処理回路に接続されている切替回路に対して行う。また、処理開始信号と、入力ストリーム保存アドレスとの送信は、信号処理を行っていない信号処理回路に対して行う。また、信号処理を行っていないか否かの判断は、非処理中信号を、信号処理回路350、351のいずれかが出力しているか否かで判断する。信号処理回路350、351の両方が非処理中信号を出力している場合、制御回路330は、通常、処理開始信号等を信号処理回路350に送信する。なお、この場合、制御回路330は、処理開始信号等を信号処理回路351に送信してもよい。   Next, the control circuit 330 determines whether any of the signal processing circuits 350 and 351 is not performing signal processing. If either of the signal processing circuits 350 and 351 is not performing signal processing, the control circuit 330 performs control for executing the first request stored in the input queue 3310. Specifically, the control circuit 330 transmits the input processing circuit identification ID to one of the switching circuits 340 and 341, and sends the processing start signal and the input stream storage address to one of the signal processing circuits 350 and 351. Send. The input processing circuit identification ID is transmitted to a switching circuit connected to a signal processing circuit that is not performing signal processing. The processing start signal and the input stream storage address are transmitted to a signal processing circuit that has not performed signal processing. Whether or not signal processing is being performed is determined based on whether or not one of the signal processing circuits 350 and 351 outputs a non-processing signal. When both of the signal processing circuits 350 and 351 are outputting non-processing signals, the control circuit 330 normally transmits a processing start signal or the like to the signal processing circuit 350. In this case, the control circuit 330 may transmit a processing start signal or the like to the signal processing circuit 351.

また、制御回路330は、処理完了信号と、処理結果保存アドレスとを、信号処理回路350、351から受信する。そして、制御回路230は、受信した処理結果保存アドレスを、出力用キュー3321、3322、3323に保存する。   Further, the control circuit 330 receives the processing completion signal and the processing result storage address from the signal processing circuits 350 and 351. Then, the control circuit 230 stores the received processing result storage address in the output queues 3321, 3322, and 3323.

また、制御回路330は、出力リクエスト信号を、出力処理回路371、372、373から受信する。そして、制御回路330は、出力リクエスト信号を受信すると、出力用キュー3321、3322、3223のいずれかに保存されている処理結果保存アドレスを、出力処理回路371、372、373のいずれかに送信する。具体的には、制御回路330は、出力処理回路識別IDに応じて出力用キュー3321、3322、3323のいずれかを選択し、選択した出力用キューから処理結果保存アドレスを読み出し、当該処理結果保存アドレスを、出力処理回路識別IDにより識別される出力処理回路371、372、373のいずれかに送信する。   Further, the control circuit 330 receives the output request signal from the output processing circuits 371, 372, and 373. When the control circuit 330 receives the output request signal, the control circuit 330 transmits the processing result storage address stored in any of the output queues 3321, 3322, and 3223 to any of the output processing circuits 371, 372, and 373. . Specifically, the control circuit 330 selects one of the output queues 3321, 3322, and 3323 according to the output processing circuit identification ID, reads the processing result storage address from the selected output queue, and stores the processing result storage The address is transmitted to one of the output processing circuits 371, 372, and 373 identified by the output processing circuit identification ID.

切替回路340、341は、入力処理回路識別IDを、制御回路330から受信する。そして、入力処理回路識別IDにより識別される入力処理回路に対応する内部状態保存回路361、362、363のいずれかと、信号処理回路350、351のいずれかとの接続の切り替えを行う。例えば、入力処理回路識別IDが入力処理回路311を識別するものである場合、切替回路340、341は、内部状態保存回路361と、信号処理回路350、351のいずれかとを接続する。また、例えば、入力処理回路識別IDが入力処理回路312を識別するものである場合、切替回路340、341は、内部状態保存回路362と、信号処理回路350、351のいずれかとを接続する。また、例えば、入力処理回路識別IDが入力処理回路313を識別するものである場合、切替回路340、341は、内部状態保存回路363と、信号処理回路350、351のいずれかとを接続する。なお、入力処理回路に対応する内部状態保存回路は、通常、予め決められている。また、この対応関係は、通常、切替回路340、341が保持しているが、制御回路330が保持していてもよい。また、内部状態保存回路361、362、363には、信号処理回路350、351の内部状態が保存される。そして、切替回路340、341は、信号処理回路350、351と接続した内部状態保存回路361、362、363のいずれかに保存されている信号処理回路350、351の内部状態を読み出し、信号処理回路350、351に送信する。   The switching circuits 340 and 341 receive the input processing circuit identification ID from the control circuit 330. Then, the connection between one of the internal state storage circuits 361, 362, and 363 corresponding to the input processing circuit identified by the input processing circuit identification ID and one of the signal processing circuits 350 and 351 is switched. For example, when the input processing circuit identification ID identifies the input processing circuit 311, the switching circuits 340 and 341 connect the internal state storage circuit 361 and one of the signal processing circuits 350 and 351. For example, when the input processing circuit identification ID identifies the input processing circuit 312, the switching circuits 340 and 341 connect the internal state storage circuit 362 and one of the signal processing circuits 350 and 351. For example, when the input processing circuit identification ID identifies the input processing circuit 313, the switching circuits 340 and 341 connect the internal state storage circuit 363 and one of the signal processing circuits 350 and 351. Note that the internal state storage circuit corresponding to the input processing circuit is usually predetermined. In addition, this correspondence is normally held by the switching circuits 340 and 341, but may be held by the control circuit 330. Also, the internal states of the signal processing circuits 350 and 351 are stored in the internal state storage circuits 361, 362, and 363. The switching circuits 340 and 341 read out the internal state of the signal processing circuits 350 and 351 stored in any of the internal state storage circuits 361, 362, and 363 connected to the signal processing circuits 350 and 351, and the signal processing circuit 350 and 351.

信号処理回路350、351は、処理開始信号と、入力ストリーム保存アドレスとを、制御回路330から受信する。また、信号処理回路350、351は、内部状態を切替回路340、341から受信し、自身の内部状態内部状態として上書きする。そして、信号処理回路350、351は、受信した入力ストリーム保存アドレスで示される信号保存用メモリ320上の保存場所に保存されている入力ストリームを読み出し、信号処理を開始する。なお、信号処理を開始し、信号処理を行っている間、信号処理回路350、351は、処理中信号を制御回路330に送信する。   The signal processing circuits 350 and 351 receive the processing start signal and the input stream storage address from the control circuit 330. In addition, the signal processing circuits 350 and 351 receive the internal state from the switching circuits 340 and 341 and overwrite it as its own internal state and internal state. Then, the signal processing circuits 350 and 351 read the input stream stored in the storage location on the signal storage memory 320 indicated by the received input stream storage address, and start signal processing. Note that while the signal processing is started and the signal processing is being performed, the signal processing circuits 350 and 351 transmit a processing signal to the control circuit 330.

また、信号処理回路350、351は、信号処理が完了すると、切替回路340、341を介して、接続されている内部状態保存回路361、362、363のいずれかに、自身の内部状態を保存する。このとき、信号処理回路350、351の内部状態の一部は、常に初期値に戻るため、信号処理回路350は、初期値に戻らない内部状態のみを保存する。これにより、内部状態保存回路361、362、363に保存するデータ量を削減することができる。また、信号処理回路350、351は、信号処理結果を、信号保存用メモリ320に保存する。そして、信号処理回路350、351は、処理結果保存アドレスと、非処理中信号とを、制御回路330に送信する。なお、信号処理回路350、351は、信号処理を行っていない間は、非処理中信号を制御回路330に送信し続ける。   When the signal processing is completed, the signal processing circuits 350 and 351 store their internal states in any of the connected internal state storage circuits 361, 362, and 363 via the switching circuits 340 and 341. . At this time, part of the internal state of the signal processing circuits 350 and 351 always returns to the initial value, so the signal processing circuit 350 stores only the internal state that does not return to the initial value. As a result, the amount of data stored in the internal state storage circuits 361, 362, 363 can be reduced. Further, the signal processing circuits 350 and 351 store the signal processing result in the signal storage memory 320. Then, the signal processing circuits 350 and 351 transmit the processing result storage address and the non-processing signal to the control circuit 330. Note that the signal processing circuits 350 and 351 continue to transmit non-processing signals to the control circuit 330 while signal processing is not being performed.

出力処理回路371、372、373は、出力リクエスト信号を、制御回路330に送信する。そして、出力処理回路371、372、373は、当該出力リクエスト信号に応じた処理結果保存アドレスを制御回路330から受信する。そして、出力処理回路371、372、373は、当該処理結果保存アドレスにより示される信号保存用メモリ320上の保存場所に保存されている信号処理結果を読み出し、出力フォーマットに応じて出力する。出力フォーマットは、通常、制御回路330からの制御信号により指示される。   The output processing circuits 371, 372, and 373 transmit output request signals to the control circuit 330. Then, the output processing circuits 371, 372, and 373 receive the processing result storage address corresponding to the output request signal from the control circuit 330. Then, the output processing circuits 371, 372, and 373 read the signal processing result stored in the storage location on the signal storage memory 320 indicated by the processing result storage address, and output it according to the output format. The output format is usually instructed by a control signal from the control circuit 330.

以上のように、本実施の形態による信号処理装置は、入力ストリームと同数の内部状態保存回路を備える。このような構成により、信号処理回路の内部状態をメモリに保存する場合に比べ、処理の中断・再開のオーバーヘッドの低減化を図ることができ、より効率よく信号処理が行える。   As described above, the signal processing apparatus according to the present embodiment includes the same number of internal state storage circuits as input streams. With such a configuration, compared with the case where the internal state of the signal processing circuit is stored in a memory, the overhead of interruption / resumption of processing can be reduced, and signal processing can be performed more efficiently.

また、本実施の形態による信号処理装置は、入力ストリームと同数の入力処理回路を備えるが、これらは1つであってもよい。つまり、信号処理装置に対して、信号処理の対象となるストリームが、シリアルに入力されてもよい。   In addition, the signal processing apparatus according to the present embodiment includes the same number of input processing circuits as input streams, but there may be only one. That is, a stream that is a signal processing target may be serially input to the signal processing device.

また、上記実施の形態において、各処理または各機能は、単一の装置によって集中処理されることによって実現されてもよいし、あるいは、複数の装置によって分散処理されることによって実現されてもよい。   In the above embodiment, each process or each function may be realized by centralized processing by a single device, or may be realized by distributed processing by a plurality of devices. .

また、上記実施の形態において、各構成要素は専用のハードウェアにより構成されてもよいし、あるいは、ソフトウェアにより実現可能な構成要素については、プログラムを実行することによって実現されてもよい。例えば、ハードディスクや半導体メモリ等の記録媒体に記録されたソフトウェア・プログラムをCPU等のプログラム実行部が読み出して実行することによって、各構成要素が実現され得る。   Moreover, in the said embodiment, each component may be comprised by exclusive hardware, or about the component realizable by software, it may implement | achieve by running a program. For example, each component can be realized by a program execution unit such as a CPU reading and executing a software program recorded on a recording medium such as a hard disk or a semiconductor memory.

本発明は、以上の実施の形態に限定されることなく、種々の変更が可能であり、それらも本発明の範囲内に包含されるものであることは言うまでもない。   The present invention is not limited to the above-described embodiments, and various modifications are possible, and it goes without saying that these are also included in the scope of the present invention.

以上のように、本発明にかかる信号処理装置は、効率よく、複数ストリームの時分割処理を行うことができるという効果を有し、テレビジョン装置等として有用である。   As described above, the signal processing device according to the present invention has an effect that it can efficiently perform time-sharing processing of a plurality of streams, and is useful as a television device or the like.

1、2、3 信号処理装置
11 ストリーム受付手段
12 制御手段
13 信号処理手段
14 保存手段
15 出力手段
211、212、311、312、313 入力処理回路
220、320 信号保存用メモリ
230、330 制御回路
240、340、341 切替回路
250、350、351 信号処理回路
261、262、361、362、363 内部状態保存回路
271、272、371、372、373 出力処理回路
2310、3310 入力用キュー
2321、2322、3321、3322、3323 出力用キュー
1, 2, 3 Signal processing device 11 Stream receiving means 12 Control means 13 Signal processing means 14 Storage means 15 Output means 211, 212, 311, 312, 313 Input processing circuit 220, 320 Signal storage memory 230, 330 Control circuit 240 340, 341 Switching circuit 250, 350, 351 Signal processing circuit 261, 262, 361, 362, 363 Internal state storage circuit 271, 272, 371, 372, 373 Output processing circuit 2310, 3310 Input queue 2321, 2322, 3321 , 3322, 3323 Output queue

Claims (4)

ストリームの信号処理に関する情報である内部状態を保存し得る複数の保存手段と、
複数のストリームを受け付けるストリーム受付手段と、
前記ストリーム受付手段が受け付けた複数のストリームを信号処理する信号処理手段と、
前記ストリーム受付手段が受け付けた複数のストリームを時分割で切り替えて信号処理するように前記信号処理手段に指示する制御手段と、
前記信号処理手段が信号処理した結果を出力する出力手段とを具備し、
前記制御手段は、
時分割で、一のストリームの信号処理を中断し、他のストリームの信号処理を行うように前記信号処理手段に指示する場合に、当該一のストリームの信号処理に関する当該信号処理手段の内部状態のうち、前記信号処理手段が信号処理を行っている間に変化する内部状態の一部のみを前記複数の保存手段のうちの一の保存手段に保存し、前記信号処理手段が信号処理を行っている間に変化しない内部状態の一部は保存手段に保存せず、当該一のストリームの信号処理を再開する場合に、当該一の保存手段に保存した前記内部状態の一部を、前記信号処理手段が前記一のストリームの信号処理に利用する内部状態に上書きし、内部状態を復元し、
前記信号処理手段は、
前記制御手段の指示に従って、前記一のストリームの信号処理を再開する場合に、前記制御手段が復元した前記内部状態を利用して当該一のストリームの信号処理を続行する信号処理装置。
A plurality of storage means capable of storing an internal state that is information relating to signal processing of the stream;
Stream receiving means for receiving a plurality of streams;
Signal processing means for performing signal processing on the plurality of streams received by the stream receiving means;
Control means for instructing the signal processing means to perform signal processing by switching the plurality of streams received by the stream receiving means in a time-sharing manner;
Output means for outputting the result of signal processing by the signal processing means,
The control means includes
When the signal processing means is instructed to interrupt the signal processing of one stream and perform the signal processing of another stream in time division, the internal state of the signal processing means related to the signal processing of the one stream Of these, only a part of the internal state that changes while the signal processing means performs signal processing is stored in one of the plurality of storage means, and the signal processing means performs signal processing. When the signal processing of the one stream is resumed without storing a part of the internal state that does not change during the period, the signal processing is performed on the part of the internal state stored in the one storage unit. The means overwrites the internal state used for signal processing of the one stream , restores the internal state ,
The signal processing means includes
A signal processing device that continues signal processing of the one stream using the internal state restored by the control means when the signal processing of the one stream is resumed according to an instruction of the control means.
前記保存手段は、
前記ストリームの数だけ存在し、
前記制御手段は、
前記内部状態の一部を保存する場合に、前記一のストリームの信号処理に関する内部状態のうち、前記信号処理手段が信号処理を行っている間に変化する内部状態の一部のみを当該一のストリームに対応する一の保存手段に保存する請求項1記載の信号処理装置。
The storage means includes
There are as many as the number of streams,
The control means includes
In the case of storing a part of the internal state , only a part of the internal state that changes while the signal processing means is performing signal processing among the internal states related to signal processing of the one stream. The signal processing apparatus according to claim 1, wherein the signal processing apparatus stores the data in one storage unit corresponding to the stream.
ストリームの信号処理に関する情報である内部状態を保存し得る複数の保存手段と、
ストリーム受付手段と、信号処理手段と、制御手段と、出力手段とを用いて行われる信号処理方法であって、
前記ストリーム受付手段が、
複数のストリームを受け付けるストリーム受付ステップと、
前記信号処理手段が、
前記ストリーム受付手段が受け付けた複数のストリームを信号処理する信号処理ステップと、
前記制御手段が、
前記ストリーム受付手段が受け付けた複数のストリームを時分割で切り替えて信号処理するように前記信号処理手段に指示する制御ステップと、
前記出力手段が、
前記信号処理手段が信号処理した結果を出力する出力ステップとを具備し、
前記制御ステップでは、
前記制御手段が、
時分割で、一のストリームの信号処理を中断し、他のストリームの信号処理を行うように前記信号処理手段に指示する場合に、当該一のストリームの信号処理に関する内部状態のうち、前記信号処理手段が信号処理を行っている間に変化する内部状態の一部のみを前記複数の保存手段のうちの一の保存手段に保存し、前記信号処理手段が信号処理を行っている間に変化しない内部状態の一部は保存手段に保存せず、当該一のストリームの信号処理を再開する場合に、当該一の保存手段に保存した前記内部状態の一部を、前記信号処理手段が前記一のストリームの信号処理に利用する内部状態に上書きし、内部状態を復元し、
前記信号処理ステップでは、
前記出力手段が、
前記制御手段の指示に従って、前記一のストリームの信号処理を再開する場合に、前記制御手段が復元した前記内部状態を利用して当該一のストリームの信号処理を続行する信号処理方法。
A plurality of storage means capable of storing an internal state that is information relating to signal processing of the stream;
A signal processing method performed using a stream receiving means, a signal processing means, a control means, and an output means,
The stream receiving means is
A stream reception step for receiving a plurality of streams;
The signal processing means is
A signal processing step of performing signal processing on the plurality of streams received by the stream receiving means;
The control means is
A control step for instructing the signal processing means to perform signal processing by switching the plurality of streams received by the stream receiving means in a time-sharing manner;
The output means is
An output step of outputting a result of signal processing by the signal processing means,
In the control step,
The control means is
In time division, interrupt the signal processing of one stream, when instructing the signal processing unit to perform signal processing of the other streams, of the internal states for the signal processing of the first stream, the signal processing Only a part of the internal state that changes while the means is performing signal processing is stored in one of the plurality of storage means, and does not change while the signal processing means is performing signal processing. A part of the internal state is not stored in the storage unit, and when the signal processing of the one stream is resumed, the signal processing unit stores the part of the internal state stored in the one storage unit . Overwrite the internal state used for signal processing of the stream, restore the internal state ,
In the signal processing step,
The output means is
A signal processing method of continuing signal processing of the one stream by using the internal state restored by the control unit when resuming signal processing of the one stream in accordance with an instruction of the control unit.
前記保存手段は、
前記ストリームの数だけ存在し、
前記制御ステップでは、
前記制御手段が、
前記内部状態の一部を保存する場合に、前記一のストリームの信号処理に関する内部状態のうち、前記信号処理手段が信号処理を行っている間に変化する内部状態の一部のみを当該一のストリームに対応する一の保存手段に保存する請求項3記載の信号処理方法。
The storage means includes
There are as many as the number of streams,
In the control step,
The control means is
In the case of storing a part of the internal state , only a part of the internal state that changes while the signal processing means is performing signal processing among the internal states related to signal processing of the one stream. 4. The signal processing method according to claim 3, wherein the signal is stored in one storage unit corresponding to the stream.
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