JP5451512B2 - 演算装置 - Google Patents
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Description
はじめに、本発明の実施の形態1について説明する。図1は、本発明の実施の形態1における演算装置の構成を示す構成図である。この演算装置は、第1周波数fに差分周波数Δを加えた第1入力周波数f+Δの第1振動および第1周波数fから差分周波数Δを減じた第2入力周波数f−Δの第2振動が入力される第1入力部101と、第1周波数fと異なる周波数の第2周波数f’に差分周波数Δを加えた第3入力周波数f’+Δの第3振動および第2周波数f’から差分周波数Δを減じた第4入力周波数f’−Δの第4振動が選択的に入力される第2入力部102とを備える。
(f’+Δ)−{(f’+Δ)−(f+Δ)}=f+Δ
(f’−Δ)−{(f’+Δ)−(f+Δ)}=f−Δ
(f’+Δ)−{(f’−Δ)−(f+Δ)}=f+3Δ
(f’+Δ)−{(f’+Δ)−(f−Δ)}=f−Δ
(f’+Δ)−{(f’−Δ)−(f−Δ)}=f+Δ
(f’−Δ)−{(f’−Δ)−(f+Δ)}=f+Δ
(f’−Δ)−{(f’+Δ)−(f−Δ)}=f−3Δ
(f’−Δ)−{(f’−Δ)−(f−Δ)}=f−Δ
(f’+Δ)−{(f’+Δ)−(f+Δ)}=f+Δ
(f’−Δ)−{(f’+Δ)−(f+Δ)}=f−Δ
(f’+Δ)−{(f’−Δ)−(f+Δ)}=f+3Δ
(f’+Δ)−{(f’+Δ)−(f−Δ)}=f−Δ
(f’+Δ)−{(f’−Δ)−(f−Δ)}=f+Δ
(f’−Δ)−{(f’−Δ)−(f+Δ)}=f+Δ
(f’−Δ)−{(f’+Δ)−(f−Δ)}=f−3Δ
(f’−Δ)−{(f’−Δ)−(f−Δ)}=f−Δ
次に、本発明の実施の形態2について図2,3を用いて説明する。図2は、本発明の実施の形態2における演算装置の構成を示す構成図であり、一部を斜視図で示している。また、図3は、実施の形態2における演算装置の動作例を説明する説明図である。
次に、本発明の実施の形態3について図4を用いて説明する。図4は、本発明の実施の形態3における演算装置の構成を示す構成図である。図4では、一部を斜視図で示している。本実施の形態における演算装置200は、例えば面方位が(001)のGaAsからなる基板201の上に、まず、単結晶の絶縁性Al0.7Ga0.3Asからなる絶縁層202,シリコンがドープされた単結晶の導電性GaAsからなる導電層203,および単結晶の絶縁性Al0.3Ga0.7Asからなる絶縁層204からなる積層構造体が形成されている。
Claims (7)
- 第1周波数に第1差分周波数を加えた第1入力周波数の第1振動および前記第1周波数から前記第1差分周波数を減じた第2入力周波数の第2振動が入力される第1入力部と、
前記第1周波数と異なる周波数の第2周波数に前記第1差分周波数を加えた第3入力周波数の第3振動および前記第2周波数から前記第1差分周波数を減じた第4入力周波数の第4振動が選択的に入力される第2入力部と、
前記第1入力部の振動と前記第2入力部の振動との差を出力する周波数変換手段と、
設定された少なくとも第1設定周波数を検出して対応する第1出力を出力する周波数検出手段と
を少なくとも備え、
前記第1設定周波数は、前記第1周波数と前記第2周波数との差であり、
前記周波数検出手段は、前記第1振動と前記第2振動とが前記第1入力部に入力された状態で、少なくとも前記第3振動ないしは前記第4振動のいずれかが前記第2入力部に入力されたときに、前記第1出力を出力することを特徴とする演算装置。 - 請求項1記載の演算装置において、
前記周波数検出手段は、設定された前記第1設定周波数および第2設定周波数を検出して各々対応する前記第1出力および第2出力を出力し、
前記第2設定周波数は、前記第1入力周波数および前記第2入力周波数のいずれかと前記第3入力周波数および前記第4入力周波数のいずれかとの差と、前記第3入力周波数および前記第4入力周波数のいずれかとの差により得られる周波数のなかより選択される1の周波数であり、
前記周波数検出手段は、前記第1振動と前記第2振動とが前記第1入力部に入力された状態で、前記第3振動および前記第4振動が前記第2入力部に入力されたときに、前記第2出力を出力することを特徴とする演算装置。 - 請求項2記載の演算装置において、
前記第2入力部は、前記第3振動,前記第4振動,および前記第2周波数と前記第1差分周波数の整数倍との和もしくは差の第5入力周波数の第5振動が選択的に入力され、
前記周波数検出手段は、前記第1設定周波数および前記第2設定周波数に加え、設定された第3設定周波数および第4設定周波数を検出し、各々対応する前記第1出力,前記第2出力,第3出力,および第4出力を出力し、
前記第2設定周波数は、前記第1設定周波数から前記第1差分周波数の3倍の周波数を減じた周波数であり、
前記第3設定周波数は、前記第1設定周波数に前記第1差分周波数の2倍の周波数を加えた周波数であり、
前記第4設定周波数は、前記第1設定周波数から前記第1差分周波数の2倍の周波数を減じた周波数であり、
前記周波数検出手段は、前記第1振動と前記第2振動とが前記第1入力部に入力された状態で、前記第5振動が前記第2入力部に入力されたとき、ないしは前記第3振動と前記第4振動とが前記第2入力部に入力されたときの、少なくともいずれか一方の条件を満たす場合に、前記第2出力を出力する
ことを特徴とする演算装置。 - 請求項1〜3のいずれか1項に記載の演算装置において、
前記第1入力部,前記第2入力部および前記周波数変換手段は、パラメトリック振動子より構成されていることを特徴とする演算装置。 - 請求項4記載の演算装置において、
前記パラメトリック振動子は、機械的に振動するものであることを特徴とする演算装置。 - 請求項4記載の演算装置において、
前記パラメトリック振動子は、LC共振器であることを特徴とする演算装置。 - 請求項1〜3のいずれか1項に記載の演算装置において、
前記第1入力部,前記第2入力部および前記周波数変換手段は、非線形振動子より構成されていることを特徴とする演算装置。
Priority Applications (1)
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JP2010104961A JP5451512B2 (ja) | 2010-04-30 | 2010-04-30 | 演算装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2010104961A JP5451512B2 (ja) | 2010-04-30 | 2010-04-30 | 演算装置 |
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JP2011234271A JP2011234271A (ja) | 2011-11-17 |
JP5451512B2 true JP5451512B2 (ja) | 2014-03-26 |
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ID=45323101
Family Applications (1)
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JP2010104961A Active JP5451512B2 (ja) | 2010-04-30 | 2010-04-30 | 演算装置 |
Country Status (1)
Country | Link |
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JP (1) | JP5451512B2 (ja) |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07115229A (ja) * | 1993-10-19 | 1995-05-02 | Hitachi Ltd | 超電導論理回路 |
WO2009041362A1 (ja) * | 2007-09-27 | 2009-04-02 | Nippon Telegraph And Telephone Corporation | 論理素子 |
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2010
- 2010-04-30 JP JP2010104961A patent/JP5451512B2/ja active Active
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JP2011234271A (ja) | 2011-11-17 |
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