JP5443769B2 - 半導体装置 - Google Patents
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Description
(素子構造)
本発明の第1の実施の形態に係る半導体装置の模式的平面パターン構成は、図1に示すように表される。また、第1の実施の形態に係る半導体装置のゲート電極パターンは、図2に示すように表される。
第1の実施の形態に係る半導体装置は、図3に示すように、基板10と、基板10上に配置されたGaNエピタキシャル成長層12と、GaNエピタキシャル成長層12上に配置されたアルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18と、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18上に配置されたソース電極20,ゲート電極24およびドレイン電極22と、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18とGaNエピタキシャル成長層12の一部分に形成された素子分離領域14とを備える。GaNエピタキシャル成長層12上のアルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18との界面には、2次元電子ガス(2DEG:Two Dimensional Electron Gas)層16が形成されている。図3に示す半導体装置では、高電子移動度トランジスタ(HEMT:High Electron Mobility Transistor)が構成されている。
第1の実施の形態に係る半導体装置の別の構成例は、図4に示すように、基板10と、基板10上に配置されたGaNエピタキシャル成長層12と、GaNエピタキシャル成長層12上に配置されたソース領域26およびドレイン領域28と、ソース領域26上に配置されたソース電極20,GaNエピタキシャル成長層12上に配置されたゲート電極24およびドレイン領域28上に配置されたドレイン電極22と、GaNエピタキシャル成長層12の一部分に形成された素子分離領域14とを備える。
第1の実施の形態に係る半導体装置の更に別の構成例は、図5に示すように、基板10と、基板10上に配置されたGaNエピタキシャル成長層12と、GaNエピタキシャル成長層12上に配置されたアルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18と、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18上に配置されたソース電極20およびドレイン電極22と、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18上のリセス部に配置されたゲート電極24と、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18とGaNエピタキシャル成長層12の一部分に形成された素子分離領域14とを備える。GaNエピタキシャル成長層12上のアルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)18との界面には、2DEG層16が形成されている。図5に示す半導体装置は、HEMTに相当している。
第1の実施の形態の変形例に係る半導体装置の模式的平面パターン構成は、図6に示すように表される。また、第1の実施の形態の変形例に係る半導体装置の模式的断面構造は、図3〜図5に示す構成例1〜構成例3と同様の構造を適用することができる。
第2の実施の形態に係る半導体装置の模式的平面パターン構成は、図7に示すように表される。第2の実施の形態は、ゲート電極24,24a〜24cの分岐における再帰的な自己相似のフラクタル図形において、αは0.7、分岐角度θを90°とした構成例に対応する。第2の実施の形態に係る半導体装置の模式的断面構造は、図3〜図5に示す構成例1〜構成例3と同様の構造を適用することができる。その他の構成は、第1の実施の形態と同様であるため、説明は省略する。
第2の実施の形態の変形例に係る半導体装置の模式的平面パターン構は、図8に示すように表され、図7の構成を並列に3個並べた構成例に対応している。図8の例では、3個並列に並べた例が示されているが、並列に配置される個数は3個に限定されるものではなく、更に多くの個数を並列配置しても良い。第2の実施の形態の変形例に係る半導体装置の模式的断面構造も、図3〜図5に示す構成例1〜構成例3と同様の構造を適用することができる。その他の構成は、第1の実施の形態と同様であるため、説明は省略する。
上記のように、本発明は第1〜第2の実施の形態およびその変形例によって記載したが、この開示の一部をなす論述および図面は例示的なものであり、この発明を限定するものであると理解すべきではない。この開示から当業者には様々な代替実施の形態、実施例および運用技術が明らかとなろう。
12…窒化物系化合物半導体層(GaNエピタキシャル成長層)
14…素子分離領域
16…2次元電子ガス(2DEG)層
18…アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)
20…ソース電極
22…ドレイン電極
24,24a,24b,24c…ゲート電極
26…ソース領域
28…ドレイン領域
200…ソース端子電極
220…ドレイン端子電極
240…ゲート端子電極
Claims (2)
- 基板と、
前記基板上に配置された窒化物系化合物半導体層と、
前記窒化物系化合物半導体層上に配置され、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)からなる活性領域と、
前記活性領域を互いに素子分離する素子分離領域と、
前記素子分離領域によって囲まれた前記活性領域上に配置されたゲート電極、ソース電極およびドレイン電極と、
前記素子分離領域上に配置され、それぞれ前記ゲート電極,前記ソース電極および前記ドレイン電極に接続されたゲート端子電極,ソース端子電極およびドレイン端子電極と
を備え、前記ゲート電極の分岐を再帰的な自己相似のフラクタル図形で構成し、
前記ゲート電極の分岐における再帰的な自己相似のフラクタル図形において、θを分岐角度、αを縮小率、nを分岐数とすると、
n個目の分岐の枝の長さd(n,θ)は、n−1個目の分岐の枝の長さd(n−1,θ)との関係において、
d(n,θ)=α・d(n−1,θ)であることを特徴とする半導体装置。 - 基板と、
前記基板上に配置された窒化物系化合物半導体層と、
前記窒化物系化合物半導体層上に配置され、アルミニウム窒化ガリウム層(AlxGa1-xN)(0.1≦x≦1)からなる活性領域と、
前記活性領域を互いに素子分離する素子分離領域と、
前記素子分離領域によって囲まれた前記活性領域上に配置され、それぞれ複数のフィンガーを有するゲート電極、ソース電極およびドレイン電極と、
前記素子分離領域上に配置され、前記ゲート電極、前記ソース電極および前記ドレイン電極ごとに複数のフィンガーをそれぞれ束ねて形成したゲート端子電極、ソース端子電極およびドレイン端子電極と
を備え、前記ゲート電極の分岐を再帰的な自己相似のフラクタル図形で構成し、
前記ゲート電極の分岐における再帰的な自己相似のフラクタル図形において、θを分岐角度、αを縮小率、nを分岐数とすると、
n個目の分岐の枝の長さd(n,θ)は、n−1個目の分岐の枝の長さd(n−1,θ)との関係において、
d(n,θ)=α・d(n−1,θ)であることを特徴とする半導体装置。
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