JP5373457B2 - Abnormality detection method for power converter - Google Patents
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Abstract
Description
本発明は、鉄道車両などで駆動用電動機の制御に用いられる半導体スイッチ素子により構成される電力変換器の半導体スイッチ素子のドライブ異常を検出する異常検出方式に関する。 The present invention relates to an abnormality detection method for detecting a drive abnormality of a semiconductor switch element of a power converter constituted by a semiconductor switch element used for controlling a drive motor in a railway vehicle or the like.
鉄道車両などの駆動用電動機の制御に用いられるインバータ装置などの電力変換器では、高圧大電流の電力制御を行う為、構成される半導体スイッチング素子が誤制御されると電源短絡などにより装置を激しく損傷する可能性がある。
したがって、半導体スイッチング素子が異常な動作をした場合、極力早く装置を停止させ、装置の損傷を避ける必要がある。このため半導体スイッチング素子を駆動するドライブ回路に対する制御指令信号と、ドライブ回路がスイッチング素子をオンまたはオフにするよう駆動する動作状態を検出するドライバ動作情報と前記制御指令信号とを比較し、不一致が生じた時にドライブ回路の異常動作と判定する異常検出方式が採用されている。
In power converters such as inverter devices used to control drive motors for railway vehicles, etc., high-voltage and large-current power control is performed. Possible damage.
Therefore, when the semiconductor switching element performs an abnormal operation, it is necessary to stop the device as soon as possible and avoid damage to the device. Therefore, the control command signal for the drive circuit that drives the semiconductor switching element is compared with the driver command information that detects the operating state in which the drive circuit drives the switching element to turn on or off, and the control command signal is compared. An abnormality detection method is adopted in which an abnormal operation of the drive circuit is determined when it occurs.
図11にこの異常検出が実施されている従来のシステム例を示す。スイッチング素子数は電力変換器のシステムにより異なるが本図ではスイッチング素子が2個の場合を示す。図11によりその構成を説明する。電力変換器の制御装置1は制御指令信号発生部4で生成した制御信号を、電力変換器3を構成する個々のスイッチング素子であるIGBT(Insulated Gate Bipolar Transistor:絶縁ゲートバイポーラトランジスタ)300、310に対し、制御情報PWM0、PWM1を個々のIGBTのドライブ回路200、210に出力している。この制御情報がドライブ回路200、210内で整形され、電力変換器を構成する半導体スイッチング素子IGBT300、310が駆動される。
FIG. 11 shows a conventional system example in which this abnormality detection is performed. Although the number of switching elements varies depending on the power converter system, this figure shows a case where there are two switching elements. The configuration will be described with reference to FIG. The power
またIGBTのオン・オフの動作状態をドライブ回路200、210内で判定しその情報FB0、FB1が制御装置1にフィードバックされ不一致検出部不一致検出部400、410において制御指令信号と比較されて異常検出が行われている。不一致検出部400、410の各々により異常検出された信号は論理和機能20を介して制御指令信号発生部4に伝達され異常検出時には制御信号の発生を停止する構成となっている。上記はスイッチング素子に対応した系列が2系列の場合を示したが、スイッチング素子に対応した系列がさらに多数あっても論理和機能20を介して異常信号が統合され制御指令信号発生部4の停止を行う点は変わりがない。
Further, the on / off operation state of the IGBT is determined in the
図12は上記図11の従来例の構成の内IGBT300に対応した1つの系列をより詳細に示した図である。図12によりさらに詳細に説明する。制御装置1の内部では電力変換器3の制御に対応しIGBTのオン・オフに対応した制御指令信号PWMPが制御指令信号発生部4より出力され、電気光変換器(E/O)5により光の制御信号PWM0に変換され、これが光ファイバ6を介してドライブ装置200に伝達される。光ファイバ6は高電圧回路である電力変換器3と電子回路である制御装置の間の電気的絶縁を取る為のものである。
FIG. 12 is a diagram showing one series corresponding to
ドライブ回路200では制御指令は光電気変換器(O/E)7で再度電気信号に変換され波形整形回路8によりドライブ回路200内での電気的に整合の取れた波形DSに整形され、これをAMP回路9により駆動信号GSとしてIGBT300を駆動する。一方判定機能10は駆動信号GSを監視しIGBT300がオンに駆動されているかオフに駆動されているかを判定し、その判定情報DFBは論理反転機能11、電気光変換器(E/O)12、光ファイバ13、光電気変換器(O/E)14、及び論理反転機能15を介してフィードバック信号FBとして不一致検出部400に与えられる。
In the
ここで、論理反転機能11、15は光ファイバ内の情報として光ありの場合をIGBT300のオフ動作状態情報、光なしの場合をIGBT300のオン動作状態情報に割り当て、ファイバ折損などの場合の光信号伝達不能時にスイッチング素子オンとみなしシステムの安全を図るためのものである。不一致検出部400では制御指令信号PWMPとフィードバック信号FBが不一致検出用のEOR機能16に入力され、不一致信号NEが検出猶予時間タイマ17の猶予時間出力DL以上に継続して出力されるとAND機能18を介して異常信号DTが出力される。
Here, the
ここで、検出猶予時間タイマ17は不一致信号NEの立ち上がりエッジでトリガされ、出力時間Texは、正常時の全ての動作条件において、制御指令信号PWMPが出力されてから駆動信号GSに至るまでの回路の動作遅れ時間と、駆動信号GSからフィードバック信号FBに至るまでの回路の動作遅れ時間との和の最大値よりも長くなるよう設定されている。
Here, the detection
異常信号DTが出力されると異常検出保持機能19によりこれが保持され異常信号CFDが出力されこれが論理和機能20を介して他の系列の異常信号とともに制御指令信号発生部4の制御指令信号PWMP出力が停止させられる。IGBT310に対応した系列も全く同様に構成され検出された異常信号は論理和機能20を介して一つの信号とされ制御指令信号発生部4の制御指令信号PWMPを停止させる。
When the abnormal signal DT is output, it is held by the abnormality
図13〜図16に従来例の動作波形を示す。図13は、本構成の中に異常がない場合における制御指令信号PWMPがオフからオンへ変化した時の動作(a)を示す。図13の時刻A点において制御指令信号発生部4からIGBTをオフからオンへ切り替えるよう制御指令信号PWMPが出力されたとする。この場合、図12の制御指令信号PWMPから駆動信号GSに至るまでの回路の動作遅れ時間Tpg1を経た後、図13のB点において駆動信号GSの信号がオフからオンに変化する。同様に、図12の駆動信号GSからフィードバック信号FBに至るまでの回路の動作遅れ時間Tgf1を経た後、図13のC点でフィードバック信号FBがオフからオンに変化する。
13 to 16 show operation waveforms of the conventional example. FIG. 13 shows an operation (a) when the control command signal PWMP changes from OFF to ON when there is no abnormality in the present configuration. Assume that the control command signal PWMP is output from the control command
不一致検出用のEOR機能16によってこのフィードバック信号FBが制御指令信号PWMPと比較されるので上記のTpg1及びTgf1の遅れによりA点からC点の間において不一致信号NEに不一致に対応する信号が現れるが、不一致に対する検出猶予時間タイマ17の猶予時間Texの設定値より短い、即ち、Tex>最大値(Tpg1+Tgf1)と設定されているので、猶予時間タイマ出力DLは、C点より後のD点まで継続し、その結果、不一致信号NEはAND機能18によりマスクされる。したがって異常検出保持機能19はセットされることは無く、その出力CFDには異常信号は現れない。即ち、構成の中に異常がない場合には異常信号は出力されない。
Since this feedback signal FB is compared with the control command signal PWMP by the
同様に、図14は、従来例の構成の中に異常がない場合の制御指令信号がオンからオフへ変化した時の動作(b)を示す。図13と同様に時刻A点において制御指令信号発生部4からIGBT300をオンからオフへ切り替えるよう制御指令信号PWMPが出力されたとする。この場合の図14と同様に制御指令信号PWMPから駆動信号GSを経てフィードバック信号FBに至るまでの回路の動作遅れ時間によって不一致検出用のEOR機能16にTpg0とTgf0の合計の時間、即、ちA点からC点の間、不一致信号NEに不一致に対応する信号が現れるが、不一致に対する検出猶予時間タイマ17の猶予時間出力DLは猶予時間Tex経過後のD点まで継続され、不一致信号NEはマスクされ、異常検出保持機能19はセットされることは無く、その出力CFDには異常信号は現れない。
Similarly, FIG. 14 shows the operation (b) when the control command signal changes from on to off when there is no abnormality in the configuration of the conventional example. As in FIG. 13, it is assumed that the control command signal PWMP is output from the control command
図15に、制御指令信号がオフにもかかわらず何らかの異常によりドライバ回路出力の駆動信号GSがオンとなり猶予時間タイマの猶予時間Texより長く継続した場合(c)を示す。B点において駆動信号GSが異常動作すると、これが図12の判定機能10により検出され、フィードバック信号FBに至るまでの回路の動作遅れ時間Tgf1を経た後、C点でフィードバック信号FBがオフからオンに変化する。不一致検出用のEOR機能16によってこのフィードバック信号FBが制御指令信号PWMPと比較されるのでフィードバック信号FBとほぼ同時間不一致信号NEが出力され、猶予時間Tex経過後D点でAND機能によるマスクが解け、異常検出保持機能19はセットされ異常信号CFDが出力される。このようにして異常検出される。
FIG. 15 shows a case (c) in which the drive signal GS output from the driver circuit is turned on due to some abnormality despite the control command signal being turned off and continues longer than the grace time Tex of the grace time timer. When the drive signal GS operates abnormally at the point B, this is detected by the
この従来例においては上記のようにして異常時には異常検知信号CFDが出力されるが、上記説明で明らかなように異常信号がフィードバック信号FBに現れた後、猶予時間Texという時間その出力を継続しないと検出信号を出力できないという問題がある。 In this conventional example, the abnormality detection signal CFD is output at the time of abnormality as described above. However, as apparent from the above description, after the abnormality signal appears in the feedback signal FB, the output is not continued for a delay time Tex. The detection signal cannot be output.
従来例において、スイッチング素子の異常動作、或いはドライブ回路内の異常により図16に示すように駆動信号GSが振動的な或いは発振的な異常を起こす場合(d)があるが、このような時、発振周期が短く、図16に示すように不一致信号NEが猶予時間Texの継続する時間D点以前のE点で消失し、その後、再度、駆動信号GSが出力されることを繰り返すような異常の場合には、猶予時間Texが解除されるD点以前のE点で不一致信号NEがオフするため、この異常が検出できない。さらに、この異常が発振動作のように繰り返し動作を行う場合、異常が継続し装置を破壊するという問題がある。 In the conventional example, there is a case (d) in which the drive signal GS causes a vibration or oscillation abnormality as shown in FIG. 16 due to an abnormal operation of the switching element or an abnormality in the drive circuit. As shown in FIG. 16, the non-matching signal NE disappears at the point E before the time point D where the grace time Tex continues, and thereafter the drive signal GS is output again again as shown in FIG. In this case, since the mismatch signal NE is turned off at the point E before the point D at which the grace period Tex is canceled, this abnormality cannot be detected. Furthermore, when this abnormality repeats an operation like an oscillation operation, there is a problem that the abnormality continues and the device is destroyed.
上記の従来例の異常検出方式では、異常信号はある程度固定的な或いは長時間継続するという前提で構成されたもので、スイッチング素子の異常動作、或いはドライブ回路内の異常による振動的な或いは発振的な異常は考慮されていない。本発明の目的は上記のような振動的な或いは発振的な異常のケースにも対応可能な異常検出方式を提供することにある。 The above-described conventional abnormality detection method is configured on the premise that the abnormal signal is fixed to a certain extent or lasts for a long time, and it is vibrational or oscillating due to an abnormal operation of the switching element or an abnormality in the drive circuit. No abnormalities are considered. An object of the present invention is to provide an anomaly detection method that can cope with cases of vibration or oscillation as described above.
上記目的を達成するため、本発明に係る電力変換器の異常検出方式では、直流定電圧源のプラス側とマイナス側の間に複数の半導体スイッチング素子を接続して構成され、該複数半導体スイッチング素子のオン・オフ状態の組み合わせにより直流電圧源の電位レベルを選択し出力する電力変換器を制御する制御装置において、個々の半導体スイッチング素子を駆動するドライブ回路に対して制御指令信号を出力するとともに該制御指令信号に対応して前記ドライブ回路がスイッチング素子を駆動している動作状態よりオン側に駆動しているかオフ側に駆動しているかを判定する判定機能の判定情報と該制御指令信号とを比較して該判定情報と該制御指令信号の不一致を検出する不一致検出手段と、該不一致検出手段が前記制御指令信号の変化後から所定の時間範囲内のみで不一致を出力していることを監視し、前記所定の時間範囲を超えて不一致が検出された場合に、ドライブ回路或いはスイッチング素子自体の異常動作と判定する異常判定部と、を有し、前記不一致検出手段に入力する制御指令信号は、該制御指令信号が出力された後、これに対応してドライブ回路が動作し、その動作を判定機能が検出し、その判定情報が前記不一致検出手段に到達するまでの所要時間とほぼ同等な遅れ要素を介して入力する電力変換器の異常検出方式とした。 In order to achieve the above object, the power converter abnormality detection system according to the present invention is configured by connecting a plurality of semiconductor switching elements between a positive side and a negative side of a DC constant voltage source, and the plurality of semiconductor switching elements In a control device for controlling a power converter that selects and outputs a potential level of a DC voltage source by a combination of on / off states of the control circuit, a control command signal is output to a drive circuit that drives each semiconductor switching element. Corresponding to the control command signal, determination information of a determination function for determining whether the drive circuit is driving on or off from the operating state in which the switching element is driving is output and the control command signal A mismatch detection means for detecting a mismatch between the determination information and the control command signal, and a change in the control command signal when the mismatch detection means The abnormality determination unit that monitors that a mismatch is output only within a predetermined time range from the first time and determines that the drive circuit or the switching element itself is abnormal when a mismatch is detected exceeding the predetermined time range. The control command signal to be input to the inconsistency detection means is output after the control command signal is output, and the drive circuit operates in response to the control command signal. A power converter abnormality detection method is adopted in which information is input via a delay element substantially equivalent to the time required for reaching the mismatch detection means .
本発明によれば、前記のような振動的な異常の場合も制御指令信号が変化した直後の所定時間経過後は全て異常検出が可能となる。また、ドライブ回路で発生した異常の情報を確実に判定できるので異常に対する保護動作を早く作動することができ異常によるシステムの損傷を最小限に抑制することが可能となる。 According to the present invention, even in the case of a vibrational abnormality as described above, it is possible to detect an abnormality all after a predetermined time immediately after the control command signal changes. In addition, since information on an abnormality that has occurred in the drive circuit can be reliably determined, a protection operation against the abnormality can be activated quickly, and damage to the system due to the abnormality can be minimized.
本発明では、制御指令を出力しそれに対応したオン・オフ判定信号がフィードバックされるまでの遅れ時間の最大値に対応した時間範囲でのみ不一致を許容し、それ以外の時間に発生した不一致は全て異常と判定する方式をとる。以下、本発明の実施の形態について図面を用いて説明する。 In the present invention, mismatch is allowed only in the time range corresponding to the maximum value of the delay time until the control command is output and the corresponding ON / OFF determination signal is fed back, and all the mismatches occurring at other times are all Use a method of judging abnormal. Hereinafter, embodiments of the present invention will be described with reference to the drawings.
図1に本発明の実施例である電力変換器の異常検出方式のシステム例を示す。スイッチング素子数は電力変換器のシステムにより異なるが本図ではスイッチング素子が2個の場合を示す。図1により、その構成を説明する。電力変換器3の制御装置1は、制御指令信号発生部4で生成した制御指令信号を、電力変換器3を構成する個々のスイッチング素子であるIGBT300,310に対し、制御情報PWM0、PWM1を個々のIGBTのドライブ回路200、210に出力している。この制御情報がドライブ回路200、210内で整形され電力変換器を構成する半導体スイッチング素子IGBT300、310が駆動される。
FIG. 1 shows a system example of a power converter abnormality detection system according to an embodiment of the present invention. Although the number of switching elements varies depending on the power converter system, this figure shows a case where there are two switching elements. The configuration will be described with reference to FIG. The
またIGBTのオン・オフの動作状態をドライブ回路200、210内で判定し、その情報FB0、FB1が制御装置1にフィードバックされ不一致検出部400、410において制御指令信号を所定の時間遅らせた信号DP0、DP1と比較されて異常検出が行われている。異常検出された信号は論理和機能20を介して制御指令信号発生部4に伝達され異常検出時には制御指令信号の発生を停止する構成となっている。上記はスイッチング素子に対応した系列が2系列の場合を示したが、スイッチング素子に対応した系列がさらに多数あっても論理和機能20を介して異常信号が統合され制御指令信号発生部4の停止を行う点は変わりがない。
Further, the on / off operation state of the IGBT is determined in the
図2は、上記図1の構成の内IGBT300に対応した1つの系列をより詳細に示した図である。図2によりさらに詳細に説明する。制御装置1の内部では電力変換器3の制御に対応しIGBTのオン・オフに対応した制御指令信号PWMPが制御指令信号発生部4より出力され、電気光変換器(E/O)5により光の制御信号PWM0に変換され、これが、光ファイバ6を介してドライブ装置200に伝達される。光ファイバ6は高電圧回路である電力変換器3と電子回路である制御装置1の間の電気的絶縁を取る為のものである。ドライブ回路200では、制御信号PWM0は光電気変換器(O/E)7で再度電気信号に変換され波形整形回路8によりドライブ回路200内での電気的に整合の取れた波形DSに整形され、これをAMP回路9により駆動信号GSとしてIGBT300を駆動する。
FIG. 2 is a diagram showing one series corresponding to IGBT 300 in the configuration of FIG. 1 in more detail. This will be described in more detail with reference to FIG. Inside the
一方、判定機能10は駆動信号GSを監視しIGBT300がオンに駆動されているかオフに駆動されているかを判定し、その判定情報DFBは論理反転機能11、電気光変換器(E/O)12、光ファイバ13、光電気変換器(O/E)14、及び論理反転機能15を介してフィードバック信号FBとして不一致検出部400に与えられる。不一致検出部400では、制御指令信号PWMPを遅延機能21により所定時間遅らせた信号DP0とフィードバック信号FBが不一致検出用のEOR機能16に入力され、両方の入力信号がオン、オフ不一致時に不一致信号NEが出力される。
On the other hand, the
一方、制御指令信号PWMPの変化点を検出しこの変化点より所定の時間幅のパルスRPを出力するタイマ31を有し、このタイマ出力RPと不一致信号NEとがAND機能18に入力される。AND機能18では不一致信号NEがタイマ出力RPの発生されている時間のみ通過を禁止するよう構成される。AND機能18を通過した不一致信号NEは異常検出保持機能19により保持され、異常信号CFDが出力され、これが論理和機能20を介して他の系列の異常信号とともに制御指令信号発生部4の制御指令信号PWMPの出力が停止させられる。
On the other hand, it has a
ここで、遅延機能21は、不一致信号の出力をできるだけ短時間にするために設けられており、その遅延時間は、制御指令信号がドライブ回路に伝達されそのフィードバック信号FBが不一致検出部400に到達するまでの遅延時間の平均値程度にセットされるが、前記遅延時間の最大値と最小値の中間値であればよく、厳密な設定は必要としない。
Here, the
また、タイマ31の発生するパルスRPのパルス幅は、正常時の全ての動作条件における、前記制御指令信号がドライブ回路に伝達されそのフィードバック信号FBが不一致検出部400に到達するまでの遅延時間の最大値より大きい範囲でかつ極力短い時間が設定される。IGBT310に対応した系列も全く同様に構成され検出された異常信号は論理和機能20を介して一つの信号とされ制御指令信号発生部4の制御指令信号を停止させる。
Further, the pulse width of the pulse RP generated by the
図3に、本発明に使用されるタイマ31の回路実施例の構成を示す。本実施例は、タイマ設定時間が制御指令信号PWMPの最小出力パルス幅に比べて短時間であることを利用し簡易に構成している。即ち、制御指令信号PWMPは遅延機能35に入力され一定時間、即ち、検出猶予時間Tex遅延させられDL1として出力される。これがEOR機能34に入力され、これとPWMPが比較されて、制御指令信号PWMPの変化後において上記遅延機能35の遅延時間分Texの時間長パルスRPが生成される。図4に制御指令信号PWMPと生成パルスRPの波形を示す。
FIG. 3 shows a configuration of a circuit embodiment of the
図5〜図10に、図2に示す本発明の実施例の異常検出方式の動作波形を示す。図5は、図2の構成の中に異常がない場合における制御指令信号がオフからオンへ変化した時の動作(a)を示す。時刻A点において制御指令信号発生部4からIGBT300をオフからオンへ切り替えるよう制御指令信号PWMPが出力されたとする。この場合、図2の制御指令信号PWMPから駆動信号GSに至るまでの回路の動作遅れ時間によってTpg1を経たB点において駆動信号GSの信号がオフからオンに変化する。さらに駆動信号GSにおける信号変化は、図2の駆動信号GSからフィードバック信号FBに至るまでの回路の動作遅れ時間によってTgf1を経たC点で、フィードバック信号FBがオフからオンに変化する。
5 to 10 show operation waveforms of the abnormality detection method of the embodiment of the present invention shown in FIG. FIG. 5 shows an operation (a) when the control command signal changes from OFF to ON when there is no abnormality in the configuration of FIG. It is assumed that the control command signal PWMP is output from the control command
一方、制御指令信号PWMPが、遅れ回路21によって、制御指令信号PWMPがドライブ回路に伝達され、そのフィードバック信号FBが不一致検出部400に到達するまでの遅延時間平均値程度の時間長Tpfの時間遅れを受けた信号DP0と前記フィードバック信号FBとが不一致検出用のEOR機能16によって比較されるので、上記のTpg1及びTgf1の遅れ時間とTpfの遅れ時間の差分、即ち、C点からF点の間、不一致信号NEに不一致に対応する信号が現れる。C点、F点ともに、A点以後でかつ、A点から猶予時間Tex後に生じるD点より、以前に発生するように設定されているから、タイマ出力PRによりAND機能を介してマスクされる。したがって異常出力DTは出力されず異常検出保持機能19はセットされることは無く、その出力CFDには異常信号は現れない。即ち、構成の中に異常がない場合には異常信号は出ない。
On the other hand, the control command signal PWMP is transmitted by the
同様に、図6は、本構成の中に異常がない場合の制御指令信号がオンからオフへ変化した時の動作(b)を示す。図5と同様に時刻A点において制御指令信号発生部からIGBT300をオンからオフへ切り替えるよう信号が出力されたとする。この場合も図5と同様に不一致検出用のEOR機能16によってフィードバック信号FBと、制御指令信号PWMPが遅れ回路21によってTpfの時間遅れを受けた信号DP0とが比較されるので、上記のTpg0及びTgf0の遅れ時間とTpfの遅れ時間の差分、即ちC点からF点の間、不一致信号NEに不一致に対応する信号が現れる。このときも、前記と同様にC点、F点ともに、A点以後でかつ、A点からTex後に生じるD点以前に発生するからタイマ出力PRによりAND機能を介してマスクされる。したがって異常出力DTは出力されず異常検出保持機能19はセットされることは無くその出力CFDには異常信号は現れない。
Similarly, FIG. 6 shows the operation (b) when the control command signal changes from on to off when there is no abnormality in the present configuration. Assume that a signal is output from the control command signal generator to switch the
図7および図8に制御指令信号がドライブ回路に伝達されそのフィードバック信号FBが不一致検出部400に到達するまでの遅延時間が何らかの異常によりTex以上に長くなった場合の動作(c)および(d)を示す。いずれの場合もフィードバック信号FBの終点であるC点がD点を越えるため、不一致信号NEがタイマ出力RPによりマスクされない部分で異常出力DTが出力され異常検出される。
7 and 8, the operations (c) and (d) when the delay time until the control command signal is transmitted to the drive circuit and the feedback signal FB reaches the
図9に、制御指令信号がオフにもかかわらず、何らかの異常によりドライバ回路出力である駆動信号GSがオンとなった場合(e)を示す。B点において駆動信号GSが異常動作すると、これが図2の判定機能10により検出され、フィードバック信号FBに至るまでの回路の動作遅れ時間Tgf1を経た後、C点でフィードバック信号FBがオフからオンに変化する。不一致検出用のEOR機能16によってこのフィードバック信号FBがTpfの時間遅れを受けた信号DP0と比較されるが、制御指令信号PWMPが変化していないので、Tpfの時間遅れを受けた信号DP0も制御指令信号PWMPと同じ状態を保っているので即時に不一致信号NEが出力され、かつマスクを行うタイマ出力RPも発生されていないのでAND機能によるマスクはされず異常信号DTが出力され異常検出保持機能19はセットされ、異常信号CFDが現れる。
FIG. 9 shows a case (e) where the drive signal GS which is the driver circuit output is turned on due to some abnormality even though the control command signal is turned off. When the drive signal GS operates abnormally at the point B, this is detected by the
図10にスイッチング素子の異常動作、或いはドライブ回路内の異常により駆動信号GSが振動的な或いは発振的な異常を起こした場合(f)を示す。即ち、B2,B3点で示すように、オンしその後オフすることを繰り返す場合、制御指令信号PWMPの変化直後のA点、D点間では、不一致信号NEはマスクされるが、タイマ出力RPが消失するD点以後、B2,B3点で駆動信号GSに発生する異常信号に対しては、マスクはされない。したがってC2、C3点で異常信号DTが出力され異常検知される。即ち、Texに比べて短い異常信号の繰り返しのような異常モードにおいても、異常をマスクするタイマ出力RP信号は、制御指令信号PWMPの変化直後に発生するのみであるから、異常信号GS或いは不一致信号NEに現れる異常波形に無関係にタイマ出力RPがオフした後は、不一致信号NEはマスクされず異常信号DTに出力され、異常検出保持機能19はセットされて異常信号CFDが現れる。
FIG. 10 shows a case (f) in which the drive signal GS causes a vibration or oscillation abnormality due to an abnormal operation of the switching element or an abnormality in the drive circuit. That is, as shown by points B2 and B3, when repeatedly turning on and then off, the mismatch signal NE is masked between the points A and D immediately after the change of the control command signal PWMP, but the timer output RP is After the disappearing point D, the abnormal signals generated in the drive signal GS at the points B2 and B3 are not masked. Accordingly, an abnormality signal DT is output at points C2 and C3, and abnormality is detected. That is, even in an abnormal mode such as repetition of an abnormal signal that is shorter than Tex, the timer output RP signal that masks the abnormality is generated immediately after the change of the control command signal PWMP. After the timer output RP is turned off regardless of the abnormal waveform appearing in NE, the mismatch signal NE is not masked and output as the abnormal signal DT, and the abnormality
本実施例においては、上記のように、不一致信号NEのマスクを、従来例のように不一致信号NEの波形に依存させるのでなく、制御指令信号PWMPの変化直後に限定するようにした。このため、スイッチング素子の異常動作、或いはドライブ回路内の異常により、駆動信号GSが振動的な或いは発振的な異常を起こした場合のようなケースにおいても、不要に検出猶予時間が発生されることは無く、確実に異常検知がなされる。また、制御指令信号PWMPが一定値を保っている場合、猶予時間は発生しないので異常発生時に即時に異常に対応する処置が可能となり、装置の保護上有効な異常検知が可能となる。 In this embodiment, as described above, the mask of the mismatch signal NE is not dependent on the waveform of the mismatch signal NE as in the conventional example, but is limited to immediately after the change of the control command signal PWMP. For this reason, even in the case where the drive signal GS causes a vibration or oscillation abnormality due to an abnormal operation of the switching element or an abnormality in the drive circuit, an unnecessary detection delay time is generated. There is no, and the abnormality is detected reliably. Further, when the control command signal PWMP is maintained at a constant value, no grace time is generated, so that it is possible to immediately cope with the abnormality when the abnormality occurs, and it is possible to detect an abnormality that is effective for protecting the apparatus.
ドライブ回路で発生した異常の情報を確実に判定できるので異常に対する保護動作を早く作動することができ異常によるシステムの損傷を最小限に抑制することが可能となるので、信頼性の高い電力変換装置となる。 Since it is possible to reliably determine the information of the abnormality that has occurred in the drive circuit, it is possible to operate the protection operation against the abnormality quickly, and to minimize damage to the system due to the abnormality, so that a highly reliable power conversion device It becomes.
1 制御装置
3 電力変換器
4 制御信号発生部
5 電気光変換器
6 光ファイバ
7 光電気変換器
8 波形整形回路
9 AMP回路
10 判定機能
11 論理反転機能
12 電気光変換器
13 光ファイバ
14 光電気変換器
15 論理反転機能
16 EOR機能
17 タイマ
18 AND機能
19 異常検出保持機能
20 論理和機能
21 遅延機能
22 遅延機能
31 タイマ
34 EOR機能
35 遅延機能
200 ドライブ回路
210 ドライブ回路
300 IGBT
310 IGBT
400 不一致検出部
410 不一致検出部
DESCRIPTION OF
310 IGBT
400
Claims (2)
個々の半導体スイッチング素子を駆動するドライブ回路に対して制御指令信号を出力するとともに該制御指令信号に対応して前記ドライブ回路がスイッチング素子を駆動している動作状態よりオン側に駆動しているかオフ側に駆動しているかを判定する判定機能の判定情報と該制御指令信号とを比較して該判定情報と該制御指令信号の不一致を検出する不一致検出手段と、
該不一致検出手段が前記制御指令信号の変化後から所定の時間範囲内のみで不一致を出力していることを監視し、前記所定の時間範囲を超えて不一致が検出された場合に、ドライブ回路或いはスイッチング素子自体の異常動作と判定する異常判定部と、を有し、
前記不一致検出手段に入力する制御指令信号は、該制御指令信号が出力された後、これに対応してドライブ回路が動作し、その動作を判定機能が検出し、その判定情報が前記不一致検出手段に到達するまでの所要時間とほぼ同等な遅れ要素を介して入力することを特徴とする電力変換器の異常検出方式。 A power that is configured by connecting a plurality of semiconductor switching elements between a positive side and a negative side of a DC constant voltage source, and selecting and outputting a potential level of the DC voltage source by a combination of on / off states of the plurality of semiconductor switching elements In the control device for controlling the converter,
A control command signal is output to a drive circuit that drives each semiconductor switching element, and in response to the control command signal, the drive circuit is driven on or off from an operating state in which the switching element is driven. A non-coincidence detecting means for comparing the determination information of the determination function for determining whether the control is driven to the control command signal and detecting a mismatch between the determination information and the control command signal;
It is monitored that the mismatch detection means outputs a mismatch only within a predetermined time range after the change of the control command signal, and when a mismatch is detected exceeding the predetermined time range, a drive circuit or possess an abnormality determination unit for determining an abnormal operation of the switching element itself, and
The control command signal to be input to the mismatch detection means is such that the drive circuit operates in response to the output of the control command signal, the operation is detected by the determination function, and the determination information is the mismatch detection means. An abnormality detection method for a power converter, characterized in that the input is made through a delay element substantially equal to the time required to reach
前記所定の時間範囲以上の不一致を出力する状態が生じた時、その後不一致を出力する状態が消失してもその異常検出情報を保持するとともに異常検出情報により上記電力変換器内の半導体スイッチング素子をオフする制御指令を出力させることを特徴とする電力変換器の異常検出方式。 In the power converter abnormality detection method according to claim 1,
When a state of outputting a mismatch exceeding the predetermined time range occurs, even if the state of outputting the mismatch disappears thereafter, the abnormality detection information is retained and the semiconductor switching element in the power converter is abnormality detection method for a power converter according to claim Rukoto to output a control command to turn off.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009093907A JP5373457B2 (en) | 2009-04-08 | 2009-04-08 | Abnormality detection method for power converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009093907A JP5373457B2 (en) | 2009-04-08 | 2009-04-08 | Abnormality detection method for power converter |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2010246309A JP2010246309A (en) | 2010-10-28 |
JP5373457B2 true JP5373457B2 (en) | 2013-12-18 |
Family
ID=43098722
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2009093907A Active JP5373457B2 (en) | 2009-04-08 | 2009-04-08 | Abnormality detection method for power converter |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5373457B2 (en) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7101451B2 (en) | 2016-07-19 | 2022-07-15 | ナブテスコ株式会社 | Electric actuator drive control device and aircraft |
JP7101452B2 (en) * | 2016-07-19 | 2022-07-15 | ナブテスコ株式会社 | Electric actuator drive control device and aircraft |
JP7077588B2 (en) * | 2017-11-21 | 2022-05-31 | 株式会社デンソー | Signal propagation device |
JP6966121B1 (en) * | 2020-09-25 | 2021-11-10 | Necプラットフォームズ株式会社 | Signal judgment device, power supply device, signal judgment method and program |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0956177A (en) * | 1995-08-18 | 1997-02-25 | Hitachi Ltd | Gate signal generating circuit for power conversion equipment |
JPH11356035A (en) * | 1998-06-04 | 1999-12-24 | Hitachi Ltd | Gate driving device for voltage-driven self-arc-extinguishing element |
JP4434510B2 (en) * | 2001-03-16 | 2010-03-17 | 株式会社東芝 | Fault detection method and fault detection apparatus for insulated gate semiconductor device |
JP4693362B2 (en) * | 2004-04-23 | 2011-06-01 | 株式会社東芝 | Power converter |
JP2006254657A (en) * | 2005-03-14 | 2006-09-21 | Toyota Motor Corp | Power supply device with overcurrent prevention function |
JP4338721B2 (en) * | 2006-08-22 | 2009-10-07 | 株式会社日立製作所 | Power conversion apparatus and abnormality detection method thereof |
-
2009
- 2009-04-08 JP JP2009093907A patent/JP5373457B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2010246309A (en) | 2010-10-28 |
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Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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|
A521 | Written amendment |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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