JP5095561B2 - 送受共用回路 - Google Patents
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Description
図3に示す送受共用回路100において、共用端子101には例えば共用アンテナが接続され、受信帯域がFBr1,FBr3、送信帯域がFBt1,FBt3とされている3G用の無線機A(104)が第1端子102に接続され、受信帯域がFBr2、送信帯域がFBt2とされているLTE用の無線機B(105)が第2端子103に接続されている。この送受共用回路100はCIB(CONSTANT IMPEDANCE BANDPASS-FILTER)型の共用回路とされており、その動作について説明すると、共用端子101に入力された共用アンテナ等からの3つの受信帯域FBr1,FBr2,FBr3からなる受信周波数帯域FBrの受信信号は、第2のCIB111に入力される。第2のCIB111は、3dBハイブリッド回路111a,111dとバンドパスフィルタ(BPF)111b、111cからなり、3dBハイブリッド回路111aの端子Hに入力された受信周波数帯域FBrの受信信号は、端子Gと端子Fに2分配されて出力される。この場合、同相で端子Gに出力されると共に90°遅れて端子Fに出力される。
そこで、本発明はハイブリッド回路とバンドパスフィルタとを組み合わせる送受共用回路としても、回路規模を小さくすることのできる送受共用回路を提供することを目的としている。
図1に示す送受共用回路1は、アンテナと3G用の第1の無線機およびLTE用の第2の無線機との間に設けられて、アンテナにより受信された受信信号を3G用の第1の無線機およびLTE用の第2の無線機とに使用する周波数帯域別に振り分けると共に、3G用の第1の無線機およびLTE用の第2の無線機からの送信信号を合成してアンテナから放射できるようにしている。この場合の3G用の第1の無線機およびLTE用の第2の無線機の受信周波数帯域および送信周波数帯域は図2に示すとおりとされている。すなわち、3G用の第1の無線機が使用する周波数帯域は、2つの受信帯域FBr1,FBr3と2つの送信帯域FBt1,FBt3とされ、LTE用の第2の無線機が使用する周波数帯域は、受信帯域FBr2と送信帯域FBt2とされている。
これにより、送受共用回路1の共用端子10に入力された受信周波数帯域FBrの受信信号の内の受信帯域FBr1,FBr3の受信信号が第1の無線機A(13)に振り分けられると共に、受信帯域FBr2の受信信号が第2の無線機B(14)に振り分けられて入力されるようになる。
これにより、送受共用回路1の第1端子11に入力された第1の無線機A(13)から送信された送信帯域FBt1,FBt3の送信信号と、送受共用回路1の第2端子12に入力された第2の無線機B(14)から送信された送信帯域FBt2の送信信号とは、合成されて送信周波数帯域FBtの送信信号として共用端子10から出力されるようになる。
Claims (1)
- 3つの受信帯域からなる受信周波数帯域の内の低域と高域の受信帯域を第1受信帯域とすると共に、該受信周波数帯域と離隔された3つの送信帯域からなる送信周波数帯域の内の低域と高域の送信帯域を第1送信帯域とする第1の無線機と、
前記受信周波数帯域の内の中域の受信帯域を第2受信帯域とすると共に、前記送信周波数帯域の内の中域の送信帯域を第2送信帯域とする第2の無線機と、
前記第1の無線機が接続された端子Aと、該端子Aに入力された信号が同相で出力される端子Bと、前記端子Aに入力された信号が90°遅れて出力される端子Hと、前記端子Aに入力された信号が出力されない端子Gとを有する第1ハイブリッド回路と、
該第1ハイブリッド回路の前記端子Bに一端が接続された前記第2受信帯域のみを通過させる第1受信用バンドパスフィルタおよび前記第2送信帯域のみを通過させる第1送信用バンドパスフィルタと、
前記第1ハイブリッド回路の前記端子Hに一端が接続された前記第2受信帯域のみを通過させる第2受信用バンドパスフィルタおよび前記第2送信帯域のみを通過させる第2送信用バンドパスフィルタと、
前記第1受信用バンドパスフィルタおよび前記第1送信用バンドパスフィルタの他端が接続された端子Eと、該端子Eに入力された信号が同相で出力されると共に前記第2の無線が接続された端子Fと、前記端子Eに入力された信号が90°遅れて出力される端子Rと、前記端子Eに入力された信号が出力されないと共に前記第2受信用バンドパスフィルタおよび前記第2送信用バンドパスフィルタの他端が接続された端子Lとを有する第2ハイブリッド回路と、
前記第2ハイブリッド回路の前記端子Rに接続された終端抵抗とを備え、
前記第1ハイブリッド回路において、前記端子Bに入力された信号は同相で前記端子Aに出力されると共に90°遅れて前記端子Gに出力され、前記端子Hに入力された信号は同相で前記端子Gに出力されると共に90°遅れて前記端子Aに出力され、前記端子Gに入力された信号は同相で前記端子Hに出力されると共に90°遅れて前記端子Bに出力され、前記第2ハイブリッド回路において、前記端子Fに入力された信号は同相で前記端子Eに出力されると共に90°遅れて前記端子Lに出力され、前記端子Lに入力された信号は同相で前記端子Rに出力されると共に90°遅れて前記端子Fに出力されることを特徴とする送受共用回路。
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