JP4886895B2 - 動的な電力の低減 - Google Patents
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Claims (29)
- 集積回路装置であって、
前記集積回路装置の動作中にアイドル状態となり得る1以上の機能ブロックまたはマルチコアプロセッサ内の1以上のコアと、
アイドル状態である前記1以上の機能ブロックまたはコアの数、アイドル状態である前記1以上の機能ブロックまたはコアの数とコア毎動的電流値に基づく供給電流低減量、および負荷ライン抵抗値に基づいて、電圧レギュレータモジュール(VRM)に対して要求する供給電圧レベルを決定するロジックと
を備える集積回路装置。 - 前記1以上の機能ブロックは、プロセッサが備えるコアである
請求項1に記載の集積回路装置。 - 前記供給電圧レベルは、前記プロセッサの実行状態に基づいて決まる
請求項2に記載の集積回路装置。 - 前記供給電圧レベルは、前記実行状態についての電流のコア毎パラメータを調べることによって決定される量だけ、低減される
請求項3に記載の集積回路装置。 - 前記供給電圧レベルは、IC動的容量の関数として供給電流低減幅を決定することに基づいて決まる量だけ、低減される
請求項3に記載の集積回路装置。 - 前記供給電圧レベルは、前記実行状態に対するコア毎ΔVパラメータを調べることによって決定される量だけ、低減される
請求項3に記載の集積回路装置。 - 前記1以上の機能ブロックまたはコアは、アイドル状態でなく同一実行状態にある場合、消費する動的電流が略同じである
請求項1から請求項6のいずれか1つに記載の集積回路装置。 - 前記ロジックおよび前記1以上の機能ブロックまたはコアは、供給領域の一部であって、前記供給領域は、前記集積回路装置内の複数の供給領域のうちの1つである
請求項1から請求項7のいずれか1つに記載の集積回路装置。 - 前記1以上のコアを有する前記マルチコアプロセッサを備え、
前記ロジックは、アイドル状態である前記1以上のコアの数に基づいて、前記マルチコアプロセッサの前記1つ以上のコアに対する前記供給電圧レベルを決定する請求項1から請求項8のいずれか1つに記載の集積回路装置。 - 前記コア毎動的電流値は、前記1以上の機能ブロックまたはコアに対するP状態パラメータに基づいて選択される請求項1から請求項9のいずれか1つに記載の集積回路装置。
- 集積回路装置によって実行される方法であって、
電圧レギュレータモジュール(VRM)に対して要求される所定の供給電圧を決定する段階と、
動作中の集積回路においてアイドル状態である、機能ブロックまたはマルチコアプロセッサ内のコアの数を決定する段階と、
コア毎動的電流値を決定し、前記アイドル状態である機能ブロックまたはコアの数で前記コア毎動的電流値を乗算することで、供給電流低減量を決定する段階と、
前記供給電流低減量および負荷ライン抵抗値に基づいて前記所定の供給電圧の低減量を決定する段階と、
前記供給電流低減量および前記負荷ライン抵抗値に基づいて決定された前記低減量で前記所定の供給電圧を低減する段階と
を備える方法。 - 低減された前記所定の供給電圧を前記VRMに与える段階
をさらに備える、請求項11に記載の方法。 - 前記機能ブロックは、マルチコアプロセッサに含まれるコアである
請求項11または12に記載の方法。 - 前記負荷ライン抵抗値は、前記集積回路に書き込まれている
請求項11から請求項13のいずれか1つに記載の方法。 - 前記負荷ライン抵抗値は、前記集積回路の外部から取得される
請求項14に記載の方法。 - コア毎ΔVR値を決定して、前記コア毎ΔVR値をアイドル状態のコアの数で乗算して、前記所定の供給電圧をどれだけ低減するかを決定する段階
を備える、請求項11から請求項15のいずれか1つに記載の方法。 - プロセッサであって、
複数の実行状態から選択される1の実行状態において動作可能な複数のコアと、
入力供給電圧VCを前記複数のコアに対して供給するべく、供給電圧VRを要求する電圧選択ロジックと
を備え、
前記供給電圧VRは、前記プロセッサの動作中にアイドル状態にあるコアの数、コア毎動的電流値および前記アイドル状態のコアの数に基づく供給電流低減量、および負荷ライン抵抗値に基づいて決定される量で低減される
プロセッサ。 - 前記供給電圧VRは、前記選択される実行状態に基づいて、供給電流低減幅を決定することに基づいて決まる量だけ、所定のVRを低減することによって決定される
請求項17に記載のプロセッサ。 - 前記供給電流低減幅は、実行状態データ構造からコア毎供給電流値を取得することによって決定される
請求項18に記載のプロセッサ。 - 前記供給電圧VRは、前記選択される実行状態に基づいて、コア毎電圧値を決定することによって決まる量だけ、所定のVRを低減することによって決定される
請求項17に記載のプロセッサ。 - 前記コア毎電圧値は、実行状態データ構造から取得される
請求項20に記載のプロセッサ。 - 前記供給電圧VRは、VRMに対して要求される
請求項17から請求項21のいずれか1つに記載のプロセッサ。 - 前記VRMの少なくとも一部を備える
請求項22に記載のプロセッサ。 - 前記複数のコアおよび前記電圧選択ロジックは、供給領域の一部であって、前記供給領域は、前記プロセッサの複数の供給領域のうち1つである
請求項17から請求項23のいずれか1つに記載のプロセッサ。 - プロセッサと、
電圧レギュレータの少なくとも一部と、
前記プロセッサに結合されて、前記プロセッサとワイヤレスネットワークとを通信可能にリンクするアンテナと
を備え、
前記プロセッサは、
複数の実行状態から選択される1の実行状態において動作可能な複数のコアと、
入力供給電圧VCを前記複数のコアに対して供給するべく、供給電圧VRを要求する電圧選択ロジックと
を有し、
前記供給電圧VRは、前記プロセッサの動作中にアイドル状態にあるコアの数、コア毎動的電流値および前記アイドル状態のコアの数に基づく供給電流低減量、および負荷ライン抵抗値に基づいて決定される量で低減される、
前記電圧レギュレータの少なくとも一部は、前記供給電圧VRを生成して、前記プロセッサに前記入力供給電圧VCを与える
コンピュータシステム。 - 前記供給電圧VRは、前記選択される実行状態に基づいて、供給電流低減幅を決定することに基づいて決まる量だけ、所定のVRを低減することによって決定される
請求項25に記載のコンピュータシステム。 - 前記供給電流低減幅は、実行状態データ構造からコア毎供給電流値を取得することによって決定される
請求項26に記載のコンピュータシステム。 - 前記供給電圧VRは、前記選択される実行状態に基づいて、コア毎電圧値を決定することによって決まる量だけ、所定のVRを低減することによって決定される
請求項25から請求項27のいずれか1つに記載のコンピュータシステム。 - 前記コア毎電圧値は、実行状態データ構造から取得される
請求項28に記載のコンピュータシステム。
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