JP4768386B2 - 外部デバイスとデータ通信可能なインターフェイスデバイスを有するシステム及び装置 - Google Patents
外部デバイスとデータ通信可能なインターフェイスデバイスを有するシステム及び装置 Download PDFInfo
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Description
1010 キー
102 セル
104 ネットワーク
106 クライアント
108 サーバー・コンピュータ
1104 光インターフェース
1108 バス
1118,1122 ポート
1126 光導波路
1160,1162,1164,1166,1182,1184,1186,1188,1190 光インターフェース
1206,1234,1242 コントロール
1212,1240 ユニット
1221 クロスバ交換機
1232 外部ポート
1244,1414,1416 バンク
1406 ブロック
1504 ノード
1607,1608 バス
1722 制御回路
1724,1742 制御論理回路
1726 ストレージ
1728,1731,1732,1746,1750 ロケーション
1729,1752,1760,1762 セグメント
1880 エンプティ状態
1882 フル状態
1884 ブロッキング状態
1902 キー管理テーブル
1906 キー
1908 マスク
2006 格納位置
2008,2010 セグメント
2012 キー
2102 アクセス管理テーブル
2106 アドレス
2110 キー
2110 キー・マスク
223 バス
227 高帯域メモリ接続部
2302,2320 セル
2308 ヘッダ
2322 インターフェース
2332 実行セクション
2334 リスト
2520,2522,2524,2526,2704 サンドボックス
2706 宛先サンドボックス
2900 処理環境
2901,2902,2903 APU
2905 PU
2906〜2908 バス
2910 DRAM
2915 インターフェース
2920 外部デバイス
2930 エレメント
2940 保護テーブル
2945 伝送コントローラ
2950 伝送パス
2981 メモリ
3020 外部メモリ
3620 物理レシーバ
3706,3707 バス
3715 インターフェース
3720 外部デバイス
3730,3735,3745,3740 エレメント
3781 メモリ
4015 インターフェース
4020 外部デバイス
4030,4031 エレメント
4050,4055 出力チャネル
Claims (21)
- 外部デバイスと通信を行うシステムであって、
前記システムから前記外部デバイスへのデータ通信と前記外部デバイスから前記システムへのデータ通信とを行うインターフェースデバイスと、
複数の演算処理ユニットと、
前記各演算処理ユニットに設けられて、各々が前記データを格納する複数のメモリ・ロケーションを持つメモリと、
第1の伝送パスを通じて前記インターフェースデバイスに接続された外部デバイスと、前記第1の伝送パスとは異なる第2の伝送パスを通じて前記インターフェースデバイスに接続された、前記複数の演算処理ユニットの共用メモリと、を含み、前記共用メモリには複数のメモリ・ロケーションが含まれ、
前記共用メモリの前記メモリ・ロケーションには、前記演算処理ユニットによって状態情報が格納され、前記状態情報には、第1フィールドとアドレス・フィールドとが含まれ、前記アドレス・フィールドは、前記共用メモリの前記メモリ・ロケーションに書き込まれたデータの転送先を示すアドレスの書き込み及び消去が行われるものであり、
前記演算処理ユニット又は外部ユニットは、前記共用メモリの前記メモリ・ロケーションへの書き込みオペレーションを行うとともに、当該書き込みオペレーションが終了した後に、前記状態情報の前記第1フィールドの値が第1の状態値であり、かつ前記アドレスフィールドにアドレスが書き込まれている場合に、前記共用メモリの前記メモリ・ロケーションに書き込まれたデータを前記書き込まれたアドレス値によって示されるアドレスに書き込む、システム。 - 前記アドレスは前記外部デバイス内のメモリを表すアドレスである、請求項1記載のシステム。
- 前記インターフェースデバイスと結合されて前記メモリに対してデータアクセスを行うプロセッサを含み、前記プロセッサは、前記演算処理ユニットのうちの一つであり、かつ、前記外部デバイスに対して要求を発行する、請求項1又は2記載のシステム。
- 少なくとも1つの前記要求は、前記外部デバイスからのデータの読み出し要求である、請求項3記載のシステム。
- 少なくとも1つの前記要求は、前記外部デバイスへのデータの書き込み要求である、請求項3記載のシステム。
- 前記外部デバイスは、前記インターフェースデバイスと結合されている、請求項1〜5のいずれかに記載のシステム。
- 前記インターフェースデバイスは、DMA伝送を用いて、前記システムから前記外部デバイスへのデータ通信と、前記外部デバイスから前記システムへのデータ通信と、を行う、請求項1〜6のいずれかに記載のシステム。
- 前記インターフェースデバイス内に、前記共用メモリ及び前記外部デバイスへのアクセス制御を行う伝送コントローラと、前記プロセッサによってアクセス可能な共用メモリの領域を示す情報が記録された保護テーブルと、を有し、
前記伝送コントローラは、前記保護テーブルに格納された情報を参照して、アクセスが要求されたメモリの値域が有効であるか否かを判断するアクセス制御を行う、請求項3記載のシステム。 - 複数の演算処理ユニットと、
前記各演算処理ユニットに設けられて、それぞれが複数のメモリ・ロケーションを持つメモリと、
第1の要求と第2の要求とを発行するとともに前記メモリと結合されたプロセッサと、
前記プロセッサのメモリに結合されたインターフェースデバイスと、
第2伝送パスを通じて前記インターフェースデバイスに接続された、前記複数の演算処理ユニットの共用メモリと、前記第2伝送パスとは異なる第1の伝送パスを通じて前記インターフェースデバイスに接続された外部デバイスと、
を含むシステムであって、前記インターフェースデバイスは、前記プロセッサから前記第1の要求を受信すると、前記外部デバイスから前記メモリへデータを伝送して前記メモリへ前記データを格納し、かつ、前記インターフェースデバイスは前記プロセッサから前記第2の要求を受信すると、前記メモリから前記外部デバイスへデータを伝送し、
前記共用メモリの少なくとも1つのメモリ・ロケーションには、複数の異なるメモリの状態として、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新であるという状態、又は最新ではないという状態を表すための状態情報が格納されており、前記状態情報が、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新ではないことを表し、かつ、読み出されたデータを記録すべきアドレスが前記状態情報に記録されている場合に、前記演算処理ユニットは、前記インターフェースデバイスを通じて、前記共用メモリの前記最新ではないメモリ・ロケーションへの書き込み要求を受信すると、当該書き込み要求を実行するとともに、前記共用メモリの前記メモリ・ロケーションに書き込まれたデータを、前記読み出されたデータを記録すべきアドレスに書き込む、システム。 - 前記読み出されたデータを記録すべきアドレスは前記外部デバイス内のアドレスを表す、請求項9記載のシステム。
- 前記プロセッサはローカル・メモリを更に有し、前記読み出されたデータを記録すべきアドレスは前記ローカル・メモリのメモリ・ロケーションを表わす、請求項9又は10記載のシステム。
- 前記第1の前記要求は、前記外部デバイスからのデータの読み出し要求に応答して発行される要求である、請求項9又は10又は11記載のシステム。
- 前記第2の要求は、前記外部デバイスからのデータの書き込み要求に応答して発行される要求である、請求項9又は10又は11記載のシステム。
- 前記外部デバイスは前記インターフェースデバイスと結合されている、請求項9〜13のいずれかに記載のシステム。
- 前記インターフェースデバイスは、DMA伝送を用いて、前記外部デバイスと前記メモリとの間でのデータ通信を行う、請求項9〜14のいずれかに記載のシステム。
- 前記プロセッサは、プロセシングユニット(PU)と、前記要求を発行する、少なくとも1つの付加処理ユニット(APU)とを含む、請求項9〜15のいずれかに記載のシステム。
- 前記インターフェースデバイス内に、前記共用メモリ及び前記外部デバイスへのアクセス制御を行う伝送コントローラと、前記プロセッサによってアクセス可能な共用メモリの領域を示す情報を格納する保護テーブルと、を有し、
前記伝送コントローラは、前記保護テーブルに格納された情報を参照して、アクセスが要求されたメモリの値域が有効であるか否かを判断するアクセス制御を行う、請求項9記載のシステム。 - 複数のプロセッサに接続されているとともに、第1の伝送パスを通じて外部デバイスに接続されて、この外部デバイスと前記複数のプロセッサとを相互接続し、更に、前記複数のプロセッサの共用メモリに前記第1の伝送パスとは異なる第2の伝送パスを通じて接続される装置であって、
保護テーブルを含み、前記保護テーブルは前記プロセッサによってアクセス可能な共用メモリの領域を示す情報が記録されており、
伝送コントローラを含み、前記伝送コントローラはプロセッサからの要求に応答して、前記外部デバイスと前記共用メモリの前記アクセス可能な領域のうちの少なくとも1つとの間のデータ伝送を制御するものであって、かつ、
伝送コントローラは、前記第1伝送パス及び第2伝送パスを通じて、前記外部デバイスと、前記共用メモリの前記少なくとも1つのアクセス可能な領域との間で前記データを伝送し、
前記複数のプロセッサの共用メモリのメモリ・ロケーションには、複数の異なるメモリの状態として、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新であるという状態、又は最新ではないという状態を表すための状態情報が格納されており、前記状態情報が、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新ではないことを表し、かつ、読み出されたデータを記録すべきアドレスが前記状態情報に記録されている場合に、前記伝送コントローラは、共用メモリの前記少なくとも1つのアクセス可能な領域のメモリ・ロケーションと前記外部デバイスとの間のデータ伝送を制御して、前記共用メモリの前記最新ではないメモリ・ロケーションへの書き込み要求を前記伝送コントローラが受信すると、前記伝送コントローラは、当該書き込み要求を実行するとともに、前記共用メモリの前記メモリ・ロケーションに書き込まれたデータを、前記読み出されたデータを記録すべきアドレスに書き込む、装置。 - 複数のプロセッサに接続されているとともに、第1の伝送パスを通じて外部デバイスに接続され、かつ前記第1の伝送パスとは異なる第2の伝送パスを通じて複数のプロセッサの共用メモリに接続されたインターフェースデバイスを介して、前記複数のプロセッサと前記外部デバイスとの間でデータ伝送を行う方法であって、
前記インターフェースデバイスが、前記外部デバイスと前記共用メモリとの間のデータ伝送を前記第1パス及び第2パスを通じて行い、かつ、前記共用メモリと前記プロセッサに設けられたローカルメモリとの間のデータ転送を前記第2パスを通じて行い、
前記共用メモリのメモリ・ロケーションには、複数の異なるメモリの状態として、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新であるという状態、又は最新ではないという状態を表すための状態情報が格納されており、前記状態情報が、前記共用メモリの前記メモリ・ロケーションに記録されたデータが最新ではないことを表し、かつ、読み出されたデータを記録すべきアドレスが前記状態情報に記録されている場合に、前記インターフェースデバイスは、前記共用メモリの最新ではないメモリ・ロケーションへの書き込み要求を前記伝送コントローラが受信すると、当該書き込み要求を実行するとともに、前記共用メモリの前記メモリ・ロケーションに書き込まれたデータを、前記読み出されたデータを記録すべきアドレスに書き込む、方法。 - 前記インターフェースデバイス内に、前記共用メモリ及び前記外部デバイスへのアクセス制御を行う伝送コントローラと、前記プロセッサによってアクセス可能な共用メモリの領域を示す情報を格納する保護テーブルと、を有し、
前記伝送コントローラは、前記保護テーブルに格納された情報を参照して、アクセスが要求されたメモリの値域が有効であるか否かを判断するアクセス制御を行う、請求項19記載の方法。 - 前記関連するアドレス値は前記プロセッサと関連付けられたローカル・メモリを示す、請求項19〜20のいずれかに記載の方法。
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