JP4766575B2 - Electronic musical instrument communication device - Google Patents

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Description

この発明は電子楽器の通信装置に関し、特に電子楽器で使用される各種データや各種信号のシリアル通信速度、あるいは転送レートを可変とした電子楽器の通信装置に関する。    The present invention relates to a communication device for an electronic musical instrument, and more particularly to a communication device for an electronic musical instrument in which the serial communication speed or transfer rate of various data and signals used in the electronic musical instrument is variable.

図12に、従来の電子楽器の通信装置の一例を示す。該電子楽器の通信装置は、ホストモジュール10、複数個の音源モジュール30、50、および発音モジュール70から構成されている。     FIG. 12 shows an example of a communication apparatus for a conventional electronic musical instrument. The electronic musical instrument communication apparatus includes a host module 10, a plurality of tone generator modules 30 and 50, and a sound generation module 70.

ホストモジュール10は、システムバス11に接続された鍵盤スキャナ部12、RAM13、CPUプログラム等を格納されたROM14、ホストモジュール10の全体の動作を制御するホストCPU15、FD(フロッピー(登録商標)ディスク)ドライバ16、パネルSW/表示部17、非同期シリアル通信部A18、および非同期シリアル通信部B19から構成されている。鍵盤スキャナ部12は、電子楽器本体1の鍵盤スイッチの状態を調べ、その鍵盤番号、オンまたはオフ情報を出力すると共に、そのオン/オフを示す信号から、鍵盤タッチの強さを示すタッチデータを生成する。また、FDドライバ16は、FD駆動装置2を制御し、FDから演奏データ等を読み出す動作をする。また、非同期シリアル通信部A18は、外部MIDIとの間でデータの送受信を非同期で行う。   The host module 10 includes a keyboard scanner unit 12 connected to the system bus 11, a RAM 13, a ROM 14 storing a CPU program, a host CPU 15 for controlling the entire operation of the host module 10, and an FD (floppy (registered trademark) disk). The driver 16, the panel SW / display unit 17, the asynchronous serial communication unit A 18, and the asynchronous serial communication unit B 19 are included. The keyboard scanner unit 12 checks the state of the keyboard switch of the electronic musical instrument main body 1, outputs the keyboard number, on / off information, and receives touch data indicating the strength of the keyboard touch from the on / off signal. Generate. Further, the FD driver 16 controls the FD driving device 2 and performs an operation of reading performance data and the like from the FD. The asynchronous serial communication unit A18 asynchronously transmits and receives data to and from external MIDI.

次に、音源モジュール30、50は同構成であるので音源モジュール30を代表にあげてその構成を説明すると、音源モジュール30は、システムバス31に接続された非同期シリアル通信部B32、モジュールNO.設定部33、音源CPU34、第1のROM35、第1のRAM36、第2のROM37、楽音発生回路38、DSP(Digital signal processor)39(エフェクト回路と呼ぶこともある)、第2のRAM40、およびDAC(Digital analog converter)41から構成されている。   Next, since the tone generator modules 30 and 50 have the same configuration, the tone generator module 30 will be described as a representative. The tone generator module 30 includes the asynchronous serial communication unit B32 connected to the system bus 31, the module NO. A setting unit 33, a sound source CPU 34, a first ROM 35, a first RAM 36, a second ROM 37, a musical sound generating circuit 38, a DSP (Digital signal processor) 39 (sometimes referred to as an effect circuit), a second RAM 40, and It consists of a DAC (Digital Analog Converter) 41.

前記非同期シリアル通信部B19と32は、両者間で、演奏データなどのデータを非同期シリアル通信する。前記モジュールNO.設定部33には、例えばディップスイッチ等で、音源モジュールの番号が付けられる。前記第1のROM35には、CPUプログラム、DSPプログラム、各種パラメータ等が格納される。また、第2のROM37は波形メモリとしての働きをする。前記DSP39はエフェクト回路として働き、前記第2のRAM40は、プログラムメモリおよび係数メモリとしての働きをする。   The asynchronous serial communication units B19 and 32 perform asynchronous serial communication of data such as performance data between them. The module NO. The setting unit 33 is assigned the number of the sound module by, for example, a dip switch. The first ROM 35 stores a CPU program, a DSP program, various parameters, and the like. The second ROM 37 functions as a waveform memory. The DSP 39 functions as an effect circuit, and the second RAM 40 functions as a program memory and a coefficient memory.

さらに、発音モジュール70は、前記音源モジュール30、50のDAC41から出力されたアナログの楽音信号を混合するアナログミキサ71、増幅器72、および左右のスピーカ73L、73Rから構成されている。   Further, the sound generation module 70 includes an analog mixer 71, an amplifier 72, and left and right speakers 73L and 73R that mix analog tone signals output from the DAC 41 of the sound source modules 30 and 50.

なお、マスタCPUより各ボイスユニットに制御プログラムや波形データ等を転送すると共にキーオン/オフ信号等の操作に伴う発生楽音の制御データ等のシリアル制御データを供給する楽音信号発生装置は、下記の特許文献1に示されている。
特開平7−191671号公報
Note that a musical tone signal generating apparatus that transfers control programs, waveform data, etc. from the master CPU to each voice unit and supplies serial control data such as generated musical tone control data associated with operations such as key-on / off signals is disclosed in the following patents: It is shown in Document 1.
Japanese Patent Laid-Open No. 7-191671

前記非同期シリアル通信部B19と32は演奏データやMIDIデータ等を非同期シリアル通信するが、その通信速度は一定であった。   The asynchronous serial communication units B19 and 32 perform asynchronous serial communication of performance data, MIDI data, etc., but the communication speed is constant.

例えば、前記非同期シリアル通信Aは外部とのMIDI通信であるため、MIDI規格から、その転送レートは31.25Kボーであり、前記非同期シリアル通信Bは内部通信のためもう少し高速であり250Kボー程度であった。   For example, since the asynchronous serial communication A is MIDI communication with the outside, the transfer rate is 31.25K baud according to the MIDI standard, and the asynchronous serial communication B is a little faster and is about 250K baud for internal communication. there were.

この内部通信速度の250Kボーという転送速度は、演奏データをリアルタイムで転送するには十分な速度である。つまり、1つのキーオン情報は25ビット程度からなるので250Kボーで転送すれば25/250K(秒)=0.1ミリ秒程度で送信可能である。同時に10鍵弾いても1ミリ秒で送信できる。   This internal communication speed of 250K baud is a sufficient speed for transferring performance data in real time. That is, since one key-on information consists of about 25 bits, if it is transferred at 250K baud, it can be transmitted in about 25 / 250K (seconds) = 0.1 milliseconds. Even if you play 10 keys at the same time, you can send in 1 millisecond.

しかし、多量の楽音データを送信する場合、例えば低域のピアノ音のPCM波形データ等は1波形だけでも2400Kビット(12ビット×200Kワード)程度であり、これを上記250Kボーで転送すると9.6秒かかってしまう。   However, when a large amount of musical sound data is transmitted, for example, the PCM waveform data of a low-frequency piano sound is about 2400 Kbits (12 bits × 200 Kwords) even if only one waveform is used. It takes 6 seconds.

PCM波形で製作したピアノ音は、1オクターブ内に4波形程度が必要なことを考慮すると(高域は波形容量が少なくて済むことを考慮しても)、そのデータ転送に数分かかることは明らかである。   A piano sound produced with a PCM waveform can take several minutes to transfer its data, considering that about four waveforms are required within one octave (even if the high frequency requires less waveform capacity). it is obvious.

つまり、従来の内部転送速度は演奏情報を転送するのには十分であったが、波形データ等を転送するには不十分な速度であった。   In other words, the conventional internal transfer speed is sufficient for transferring performance information, but is insufficient for transferring waveform data and the like.

ただ、それならば常に最高速度で転送すれば良いかというと、そうではない。なぜならば、転送を司る各CPUの負荷が転送速度を上げることで極端に重くなり、例えば1Mボーで転送を行うと約0.01ミリ秒毎に割込みが発生することになり、通常の処理がこなせない。   However, if that's the case, it's not always the case that you should always transfer at the highest speed. This is because the load on each CPU that controls the transfer becomes extremely heavy by increasing the transfer speed. For example, if the transfer is performed at 1M baud, an interrupt is generated every about 0.01 millisecond, and the normal processing is performed. I can't do it.

よって、各CPUが通常の処理をこなしながら、転送を行なう上での最高の速度は250Kボー程度であり、1Mボーという転送の場合は通常の処理を行なわず、データダンプに専念することになる。   Therefore, the maximum speed for performing transfer while each CPU performs normal processing is about 250K baud, and in the case of transfer at 1M baud, normal processing is not performed and the data dump is concentrated. .

ところで、波形データ等を転送する場合は、その楽器(又は楽音発生装置)が編集モードにあり、演奏を一次停止することが許される状況である。   By the way, when transferring waveform data or the like, the instrument (or musical tone generator) is in the edit mode, and it is allowed to temporarily stop the performance.

また、各音源モジュール30、50は、DSP39でエフェクトされたデータを、各DAC41でアナログ楽音に変えた後、発音モジュール70のアナログミキサ71に送信するようにしているため、楽音信号のミキシング結果に、トータルエフェクトをかけることが困難であるという問題があった。すなわち、トータルエフェクトをかけるには、デジタル楽音でないと、任意のエフェクトがかけられないため、従来装置でエフェクトをかけようとすると、前記アナログミキサ71の後段にA/D変換器を入れて一旦デジタル信号に変換しなければならず、S/Nが悪くなるばかりか、コストアップになるという問題があった。   In addition, since each sound module 30, 50 converts the data effected by the DSP 39 into an analog tone by each DAC 41 and transmits the analog tone to the analog mixer 71 of the sound generation module 70, the result of mixing the tone signal is obtained. There was a problem that it was difficult to apply the total effect. That is, in order to apply a total effect, an arbitrary effect cannot be applied unless it is a digital musical tone. Therefore, when an effect is applied with a conventional apparatus, an A / D converter is inserted after the analog mixer 71 and the digital effect is once applied. There is a problem that not only the S / N is deteriorated but also the cost is increased because it must be converted into a signal.

本発明は、前記した従来技術に鑑みてなされたものであり、その目的は転送すべき演奏内容(演奏データ、楽音データ、エフェクトプログラム、またはエフェクト係数データ)に最適な通信速度を自動的に選択可能としたことにある。   The present invention has been made in view of the above-described prior art, and its purpose is to automatically select the optimum communication speed for the performance content (performance data, musical tone data, effect program, or effect coefficient data) to be transferred. It is possible.

また、本発明はトータルエフェクトを少ない配線数で、かつ安価にかけることのできる電子楽器の送信装置を提供することにある。   It is another object of the present invention to provide an electronic musical instrument transmitting apparatus that can apply the total effect with a small number of wires and at a low cost.

本発明は、音源モジュールを単体で使用する場合と、複数接続して使用する場合とで、該音源モジュールのエフェクト回路が出力するデジタル楽音信号の転送レートを切替えるようにした点に特徴がある。この特徴によれば、共通の出力ラインを使用することができるようになり、出力ラインの配線数を低減できると共に、厚みのある音を再生できるようになる。    The present invention is characterized in that the transfer rate of the digital musical tone signal output by the effect circuit of the tone generator module is switched between when the tone generator module is used alone and when a plurality of tone generator modules are connected. According to this feature, a common output line can be used, the number of output lines can be reduced, and a thick sound can be reproduced.

本発明によれば、音源モジュールを単体で使用する場合と、複数接続して使用する場合とで、該音源モジュールのエフェクト回路が出力するデジタル楽音信号の転送レートを切替えるようにしたので、共通の出力ラインを使用することができるようになり、出力ラインの本数を低減できると共に、厚みのある音を再生できるようになる。   According to the present invention, the transfer rate of the digital musical tone signal output by the effect circuit of the tone generator module is switched between the case where the tone generator module is used alone and the case where a plurality of tone generator modules are connected. Output lines can be used, the number of output lines can be reduced, and a thick sound can be reproduced.

以下に、図面を参照して、本発明を詳細に説明する。図1は、本発明の一実施形態の構成を示すブロック図である。なお、このブロック図において、図12と同一の符号は、同一または同等物を示すので、説明を省略する。   Hereinafter, the present invention will be described in detail with reference to the drawings. FIG. 1 is a block diagram showing a configuration of an embodiment of the present invention. In this block diagram, the same reference numerals as those in FIG.

図1において、ホストモジュール10aは、インピーダンスコンバータとしての働きをするアナログSW20(例えば、マルチプレクサ)、非同期シリアル通信部C21、バッファA22、バッファB23、バッファC24、およびバッファS25を有している。また、非同期シリアル通信部A18は、受信レジスタ18a、送信レジスタ18bを有し、非同期シリアル通信部Bは、受信レジスタ19a、送信レジスタ19bを有している。また、CDRドライバ26は、CDR駆動装置3の動作を制御する。ここに、該CDR駆動装置3は、CDに記憶されている演奏データ、波形データ、DSPプログラム、DSP係数などの高速転送データをCDから読み出して出力する。   In FIG. 1, the host module 10a includes an analog SW 20 (for example, a multiplexer), an asynchronous serial communication unit C21, a buffer A22, a buffer B23, a buffer C24, and a buffer S25 that function as an impedance converter. The asynchronous serial communication unit A18 includes a reception register 18a and a transmission register 18b, and the asynchronous serial communication unit B includes a reception register 19a and a transmission register 19b. The CDR driver 26 controls the operation of the CDR drive device 3. Here, the CDR driving device 3 reads out and outputs high-speed transfer data such as performance data, waveform data, a DSP program, and DSP coefficients stored in the CD from the CD.

該ホストモジュール10aに対して、音源モジュール30a,50aは最大4個(0〜3)接続できるが、図示では2個接続した例が示されている。これらの4個の音源モジュールは同一構成であるので、音源モジュール30aを代表に挙げて構成を説明すると、該音源モジュール30aは、波形メモリとしてRAM42を用いると共に、各DSP39からの出力線を共通線にして、発音モジュール70aに接続する点を除いて、図12の音源モジュール30と同一または同等である。   Up to four (0 to 3) tone generator modules 30a and 50a can be connected to the host module 10a, but in the figure, two examples are shown. Since these four sound source modules have the same configuration, the configuration will be described with the sound source module 30a as a representative. The sound source module 30a uses the RAM 42 as a waveform memory and outputs output lines from the DSPs 39 to a common line. Thus, it is the same as or equivalent to the sound module 30 of FIG. 12 except that it is connected to the sound generation module 70a.

次に、発音モジュール70aは、例えば4音源時分割のデジタルミキサ81と、トータルエフェクトをかけるDSP82と、DAC(D/A変換器)83とを有し、該DAC83の出力はアンプ72で増幅されて、左右のスピーカ73L,73Rから放音される。前記DSP82は、プログラムメモリ84に蓄積されたDSPプログラムおよびホストモジュール10aから前記非同期シリアル通信部C21を経て送られてきて係数メモリ85に蓄積されるDSP係数を用いて、デジタルミキサ81の出力信号に、EQ(エコー)、リバーブなどの、トータルエフェクトをかける。   Next, the sound generation module 70a includes, for example, a four sound source time-division digital mixer 81, a DSP 82 for applying a total effect, and a DAC (D / A converter) 83. The output of the DAC 83 is amplified by an amplifier 72. The sound is emitted from the left and right speakers 73L and 73R. The DSP 82 uses the DSP program stored in the program memory 84 and the DSP coefficient sent from the host module 10a via the asynchronous serial communication unit C21 and stored in the coefficient memory 85 as an output signal of the digital mixer 81. Apply total effects such as EQ, echo, and reverb.

次に、本実施形態の動作を、図2〜図4のフローチャートを参照して説明する。このフローチャートは、ホストCPU15のメインフローを示すものであり、主に、データの転送速度の制御を中心とする処理を示す。   Next, the operation of this embodiment will be described with reference to the flowcharts of FIGS. This flowchart shows the main flow of the host CPU 15, and mainly shows processing centering on control of the data transfer rate.

パワーオンされてホストCPU15の処理がスタートすると、ステップS1では、ホストCPU15、RAM13等のワークエリアがイニシャライズ(初期化)される。ステップS2では、非同期シリアル通信部A18における非同期シリアル通信Aの転送速度をMIDIレベル(すなわち、31.25Kボー)に設定し、通信A用割込みを許可する。これによって、ホストモジュール10aと外部MIDIとの割込み通信が可能になるが、該通信A用割込み処理の詳細は、図5を参照して後述する。ステップS3では、非同期シリアル通信部B19における非同期シリアル通信Bの転送速度をMIDIレベル(すなわち、31.25Kボー)に設定し、通信B用割込みを許可する。これによって、ホストモジュール10aと音源モジュール30a,50aあるいは発音モジュール70a間の割込み通信が可能になるが、該通信B用割込み処理の詳細は、図6を参照して後述する。   When the power is turned on and the processing of the host CPU 15 starts, in step S1, work areas such as the host CPU 15 and the RAM 13 are initialized (initialized). In step S2, the transfer rate of the asynchronous serial communication A in the asynchronous serial communication unit A18 is set to the MIDI level (that is, 31.25K baud), and the communication A interrupt is permitted. This enables interrupt communication between the host module 10a and the external MIDI. Details of the communication A interrupt processing will be described later with reference to FIG. In step S3, the transfer rate of the asynchronous serial communication B in the asynchronous serial communication unit B19 is set to the MIDI level (that is, 31.25K baud), and the communication B interrupt is permitted. This enables interrupt communication between the host module 10a and the tone generator modules 30a and 50a or the sound generation module 70a. Details of the communication B interrupt processing will be described later with reference to FIG.

次に、ステップS4では、非同期シリアル通信B用のインピーダンスを最大(すなわち、MIDI×1倍用)に設定する。この設定は、非同期シリアル通信Bに使用されるデジタル信号は一般的に矩形波が使用されるために、回路のインピーダンス(CR時定数)を該デジタル信号の周期に適合する値にして、矩形波の角を丸くし、できるだけ不要な電磁波が放出されないようにするためであるが、詳細は、図7を参照して後述する。   Next, in step S4, the impedance for asynchronous serial communication B is set to the maximum (that is, for MIDI × 1). In this setting, since a rectangular wave is generally used for the digital signal used for the asynchronous serial communication B, the impedance (CR time constant) of the circuit is set to a value suitable for the period of the digital signal, and the rectangular wave is used. In order to prevent unnecessary electromagnetic waves from being emitted as much as possible, details will be described later with reference to FIG.

ステップS5では、音源モジュール0、1、2、3に対して、非同期シリアル通信Bの転送速度を、MIDI×8倍レベル(250Kボー)に変更する命令を送る。この命令は、前記MIDIレベルの最も遅い転送速度で送られる。続いて、ステップS6では、ホストCPU15は、非同期シリアル通信B用割込みを禁止した後、例えば10m秒遅延する。これは、音源モジュール0、1、2、3が、受信速度の切り替えに要する時間を確保するためであり、10m秒としたのは一例に過ぎない。ステップS6の遅延時間が経過すると、ステップS7に進み、非同期シリアル通信Bの転送速度を、MIDI×8倍レベル(250Kボー)に設定する。ステップS8では、非同期シリアル通信B用のインピーダンスを中の大きさ(すなわち、MIDI×8倍用)に設定する。このようにインピーダンスを中の大きさに設定する理由も、回路のCR時定数を矩形波の転送速度と適合させて、できるだけ不要な電磁波が発生しないようにするためであるが、詳細は、図7を参照して後述する。ステップS9では、図6で後述する通信B用割込みを許可する。以上で、ホストCPU15の初期化ルーチンは終わり、次に図3、図4のメインルーチンに進む。   In step S5, a command for changing the transfer rate of the asynchronous serial communication B to MIDI × 8 times level (250K baud) is sent to the tone generator modules 0, 1, 2, and 3. This command is sent at the slowest transfer rate of the MIDI level. Subsequently, in step S6, the host CPU 15 delays, for example, 10 msec after prohibiting the asynchronous serial communication B interrupt. This is because the sound source modules 0, 1, 2, and 3 ensure the time required for switching the reception speed, and the setting of 10 milliseconds is merely an example. When the delay time of step S6 elapses, the process proceeds to step S7, and the transfer speed of the asynchronous serial communication B is set to MIDI × 8 times level (250K baud). In step S8, the impedance for asynchronous serial communication B is set to a medium size (that is, for MIDI × 8 times). The reason for setting the impedance to a medium value in this way is to make the CR time constant of the circuit compatible with the transfer speed of the rectangular wave so that unnecessary electromagnetic waves are not generated as much as possible. This will be described later with reference to FIG. In step S9, the communication B interrupt described later in FIG. 6 is permitted. This completes the initialization routine of the host CPU 15, and then proceeds to the main routine of FIGS.

図3のステップS10では、ホストCPU15は、パネルSW/表示部17に対して、パネルSWのスキャン検出と、それに対応した表示処理を行う。次いで、ステップS11では、鍵盤スキャナ部12に対して電子楽器本体1の鍵盤をスキャンする指令を出力する。ステップS12では、キーイベントがあったか否かの判断を行い、キーイベントがあった場合にはステップS13に進んで該キーイベントをバッファA22に入れ、ステップS14では該キーイベントをバッファB23に入れる。前記キーイベントがなかった場合、あるいは前記キーイベントをバッファA,Bに入れた後に、ステップS15に進んで、前記CDRドライバ26にて、CDに記憶されている演奏データ、波形データ、DSPプログラム、DSP係数等のデータを読み出す。ステップS16では、該CDから読み出したデータがあるかないかの判断を行い、該判断が肯定の時にはステップ17に進んで、ステップS15で読み出したデータが、波形データ、DSPプログラム、DSP係数等の高速転送データであるか否かの判断がなされる。そして、高速転送データである場合には、ステップS18に進む。一方、前記ステップS16の判断が否定の時には、図4のステップS33に進み、ステップS17の判断が否定の時には、ステップS32に進む。   In step S10 of FIG. 3, the host CPU 15 performs panel SW scan detection and display processing corresponding to the panel SW / display unit 17. Next, in step S <b> 11, a command for scanning the keyboard of the electronic musical instrument main body 1 is output to the keyboard scanner unit 12. In step S12, it is determined whether or not there is a key event. If there is a key event, the process proceeds to step S13, where the key event is stored in the buffer A22, and in step S14, the key event is stored in the buffer B23. If there is no key event, or after the key event is stored in the buffers A and B, the process proceeds to step S15, where the CDR driver 26 performs performance data, waveform data, DSP program, Read data such as DSP coefficients. In step S16, it is determined whether or not there is data read from the CD. If the determination is affirmative, the process proceeds to step 17, and the data read in step S15 is a high-speed waveform data, DSP program, DSP coefficient, or the like. A determination is made as to whether the data is transfer data. If it is high-speed transfer data, the process proceeds to step S18. On the other hand, when the determination in step S16 is negative, the process proceeds to step S33 in FIG. 4, and when the determination in step S17 is negative, the process proceeds to step S32.

前記ステップS18では、前記バッファB23が空になるまで待機する。ステップS19では、音源モジュール0、1、2、3に対して、非同期シリアル通信Bの転送速度を、MIDI×32倍レベル(1Mボー)に変更する命令を送る。この命令は、前記MIDI×8レベルの中速の転送速度で送られる。続いて、ステップS20では、ホストCPU15は、非同期シリアル通信B用割込みを禁止した後、例えば10m秒遅延する。ステップS21では、非同期シリアル通信Bの転送速度を、MIDI×32倍レベル(1Mボー)に設定する。ステップS22では、非同期シリアル通信B用のインピーダンスを最小の大きさ(すなわち、MIDI×32倍用)に設定する。次いで、ステップS23に進み通信B用割込みを許可する。   In step S18, the process waits until the buffer B23 becomes empty. In step S19, a command to change the transfer rate of the asynchronous serial communication B to MIDI × 32 times level (1M baud) is sent to the tone generator modules 0, 1, 2, and 3. This command is sent at a medium transfer rate of the MIDI × 8 level. Subsequently, in step S20, after prohibiting the asynchronous serial communication B interrupt, the host CPU 15 delays, for example, 10 milliseconds. In step S21, the transfer rate of asynchronous serial communication B is set to MIDI × 32 times level (1M baud). In step S22, the impedance for asynchronous serial communication B is set to the minimum size (that is, for MIDI × 32 times). Next, the process proceeds to step S23, and the communication B interrupt is permitted.

次に、図4のステップS24に進んで、高速転送データを指定の音源モジュールに、前記1Mボーで高速転送する。例えば、波形データは波形メモリ42に、DSPプログラムはDSP用プログラムメモリ40aまたは84へ、またDSP係数は係数メモリ40bまたは85に転送される。例えば、エコー、リザーブに関するDSP係数は係数メモリ85に転送され、これら以外の残響、コーラス、アンサンブル等のDSP係数は係数メモリ40bに転送される。なお、ここでは、ホストCPU15は、バッファBは使わないで、データ転送に専念する。ステップS25では、全データの転送が終了したか否かの判断がなされ、この判断が否定の時には、ステップS24に戻って、その動作を繰り返す。   Next, the process proceeds to step S24 in FIG. 4, and the high-speed transfer data is transferred at high speed to the designated sound source module at the 1M baud. For example, the waveform data is transferred to the waveform memory 42, the DSP program is transferred to the DSP program memory 40a or 84, and the DSP coefficient is transferred to the coefficient memory 40b or 85. For example, DSP coefficients related to echo and reserve are transferred to the coefficient memory 85, and other DSP coefficients such as reverberation, chorus, and ensemble are transferred to the coefficient memory 40b. Here, the host CPU 15 does not use the buffer B and concentrates on data transfer. In step S25, it is determined whether or not all data has been transferred. If this determination is negative, the process returns to step S24 and the operation is repeated.

高速転送データの転送が終了すると、通常の中速の転送速度に戻るために、ステップS26の処理を行う。ステップS26では、音源モジュール0、1、2、3に対し、非同期シリアル通信Bの転送速度をMIDI×8倍レベル(250Kボー)に変更する命令を、各音源モジュールに送る。ステップS27では、通信B用割込みを禁止した後、例えば10m秒遅延する。ステップS28では、再度非同期シリアル通信Bの転送速度を、MIDI×8倍レベル(250Kボー)に設定する。ステップS30では、非同期シリアル通信B用のインピーダンスを中の大きさ(すなわち、MIDI×8倍用)に設定する。その後、ステップS30で、通信B用割込みを許可する。   When the transfer of the high-speed transfer data is completed, the process of step S26 is performed in order to return to the normal medium transfer speed. In step S26, an instruction to change the transfer rate of the asynchronous serial communication B to MIDI × 8 times level (250K baud) is sent to the sound source modules 0, 1, 2, and 3. In step S27, after the communication B interrupt is prohibited, the delay is, for example, 10 milliseconds. In step S28, the transfer rate of the asynchronous serial communication B is set again to the MIDI × 8 times level (250K baud). In step S30, the impedance for asynchronous serial communication B is set to a medium size (that is, for MIDI × 8 times). Thereafter, in step S30, the communication B interrupt is permitted.

次に、前記ステップS17の判断が否定の時には、ステップS32に進んで、中速転送データ、例えば自動演奏データ(ソングファイル)をバッファS25へ記憶する。また、前記ステップS16の判断が否定の時、またはステップS30またはS32の処理の後に、ステップS33に進んで、自動演奏中であるか否かの判断がなされる。この判断が肯定の時には、ステップS34に進んで、読み出すべきタイミングの演奏データであるか否かの判断がなされる。この判断が肯定の時には、ステップS35に進み、キーイベント、音色イベント、音量イベントなどの演奏データがバッファS25から読み出され、バッファB23に入れられる。バッファB23に入れられたデータは、通信B用割込みにより非同期シリアル通信部B19から、音源モジュールに転送される。その後、図3のステップS10に戻って、該ステップS10以降の処理が繰り返される。   Next, when the determination in step S17 is negative, the process proceeds to step S32, and medium speed transfer data, for example, automatic performance data (song file) is stored in the buffer S25. When the determination at step S16 is negative, or after the processing at step S30 or S32, the process proceeds to step S33 to determine whether or not automatic performance is being performed. When this determination is affirmative, the process proceeds to step S34 to determine whether or not the performance data is to be read out. If the determination is affirmative, the process proceeds to step S35, and performance data such as a key event, a tone color event, and a volume event is read from the buffer S25 and stored in the buffer B23. The data stored in the buffer B23 is transferred from the asynchronous serial communication unit B19 to the tone generator module by the communication B interrupt. Then, it returns to step S10 of FIG. 3, and the process after this step S10 is repeated.

次に、前記通信A用割込み処理の一例を、図5のフローチャートを参照して説明する。ステップS51では、受信データがあるか否かの判断がなされ、この判断が肯定の場合には、ステップS52に進んで、非同期シリアル通信Aの受信レジスタ18aの内容が、バッファB23に格納される。ステップS53では、バッファAに未転送のデータがあるか否かの判断がなされ、この判断が肯定の時には、ステップS54に進んで、未転送のデータを1つ読み出し、非同期シリアル通信Aの送信レジスタ18bに書込む。その後、リターンする。この動作により、非同期シリアル通信部A18と外部MIDIとの間で、データの送受信が行われる。   Next, an example of the communication A interrupt process will be described with reference to the flowchart of FIG. In step S51, it is determined whether or not there is reception data. If the determination is affirmative, the process proceeds to step S52, and the contents of the reception register 18a of the asynchronous serial communication A are stored in the buffer B23. In step S53, it is determined whether or not there is untransferred data in the buffer A. If this determination is affirmative, the process proceeds to step S54, where one untransferred data is read and the transmission register of the asynchronous serial communication A is read. Write to 18b. Then return. With this operation, data is transmitted and received between the asynchronous serial communication unit A18 and the external MIDI.

次に、前記通信B用割込み処理の一例を、図6のフローチャートを参照して説明する。ステップS61では、受信データがあるか否かの判断がなされる。この判断が肯定の場合には、ステップS62に進んで、非同期シリアル通信Bの受信レジスタ19aの内容が、バッファC24に格納される。ステップS63では、バッファBに未転送のデータがあるか否かの判断がなされ、この判断が肯定の時には、ステップS64に進んで、未転送のデータを1つ読み出し、非同期シリアル通信Bの送信レジスタ19bに書込む。その後、リターンする。この動作により、ホストモジュール10aの非同期シリアル通信部B19と音源モジュール30a、50aの非同期シリアル通信部B32との間で、データの送受信が行われる。また、前記バッファBに格納されているデータが、非同期シリアル通信部A18と外部MIDIとの間の通信で受信された外部MIDIのデータであった場合には、この通信B用割込み処理により、外部MIDIデータが、音源モジュール30a、50aへ送信されることになる。   Next, an example of the communication B interrupt process will be described with reference to the flowchart of FIG. In step S61, it is determined whether there is received data. If this determination is affirmative, the process proceeds to step S62, and the contents of the reception register 19a of the asynchronous serial communication B are stored in the buffer C24. In step S63, it is determined whether or not there is untransferred data in the buffer B. If this determination is affirmative, the process proceeds to step S64, where one untransferred data is read and the asynchronous serial communication B transmission register is read. Write to 19b. Then return. With this operation, data is transmitted and received between the asynchronous serial communication unit B19 of the host module 10a and the asynchronous serial communication unit B32 of the sound source modules 30a and 50a. If the data stored in the buffer B is external MIDI data received by communication between the asynchronous serial communication unit A18 and the external MIDI, the communication B interrupt processing causes the external B MIDI data is transmitted to the tone generator modules 30a and 50a.

次に、図7を参照して、前記ステップS4、S8、S22において、それぞれ、非同期シリアル通信B用のインピーダンスを最大、中、最小に設定する理由を説明する。   Next, with reference to FIG. 7, the reason why the impedance for the asynchronous serial communication B is set to the maximum, middle, and minimum in the steps S4, S8, and S22, respectively, will be described.

電子楽器に電源投入直後、または音源モジュールを単体で利用している時には、同図(a) に示されているように、非同期シリアル通信Bの転送速度は、31.25Kボー(Kビット/秒)であり、矩形波信号の一周期は大きい。そこで、前記アナログSW20でインピーダンスを最大(MIDI×1倍用)にする。そうすると、CR時定数1が大きくなり、矩形波信号の角の丸みが大きくなる。   As soon as the electronic musical instrument is turned on, or when the sound module is used alone, the transfer rate of asynchronous serial communication B is 31.25 Kbaud (Kbit / sec) as shown in FIG. ) And one period of the rectangular wave signal is large. Therefore, the analog SW 20 maximizes the impedance (for MIDI × 1). As a result, the CR time constant 1 increases, and the roundness of the corners of the rectangular wave signal increases.

次に、電子楽器の通常動作時には、演奏者が遅れを感じないレベルの転送速度、すなわち非同期シリアル通信Bの転送速度は、250Kボー(Kビット/秒)とされる。これは、ホストCPU15が、外部MIDIからの情報の他に、鍵盤からの操作情報(キーオン、オフデータ)も、音源モジュール30a、50aに送る必要があるためである。この時、矩形波信号の一周期は中程度の大きさになるので、前記アナログSW20でインピーダンスを中(MIDI×8倍用)にする。そうすると、CR時定数2が中程度の大きさになり、矩形波信号の角が丸くなって、ホストモジュール10aと音源モジュール間の通信線26等から不要な電磁波が放出されるのが抑制される。   Next, during the normal operation of the electronic musical instrument, the transfer speed at which the performer does not feel a delay, that is, the transfer speed of the asynchronous serial communication B is set to 250 Kbaud (K bits / second). This is because the host CPU 15 needs to send operation information (key on / off data) from the keyboard to the tone generator modules 30a and 50a in addition to the information from the external MIDI. At this time, since one cycle of the rectangular wave signal has a medium magnitude, the impedance is set to medium (for MIDI × 8 times) by the analog SW 20. Then, the CR time constant 2 becomes medium, the corners of the rectangular wave signal are rounded, and unnecessary electromagnetic waves are prevented from being emitted from the communication line 26 between the host module 10a and the sound source module. .

次に、高速データ転送時には、非同期シリアル通信Bの転送速度は、1Mボー(Mビット/秒)にされる。これは、ホストCPUから、多量の波形データを音源モジュールの波形メモリ42に転送する時、あるいはホストCPU15からエフェクト回路を構成するDSP39に対して効果プログラムや係数データを素早く転送したい時にのみ、該高速転送速度にされる。この高速転送により、演奏者の待ち時間が短くなる。また、前記アナログSW20でインピーダンスを最大(MIDI×32倍用)にすることにより、CR時定数3が最大の大きさになり、電磁波の発生を最小限に抑えることができるようになる。   Next, at the time of high-speed data transfer, the transfer rate of the asynchronous serial communication B is set to 1M baud (M bits / second). This is only when the large amount of waveform data is transferred from the host CPU to the waveform memory 42 of the tone generator module, or when it is desired to quickly transfer the effect program and coefficient data from the host CPU 15 to the DSP 39 constituting the effect circuit. To transfer speed. This high-speed transfer shortens the performer's waiting time. Further, by setting the impedance to the maximum (for MIDI × 32 times) with the analog SW 20, the CR time constant 3 is maximized, and the generation of electromagnetic waves can be minimized.

以上のように、本実施形態によれば、イニシャライズ時はデータの転送速度を低速のMIDIレベル(すなわち、31.25Kボー)に、またインピーダンスを最小のMIDI×1倍用に設定し、演奏データ等のデータの転送時には中速のMIDI×8倍レベル(250Kボー)に、またインピーダンスを中の大きさ(すなわち、MIDI×8倍用)に設定し、波形データ、DSPプログラム等の転送時には高速のMIDI×32倍レベル(1Mボー)に、またインピーダンスを最大の大きさ(すなわち、MIDI×32倍用)に設定するようにしたので、低速および中速の転送速度で利用する一般ユーザは勿論、高速の転送速度をも使用するプロまたはプロに近いユーザにも十分に使用されることのできる電子楽器を提供できるようになる。   As described above, according to the present embodiment, at the time of initialization, the data transfer speed is set to a low MIDI level (that is, 31.25K baud), the impedance is set to the minimum MIDI × 1 time, and the performance data is set. When transferring data such as medium speed MIDI × 8 times level (250K baud) and impedance is set to medium size (ie for MIDI × 8 times), high speed when transferring waveform data, DSP programs, etc. MIDI × 32 times level (1M baud) and the maximum impedance (that is, for MIDI × 32 times) is set, so of course general users who use low and medium transfer rates Therefore, it is possible to provide an electronic musical instrument that can be used sufficiently even by a professional or a near-professional user who also uses a high transfer rate.

次に、前記音源モジュール30a、50a等の音源CPU34の機能を、図8のフローチャートを参照して説明する。該音源モジュールに電源が投入されてパワーオンになると、ステップS81に進んで、音源CPUのワークエリアがイニシャライズされる。ステップS82では、楽音発生回路38をクリアし、非発音状態とされる。ステップS83では、自ボードの音源モジュール番号、すなわちモジュールNo.設定部33に設定されている番号(=TG.NO)を取込む。ステップS84では、TG.NO=111B であるか否かの判断がされる。ここにBはバイナリ(二進数)を表す。また111B は、単独で使用される音源モジュール(シングル音源モード)を表し、TG.NO=000B 〜011B の場合は、複数で使用される音源モジュール(マルチ音源モード)を表す。   Next, functions of the sound source CPU 34 such as the sound source modules 30a and 50a will be described with reference to the flowchart of FIG. When the sound module is powered on and powered on, the process proceeds to step S81, where the work area of the sound source CPU is initialized. In step S82, the tone generation circuit 38 is cleared and the sound is not generated. In step S83, the sound module number of the own board, that is, the module number. The number (= TG.NO) set in the setting unit 33 is taken in. In step S84, TG. It is determined whether or not NO = 111B. Here, B represents binary (binary number). 111B represents a sound source module (single sound source mode) used alone, and TG. In the case of NO = 000B to 011B, a plurality of tone generator modules (multi tone generator mode) are used.

そこで、前記ステップS84の判断が肯定になるとステップS85に進んで、自ボードのエフェクト回路39の出力をシングル音源モードとする。一方、該判断が否定のときには、ステップS86に進んで、自ボードのエフェクト回路39の出力をマルチ音源モードとし、自ボード用のタイムスロットを設定する。なお、該自ボード用のタイムスロットを設定する処理の詳細は、図11にて後述する。 ステップS87では、前記番号TG.NOが000B であるか否かの判断がなされる。番号TG.NOが000B の音源モジュールは、マルチ音源モードの場合、他の音源モジュールの基準となるCLKを発生するから、ステップS88に進んで、自ボードからLRCKおよびCK(クロック)を出力し、それと合わせてDAT(データ)を出力できるようにする。一方、ステップS87の判断が否定の場合、すなわちTG.NO=001B 〜011B の場合には、ステップS89に進む。ステップS89では、これらのTG.NOの音源モジュールは、TG.NO=000B のボードから、LRCK、CKを入力し、それに合わせてDAT(データ)を出力可能にする。   Therefore, if the determination in step S84 becomes affirmative, the process proceeds to step S85, and the output of the effect circuit 39 of the own board is set to the single sound source mode. On the other hand, when the determination is negative, the process proceeds to step S86, the output of the effect circuit 39 of the own board is set to the multi sound source mode, and the time slot for the own board is set. Details of the processing for setting the time slot for the own board will be described later with reference to FIG. In step S87, the number TG. A determination is made as to whether NO is 000B. Number TG. In the multi-sound source mode, the sound source module with NO of 000B generates CLK as a reference for other sound source modules, so the process proceeds to step S88 to output LRCK and CK (clock) from the own board, together with it. Enable to output DAT (data). On the other hand, if the determination in step S87 is negative, that is, TG. If NO = 001B to 011B, the process proceeds to step S89. In step S89, these TG. The sound module of NO is TG. LRCK and CK are input from the board of NO = 000B, and DAT (data) can be output in accordance with the input.

ステップS90では、非同期シリアル通信Bの転送速度をMIDIレベル(31.25ボー)に設定し、通信B用割込みを許可する。該通信B用割込みの詳細は、図10を参照して後述する。次いで、ステップS91に進み、通信B用転送レートレジスタ(以下、TGRATEと記す)を1にセット、すなわちイニシャライズする。以上が、音源CPUのイニシャラズ処理であり、以後メインルーチンに入る。   In step S90, the transfer rate of the asynchronous serial communication B is set to the MIDI level (31.25 baud), and the communication B interrupt is permitted. Details of the communication B interrupt will be described later with reference to FIG. In step S91, the communication B transfer rate register (hereinafter referred to as TGRATE) is set to 1, that is, initialized. The above is the initialization processing of the sound source CPU, and the main routine is entered thereafter.

ステップS92では、TG.NO=111B であるか否かの判断がなされ、この判断が肯定の場合、すなわちシングル音源モードの場合には、ステップS93に進んで、パネルSW43のスキャン検出、およびそれに対応した表示処理を行う。なお、音源モジュールのパネルSW/表示部43から、音色設定や音量調節が可能である。次に、ステップS94で、TGRATE=3であるか否かの判断がなされ、この判断が肯定であれば、ステップS95に進んで、高速転送処理に移る。TGRATE=3の意味については、図10で後述する。そして、あるバッファTGから読み出した内容を、波形メモリ42あるいはDSPプログフラム40a、DSP係数メモリ40bの書込みポインタの示すアドレスに転送して書込む。なお、この高速転送処理の間は、発音モジュール70aにおける発音を停止する。   In step S92, TG. It is determined whether or not NO = 111B. If this determination is affirmative, that is, in the single sound source mode, the process proceeds to step S93 to perform scan detection of the panel SW43 and display processing corresponding thereto. Note that tone color setting and volume adjustment are possible from the panel SW / display unit 43 of the tone generator module. Next, in step S94, it is determined whether or not TGRATE = 3. If this determination is affirmative, the process proceeds to step S95 and proceeds to high-speed transfer processing. The meaning of TGRATE = 3 will be described later with reference to FIG. Then, the contents read from a certain buffer TG are transferred to and written in the waveform memory 42 or the address indicated by the write pointer in the DSP program 40a and DSP coefficient memory 40b. During this high-speed transfer process, sound generation in the sound generation module 70a is stopped.

一方、ステップS94の判断が否定の時、すなわちTGRATE=1または2の時には、図9のステップS96に進んで、前記バッファTGから1個の内容(制御データ)を読み出す。次いで、ステップS97では、該制御データがキーオンデータであるか否かの判断がなされ、この判断が肯定の場合にはステップS98に進んで、キーアサイナにより発音するチャネルchを決定し、このチャネルchを用いて発音を開始する。   On the other hand, when the determination in step S94 is negative, that is, when TGRATE = 1 or 2, the process proceeds to step S96 in FIG. 9, and one content (control data) is read from the buffer TG. Next, in step S97, it is determined whether or not the control data is key-on data. If this determination is affirmative, the process proceeds to step S98 to determine a channel ch to be generated by the key assigner, Use to start pronunciation.

ステップS97でキーオンデータと判断されなかった場合には、ステップS99に進んでキーオフデータであるか否かの判断がなされ、この判断が肯定の時にはステップS100に進んで、キーオフされた発音chを検索し、そのchを消音(リリース状態に)する。   If the key-on data is not determined in step S97, the process proceeds to step S99 to determine whether the data is key-off data. If the determination is affirmative, the process proceeds to step S100 to search for a key-off pronunciation channel. And mute the channel (release state).

キーオフデータでもなかった場合(ステップS99の判断が否定)には、ステップS101に進んで、その他の楽音発生回路用のデータ(例えば、ボリューム、音色データ等)であるか否かの判断がなされる。この判断が肯定の時には、ステップS102に進んで、該データを楽音発生回路38に書込む。ステップS101の判断がさらに否定の時には、ステップS103に進んで、DSP用のデータ(リバーブ、残響等の係数)であるか否かの判断がなされる。この判断が肯定の時には、ステップS104に進んで、該データをエフェクト回路39の係数メモリへ書込む。一方、該ステップS103の判断が否定の時には、ステップS105に進んで、その他の処理が行われる。前記ステップS104またはS105の処理が終わると、ステップS92に戻り、該ステップS92以下の処理が繰り返される。   If it is not key-off data (determination in step S99 is negative), the process proceeds to step S101, where it is determined whether the data is for other musical tone generation circuits (for example, volume, tone color data, etc.). . When this determination is affirmative, the process proceeds to step S102, and the data is written into the tone generation circuit 38. When the determination in step S101 is further negative, the process proceeds to step S103 to determine whether or not the data is DSP data (reverb, reverberation coefficient, etc.). When this determination is affirmative, the process proceeds to step S104, and the data is written into the coefficient memory of the effect circuit 39. On the other hand, when the determination in step S103 is negative, the process proceeds to step S105, and other processing is performed. When the process of step S104 or S105 ends, the process returns to step S92, and the processes after step S92 are repeated.

次に、図10のフローチャートを参照して、音源CPU34の通信B用割込み処理を説明する。   Next, the communication B interrupt process of the sound source CPU 34 will be described with reference to the flowchart of FIG.

ステップS110では、受信データがあるか否かの判断がなされ、受信データがあった場合にはステップS111に進んで、非同期シリアル通信Bの転送速度が変更されたか否かの判断がなされる。この判断が肯定になった場合には、ステップS112に進んで、前記バッファTGに残っている内容を処理して、空にする。ステップS113では、前記転送速度の変更が、「MIDI×16」命令であるか否かの判断をする。この判断が肯定の時には、ステップS114に進んで、楽音発生回路38をクリアし、強制的に非発音状態とする。すなわち、発音中であっても、非発音状態にする。ステップS115では、非同期シリアル通信Bの転送速度を、MIDI×32(=1Mボー)に変更する。続いて、ステップS116に進み、通信B用転送レートレジスタ(TGRATE)に“3”をセットする。   In step S110, it is determined whether there is received data. If there is received data, the process proceeds to step S111, where it is determined whether the transfer rate of the asynchronous serial communication B has been changed. If this determination is affirmative, the process proceeds to step S112, where the contents remaining in the buffer TG are processed and emptied. In step S113, it is determined whether or not the transfer rate change is a “MIDI × 16” command. When this determination is affirmative, the routine proceeds to step S114, where the musical tone generation circuit 38 is cleared and is forced into a non-sounding state. That is, even when sound is being generated, a non-sounding state is set. In step S115, the transfer rate of asynchronous serial communication B is changed to MIDI × 32 (= 1M baud). In step S116, “3” is set in the transfer rate register for communication B (TGRATE).

一方、前記ステップS113の判断が否定の時には、ステップS117に進んで、「MIDI×8」命令であるか否かの判断をする。この判断が肯定の時には、ステップS118に進んで、非同期シリアル通信Bの転送速度を、MIDI×8(=250Kボー)に変更する。続いて、ステップS119に進み、通信B用転送レートレジスタ(TGRATE)に“2”をセットする。   On the other hand, if the determination in step S113 is negative, the process proceeds to step S117 to determine whether the instruction is a “MIDI × 8” instruction. When this determination is affirmative, the process proceeds to step S118, and the transfer rate of the asynchronous serial communication B is changed to MIDI × 8 (= 250K baud). In step S119, “2” is set in the transfer rate register for communication B (TGRATE).

さらに、前記ステップS117の判断が否定の時には、ステップS120に進んで、非同期シリアル通信Bの転送速度を、MIDI×1(=31.25Kボー)に変更する。続いて、ステップS121に進み、通信B用転送レートレジスタ(TGRATE)に“1”をセットする。   Further, when the determination in step S117 is negative, the process proceeds to step S120, and the transfer rate of the asynchronous serial communication B is changed to MIDI × 1 (= 31.25K baud). In step S121, “1” is set in the communication B transfer rate register (TGRATE).

前記ステップS116、S119、またはS121の後は、ステップS122に進んで、各転送レートで受信したデータを、バッファTGに格納する。ステップS123では、割込み許可を行い、リターンする。   After step S116, S119, or S121, the process proceeds to step S122, and the data received at each transfer rate is stored in the buffer TG. In step S123, an interrupt is permitted and the process returns.

図11は、音源モジュールのエフェクト回路39の出力信号速度を示すタイミングチャートであり、同図(a) はシングル音源モード(1音源時分割)時の出力信号速度、同図(b) はマルチ音源モード(4音源時分割)時の出力信号速度を示す。   FIG. 11 is a timing chart showing the output signal speed of the effect circuit 39 of the sound module. FIG. 11A shows the output signal speed in the single sound source mode (single sound source time division), and FIG. The output signal speed in the mode (4 sound source time division) is shown.

同図(a) に示されているように、シングル音源モードでは、LRCK(クロック)は44.1KHzであり、LおよびR用データ転送タイミングのそれぞれの間に、24ビットのL用データ(DAT)およびR用データが転送される。したがって、該シングル音源モードにおけるデータ転送CKは、1.06MHzになる。   As shown in FIG. 9A, in the single sound source mode, LRCK (clock) is 44.1 KHz, and 24-bit L data (DAT) is used between the L and R data transfer timings. ) And R data are transferred. Therefore, the data transfer CK in the single sound source mode is 1.06 MHz.

一方、マルチ音源モード(4音源時分割)では、同図(b) に示されているように、前記LおよびR用データ転送タイミングのそれぞれの間に、4音源の24ビットのL用データ(DAT)およびR用データが転送される。このため、該マルチ音源モード(4音源時分割)におけるデータ転送CKは、4.23MHz、すなわちシングル音源モードの時の4倍になる。このため、楽音データの転送速度も、シングル音源モードの時の4倍になる。なお、該マルチ音源モード(4音源時分割)では、前記ステップS86〜S89に示したように、TG.NO=000B のボードがLRCK、CKを生成し、他のボード(TG.NO=001B 〜011B )は該000B のボードが生成したLRCK、CKを入力するから、各ボードから出力されるデータ(DAT)は同一のクロックと同期して出力されることになる。   On the other hand, in the multi-sound source mode (4 sound source time division), as shown in FIG. 4B, during each of the L and R data transfer timings, 24-bit L data (4 bits of 4 sound sources) DAT) and R data are transferred. For this reason, the data transfer CK in the multi sound source mode (four sound source time division) is 4.23 MHz, that is, four times that in the single sound source mode. For this reason, the transfer speed of the musical sound data is also four times that in the single sound source mode. In the multi-sound source mode (four sound source time division), as shown in steps S86 to S89, TG. Since the board of NO = 000B generates LRCK and CK, and the other boards (TG.NO = 001B to 011B) input the LRCK and CK generated by the board of 000B, the data (DAT) output from each board ) Is output in synchronization with the same clock.

したがって、本実施形態によれば、マルチ音源モード(4音源時分割)には、4個の音源モジュールから出力されるCLKとDATは、シングル音源モード時の4倍の転送速度で、かつ共通の出力ラインを経て、発音モジュール70a(図1参照)のデジタルミキサー81のCLK端子とDAT端子に転送され、該4個の音源モジュールから出力されたデータは1つにミキシングされる。該ミキシングされたデータは、DSP82でエフェクトをかけられ、DAC83に出力される。このように、4個の音源モジュールから出力された楽音データをミキシングすることにより、厚みのある音を再生できるようになる。また、TG.NOが001B 〜011B のボードのクロックCLKをTG.NOが000B のボードで生成されたものを使用し、シングル音源モード時の4倍の転送速度で転送するようにしたので、各音源モジュールのエフェクト回路39と発音モジュール70aのデジタルミキサー81とを結ぶ出力ラインの本数が図1のように削減され、またデジタルミキサー81の入力端子はCLKとDATの2個でよくなる。なお、前記の説明では、4個の音源モジュールを対象としたが、本発明はこれに限定されず、2個または3個の音源モジュールであってもよい。   Therefore, according to the present embodiment, in the multi sound source mode (four sound source time division), CLK and DAT output from the four sound source modules have a transfer rate four times that in the single sound source mode and are common. Via the output line, the data is transferred to the CLK terminal and the DAT terminal of the digital mixer 81 of the sound generation module 70a (see FIG. 1), and the data output from the four sound source modules is mixed into one. The mixed data is subjected to an effect by the DSP 82 and is output to the DAC 83. As described above, by mixing the musical sound data output from the four sound source modules, a thick sound can be reproduced. Also, TG. The clock CLK of the board having NO of 001B to 011B is set to TG. Since the data generated on the board with NO of 000B is used and transferred at a transfer speed four times that in the single sound source mode, the effect circuit 39 of each sound module and the digital mixer 81 of the sound generation module 70a are connected. The number of output lines is reduced as shown in FIG. 1, and the input terminals of the digital mixer 81 need only be two CLK and DAT. In the above description, four sound source modules are targeted. However, the present invention is not limited to this, and two or three sound source modules may be used.

本発明の一実施形態の構成を示すブロック図である。It is a block diagram which shows the structure of one Embodiment of this invention. 図1のホストCPUの動作を説明するためのフローチャートである。3 is a flowchart for explaining the operation of the host CPU in FIG. 1. 図2の続きのフローチャートである。FIG. 3 is a flowchart continued from FIG. 2. 図3の続きのフローチャートである。FIG. 4 is a continuation flowchart of FIG. 3. 非同期通信A用割込み処理の一例を示すフローチャートである。It is a flowchart which shows an example of the interruption process for asynchronous communication A. 非同期通信B用割込み処理の一例を示すフローチャートである。It is a flowchart which shows an example of the interruption process for asynchronous communication B. 非同期通信Bの転送速度の変化およびインピーダンスの切替えを示す図である。It is a figure which shows the change of the transfer rate of asynchronous communication B, and switching of an impedance. 音源CPUの動作を説明するためのフローチャートである。It is a flowchart for demonstrating operation | movement of sound source CPU. 図8の続きのフローチャートである。FIG. 9 is a flowchart continued from FIG. 8. FIG. 音源CPUの通信B用割込み処理の一例を示すフローチャートである。It is a flowchart which shows an example of the interruption process for communication B of sound source CPU. エフェクト回路の出力信号速度の変化を示す図である。It is a figure which shows the change of the output signal speed of an effect circuit. 従来構成の一例を示すブロック図である。It is a block diagram which shows an example of a conventional structure.

1…電子楽器本体、3…CDR駆動装置、10a…ホストモジュール、15…ホストCPU、18…非同期シリアル通信部A、19…非同期シリアル通信部B、30a…音源モジュール、32…非同期シリアル通信部B、34…音源CPU、38…楽音発生回路、39…DSP(エフェクト回路)、70a…発音モジュール、81…デジタルミキサー、82…DSP(トータルエフェクト回路)。   DESCRIPTION OF SYMBOLS 1 ... Electronic musical instrument main body, 3 ... CDR drive device, 10a ... Host module, 15 ... Host CPU, 18 ... Asynchronous serial communication part A, 19 ... Asynchronous serial communication part B, 30a ... Sound source module, 32 ... Asynchronous serial communication part B 34 ... Sound source CPU, 38 ... Musical sound generation circuit, 39 ... DSP (effect circuit), 70a ... Sound generation module, 81 ... Digital mixer, 82 ... DSP (total effect circuit).

Claims (2)

制御データを受信して対応する楽音を合成し、該楽音をデジタルのシリアルデータとして送出する1またはN(Nは2以上の整数)の音源モジュールと、該1またはNの音源モジュールからの楽音のデジタルのシリアルデータを受信して、該音源モジュールがNである場合はそれぞれをミキシング合成して発音する発音モジュールとを少なくとも備えた電子楽器の通信装置において、
前記デジタルのシリアルデータの1サンプル時間をN分割する分割手段と、
前記分割されたサンプル時間のいずれかに前記音楽モジュールのデジタルのシリアルデータを送出する送出手段とを備え、
前記音源モジュールを単体で使用するシングル音源モードの場合と、複数接続して使用するマルチ音源モードの場合とで、該音源モジュールが前記発音モジュールに対して出力するデジタル楽音信号の転送レートを切り替えるようにしたことを特徴とする電子楽器の通信装置。
1 or N (N is an integer of 2 or more) sound source modules that receive control data, synthesize the corresponding musical sounds, and send the musical sounds as digital serial data ; and the musical sounds from the 1 or N sound source modules In an electronic musical instrument communication device comprising at least a sound generation module that receives digital serial data and mixes and synthesizes each of the sound source modules when the sound source module is N ,
Dividing means for dividing one sample time of the digital serial data into N;
Sending means for sending digital serial data of the music module at any of the divided sample times;
The transmission rate of the digital musical sound signal that the sound module outputs to the sound module is switched between the single sound source mode in which the sound module is used alone and the multi sound source mode in which a plurality of the sound modules are connected. An electronic musical instrument communication device characterized by the above.
前記発音モジュールは、
前記マルチ音源モードの場合、前記音源モジュールから出力されたデジタル楽音信号をミキシング合成する合成手段と、
該合成手段から出力されたデジタル楽音信号にエフェクトをかける手段とを具備したことを特徴とする請求項1に記載の電子楽器の通信装置。
The pronunciation module is
In the case of the multi-sound source mode, a synthesis unit that mixes and synthesizes the digital musical sound signal output from the sound source module;
2. The electronic musical instrument communication apparatus according to claim 1, further comprising means for applying an effect to the digital musical tone signal output from the synthesizing means.
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