JP4764694B2 - Withstand voltage test equipment - Google Patents
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Description
本発明は耐電圧試験装置に関し、さらに詳しく言えば、試験中に外部から強制終了の指示が出された場合に実行される強制ストップモードに関するものである。 The present invention relates to a withstand voltage test apparatus, and more particularly, to a forced stop mode that is executed when a forced termination instruction is issued from the outside during a test.
電気・電子機器の安全性および信頼性を評価するパラメータとしては、第１に電気絶縁性があげられる。絶縁は事故防止のための重要な要素であり、そのため、ＩＥＣ規格，ＵＬ規格，電気用品取締法などの各種安全規格により、その試験方法が規定されている。 As a parameter for evaluating the safety and reliability of an electric / electronic device, firstly, electrical insulation can be mentioned. Insulation is an important element for preventing accidents. Therefore, the test method is defined by various safety standards such as IEC standard, UL standard, and Electrical Appliance and Material Control Law.
試験電圧や試験時間は製品ごとに決められているが、基本的には、電圧発生部より製品（被試験体）の電極端子間に所定の試験電圧（一般的には交流電圧）を印加し、そのとき被試験体に流れる試験電流（漏れ電流）Ｉａを測定して、あらかじめ設定されている電流閾値Ｉｂと比較し、Ｉａ＜Ｉｂ（もしくはＩａ≦Ｉｂ）であればＰＡＳＳ（合格）判定とし、Ｉａ≧Ｉｂ（もしくはＩａ＞Ｉｂ）であればＦＡＩＬ（不合格）判定とする。 The test voltage and test time are determined for each product. Basically, a predetermined test voltage (generally an AC voltage) is applied between the electrode terminals of the product (device under test) from the voltage generator. Then, the test current (leakage current) Ia flowing through the DUT is measured and compared with a preset current threshold value Ib. If Ia <Ib (or Ia ≦ Ib), a PASS (pass) determination is made. If Ia ≧ Ib (or Ia> Ib), it is determined as FAIL (failure).
図５に従来一般的に行われている耐電圧試験のフローチャートを示す。まず、ユーザーによって被試験体に印加する「試験電圧」，合否判定基準となる「電流閾値」および「試験時間」が制御部に設定されたのち、試験が開始される。なお、試験時間は制御部の内蔵タイマにより計時される。この試験中、測定部にて被試験体に流れる試験電流Ｉａが測定され、制御部にて試験電流Ｉａと電流閾値Ｉｂとの大小関係が判断される。 FIG. 5 shows a flowchart of a withstand voltage test that has been generally performed. First, after the “test voltage” to be applied to the device under test by the user, “current threshold value” and “test time” that are acceptance criteria are set in the control unit, the test is started. The test time is counted by a built-in timer of the control unit. During this test, a test current Ia flowing through the device under test is measured by the measurement unit, and a magnitude relationship between the test current Ia and the current threshold value Ib is determined by the control unit.
その結果、Ｉａ＜Ｉｂであれば、試験時間が経過するまで試験を継続し、試験時間経過後にＰＡＳＳ判定を出す。これに対して、Ｉａ≧Ｉｂであれば、試験時間の経過を待つことなくその時点で試験を停止してＦＡＩＬ判定を出す。 As a result, if Ia <Ib, the test is continued until the test time elapses, and a PASS determination is issued after the test time elapses. On the other hand, if Ia ≧ Ib, the test is stopped at that point without waiting for the elapse of the test time and a FAIL judgment is issued.
このように、Ｉａ＜ＩｂでＰＡＳＳ判定の場合、試験時間が経過するまで試験を継続するのは、耐電圧試験では被試験体によって試験時間が異なるものの、その試験時間が経過しないと試験が未成立と見なされるからである。 Thus, in the case of PASS determination with Ia <Ib, the test is continued until the test time elapses. In the withstand voltage test, although the test time varies depending on the test object, the test is not performed unless the test time elapses. This is because it is considered to be established.
換言すれば、Ｉａ＜Ｉｂであっても、タイムアップ前に試験が止められた場合にはＰＡＳＳ判定は出されない。なお、従来の耐電圧試験装置の制御部は、通常、その内蔵タイマからのタイムアップ信号に基づいて試験時間が経過したと判断するようにプログラムされている。一方、Ｉａ≧ＩｂでＦＡＩＬ判定の場合には、被試験体が絶縁破壊に至るおそれがあるため、即座に試験を終了する。 In other words, even if Ia <Ib, if the test is stopped before the time is up, the PASS determination is not issued. Note that the control unit of the conventional withstand voltage test apparatus is usually programmed to determine that the test time has elapsed based on the time-up signal from the built-in timer. On the other hand, in the case of FAIL determination with Ia ≧ Ib, the test object is immediately terminated because the device under test may be subject to dielectric breakdown.
従来の一般的な耐電圧試験装置は上記のような動作モードを備えるが、例えば製品の連続組立ラインに組み込まれて、そのラインの主制御手段の管理下でシーケンス制御されるような場合、ラインの他の機器やタクトタイムとの関係で、耐電圧試験の試験時間がラインの主制御手段によって設定されることがある。 The conventional general withstand voltage test apparatus has the operation mode as described above. For example, when it is incorporated in a continuous assembly line of a product and is sequence-controlled under the control of the main control means of the line, The test time of the withstand voltage test may be set by the main control means of the line in relation to other equipment and tact time.
このような場合、ラインの主制御手段が備える試験時間設定用のタイマが優先され、しかも主制御手段により設定される試験時間は、生産性などの観点から、一般的に耐電圧試験装置のタイマで設定可能な時間よりも短くされることになる。 In such a case, the test time setting timer provided in the main control means of the line has priority, and the test time set by the main control means is generally a timer of a withstand voltage test apparatus from the viewpoint of productivity. It will be shorter than the time that can be set with.
そうすると、耐電圧試験装置側では、ラインの主制御手段から出される試験終了信号を試験を途中で終了させる強制終了信号と見なし、図５のフローチャートに示すように、試験は終了するが、Ｉａ＜ＩｂであってもＰＡＳＳ判定を出さない。 Then, the withstand voltage test apparatus side regards the test end signal output from the main control means of the line as a forced end signal for terminating the test halfway, and the test ends as shown in the flowchart of FIG. 5, but Ia < Even if it is Ib, the PASS judgment is not issued.
そのため、ラインの主制御手段側ではＰＡＳＳ判定が出されないことから、被試験体を次工程にすすめることができない、という問題が生ずる。これとは別に、ユーザーが試験途中で強制終了をかけたときにも、ＰＡＳＳ判定が出されないため、合格品であっても再度試験をやり直さなければならない、という問題もある。 Therefore, since the PASS judgment is not issued on the main control means side of the line, there arises a problem that the device under test cannot be advanced to the next process. Apart from this, there is also a problem that even when the user forcibly terminates the test, the PASS judgment is not issued, so that the test must be performed again even if it is a pass product.
したがって、本発明の課題は、被試験体に試験電圧を所定の試験時間印加して行う耐試験において、タイマに設定されている試験時間の途中で、外部から強制終了がかけられた場合でも、判定結果が出されるようにすることにある。 Therefore, the problem of the present invention is that in the durability test performed by applying a test voltage to the device under test for a predetermined test time, even when forced termination is applied from the outside during the test time set in the timer, The determination result is to be output.
上記課題を解決するため、本発明は、請求項１に記載されているように、被試験体に所定の試験電圧を印加する電圧発生部と、上記試験電圧の印加により上記被試験体に流れる試験電流を測定する測定部と、所定の試験条件を設定する入力部と、上記入力部から少なくとも上記試験電流の合否判定用の電流閾値と試験時間とが設定されるとともに、上記試験時間を計時する内蔵タイマを有する制御部と、試験時間設定用の外部タイマを有する外部制御手段が接続される接続端子部とを含み、上記制御部は、基本的な動作制御モードとして、試験開始に伴って上記内蔵タイマをスタートさせて、上記電圧発生部から上記被試験体に上記試験電圧を印加するとともに、上記測定部にて測定される上記試験電流を監視し、上記試験電流が上記電流閾値よりも大きい場合には、その時点で不合格判定を行って試験を終了し、上記試験電流が上記電流閾値よりも小さい場合には、上記内蔵タイマが上記試験時間を計時するまで試験を継続し、上記試験時間の経過後に合格判定を行って試験を終了する耐電圧試験装置において、上記制御部は、上記接続端子部に上記外部制御手段が接続された場合には、特定制御モードとして、上記内蔵タイマよりも上記外部タイマを優先し、上記試験電流が上記電流閾値よりも大きい場合を除いて、上記外部タイマに設定された試験時間が経過した時点で、合格判定を行って試験を終了する強制ストップモードを備えていることを特徴としている。 In order to solve the above-described problems, the present invention provides a voltage generator for applying a predetermined test voltage to a device under test as described in claim 1, and flows to the device under test by applying the test voltage. A measurement unit for measuring the test current, an input unit for setting a predetermined test condition, and at least a current threshold for determining whether the test current is acceptable and a test time are set from the input unit, and the test time is counted. A control unit having a built-in timer, and a connection terminal unit to which an external control means having an external timer for setting a test time is connected. The control unit has a basic operation control mode as a test starts. The built-in timer is started, and the test voltage is applied to the device under test from the voltage generator, and the test current measured by the measurement unit is monitored. If the test current is smaller than the current threshold value, the test is continued until the built-in timer times the test time. In the withstand voltage test apparatus that performs a pass determination after the test time elapses and ends the test, the control unit, when the external control means is connected to the connection terminal unit, as the specific control mode, Prioritize the external timer over the built-in timer. Except when the test current is larger than the current threshold, when the test time set for the external timer has elapsed, the pass determination is made and the test is terminated. It features a forced stop mode.
本発明において、請求項２に記載されているように、上記外部制御手段は、当該耐電圧試験装置を他の試験装置と関連して制御する主制御手段であることが好ましい。 In the present invention, as described in claim 2 , the external control means is preferably main control means for controlling the withstand voltage test apparatus in association with another test apparatus.
請求項１に記載の発明によれば、制御部は、特定制御モードとして、試験時間の経過前に外部指令手段から試験を終了させる強制終了信号を受けたときには、試験電流が電流閾値よりも大きい場合を除いて、試験時間の経過を待つことなく即座に合格判定を行って試験を終了する強制ストップモードを備えていることにより、試験途中で強制終了信号が出された場合でも、合格判定が出される。 According to the first aspect of the present invention, when the control unit receives, as the specific control mode, a forced end signal for ending the test from the external command means before the test time elapses, the test current is larger than the current threshold value. Except in some cases, it is equipped with a forced stop mode that immediately performs a pass determination without ending the test time and ends the test. Is issued.
したがって、請求項２に記載のように、例えば製品の連続組立ラインに組み込まれて、そのラインの主制御手段の管理下でシーケンス制御されるような場合でも、支障なくラインを稼働することができる。 Therefore, as described in claim 2 , for example, even if it is incorporated in a continuous assembly line of a product and sequence-controlled under the control of the main control means of the line, the line can be operated without any trouble. .
次に、図１ないし図４により本発明の実施形態について説明する。図１は本発明による耐電圧試験装置の一例を示す概略的なブロック図，図２は本発明の基本的な動作制御モードを示すフローチャート，図３は本発明の請求項１に対応する第１強制ストップモードを示すフローチャート，図４は本発明の参考実施形態としての第２強制ストップモードを示すフローチャートである。 Next, an embodiment of the present invention will be described with reference to FIGS. 1 is a schematic block diagram showing an example of a withstand voltage test apparatus according to the present invention, FIG. 2 is a flowchart showing a basic operation control mode of the present invention, and FIG. 3 is a first diagram corresponding to claim 1 of the present invention. FIG. 4 is a flowchart showing a second forced stop mode as a reference embodiment of the present invention.
図１に示すように、この耐電圧試験装置は、被試験体ＥＵＴに対して所定の試験電圧を印加する電圧発生部１１と、その試験電圧の印加により被試験体ＥＵＴに流れる試験電流Ｉａを測定する測定部１２と、制御部１３と、制御部１３に試験条件を与える入力部１４と、試験結果を表示する表示部１５と、図示しない外部制御手段（外部指令手段）が接続される接続端子部１６とを備える。
As shown in FIG. 1, the withstand voltage test apparatus includes a
被試験体ＥＵＴは、電気・電子機器，電子部品，電子材料などであってよく、図示しない一対の電極端子間に電圧発生部１１より試験電圧が印加される。耐電圧試験装置では、電圧発生部１１に交流電源が用いられるのが一般的であるが、場合によっては、直流電源が用いられてもよい。試験電圧は、被試験体ＥＵＴごとに決められる。
The device under test EUT may be an electric / electronic device, an electronic component, an electronic material, or the like, and a test voltage is applied from the
測定部１２は、被試験体ＥＵＴの試験電流Ｉａが流される電流検出抵抗と、電流検出抵抗に生ずる電圧降下を測定する電圧計（ともに図示しない）とにより構成することができる。制御部１３には、ＣＰＵ（中央演算処理ユニット）やマイクロコンピュータなどが用いられてよい。
The
制御部１３には、入力部１４より各種の試験条件として試験電圧，試験時間，合否判定基準の電流閾値Ｉｂなどが設定され、その試験電圧に基づいて電圧発生部１１の出力が制御される。試験時間は、制御部１３に内蔵されているタイマにより計時される。
The
入力部１４には、キーボードなどの操作盤が用いられてよいが、その中には強制終了スイッチが含まれる。表示部１５には、液晶表示パネルやプラズマディスプレイが好ましく採用されるが、プリンタが用いられてもよい。
An operation panel such as a keyboard may be used for the
接続端子部１６には外部制御手段が接続されるが、当該耐電圧試験装置が、例えば製品の連続組立ラインに組み込まれて、その組立ラインの主制御手段の管理下でシーケンス制御されるような場合、接続端子部１６には、その組立ラインの主制御手段（パソコンなど）が接続される。
An external control means is connected to the
このような場合、当該耐電圧試験装置の試験時間は、外部制御手段である上記主制御手段により設定される。すなわち、上記主制御手段が備える試験時間設定用のタイマが優先され、そのタイマには、組立ラインの生産性などの観点から、当該耐電圧試験装置のタイマで設定可能な時間よりも短い試験時間が設定される。 In such a case, the test time of the withstand voltage test apparatus is set by the main control means which is an external control means. That is, the test time setting timer provided in the main control unit has priority, and from the viewpoint of assembly line productivity, the timer has a test time shorter than the time settable by the timer of the withstand voltage test device. Is set.
次に、本発明の動作について説明するが、まず、図２のフローチャートを参照して、試験中に強制ストップがかからないときの基本的な動作制御モードについて説明する。 Next, the operation of the present invention will be described. First, a basic operation control mode when a forced stop is not applied during the test will be described with reference to the flowchart of FIG.
試験が開始されるのと同時に、電圧発生部１１より被試験体ＥＵＴに所定の試験電圧が印加され、また、制御部１３の図示しない内蔵タイマがスタートするとともに、測定部１２にて被試験体ＥＵＴに流れる試験電流Ｉａが測定される（ステップＳＴ１）。
At the same time as the test is started, a predetermined test voltage is applied from the
次に、制御部１３は、試験電流Ｉａと電流閾値Ｉｂとの大小関係を判定する（ステップＳＴ２）。その結果、Ｉａ＜Ｉｂ（もしくはＩａ≦Ｉｂ）であれば、試験時間が経過しているかを判断する（ステップＳＴ３）。
Next, the
試験時間が経過していなければ、ステップＳＴ１に戻り、試験時間が経過するまでステップＳＴ１，ＳＴ２を繰り返す。そして、試験時間が経過した時点（内蔵タイマのタイムアップ時点）で、ＰＡＳＳ判定を表示部１５に表示して（ステップＳＴ４）、試験を終了する。 If the test time has not elapsed, the process returns to step ST1, and steps ST1 and ST2 are repeated until the test time elapses. Then, when the test time has elapsed (when the built-in timer expires), the PASS determination is displayed on the display unit 15 (step ST4), and the test is terminated.
上記ステップＳＴ２で、Ｉａ≧Ｉｂ（もしくはＩａ＞Ｉｂ）であれば、ＦＡＩＬ判定を表示部１５に表示し（ステップＳＴ５）、その時点で電圧発生部１１を出力を止めて試験を停止する。
If Ia ≧ Ib (or Ia> Ib) in step ST2, the FAIL determination is displayed on the display unit 15 (step ST5), and at that time, the output of the
本発明は、上記基本的な動作制御モードのほかに、特定制御モードとして、第１強制ストップモードおよび／または第２強制ストップモードを備える。 In addition to the basic operation control mode, the present invention includes a first forced stop mode and / or a second forced stop mode as the specific control mode.
この特定制御モードは、接続端子部１６に外部制御手段（例えば、上記組立ラインの主制御手段）が接続され、試験の途中で、その外部制御手段から試験終了信号が出された場合、もしくは入力部１４の強制終了スイッチが押された場合に動作する。
In this specific control mode, an external control means (for example, the main control means of the assembly line) is connected to the
図３は、請求項１に記載されている第１強制ストップモードのフローチャートで、このモードでは、Ｉａ＜Ｉｂ（もしくはＩａ≦Ｉｂ）であるが、上記ステップＳＴ３で試験時間がまだ経過していないと判断されて、上記ステップＳＴ１に戻るときに強制終了かを判断するステップＳＴ３ａが付加される。 FIG. 3 is a flowchart of the first forced stop mode described in claim 1. In this mode, Ia <Ib (or Ia ≦ Ib), but the test time has not yet elapsed in step ST3. Step ST3a for determining whether to forcibly terminate when returning to step ST1 is added.
すなわち、試験の途中で、外部制御手段から試験終了信号が出されるか、もしくは強制終了スイッチが押されると、即座に上記ステップＳＴ４を実行し、ＰＡＳＳ判定としたのち、試験を終了する。なお、ＦＡＩＬ判定の場合には、上記基本的な動作制御モードと同じく、その時点で上記ステップＳＴ５を実行し、ＦＡＩＬ判定としたのち、試験を終了する。 That is, when a test end signal is output from the external control means or the forced end switch is pressed during the test, step ST4 is immediately executed to determine PASS, and then the test ends. In the case of FAIL determination, as in the basic operation control mode, step ST5 is executed at that time, and after the FAIL determination is made, the test is terminated.
次に、第２強制ストップモードについて説明する。このモードでは、上記ステップＳＴ３での試験時間経過待ちのときに、外部制御手段から試験終了信号が出されるか、もしくは強制終了スイッチが押されると、図４に示す割り込み処理が実行され、Ｉａ＜Ｉｂ（もしくはＩａ≦Ｉｂ）であれば、試験時間の経過を待つことなくＰＡＳＳ判定とし、Ｉａ≧Ｉｂ（もしくはＩａ＞Ｉｂ）であれば、ＦＡＩＬ判定として試験を終了する。 Next, the second forced stop mode will be described. In this mode, when a test end signal is issued from the external control means or when the forced end switch is pressed while waiting for the test time to elapse in step ST3, the interrupt process shown in FIG. 4 is executed, and Ia < If Ib (or Ia ≦ Ib), the PASS determination is made without waiting for the test time to elapse, and if Ia ≧ Ib (or Ia> Ib), the test is ended as FAIL determination.
以上説明したように、本発明によれば、耐電圧試験の途中で強制終了した場合でも、ＰＡＳＳ判定，ＦＡＩＬ判定がなされるため、例えば製品の連続組立ラインや自動試験システムに適用される場合には、その外部制御手段とのマッチングがとられ円滑に試験を進めることができる。また、手動で強制終了させた場合でも、Ｉａ＜Ｉｂ（もしくはＩａ≦Ｉｂ）であればＰＡＳＳ判定が出されるため、試験途中であっても良品であることを知ることができる。 As described above, according to the present invention, even when the withstand voltage test is forcibly terminated in the middle of the withstand voltage test, the PASS determination and the FAIL determination are performed. For example, when applied to a product continuous assembly line or an automatic test system. Can be matched with the external control means and the test can proceed smoothly. Further, even when the operation is forcibly terminated manually, if Ia <Ib (or Ia ≦ Ib), a PASS determination is issued, so that it is possible to know that the product is non-defective even during the test.
なお、外部制御手段に接続し、その外部制御手段により試験時間が設定されるような場合には、当該耐電圧試験装置側の内蔵タイマを無効とすることにより、タイムアップかどうかの判断ステップを省略することができ、制御部の負担を軽減することができる。 If the test time is set by the external control means connected to the external control means, the internal timer on the withstand voltage test device side is invalidated to determine whether the time is up or not. This can be omitted, and the burden on the control unit can be reduced.
また、本発明の耐電圧試験装置は単機能の機器として製品化されてもよいし、他の測定機能を有する電気測定器の一つの機能として組み込まれてもよい。 In addition, the withstand voltage test device of the present invention may be commercialized as a single-function device, or may be incorporated as one function of an electric measuring instrument having other measurement functions.
１１ 電圧発生部
１２ 測定部
１３ 制御部
１４ 入力部
１５ 表示部
１６ 外部制御機器の接続端子部
DESCRIPTION OF
Claims (2)
上記制御部は、基本的な動作制御モードとして、試験開始に伴って上記内蔵タイマをスタートさせて、上記電圧発生部から上記被試験体に上記試験電圧を印加するとともに、上記測定部にて測定される上記試験電流を監視し、上記試験電流が上記電流閾値よりも大きい場合には、その時点で不合格判定を行って試験を終了し、上記試験電流が上記電流閾値よりも小さい場合には、上記内蔵タイマが上記試験時間を計時するまで試験を継続し、上記試験時間の経過後に合格判定を行って試験を終了する耐電圧試験装置において、
上記制御部は、上記接続端子部に上記外部制御手段が接続された場合には、特定制御モードとして、上記内蔵タイマよりも上記外部タイマを優先し、上記試験電流が上記電流閾値よりも大きい場合を除いて、上記外部タイマに設定された試験時間が経過した時点で、合格判定を行って試験を終了する強制ストップモードを備えていることを特徴とする耐電圧試験装置。 A voltage generator for applying a predetermined test voltage to the device under test; a measuring unit for measuring a test current flowing through the device under test by applying the test voltage; an input unit for setting predetermined test conditions; and the input A control unit having a built-in timer for timing the test time, and an external control means having an external timer for setting the test time. Including a connection terminal portion to be connected,
As a basic operation control mode, the control unit starts the built-in timer at the start of a test, applies the test voltage from the voltage generation unit to the device under test, and measures the measurement unit. The test current is monitored, and if the test current is greater than the current threshold, the test is terminated at that time, and if the test current is smaller than the current threshold, the test is terminated. In the withstand voltage test device that continues the test until the built-in timer times the test time, and performs a pass determination after the test time has elapsed,
When the external control means is connected to the connection terminal unit, the control unit prioritizes the external timer over the built-in timer as a specific control mode, and the test current is greater than the current threshold A withstand voltage test apparatus comprising: a forced stop mode in which a pass determination is made and the test is terminated when the test time set in the external timer has elapsed except for.
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