JP4753324B2 - ビデオ・エンコーダおよびエンコーダからデコーダへのタイミングを同期させる方法 - Google Patents
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Description
E→|PCRn−PCRn−1|−|Ln−Ln−1|
誤差信号Eは、これらの差を等しくする傾向にある周波数に電圧制御発振器37を調整するのに利用される。クロック制御装置39から発生される誤差信号は、パルス幅変調された信号の形式をとり、これは、アナログ構成要素で低域フィルタを実現することにより、アナログ誤差信号にすることもできる。
LTE→|Ln−L0|−|PCRn−PCR0|
ここで、PCR0およびL0は、例えば、最初に生じるPCRおよびそれと対応する、受信機計数器の保持された値である。通常、誤差信号EおよびLTEは離散的ステップで変化する。従って、ひとたびシステムが“同期”すると、誤差信号はゼロ点に関して1単位ディザーする。選択された同期の方法では、1単位のディザーが誤差信号Eに生じるまで誤差信号Eを使用して電圧制御発振器の制御を開始し、それから、長期誤差信号LTEの使用に切り替えて、電圧制御発振器を制御する。
(1) ビデオ信号の源(10)と、
クロック信号の源(22)と、
整数Nを法として前記クロック信号を計数する計数器(23)と、
前記ビデオ信号のフレームの発生に応答して、前記計数器から供給される計数値のうちの或る計数値をPTRとして捕捉する手段(24)と、
前記ビデオ信号を圧縮し、前記PTRをこの圧縮済みビデオ信号に含ませて、圧縮済みビデオ・データをフォーマット化する圧縮/フォーマット化手段(11、12)と、
前記圧縮/フォーマット化手段から前記PTRを含む前記フォーマット化した圧縮済みビデオ・データを受け取るように結合されており、この圧縮済みビデオ・データを、トランスポート・ヘッダに連結された前記圧縮済みビデオ・データのペイロードと前記PTRのペイロードを含むトランスポート・パケットに分割するトランスポート・プロセッサ(13)と、
トランスポート・パケットのタイミングに応答して、前記計数器から供給される更なる計数値を、前記圧縮済みビデオ・データを除いた補助データ(AUX2)として前記トランスポート・パケットのうちの或るトランスポート・パケットのペイロードに含ませるPCRとして、周期的に捕捉する手段(13、25)と、
前記トランスポート・パケットを伝送用に調整する手段(14、15)と、
を備えるビデオ信号圧縮装置。
(2) 前記トランスポート・プロセッサ(13)が、圧縮済みビデオ・データのトランスポート・パケットと前記PCRを含む補助トランスポート・パケットとを形成し、また、前記トランスポート・プロセッサ(13)が、前記補助トランスポート・パケットの間に前記圧縮済みビデオ・データのトランスポート・パケットを挿入する手段を含んでいる、(1)記載のビデオ信号圧縮装置。
(3) 符号化システム内に設けられ整数Nを法として符号化システム・クロックのパルスを計数する計数器(23)から周期的に得られる第1の計数値(PCR)と、圧縮済みビデオ信号および/または圧縮済みデータ信号とを含むトランスポート・パケットを処理する圧縮済み信号受信システムの少なくとも一部を同期させる同期装置であって、
前記トランスポート・パケットの源(17)と、
第1の制御信号に応答する被制御発振器(37)と、前記符号化システム内の前記計数器(23)と同じく、Nを法として受信機システム・クロック信号のパルスを計数する受信機用計数器(36)と、前記符号化システム・クロックの周波数と前記受信機用計数器の出力の周波数との差を表す誤差信号(E)を生成する制御器(39)とを含み、前記受信機システム・クロック信号を供給する固定ループと、
前記第1の計数値(PCR)を含むトランスポート・パケットの各出現に応答して、第2の制御信号を供給する手段(31)と、を有し、
更に、前記同期装置は、前記受信機用計数器(36)を前記符号化システム内の計数器(23)と同期させるために、
前記受信した第1の計数値(PCR)を記憶する手段(34)と、
前記第2の制御信号に応答して、前記受信機用計数器(36)から出力される第2の計数値(RCV)を保持する手段(35)と、を有し、
前記制御器(39)が、現在受信している第1の計数値(PCRn)とその前に受信した第1の計数値(PCRn−1)との差と、現在の第2の計数値(RCVn)とその前の第2の計数値(RCVn−1)との差とから前記誤差信号(E)を形成するように構成された、前記同期装置。
(4) 前記誤差信号(E)は、
|PCRn−PCRn−1|−|RCVn−RCVn−1|
に比例して計算され、ここで、PCRnとPCRn−1は、それぞれ、前記現在受信している第1の計数値と前記その前に受信した第1の計数値であり、RCVnとRCVn−1は、それぞれ、前記現在の第2の計数値と前記その前の第2の計数値とである、(3)記載の同期装置。
(5) 前記連続する計数値の各差により形成される誤差信号(E)から、それらの各差に対応する、現在の各計数値(PCRn、RCVn)とシステム始動時の最初に生じる各計数値(PCR0、RCV0)との各差、|PCRn−PCR0|−|RCVn−RCV0|に比例して計算される誤差信号(LTE)に切り替える手段を含む、請求項3或いは(4)記載の同期装置。
(6) 計数器において、整数Nを法としてクロック信号源(22)からのクロック信号を計数する段階と、
ビデオ信号のフレームの発生に応答して、前記計数器から供給される計数値のうちの或る計数値をPTRとして捕捉する(24)段階と、
前記ビデオ信号を圧縮(11)し、前記PTRをこの圧縮済みビデオ信号に含ませて、圧縮済みビデオ・データをフォーマット化する(12)段階と、
トランスポート・プロセッサ(13)内で、前記PTRを含む前記フォーマット化した圧縮済みビデオ・データを受け取り、この圧縮済みビデオ・データを、トランスポート・ヘッダに連結された前記圧縮済みビデオ・データのペイロードと前記PTRのペイロードを含むトランスポート・パケットに分割する段階と、
トランスポート・パケットのタイミングに応答して、前記計数器から供給される更なる計数値を、前記圧縮済みビデオ・データを除いた補助データ(AUX2)として前記トランスポート・パケットのうちの或るトランスポート・パケットのペイロードに含ませるPCRとして、周期的に捕捉する(13、25)段階と、
前記トランスポート・パケットを伝送用に調整する(14、15)段階と、
を含む、ビデオ信号圧縮方法。
11 圧縮装置
12 フォーマット形成装置
13 トランスポート処理装置
14 レート・バッファ
15 モデム
16 モデム
17 レート・バッファ
18 逆トランスポート処理装置
19 復元装置
20 ディスプレイ(表示装置)
21 システム制御装置
22 システム・クロック
23 計数器
26 システム制御装置
27 システム・クロック
31 補助パケット検出器;整合フィルタ
32 逆トランスポート処理装置
33 トランスポート(TP)制御装置
34 メモリ
36 局部計数器
37 電圧制御発振器
38 低減フィルタ
39 クロック制御装置
45 加算器
46 メモリ
50 ビデオ・エンコーダ
51 ディジタル蓄積メディア
52 クロックPCR発生器
53 トランスポート処置装置
54 ディジタル読取り制御装置
55 マルチプレクサ
56 マルチプレクサ
60 局部クロック
61 補助パケット検出器
62 計数器
63 補助パケット検出器
66 マルチプレクサ
67 バッファ
Claims (1)
- 所定の長さのトランスポート・パケットを使用して圧縮されたビデオ・データを送信する方法であって、
可変長の補助フィールドを前記トランスポート・パケットの一つに組み込むステップと、
前記可変長の補助フィールドのバイト数に関する情報を伝送するために8ビット長のフィールドを前記トランスポート・パケットに組み込むステップと、
前記補助フィールドが、前記トランスポート・パケット内に定められているかどうかを示すための制御データを前記トランスポート・パケットに組み込むステップと、
を含み、
タイミング情報に関連するプログラム・クロック・リファレンス(PCR)が、前記圧縮ビデオ・データを含むフィールド以外の前記補助フィールドに含まれる、前記方法。
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