JP4738068B2 - プロセッサ及びシステム - Google Patents
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Description
11 ROM
12 メモリ
13 HDD
14 外部命令・データバス
15 外部アドレスバス
21 実行部
22 MMU
23 セキュアDMA
24 キャッシュメモリ
25 ローカルメモリ
26 バス・インターフェース
Claims (6)
- プログラムを実行する実行部と、
該実行部に結合されるバスと、
該バスに結合されるローカルメモリと、
該バスに結合されるDMAユニットと、
該バスと外部とを結合するインターフェースと
を含み、該DMAユニットは、該実行部からの命令に応じてDMA転送処理を実行し、該DMA転送処理により該インターフェースを介して外部から情報を取り込み、該取り込んだ情報を復号化し、該復号化した情報を該DMA転送処理により該ローカルメモリに書き込むよう構成され、
該DMAユニットは、
該DMA転送処理を実行するDMAコントローラと、
該実行部が実行するプログラムに関連したIDを格納するレジスタと、
該レジスタに設定された前記DMA転送処理のアクセスのIDと、前記DMA転送処理の終了後に前記実行部により要求される別のDMA転送処理のアクセスのIDとが一致するか否かに応じて該別のDMA転送処理の実行を許可又は禁止する制御回路
を含むことを特徴とするプロセッサ。 - 該ローカルメモリはメインメモリ空間以外のアドレス領域に割当てられることを特徴とする請求項1記載のプロセッサ。
- 該ローカルメモリは、
情報を記憶するメモリコア回路と、
該実行部が実行するプログラムに関連したIDを格納するレジスタと、
該レジスタに設定された前記DMA転送処理のアクセスのIDと、前記DMA転送処理の終了後に前記実行部から要求される該メモリコア回路への読み出し処理のアクセスのIDとが一致するか否かに応じて、該読み出し処理のアクセスを許可又は禁止する制御回路
を含むことを特徴とする請求項1記載のプロセッサ。 - 該ローカルメモリは、
情報を記憶するメモリコア回路と、
該実行部が実行するプログラムの特権レベルを示す情報を格納するレジスタと、
該レジスタに設定された前記DMA転送処理の特権レベル情報と、前記DMA転送処理の終了後に前記実行部から要求される該メモリコア回路への読み出し処理の特権レベル情報とが一致するか否かに応じて、該読み出し処理のアクセスを許可又は禁止する制御回路
を含むことを特徴とする請求項1記載のプロセッサ。 - メモリと、
該メモリに結合される外部バスと、
該外部バスに結合されるプロセッサ
を含み、該プロセッサは、
プログラムを実行する実行部と、
該実行部に結合される内部バスと、
該内部バスに結合されるローカルメモリと、
該内部バスに結合されるDMAユニットと、
該内部バスと該外部バスとを結合するインターフェース
を含み、該DMAユニットは、該実行部からの命令に応じてDMA転送処理を実行し、該DMA転送処理により該インターフェースを介して該メモリから情報を取り込み、該取り込んだ情報を復号化し、該復号化した情報を該DMA転送処理により該ローカルメモリに書き込むよう構成され、
該DMAユニットは、
該DMA転送処理を実行するDMAコントローラと、
該実行部が実行するプログラムに関連したIDを格納するレジスタと、
該レジスタに設定された前記DMA転送処理のアクセスのIDと、前記DMA転送処理の終了後に前記実行部により要求される別のDMA転送処理のアクセスのIDとが一致するか否かに応じて該別のDMA転送処理の実行を許可又は禁止する制御回路
を含むことを特徴とするシステム。 - 該ローカルメモリは該メモリのメモリ空間以外のアドレス領域に割当てられることを特徴とする請求項5記載のシステム。
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