JP4694410B2 - 昇圧回路装置 - Google Patents
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Description
図2の昇圧回路装置において、昇圧電源1が動作し、電源電位VDDを昇圧して昇圧電位VPPを出力端子OUTに出力する。電圧センサ10は、電源電位VDDを抵抗分圧したノードN1上の電位と、出力端子OUT上の昇圧電位VPPを抵抗分圧したノードN2上の電位とを、比較回路15で比較して昇圧電位VPPをモニタしており、(ノードN1上の電位>ノードN2上の電位)の時には、活性化信号ENを“H”にして昇圧電源1の動作を継続させて昇圧電位VPPを上昇させ、(ノードN1上の電位≦ノードN2上の電位)の時には、活性化信号ENを“L”にして昇圧電源1の動作を停止させる。これより、出力端子OUTから、式(1)に示すような一定の昇圧電位VPPが出力され、負荷側のメモリセル20へ供給される。
図1は、本発明の実施例1における昇圧回路装置の構成例を示す概略の回路図である。
本実施例1の昇圧回路装置に電源電位VDD及び一定電位REFを印加すると、電圧センサ40内のノードN41の電位が上昇していき、(ノードN41の電位>ノードN42の電位)となるので、比較回路43から出力される活性化信号ENが“H”となる(図4(B)の波形)。活性化信号ENが“H”になると、リング発振器31内のNANDゲート31aが開いてこのリング発振器31が動作し、インバータ31bからパルス信号OSCが出力されてスイッチド・キャパシタ昇圧回路32へ送られる(図4(C)の波形)。
図5は、本実施例1の図1と従来の図2との昇圧電位VPPの相違を示す図である。
図6は、本発明の実施例2における昇圧回路装置の構成例を示す概略の回路図であり、実施例1を示す図1中の要素と共通の要素には共通の符号が付されている。
本実施例2の昇圧回路装置に電源電位VDD及び一定電位REFを印加すると、電圧センサ50内の加算回路51により、電源電位VDDと一定電位REFとが加算され、オペアンプ51cの出力側のノードN51の電位が上昇していき、(ノードN51の電位>ノードN52の電位)となるので、比較回路53から出力される活性化信号ENが“H”となる。活性化信号ENが“H”になると、昇圧電源30が動作して昇圧電位VPPが生成される。
本実施例2によれば、加算回路51によって、傾き、オフセットが抵抗51a,51b,51d,51e,52a,52bの大きさで、電源電位VDDに対する昇圧電位VPPの閾値電位を制御できるので、実施例1と略同様に、回路構成を複雑化することなく、回路定数の設計(設定)が容易になる。
なお、本発明は、図示の実施例に限定されず、種々の利用形態や変形が可能である。この利用形態や変形例としては、例えば、次の(a)、(b)のようなものがある。
40,50 電圧センサ
41 抵抗分圧レベル生成回路
42,52 昇圧電位分圧回路
51 加算回路
Claims (3)
- 第1及び第2の論理レベルに遷移する活性化信号が入力され、前記活性化信号が前記第1の論理レベルの時にオン状態となって電源電位よりも高い昇圧電位を出力端子へ出力し、前記活性化信号が前記第2の論理レベルの時にオフ状態になる昇圧電源と、
前記出力端子上の前記昇圧電位が閾値電位を超えるか否かを検出し、この検出結果に対応した前記第1又は第2の論理レベルの前記活性化信号を前記昇圧電源に与える電圧センサと、
を備えた昇圧回路装置において、
前記電圧センサは、
一定電位と前記電源電位と接地電位との抵抗分圧レベルの分圧レベル電位を生成する抵抗分圧レベル生成回路と、
前記出力端子上の前記昇圧電位を分圧して分圧電位を生成する昇圧電位分圧回路と、
前記分圧レベル電位と前記分圧電位とを比較して、(前記分圧レベル電位>前記分圧電位)の時には、前記第1の論理レベルの前記活性化信号を前記昇圧電源に与え、(前記分圧レベル電位≦前記分圧電位)の時には、前記第2の論理レベルの前記活性化信号を前記昇圧電源に与える比較回路と、
を有することを特徴とする昇圧回路装置。 - 第1及び第2の論理レベルに遷移する活性化信号が入力され、前記活性化信号が前記第1の論理レベルの時にオン状態となって電源電位よりも高い昇圧電位を出力端子へ出力し、前記活性化信号が前記第2の論理レベルの時にオフ状態になる昇圧電源と、
前記出力端子上の前記昇圧電位が閾値電位を超えるか否かを検出し、この検出結果に対応した前記第1又は第2の論理レベルの前記活性化信号を前記昇圧電源に与える電圧センサと、
を備えた昇圧回路装置において、
前記電圧センサは、
一定電位と前記電源電位とを加算して基準電位を生成する加算回路と、
前記出力端子上の前記昇圧電位を分圧して分圧電位を生成する昇圧電位分圧回路と、
前記基準電位と前記分圧電位とを比較して、(前記基準電位>前記分圧電位)の時には、前記第1の論理レベルの前記活性化信号を前記昇圧電源に与え、(前記基準電位≦前記分圧電位)の時には、前記第2の論理レベルの前記活性化信号を前記昇圧電源に与える比較回路と、
を有することを特徴とする昇圧回路装置。 - 前記加算回路は、演算増幅器を用いて構成されていることを特徴とする請求項2記載の昇圧回路装置。
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