JP4567373B2 - データ転送装置及び通信データ処理システム - Google Patents
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Description
前記通信データ転送装置は、互いに独立してデータの入出力が可能な3以上のバッファ・メモリを備えることができる。多くのバッファ・メモリを有することによって、より効率的な処理が可能となる。
図1は、本実施形態における通信データ処理システム100の概略構成を示すブロック図である。図1に示すように、通信データ処理システム100は、通信データを記憶するメイン・メモリ110と、メイン・メモリ110から取得したデータを転送するデータ転送部120とを備えている。データ転送部120の典型的な一例は、LANなどに接続されるネットワーク・コントローラである。データ転送部120は、送信されるパケット・データ形成のために、メイン・メモリ110から取得したデータを並び替えるアライナ130を備えている。メイン・メモリ110及びアライナ130はデータ・バス140を介してデータの通信を行う。
続いて、通信データ処理システム100の他の特徴的な処理を、図3を参照して説明する。上記のように、本形態のバス・システムはスプリット・トランザクションに対応している。上記実施形態においては、リクエストの順序に従ってデータがメイン・メモリ110から読み出されるが、本形態においては、リクエストとは異なる順序においてデータがメイン・メモリ110から読み出される。尚、バス・アービタ141がAck(Reg1)をシーケンサ132に返す([5])までの処理は、図2を参照して説明された処理と同様であり、説明を省略する。
125 後段処理ブロック、130 アライナ、131 レジスタ・ファイル
132 アライン・ロジック、132 シーケンサ、133 セレクタ
134 アライン・リクエスト・キュー、135 シーケンサ
136 バス・リクエスト・キュー、140 データ・バス
141 バス・アービタ、310 アライナ、311 アライン・ロジック
313 シーケンサ、350 メイン・メモリ、360 データ・バス
Claims (8)
- メモリから取得した通信データを転送する通信データ転送装置であって、
メモリからのデータを一時的に記憶し、互いに独立してデータの入出力が可能な複数のバッファ・メモリと、
入力されたデータをパケット通信に対応した順序に並べ替えるアライン部と、
前記複数のバッファ・メモリから選択したバッファ・メモリの読み出しデータを前記アライン部に出力するセレクタと、
前記セレクタを制御するシーケンサを有し、
前記シーケンサは、前記メモリからのデータ出力の順番が、前記メモリへのデータリクエストの順番と異なっていた場合に、前記バッファ・メモリからの読み出しを前記データリクエストの順番にあわせて行う、通信データ転送装置。 - 前記通信データ転送装置は、互いに独立してデータの入出力が可能な3以上のバッファ・メモリを備える、請求項1に記載のデータ転送装置。
- 前記シーケンサによって制御され、前記セレクタによって選択されるバッファ・メモリを特定する選択制御データがセットされる選択制御データ・キューと、
前記シーケンサからのデータリクエストに応じて、前記メモリと前記バッファ・メモリ間のデータ通信を制御するバス・アービタとを更に備え、
前記バス・アービタは、前記シーケンサからのデータリクエストに対してアウト・オブ・オーダで前記データ通信を制御可能であり、
前記シーケンサは、前記バス・アービタが制御したデータ通信が前記データリクエストの順番と異なっていた場合に、前記バッファ・メモリからの読み出しが前記データリクエストの順番となるように前記選択制御データをセットする、請求項1に記載のデータ転送装置。 - 前記バッファ・メモリのそれぞれは、データが書き込まれたことに応じてレディ信号を前記シーケンサに送信し、
前記シーケンサは、前記レディ信号が前記データリクエストの順番と異なって発行された場合は、当該レディ信号に対応する前記選択制御データのセットを保留する、請求項3に記載のデータ転送装置。 - データを記憶するメモリと、
前記メモリからの読み出しデータを伝送するデータ・バスと、
前記メモリから前記データ・バスを介して取得したデータを一時的に記憶する、
互いに独立してデータの入出力が可能な複数のバッファ・メモリと、
前記データ・バスの使用権を調停し、前記メモリから前記複数のバッファ・メモリへのデータ読み出しを制御するバス・アービタと、
入力されたデータをパケット通信に対応した順序に並べ替えるアライン部と、
前記複数のバッファ・メモリから選択したバッファ・メモリの読み出しデータを前記アライン部に出力するセレクタと、
前記セレクタを制御するシーケンサとを有し、
前記シーケンサは、前記メモリからのデータ出力の順番が、前記メモリへのデータ・リード要求の順番と異なっていた場合に、前記バッファ・メモリからの読み出しを前記データリクエストの順番にあわせて行う、通信データ処理システム。 - 前記バス・アービタは、前記メモリからの前記複数のバッファ・メモリへのデータ読み出しを要求するデータ・リード要求の発行順序と、前記メモリから前記複数のバッファ・メモリ内のバッファ・メモリへのデータ転送順序とを、アウト・オブ・オーダにおいて制御する、請求項5に記載の通信データ処理システム。
- 前記メモリからのデータを格納するバッファ・メモリを特定して前記メモリからのデータ読み出しを要求するデータ・リード要求がセットされる、データ・リード要求キューと、
前記セレクタによって選択されるバッファ・メモリを特定する選択制御データが
セットされる選択制御データ・キューと、を更に備え、
前記シーケンサは、前記バス・アービタが制御したデータ通信が前記データ・リード要求の順番と異なっていた場合に、前記バッファ・メモリからの読み出しが前記データ・リード要求の順番となるように前記選択制御データをセットする、請求項6に記載の通信データ処理システム。 - 前記バッファ・メモリのそれぞれは、データが書き込まれたことに応じてレディ信号を前記シーケンサに送信し、
前記シーケンサは、前記レディ信号が前記データ・リード要求の順番と異なって発行された場合は、当該レディ信号に対応する前記選択制御データのセットを保留する、請求項7に記載のデータ転送装置。
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