JP4499387B2 - Solid-state imaging device - Google Patents

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Description

本発明は、例えば画素の間引き読み出しによりフレームレートを向上させ、併せて画質劣化も抑制するようにした固体撮像装置に関する。   The present invention relates to a solid-state imaging device that improves the frame rate by, for example, thinning-out readout of pixels and suppresses image quality deterioration.

従来、電子カメラ等の分野では、高速読み出し、低消費電力化の観点から、撮像前の画像表示等の際に必要十分な画素だけを読み出すことがなされている。   2. Description of the Related Art Conventionally, in the field of electronic cameras and the like, only necessary and sufficient pixels are read out during image display before imaging from the viewpoint of high-speed reading and low power consumption.

この種の技術として、例えば特許文献1では、マトリクス状に配置された複数の光電変換画素の内、走査回路によって行グループ又は列グループを選択し、選択された行グループ又は列グループの内から選択回路によって所望の行又は列を任意に選択することで、所望の行又は列の画素のみを的確に間引き読み出しすることを特徴とする電子カメラに関する技術が開示されている。
特開2000−004406号公報
As this type of technology, for example, in Patent Document 1, among a plurality of photoelectric conversion pixels arranged in a matrix, a row group or a column group is selected by a scanning circuit, and selected from the selected row group or column group. A technique related to an electronic camera is disclosed in which only a desired row or column of pixels is accurately thinned and read out by arbitrarily selecting a desired row or column by a circuit.
JP 2000-004406 A

しかしながら、特許文献1では、画素の間引き読み出しによって生じる水平方向の偽色を抑圧することについては何等記載も示唆もされていない。   However, in Patent Document 1, there is no description or suggestion about suppressing the false color in the horizontal direction caused by thinning out readout of pixels.

本発明は、上記課題に鑑みてなされたもので、その目的とするところは、画素の間引き読み出しにより高フレームレートでの読み出しを可能とし、更にそのとき水平同色所定数の画素の画素信号を平均化して出力することで、画素の間引き読み出しによって生じる水平方向の偽色を抑圧することが可能な固体撮像装置を提供することにある。   The present invention has been made in view of the above-described problems. The object of the present invention is to enable readout at a high frame rate by thinning out readout of pixels, and at that time, average the pixel signals of a predetermined number of pixels of the same horizontal color. It is an object of the present invention to provide a solid-state imaging device capable of suppressing horizontal false color caused by thinning out readout of pixels by converting the output into a pixel.

上記課題を解決するために、本発明の第1の態様に係る固体撮像装置は、少なくとも一部がベイヤー配列のカラーフィルタを備えた複数の画素が2次元に配列された固体撮像素子と、該画素の読み出しを行うための水平及び垂直走査回路とからなるXYアドレス型の固体撮像装置において、上記カラーフィルタにより規定される色位相のコーディングのうち同一の色位相にある画素の画素信号を平均化する信号平均化スイッチ部を有し、上記走査回路の制御に基づき、全画素を順次出力するモードと、1フレーム内で画素の間引き読み出しを行い且つ当該画素について上記信号平均化スイッチ部により平均化した信号を出力するモードと、を有し、全画素を順次出力するモードと平均化して出力するモードとの切り換えは、前記水平及び垂直走査回路及び前記信号平均化スイッチ部の駆動制御によって行い、前記信号平均化スイッチ部は、列毎の回路構成が均一となるように、制御信号によらず機能しない素子を含むことを特徴とする。 In order to solve the above-described problem, a solid-state imaging device according to the first aspect of the present invention includes a solid-state imaging device in which a plurality of pixels each having at least a part of a Bayer array color filter are two-dimensionally arranged; In an XY address type solid-state imaging device composed of horizontal and vertical scanning circuits for reading out pixels, pixel signals of pixels having the same color phase in the color phase coding defined by the color filter are averaged. A signal averaging switch unit that performs a mode for sequentially outputting all pixels based on the control of the scanning circuit, performs thinning-out readout of pixels within one frame, and averages the pixels by the signal averaging switch unit And a mode for outputting all the pixels in sequence and a mode for outputting after averaging all the pixels in the horizontal and vertical directions. Performed by the drive control of the査回path and said signal averaging switch unit, wherein the signal averaging switch unit, so that the circuit configuration of each column is uniform, characterized in that it comprises a device that does not function without depending on the control signal .

本発明によれば、画素の間引き読み出しにより高フレームレートでの読み出しを可能とし、更にそのとき水平同色所定数の画素の画素信号を平均化して出力することで、画素の間引き読み出しによって生じる水平方向の偽色を抑圧することが可能な固体撮像装置を提供することができる。   According to the present invention, it is possible to perform readout at a high frame rate by decimation readout of pixels, and further, by averaging and outputting pixel signals of a predetermined number of pixels of the same color in the horizontal direction, thereby generating a horizontal direction caused by decimation readout of pixels. It is possible to provide a solid-state imaging device capable of suppressing the false color.

先ず、図1には本発明の一実施の形態に係る固体撮像装置の概念図を示し、図2及び図3には図1の構成を更に具現化して示した構成図を示す。以下、これら図1乃至図3を参照して、本発明の一実施の形態に係る固体撮像装置について詳細に説明する。   First, FIG. 1 shows a conceptual diagram of a solid-state imaging device according to an embodiment of the present invention, and FIGS. 2 and 3 show configuration diagrams further embodying the configuration of FIG. Hereinafter, a solid-state imaging device according to an embodiment of the present invention will be described in detail with reference to FIGS. 1 to 3.

これらの図1乃至図3において、固体撮像素子としての画素部1は、複数の画素が2次元にマトリックス状に配列されて構成されている。より詳細には、画素部1は、黒レベルに対応した信号を出力する遮光画素部1aと、被写体光を受光して電荷を発生して画素信号を出力する有効画素部1bとで構成されている。そして、遮光画素部1aの各画素の表面は例えばアルミニウム等の遮光性の膜で被覆されており、有効画素部1bの各画素の表面にはカラーフィルタが配設されている。更に、図2及び3中に示した、P(i−4,k−3)〜P(i+3,k+4)は画素部1内に複数配列された遮光画素部1aの画素アドレスを意味しており、P(j−8,k−3)〜P(j+7,k+4)は画素部1内に複数配列された有効画素部1bの画素アドレスを意味している。   1 to 3, the pixel unit 1 as a solid-state imaging device is configured by a plurality of pixels arranged in a two-dimensional matrix. More specifically, the pixel unit 1 includes a light-shielding pixel unit 1a that outputs a signal corresponding to a black level, and an effective pixel unit 1b that receives subject light, generates charges, and outputs a pixel signal. Yes. The surface of each pixel of the light-shielding pixel portion 1a is covered with a light-shielding film such as aluminum, and a color filter is disposed on the surface of each pixel of the effective pixel portion 1b. Further, P (i−4, k−3) to P (i + 3, k + 4) shown in FIGS. 2 and 3 mean pixel addresses of a plurality of light-shielding pixel portions 1 a arranged in the pixel portion 1. , P (j−8, k−3) to P (j + 7, k + 4) mean pixel addresses of a plurality of effective pixel portions 1 b arranged in the pixel portion 1.

更に、図2,3中に示した「R」は有効画素のうち赤色の光に対して感度のある画素(以下、R画素という)、「G」は有効画素のうち緑色の光に対して感度のある画素(以下、G画素という)、「B」は有効画素のうち青色の光に対して感度のある画素(以下、B画素という)、をそれぞれ意味している。これらR画素、G画素、B画素は、G画素が市松状に配置され、残されたその他の部分にR画素及びB画素が線順次に配置(ベイヤー配列)されている。「OB」は遮光画素である。   Further, “R” shown in FIGS. 2 and 3 is a pixel that is sensitive to red light among the effective pixels (hereinafter referred to as “R pixel”), and “G” is green light among the effective pixels. Sensitive pixels (hereinafter referred to as G pixels), and “B” mean pixels that are sensitive to blue light (hereinafter referred to as B pixels) among the effective pixels. Of these R, G, and B pixels, the G pixels are arranged in a checkered pattern, and the R pixels and the B pixels are arranged in a line sequential manner (Bayer arrangement) in the remaining portions. “OB” is a light-shielded pixel.

垂直走査回路20は、行選択信号により垂直信号線を順次走査して、遮光画素部1aと有効画素部1bからの画素信号を順次に読み出すものである。そして、この垂直走査回路20は、n(nは自然数)個の垂直走査回路ユニットからなる。図2中に示した符号20−(k−3)〜20−(k+4)は、n個の垂直走査回路ユニットのうちk(kは自然数)番目近傍の垂直走査回路ユニットを示している。   The vertical scanning circuit 20 sequentially scans the vertical signal lines according to the row selection signal, and sequentially reads out the pixel signals from the light-shielding pixel portion 1a and the effective pixel portion 1b. The vertical scanning circuit 20 includes n (n is a natural number) vertical scanning circuit units. Reference numerals 20- (k-3) to 20- (k + 4) shown in FIG. 2 indicate k (k is a natural number) vertical scanning circuit units in the n vertical scanning circuit units.

信号転送スイッチ部14は、信号転送クロックCKTにより駆動制御される。より詳細に説明すると、信号転送スイッチ部14を構成する信号転送スイッチ14−(i−4)〜14−(i+3)及び14−(j−8)〜14−(j+7)は、前述した垂直走査回路20により選択された行の画素信号を、後段の容量素子13−(i−4)〜13−(i+3)及び13−(j−8)〜13−(j+7)に転送する。   The signal transfer switch unit 14 is driven and controlled by a signal transfer clock CKT. More specifically, the signal transfer switches 14- (i-4) to 14- (i + 3) and 14- (j-8) to 14- (j + 7) constituting the signal transfer switch unit 14 are the vertical scanning described above. The pixel signals in the row selected by the circuit 20 are transferred to the subsequent capacitive elements 13- (i-4) to 13- (i + 3) and 13- (j-8) to 13- (j + 7).

ラインメモリ部13は、m(mは自然数)個の容量素子からなり、画素一行分の信号を一時的に記憶する。図2,3中に示した符号13−(i−4)〜13−(i+3)及び13−(j−8)〜13−(j+7)は、m個の容量素子のうちi(iは自然数)個目近傍及びj(jは自然数)個目近傍の容量素子を示している。   The line memory unit 13 includes m (m is a natural number) capacitive elements, and temporarily stores a signal for one row of pixels. Reference numerals 13- (i-4) to 13- (i + 3) and 13- (j-8) to 13- (j + 7) shown in FIGS. 2 and 3 denote i (i is a natural number) among m capacitive elements. ) Capacitance elements in the vicinity of the individual and j (j is a natural number).

信号平均化スイッチ部12は、ラインメモリ部13に記憶された信号を平均化する為のスイッチであり、ラインメモリ部13に記憶された遮光画素の信号を平均化する為の遮光画素信号平均化スイッチ部12aと、ラインメモリ部13に記憶された有効画素の信号を平均化する為の有効画素信号平均化スイッチ部12bに大別される。   The signal averaging switch unit 12 is a switch for averaging the signal stored in the line memory unit 13 and averages the light-shielded pixel signal for averaging the signal of the light-shielded pixel stored in the line memory unit 13. It is roughly divided into a switch unit 12a and an effective pixel signal averaging switch unit 12b for averaging the effective pixel signals stored in the line memory unit 13.

遮光画素信号平均化スイッチ部12aは、一列おきに配置され、クロックCKAVE1が“H”レベルになると、所定数(ここでは3列分)の遮光画素信号が平均化される。例えば、遮光画素信号平均化スイッチ12−(i−1)及び12−(i+1)はクロックCKAVE1が“H”レベルになると、容量素子13−(i−1),13−(i+1)及び13−(i+3)を電気的に接続するように動作する。また、例えば、遮光画素信号平均化スイッチ12−(i−3)及び12−(i+3)等は、列毎の回路構成、即ちレイアウトが均一になるように設けたもので、クロックCKAVE1が“H”レベルになってもスイッチとして機能しないように接続されている。このような接続により有効画素信号平均化スイッチ部12bにおける接続形態と同一としている。   The light-shielded pixel signal averaging switch units 12a are arranged every other column, and when the clock CKAVE1 is set to the “H” level, a predetermined number (here, three columns) of light-shielded pixel signals are averaged. For example, the light shielding pixel signal averaging switches 12- (i-1) and 12- (i + 1) are connected to the capacitive elements 13- (i-1), 13- (i + 1) and 13- when the clock CKAVE1 becomes "H" level. It operates to electrically connect (i + 3). Further, for example, the light-shielded pixel signal averaging switches 12- (i-3) and 12- (i + 3) are provided so that the circuit configuration for each column, that is, the layout is uniform, and the clock CKAVE1 is “H”. "It is connected so that it does not function as a switch even if it reaches the level." With this connection, the connection form in the effective pixel signal averaging switch unit 12b is the same.

一方、有効画素信号平均化スイッチ部12bは、R画素、G画素及びB画素の各信号同士が所定数の画素単位(ここでは3画素分)で平均化されるように構成され、クロックCKAVE2によって制御されるように接続されている。   On the other hand, the effective pixel signal averaging switch unit 12b is configured so that the signals of the R pixel, the G pixel, and the B pixel are averaged in a predetermined number of pixel units (here, three pixels), and the clock CKAVE2 Connected to be controlled.

このように、この実施の形態では、画素信号平均化スイッチ部12は、遮光画素信号平均化スイッチ部12aによりラインメモリ部13に記憶された信号のうち遮光画素の信号についてはクロックCKAVE1により3画素分の信号平均化が制御され、有効画素信号平均化スイッチ部12bにより有効画素の信号についてはクロックCKAVE2により同色3画素分の信号平均化が制御されるように構成されている。   As described above, in this embodiment, the pixel signal averaging switch unit 12 has three pixels for the signal of the light-shielded pixel among the signals stored in the line memory unit 13 by the light-shielded pixel signal averaging switch unit 12a by the clock CKAVE1. Signal averaging is controlled, and the effective pixel signal averaging switch unit 12b controls the signal averaging of three pixels of the same color by the clock CKAVE2.

水平走査回路10は、水平選択スイッチ部11を順次に駆動するためのものであり、m個の水平走査回路ユニットから構成される。即ち、符号10−(i−4)〜10−(i+3)及び10−(j−8)〜10−(j+7)は、m個の水平走査回路ユニットのうちi個目近傍及びj個目近傍の水平走査回路ユニットを示している。   The horizontal scanning circuit 10 is for sequentially driving the horizontal selection switch unit 11, and is composed of m horizontal scanning circuit units. That is, reference numerals 10- (i-4) to 10- (i + 3) and 10- (j-8) to 10- (j + 7) denote the i-th neighborhood and the j-th neighborhood among the m horizontal scanning circuit units. The horizontal scanning circuit unit is shown.

水平選択スイッチ部11は、水平走査回路部10の出力(水平選択信号)により制御されるもので、m個の水平選択スイッチからなる。図2,3中の符号11−(i−4)〜11−(i+3)及び11−(j−8)〜11−(j+7)は、m個の水平選択スイッチのうちi個目近傍及びj個目近傍の水平選択スイッチを示している。そして、この水平選択スイッチ部11では、各水平選択スイッチが水平選択信号によりオン状態になると、ラインメモリ部13に記憶された画素信号が水平信号線に伝達され、更には後段の出力アンプ30により増幅されて外部に出力されることになる。   The horizontal selection switch unit 11 is controlled by the output (horizontal selection signal) of the horizontal scanning circuit unit 10 and includes m horizontal selection switches. Reference numerals 11- (i-4) to 11- (i + 3) and 11- (j-8) to 11- (j + 7) in FIGS. 2 and 3 denote the i-th neighborhood and j of the m horizontal selection switches. The horizontal selection switch near the individual is shown. In the horizontal selection switch unit 11, when each horizontal selection switch is turned on by a horizontal selection signal, the pixel signal stored in the line memory unit 13 is transmitted to the horizontal signal line, and further, the output amplifier 30 in the subsequent stage. Amplified and output to the outside.

以上の構成において、本実施の形態は、ベイヤー配列のカラーフィルタを備えた画素部1を有する固体撮像装置であって、1フレーム内で画素の間引き読み出しを行い、且つ当該画素について上記カラーフィルタにより規定される色位相コーディングのうち同一色位相にある画素の画素信号を平均化して出力することを特徴とする。   In the above configuration, the present embodiment is a solid-state imaging device having the pixel unit 1 including a color filter with a Bayer array, performs pixel thinning-out readout within one frame, and the pixel is subjected to the color filter. The pixel signals of pixels having the same color phase in the specified color phase coding are averaged and output.

より詳細には、少なくとも一部がベイヤー配列のカラーフィルタを備えた複数の画素が2次元に配列された画素部1と、該画素の画素信号の読み出しを行うための水平走査回路10及び垂直走査回路20とからなるXYアドレス型の固体撮像装置において、上記カラーフィルタにより規定される色位相のコーディングのうち同一の色位相にある画素の画素信号を平均化する信号平均化スイッチ部12を有し、上記走査回路10,20の制御に基づき1フレーム内で画素の間引き読み出しを行い、且つ当該画素について上記信号平均化スイッチ部12により平均化した信号を出力することを特徴とする。   More specifically, a pixel unit 1 in which a plurality of pixels each having at least a part of a Bayer color filter are two-dimensionally arranged, a horizontal scanning circuit 10 for reading out pixel signals of the pixels, and vertical scanning An XY address type solid-state imaging device including a circuit 20 includes a signal averaging switch unit 12 that averages pixel signals of pixels in the same color phase among color phase codings defined by the color filter. Based on the control of the scanning circuits 10 and 20, the pixels are thinned and read out within one frame, and the signal averaged by the signal averaging switch unit 12 is output for the pixels.

さらに、上記画素部1は、遮光画素部1aと有効画素部1bからなり、信号平均化スイッチ部12は、更に当該遮光画素部1aの画素に係る信号のうち所定画素分の信号も平均化する。このとき、上記遮光画素部1aの画素に係る信号については1フレーム内で順次に読み出しを行う。そして、信号平均化スイッチ部12は、遮光画素信号平均化スイッチ部12aと有効画素信号平均化スイッチ部12bからなり、第1の信号(CKAVE1)により当該遮光画素信号平均化スイッチ部12aによる遮光画素に係る信号の平均化の可否を制御し、第2の信号(CKAVE2)により当該有効画素信号平均化スイッチ部12bによる上記カラーフィルタにより規定される色位相のコーディングのうち同一の色位相にある画素の画素信号を平均化の可否を制御する。   Further, the pixel unit 1 includes a light-shielding pixel unit 1a and an effective pixel unit 1b, and the signal averaging switch unit 12 further averages a signal for a predetermined pixel among signals related to the pixels of the light-shielding pixel unit 1a. . At this time, signals related to the pixels of the light-shielding pixel portion 1a are sequentially read out within one frame. The signal averaging switch unit 12 includes a light-shielded pixel signal averaging switch unit 12a and an effective pixel signal averaging switch unit 12b, and a light-shielded pixel formed by the light-shielded pixel signal averaging switch unit 12a by a first signal (CKAVE1). The pixels having the same color phase among the coding of the color phase defined by the color filter by the effective pixel signal averaging switch unit 12b by the second signal (CKAVE2) The pixel signal is controlled to be averaged.

以下、図4及び図5のタイミングチャートを参照して、前述したように構成した固体撮像装置の動作を更に詳細に説明する。尚、図4中に符号a乃至pで示したタイミングは図5中に同符号で示したタイミングにそれぞれ対応している。   Hereinafter, the operation of the solid-state imaging device configured as described above will be described in more detail with reference to the timing charts of FIGS. 4 and 5. Note that the timings indicated by symbols a to p in FIG. 4 correspond to the timings indicated by the same symbols in FIG.

この図4及び図5において、「VD」は垂直同期信号、「HD」は水平同期信号、「CKAVE1」は遮光画素信号平均化スイッチ部12aのオン/オフを制御するクロック、「CKAVE2」は有効画素信号平均化スイッチ部12bのオン/オフを制御するクロック、「CKT」は信号転送スイッチ部14のオン/オフを制御するクロックである。   4 and 5, “VD” is a vertical synchronizing signal, “HD” is a horizontal synchronizing signal, “CKAVE1” is a clock for controlling on / off of the shading pixel signal averaging switch unit 12a, and “CKAVE2” is effective. A clock for controlling on / off of the pixel signal averaging switch section 12b, and “CKT” is a clock for controlling on / off of the signal transfer switch section 14.

「V−1」〜「V−n」は行選択信号であり、垂直走査回路ユニット20−1〜20−nの出力である。「H−1」〜「H−m」は水平選択スイッチ11−1〜11−mを制御する水平選択信号であり、水平走査回路ユニット10−1〜10−mの出力信号である。以上のほか、「信号出力」とは出力アンプ30から出力される画素信号である。   “V-1” to “Vn” are row selection signals and are outputs of the vertical scanning circuit units 20-1 to 20-n. “H-1” to “Hm” are horizontal selection signals for controlling the horizontal selection switches 11-1 to 11-m, and are output signals of the horizontal scanning circuit units 10-1 to 10-m. In addition to the above, “signal output” is a pixel signal output from the output amplifier 30.

さて、この動作に入ると、垂直走査回路20は、例えば20−1…20−(k−3)、20−k、20−(k+3)、…20−nのように、垂直走査回路ユニット20−1〜20−nの配列方向に2行分スキップした走査、即ち垂直1/3間引き走査を行う。   When entering this operation, the vertical scanning circuit 20 is, for example, 20-1... 20- (k-3), 20-k, 20- (k + 3),. Scanning skipped by two lines in the arrangement direction of −1 to 20-n, that is, vertical 1/3 thinning scanning is performed.

即ち、水平ブランキング期間(水平同期信号HDが“L”レベルの期間)内で垂直走査回路20より出力される行選択信号V−(k−3)が“H”レベルとなると、(k−3)行目の画素P(1,k−3)〜P(m,k−3)が選択される。   That is, when the row selection signal V− (k−3) output from the vertical scanning circuit 20 becomes “H” level within the horizontal blanking period (period in which the horizontal synchronization signal HD is “L” level), (k− 3) Pixels P (1, k-3) to P (m, k-3) in the row are selected.

この間、信号転送スイッチ部14に入力される信号転送クロックCKTが“H”レベルであるため、選択された画素P(1,k−3)〜P(m,k−3)の画素信号は、容量素子13−1〜13−mに記憶される。その後、画素信号平均化スイッチ部12に入力されるクロックCKAVE1及びCKAVE2が“H”レベルであるため一列おきの3画素分の信号が平均化され、ラインメモリ部13に記憶される。   During this time, since the signal transfer clock CKT input to the signal transfer switch unit 14 is at the “H” level, the pixel signals of the selected pixels P (1, k−3) to P (m, k−3) are It memorize | stores in the capacitive elements 13-1 to 13-m. Thereafter, since the clocks CKAVE 1 and CKAVE 2 input to the pixel signal averaging switch unit 12 are at the “H” level, signals for every other three pixels are averaged and stored in the line memory unit 13.

即ち、例えば容量素子13−(i−4),13−(i−2),13−iに記憶された信号の平均が遮光画素3画素分の平均信号として、例えば容量素子13−(j−1),メモリ13−(j+1),13−(j+3)に記憶された信号の平均が有効画素3画素分の平均信号として、それぞれラインメモリ部13に記憶される。このような動作により、ベイヤー配列されたR画素及びG画素の水平同色3画素平均化が行われる。   That is, for example, an average of signals stored in the capacitive elements 13- (i-4), 13- (i-2), and 13-i is an average signal for three light-shielded pixels, for example, the capacitive element 13- (j- 1), averages of signals stored in the memories 13- (j + 1) and 13- (j + 3) are respectively stored in the line memory unit 13 as average signals for three effective pixels. By such an operation, horizontal three-pixel averaging of R pixels and G pixels arranged in a Bayer array is performed.

その後、水平有効期間(水平同期信号HDが“H”レベルの期間)内で水平走査回路ユニット10−1〜10−mに向かって走査・選択信号を出力するときに、遮光画素信号を選択する場合は、順番に1ユニットずつ水平選択信号が出力されるように順次走査(H−1、…H−(i−4)、H−(i−3)、H−(i−2)、H−(i−1)、H−i、H−(i+1)、H−(i+2)、H−(i+3)、H−(i+4)、…)させる。   Thereafter, when the scanning / selection signal is output toward the horizontal scanning circuit units 10-1 to 10-m within the horizontal effective period (period in which the horizontal synchronization signal HD is at "H" level), the light-shielded pixel signal is selected. In this case, sequential scanning (H-1,... H- (i-4), H- (i-3), H- (i-2), H is performed so that the horizontal selection signal is output one unit at a time. − (I−1), H−i, H− (i + 1), H− (i + 2), H− (i + 3), H− (i + 4),.

一方、有効画素信号を選択する場合は、3ユニット中の1ユニットから水平選択信号が出力されるように走査、即ち1/3間引き走査(…H−(j−8)、H−(j−5)、H−(j−2)、H−(j+1)、H−(j+4)、H−(j+7)、…)させる。   On the other hand, when an effective pixel signal is selected, scanning is performed so that a horizontal selection signal is output from one of the three units, that is, 1/3 thinning scanning (... H- (j-8), H- (j- 5), H− (j−2), H− (j + 1), H− (j + 4), H− (j + 7),.

このようにして水平走査が行われると、ラインメモリ部13に記憶されていた遮光画素3画素平均信号及び有効画素3画素平均信号は、水平選択スイッチ部11を介して水平信号線に伝達され、更に後段の出力アンプ30で増幅されて信号出力となる。   When horizontal scanning is performed in this manner, the light-shielded pixel three-pixel average signal and the effective pixel three-pixel average signal stored in the line memory unit 13 are transmitted to the horizontal signal line via the horizontal selection switch unit 11, Further, it is amplified by the output amplifier 30 at the subsequent stage and becomes a signal output.

このとき、遮光画素3画素平均信号は順次出力され、有効画素3画素平均信号は信号数が1/3に間引かれて出力される。こうして1行分の画素信号が3画素平均され、遮光画素数分の信号及び有効画素数の1/3の信号が出力される。   At this time, the light-shielded pixel three-pixel average signal is sequentially output, and the effective pixel three-pixel average signal is output with the number of signals reduced to 1/3. In this way, the pixel signals for one row are averaged over three pixels, and a signal corresponding to the number of light-shielded pixels and a signal corresponding to 1/3 of the number of effective pixels are output.

次の水平ブランキング期間では、垂直走査回路20が1/3間引き走査するので、垂直走査回路20からの行選択信号V−kが“H”レベルとなる。この垂直ブランキング期間内で行選択信号V−kが“H”レベルとなると、k行目の画素P(1,k)〜P(m,k)が選択される。この間、信号転送スイッチ部14に入力される信号転送クロックCKTが“H”レベルであるため、選択された画素P(1,k)〜P(m,k)の画素信号は、ラインメモリ部13の容量素子13−1〜13−mに記憶される。   In the next horizontal blanking period, the vertical scanning circuit 20 performs 1/3 thinning scanning, so that the row selection signal Vk from the vertical scanning circuit 20 is at the “H” level. When the row selection signal Vk becomes “H” level within this vertical blanking period, the pixels P (1, k) to P (m, k) in the k-th row are selected. During this time, since the signal transfer clock CKT input to the signal transfer switch unit 14 is at “H” level, the pixel signals of the selected pixels P (1, k) to P (m, k) are stored in the line memory unit 13. Are stored in the capacitive elements 13-1 to 13-m.

その後、信号平均化スイッチ部12に入力されるクロックCKAVE1及びCKAVE2が“H”レベルである為、一列おきの3画素分の信号が平均化され、遮光画素3画素平均信号及び有効画素3画素平均信号がそれぞれラインメモリ13に記憶される。   After that, since the clocks CKAVE1 and CKAVE2 input to the signal averaging switch unit 12 are at the “H” level, the signals for every other three pixels are averaged, and the light-shielded pixel three-pixel average signal and the effective pixel three-pixel average Each signal is stored in the line memory 13.

以上の動作により、ベイヤー配列されたG画素及びB画素の水平同色3画素平均が行われる。その後、水平有効期間内で水平走査回路ユニット10−1〜10−mに向けて走査・選択信号を出力するときに、遮光画素信号を選択する場合は順番に1ユニットずつ水平選択信号が出力されるように順次走査(H−1、…H−(i−4)、H−(i−3)、H−(i−2)、H−(i−1)、H−i、H−(i+1)、H−(i+2)、H−(i+3)、H−(i+4)、…)させ、有効画素信号を選択する場合は3ユニット中の1ユニットから水平選択信号が出力されるように1/3間引き走査(…H−(j−8)、H−(j−5)、H−(j−2)、H−(j+1)、H−(j+4)、H−(j+7)、…)させる。   With the above operation, the average of three pixels in the same color of the G pixels and B pixels arranged in the Bayer array is performed. Thereafter, when the scanning / selection signal is output toward the horizontal scanning circuit units 10-1 to 10-m within the horizontal effective period, the horizontal selection signal is output one unit at a time in order to select the light-shielded pixel signal. Sequential scanning (H-1,... H- (i-4), H- (i-3), H- (i-2), H- (i-1), Hi, H- ( i + 1), H− (i + 2), H− (i + 3), H− (i + 4),...), and when selecting an effective pixel signal, 1 so that a horizontal selection signal is output from one of the three units. / 3 thinning scan (... H- (j-8), H- (j-5), H- (j-2), H- (j + 1), H- (j + 4), H- (j + 7), ...) Let

このようにして水平走査が行われると、ラインメモリ部13に記憶されていた遮光画素3画素平均信号及び有効画素3画素平均信号は、水平選択スイッチ部11を介して水平信号線に伝達され、さらに出力アンプで増幅されて信号出力となる。   When horizontal scanning is performed in this manner, the light-shielded pixel three-pixel average signal and the effective pixel three-pixel average signal stored in the line memory unit 13 are transmitted to the horizontal signal line via the horizontal selection switch unit 11, Further, it is amplified by an output amplifier to become a signal output.

このとき遮光画素3画素平均信号は順次出力され、有効画素3画素平均信号は信号数が1/3間引かれて出力される。このようにして、1行分の画素信号が3画素平均され、遮光画素数分の信号及び有効画素数の1/3の信号が出力される。   At this time, the light-shielding pixel three-pixel average signal is sequentially output, and the effective pixel three-pixel average signal is output with the number of signals reduced by 1/3. In this way, the pixel signals for one row are averaged over three pixels, and a signal corresponding to the number of light-shielded pixels and a signal that is 1/3 of the number of effective pixels are output.

以降、同様に垂直ブランキング期間中に(k+3)行目からn行目までの画素が2行飛びに選択され、水平有効期間中に行ごとの画素信号が出力される。   Thereafter, similarly, the pixels from the (k + 3) -th row to the n-th row are selected skipping two rows during the vertical blanking period, and the pixel signal for each row is output during the horizontal effective period.

以上の読み出し動作により、垂直1/3間引き読み出し、かつ遮光画素3画素分の平均信号の水平順次読み出し及び有効画素の同色3画素分の平均信号の水平1/3間引き読み出し動作が行われる。このように動作させることで、読み出し有効画素数が水平・垂直1/3に圧縮されるので、高フレームレートでの読み出しが可能となる。   With the above readout operation, the vertical 1/3 thinning readout, the horizontal sequential readout of the average signal for the three light-shielded pixels, and the horizontal 1/3 thinning readout operation of the average signal for the three pixels of the same color of the effective pixels are performed. By operating in this way, the number of effective readout pixels is compressed to horizontal and vertical 1/3, so that readout at a high frame rate is possible.

このとき、水平同色3画素の信号が平均化されて出力されるので、間引き読み出しすることによって生じる水平方向の偽色を抑圧することができる。また、垂直方向に対しての平均化を行う場合と比較して大幅に回路規模を削減することができる。さらに、遮光画素を読み出す場合は順次読み出しを行うので遮光画素信号レベルにクランプするときの期間を順次読み出しの場合と同じだけ確保することができる。   At this time, since the signals of three pixels of the same color in the horizontal direction are averaged and output, the false color in the horizontal direction caused by thinning out reading can be suppressed. In addition, the circuit scale can be greatly reduced as compared with the case of averaging in the vertical direction. Further, when reading out the light-shielded pixels, the readout is performed sequentially, so that the same period as when sequentially clamping the light-shielded pixel signal level can be ensured.

次に、図6の概念図を参照して、上述した実施の形態に係る固体撮像装置を適用したカメラについて詳細に説明する。   Next, a camera to which the solid-state imaging device according to the above-described embodiment is applied will be described in detail with reference to the conceptual diagram of FIG.

この図6に示されるように、撮影レンズ50を介して入射した被写体光の光路上には固体撮像装置51が配設されている。そして、この固体撮像装置51の出力は直流再生部(CDS)56の入力に接続されており、更に当該直流再生部56の出力はスイッチ部を介してコントラストAF検出部57、画像処理部58の入力に接続されている。   As shown in FIG. 6, a solid-state imaging device 51 is disposed on the optical path of subject light incident through the photographing lens 50. The output of the solid-state imaging device 51 is connected to the input of a direct current reproducing unit (CDS) 56, and the output of the direct current reproducing unit 56 is supplied to the contrast AF detection unit 57 and the image processing unit 58 via a switch unit. Connected to the input.

このコントラストAF検出部57の検出結果に基づいて撮影レンズ50に概念上含まれるズームレンズが駆動制御される。画像処理部58の出力は、LCD等の表示部60、メディア記録部61の入力に接続されている。クロック信号を発生する同期タイミング発生部55の出力は、直流再生部56、走査制御部54の入力に接続されている。この走査制御部54には、各種モードを設定する為のモード切換部59も接続されている。   Based on the detection result of the contrast AF detection unit 57, the zoom lens conceptually included in the photographing lens 50 is driven and controlled. An output of the image processing unit 58 is connected to an input of a display unit 60 such as an LCD and a media recording unit 61. The output of the synchronization timing generator 55 that generates the clock signal is connected to the inputs of the DC regenerator 56 and the scan controller 54. The scanning control unit 54 is also connected with a mode switching unit 59 for setting various modes.

このような構成において、撮影レンズ50を介して入射された被写体光は、固体撮像装置1の固体撮像素子に撮像され、画素信号が出力される。   In such a configuration, the subject light incident through the photographing lens 50 is imaged by the solid-state imaging device of the solid-state imaging device 1 and a pixel signal is output.

このとき、モード切換部59で設定された各種モードに基づいて走査制御部54が制御され、前述した間引き走査等を実施するように垂直シフトレジスタ制御信号及び水平シフトレジスタ制御信号が固体撮像装置1内の水平走査回路53、垂直走査回路52に出力される。この制御信号に基づいて、前述したような駆動がなされ、画素を間引きながらの読み出しが行われることになる。   At this time, the scanning control unit 54 is controlled based on various modes set by the mode switching unit 59, and the vertical shift register control signal and the horizontal shift register control signal are sent to the solid-state imaging device 1 so as to perform the above-described thinning scanning and the like. Are output to the horizontal scanning circuit 53 and the vertical scanning circuit 52. Based on this control signal, driving as described above is performed, and readout is performed while thinning out pixels.

画素信号は、直流再生部56にて相関二重サンプリングされ、更にA/D変換されてデジタル画像信号とされ、スイッチ部の切替状態に応じてコントラストAF検出部57又は画像処理部58に送られる。コントラストAF検出部57では、デジタル画像信号に基づく被写体距離の検出がなされる。一方で、画像処理部58では、例えば色信号生成処理、マトリックス変換処理、その他の各種画像処理がなされ、表示部60又はメディア記録部61に出力される。この表示部60では、デジタル画像信号に基づいて各種表示がなされることになる。一方、メディア記録部61は、例えばカードインターフェース及びメモリカード等からなり、デジタル画像信号が記録されることになる。   The pixel signal is correlated double-sampled by the DC reproducing unit 56, further A / D converted into a digital image signal, and sent to the contrast AF detecting unit 57 or the image processing unit 58 according to the switching state of the switch unit. . The contrast AF detection unit 57 detects the subject distance based on the digital image signal. On the other hand, in the image processing unit 58, for example, color signal generation processing, matrix conversion processing, and other various image processing are performed and output to the display unit 60 or the media recording unit 61. In the display unit 60, various displays are performed based on the digital image signal. On the other hand, the media recording unit 61 includes, for example, a card interface and a memory card, and records a digital image signal.

この適用例としてのカメラでは、その内部の固体撮像装置で、1/3間引き走査による読み出しを行うことによって、フレームレートを向上させ、高速なエリア読み出しが可能となり、その結果、各種モード(AF、表示、記録等)に応じた好適な読み出し方法を選択することができることになる。即ち、間引き走査は短いフレームレートで連続的な表示を表示部60で行う場合に好適であるが、上記モード切換部59の設定に基づいて走査制御部54が垂直シフトレジスタ制御信号、水平シフトレジスタ制御信号の出力タイミングを制御することで、簡易に実現されることになる。   In the camera as this application example, reading by 1/3 thinning scanning is performed by a solid-state imaging device inside the camera, thereby improving the frame rate and enabling high-speed area reading. As a result, various modes (AF, A suitable reading method according to display, recording, etc. can be selected. In other words, thinning scanning is suitable when continuous display is performed on the display unit 60 at a short frame rate, but based on the setting of the mode switching unit 59, the scanning control unit 54 uses the vertical shift register control signal and the horizontal shift register. This is easily realized by controlling the output timing of the control signal.

以上、本発明の一実施の形態について説明したが、本発明はこれに限定されることなく、その趣旨を逸脱しない範囲で種々の改良・変更が可能であることは勿論である。   Although one embodiment of the present invention has been described above, the present invention is not limited to this, and it is needless to say that various improvements and modifications can be made without departing from the spirit of the present invention.

即ち、例えば、図1乃至3に示した回路構成はこれに限定されるものではなく、読出し回路に画素のFPNをキャンセルするための機能をもたせること等が可能である。   That is, for example, the circuit configuration illustrated in FIGS. 1 to 3 is not limited to this, and the readout circuit can have a function for canceling the FPN of the pixel.

また、実施の形態では、水平3画素平均を可能にするための構成を示したが、信号平均化スイッチの繰返し周期を変更することで、水平5画素平均或いは水平7画素平均等が行えるように構成することも可能であり、複数の平均化動作を選択的に行えるように構成することも可能である。また、前述した実施の形態では、信号出力は一線で行うように構成したが、多線出力できるように構成することも可能であることは勿論である。   In the embodiment, the configuration for enabling horizontal three-pixel averaging is shown. However, by changing the repetition cycle of the signal averaging switch, horizontal five-pixel average or horizontal seven-pixel average can be performed. It is also possible to configure such that a plurality of averaging operations can be selectively performed. Further, in the above-described embodiment, the signal output is configured to be performed by one line, but it is needless to say that the signal output can be configured to be able to output multiple lines.

また、図4及び5のタイミングチャートにおいて、CKAVE1を“L”レベルにしておくことで遮光画素信号を平均化せずに読み出すこともできるし、CKAVE2を“L”レベルにしておくことで有効画素部を平均化せずに読み出すこともできる。   In the timing charts of FIGS. 4 and 5, the light-shielded pixel signal can be read out without averaging by setting CKAVE1 to “L” level, and the effective pixel can be read by setting CKAVE2 to “L” level. It is also possible to read out the parts without averaging.

また、本発明の上記実施の形態では、水平走査回路及び垂直走査回路を1/3間引き走査が行えるような動作につき説明したが、このような動作を行うためにはデコーダ回路を使用したものや、走査回路にシフトレジスタを用いたものとしては、例えば特開平9−163245号公報に記載した間引き走査の方法で実現することができ、順次走査を行うことで全画素を順次読み出しすることが可能であることは勿論である。   In the above-described embodiment of the present invention, the operation for performing the 1/3 decimation scanning in the horizontal scanning circuit and the vertical scanning circuit has been described, but in order to perform such an operation, a decoder circuit is used. The use of a shift register in the scanning circuit can be realized, for example, by the thinning scanning method described in JP-A-9-163245, and all pixels can be read out sequentially by performing sequential scanning. Of course.

ここで、図7には、順次走査及びスキップ走査を行う為の走査回路に用いるシフトレジスタの構成例を示し説明する。この図7において、1段分のシフトレジスタユニット300は、サブユニット101及び102からなる第1のシフトレジスタユニット100と第2のシフトレジスタユニット200とで構成されている。この第1及び第2のシフトレジスタユニット100及び200の入力端は共通に接続されている。また、第1のシフトレジスタユニット100の出力端は、次段のシフトレジスタユニットの入力端に接続されており、第2のシフトレジスタユニット200の出力端は、2段後ろのサブユニット102の入力端に接続されている。そして、第1のシフトレジスタユニットのサブユニット101,102は、それぞれ駆動パルスφ1−1,φ1−2により駆動され、第2のシフトレジスタユニット200は、駆動パルスφ2により駆動される。   Here, FIG. 7 shows a configuration example of a shift register used in a scanning circuit for performing sequential scanning and skip scanning. In FIG. 7, the shift register unit 300 for one stage is composed of a first shift register unit 100 and a second shift register unit 200 including subunits 101 and 102. The input ends of the first and second shift register units 100 and 200 are connected in common. The output terminal of the first shift register unit 100 is connected to the input terminal of the next-stage shift register unit, and the output terminal of the second shift register unit 200 is the input of the subunit 102 that is two stages behind. Connected to the end. The subunits 101 and 102 of the first shift register unit are driven by drive pulses φ1-1 and φ1-2, respectively, and the second shift register unit 200 is driven by a drive pulse φ2.

このような構成のシフトレジスタにおいて、駆動パルスφ1−1とφ1−2に駆動信号を与え、駆動パルスφ2は、第2のシフトレジスタユニット200が非動作となるような状態として、シフトレジスタのスタートパルスφSTを入力すると、入力信号は図8に一点鎖線で示したようにシフトレジスタ内をシフトしていくので、シフトレジスタからはSRout1,SRout2,SRout3,…という順番で信号が出力され、順次走査が行える。   In the shift register having such a configuration, a drive signal is given to the drive pulses φ1-1 and φ1-2, and the drive pulse φ2 is set in a state in which the second shift register unit 200 is not operated, so that the shift register starts. When the pulse φST is input, the input signal shifts in the shift register as shown by the one-dot chain line in FIG. 8, so signals are output from the shift register in the order of SRout1, SRout2, SRout3,. Can be done.

一方、このシフトレジスタにおいて、駆動パルスφ1−2とφ2に駆動信号を与え、駆動パルスφ1−1は、サブユニット101が非動作となるような状態として、シフトレジスタのスタートパルスφSTを入力すると、入力信号は図9に一点鎖線で示したようにシフトレジスタ内をシフトしていくので、シフトレジスタからは、Srout3,Srout6,…という順番で信号が出力されので、1/3間引き走査が行える。   On the other hand, in this shift register, a drive signal is given to the drive pulses φ1-2 and φ2, and the drive pulse φ1-1 is set in a state in which the subunit 101 is inoperative. Since the input signal is shifted in the shift register as indicated by the one-dot chain line in FIG. 9, the signals are output from the shift register in the order of Srout3, Srout6,...

以上のように、図7のような構成のシフトレジスタを走査回路に用い、駆動パルスを制御することで、順次走査及びスキップ走査の切換えが可能となる。尚、順次走査及びスキップ走査の切換えは駆動パルスの制御で行えるので、走査の途中で駆動パルスを変えることで走査の途中で順次走査と間引き走査の切換えが可能となり、遮光画素領域は順次走査を行い、有効画素領域は間引き走査を行うといった走査も可能である。   As described above, by using the shift register configured as shown in FIG. 7 in the scanning circuit and controlling the driving pulse, it is possible to switch between the sequential scanning and the skip scanning. Since switching between sequential scanning and skip scanning can be performed by controlling the driving pulse, changing the driving pulse in the middle of scanning enables switching between sequential scanning and thinning scanning in the middle of scanning. The effective pixel region can also be scanned such that thinning scanning is performed.

本発明の実施の形態に係る固体撮像装置の概念図。1 is a conceptual diagram of a solid-state imaging device according to an embodiment of the present invention. 図1の構成の一部を更に具現化して示した構成図。FIG. 2 is a configuration diagram further illustrating a part of the configuration of FIG. 1. 図1の構成の一部を更に具現化して示した構成図。FIG. 2 is a configuration diagram further illustrating a part of the configuration of FIG. 1. 本発明の実施の形態に係る固体撮像装置の動作を示すタイミングチャート。4 is a timing chart showing the operation of the solid-state imaging device according to the embodiment of the present invention. 本発明の実施の形態に係る固体撮像装置の動作を示すタイミングチャート。4 is a timing chart showing the operation of the solid-state imaging device according to the embodiment of the present invention. 本発明の実施の形態に係る固体撮像装置を適用したカメラの構成図。1 is a configuration diagram of a camera to which a solid-state imaging device according to an embodiment of the present invention is applied. 本発明の実施の形態に係る固体撮像装置に、順次走査及びスキップ走査を行う為の走査回路として適用可能なシフトレジスタの構成例を示す図。FIG. 6 is a diagram showing a configuration example of a shift register that can be applied as a scanning circuit for performing sequential scanning and skip scanning in the solid-state imaging device according to the embodiment of the present invention. 図7の構成による順次走査を説明する概念図。FIG. 8 is a conceptual diagram illustrating sequential scanning with the configuration of FIG. 7. 図7の構成による1/3スキップ走査を説明する概念図。The conceptual diagram explaining 1/3 skip scanning by the structure of FIG.

符号の説明Explanation of symbols

1・・・画素部、1a・・・遮光画素部、1b・・・有効画素部、10・・・水平走査回路、11・・・水平選択スイッチ、12・・・信号平均化スイッチ部、12a・・・遮光画素信号平均化スイッチ部、12b・・・有効画素信号平均化スイッチ部、13・・・ラインメモリ、14・・・信号転送スイッチ部、20・・・垂直走査回路。   DESCRIPTION OF SYMBOLS 1 ... Pixel part, 1a ... Light-shielding pixel part, 1b ... Effective pixel part, 10 ... Horizontal scanning circuit, 11 ... Horizontal selection switch, 12 ... Signal averaging switch part, 12a ... Shading pixel signal averaging switch unit, 12b... Effective pixel signal averaging switch unit, 13... Line memory, 14.

Claims (1)

少なくとも一部がベイヤー配列のカラーフィルタを備えた複数の画素が2次元に配列された固体撮像素子と、該画素の読み出しを行うための水平及び垂直走査回路とからなるXYアドレス型の固体撮像装置において、
上記カラーフィルタにより規定される色位相のコーディングのうち同一の色位相にある画素の画素信号を平均化する信号平均化スイッチ部を有し、
上記走査回路の制御に基づき、全画素を順次出力するモードと、
1フレーム内で画素の間引き読み出しを行い且つ当該画素について上記信号平均化スイッチ部により平均化した信号を出力するモードと、
を有し、
全画素を順次出力するモードと平均化して出力するモードとの切り換えは、前記水平及び垂直走査回路及び前記信号平均化スイッチ部の駆動制御によって行い、
前記信号平均化スイッチ部は、列毎の回路構成が均一となるように、制御信号によらず機能しない素子を含む
ことを特徴とする固体撮像装置。
An XY address type solid-state image pickup device comprising a solid-state image pickup device in which a plurality of pixels each having at least a part of a Bayer color filter are two-dimensionally arranged and a horizontal and vertical scanning circuit for reading out the pixels. In
A signal averaging switch unit that averages pixel signals of pixels in the same color phase among the coding of the color phase defined by the color filter;
Based on the control of the scanning circuit, a mode for sequentially outputting all pixels,
A mode in which pixel readout is performed within one frame and a signal averaged by the signal averaging switch unit is output for the pixel;
Have
Switching between the mode of sequentially outputting all pixels and the mode of outputting after averaging is performed by driving control of the horizontal and vertical scanning circuits and the signal averaging switch unit,
The signal averaging switch unit includes an element that does not function regardless of a control signal so that a circuit configuration for each column is uniform .
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