JP4480753B2 - 固体撮像装置 - Google Patents
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Description
図11は、上記の固体撮像装置などにおいて、画素毎に蓄積した電荷を電圧として読み出すためのソースフォロワと称せられる回路の回路図である。
上記のソースフォロワ回路において、ソースとボディの電圧が異なるため、Vth(Vout)は基板バイアスの影響を受けることとなり、下記式(1)で表される。式(1)中のγとΦFは下記式(2)及び(3)で表される。
上記のフォトダイオードは、光を受光して光電荷を生成及び蓄積する。
上記の転送トランジスタは、フォトダイオードから光電荷を転送する。
上記のフローティングディフュージョンは、転送トランジスタを通じて光電荷が転送される。
上記の増幅トランジスタは、フローティングディフュージョンに接続されたゲート電極を有する。
ここで、増幅トランジスタの出力側に、増幅トランジスタの出力が入力される増幅器と、増幅器の出力が接続されたゲート電極を有する補償トランジスタとを含み、補償トランジスタの出力が増幅器に負帰還された構成の補償回路が設けられている。
さらに好適には、前記画素が、前記付加容量素子または前記フローティングディフュージョンに接続され、前記付加容量素子及び/または前記フローティングディフュージョン内の光電荷を排出するためのリセットトランジスタをさらに有する。
本実施形態に係る固体撮像装置は、広ダイナミックレンジに対応した構成を有するCMOSイメージセンサである。
図1は、本実施形態に係るCMOSイメージセンサのレイアウトを示す平面図である。
例えば、半導体基板に、フォトダイオードと、転送トランジスタと、フローティングディフュージョン(浮遊拡散領域)と、増幅トランジスタなどを有する画素(ピクセル)PXがアレイ状(m行×n列)に複数個集積されている。
補償回路(出力回路)は、増幅トランジスタの出力が入力される増幅器と、増幅器の出力が接続されたゲート電極を有する補償トランジスタ(出力トランジスタ)とを含み、補償トランジスタの出力が増幅器に負帰還された構成となっている。補償トランジスタは、画素PX(撮像素子)と同様の構成を備える補償画素CC(出力素子)内に配置され、増幅器は、画素PX及び補償画素CCを含む画素領域の外側に画素領域に沿って配置されている。また、補償画素CC内の補償トランジスタは、画素PX内の増幅トランジスタに対応している。
ダミー画素DCは、例えば画素PXと同一の構成を有し、黒レベル測定などのために用いられる領域である。
ダミー領域は、製造プロセス時の加工安定性などのために設けられた領域である。
各画素PXは、例えば、光を受光して光電荷を生成及び蓄積するフォトダイオードPD、フォトダイオードPDからの光電荷を転送する転送トランジスタTr1、転送トランジスタTr1を通じて光電荷が転送されるフローティングディフュージョンFD、付加容量素子CS、フローティングディフュージョンFDの容量と付加容量素子CSの容量とを結合または分割する容量結合トランジスタTr2、フローティングディフュージョンFDに接続して形成され、フローティングディフュージョンFD内の光電荷を排出するためのリセットトランジスタTr3、ゲート電極がフローティングディフュージョンFDに接続して形成され、フローティングディフュージョンFD内の光電荷を電圧信号に増幅変換する増幅トランジスタ(ソースフォロワトランジスタ)Tr4、及び、増幅トランジスタに直列に接続して形成され、画素を選択するための選択トランジスタTr5を有して構成されており、いわゆる5トランジスタ型のCMOSイメージセンサである。例えば、上記の5つのトランジスタはいずれもnチャネルMOSトランジスタである。
補償画素CC,ダミー画素DCも、当該画素PXと同様の回路構成を有する。
補償回路は、増幅トランジスタTr4(M1)の出力側に設けられ、増幅トランジスタの出力が入力される増幅器APと、増幅器APの出力が接続されたゲート電極を有する補償トランジスタM2とを含み、補償トランジスタM2の出力が増幅器APに負帰還された構成となっている。この増幅器APは、演算増幅器(オペアンプ)であってよい。
また、例えば、増幅トランジスタTr4(M1)と補償トランジスタM2は、ゲート幅とゲート長の比が実質的に等しく、増幅トランジスタTr4(M1)に対する電流源l1と補償トランジスタM2に対する電流源l2の電流量が実質的に等しい構成となっている。この理由は、画素PXと補償画素CCとは同一の構成を有し、増幅トランジスタM1と補償トランジスタM2とが互いに対応する関係にあるからである。
アレイ状に集積された画素PXの列毎に補償回路が設けられた構成とすることで、補償回路を画素毎に設ける場合より補償回路に必要な面積を抑制することができる。
また、フローティングディフュージョンに蓄積した電荷に応じた電圧である増幅トランジスタTr4(M1)のゲートへの入力電圧Vinに対して、増幅トランジスタTr4(M1)のソース電圧Vout1は下記式(4)で表される。
図4は本実施形態のCMOSイメージセンサの全体の回路構成を示す等価回路図である。
複数個(図面上は代表して4個)の画素PXがアレイ状に配置されており、各画素PXには行シフトレジスタSRVで制御された駆動ライン(φT,φS,φR,φX)と、電源電圧VR及びグラウンドGNDなどが接続されている。
また、アレイ状の画素PXに隣接して、補償画素CCと増幅器APとを含む補償回路が設けられている。
図5は、本実施形態に係るCMOSイメージセンサのレイアウトを示す平面図である。
第1実施形態と同様に、画素PXがアレイ状に複数個集積されており、アレイ状に集積された画素PXの列の下端と上端のそれぞれに、2つの補償画素(CC1,CC2)が設けられており、その隣接部に、例えば2つのダミー画素領域(DC1,DC2)が設けられている。2組の補償画素CC1,CC2に対し、それぞれ増幅器APが画素領域の外側に画素領域に沿って配置されている。
例えば、全ての画素において第1信号(飽和前電荷信号S1)を出力する高感度モードと、全ての画素において第2信号(飽和前電荷信号S1+過飽和電荷信号S2)を出力する低感度モードが設けられ、例えばユーザが撮影場面に応じてダイナミックレンジのモードを切り替えて用いるように構成されており、例えば、高感度モードでは、補償画素CC1を介して常に第1信号(飽和前電荷信号S1)が出力され、低感度モードでは補償画素CC2を介して常に第2信号(飽和前電荷信号S1+過飽和電荷信号S2)が出力される構成とすることができる。
上記の実施形態に係る固体撮像装置のリニアリティ改善の効果をシミュレーションにより検証した。
図6は、本実施例のシミュレーションにおいて用いた回路図である。図3における電流源l1,l2を、より現実的なカレントミラートランジスタ回路の構成に置き換えたものである。
以下において、入力基準電圧(ここでは2.7Vとする)における出力曲線の傾きを求め、基準電圧の点を通り、求めた傾きを持つ曲線を得る。
リニアリティエラーは、上記で得た直線(理論値)とからのずれの割合として、下記式(11)のように定義する。
図7(a)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)を示す。図中、曲線aは本実施例の入力出力曲線、直線aiはその理論値の直線、曲線bは従来例の入力出力曲線、直線biはその理論値の直線である。
増幅トランジスタTr4(M1)と補償トランジスタM2のミスマッチの影響を考慮する場合、上記の式(8)におけるVth1がVth2に近似されることを見直さなければならない。このとき、Vlinは、下記式(12)で表される。
図8(a)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)を示す。図中、曲線aは本実施例の入力出力曲線、曲線bは従来例の入力出力曲線である。
図8(b)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)のリニアリティエラーを示す。図中、曲線aは本実施例のリニアリティエラー、曲線bは従来例のリニアリティエラー直線である。
図8(b)から、本実施例ではリニアリティエラーのバラツキは目立たなくなっている。これは、差動の2つの信号のどちらも同じ増幅トランジスタTr4(M1)と補償トランジスタM2で処理され、これによって基準点のズレがキャンセルされるためであり、本実施例はマッチングの影響を非常に受けにくい構成となっているためである。
各画素列に設ける補償回路に含まれる増幅器の利得が無限大と仮定しているが、これが有限である場合について調べた。
図9(a)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)を示す。図中、曲線aは本実施例の入力出力曲線であり、a1は利得が10倍、a2は利得が100倍、a3は利得が1000倍、a4は利得が10000倍の場合である。曲線bは従来例の入力出力曲線である。
図9(b)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)のリニアリティエラーを示す。図中、曲線aは本実施例のリニアリティエラーであり、a1は利得が10倍、a2は利得が100倍、a3は利得が1000倍、a4は利得が10000倍の場合である。曲線bは従来例のリニアリティエラー直線である。
トランジスタのバックゲート電圧は温度にも依存することから、温度の影響についてシミュレーションを行った。
図10(a)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)を示す。図中、曲線aは本実施例の入力出力曲線であり、a1は−15℃、a2は27℃、a3は80℃の場合である。曲線bは従来例の入力出力曲線であり、b1は−15℃、b2は27℃、b3は80℃の場合である。
図10(b)は、本実施例と従来例に係るCMOSイメージセンサの入力(V)に対する出力(V)のリニアリティエラーを示す。図中、曲線aは本実施例のリニアリティエラーであり、a1は−15℃、a2は27℃、a3は80℃の場合である。曲線bは従来例のリニアリティエラー直線であり、b1は−15℃、b2は27℃、b3は80℃の場合である。
一方、本実施例の場合には、同一基板上に形成される同じ特性のトランジスタ対により補償が行われるため、温度変化に対しても出力のバラツキが小さく、リニアリティが改善されている。
例えば、各画素に付加容量素子が設けられた広ダイナミックレンジに対応した固体撮像装置について説明しているが、これに限らず、付加容量素子がない通常のダイナミックレンジの固体撮像装置に適用できる。
例えば、各画素に付加容量素子が設けられている場合でも、フローティングディフュージョンと付加容量素子の容量比は設計などに応じて適宜変更できる。
また、CMOSイメージセンサに限らず、画素の電荷を電圧に変換して読み出す機構に、本発明の補償回路を適用することが可能である。
また、画素PXに隣接してダミー画素DCを配置し、ダミー画素DCに隣接して補償画素CCを配置する、即ち、画素PXと補償画素CCの間にダミー画素DCを配置する構成としてもよい。
その他、本発明の要旨を逸脱しない範囲で種々の変更を行うことが可能である。
Claims (13)
- 光を受光して光電荷を生成及び蓄積するフォトダイオードと、
前記フォトダイオードから光電荷を転送する転送トランジスタと、
前記転送トランジスタを通じて前記光電荷が転送されるフローティングディフュージョンと、
前記フローティングディフュージョンに接続されたゲート電極を有するMOS型の増幅トランジスタと、
を有する画素が半導体基板にアレイ状に複数個集積されており、
前記増幅トランジスタの出力側に、前記増幅トランジスタの出力が入力される増幅器と、前記増幅器の出力が接続されたゲート電極を有するMOS型の補償トランジスタとを含み、前記補償トランジスタの出力が前記増幅器に負帰還された構成の補償回路が設けられている、
固体撮像装置。 - 前記増幅トランジスタと前記補償トランジスタは、ゲート幅とゲート長の比が実質的に等しく、前記増幅トランジスタに対する電流源と前記補償トランジスタに対する電流源の電流量が実質的に等しい、
請求項1に記載の固体撮像装置。 - アレイ状に集積された前記画素の列毎に前記補償回路が設けられている、
請求項1に記載の固体撮像装置。 - 前記画素が、前記増幅トランジスタと直列に接続された前記画素を選択するための選択トランジスタを有する、
請求項1に記載の固体撮像装置。 - 前記画素が、前記フローティングディフュージョンを介して前記フォトダイオードに接続して設けられ、前記転送トランジスタを通じて前記フォトダイオードから転送される光電荷を蓄積する付加容量素子と、前記フローティングディフュージョンと前記付加容量素子とを結合または分割する容量結合トランジスタとをさらに有する、
請求項1に記載の固体撮像装置。 - 前記画素が、前記付加容量素子または前記フローティングディフュージョンに接続され、前記付加容量素子及び/または前記フローティングディフュージョン内の光電荷を排出するためのリセットトランジスタをさらに有する、
請求項5に記載の固体撮像装置。 - マトリクス状に配置されたM×N(M,Nは2以上の自然数)個の撮像素子と、上記撮像素子の出力を受けるN個の出力回路とを有し、
上記撮像素子が、フォトダイオードと、浮遊拡散領域と、上記フォトダイオードから上記浮遊拡散領域に電荷を転送するための転送トランジスタと、上記浮遊拡散領域の電位をリセットするためのリセットトランジスタと、制御端子が上記浮遊拡散領域に接続され、上記浮遊拡散領域の電位に応じた電圧を出力するためのMOS型の増幅トランジスタと、上記増幅トランジスタに直列に接続され、撮像素子を選択するための選択トランジスタとを含み、
上記出力回路が、上記増幅トランジスタの出力を一方の入力に受ける増幅器と、制御端子が上記増幅器の出力に接続され、出力を上記増幅器の他方の入力に供給するMOS型の出力トランジスタとを含み、
上記撮像素子の増幅トランジスタの構造と上記出力回路の出力トランジスタの構造とが同じであり、
上記N個の出力回路が第M行の撮像素子に対応して配置され、
上記増幅器の出力が上記撮像素子の出力として供給される、
固体撮像装置。 - 上記出力回路が上記出力トランジスタを含む出力素子を含み、
上記出力素子が上記撮像素子と同様の構成を有し、
上記出力素子内の出力トランジスタが上記撮像素子内の増幅トランジスタに対応する、
請求項7に記載の固体撮像装置。 - N個の上記出力素子が第M行の撮像素子にそれぞれ隣接して配置されている、
請求項8に記載の固体撮像装置。 - 上記増幅器がオペアンプであり、反転入力端子に上記出力トランジスタの出力が供給され、非反転入力端子に上記増幅トランジスタの出力が供給される、
請求項7〜9のいずれかに記載の固体撮像装置。 - M×N(M,Nは2以上の自然数)個の画素がマトリクス状に配置された画素領域と、
第M行の画素の出力を一方の入力に受け、第1行乃至第M−1行の画素の出力を選択的に他方の入力に受けるN個の増幅器と、
を有し、
上記画素が、フォトダイオードと、浮遊拡散領域と、上記フォトダイオードから上記浮遊拡散領域に電荷を転送するための転送トランジスタと、上記浮遊拡散領域の電位をリセットするためのリセットトランジスタと、制御端子が上記浮遊拡散領域に接続され、上記浮遊拡散領域の電位に応じた電圧を出力するためのMOS型の増幅トランジスタとを含み、
上記増幅器の出力が第M行の画素の増幅トランジスタの制御端子に供給され、
上記N個の増幅器が第M行の画素にそれぞれ対応して一行に配置されている、
固体撮像装置。 - 上記増幅器がオペアンプであり、反転入力端子に第M行の画素の増幅トランジスタの出力が供給され、非反転入力端子に第1行乃至第M−1行の画素の増幅トランジスタの出力が選択的に供給される、
請求項11に記載の固体撮像装置。 - 一行にN個を含み、上記画素領域と上記N個の増幅器との間に配置された複数行のダミー画素を更に有する、
請求項11又は12に記載の固体撮像装置。
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