JP3939666B2 - 発光装置及び電子機器 - Google Patents
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Description
【発明の属する技術分野】
本発明は、エレクトロルミネッセンス(Electro Luminescence:EL)素子および、薄膜トランジスタ(以下TFTと表記)を基板上に作り込んで形成された電子表示装置の駆動方法に関する。特に半導体素子(半導体薄膜を用いた素子)を用いた発光装置に関する。また発光装置を表示部に用いた電子機器に関する。
【0002】
なお、本明細書中では、EL素子とは、一重項励起子からの発光(蛍光)を利用するものと、三重項励起子からの発光(燐光)を利用するものの両方を示すものとする。
【0003】
【従来の技術】
近年、自発光型素子として、EL素子を有した発光装置の開発が活発化している。発光装置は、液晶表示装置と異なり自発光型である。EL素子は一対の電極(陽極と陰極)間にEL層が挟まれた構造となっている。発光装置の型式としては、パッシブマトリクス型とアクティブマトリクス型とがあるが、高解像度化に伴う画素数の増加や動画表示のため、高速な動作が要求されるものに関しては、アクティブマトリクス型が向いている。
【0004】
アクティブマトリクス型有機ELパネルの各画素には電圧を保持するために、保持容量(Cs)部が設けられている。実際の画素構成例を図12(A)に示す。また、図12(B)は等価回路を示している。特許文献1で開示されているように、Cs部が大きく、その分有機ELの発光面積が小さくなってしまう。Cs部の他にも画素を構成するTFT・配線・コンタクト・隔壁などの形状や数、配置の仕方が発光面積を小さくしてしまう要因となっている。発光面積が小さくなることによって、電流密度が高くなり、有機ELの信頼性が著しく低下する。
【0005】
また、無理に開口率を稼ごうとして、開口部を複雑な形状にしてしまうと、有機EL発光部のシュリンクを助長してしまうこともある。ここで、EL発光部のシュリンクとは、EL層が物理的に収縮する状態ではなく、EL素子の有効面積(EL素子が発光している部分の面積)が、端部より徐々に縮小していく状態をいう。つまり、開口部の形状が複雑になると、開口部の面積に対して、端部の長さがより長くなり、したがってシュリンクを助長することになってしまう。
【0006】
【特許文献1】
特開平8−234683号
【0007】
【発明が解決しようとする課題】
図20に、アクティブマトリクス型EL表示装置の画素部の構成の例を示す。点線枠2300で囲まれた部分が画素部であり、その中に複数の画素を有する。点線枠2310で囲まれた部分が1画素である。
【0008】
ゲート信号線駆動回路から選択信号が入力されるゲート信号線(G1、G2、・・・、Gy)は、各画素が有するスイッチング用TFT2301のゲート電極に接続されている。また、各画素が有するスイッチング用TFT2301のソース領域とドレイン領域は、一方がソース信号線駆動回路から信号が入力されるソース信号線(S1〜Sx)に、他方が駆動用TFT2302のゲート電極に接続されている。各画素の有する駆動用TFT2302のソース領域とドレイン領域の一方は電流供給線(V1、V2、・・・、Vx)に、他方は、各画素が有するEL素子2304の一方の電極に接続されている。また、表示期間中に、駆動用TFT2302のゲート・ソース間電圧を保持するための容量手段2303を各画素に設けていても良い。
【0009】
EL素子2304は、陽極と、陰極と、陽極と陰極の間に設けられたEL層とを有する。EL素子2304の陽極が駆動用TFT2302のソース領域またはドレイン領域と接続している場合、EL素子2304の陽極が画素電極、陰極が対向電極となる。逆に、EL素子2304の陰極が駆動用TFT2302のソース領域またはドレイン領域と接続している場合、EL素子2304の陰極が画素電極、陽極が対向電極となる。
【0010】
なお、本明細書において、対向電極の電位を対向電位という。なお、対向電極に対向電位を与える電源を対向電源と呼ぶ。画素電極の電位と対向電極の電位の電位差がEL駆動電圧であり、このEL駆動電圧が、画素電極と対向電極とに挟まれたEL層に印加される。
【0011】
このような発光装置の階調表示方法として、アナログ階調方式と、デジタル階調方式が挙げられる。デジタル階調方式としては面積階調や時間階調方式がある。
【0012】
アナログ階調方式とデジタル階調方式のそれぞれの場合において、Csを設ける場合の値について説明する。
【0013】
アナログ階調方式の場合は一般的に、1フレーム期間に1回、各画素にアナログ映像信号が書き込まれる。各画素へのアナログ映像信号入力はアナログ電圧、あるいはアナログ電流によって行われる。アナログ電圧の場合は、書き込まれたアナログ電圧がそのまま各画素の保持容量に蓄えられ、1フレーム期間(フレーム周波数60Hzの場合1フレーム期間の長さは16.66ms)そのアナログ電圧を保持しなくてはならない。アナログ電流の場合は書き込まれた電流が各画素内で一旦アナログ電圧に変換される。そのアナログ電圧を1フレーム期間保持しなくてはならない。
【0014】
また、デジタル階調方式の場合は、前述のように、デジタル映像信号を1フレーム期間に複数(n)回書き込む必要がある。4ビット階調ならn=4回以上、6ビット階調ならn=6回以上となる。したがって、1フレーム期間をn個に分割した内、最も長いサブフレームの間保持できなくてはならない。
【0015】
続いて、駆動用TFTとEL素子の関係について説明する。
【0016】
図15(A)に示すように、各画素の電流供給線・対向電源間には駆動用TFT1505とEL素子1506が直列に接続されている。EL素子1506に流れる電流は、図15(B)の駆動用TFTのVd−Id曲線とEL素子のV−I曲線の交点が動作点となり、そのときの駆動用TFT1505のソース・ドレイン間電圧とEL素子1505の両電極間の電圧に従って、電流が流れる。
【0017】
駆動用TFT1505のゲート・ソース間電圧(|VGS|)が、ソース・ドレイン間電圧(|VDS|)よりもしきい値電圧分以上大きいと、駆動用TFT1505は線形領域で動作(定電圧駆動)し、それよりも小さいと、駆動用TFT1505は飽和領域で動作(定電流駆動)する。
【0018】
駆動用TFT1505を線形領域で動作させる場合、すなわち動作点における駆動用TFT1505の動作が線形領域に含まれる場合は、駆動用TFT1505の|VDS|がEL素子1506の両電極間の電圧(|VEL|)に比べて遥かに小さく、駆動用TFT1505の特性ばらつきが、EL素子1506を流れる電流に殆ど影響しない。しかし、温度変化や経時変化によってEL素子1506の抵抗が変化してしまうと、電流もその影響を受け変化してしまう。例えば、図16(A)に示すように、EL素子1506が劣化し、その電圧−電流特性が1601から1602へと変化すると、動作点もまた、1603から1604へと変化する。このとき、駆動用TFT1505が線形領域で動作していると、動作点の移動に伴い、ΔIDだけ、EL素子1506を流れる電流値が減少することになる。したがって輝度が低下する。
【0019】
これに対し、駆動用TFT1505を飽和領域で動作させた場合では、図16(B)に示すように、EL素子の劣化によってEL素子1506の電圧−電流特性が1611から1612へと変化しても、駆動用TFT1505のドレイン電流(IDS)が一定のため、動作点が1613から1614に変化しても、EL素子1506には一定の電流が流れる。そのため、輝度の変動が駆動用TFT1505を線形領域で動作させたときと比べて少ない。
【0020】
駆動用TFTのチャネル長・チャネル幅の設定や、駆動用TFTやEL素子の特性・駆動電圧によっては動作点を全て飽和領域に持ってくることも出来る。
【0021】
しかし、駆動用TFT1505を飽和領域で動作させた場合では、EL素子1506に流れる電流値を決めているのはTFTのVGS−IDS特性のみに依存するため、駆動用TFT1505の特性が各画素でばらつくと、そのままEL素子1506の発光輝度のばらつきに反映される。また、保持期間中のVGSの変化も流れる電流に大きく影響する。飽和領域におけるIDSは、式(1)で表される。
【0022】
【数1】
【0023】
スイッチング用TFT1504のオフリーク電流により、駆動用TFT1505のゲート電極の電荷はソース信号線1501にリークし、それにともなって駆動用TFTの|VGS|が変化するため、IDSも変化してしまう。よって、スイッチング用TFT1504からの電荷のリークによる、駆動用TFTのVGS損失を補うための容量が必要となる。これを保持容量と呼んでいる。保持容量の大きさは、駆動用TFTのVGS−IDS特性と、EL素子1506の輝度が1階調分変化するのに伴う電流値の変化量ΔIELの関係で決まる。式(1)からもわかるように、IDSはVGSの2乗に比例するため、|VGS|の変化に対してIDSは大変敏感である。ΔIELから、駆動用TFT1505に許容されるVGSの変化量ΔVGSを求める。必要な保持容量の大きさはスイッチング用TFTのオフリーク電流値Ioff、および保持時間から、式(2)(3)を用いて決定する。ここでΔtは微小時間、ΔVGSは、駆動用TFT1505のゲート・ソース間電圧の増分である。
【0024】
【数2】
【0025】
【数3】
【0026】
1フレーム期間に複数回の書き込み動作を行うデジタル階調方式に比べて、アナログ階調方式は1フレームに1回しか書き込まれないので、保持時間が長くなり、より大きな保持容量が必要となる。
【0027】
また、前述の理由から各画素の駆動用TFTのチャネル長は長く保つ必要があり、駆動用TFTサイズが大きくなることにより開口率が下がってしまう。
【0028】
本発明は、前述の課題を鑑みてなされたものであり、駆動用TFTのばらつきが映像の画質に影響しにくく、かつ高開口率を実現する発光装置を提供することを課題とする。
【0029】
【課題を解決するための手段】
課題を解決するために、本発明では以下のような手段を講じた。
【0030】
本発明の発光装置においては、画素部に、大きなCs部を設けず、駆動用TFTのチャネル長・チャネル幅を大きくし、駆動用TFTのゲート電極と、チャネル形成領域との間の容量(チャネル容量)をCsとして利用する。
【0031】
図18のように、TFT電極はゲート絶縁膜1803を挟んで、ゲート電極1804、ソース電極1807、ドレイン電極1808で構成されている。そのため各端子間、ゲート電極1804・ソース電極1807・ソース領域1802a間にはゲート・ソース間容量1811、1812が、ゲート電極1804・ドレイン電極1808・ドレイン領域1802b間にはゲート・ドレイン間容量1813、1814が本質的に存在する。
【0032】
TFTをONさせるのに必要なゲート・ソース間電圧が、TFTのゲート電極1804とソース領域1802a間に印加されれば、チャネル形成領域1809内にチャネル1810が形成されドレイン電流が流れる。この時ゲート電極1804とチャネル間にチャネル容量1815が発生する。
【0033】
ゲート電極1804、ソース電極1807、ドレイン電極1808の電圧条件によってチャネル領域は変化するため、チャネル容量も変化する。
【0034】
電圧条件によるチャネル領域の変化を、図17を用い説明する。ここにはPチャネル型TFTを例として用いた。
【0035】
図17の(B)のように、TFTがOFF状態の場合、チャネル形成領域1704にチャネルは形成されないため、チャネル容量は無視出来る。
【0036】
次に、図17(C)のように、TFTを線形領域で動作する場合、ソース・ドレイン間全面にチャネル1706が形成され、正孔はソースからドレインに向けて直線的に減少するように分布する。チャネル形成領域の半導体全表面に正孔が存在するため、充分なチャネル容量が確保出来る。
【0037】
次に、図17(D)のように、TFTを飽和領域で動作する場合、チャネル1706は形成されるが、ドレイン側の半導体表面には正孔の分布がない状態になる。しかし、ソース側の半導体表面には正孔が存在するため、ゲート・ソース間に充分な容量が確保出来る。
【0038】
また、画素のレイアウトを行う際に、隔壁の下に配線を配置し、配線の下に駆動用TFTを配置することで、駆動用TFTのサイズが大きくなっても開口率を稼ぐことが出来る。また、3トランジスタ型の場合スイッチング用TFTと消去用TFTを直線状に配置することで開口率を稼ぎ、シンプルな開口部にすることが出来る。ここで直線状とは必ずしも厳密に一直線でなくともよい。開口率を上げることによりEL素子を同じ輝度にしても電流密度が下がり、劣化速度が遅くなる。また、シンプルな開口部にすることでEL素子のシュリンクの影響を受けにくくなる。
【0039】
本発明の構成を以下に記す。
【0040】
本発明の発光装置は、
駆動用トランジスタと接続する発光素子と、スイッチング用TFTと、消去用TFTとを有する画素を、複数個備えた発光装置であって、
前記駆動用トランジスタのゲート・ソース間電圧を保持するための容量部は、前記駆動用トランジスタのゲート電極と半導体層とそれらの間に設けられた絶縁膜によって設けられたことを特徴としている。
【0041】
本発明の発光装置は、
駆動用トランジスタと接続する発光素子と、スイッチング用TFTと、消去用TFTとを有する画素を、複数個備えた発光装置であって、
前記駆動用トランジスタのゲート・ソース間電圧を保持するための容量部は、前記駆動用トランジスタのゲート電極とソース領域を形成する半導体層、あるいは前記駆動用トランジスタのゲート電極とドレイン領域を形成する半導体層と、前記ゲート電極と前記半導体層との間に設けられた絶縁膜によって設けられたことを特徴としている。
【0042】
本発明の発光装置は、
発光素子を備えた複数の画素を有し、
前記複数の画素はそれぞれ、ソース信号線と、第1および第2のゲート信号線と、電流供給線と、スイッチング用トランジスタと、消去用トランジスタと、駆動用トランジスタとを有する発光装置であって、
前記駆動用トランジスタのゲート・ソース間電圧を保持するための容量は、前記駆動用トランジスタのゲート電極とチャネル形成領域との間の容量によって設けられたことを特徴としている。
【0043】
本発明の発光装置は、
発光素子を備えた複数の画素を有し、
前記複数の画素はそれぞれ、ソース信号線と、第1および第2のゲート信号線と、電流供給線と、スイッチング用トランジスタと、消去用トランジスタと、駆動用トランジスタとを有する発光装置であって、
前記駆動用トランジスタのゲート・ソース間電圧を保持するための容量は、前記駆動用トランジスタのゲート電極とソース領域との間、あるいは前記駆動用トランジスタのゲート電極とドレイン領域との間の容量とによって設けられたことを特徴としている。
【0044】
本発明の発光装置は、
駆動用トランジスタと接続する発光素子と、スイッチング用TFTと、消去用TFTを有する画素を、複数個備えた発光装置であって、
前記ソース信号線と、前記電流供給線と、前記駆動用トランジスタとはいずれも、前記複数の画素の隣接する発光エリアを隔てる位置に形成された絶縁膜と重なり合う位置に配置されていることを特徴としている。
【0045】
本発明の発光装置は、
発光素子を備えた複数の画素を有し、
前記複数の画素はそれぞれ、ソース信号線と、第1および第2のゲート信号線と、電流供給線と、スイッチング用トランジスタと、駆動用トランジスタとを有する発光装置であって、
前記ソース信号線と、前記電流供給線と、前記駆動用トランジスタとはいずれも、前記複数の画素の隣接する発光エリアを隔てる位置に形成された絶縁膜と重なり合う位置に配置されていることを特徴としている。
【0046】
本発明の発光装置において、
前記スイッチング用トランジスタと前記消去用トランジスタとは、
前記スイッチング用トランジスタのソース領域におけるある一点とドレイン領域におけるある一点および、前記消去用トランジスタのソース領域におけるある一点とドレイン領域におけるある一点が、いずれも1つの直線上に含まれる位置に配置されていることを特徴としている。
【0047】
本発明の発光装置において、
前記駆動用トランジスタは、前記ソース信号線の一部あるいは、前記電流供給線の一部と重なり合う位置に配置されていることを特徴としている。
【0048】
本発明の発光装置において、
前記駆動用トランジスタのチャネル領域を形成する半導体層は、U字状、S字状、渦巻状、あるいはミアンダ状に形成されていることを特徴としている。
【0049】
本発明の発光装置において、
前記駆動用トランジスタのチャネル長がL、チャネル幅がWであるとき、
L×W>200μm2であることを特徴としている。
【0050】
本発明の発光装置において、
前記駆動用トランジスタのゲート・ソース間電圧がVGS、ソース・ドレイン間電圧がVDS、しきい値電圧がVthであるとき、
|VDS|<|VGS|−|Vth|となるように駆動されることを特徴としている。
【0051】
本発明の発光装置において、
前記駆動用トランジスタのゲート・ソース間電圧がVGS、ソース・ドレイン間電圧がVDS、しきい値電圧がVthであるとき、
|VDS|≧|VGS|−|Vth|となるように駆動されることを特徴としている。
【0052】
本発明の発光装置において、
前記駆動用トランジスタのゲート・ソース間電圧が、4V以上14V以下となるように駆動されることを特徴としている。
【0053】
本発明の発光装置において、
前記駆動用トランジスタのチャネル長がL、チャネル幅がWであるとき、
L>5Wであることを特徴としている。
【0054】
本発明の発光装置において、
前記駆動用のトランジスタのチャネル長がL、チャネル幅がWであるとき、
R、G、Bの発光色を呈するそれぞれの画素が有する前記駆動用トランジスタにおけるL/Wはそれぞれ異なることを特徴としている。
【0055】
【発明の実施の形態】
【0056】
[実施形態1]
まず図1を用いて説明する。ここでの発光装置は、フルカラー表示をするものとし、それぞれ、赤色を発光する画素(R)の駆動用TFTのソース領域とドレイン領域のうちの一方は赤色用の電流供給線に接続されていて、緑色を発光する画素(G)の駆動用TFTのソース領域とドレイン領域のうちの一方は緑色用の電流供給線に接続されていて、青色を発光する画素(B)の駆動用TFTのソース領域とドレイン領域のうちの一方は青色用の電流供給線に接続されている。RGBそれぞれのEL素子はストライプ状に塗り分けられる。
【0057】
図1では隔壁は発光エリア5007以外の領域を覆っていて、隔壁5020のうち、前記ストライプと平行な方向に設けられた隔壁が塗り分けマージンとなる。この時、塗り分けマージン用の隔壁がある場所は発光エリアに用いることができないので、隔壁の下にソース信号線5001と電流供給線5003を配置する。次に、ソース信号線5001と電流供給線5003の下に駆動用TFT5005を配置する。この時隣り合う画素が有するソース信号線や電流供給線の下であっても良い。
【0058】
このような配置としたとき、駆動用TFTのゲート電極は、電流供給線の一部と重なり合うように配置される。電流供給線は、常に一定電位に固定されているため、駆動用TFTのゲート電極と、電流供給線との間の容量を、Csの一部として利用することも出来る。
【0059】
駆動用TFT5005は保持容量を兼ね、更に特性バラツキも抑えるために、チャネル長×チャネル幅が大きくなっている。しかし、駆動用TFT5005を塗り分けマージン用隔壁の下に配置することでチャネル長×チャネル幅が大きくなっても開口率が低くなることを避けることが出来る。
【0060】
[実施形態2]
次に、画素を構成するTFTが3トランジスタ型の場合は、駆動用TFTを除く、スイッチング用TFTと消去用TFTの2つを直線状に配置することで開口率を稼ぎ、更にシンプルな開口部にすることが出来る。開口部をシンプルに、より長方形に近い形にすることでシュリンクの影響を少なくすることが出来る。
【0061】
[実施形態3]
また、駆動用TFTのチャネル長とチャネル幅を決める際は、なるべくチャネル長×チャネル幅を大きくとることを目標とし、駆動用TFTを飽和領域で動作させる場合はチャネル幅に比べチャネル長を長くし、VGSがしきい値電圧の影響を受けにくい値にする必要がある。チャネル長を大きくすることで駆動用TFTの飽和領域特性もよりフラットになる。この時、VGSを大きくしすぎると消費電力が大きくなる事や、駆動用TFTの耐圧が問題となるため、|VGS|を4V以上14V以下の間になるようにチャネル長・チャネル幅を調整すると良い。
【0062】
実施形態1〜3によって、駆動用TFTのサイズを大きくし、かつチャネル幅Wに対してチャネル長Lを大きくすることによって、飽和領域における電流特性の均一さに優れたTFTを、それぞれの画素の駆動用TFTとして用いることが出来、かつ駆動用TFTのばらつきがEL素子の発光輝度に影響しにくくすることが出来る。
【0063】
さらに、保持容量を、駆動用TFTのチャネル容量によってまかない、かつ発光エリア外の隔壁と重なり合う位置に配置することによって、高開口率化が期待出来る。
【0064】
[実施形態4]
EL素子においては、一般的にはR、G、Bそれぞれで発光効率が異なり、したがって均一な輝度を得るのに必要な電流値も異なる。因って駆動用TFTの電流能力が全て同一である場合、電流値に差をつけるにはVgsに差をつける必要がある。故にR、G、BそれぞれのEL素子の発光効率の差が大きい場合にはVgsの差が大きくなり電圧設定が困難になる場合がある。
【0065】
この場合は、R、G、Bそれぞれで、駆動用TFTのチャネル長/チャネル幅を変え、電流能力を調整すれば良い。またこの際、駆動用TFTチャネル長、チャネル幅を駆動用TFTが塗り分けマージン用隔壁の領域を出ない範囲で調整することでRGBで開口率が同一となる。また、RGBそれぞれの、チャネル長×チャネル幅が大きくなるよう調整することで、チャネル容量が十分に確保できる。
【0066】
【実施例】
以下に、本発明の実施例について記載する。
【0067】
[実施例1]
図13に、実測したPチャネル型TFTのゲート・ソース間容量、ゲート・ドレイン容量の値を示す。VGSは−6Vとし、VDSを16V〜−16Vまで変化させている。VDSがおよそ−5Vから、それよりも低くなる領域で、飽和領域となっている。図13(A)と(B)との和が駆動用TFTの容量となる。
【0068】
図17(C)で説明したように、駆動用TFTを線形領域で駆動させた場合、半導体全表面にチャネルが形成されるため、充分な容量が確保出来る。
【0069】
駆動用TFTを飽和領域で駆動させた場合は、図17(C)で説明したようにドレイン領域側にはチャネルが形成されず、図13(b)で見るようにゲート・ドレイン間容量は0に近い値となる。しかし、ソース領域側にはチャネルが形成されるため、図13(a)で見えるようにゲート・ソース間容量で充分まかなうことが出来る。したがって、駆動用TFTを飽和領域で駆動させたい場合は、駆動用TFTにPチャネル型を使うと充分なチャネル容量が確保出来る。
【0070】
上記説明から、各画素内で大きなCs部を設けず、駆動用TFTのチャネル容量を利用することで開口率を稼ぐことが出来る。また、チャネル長×チャネル幅が大きくなることで、駆動用TFTを構成する半導体の結晶性のバラツキが平均化されること等によって、素子自体のIonバラツキも低減される。
【0071】
また、駆動用TFTを飽和領域で駆動させる場合でも各画素での駆動用TFTのVgs−Ids特性のバラツキが問題となる。その場合、EL素子に流す電流はそのままでチャネル幅よりもチャネル長を充分大きくすることで、飽和領域の飽和特性も改善される。反面チャネル長を大きくしたことによって、ELに供給される電流値が減少するので、VGSを高くすることで、所望の電流をEL素子に供給するようにする。従ってVGSがしきい値を充分上回る値となることで、VGSがしきい値バラツキの影響を受けにくくなり、IDSバラツキをより低減することが出来る。チャネル長を長くすることで飽和特性が良いと飽和領域内ではIDSがほぼ一定になっているため、EL素子の劣化などにより抵抗が変化しても同じ電流量がEL素子に供給される。
【0072】
図14には、チャネル長×チャネル幅を大きくし、チャネル幅に対してチャネル長を充分大きくしたTFTの実測したIdsのバラツキを示す。
【0073】
|VGS|を5V、|VDS|を8Vと固定し、チャネル長・チャネル幅の異なる素子について、それぞれ複数の素子を用いてIDSを測定した。図14で分かるように、IDSのバラツキは、チャネル形成領域の面積(チャネル長×チャネル幅)を大きくすることによって抑えることが出来る。また、図14の|VGS|5Vと8Vを比較すると、VGSがVthを大きく上回ると、よりIDSのバラツキを抑えられることが分かる。
【0074】
[実施例2]
ここでは図1を用い、2トランジスタ型の画素の構成・レイアウトについて説明する。
【0075】
図1の画素はソース信号線5001、ゲート信号線5002、電流供給線5003、スイッチング用TFT5004、駆動用TFT5005、画素電極5006、発光エリア5007以外を覆う隔壁で構成されていて、スイッチング用TFT5004のゲート電極はゲート信号線5002と接続され、ソース側はソース信号線5001と接続され、ドレイン側は駆動用TFT5005のゲート電極と接続されている。また、駆動用TFT5005のソース側は電流供給線5003と接続され、ドレイン側は画素電極5006と接続されている。
【0076】
発光エリア5007以外を覆う隔壁のうち、隣接する左右の画素の間に設けられた隔壁は、RGBを塗り分ける際に必要とされる塗り分けマージンとなる。隣り合って隣接する左右の画素間に設けられる隔壁の幅は、30μm前後とするのが望ましい。
【0077】
この時、塗り分けマージン用の隔壁は発光エリアとしては用いることができないため、幅30μmの下にソース信号線5001と電流供給線5003を配置する。次に、ソース信号線5001と電流供給線5003の下に駆動用TFT5005を配置する。この時隣り合う画素が有するソース信号線や電流供給線の下であっても良い。
【0078】
また、保持容量は駆動用TFT5005の、半導体層5014とゲート電極5016の間にあるゲート絶縁膜5015で作られるチャネル容量で兼ねることが出来る。
【0079】
この時保持時間の短いデジタル階調で、保持時間が1ms、駆動用TFTのIoff=1pAとし、EL素子の発光輝度が1階調変化する時の駆動用TFTのVgsの変化量ΔVgsは0.02V程度とする。式(3)より、その時必要な保持容量は50fFとなる。ゲート絶縁膜5015の厚さを120nmとし、比誘電率を4とすると、チャネル長×チャネル幅=200μm2で約60fFのチャネル容量となる。したがって、充分な容量を作るため、駆動用TFT5005のチャネル長×チャネル幅は200μm2以上であることが望ましい。
【0080】
また、駆動用TFT5005のチャネル長×チャネル幅が大きい程、素子自体のバラツキも低減されるので、なるべく大きくなることを目標とすると良い。
【0081】
駆動用TFT5005を飽和領域で駆動させる場合は、チャネル幅に比べチャネル長を大きくし、Vgsがしきい値の影響を受けにくい値にすると良い。この時、チャネル長/チャネル幅が5以上であることが望ましい。チャネル長を大きくすることで駆動用TFTの飽和領域特性もよりフラットになる。しかし、VGSを大きくしすぎると消費電力が大きくなる事や、駆動用TFTの耐圧が問題となるため、|VGS|を4V以上14V以下の間になるようにチャネル長とチャネル幅を調整すると良い。
【0082】
駆動用TFT5005のチャネル長を長くするため、半導体層5014のように縦方向にまっすぐさせると良い。開口率を落とさず、駆動用TFT5005のチャネル長を長くでき、チャネル幅もある程度大きくすることが出来る。
【0083】
開口率が高いと、EL素子に対する電流密度が低くなり長寿命化に繋がり、開口部もシンプルな形になっているため、シュリンクの影響も受けにくくなる。
【0084】
スイッチング用TFT5004は図ではダブルゲートになっているが、シングルゲートでも良いし、3本以上のマルチゲートでも良い。
【0085】
図2(A)は図1(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図2(A)中、α‐α’間の断面を示したものが図2(B)である。駆動用TFT5105のように半導体層を縦方向に蛇行させても良い。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5105のチャネル長をより長くすることが出来る。
【0086】
図3(A)は図1(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図3(A)中、α‐α’間の断面を示したものが図3(B)である。駆動用TFT5205のように半導体層をU字型にしても良い。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5205のチャネル長をより長くし、チャネル幅もある程度大きくすることが出来る。
【0087】
図4(A)は図1(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図4(A)中、α‐α’間の断面を示したものが図4(B)である。駆動用TFT5305のように半導体層をミアンダ形状としても良い。ここで、ミアンダとは、「meander:曲がりくねって流れる」という意味を有し、ミアンダ形状とは、半導体層の形状が曲がりくねっている様子を指す。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5305のチャネル長をより長くし、チャネル幅もある程度大きくすることが出来る。
【0088】
[実施例3]
ここでは図5を用い、3トランジスタ型の画素の構成・レイアウトについて説明する。
【0089】
SES駆動をする場合の消去用トランジスタ5506を追加し、ゲート電極に消去用の信号を入力する第2のゲート信号線5503が接続され、ソース電極と電流供給線5504が接続され、ドレイン電極とスイッチング用TFT5505のドレイン電極・駆動用TFT5507のゲート電極が接続されている。
【0090】
3トランジスタ型の場合、スイッチング用TFT5505と消去用TFT5506の2つのTFTを、第1のゲート信号線5502と第2のゲート信号線5503の間に、横に並べ直線状に配置する。スイッチング用TFT5505のドレイン領域と消去用TFT5506のドレイン領域を重ねても良い。この時、スイッチング用TFT5505のソース領域のある一点とドレイン領域のある一点と消去用TFT5506のソース領域のある一点とドレイン領域のある一点が1つの直線上に並ぶように配置する。
【0091】
上記のように配置することで開口率を上げ、開口部もシンプルな形状にすることが出来る。
【0092】
図6(A)は図5(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図6(A)中、α‐α’間の断面を示したものが図6(B)である。駆動用TFT5607のように半導体層を縦方向に蛇行させても良い。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5607のチャネル長をより長くすることが出来る。
【0093】
図7(A)は図5(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図7(A)中、α‐α’間の断面を示したものが図7(B)である。駆動用TFT5707のように半導体層をU字型にしても良い。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5707のチャネル長をより長くし、チャネル幅もある程度大きくすることが出来る。
【0094】
図8(A)は図5(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図8(A)中、α‐α’間の断面を示したものが図8(B)である。駆動用TFT5807のように半導体層をミアンダ形状にしても良い。半導体層をこのような形状とすることで、開口率を落とさず、駆動用TFT5807のチャネル長をより長くし、チャネル幅もある程度大きくすることが出来る。
【0095】
図10(A)は図5(A)における半導体層に代えて、パターニング形状の異なる半導体層とした例である。図10(A)中、α‐α’間の断面を示したものが図10(B)である。駆動TFTの半導体層の大きさを5907のようにし、保持容量が駆動TFTのゲート容量だけでは充分でない場合は保持容量部5910を形成しても良い。保持容量5910を隔壁5920の下に形成することで、開口率を落とさず、充分な保持容量を得ることができる。
【0096】
さらに、実施例2および本実施例にて示した構成の画素においては、駆動用TFTを飽和領域で動作させることによって、駆動用TFTのソース・ドレイン間電圧に関係なく、駆動用TFTのゲート・ソース間電圧のみによって、EL素子に供給する電流値を制御することが出来る。この場合、駆動用TFTは定電流源として機能することが出来るため、発光装置の画素部周辺に一体形成、もしくは外付けで供給される駆動回路に電流源回路を追加する必要がないため、装置の省スペース化にも貢献出来る。
【0097】
[実施例4]
図9(A)に示すように、携帯電話等の電子機器の表示部として発光装置が使用される場合は、モジュール901という形で内蔵される。ここで、モジュール901とは、発光装置と、発光装置を駆動するための信号処理用LSI、メモリ等を実装した基板とを接続した形態を指す。
【0098】
モジュール901をブロック図として、図9(B)に示す。モジュール901は、電源部911、信号制御部912、FPC913、発光装置914を有する。電源部911は、外部バッテリーより供給される電源より、ソース信号線駆動回路、ゲート信号線駆動回路、発光素子等に、それぞれ所望の複数の電圧値の電源を生成し、供給する。信号制御部912には、映像信号、同期信号が入力され、発光装置901にて処理が出来るように、各種信号の変換を行う他、ソース信号線駆動回路、ゲート信号線駆動回路を駆動するためのクロック信号等を生成する。
【0099】
本実施例にて示したモジュール901は、発光装置914と、電源部911および信号制御部912とは独立して作成されているが、これらを基板上に一体形成して作製しても良い。
【0100】
続いて、図11に、図9にて示したモジュール901に含まれる発光装置914の詳細な構成について示す。
【0101】
発光装置は、基板1001上に画素部1003、ソース信号線駆動回路1004、ゲート信号線駆動回路1005、1006、FPC1007等によって構成される。対向基板1002は、ガラス等の透明材料でも良いし、金属材料でも良い。基板1001と対向基板1002との間は、充填材等によって密閉され、さらにEL素子の水分による劣化等を防止するための乾燥剤等が封入される場合もある。
【0102】
図11(B)に、上面図を示す。基板中央部には、画素部1003が配置され、その周辺部には、ソース信号線駆動回路1004、ゲート信号線駆動回路1005、1006が配置されている。ソース信号線駆動回路1004の周辺には、電流供給線1011、対向電極コンタクト1013等が配置されている。EL素子の対向電極は、画素部全面に形成されており、前記対向電極コンタクト1013によってFPC1007を通じ、対向電位が与えられる。ソース信号線駆動回路1004、ゲート信号線駆動回路1005、1006を駆動するための信号、および電源の供給は、FPC1007を通じて、外部より行われる。
【0103】
また、基板1001と対向基板1002とを貼り合わせるためのシール材1014は、図11(B)に示すように、ソース信号線駆動回路1004、ゲート信号線駆動回路1005、1006の一部に重なるように形成されていても良い。このようにすると、発光装置の狭額縁化が期待出来る。
【0104】
[実施例5]
本実施例では、本発明を用いて発光装置を作製した例について、図19を用いて説明する。
【0105】
図19は、TFTが形成された素子基板をシーリング材によって封止することによって形成された発光装置の上面図であり、図19(B)は、図19(A)のA−A’における断面図、図19(C)は図19(A)のB−B’における断面図である。
【0106】
基板4001上に設けられた画素部4002と、ソース信号線駆動回路4003と、第1及び第2のゲート信号線駆動回路4004a、4004bとを囲むようにして、シール材4009が設けられている。また画素部4002と、ソース信号線駆動回路4003と、第1及び第2のゲート信号線駆動回路4004a、4004bとの上にシーリング材4008が設けられている。よって画素部4002と、ソース信号線駆動回路4003と、第1及び第2のゲート信号線駆動回路4004a、4004bとは、基板4001とシール材4009とシーリング材4008とによって、充填材4210で密封されている。シール材4009は、ソース信号線駆動回路4003と、第1及び第2のゲート信号線駆動回路4004a、4004bとの一部と重なり合うように設けられていても良い。
【0107】
また基板4001上に設けられた画素部4002と、ソース信号線駆動回路4003と、第1及び第2のゲート信号線駆動回路4004a、4004bとは、複数のTFTを有している。図19(B)では代表的に、下地膜4010上に形成された、ソース信号線駆動回路4003に含まれるTFT(但し、ここではNチャネル型TFTとPチャネル型TFTを図示する)4201及び画素部4002に含まれるTFT4202を図示した。
【0108】
TFT4201及び4202上には層間絶縁膜(平坦化膜)4301が形成され、その上にTFT4202のドレインと電気的に接続する画素電極(陽極)4203が形成される。画素電極4203としては仕事関数の大きい透明導電膜が用いられる。透明導電膜としては、酸化インジウムと酸化スズとの化合物、酸化インジウムと酸化亜鉛との化合物、酸化亜鉛、酸化スズまたは酸化インジウムを用いることが出来る。また、前記透明導電膜にガリウムを添加したものを用いても良い。
【0109】
そして、画素電極4203の上には絶縁膜4302が形成され、絶縁膜4302は画素電極4203の上に開口部が形成されている。この開口部において、画素電極4203の上には有機発光層4204が形成される。有機発光層4204は公知の有機発光材料または無機発光材料を用いることが出来る。また、有機発光材料には低分子系(モノマー系)材料と高分子系(ポリマー系)材料があるがどちらを用いても良い。
【0110】
有機発光層4204の形成方法は公知の蒸着技術もしくは塗布法技術を用いれば良い。また、有機発光層の構造は正孔注入層、正孔輸送層、発光層、電子輸送層または電子注入層を自由に組み合わせて積層構造または単層構造とすれば良い。
【0111】
有機発光層4204の上には遮光性を有する導電膜(代表的にはアルミニウム、銅もしくは銀を主成分とする導電膜またはそれらと他の導電膜との積層膜)からなる陰極4205が形成される。また、陰極4205と有機発光層4204の界面に存在する水分や酸素は極力排除しておくことが望ましい。従って、有機発光層4204を窒素または希ガス雰囲気で形成し、酸素や水分に触れさせないまま陰極4205を形成するといった工夫が必要である。本実施例ではマルチチャンバー方式(クラスターツール方式)の成膜装置を用いることで上述のような成膜を可能とする。そして陰極4205は所定の電圧が与えられている。
【0112】
以上のようにして、画素電極(陽極)4203、有機発光層4204及び陰極4205からなる発光素子4303が形成される。そして発光素子4303を覆うように、絶縁膜4302上に保護膜4303が形成されている。保護膜4303は、発光素子4303に酸素や水分等が入り込むのを防ぐのに効果的である。
【0113】
4005aは電源線に接続された引き回し配線であり、TFT4202の第1の電極に接続されている。引き回し配線4005aはシール材4009と基板4001との間を通り、異方導電性フィルム4300を介してFPC4006が有するFPC用配線4301に電気的に接続される。
【0114】
シーリング材4008としては、ガラス材、金属材(代表的にはステンレス材)、セラミックス材、プラスチック材(プラスチックフィルムも含む)を用いることが出来る。プラスチック材としては、FRP(Fiberglass‐Reinforced‐Plastics)板、PVF(ポリビニルフルオライド)フィルム、マイラーフィルム、ポリエステルフィルムまたはアクリル樹脂フィルムを用いることが出来る。また、アルミニウムホイルをPVFフィルムやマイラーフィルムで挟んだ構造のシートを用いることも出来る。
【0115】
但し、発光素子からの光の放射方向がカバー材側に向かう場合にはカバー材は透明でなければならない。その場合には、ガラス板、プラスチック板、ポリエステルフィルムまたはアクリルフィルムのような透明物質を用いる。
【0116】
また、充填材4103としては窒素やアルゴンなどの不活性な気体の他に、紫外線硬化樹脂または熱硬化樹脂を用いることができ、PVC(ポリビニルクロライド)、アクリル、ポリイミド、エポキシ樹脂、シリコン樹脂、PVB(ポリビニルブチラル)またはEVA(エチレンビニルアセテート)を用いることが出来る。本実施例では充填材として窒素を用いた。
【0117】
また充填材4103を吸湿性物質(好ましくは酸化バリウム)もしくは酸素を吸着しうる物質にさらしておくために、シーリング材4008の基板4001側の面に凹部4007を設けて吸湿性物質または酸素を吸着しうる物質4207を配置する。そして、吸湿性物質または酸素を吸着しうる物質4207が飛び散らないように、凹部カバー材4208によって吸湿性物質または酸素を吸着しうる物質4207は凹部4007に保持されている。なお凹部カバー材4208は目の細かいメッシュ状になっており、空気や水分は通し、吸湿性物質または酸素を吸着しうる物質4207は通さない構成になっている。吸湿性物質または酸素を吸着しうる物質4207を設けることで、発光素子4303の劣化を抑制出来る。
【0118】
図19(C)に示すように、画素電極4203が形成されると同時に、引き回し配線4005a上に接するように導電性膜4203aが形成される。
【0119】
また、異方導電性フィルム4300は導電性フィラー4300aを有している。基板4001とFPC4006とを熱圧着することで、基板4001上の導電性膜4203aとFPC4006上のFPC用配線4301とが、導電性フィラー4300aによって電気的に接続される。
【0120】
[実施例6]
本実施例においては、実施例2、3にて示した構成の発光装置の作製工程について、図22を用いて説明する。なお、説明に際しては画素部のみについて説明するが、駆動回路部においては、作製工程はこの限りではなく、ここでは説明を省略する。
【0121】
まず、図22(A)に示すように、バリウムホウケイ酸ガラス、またはアルミノホウケイ酸ガラス等のガラスからなる基板上に、酸化珪素膜、窒化珪素膜、もしくは酸化窒化珪素膜でなる下地膜(図示せず)を形成する。その後、非晶質構造を有する半導体膜をレーザ結晶化法や公知の熱結晶化法を用いて結晶化した結晶質半導体膜を所望の形状にパターニングし、島状半導体層2201、2202を得る(図22(A))。
【0122】
続いて、島状半導体層2201、2202を覆うゲート絶縁膜(図示せず)を形成する。その後、Ta、W、Ti、Mo、Al、Cu等から選ばれた元素、または前記元素を主成分とする合金材料もしくは化合物材料を用いて、ゲート電極を形成するための導電膜を形成する。その後、所望の形状にパターニングし、ゲート電極2203、2204(2203はゲート信号線を兼ねる)を得る(図22(B))。
【0123】
続いて、基板表面の平坦化を兼ねる絶縁膜(図示せず)を形成し、その上に画素電極2205を形成する。画素電極2205については、表示面が図の表側にあたる場合には反射電極とし、表示面が図の裏側にあたる場合には、光透過性のある透明電極とする。前者の反射電極の材料としては、MgAg等があり、後者の透明導電膜としては、ITO等が代表的である。画素電極2205もまた、前記材料でなる膜を形成した後、パターニングにより所望の形状を得る。
【0124】
その後、半導体層2201、2202、ゲート電極2204に達するコンタクトホール2206を開口し、配線2207〜2209(うち、2207はソース信号線、2208は電流供給線となる)を形成する。ここで、配線2209と、画素電極2206とは、互いに重なり合うようにして接点を取っている(図22(C))。
【0125】
続いて、隣接する画素の間に隔壁(図示せず)を形成し、発光エリア2210となる部分をエッチングにより開口する(図22(D))。その後、開口部分にEL層を形成して完成する。
【0126】
[実施例7]
発光素子を用いた発光装置は自発光型であるため、液晶ディスプレイに比べ、明るい場所での視認性に優れ、視野角が広い。従って、様々な電子機器の表示部に用いることが出来る。
【0127】
本発明の発光装置を用いた電子機器として、ビデオカメラ、デジタルカメラ、ゴーグル型ディスプレイ(ヘッドマウントディスプレイ)、ナビゲーションシステム、音響再生装置(カーオーディオ、オーディオコンポ等)、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末(モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等)、記録媒体を備えた画像再生装置(具体的にはDigital Versatile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置)などが挙げられる。特に、斜め方向から画面を見る機会が多い携帯情報端末は、視野角の広さが重要視されるため、発光装置を用いることが望ましい。それら電子機器の具体例を図21に示す。
【0128】
図21(A)はELディスプレイであり、筐体3001、支持台3002、表示部3003、スピーカー部3004、ビデオ入力端子3005等を含む。本発明の発光装置は表示部3003に用いることが出来る。発光装置は自発光型であるためバックライトが必要なく、液晶ディスプレイよりも薄い表示部とすることが出来る。なお、発光素子表示装置は、パソコン用、TV放送受信用、広告表示用などの全ての情報表示用表示装置が含まれる。
【0129】
図21(B)はデジタルスチルカメラであり、本体3101、表示部3102、受像部3103、操作キー3104、外部接続ポート3105、シャッター3106等を含む。本発明の発光装置は表示部3102に用いることが出来る。
【0130】
図21(C)はノート型パーソナルコンピュータであり、本体3201、筐体3202、表示部3203、キーボード3204、外部接続ポート3205、ポインティングマウス3206等を含む。本発明の発光装置は表示部3203に用いることが出来る。
【0131】
図21(D)はモバイルコンピュータであり、本体3301、表示部3302、スイッチ3303、操作キー3304、赤外線ポート3305等を含む。本発明の発光装置は表示部3302に用いることが出来る。
【0132】
図21(E)は記録媒体を備えた携帯型の画像再生装置(具体的にはDVD再生装置)であり、本体3401、筐体3402、表示部A3403、表示部B3404、記録媒体(DVD等)読込部3405、操作キー3406、スピーカー部3407等を含む。表示部A3403は主として画像情報を表示し、表示部B3404は主として文字情報を表示するが、本発明の発光装置はこれら表示部A、B3403、3404に用いることが出来る。なお、記録媒体を備えた画像再生装置には家庭用ゲーム機器なども含まれる。
【0133】
図21(F)はゴーグル型ディスプレイ(ヘッドマウントディスプレイ)であり、本体3501、表示部3502、アーム部3503を含む。本発明の発光装置は表示部3502に用いることが出来る。
【0134】
図21(G)はビデオカメラであり、本体3601、表示部3602、筐体3603、外部接続ポート3604、リモコン受信部3605、受像部3606、バッテリー3607、音声入力部3608、操作キー3609等を含む。本発明の発光装置は表示部3602に用いることが出来る。
【0135】
図21(H)は携帯電話であり、本体3701、筐体3702、表示部3703、音声入力部3704、音声出力部3705、操作キー3706、外部接続ポート3707、アンテナ3708等を含む。本発明の発光装置は表示部3703に用いることが出来る。なお、表示部3703は黒色の背景に白色の文字を表示することで携帯電話の消費電流を抑えることが出来る。
【0136】
なお、将来的に有機発光材料の発光輝度が高くなれば、出力した画像情報を含む光をレンズ等で拡大投影してフロント型若しくはリア型のプロジェクターに用いることも可能となる。
【0137】
また、上記電子機器はインターネットやCATV(ケーブルテレビ)などの電子通信回線を通じて配信された情報を表示することが多くなり、特に動画情報を表示する機会が増してきている。有機発光材料の応答速度は非常に高いため、発光装置は動画表示に好ましい。
【0138】
また、発光装置は発光している部分が電力を消費するため、発光部分が極力少なくなるように情報を表示することが望ましい。従って、携帯情報端末、特に携帯電話や音響再生装置のような文字情報を主とする表示部に発光装置を用いる場合には、非発光部分を背景として文字情報を発光部分で形成するように駆動することが望ましい。
【0139】
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器に用いることが可能である。また、本実施例の電子機器は実施例1〜6に示したいずれの構成の発光装置を用いても良い。
【0140】
【発明の効果】
本発明のとおり、駆動用TFTのサイズを大きくし、かつチャネル幅Wに対してチャネル長Lを大きくすることによって、飽和領域における電流特性の均一さに優れたTFTを、それぞれの画素の駆動用TFTとして用いることが出来、かつ駆動用TFTのばらつきがEL素子の発光輝度に影響しにくくすることが出来る。また、保持容量を、駆動用TFTのチャネル容量によってまかない、かつ発光エリア外の隔壁と重なり合う位置に配置することによって、高開口率化が期待出来る。
【図面の簡単な説明】
【図1】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図2】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図3】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図4】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図5】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図6】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図7】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図8】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図9】 発光装置と周辺回路とがモジュール化されて電子機器に用いられている例を示す図。
【図10】 本発明を用いて作製される画素部のレイアウト例を示す図。
【図11】 発光装置の概略を示す図。
【図12】 従来方法によってレイアウトされた2トランジスタ型画素の例を示す図。
【図13】 実測したTFTのチャネル容量を示す図。
【図14】 実測したTFTのIDSバラツキを示す図。
【図15】 EL素子の動作点を説明する図。
【図16】 駆動用TFTの動作範囲が線形領域である場合と飽和領域である場合とにおける、EL素子の劣化と輝度への影響を説明する図。
【図17】 TFTの動作時における、チャネル周辺での電荷の振る舞いについて説明する図。
【図18】 TFTの各部における容量の要素について説明する図。
【図19】 発光装置の上面図および断面図。
【図20】 2トランジスタ型画素のマトリクスを示す図。
【図21】 本発明が適用可能な電子機器の例を示す図。
【図22】 画素部の作製工程を簡略に説明する図。
Claims (9)
- 隣接する2つの画素電極の間に配置された隔壁と、
前記隔壁の下に配置された配線と、
チャネル領域とソース領域とドレイン領域とを有する半導体層と、ゲート絶縁膜と、ゲート電極と、を有する駆動用の薄膜トランジスタと、を有し、
前記ゲート電極は、前記配線の下方に配置されており、
前記チャネル領域は、前記ゲート絶縁膜を介して前記ゲート電極の下に配置されており、
前記チャネル領域の形状は、U字状、S字状あるいはミアンダ状であり、
前記駆動用の薄膜トランジスタのゲート・ソース間電圧を保持するための容量部は、前記半導体層と、前記ゲート絶縁膜と、前記ゲート電極と、によって設けられていることを特徴とする発光装置。 - 請求項1において、
前記薄膜トランジスタのソース側又はドレイン側の一方は、前記配線と接続されており、
前記薄膜トランジスタのソース側又はドレイン側の他方は、前記隣接する2つの画素電極の一方に接続されていることを特徴とする発光装置。 - 請求項1又は請求項2において、
前記薄膜トランジスタのチャネル長がL、チャネル幅がWであるとき、L>5Wであることを特徴とする発光装置。 - 請求項1乃至請求項3のいずれか一項において、
前記薄膜トランジスタのチャネル長がL、チャネル幅がWであるとき、L×W>200μm 2 であることを特徴とする発光装置。 - 請求項1乃至請求項4のいずれか一項において、
前記配線は、電流供給線であることを特徴とする発光装置。 - 請求項1乃至請求項5のいずれか一項において、
前記半導体層は、非晶質半導体層を結晶化した結晶質半導体層であることを特徴とする発光装置。 - 請求項1乃至請求項6のいずれか一項において、
前記薄膜トランジスタのゲート・ソース間電圧がVGS、ソース・ドレイン間電圧がVDS、しきい値電圧がVthであるとき、
|VDS|<|VGS|−|Vth|となるように駆動されることを特徴とする発光装置。 - 請求項1乃至請求項6のいずれか一項において、
前記薄膜トランジスタのゲート・ソース間電圧がVGS、ソース・ドレイン間電圧がVDS、しきい値電圧がVthであるとき、
|VDS|≧|VGS|−|Vth|となるように駆動されることを特徴とする発光装置。 - 請求項1乃至請求項8のいずれか一項に記載の発光装置を用いたことを特徴とする電子機器。
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