JP3724485B2 - 信号処理回路及び信号処理方法 - Google Patents
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Description
即ち、時刻t2でカウンタ回路97がリセットされるタイミングで、時刻t1でラッチしたカウント値をラッチ回路98から出力するように切り替え回路78で制御する。また、時刻t4でカウンタ回路95がリセットされるタイミングで、時刻t3でラッチしたカウント値をラッチ回路96から出力するように切り替え回路を制御する。
11 両エッジ検出回路
12 カウンタ回路
13、75、76、96、98 ラッチ回路
14 デジタルLPF
15 FM変調信号端子
16 クロックパルス端子
17 ディジタルFM信号端子
40 ディスク
41 光学系
42 スピンドルモータ
43 スレッドモータ
44 レーザドライバ
45 フロントモニタ
46 ALPC
47 記憶補償回路
48 ウォブル信号処理部
49 RFアンプ
50 フォーカス/トラッキングサーボ回路
51 送りサーボ回路
52 スピンドルサーボ回路
53 CDエンコード/デコード回路
54 D/Aコンバータ
55 オーディオアンプ
56、58 RAM
57 CD−ROMエンコード/デコード回路
59 インターフェース/バッファコントローラ
60 CPU
61 ホストコンピュータ
71 正極性ゲート
72 負極正ゲート
73、97 カウンタ回路(正極性)
74、95 カウンタ回路(負極性)
77、92 R−Sフリップフロップ
78 切り替え回路
79 デジタルLPF
80、81、82、101、103、104 遅延回路
83 ORゲート
87、88 ANDゲート
89 インバータ
90 ハイゲートカウンタ
93 ローゲートカウンタ
91、94 ゲート回路
99 ハイエッジ出力回路
102 ローエッジ出力回路
100 光ディスク装置
105 PLL回路
106 90°位相比較回路
107 VCO
108 1/N分周器
Claims (7)
- 入力パルス信号に応じたデジタル信号を生成する信号処理回路において、
前記入力パルス信号と所定の位相差を有する位相差パルス信号を生成する位相差パルス信号生成手段と、
前記位相差パルス信号生成手段で生成された前記位相差パルス信号に基づいて前記入力パルス信号のうちノイズ成分を許容する少なくとも一つのパルスを含む所定の期間を設定する設定手段と、
前記設定手段で設定された前記所定の期間に、いずれか一方の極性でクロックパルスを出力するクロックパルス出力手段と、
正極性で出力される前記クロックパルスと負極性で出力される前記クロックパルスをそれぞれ独立してカウントするカウント手段と、
前記位相差パルス信号生成手段で生成された前記位相差パルス信号及び前記カウント手段のカウント値を基に出力デジタル信号を出力する出力手段とを有することを特徴とする信号処理回路。 - 前記クロックパルス出力手段は、
前記入力パルス信号が正極性のときにクロックパルスを出力する第一のクロックパルス出力手段と、
前記入力パルス信号が負極性のときにクロックパルスを出力する第二のクロックパルス出力手段とを有し、
前記カウント手段は、
前記第一のクロックパルス出力手段からのクロックパルスをカウントする第一のカウント手段と、
前記第二のクロックパルス出力手段からのクロックパルスをカウントする第二のカウント手段とを有することを特徴とする請求項1記載の信号処理回路。 - 前記出力手段は、
前記位相差パルス信号のアップエッジに応じて第三のタイミング信号を出力するアップエッジ出力手段と、
前記位相差パルス信号のダウンエッジに応じて第四のタイミング信号を出力するダウンエッジ出力手段と、
前記第三のタイミング信号に応じて前記第一のカウント手段のカウント値をラッチする第一のラッチ手段と、
前記第四のタイミング信号に応じて前記第二のカウント手段のカウント値をラッチする第二のラッチ手段とを有することを特徴とする請求項2記載の信号処理回路。 - 前記出力手段は、
前記第三のタイミング信号を遅延して第五のタイミング信号を出力する第一の遅延手段と、
前記第四のタイミング信号を遅延して第六のタイミング信号を出力する第二の遅延手段とを有し、
前記第一のカウント手段は、前記第五のタイミング信号に応じてリセットされ、
前記第二のカウント手段は、前記第六のタイミング信号に応じてリセットされることを特徴とする請求項3記載の信号処理回路。 - 前記出力手段は、
前記位相差パルス信号の出力を遅延して遅延位相差パルス信号を出力する第三の遅延手段を有し、
前記遅延位相差パルス信号の出力に応じて前記第一のラッチ手段にラッチされた第一のカウント値と前記第二のラッチ手段にラッチされた第二のカウント値の出力を切り替える切り替え手段を有することを特徴とする請求項3又は4記載の信号処理回路。 - 前記出力手段は、
デジタルローパスフィルタを含むことを特徴とする請求項1乃至5いずれか一項記載の信号処理回路。 - 入力パルス信号に応じたデジタル信号を生成する信号処理方法において、
前記入力パルス信号と所定の位相差を有する位相差パルス信号を生成する位相差パルス信号生成手順と、
前記位相差パルス信号生成手順で生成された前記位相差パルス信号に基づいて前記入力パルス信号のうちノイズ成分を許容する少なくとも一つのパルスを含む所定の期間を設定する設定手順と、
前記設定手順で設定された前記所定の期間に、いずれか一方の極性でクロックパルスを出力するクロックパルス出力手順と、
正極性で出力される前記クロックパルスと負極性で出力される前記クロックパルスをそれぞれ独立してカウントするカウント手順と、
前記位相差パルス手順で生成された位相差パルス信号及び前記カウント手順のカウント値を基に出力デジタル信号を出力する出力手順とを有することを特徴とする信号処理方法。
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