JP3299853B2 - 通信システムおよび通信用中継器 - Google Patents
通信システムおよび通信用中継器Info
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- G06F13/40—Bus structure
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Description
【０００１】
【産業上の利用分野】この発明は、中継器を介してホス
ト装置と複数の端末との間で通信を行う通信システム、
およびその中継器に関する。
ト装置と複数の端末との間で通信を行う通信システム、
およびその中継器に関する。
【０００２】
【従来の技術】中継器を介してホスト装置と複数の端末
との間で通信を行う通信システムでは、ホスト装置の通
信速度よりも端末の通信速度が遅いことがある。
との間で通信を行う通信システムでは、ホスト装置の通
信速度よりも端末の通信速度が遅いことがある。
【０００３】例えば、家庭用ゲーム機システムは、従来
一般に、ゲーム機本体に直接、端末を接続して、ゲーム
機本体と端末との間で通信を行うようになっている。こ
れに対して最近、複数の者が同時にゲームをすることが
できるように、ゲーム機本体に中継器を接続し、その中
継器に同時に複数の端末を接続できるようにして、中継
器を介してホスト装置であるゲーム機本体と複数の端末
との間で通信を行うようにしたものが考えられ、市販さ
れている。この場合、端末の低コスト化をはかるなどの
理由から、端末の通信速度がホスト装置であるゲーム機
本体の通信速度よりも遅いことがある。
一般に、ゲーム機本体に直接、端末を接続して、ゲーム
機本体と端末との間で通信を行うようになっている。こ
れに対して最近、複数の者が同時にゲームをすることが
できるように、ゲーム機本体に中継器を接続し、その中
継器に同時に複数の端末を接続できるようにして、中継
器を介してホスト装置であるゲーム機本体と複数の端末
との間で通信を行うようにしたものが考えられ、市販さ
れている。この場合、端末の低コスト化をはかるなどの
理由から、端末の通信速度がホスト装置であるゲーム機
本体の通信速度よりも遅いことがある。
【０００４】このように、中継器を介してホスト装置と
ホスト装置の通信速度より遅い通信速度の複数の端末と
の間で通信を行う場合の通信方法としては、従来、次の
２つの方法のいずれかがとられている。
ホスト装置の通信速度より遅い通信速度の複数の端末と
の間で通信を行う場合の通信方法としては、従来、次の
２つの方法のいずれかがとられている。
【０００５】第１の方法は、まず図１０（Ａ）の矢印１
ａで示すように、中継器２を介してホスト装置３と第１
の端末４との間で、端末４の通信速度に合う低速実時間
で通信を行い、次に図１０（Ｂ）の矢印１ｂで示すよう
に、中継器２を介してホスト装置３と第２の端末５との
間で、同様に低速実時間で通信を行い、次に図１０
（Ｃ）の矢印１ｃで示すように、中継器２を介してホス
ト装置３と第３の端末６との間で、同様に低速実時間で
通信を行う、というように、中継器２を介してホスト装
置３と複数の端末４〜６との間で、異なる期間に順次、
それぞれ低速実時間で通信を行う方法である。
ａで示すように、中継器２を介してホスト装置３と第１
の端末４との間で、端末４の通信速度に合う低速実時間
で通信を行い、次に図１０（Ｂ）の矢印１ｂで示すよう
に、中継器２を介してホスト装置３と第２の端末５との
間で、同様に低速実時間で通信を行い、次に図１０
（Ｃ）の矢印１ｃで示すように、中継器２を介してホス
ト装置３と第３の端末６との間で、同様に低速実時間で
通信を行う、というように、中継器２を介してホスト装
置３と複数の端末４〜６との間で、異なる期間に順次、
それぞれ低速実時間で通信を行う方法である。
【０００６】第２の方法は、端末からホスト装置へのデ
ータ転送については、まず図１１（Ａ）の矢印７ａ，７
ｂ，７ｃで示すように、それぞれの端末４，５，６から
のデータを中継器２に低速で一度に送信して中継器２に
蓄えておき、次に図１１（Ｂ）の矢印８で示すように、
その蓄えた全データを中継器２からホスト装置３に高速
で送信する方法である。
ータ転送については、まず図１１（Ａ）の矢印７ａ，７
ｂ，７ｃで示すように、それぞれの端末４，５，６から
のデータを中継器２に低速で一度に送信して中継器２に
蓄えておき、次に図１１（Ｂ）の矢印８で示すように、
その蓄えた全データを中継器２からホスト装置３に高速
で送信する方法である。
【０００７】ホスト装置３から端末４，５，６へのデー
タ転送については、まず、それぞれの端末４，５，６へ
のデータをホスト装置３から中継器２に高速で送信して
中継器２に蓄えておき、次に、その蓄えたそれぞれの端
末４，５，６へのデータを中継器２から端末４，５，６
に低速で一度に送信する。
タ転送については、まず、それぞれの端末４，５，６へ
のデータをホスト装置３から中継器２に高速で送信して
中継器２に蓄えておき、次に、その蓄えたそれぞれの端
末４，５，６へのデータを中継器２から端末４，５，６
に低速で一度に送信する。
【０００８】
【発明が解決しようとする課題】しかしながら、従来の
第１の通信方法は、ホスト装置３と複数の端末４〜６と
の間で、異なる期間に順次、それぞれ低速実時間で通信
を行うので、ホスト装置３が通信に拘束される時間が長
くなる欠点がある。
第１の通信方法は、ホスト装置３と複数の端末４〜６と
の間で、異なる期間に順次、それぞれ低速実時間で通信
を行うので、ホスト装置３が通信に拘束される時間が長
くなる欠点がある。
【０００９】また、従来の第２の通信方法は、端末４〜
６と中継器２との間でホスト装置３が関与しないデータ
転送がなされるので、中継器２内に独立したタイミング
発生回路を設けて、これからそれぞれの端末４〜６に転
送クロックを供給しなければならず、中継器２の構成が
複雑かつ高コストになる欠点がある。
６と中継器２との間でホスト装置３が関与しないデータ
転送がなされるので、中継器２内に独立したタイミング
発生回路を設けて、これからそれぞれの端末４〜６に転
送クロックを供給しなければならず、中継器２の構成が
複雑かつ高コストになる欠点がある。
【００１０】そこで、本発明の目的は、中継器を介して
ホスト装置とホスト装置の通信速度より遅い通信速度の
複数の端末との間で通信を行う通信システムおよびその
中継器において、ホスト装置が通信に拘束される時間を
短くするとともに、ホスト装置から中継器に供給される
転送クロックをそのまますべての端末への転送クロック
として用いることにより中継器内の独立したタイミング
発生回路などを不要にして、中継器の構成を簡略化・低
コスト化することにある。
ホスト装置とホスト装置の通信速度より遅い通信速度の
複数の端末との間で通信を行う通信システムおよびその
中継器において、ホスト装置が通信に拘束される時間を
短くするとともに、ホスト装置から中継器に供給される
転送クロックをそのまますべての端末への転送クロック
として用いることにより中継器内の独立したタイミング
発生回路などを不要にして、中継器の構成を簡略化・低
コスト化することにある。
【００１１】
【課題を解決するための手段】上記課題に対応した本発
明の中継装置は、ホスト装置と複数の端末装置との間に
接続される中継装置であって、第1の時間期間におい
て、前記中継装置は、一部の端末装置からのデータを受
信して前記ホスト装置に第1速度で中継するとともに、
他の端末装置からのデータを前記第1速度で受信して記
憶しておき、第2の時間期間において、前記中継装置
は、前記記憶されたデータを前記ホスト装置に、前記第
1速度よりも速い第2速度で送信することを特徴とする。
ここで、前記中継装置が、前記複数の端末装置のそれぞ
れに対応したバッファメモリを備え、前記第１の時間期
間において前記第１速度で前記バッファメモリに記憶さ
れているデータを前記複数の端末装置にそれぞれ送信す
るとともに前記ホスト装置から前記一部の端末装置に対
するデータを受信して前記バッファメモリに記憶し、前
記第2の時間期間において前記第２速度で前記ホスト装
置から前記他の端末装置に対するデータを受信して前記
バッファメモリに記憶する、ようにしてもよい。
明の中継装置は、ホスト装置と複数の端末装置との間に
接続される中継装置であって、第1の時間期間におい
て、前記中継装置は、一部の端末装置からのデータを受
信して前記ホスト装置に第1速度で中継するとともに、
他の端末装置からのデータを前記第1速度で受信して記
憶しておき、第2の時間期間において、前記中継装置
は、前記記憶されたデータを前記ホスト装置に、前記第
1速度よりも速い第2速度で送信することを特徴とする。
ここで、前記中継装置が、前記複数の端末装置のそれぞ
れに対応したバッファメモリを備え、前記第１の時間期
間において前記第１速度で前記バッファメモリに記憶さ
れているデータを前記複数の端末装置にそれぞれ送信す
るとともに前記ホスト装置から前記一部の端末装置に対
するデータを受信して前記バッファメモリに記憶し、前
記第2の時間期間において前記第２速度で前記ホスト装
置から前記他の端末装置に対するデータを受信して前記
バッファメモリに記憶する、ようにしてもよい。
【００１２】また、上記課題に対応した本発明の別の中
継装置は、ホスト装置との間のデータ通信を行うための
対ホスト送受信部と、第１端末装置との間のデータ通信
を行うための第１端末送受信部と、第２端末装置との間
のデータ通信を行うための第２端末送受信部と、前記対
ホスト送受信部と前記第１端末送受信部との間に接続さ
れる第１バッファと、前記対ホスト送受信部と前記第２
端末送受信部との間に接続される第２バッファと、前記
第２バッファの出力と前記第１端末送受信部を介した第
１端末装置からの入力を選択的に前記対ホスト送受信部
に接続するセレクタと、制御部とを有し、前記制御部
は、前記ホスト装置から供給される第１速度のクロック
信号に従い、前記第１端末装置からのデータを前記ホス
ト装置に直接送信するとともに、前記第２バッファに前
記第２端末装置から受信したデータを記憶させ、前記ホ
スト装置から供給される前記第１速度よりも速い第２速
度のクロック信号に従い、前記第２バッファに記憶され
たデータを前記ホスト装置に送信する、ことを特徴とす
る。
継装置は、ホスト装置との間のデータ通信を行うための
対ホスト送受信部と、第１端末装置との間のデータ通信
を行うための第１端末送受信部と、第２端末装置との間
のデータ通信を行うための第２端末送受信部と、前記対
ホスト送受信部と前記第１端末送受信部との間に接続さ
れる第１バッファと、前記対ホスト送受信部と前記第２
端末送受信部との間に接続される第２バッファと、前記
第２バッファの出力と前記第１端末送受信部を介した第
１端末装置からの入力を選択的に前記対ホスト送受信部
に接続するセレクタと、制御部とを有し、前記制御部
は、前記ホスト装置から供給される第１速度のクロック
信号に従い、前記第１端末装置からのデータを前記ホス
ト装置に直接送信するとともに、前記第２バッファに前
記第２端末装置から受信したデータを記憶させ、前記ホ
スト装置から供給される前記第１速度よりも速い第２速
度のクロック信号に従い、前記第２バッファに記憶され
たデータを前記ホスト装置に送信する、ことを特徴とす
る。
【００１３】さらに、上記課題に対応した本発明の通信
システムは、ホスト装置と、複数の端末装置と、それら
を接続する中継装置とを含む通信システムであって、前
記ホスト装置は、前記中継装置に対し、第１の時間期間
において第１速度のクロック信号を供給するとともに、
第２の時間期間において前記第１速度よりも速い第２速
度のクロック信号を供給し、前記中継装置は、前記第１
の時間期間において前記第１速度のクロック信号に同期
して、一部の端末装置からのデータを前記ホスト装置に
中継するとともに、他の端末装置からのデータを受信し
て記憶しておき、前記第2の時間期間において前記第２
速度のクロック信号に同期して、前記記憶されたデータ
を前記ホスト装置に送信する、ことを特徴とする。ここ
で、上記通信システムの前記中継装置が、前記複数の端
末装置のそれぞれに対応したバッファメモリを備え、前
記第１の時間期間において前記第１速度のクロック信号
に同期して、前記バッファメモリに記憶されているデー
タを前記複数の端末装置にそれぞれ送信するとともに前
記ホスト装置から前記一部の端末装置に対するデータを
受信して前記バッファメモリに記憶し、前記第2の時間
期間において前記第２速度のクロック信号に同期して、
前記ホスト装置から前記他の端末装置に対するデータを
受信して前記バッファメモリに記憶する、ように構成す
ることもできる。
システムは、ホスト装置と、複数の端末装置と、それら
を接続する中継装置とを含む通信システムであって、前
記ホスト装置は、前記中継装置に対し、第１の時間期間
において第１速度のクロック信号を供給するとともに、
第２の時間期間において前記第１速度よりも速い第２速
度のクロック信号を供給し、前記中継装置は、前記第１
の時間期間において前記第１速度のクロック信号に同期
して、一部の端末装置からのデータを前記ホスト装置に
中継するとともに、他の端末装置からのデータを受信し
て記憶しておき、前記第2の時間期間において前記第２
速度のクロック信号に同期して、前記記憶されたデータ
を前記ホスト装置に送信する、ことを特徴とする。ここ
で、上記通信システムの前記中継装置が、前記複数の端
末装置のそれぞれに対応したバッファメモリを備え、前
記第１の時間期間において前記第１速度のクロック信号
に同期して、前記バッファメモリに記憶されているデー
タを前記複数の端末装置にそれぞれ送信するとともに前
記ホスト装置から前記一部の端末装置に対するデータを
受信して前記バッファメモリに記憶し、前記第2の時間
期間において前記第２速度のクロック信号に同期して、
前記ホスト装置から前記他の端末装置に対するデータを
受信して前記バッファメモリに記憶する、ように構成す
ることもできる。
【００１４】さらに、上記課題に対応した本発明の他の
通信システムは、ホスト装置、複数の端末装置と、それ
らを接続する中継装置とを含む通信システムであって、
前記ホスト装置は、前記中継装置に対し、第１の時間期
間において第１速度のクロック信号を供給するととも
に、第２の時間期間において前記第１速度よりも速い第
２速度のクロック信号を供給し、前記中継装置は、ホス
ト装置との間のデータ通信を行うための対ホスト送受信
部と、第１端末装置との間のデータ通信を行うための第
１端末送受信部と、第２端末装置との間のデータ通信を
行うための第２端末送受信部と、前記対ホスト送受信部
と前記第１端末送受信部との間に接続される第１バッフ
ァと、前記対ホスト送受信部と前記第２端末送受信部と
の間に接続される第２バッファと、前記第２バッファの
出力と前記第１端末送受信部を介した第１端末装置から
の入力を選択的に前記対ホスト送受信部に接続するセレ
クタと、制御部とを有し、前記制御部は、前記第１速度
のクロック信号に同期して、前記第１端末装置からのデ
ータを前記ホスト装置に直接送信するとともに、前記第
２バッファに前記第２端末装置から受信したデータを記
憶させ、前記ホスト装置から供給される第２速度のクロ
ック信号に同期して、前記第２バッファに記憶されたデ
ータを前記ホスト装置に送信する、ことを特徴とする。
通信システムは、ホスト装置、複数の端末装置と、それ
らを接続する中継装置とを含む通信システムであって、
前記ホスト装置は、前記中継装置に対し、第１の時間期
間において第１速度のクロック信号を供給するととも
に、第２の時間期間において前記第１速度よりも速い第
２速度のクロック信号を供給し、前記中継装置は、ホス
ト装置との間のデータ通信を行うための対ホスト送受信
部と、第１端末装置との間のデータ通信を行うための第
１端末送受信部と、第２端末装置との間のデータ通信を
行うための第２端末送受信部と、前記対ホスト送受信部
と前記第１端末送受信部との間に接続される第１バッフ
ァと、前記対ホスト送受信部と前記第２端末送受信部と
の間に接続される第２バッファと、前記第２バッファの
出力と前記第１端末送受信部を介した第１端末装置から
の入力を選択的に前記対ホスト送受信部に接続するセレ
クタと、制御部とを有し、前記制御部は、前記第１速度
のクロック信号に同期して、前記第１端末装置からのデ
ータを前記ホスト装置に直接送信するとともに、前記第
２バッファに前記第２端末装置から受信したデータを記
憶させ、前記ホスト装置から供給される第２速度のクロ
ック信号に同期して、前記第２バッファに記憶されたデ
ータを前記ホスト装置に送信する、ことを特徴とする。
【００１５】
【実施例】この発明の通信システムおよびその中継器の
一例を、１ビットごとの同期通信、８ビットごとの非同
期通信による、三端末の双方向シリアル通信の家庭用ゲ
ーム機システムおよびその中継器の場合を例として、以
下に示す。
一例を、１ビットごとの同期通信、８ビットごとの非同
期通信による、三端末の双方向シリアル通信の家庭用ゲ
ーム機システムおよびその中継器の場合を例として、以
下に示す。
【００１６】図１は、そのゲーム機システムおよびその
中継器の例を示し、通信システムとしてのゲーム機シス
テム１０は、ホスト装置としてのゲーム機本体２０が、
その処理結果の映像および音声を出力して操作者に示す
映像音声出力装置９０に接続され、ゲーム機本体２０に
中継器３０が接続され、中継器３０に端末７１，７２，
７３が接続されて構成される。
中継器の例を示し、通信システムとしてのゲーム機シス
テム１０は、ホスト装置としてのゲーム機本体２０が、
その処理結果の映像および音声を出力して操作者に示す
映像音声出力装置９０に接続され、ゲーム機本体２０に
中継器３０が接続され、中継器３０に端末７１，７２，
７３が接続されて構成される。
【００１７】中継器３０は、送受信部３１，４１，４
２，４３、バッファメモリとしてのＦＩＦＯバッファ５
１，５２，５３、セレクタ３２および制御回路３３を備
えるものとして構成される。
２，４３、バッファメモリとしてのＦＩＦＯバッファ５
１，５２，５３、セレクタ３２および制御回路３３を備
えるものとして構成される。
【００１８】送受信部３１は、ゲーム機本体２０からの
データをシリアル通信により中継器３０に受信するとと
もに、中継器３０からのデータをシリアル通信によりゲ
ーム機本体２０に送信する。また、ゲーム機本体２０か
らは送受信部３１を介して中継器３０に、後述するよう
なシリアル転送クロックが送信される。
データをシリアル通信により中継器３０に受信するとと
もに、中継器３０からのデータをシリアル通信によりゲ
ーム機本体２０に送信する。また、ゲーム機本体２０か
らは送受信部３１を介して中継器３０に、後述するよう
なシリアル転送クロックが送信される。
【００１９】送受信部４１，４２，４３は、それぞれ上
記のゲーム機本体２０から中継器３０に送信された転送
クロックによって、それぞれ中継器３０からのデータを
シリアル通信により端末７１，７２，７３に送信すると
ともに、端末７１，７２，７３からのデータをシリアル
通信により中継器３０に受信する。
記のゲーム機本体２０から中継器３０に送信された転送
クロックによって、それぞれ中継器３０からのデータを
シリアル通信により端末７１，７２，７３に送信すると
ともに、端末７１，７２，７３からのデータをシリアル
通信により中継器３０に受信する。
【００２０】ＦＩＦＯバッファ５１，５２，５３は、そ
れぞれ端末７１，７２，７３に対応するもので、ＦＩＦ
Ｏバッファ５１には、ゲーム機本体２０からのデータが
書き込まれ、ＦＩＦＯバッファ５１からのデータは、端
末７１に送信される。
れぞれ端末７１，７２，７３に対応するもので、ＦＩＦ
Ｏバッファ５１には、ゲーム機本体２０からのデータが
書き込まれ、ＦＩＦＯバッファ５１からのデータは、端
末７１に送信される。
【００２１】ＦＩＦＯバッファ５２には、ゲーム機本体
２０または端末７２からのデータが書き込まれ、ＦＩＦ
Ｏバッファ５２からのデータは、端末７２またはゲーム
機本体２０に送信される。ＦＩＦＯバッファ５３には、
ゲーム機本体２０または端末７３からのデータが書き込
まれ、ＦＩＦＯバッファ５３からのデータは、端末７３
またはゲーム機本体２０に送信される。
２０または端末７２からのデータが書き込まれ、ＦＩＦ
Ｏバッファ５２からのデータは、端末７２またはゲーム
機本体２０に送信される。ＦＩＦＯバッファ５３には、
ゲーム機本体２０または端末７３からのデータが書き込
まれ、ＦＩＦＯバッファ５３からのデータは、端末７３
またはゲーム機本体２０に送信される。
【００２２】セレクタ３２は、端末７１からのデータ、
ＦＩＦＯバッファ５２からのデータ、およびＦＩＦＯバ
ッファ５３からのデータを、後述するように順次選択し
て、送受信部３１を介してゲーム機本体２０に送信する
ものである。
ＦＩＦＯバッファ５２からのデータ、およびＦＩＦＯバ
ッファ５３からのデータを、後述するように順次選択し
て、送受信部３１を介してゲーム機本体２０に送信する
ものである。
【００２３】制御回路３３は、上記のゲーム機本体２０
から中継器３０に送信された転送クロックからタイミン
グ信号を生成して、送受信部３１，４１〜４３を制御
し、セレクタ３２を後述するように切り替え、ＦＩＦＯ
バッファ５１〜５３を制御するものである。
から中継器３０に送信された転送クロックからタイミン
グ信号を生成して、送受信部３１，４１〜４３を制御
し、セレクタ３２を後述するように切り替え、ＦＩＦＯ
バッファ５１〜５３を制御するものである。
【００２４】上記のような構成のゲーム機システム１０
の動作を、図２〜図９を用いて示す。
の動作を、図２〜図９を用いて示す。
【００２５】中継器３０を介してゲーム機本体２０と端
末７１〜７３との間で繰り返し通信を行った後の、図２
の時点ｔ１においては、図３に示すように、ＦＩＦＯバ
ッファ５１，５２，５３には、それぞれ前回、ゲーム機
本体２０から送信された１バイトのデータＡ１，Ｂ１，
Ｃ１が蓄えられている。
末７１〜７３との間で繰り返し通信を行った後の、図２
の時点ｔ１においては、図３に示すように、ＦＩＦＯバ
ッファ５１，５２，５３には、それぞれ前回、ゲーム機
本体２０から送信された１バイトのデータＡ１，Ｂ１，
Ｃ１が蓄えられている。
【００２６】この状態から、中継器３０を介してゲーム
機本体２０と端末７１〜７３との間では、１つの通信パ
ケット中で以下の３つのフェーズにより通信がなされ
る。
機本体２０と端末７１〜７３との間では、１つの通信パ
ケット中で以下の３つのフェーズにより通信がなされ
る。
【００２７】第１のフェーズは、図２の期間Ｐ１で示す
ような、それぞれの端末７１〜７３へのデータの送信を
伴う低速でのデータ転送である。
ような、それぞれの端末７１〜７３へのデータの送信を
伴う低速でのデータ転送である。
【００２８】すなわち、期間Ｐ１では、ゲーム機本体２
０からの転送クロックＣＫが低速のクロックＣＫ１とさ
れるとともに、中継器３０のセレクタ３２が端末７１か
らのデータを選択する状態に切り替えられて、図４にも
示すように、端末７１からの今回分のデータａ１がＦＩ
ＦＯバッファ５１に蓄えられることなく直接、ゲーム機
本体２０に送信される。
０からの転送クロックＣＫが低速のクロックＣＫ１とさ
れるとともに、中継器３０のセレクタ３２が端末７１か
らのデータを選択する状態に切り替えられて、図４にも
示すように、端末７１からの今回分のデータａ１がＦＩ
ＦＯバッファ５１に蓄えられることなく直接、ゲーム機
本体２０に送信される。
【００２９】同時に、前回の通信でＦＩＦＯバッファ５
１に蓄えられたデータＡ１が端末７１に送信されるとと
もに、ゲーム機本体２０からの次回分のデータＡ２がＦ
ＩＦＯバッファ５１に蓄えられる。
１に蓄えられたデータＡ１が端末７１に送信されるとと
もに、ゲーム機本体２０からの次回分のデータＡ２がＦ
ＩＦＯバッファ５１に蓄えられる。
【００３０】さらに同時に、前回の通信でＦＩＦＯバッ
ファ５２，５３に蓄えられたデータＢ１，Ｃ１がそれぞ
れ端末７２，７３に送信されるとともに、端末７２，７
３からの今回分のデータｂ１，ｃ１がそれぞれＦＩＦＯ
バッファ５２，５３に蓄えられる。
ファ５２，５３に蓄えられたデータＢ１，Ｃ１がそれぞ
れ端末７２，７３に送信されるとともに、端末７２，７
３からの今回分のデータｂ１，ｃ１がそれぞれＦＩＦＯ
バッファ５２，５３に蓄えられる。
【００３１】第１のフェーズの終了時点である、図２の
時点ｔ２においては、図５に示すように、ＦＩＦＯバッ
ファ５１にはゲーム機本体２０から送信された１バイト
のデータＡ２が、ＦＩＦＯバッファ５２，５３にはそれ
ぞれ端末７２，７３から送信された１バイトのデータｂ
１，ｃ１が、それぞれ蓄えられることになる。
時点ｔ２においては、図５に示すように、ＦＩＦＯバッ
ファ５１にはゲーム機本体２０から送信された１バイト
のデータＡ２が、ＦＩＦＯバッファ５２，５３にはそれ
ぞれ端末７２，７３から送信された１バイトのデータｂ
１，ｃ１が、それぞれ蓄えられることになる。
【００３２】第２のフェーズは、図２の期間Ｐ２で示す
ような、端末７２からのデータの中継器３０からゲーム
機本体２０への高速の転送である。
ような、端末７２からのデータの中継器３０からゲーム
機本体２０への高速の転送である。
【００３３】すなわち、期間Ｐ２では、ゲーム機本体２
０からの転送クロックＣＫが高速のクロックＣＫ２とさ
れるとともに、中継器３０のセレクタ３２がＦＩＦＯバ
ッファ５２からのデータを選択する状態に切り替えられ
て、図６にも示すように、第１のフェーズにおいてＦＩ
ＦＯバッファ５２に蓄えられた端末７２からのデータｂ
１が、ＦＩＦＯバッファ５２からゲーム機本体２０に送
信される。同時に、ゲーム機本体２０からの次回分のデ
ータＢ２がＦＩＦＯバッファ５２に蓄えられる。
０からの転送クロックＣＫが高速のクロックＣＫ２とさ
れるとともに、中継器３０のセレクタ３２がＦＩＦＯバ
ッファ５２からのデータを選択する状態に切り替えられ
て、図６にも示すように、第１のフェーズにおいてＦＩ
ＦＯバッファ５２に蓄えられた端末７２からのデータｂ
１が、ＦＩＦＯバッファ５２からゲーム機本体２０に送
信される。同時に、ゲーム機本体２０からの次回分のデ
ータＢ２がＦＩＦＯバッファ５２に蓄えられる。
【００３４】第２のフェーズの終了時点である、図２の
時点ｔ３においては、図７に示すように、ＦＩＦＯバッ
ファ５１，５２にはそれぞれゲーム機本体２０から送信
された１バイトのデータＡ２，Ｂ２が、ＦＩＦＯバッフ
ァ５３には端末７３から送信された１バイトのデータｃ
１が、それぞれ蓄えられることになる。
時点ｔ３においては、図７に示すように、ＦＩＦＯバッ
ファ５１，５２にはそれぞれゲーム機本体２０から送信
された１バイトのデータＡ２，Ｂ２が、ＦＩＦＯバッフ
ァ５３には端末７３から送信された１バイトのデータｃ
１が、それぞれ蓄えられることになる。
【００３５】第３のフェーズは、図２の期間Ｐ３で示す
ような、端末７３からのデータの中継器３０からゲーム
機本体２０への高速の転送である。
ような、端末７３からのデータの中継器３０からゲーム
機本体２０への高速の転送である。
【００３６】すなわち、期間Ｐ３では、ゲーム機本体２
０からの転送クロックＣＫが期間Ｐ２と同様に高速のク
ロックＣＫ２とされるとともに、中継器３０のセレクタ
３２がＦＩＦＯバッファ５３からのデータを選択する状
態に切り替えられて、図８にも示すように、第１のフェ
ーズにおいてＦＩＦＯバッファ５３に蓄えられた端末７
３からのデータｃ１が、ＦＩＦＯバッファ５３からゲー
ム機本体２０に送信される。同時に、ゲーム機本体２０
からの次回分のデータＣ２がＦＩＦＯバッファ５３に蓄
えられる。
０からの転送クロックＣＫが期間Ｐ２と同様に高速のク
ロックＣＫ２とされるとともに、中継器３０のセレクタ
３２がＦＩＦＯバッファ５３からのデータを選択する状
態に切り替えられて、図８にも示すように、第１のフェ
ーズにおいてＦＩＦＯバッファ５３に蓄えられた端末７
３からのデータｃ１が、ＦＩＦＯバッファ５３からゲー
ム機本体２０に送信される。同時に、ゲーム機本体２０
からの次回分のデータＣ２がＦＩＦＯバッファ５３に蓄
えられる。
【００３７】第３のフェーズの終了時点である、図２の
時点ｔ４においては、図９に示すように、ＦＩＦＯバッ
ファ５１，５２，５３には、それぞれゲーム機本体２０
から送信された１バイトのデータＡ２，Ｂ２，Ｃ２が蓄
えられることになる。
時点ｔ４においては、図９に示すように、ＦＩＦＯバッ
ファ５１，５２，５３には、それぞれゲーム機本体２０
から送信された１バイトのデータＡ２，Ｂ２，Ｃ２が蓄
えられることになる。
【００３８】このように、上述した例によれば、期間Ｐ
１では端末７１からのデータａ１がゲーム機本体２０に
低速実時間で送信されるが、期間Ｐ１のあとの期間Ｐ
２，Ｐ３では期間Ｐ１に中継器３０のＦＩＦＯバッファ
５２，５３に蓄えられた端末７２，７３からのデータｂ
１，ｃ１がゲーム機本体２０に高速で送信されるので、
ゲーム機本体２０が通信に拘束される時間が短くなる。
１では端末７１からのデータａ１がゲーム機本体２０に
低速実時間で送信されるが、期間Ｐ１のあとの期間Ｐ
２，Ｐ３では期間Ｐ１に中継器３０のＦＩＦＯバッファ
５２，５３に蓄えられた端末７２，７３からのデータｂ
１，ｃ１がゲーム機本体２０に高速で送信されるので、
ゲーム機本体２０が通信に拘束される時間が短くなる。
【００３９】しかも、端末７１からのデータａ１をゲー
ム機本体２０に低速実時間で送信するには、ゲーム機本
体２０から中継器３０に供給される転送クロックＣＫ１
をそのままその端末７１への転送クロックとして用いる
ことができるとともに、その転送クロックＣＫ１をその
まま用いて端末７２，７３からのデータｂ１，ｃ１をＦ
ＩＦＯバッファ５２，５３に蓄えることができるので、
中継器３０内に独立したタイミング発生回路などを必要
とせず、中継器３０の構成を簡略化・低コスト化するこ
とができる。
ム機本体２０に低速実時間で送信するには、ゲーム機本
体２０から中継器３０に供給される転送クロックＣＫ１
をそのままその端末７１への転送クロックとして用いる
ことができるとともに、その転送クロックＣＫ１をその
まま用いて端末７２，７３からのデータｂ１，ｃ１をＦ
ＩＦＯバッファ５２，５３に蓄えることができるので、
中継器３０内に独立したタイミング発生回路などを必要
とせず、中継器３０の構成を簡略化・低コスト化するこ
とができる。
【００４０】また、中継器３０内のクロックＣＫを単一
にすることができるので、中継器３０の設計をより容易
にすることができるとともに、すべての端末７１，７
２，７３からのデータａ１，ｂ１，ｃ１のゲーム機本体
２０への送信タイミングを完全に一致させることができ
る。
にすることができるので、中継器３０の設計をより容易
にすることができるとともに、すべての端末７１，７
２，７３からのデータａ１，ｂ１，ｃ１のゲーム機本体
２０への送信タイミングを完全に一致させることができ
る。
【００４１】なお、中継器に接続できる端末は、２個ま
たは４個以上とすることができる。中継器に最大４個の
端末を接続できるようにする場合には、上述した第１の
フェーズにおいて、同時に前回の通信で４番目の端末に
対応するＦＩＦＯバッファに蓄えられたデータが４番目
の端末に送信されるとともに、４番目の端末からの今回
分のデータが４番目の端末に対応するＦＩＦＯバッファ
に蓄えられ、上述した第３のフェーズのあとの第４のフ
ェーズにおいて、第１のフェーズにおいて４番目の端末
に対応するＦＩＦＯバッファに蓄えられてた４番目の端
末からのデータが４番目の端末に対応するＦＩＦＯバッ
ファからゲーム機本体に送信されるとともに、ゲーム機
本体からの次回分のデータが４番目の端末に対応するＦ
ＩＦＯバッファに蓄えられるようにすればよい。
たは４個以上とすることができる。中継器に最大４個の
端末を接続できるようにする場合には、上述した第１の
フェーズにおいて、同時に前回の通信で４番目の端末に
対応するＦＩＦＯバッファに蓄えられたデータが４番目
の端末に送信されるとともに、４番目の端末からの今回
分のデータが４番目の端末に対応するＦＩＦＯバッファ
に蓄えられ、上述した第３のフェーズのあとの第４のフ
ェーズにおいて、第１のフェーズにおいて４番目の端末
に対応するＦＩＦＯバッファに蓄えられてた４番目の端
末からのデータが４番目の端末に対応するＦＩＦＯバッ
ファからゲーム機本体に送信されるとともに、ゲーム機
本体からの次回分のデータが４番目の端末に対応するＦ
ＩＦＯバッファに蓄えられるようにすればよい。
【００４２】また、この発明は、家庭用ゲーム機システ
ム、およびその中継器に限らず、中継器を介してホスト
装置と複数の端末との間で通信を行う通信システム、お
よびその中継器に広く適用することができる。
ム、およびその中継器に限らず、中継器を介してホスト
装置と複数の端末との間で通信を行う通信システム、お
よびその中継器に広く適用することができる。
【００４３】
【発明の効果】上述したように、この発明によれば、ホ
スト装置が通信に拘束される時間を短くすることができ
るとともに、中継器内に独立したタイミング発生回路な
どを必要とせず、中継器の構成を簡略化・低コスト化す
ることができる。
スト装置が通信に拘束される時間を短くすることができ
るとともに、中継器内に独立したタイミング発生回路な
どを必要とせず、中継器の構成を簡略化・低コスト化す
ることができる。
【図１】この発明の通信システムおよびその中継器の一
例を示す機能ブロック図である。
例を示す機能ブロック図である。
【図２】その動作の説明に供するタイムチャートであ
る。
る。
【図３】その動作の説明に供する図である。
【図４】その動作の説明に供する図である。
【図５】その動作の説明に供する図である。
【図６】その動作の説明に供する図である。
【図７】その動作の説明に供する図である。
【図８】その動作の説明に供する図である。
【図９】その動作の説明に供する図である。
【図１０】従来の第１の通信方法を示す図である。
【図１１】従来の第２の通信方法を示す図である。
１０ ゲーム機システム（通信システム） ２０ ゲーム機本体（ホスト装置） ３０ 中継器 ５１〜５３ ＦＩＦＯバッファ（バッファメモリ） ７１〜７３ 端末
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 29/08 A63F 13/08 H04L 13/08 H04L 12/18
Claims (6)
- 【請求項１】ホスト装置と複数の端末装置との間に接続
される中継装置であって、 第1の時間期間において、前記中継装置は、一部の端末
装置からのデータを受信して前記ホスト装置に第1速度
で中継するとともに、他の端末装置からのデータを前記
第1速度で受信して記憶しておき、 第2の時間期間において、前記中継装置は、前記記憶さ
れたデータを前記ホスト装置に、前記第1速度よりも速
い第2速度で送信する中継装置。 - 【請求項２】前記中継装置は、前記複数の端末装置のそ
れぞれに対応したバッファメモリを備え、 前記第１の時間期間において前記第１速度で前記バッフ
ァメモリに記憶されているデータを前記複数の端末装置
にそれぞれ送信するとともに前記ホスト装置から前記一
部の端末装置に対するデータを受信して前記バッファメ
モリに記憶し、 前記第2の時間期間において前記第２速度で前記ホスト
装置から前記他の端末装置に対するデータを受信して前
記バッファメモリに記憶する、請求項１記載の中継装
置。 - 【請求項３】 ホスト装置との間のデータ通信を行うた
めの対ホスト送受信部と、第１端末装置との間のデータ
通信を行うための第１端末送受信部と、第２端末装置と
の間のデータ通信を行うための第２端末送受信部と、前
記対ホスト送受信部と前記第１端末送受信部との間に接
続される第１バッファと、前記対ホスト送受信部と前記
第２端末送受信部との間に接続される第２バッファと、
前記第２バッファの出力と前記第１端末送受信部を介し
た第１端末装置からの入力を選択的に前記対ホスト送受
信部に接続するセレクタと、制御部とを有し、 前記制御部は、前記ホスト装置から供給される第１速度
のクロック信号に従い、前記第１端末装置からのデータ
を前記ホスト装置に直接送信するとともに、前記第２バ
ッファに前記第２端末装置から受信したデータを記憶さ
せ、 前記ホスト装置から供給される前記第１速度よりも速い
第２速度のクロック信号に従い、前記第２バッファに記
憶されたデータを前記ホスト装置に送信する中継装置。 - 【請求項４】 ホスト装置と、複数の端末装置と、それ
らを接続する中継装置とを含む通信システムであって、 前記ホスト装置は、前記中継装置に対し、第１の時間期
間において第１速度のクロック信号を供給するととも
に、第２の時間期間において前記第１速度よりも速い第
２速度のクロック信号を供給し、 前記中継装置は、前記第１の時間期間において前記第１
速度のクロック信号に同期して、一部の端末装置からの
データを前記ホスト装置に中継するとともに、他の端末
装置からのデータを受信して記憶しておき、前記第2の
時間期間において前記第２速度のクロック信号に同期し
て、前記記憶されたデータを前記ホスト装置に送信す
る、通信システム。 - 【請求項５】 請求項４記載の通信システムであって、 前記中継装置は、前記複数の端末装置のそれぞれに対応
したバッファメモリを備え、 前記第１の時間期間において前記第１速度のクロック信
号に同期して、前記バッファメモリに記憶されているデ
ータを前記複数の端末装置にそれぞれ送信するとともに
前記ホスト装置から前記一部の端末装置に対するデータ
を受信して前記バッファメモリに記憶し、 前記第2の時間期間において前記第２速度のクロック信
号に同期して、前記ホスト装置から前記他の端末装置に
対するデータを受信して前記バッファメモリに記憶す
る、通信システム。 - 【請求項６】 ホスト装置、複数の端末装置と、それら
を接続する中継装置とを含む通信システムであって、 前記ホスト装置は、前記中継装置に対し、第１の時間期
間において第１速度のクロック信号を供給するととも
に、第２の時間期間において前記第１速度よりも速い第
２速度のクロック信号を供給し、 前記中継装置は、ホスト装置との間のデータ通信を行う
ための対ホスト送受信部と、第１端末装置との間のデー
タ通信を行うための第１端末送受信部と、第２端末装置
との間のデータ通信を行うための第２端末送受信部と、
前記対ホスト送受信部と前記第１端末送受信部との間に
接続される第１バッファと、前記対ホスト送受信部と前
記第２端末送受信部との間に接続される第２バッファ
と、前記第２バッファの出力と前記第１端末送受信部を
介した第１端末装置からの入力を選択的に前記対ホスト
送受信部に接続するセレクタと、制御部とを有し、 前記制御部は、前記第１速度のクロック信号に同期し
て、前記第１端末装置からのデータを前記ホスト装置に
直接送信するとともに、前記第２バッファに前記第２端
末装置から受信したデータを記憶させ、前記ホスト装置
から供給される第２速度のクロック信号に同期して、前
記第２バッファに記憶されたデータを前記ホスト装置に
送信する、通信システム。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03611795A JP3299853B2 (ja) | 1995-01-31 | 1995-01-31 | 通信システムおよび通信用中継器 |
| US08/590,886 US5791993A (en) | 1995-01-31 | 1996-01-24 | Communication system and relay thereof |
| MYPI96000339A MY133642A (en) | 1995-01-31 | 1996-01-30 | Communication system and relay thereof. |
| KR1019960002029A KR100398854B1 (ko) | 1995-01-31 | 1996-01-30 | 통신시스템및통신용중계기 |
| EP96300678A EP0725352B1 (en) | 1995-01-31 | 1996-01-31 | Communication system and relay thereof |
| CN96103514A CN1076837C (zh) | 1995-01-31 | 1996-01-31 | 通信***及其继电器 |
| ES96300678T ES2216037T3 (es) | 1995-01-31 | 1996-01-31 | Sistema de comunicaciones y repetidor para el mismo. |
| DE69631849T DE69631849T2 (de) | 1995-01-31 | 1996-01-31 | Datenübertragungssystem und Relais dafür |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03611795A JP3299853B2 (ja) | 1995-01-31 | 1995-01-31 | 通信システムおよび通信用中継器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08214031A JPH08214031A (ja) | 1996-08-20 |
| JP3299853B2 true JP3299853B2 (ja) | 2002-07-08 |
Family
ID=12460843
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03611795A Expired - Lifetime JP3299853B2 (ja) | 1995-01-31 | 1995-01-31 | 通信システムおよび通信用中継器 |
Country Status (8)
| Country | Link |
|---|---|
| US (1) | US5791993A (ja) |
| EP (1) | EP0725352B1 (ja) |
| JP (1) | JP3299853B2 (ja) |
| KR (1) | KR100398854B1 (ja) |
| CN (1) | CN1076837C (ja) |
| DE (1) | DE69631849T2 (ja) |
| ES (1) | ES2216037T3 (ja) |
| MY (1) | MY133642A (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5984786A (en) * | 1997-01-03 | 1999-11-16 | 2 Am Inc. | Run-time environment for simulations and games |
| JP3044117U (ja) * | 1997-06-06 | 1997-12-16 | 株式会社バンダイ | 通信端子を有するゲーム機 |
| US7098777B2 (en) * | 2000-03-01 | 2006-08-29 | Sony Computer Entertainment Inc. | Electronic equipment communications system and repeater |
| US8821285B2 (en) | 2003-11-03 | 2014-09-02 | Intel Corporation | Gaming interface techniques for media centers |
| JP5522888B2 (ja) * | 2007-04-09 | 2014-06-18 | 株式会社タイトー | 自動切替機能付きコントローラ切替装置 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4588187A (en) * | 1984-06-27 | 1986-05-13 | Wico Corporation | Port expansion adapter for video game port |
| US4864496A (en) * | 1987-09-04 | 1989-09-05 | Digital Equipment Corporation | Bus adapter module for interconnecting busses in a multibus computer system |
| US5347637A (en) * | 1989-08-08 | 1994-09-13 | Cray Research, Inc. | Modular input/output system for supercomputers |
| US5301275A (en) * | 1991-10-03 | 1994-04-05 | Compaq Computer Corporation | Data transfer system with variable data buffer size and programmable interrupt frequency |
| CA2091962A1 (en) * | 1992-03-31 | 1993-10-01 | Mark L. Witsaman | Clock synchronization system |
-
1995
- 1995-01-31 JP JP03611795A patent/JP3299853B2/ja not_active Expired - Lifetime
-
1996
- 1996-01-24 US US08/590,886 patent/US5791993A/en not_active Expired - Lifetime
- 1996-01-30 KR KR1019960002029A patent/KR100398854B1/ko active IP Right Grant
- 1996-01-30 MY MYPI96000339A patent/MY133642A/en unknown
- 1996-01-31 DE DE69631849T patent/DE69631849T2/de not_active Expired - Lifetime
- 1996-01-31 ES ES96300678T patent/ES2216037T3/es not_active Expired - Lifetime
- 1996-01-31 CN CN96103514A patent/CN1076837C/zh not_active Expired - Lifetime
- 1996-01-31 EP EP96300678A patent/EP0725352B1/en not_active Expired - Lifetime
Also Published As
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| US5791993A (en) | 1998-08-11 |
| EP0725352B1 (en) | 2004-03-17 |
| DE69631849D1 (de) | 2004-04-22 |
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| KR100398854B1 (ko) | 2003-12-01 |
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