JP3226534B2 - Document reading device - Google Patents
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は原稿に光を照射し、この反射光を光電変換し
て得られる読取データに対し、シェーディング補正を行
う原稿読取装置に関する。Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an original reading apparatus that irradiates an original with light and performs shading correction on read data obtained by photoelectrically converting the reflected light.
［従来の技術］ 一般にファクシミリ装置や光学カードリーダ等におい
ては、光電変換して得られる読み取りデータは、光源の
照度のばらつきやレンズの収差等により歪みが生じ、こ
のような読み取りデータを一定の大きさの基準信号によ
り量子化すると正しい量子化信号を得ることができな
い。[Prior Art] Generally, in a facsimile apparatus, an optical card reader, or the like, read data obtained by photoelectric conversion is distorted due to variations in illuminance of a light source, aberration of a lens, and the like. If quantization is performed using the reference signal, a correct quantized signal cannot be obtained.
そこで、従来は、例えば、特公昭63−39142号公報に
見られるように原稿送信前に基準白板を読み取り、ピー
ク値を検知し、このピーク値と再度読み取った基準白板
の読み取りデータとから、読み取り系の歪特性を予め計
算し、シェーディングデータとしてメモリに記憶する。
そして、原稿送信を行う際に、入力される読み取りデー
タを前記メモリに記憶したシェーディングデータにより
補正していた。Therefore, conventionally, for example, as disclosed in Japanese Patent Publication No. 63-39142, a reference white board is read before document transmission, a peak value is detected, and the peak value and read data of the reference white board read again are read. The distortion characteristics of the system are calculated in advance and stored in a memory as shading data.
Then, when the original is transmitted, the input read data is corrected by the shading data stored in the memory.
これを第２図を参照して今少し具体的に説明する。 This will now be described more specifically with reference to FIG.
第２図（ａ）は従来の原稿読取装置の全体を示すブロ
ック図であり、原稿を光電変換したアナログ情報信号Ａ
はアナログ情報入力端子１から、ピークホールド回路２
に入力される。そして、このピークホールド回路２で
は、アナログ情報信号Ａの最大値をデジタルピーク信号
として記憶し、この最大値に応じたアナログピーク信号
電圧ＢをA/D変換器３に出力する。このA/D変換器３で
は、画情報を含まない原稿の余白を光電変換したアナロ
グ情報信号Ａと既にピークホールド回路２に記憶された
デジタルピーク信号に基づいて出力されるアナログピー
ク信号電圧Ｂを入力し、このアナログピーク信号電圧Ｂ
を基準値としたアナログ情報Ａの各画素毎の偏差割合
（歪特性）をシェーディングデータＣとしてメモリ４に
記憶する。次にD/A変換器５では、メモリ４から多値化
すべき画素に応じて読み出されたシェーディングデータ
Ｃとピークホールド回路２から出力されるアナログピー
ク信号電圧Ｂを入力してアナログ基準信号電圧Ｄを出力
する。最後に、比較器６で、光電変換された情報信号を
含むアナログ情報信号Ａをアナログ基準信号電圧Ｄと比
較して多値化情報出力端子７に２値化情報信号Ｅを出力
することにより、入力される読み取りデータをシェーデ
ィング補正する。FIG. 2 (a) is a block diagram showing the whole of a conventional document reading apparatus, and an analog information signal A obtained by photoelectrically converting a document.
Is the analog information input terminal 1 and the peak hold circuit 2
Is input to The peak hold circuit 2 stores the maximum value of the analog information signal A as a digital peak signal, and outputs an analog peak signal voltage B corresponding to the maximum value to the A / D converter 3. The A / D converter 3 converts an analog information signal A obtained by photoelectrically converting a margin of a document not including image information and an analog peak signal voltage B output based on a digital peak signal already stored in the peak hold circuit 2. Input, and this analog peak signal voltage B
Is stored as the shading data C in the memory 4 with the deviation ratio (distortion characteristic) of the analog information A for each pixel with reference to. Next, the D / A converter 5 inputs the shading data C read from the memory 4 according to the pixel to be multi-valued and the analog peak signal voltage B output from the peak hold circuit 2 to input the analog reference signal voltage. D is output. Finally, the comparator 6 compares the analog information signal A including the photoelectrically converted information signal with the analog reference signal voltage D, and outputs the binarized information signal E to the multilevel information output terminal 7. The input read data is corrected for shading.
［発明が解決しようとする課題］ しかし、このような従来の原稿読取装置は、基準白板
の読み取りデータを最初にピークホールド回路２に入力
するため、このピーク値が光源の変化等により変化した
場合、シェーディングデータについてはそれに対応した
修正が行われない。したがって、ピーク値に対応した正
確なシェーディング補正が行われず、正常な原稿読み取
りを行うことができないという問題点があった。[Problem to be Solved by the Invention] However, in such a conventional document reading apparatus, the read data of the reference white plate is first input to the peak hold circuit 2, so that when the peak value changes due to a change in the light source or the like. The shading data is not corrected correspondingly. Therefore, there is a problem in that accurate shading correction corresponding to the peak value is not performed, and normal document reading cannot be performed.
また、当該原稿読取装置のピークホールド回路２は、
第２図（ｂ）に示すように、アドレスカウンタ21に入力
されているディジタル信号の最大値とアナログ情報信号
Ａとを比較器23により比較してピーク値を検出するた
め、D/A変換器22が必要であり、装置全体としては２台
のD/A変換器5,22が必要でとなり、回路規模が大きくな
っていた。Further, the peak hold circuit 2 of the document reading device is
As shown in FIG. 2B, a comparator 23 compares the maximum value of the digital signal input to the address counter 21 with the analog information signal A to detect a peak value. 22 are required, and two D / A converters 5 and 22 are required for the entire apparatus, which increases the circuit scale.
そこで、本発明はこの問題点を解決し、シェーディン
グ補正されたピーク値による正しいシェーディング補正
を行い正常な原稿読み取りを行うと共に、D/A変換器１
台でも正常な原稿読み取りが可能な原稿読取装置を提供
することを目的とするものである。Therefore, the present invention solves this problem, performs correct shading correction based on the peak value subjected to shading correction, performs normal document reading, and performs D / A conversion.
It is an object of the present invention to provide a document reading apparatus capable of reading a normal document even on a table.
［課題を解決するための手段］ 本発明は、基準白板から反射光を読み取り、この基準
白板読み取りデータにより求められるシェーディングデ
ータ（Ｘ）をメモリに記憶し、原稿送信時の原稿読取デ
ータを上記シェーディングデータ（Ｘ）により補正する
原稿読取装置において、ディジタル化されたシェーディ
ングデータ（Ｘ）を記憶しているメモリと、リファレン
ス信号と固定レベル間で上記原稿読取データを多階調の
デジタル信号に変換する一方、上記リファレンス信号よ
り大きいレベルの上記原稿読取データが入力されたとき
オーバーフロー信号を出力するA/D変換器と、上記A/D変
換器から出力されるデジタル信号のピーク値を保持する
と共に、上記オーバーフロー信号によりカウントアップ
し、外部より入力される信号によりカウントダウンする
アップダウンカウンタと、上記シェーディングデータ
（Ｘ）と前記アップダウンカウンタより出力されるピー
ク値（Vp）とに基づきシェーディングデータ（Vx）を次
式（Ｉ） Vx＝Vp・X/2n（ｎはＸのビット数） （Ｉ） に基づいて算出する演算回路と、この演算回路出力をア
ナログ値に変換して上記A/D変換器のリファレンス信号
として出力するD/A変換器とを備えたものである。Means for Solving the Problems The present invention reads reflected light from a reference white plate, stores shading data (X) obtained from the reference white plate read data in a memory, and converts the document read data at the time of document transmission to the above-described shading. In a document reading device for correcting data (X), the document reading data is converted into a multi-gradation digital signal between a reference signal and a fixed level in a memory storing digitized shading data (X). On the other hand, an A / D converter that outputs an overflow signal when the original read data at a level greater than the reference signal is input, and holds a peak value of a digital signal output from the A / D converter, Counts up by the overflow signal and counts down by a signal input from outside. The shading data (Vx) is calculated by the following equation (I) based on the up / down counter that goes up, the shading data (X), and the peak value (Vp) output from the up / down counter: Vx = Vp · X / 2 n ( (n is the number of bits of X) (I), and a D / A converter that converts the output of the operation circuit into an analog value and outputs the analog value as a reference signal of the A / D converter. It is a thing.
［作用］ したがって、ピーク値検出のためのD/A変換器が不要
となり、装置を小型化できるとともに、コストを低減す
ることができる。[Operation] Therefore, a D / A converter for peak value detection is not required, so that the apparatus can be downsized and the cost can be reduced.
［実施例］ 以下、添付図面を参照しながら本発明の原稿読取装置
について詳細に説明する。Hereinafter, an original reading apparatus according to the present invention will be described in detail with reference to the accompanying drawings.
第１図は本発明の一実施例による原稿読取装置の構成
を示すもので、アンプ（AMP）１は、アナログ入力信号
の基準レベルを固定レベルにクランプするクランプ回路
及び増幅回路で、アナログ入力された読み取りデータを
A/D変換器２に出力するものである。FIG. 1 shows a configuration of a document reading apparatus according to an embodiment of the present invention. An amplifier (AMP) 1 is a clamp circuit and an amplifier circuit for clamping a reference level of an analog input signal to a fixed level. Read data
The signal is output to the A / D converter 2.
A/D変換器２は、入力された読み取りデータを後述す
るD/A変換器３からの出力をVref信号とし、このVref信
号と固定レベル間で読み取りデータを多階調のデジタル
信号に変換するものである。そして、後述するピーク検
出モードにおいては、A/D変換器２にアンプ１よりVref
信号に等しい電圧が入力するとA/D変換器２は、最大値F
FHを出力する。The A / D converter 2 uses the input read data as an output from a D / A converter 3 described later as a Vref signal, and converts the read data into a multi-tone digital signal between the Vref signal and a fixed level. Things. In the peak detection mode described later, the A / D converter 2 supplies Vref from the amplifier 1 to the A / D converter 2.
When a voltage equal to the signal is input, the A / D converter 2 sets the maximum value F
Outputs FH.
このデジタル値に変換されたA/D変換器２の出力は後
述する各モードに応じて、比較器（COMP）４、アップダ
ウンカウンタ（UP/DW.C）５、No.2マルチプレクサ（No.
2MUX）６及び図示しないファクシミリ装置等の次の処理
を行う装置（OUT）へ送られる。The output of the A / D converter 2 converted into the digital value is output from a comparator (COMP) 4, an up / down counter (UP / DW.C) 5, and a No. 2 multiplexer (No.
2MUX) 6 and a device (OUT) for performing the next processing such as a facsimile device (not shown).
比較器４は、A/D変換器２の出力と、アップダウンカ
ウンタ５の出力とを比較し、A/D変換器２の出力が大き
い時はロード信号Ｌをアップダウンカウンタ５に発生す
るものである。The comparator 4 compares the output of the A / D converter 2 with the output of the up / down counter 5 and generates a load signal L to the up / down counter 5 when the output of the A / D converter 2 is large. It is.
アップダウンカウンタ５は、比較器４のロード信号Ｌ
が発生した時のA/D変換器２の出力Ｄをラッチするもの
で、その出力Vpを各モードに応じ比較器4,演算器（MU
L）７及びNo.1マルチプレクサ（No.1MUX）８に入力する
ものである。The up / down counter 5 receives the load signal L of the comparator 4
Latches the output D of the A / D converter 2 when the error occurs, and outputs the output Vp to the comparator 4, the arithmetic unit (MU) in accordance with each mode.
L) 7 and a No. 1 multiplexer (No. 1 MUX) 8.
演算器７は、アップダウンカウンタ５からの出力と後
述するNo.2マルチプレクサ６からのシェーディングデー
タとを演算する演算器で、その演算結果をNo.1マルチプ
レクサ８に入力するものである。The computing unit 7 computes the output from the up / down counter 5 and the shading data from the No. 2 multiplexer 6 described later, and inputs the calculation result to the No. 1 multiplexer 8.
No.1マルチプレクサ８は、各モードに応じて、No.1マ
ルチプレクサ８に入力される前記アップダウンカウンタ
５及び演算器７からの信号又は読み取りデータの取りう
る最大値から、D/A変換器３に入力する信号を選択する
ものである。The No. 1 multiplexer 8 converts the D / A converter 3 from the maximum value of the signal from the up / down counter 5 and the arithmetic unit 7 or the read data which can be taken into the No. 1 multiplexer 8 according to each mode. Is used to select a signal to be input to.
No.2マルチプレクサ６は、シェーディングデータをメ
モリインターフェース（RAM.I/F）９を介してシェーデ
ィングデータを記憶するメモリ10に書き込むか、メモリ
10からシェーディングデータを読み出して演算器７に入
力するかを選択するものである。The No. 2 multiplexer 6 writes the shading data to the memory 10 for storing the shading data via the memory interface (RAM.I / F) 9 or
This is to select whether to read the shading data from 10 and input it to the arithmetic unit 7.
次に、このように構成された原稿読取装置の動作につ
いて、ピーク検出モード、シェーディング検出モード及
び読み取りモードの３つのモードについて説明する。Next, with respect to the operation of the thus configured document reading apparatus, three modes of a peak detection mode, a shading detection mode, and a reading mode will be described.
まず、ピーク検出モードについて説明する。 First, the peak detection mode will be described.
このモードは、基準白板の読み取りデータのピーク値
を検出するもので、このモードではNo.1マルチプレクサ
８の出力としては読み取りデータの取りうる最大値が選
択され、この最大値は８ビットの場合はFFH（255）であ
り、これがD/A変換器３に入力される。ここで、D/A変換
器３のVrefは固定レベルであり、この場合VddがD/A変換
器３のVrefに入力される。そして、最初の基準白板読み
取りデータがアンプ１に入ると、D/A変換器３の出力をV
refとしてA/D変換器２によりデジタル値に変換され、比
較器４に入力される。この時、比較器４の他の入力であ
るアップダウンカウンタ５の出力は０であり、A/D変換
器２の出力の方がアップダウンカウンタ５の出力よりも
大きくなる。したがって、比較器４がアップダウンカウ
ンタ５にロード信号Ｌを発生し、A/D変換器２の出力で
ある最初の読み取りデータはアップダウンカウンタ５に
ラッチされる。続いて、２番目の読み取りデータが比較
器４に入力されて、先にアップダウンカウンタ５にラッ
チされた最初の読み取りデータと比較され、A/D変換器
２の出力である２番目の読み取りデータが大きければ、
この読み取りデータがアップダウンカウンタ５にラッチ
される。この動作を１ライン毎に行うことにより基準白
板の読み取りデータの最大値がアップダウンカウンタ５
にラッチされ、ピーク値が検出できる。In this mode, the peak value of the read data of the reference white board is detected. In this mode, the maximum value of the read data is selected as the output of the No. 1 multiplexer 8, and when the maximum value is 8 bits, FFH (255), which is input to the D / A converter 3. Here, Vref of the D / A converter 3 is at a fixed level. In this case, Vdd is input to Vref of the D / A converter 3. Then, when the first reference white board read data enters the amplifier 1, the output of the D / A converter 3 is changed to V
The signal is converted into a digital value by the A / D converter 2 as a ref and input to the comparator 4. At this time, the output of the up / down counter 5, which is another input of the comparator 4, is 0, and the output of the A / D converter 2 is larger than the output of the up / down counter 5. Therefore, the comparator 4 generates a load signal L to the up / down counter 5, and the first read data output from the A / D converter 2 is latched by the up / down counter 5. Subsequently, the second read data is input to the comparator 4 and compared with the first read data previously latched by the up / down counter 5, and the second read data which is the output of the A / D converter 2 is output. If is large,
This read data is latched by the up / down counter 5. By performing this operation for each line, the maximum value of the read data of the reference white plate is increased by the up-down counter 5.
And the peak value can be detected.
このピーク検出モードが終了すると、次にシェーディ
ングデータを検出するシェーディング検出モードが行わ
れる。When the peak detection mode ends, a shading detection mode for detecting shading data is performed next.
このモードではNo.1マルチプレクサ８の出力としては
前述のピーク値検出モードで検出されたピーク値が選択
され、このピーク値はD/A変換器３に入力され、A/D変換
器２のVrefとなる。このピーク値とA/D変換器２に入力
される基準白板の読み取りデータとを対比することによ
り、シェーディングデータが検出され、このシェーディ
ングデータは、No.2マルチプレクサ６によりメモリイン
ターフェース９を介してメモリ10に書き込まれる。な
お、この場合、例えば補正の範囲がピーク値の100％〜5
0％までであれば、A/D変換器２の出力のMSBは必ず１で
あるためMSBをのぞくデータを記憶し、MSBが０であれ
ば、他のデータは全て１に変換して記憶するようにすれ
ばメモリ10の容量を小さくすることができる。In this mode, the peak value detected in the above-described peak value detection mode is selected as the output of the No. 1 multiplexer 8, and this peak value is input to the D / A converter 3, and the Vref of the A / D converter 2 Becomes By comparing the peak value with the read data of the reference white board input to the A / D converter 2, shading data is detected. The shading data is stored in the memory via the memory interface 9 by the No. 2 multiplexer 6. Written to 10. In this case, for example, the range of correction is 100% to 5% of the peak value.
If it is up to 0%, the MSB of the output of the A / D converter 2 is always 1, so data other than the MSB is stored. If the MSB is 0, all other data is converted to 1 and stored. By doing so, the capacity of the memory 10 can be reduced.
このシェーディング検出モードが終了すると、最後に
読み取りモードが行われる。When the shading detection mode ends, the reading mode is finally performed.
読み取りモードは、読み取りデータの量子化を行うも
のである。このモードではNo.1マルチプレクサ８の出力
としては演算器７の出力を選択する。演算器７の出力
（Vx）は、アップダウンカウンタ５からの出力、即ちピ
ーク値（Vp）と、メモリ10からメモリインターフェース
９、マルチプレクサ６を介して読み出されるシェーディ
ングデータ（Ｘ）とを用いて次の演算を行ったものであ
る。In the read mode, the read data is quantized. In this mode, the output of the arithmetic unit 7 is selected as the output of the No. 1 multiplexer 8. The output (Vx) of the arithmetic unit 7 is next calculated using the output from the up / down counter 5, that is, the peak value (Vp), and the shading data (X) read from the memory 10 via the memory interface 9 and the multiplexer 6. Is calculated.
Vx＝Vp・X/2n ・・・（Ｉ） ここで、ｎはＸのビット数を示しており、上式におい
て、演算器７の出力（Vx）は、ピーク値（Vp）に対応し
たシェーディングデータということになる。例えば、上
述したように、Vp＝FFHであればｎ＝８でVx≒Ｘとな
り、先にメモリ10に記憶したシェーディングデータその
ものということになる。この演算器７の出力（Vx）を用
いることにより、そのときのピーク値に応じたシェーデ
ィング補正が可能となる。Vx = Vp · X / 2 n (I) where n indicates the number of bits of X. In the above equation, the output (Vx) of the arithmetic unit 7 corresponds to the peak value (Vp). This means shading data. For example, as described above, if Vp = FFH, n = 8 and Vx ≒ X, which is the shading data itself previously stored in the memory 10. By using the output (Vx) of the arithmetic unit 7, shading correction according to the peak value at that time can be performed.
なお、補正の範囲がピーク値の100％〜50％までであ
れば、次の式とすることができる。If the correction range is from 100% to 50% of the peak value, the following equation can be obtained.
Vx＝VP・X/2n+1＋Vp/2 ・・・（II） この場合、前述したように、A/D変換器２の出力のMSB
の値に応じてMSBを除いたシェーディングデータの値を
メモリ10へ記憶させるようにすれば、メモリ10の容量を
小さくすることができ、回路規模も小さくすることがで
きる。Vx = VP · X / 2 n + 1 + Vp / 2 (II) In this case, as described above, the MSB of the output of the A / D converter 2
If the value of the shading data excluding the MSB is stored in the memory 10 in accordance with the value of, the capacity of the memory 10 can be reduced, and the circuit scale can be reduced.
No.1マルチプレクサ８の出力VxをD/A変換器３に入力
すると、A/D変換器２のVrefには、そのときのピーク値V
pに対応したシェーディングデータが入力される。同時
にA/D変換器２の入力端子には原稿読み取りデータが入
力される。これにより、原稿読み取りデータは、このシ
ェーディングデータに応じて量子化される。例えば、再
び基準白板を読めばA/D変換器２の出力は全てFFHとなり
均一なシェーディング補正データが得られる。When the output Vx of the No. 1 multiplexer 8 is input to the D / A converter 3, the Vref of the A / D converter 2 has the peak value V at that time.
Shading data corresponding to p is input. At the same time, original reading data is input to the input terminal of the A / D converter 2. As a result, the original reading data is quantized according to the shading data. For example, if the reference white board is read again, the outputs of the A / D converter 2 are all FFH, and uniform shading correction data can be obtained.
この読み取りモードの際、光源等の変化により入力デ
ータが大きくなり、Vref信号を越えるとA/D変換器２か
ら波線で示すオーバーフロー信号が発生する。この信号
が発生するとアップダウンカウンタ５のカウント値はア
ップし、ピーク値を上昇させる。これにより、シェーデ
ィング補正された正確なピークが得られ、またピーク値
に応じた正しいシェーディング補正データが得られる。
また、外部より波線で示すダウン信号DWNを与えること
によりそのピーク値を必要に応じて下降させることがで
きる。In this reading mode, the input data increases due to a change in the light source or the like. When the input data exceeds the Vref signal, an overflow signal indicated by a broken line is generated from the A / D converter 2. When this signal is generated, the count value of the up / down counter 5 increases, and the peak value increases. As a result, an accurate peak subjected to shading correction can be obtained, and correct shading correction data corresponding to the peak value can be obtained.
Further, by providing a down signal DWN indicated by a dashed line from the outside, the peak value can be lowered as necessary.
［発明の効果］ 以上説明したように、本発明によれば、基準白板から
の反射光を読み取り、この基準白板読み取りデータによ
り求められるシェーディングデータ（Ｘ）をメモリに記
憶し、原稿送信時の原稿読取データを上記シェーディン
グデータ（Ｘ）により補正する原稿読取装置において、
ディジタル化されたシェーディングデータ（Ｘ）を記憶
しているメモリと、リファレンス信号と固定レベル間で
上記原稿読取データを多階調のデジタル信号に変換する
一方、上記リファレンス信号より大きいレベルの上記原
稿読取データが入力されたときオーバーフロー信号を出
力するA/D変換器と、上記A/D変換器から出力されるデジ
タル信号のピーク値を保持すると共に、上記オーバーフ
ロー信号によりカウントアップし、外部より入力される
信号によりカウントダウンするアップダウンカウンタ
と、上記シェーディングデータ（Ｘ）と前記アップダウ
ンカウンタより出力されるピーク値（Vp）とに基づきシ
ェーディングデータ（Vx）を次式（Ｉ） Vx＝Vp・X/2n（ｎはＸのビット数） （Ｉ） に基づいて算出する演算回路と、この演算回路出力をア
ナログ値に変換して上記A/D変換器のリファレンス信号
として出力するD/A変換器とを備えたので、ピーク値検
出のためのD/A変換器が不要となり、装置を小型化でき
るとともに、コストを低減することができるという効果
を得る。[Effects of the Invention] As described above, according to the present invention, reflected light from a reference white board is read, shading data (X) obtained from the reference white board read data is stored in a memory, and a document at the time of document transmission is transmitted. In a document reading apparatus for correcting read data by the shading data (X),
A memory storing digitized shading data (X), and converting the original read data into a multi-tone digital signal between a reference signal and a fixed level, while reading the original at a level higher than the reference signal An A / D converter that outputs an overflow signal when data is input, and holds the peak value of the digital signal output from the A / D converter, counts up by the overflow signal, and is input from the outside. The shading data (Vx) is calculated based on the following formula (I) based on the up-down counter that counts down by a signal that is output by the above-described signal and the peak value (Vp) output from the up-down counter. (n is the number of bits of X) 2 n and arithmetic circuit for calculating, based on (I), the arithmetic circuit output Since it has a D / A converter that converts it to an analog value and outputs it as a reference signal of the A / D converter, a D / A converter for peak value detection is not required, and the device can be downsized. This has the effect of reducing costs.
第１図は本発明の一実施例にかかる原稿読取装置のブロ
ック図、第２図は従来の原稿読取装置のブロック図であ
る。 １……アンプ、２……A/D変換器、３……D/A変換器、４
……比較器、５……アップダウンカウンタ、６……No.2
マルチプレクサ、７……演算器、８……No.1マルチプレ
クサ、９……メモリインターフェース、10……メモリ。FIG. 1 is a block diagram of a document reading apparatus according to an embodiment of the present invention, and FIG. 2 is a block diagram of a conventional document reading apparatus. 1 ... Amplifier, 2 ... A / D converter, 3 ... D / A converter, 4
…… Comparator, 5 …… Up-down counter, 6 …… No.2
Multiplexer 7, arithmetic unit, 8 No. 1 multiplexer, 9 memory interface, 10 memory.
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭60−149261（ＪＰ，Ａ) 特開 平２−203671（ＪＰ，Ａ) 特開 昭61−135277（ＪＰ，Ａ) 特開 昭61−150457（ＪＰ，Ａ) 特開 昭62−159573（ＪＰ，Ａ) 特開 昭63−301674（ＪＰ，Ａ) ──────────────────────────────────────────────────続 き Continuation of front page (56) References JP-A-60-149261 (JP, A) JP-A-2-203671 (JP, A) JP-A-61-135277 (JP, A) JP-A-61-135277 150457 (JP, A) JP-A-62-159573 (JP, A) JP-A-63-301674 (JP, A)
Claims (1)
白板読み取りデータにより求められるシェーディングデ
ータ（Ｘ）をメモリに記憶し、原稿送信時の原稿読取デ
ータを上記シェーディングデータ（Ｘ）により補正する
原稿読取装置において、 ディジタル化されたシェーディングデータ（Ｘ）を記憶
しているメモリと、 リファレンス信号と固定レベル間で上記原稿読取データ
を多階調のデジタル信号に変換する一方、上記リファレ
ンス信号より大きいレベルの上記原稿読取データが入力
されたときオーバーフロー信号を出力するA/D変換器
と、 上記A/D変換器から出力されるデジタル信号のピーク値
を保持すると共に、上記オーバーフロー信号によりカウ
ントアップし、外部より入力される信号によりカウント
ダウンするアップダウンカウンタと、 上記シェーディングデータ（Ｘ）と前記アップダウンカ
ウンタより出力されるピーク値（Vp）とに基づきシェー
ディングデータ（Vx）を次式（Ｉ） Vx＝Vp・X/2n（ｎはＸのビット数） （Ｉ） に基づいて算出する演算回路と、 この演算回路出力をアナログ値に変換して上記A/D変換
器のリファレンス信号として出力するD/A変換器とを備
えたことを特徴とする原稿読取装置。1. A document for reading reflected light from a reference white plate, storing shading data (X) obtained from the reference white plate read data in a memory, and correcting the document read data at the time of document transmission by the shading data (X). A reading device that stores digitized shading data (X) and converts the original reading data into a multi-tone digital signal between a reference signal and a fixed level, while having a level higher than the reference signal; An A / D converter that outputs an overflow signal when the original reading data is input, and holds a peak value of a digital signal output from the A / D converter, and counts up by the overflow signal, Up / down cow that counts down by a signal input from outside Motor and the peak value output from the up-down counter and the shading data (X) (Vp) and the following equation shading data (Vx) based on (I) Vx = Vp · X / 2 n (n is the X An arithmetic circuit that calculates the number of bits (I), and a D / A converter that converts the output of the arithmetic circuit into an analog value and outputs the analog value as a reference signal of the A / D converter. Document reading device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26668190A JP3226534B2 (en) | 1990-10-05 | 1990-10-05 | Document reading device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26668190A JP3226534B2 (en) | 1990-10-05 | 1990-10-05 | Document reading device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04144482A JPH04144482A (en) | 1992-05-18 |
| JP3226534B2 true JP3226534B2 (en) | 2001-11-05 |
Family
ID=17434218
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26668190A Expired - Fee Related JP3226534B2 (en) | 1990-10-05 | 1990-10-05 | Document reading device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3226534B2 (en) |
-
1990
- 1990-10-05 JP JP26668190A patent/JP3226534B2/en not_active Expired - Fee Related
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|---|---|
| JPH04144482A (en) | 1992-05-18 |
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