JP3080054B2 - 液晶ディスプレイ装置 - Google Patents
液晶ディスプレイ装置Info
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- JP3080054B2 JP3080054B2 JP09330198A JP33019897A JP3080054B2 JP 3080054 B2 JP3080054 B2 JP 3080054B2 JP 09330198 A JP09330198 A JP 09330198A JP 33019897 A JP33019897 A JP 33019897A JP 3080054 B2 JP3080054 B2 JP 3080054B2
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- JP
- Japan
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- signal
- liquid crystal
- shift register
- supplied
- crystal display
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- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Description
【0001】
【発明の属する技術分野】本発明は、例えば液晶表示素
子をX−Yマトリクス状に配置して画像の表示を行う液
晶ディスプレイ装置に関するものである。
子をX−Yマトリクス状に配置して画像の表示を行う液
晶ディスプレイ装置に関するものである。
【0002】
【従来の技術】例えば液晶を用いてテレビ画像を表示す
ることが提案(特開昭59−220793号公報等参
照)されている。
ることが提案(特開昭59−220793号公報等参
照)されている。
【0003】すなわち図3において、入力端子1には例
えばテレビジョンの映像信号が供給される。この入力端
子1からの映像信号がそれぞれ例えばNチャンネルFE
Tからなるスイッチング素子M1 、M2 ・・・Mm を通
じて垂直(Y軸)方向のラインL1 、L2 ・・・Lm に
供給される。なおmは水平(X軸)方向の画素数に相当
する数である。
えばテレビジョンの映像信号が供給される。この入力端
子1からの映像信号がそれぞれ例えばNチャンネルFE
Tからなるスイッチング素子M1 、M2 ・・・Mm を通
じて垂直(Y軸)方向のラインL1 、L2 ・・・Lm に
供給される。なおmは水平(X軸)方向の画素数に相当
する数である。
【0004】さらにm段のシフトレジスタ2が設けら
れ、このシフトレジスタ2に水平周波数のm倍のクロッ
ク信号Φ1H、Φ2Hが供給される。そしてこのクロック信
号Φ1H、Φ2Hによって順次走査される駆動パルス信号φ
1H、φ2H・・・φHmが、シフトレジスタ2の各出力端子
からスイッチング素子M1 〜Mm の各制御端子に供給さ
れる。なおシフトレジスタ2には低電位(VSS)と高電
位(VDD)が供給され、この2つの電位の駆動パルスが
形成される。
れ、このシフトレジスタ2に水平周波数のm倍のクロッ
ク信号Φ1H、Φ2Hが供給される。そしてこのクロック信
号Φ1H、Φ2Hによって順次走査される駆動パルス信号φ
1H、φ2H・・・φHmが、シフトレジスタ2の各出力端子
からスイッチング素子M1 〜Mm の各制御端子に供給さ
れる。なおシフトレジスタ2には低電位(VSS)と高電
位(VDD)が供給され、この2つの電位の駆動パルスが
形成される。
【0005】また、各ラインL1 〜Lm にそれぞれ例え
ばNチャンネルFETからなるスイッチング素子M11、
M12・・・Mn1、M12、M22・・・Mn2、・・・M1m、
M2m・・・Mnmの一端が接続される。なおnは水平走査
線数に相当する数である。このスイッチング素子M11〜
Mnmの他端がそれぞれ液晶セルC11、C12・・・Cnmを
通じてターゲット端子3に接続される。
ばNチャンネルFETからなるスイッチング素子M11、
M12・・・Mn1、M12、M22・・・Mn2、・・・M1m、
M2m・・・Mnmの一端が接続される。なおnは水平走査
線数に相当する数である。このスイッチング素子M11〜
Mnmの他端がそれぞれ液晶セルC11、C12・・・Cnmを
通じてターゲット端子3に接続される。
【0006】さらにn段のシフトレジスタ4が設けら
れ、このシフトレジスタ4に水平周波数のクロック信号
Φ1V、Φ2Vが供給される。そしてこのクロック信号
Φ1V、Φ2Vによって順次走査される駆動パルス信号
φV1、φV2・・・φVnが、シフトレジスタ4の各出力端
子から水平(X軸)方向のゲート線G1 、G2 ・・・G
n を通じてスイッチング素子M11〜MnmのX軸方向の各
列(M11〜M1m)、(M21〜M2m)・・・(Mn1〜
Mnm)ごとの制御端子にそれぞれ供給される。なお、シ
フトレジスタ4にもシフトレジスタ2と同様に電圧VSS
とVDDが供給される。
れ、このシフトレジスタ4に水平周波数のクロック信号
Φ1V、Φ2Vが供給される。そしてこのクロック信号
Φ1V、Φ2Vによって順次走査される駆動パルス信号
φV1、φV2・・・φVnが、シフトレジスタ4の各出力端
子から水平(X軸)方向のゲート線G1 、G2 ・・・G
n を通じてスイッチング素子M11〜MnmのX軸方向の各
列(M11〜M1m)、(M21〜M2m)・・・(Mn1〜
Mnm)ごとの制御端子にそれぞれ供給される。なお、シ
フトレジスタ4にもシフトレジスタ2と同様に電圧VSS
とVDDが供給される。
【0007】すなわちこの回路において、シフトレジス
タ2、4には例えば図4のA、Bに示すようなクロック
信号Φ1H、Φ2H、Φ1V、Φ2Vが供給される。そしてシフ
トレジスタ2からは同図のCに示すように各画素期間ご
とに駆動パルス信号φH1〜φHmが出力され、シフトレジ
スタ4からは同図のDに示すように1水平期間ごとに駆
動パルス信号φV1〜φVnが出力される。さらに入力端子
1には同図のEに示すような信号が供給される。
タ2、4には例えば図4のA、Bに示すようなクロック
信号Φ1H、Φ2H、Φ1V、Φ2Vが供給される。そしてシフ
トレジスタ2からは同図のCに示すように各画素期間ご
とに駆動パルス信号φH1〜φHmが出力され、シフトレジ
スタ4からは同図のDに示すように1水平期間ごとに駆
動パルス信号φV1〜φVnが出力される。さらに入力端子
1には同図のEに示すような信号が供給される。
【0008】そして例えば駆動パルス信号φV1、φH1が
出力されているときに、スイッチング素子M1 とM11〜
M1mがオンされ、入力端子1→M1 →L1 →M11→C11
→ターゲット端子3の電流路が形成される。これによっ
て入力端子1に供給された信号とターゲット端子3との
電位差が、液晶セルC11に供給される。
出力されているときに、スイッチング素子M1 とM11〜
M1mがオンされ、入力端子1→M1 →L1 →M11→C11
→ターゲット端子3の電流路が形成される。これによっ
て入力端子1に供給された信号とターゲット端子3との
電位差が、液晶セルC11に供給される。
【0009】このためこの液晶セルC11の容量分に、1
番目の画素の信号による電位差に相当する電荷がサンプ
ルホールドされる。そしてこの電荷量に対応して液晶の
光透過率が変化される。これと同様のことがセルC12〜
Cnmについて順次行われ、さらに次のフィールドの信号
が供給された時点で各セルC11〜Cnmの電荷量が書き換
えられる。
番目の画素の信号による電位差に相当する電荷がサンプ
ルホールドされる。そしてこの電荷量に対応して液晶の
光透過率が変化される。これと同様のことがセルC12〜
Cnmについて順次行われ、さらに次のフィールドの信号
が供給された時点で各セルC11〜Cnmの電荷量が書き換
えられる。
【0010】このようにして、映像信号の各画素に対応
して液晶セルC11〜Cnmの光透過率が変化され、これが
順次繰り返されてテレビ画像の表示が行われる。
して液晶セルC11〜Cnmの光透過率が変化され、これが
順次繰り返されてテレビ画像の表示が行われる。
【0011】
【発明が解決しようとする課題】ところで液晶で表示を
行う場合には、一般にその信頼性、寿命を長くするため
交流駆動が用いられる。例えばテレビジョン画像の表示
においては、1フィールドまたは1フレームごとに映像
信号を反転させた信号を入力端子1に供給する。また液
晶ディスプレイ装置においては表示の垂直方向のシュー
ディング等を防止する目的で信号を1水平期間ごとに反
転することが行われている。
行う場合には、一般にその信頼性、寿命を長くするため
交流駆動が用いられる。例えばテレビジョン画像の表示
においては、1フィールドまたは1フレームごとに映像
信号を反転させた信号を入力端子1に供給する。また液
晶ディスプレイ装置においては表示の垂直方向のシュー
ディング等を防止する目的で信号を1水平期間ごとに反
転することが行われている。
【0012】このため上述の装置において、入力端子1
には、例えば図4のEに示すように1水平期間ごとに反
転されると共に1フィールドまたは1フレームごとに反
転された信号が供給されている。
には、例えば図4のEに示すように1水平期間ごとに反
転されると共に1フィールドまたは1フレームごとに反
転された信号が供給されている。
【0013】ところが上述の装置において、上述のよう
に1水平期間ごとの極性反転が行われていると、例えば
表示画像が全白(または全黒)の場合に、入力端子1に
供給される映像信号は例えば図5のAに示すようにター
ゲット電圧に対して白(または黒)のレベルVpが1水
平期間ごとに極性反転されたものになっている。
に1水平期間ごとの極性反転が行われていると、例えば
表示画像が全白(または全黒)の場合に、入力端子1に
供給される映像信号は例えば図5のAに示すようにター
ゲット電圧に対して白(または黒)のレベルVpが1水
平期間ごとに極性反転されたものになっている。
【0014】これに対して同図のBに示すような駆動パ
ルス信号φH1〜φHmでスイッチング素子M1 〜Mm がオ
ンされると、各ラインL1 〜Lm の電位は同図のCに示
すように変化されることになり、すなわち各ラインL1
〜Lm の電位は駆動パルス信号φH1〜φHmの1パルス期
間に2Vp変化されることになる。
ルス信号φH1〜φHmでスイッチング素子M1 〜Mm がオ
ンされると、各ラインL1 〜Lm の電位は同図のCに示
すように変化されることになり、すなわち各ラインL1
〜Lm の電位は駆動パルス信号φH1〜φHmの1パルス期
間に2Vp変化されることになる。
【0015】そしてこの場合に、パルス信号φH1〜φHm
の1パルス期間は、1水平期間の有効画面期間を1/m
にした極めて短い時間であり、このような短い期間に2
Vpの電圧変化を行うためにはスイッチング素子M1 〜
Mm のオン抵抗が低くなければならず、各素子のサイズ
を大きくする必要があった。
の1パルス期間は、1水平期間の有効画面期間を1/m
にした極めて短い時間であり、このような短い期間に2
Vpの電圧変化を行うためにはスイッチング素子M1 〜
Mm のオン抵抗が低くなければならず、各素子のサイズ
を大きくする必要があった。
【0016】しかしながらこのような素子のサイズを大
きくすることは、素子をオンチップ化する場合にチップ
面積が増大するだけでなく、関連する水平走査回路(シ
フトレジスタ2)等の設計上の制約も厳しくするもので
ある。
きくすることは、素子をオンチップ化する場合にチップ
面積が増大するだけでなく、関連する水平走査回路(シ
フトレジスタ2)等の設計上の制約も厳しくするもので
ある。
【0017】またスイッチング素子M1 〜Mm のサイズ
を不充分なものとした場合には、各ラインL1 〜Lm の
信号電位が充分に立ち上がらず、液晶セルの電荷量の書
き換えが不充分になって、表示画像のコントラストが低
下されるなど、画質が極めて劣化されてしまう問題点が
あった。
を不充分なものとした場合には、各ラインL1 〜Lm の
信号電位が充分に立ち上がらず、液晶セルの電荷量の書
き換えが不充分になって、表示画像のコントラストが低
下されるなど、画質が極めて劣化されてしまう問題点が
あった。
【0018】この出願はこのような点に鑑みて成された
ものであって、解決しようとする問題点は、従来の装置
では素子のオン抵抗を低くしなければならず、素子のサ
イズを大きくするために設計上の制約が厳しくなった
り、また素子のサイズが不充分な場合には表示画像のコ
ントラストが低下されるなど画質が極めて劣化されてし
まうというものである。
ものであって、解決しようとする問題点は、従来の装置
では素子のオン抵抗を低くしなければならず、素子のサ
イズを大きくするために設計上の制約が厳しくなった
り、また素子のサイズが不充分な場合には表示画像のコ
ントラストが低下されるなど画質が極めて劣化されてし
まうというものである。
【0019】
【課題を解決するための手段】このため本発明において
は、信号線の電位を映像信号の反転ごとにその中間電位
にプリチャージするようにしたものであって、これによ
れば点順次に供給される信号の変化される幅が小さくさ
れ、スイッチング素子にかかる負担が小さくされて、小
さい素子サイズでも表示画像の画質の劣化を防止するこ
とができる。
は、信号線の電位を映像信号の反転ごとにその中間電位
にプリチャージするようにしたものであって、これによ
れば点順次に供給される信号の変化される幅が小さくさ
れ、スイッチング素子にかかる負担が小さくされて、小
さい素子サイズでも表示画像の画質の劣化を防止するこ
とができる。
【0020】
【発明の実施の形態】すなわち本発明においては、垂直
方向に平行に配設された複数の第1の信号線と、水平方
向に平行に配設された複数の第2の信号線と、これら第
1および第2の信号線の各交点にそれぞれ選択素子を介
して設けられた液晶セルと、第2の信号線を順次走査し
て1行分の画素を選択するシフトレジスタと、選択され
た1行分の画素に画像信号を書き込むためのパルス信号
を生成するシフトレジスタとを有する液晶ディスプレイ
装置において、第1の信号線に供給される画像信号の極
性を所定期間ごとに反転する手段と、点順次に供給され
る画像信号の反転ごとにその反転されたそれぞれの期間
の映像信号の任意の中間電位を、選択された1行分の画
素に画像信号を書き込むためのパルス信号を生成するシ
フトレジスタとは異なるスイッチング素子により第1の
信号線にプリチャージする手段を設けてなるものであ
る。
方向に平行に配設された複数の第1の信号線と、水平方
向に平行に配設された複数の第2の信号線と、これら第
1および第2の信号線の各交点にそれぞれ選択素子を介
して設けられた液晶セルと、第2の信号線を順次走査し
て1行分の画素を選択するシフトレジスタと、選択され
た1行分の画素に画像信号を書き込むためのパルス信号
を生成するシフトレジスタとを有する液晶ディスプレイ
装置において、第1の信号線に供給される画像信号の極
性を所定期間ごとに反転する手段と、点順次に供給され
る画像信号の反転ごとにその反転されたそれぞれの期間
の映像信号の任意の中間電位を、選択された1行分の画
素に画像信号を書き込むためのパルス信号を生成するシ
フトレジスタとは異なるスイッチング素子により第1の
信号線にプリチャージする手段を設けてなるものであ
る。
【0021】
【実施例】以下、図面を参照して本発明を説明するに、
図1は本発明を適用した液晶ディスプレイ装置の一例の
構成を示すブロック図である。
図1は本発明を適用した液晶ディスプレイ装置の一例の
構成を示すブロック図である。
【0022】図1は、図3と同様の単一の液晶ディスプ
レイ装置の構成を示し、この図1において、上述の垂直
(Y軸)方向のラインL1 〜Lm の下端部にそれぞれス
イッチング素子MR1、MR2・・・MRmが設けられる。そ
してこれらの素子MR1〜MRmを介してターゲット端子3
が接続されると共に、これらの素子MR1〜MRmの各制御
端子が水平ブラッキングパルスHBLK の供給されるリセ
ット端子5に接続される。その他の構成は図3の装置と
同様にされる。
レイ装置の構成を示し、この図1において、上述の垂直
(Y軸)方向のラインL1 〜Lm の下端部にそれぞれス
イッチング素子MR1、MR2・・・MRmが設けられる。そ
してこれらの素子MR1〜MRmを介してターゲット端子3
が接続されると共に、これらの素子MR1〜MRmの各制御
端子が水平ブラッキングパルスHBLK の供給されるリセ
ット端子5に接続される。その他の構成は図3の装置と
同様にされる。
【0023】そしてこの装置において、例えば図2のA
に示すような全白(または全黒)の映像信号が入力端子
1に供給され、同図のBに示すような駆動パルス信号φ
H1〜φHmでスイッチング素子M1 〜Mm がオンされた場
合に、リセット端子5には同図のCに示すような水平ブ
ランキングパルスHBLK が供給され、これによってスイ
ッチング素子MR1〜MRmがオンされる。
に示すような全白(または全黒)の映像信号が入力端子
1に供給され、同図のBに示すような駆動パルス信号φ
H1〜φHmでスイッチング素子M1 〜Mm がオンされた場
合に、リセット端子5には同図のCに示すような水平ブ
ランキングパルスHBLK が供給され、これによってスイ
ッチング素子MR1〜MRmがオンされる。
【0024】このため各ラインL1 〜Lm の電位は、各
水平ブランキングパルスHBLK の期間にターゲット電圧
にプリチャージされ、さらに駆動パルス信号φH1〜φHm
の期間にこのターゲット電圧から映像信号の電位に変化
される。
水平ブランキングパルスHBLK の期間にターゲット電圧
にプリチャージされ、さらに駆動パルス信号φH1〜φHm
の期間にこのターゲット電圧から映像信号の電位に変化
される。
【0025】従ってこの装置において、パルス信号φH1
〜φHmの1パルス期間に変化される信号は最大Vpとな
り、従来の装置の1/2にすることができる。このため
小さい素子のサイズでも液晶セルの電荷量の書き換えを
充分に行うことができ、表示画像のコントラストの低下
等による画質の劣化を防止することができる。さらに素
子サイズの増大によるチップ面積の増加や、設計上の制
約が生じることもないものである。
〜φHmの1パルス期間に変化される信号は最大Vpとな
り、従来の装置の1/2にすることができる。このため
小さい素子のサイズでも液晶セルの電荷量の書き換えを
充分に行うことができ、表示画像のコントラストの低下
等による画質の劣化を防止することができる。さらに素
子サイズの増大によるチップ面積の増加や、設計上の制
約が生じることもないものである。
【0026】こうしてこの装置によれば、信号線の電位
を映像信号の反転ごとにその中間電位にプリチャージす
ることによって、点順次に供給される信号の変化される
幅が小さくされ、スイッチング素子にかかる負担が小さ
くされ、スイッチング素子にかかる負担が小さくされ
て、小さい素子サイズでも表示画像の画質の劣化が防止
することができるものである。
を映像信号の反転ごとにその中間電位にプリチャージす
ることによって、点順次に供給される信号の変化される
幅が小さくされ、スイッチング素子にかかる負担が小さ
くされ、スイッチング素子にかかる負担が小さくされ
て、小さい素子サイズでも表示画像の画質の劣化が防止
することができるものである。
【0027】なお上述の装置においてスイッチング素子
は図示のようなNMOS信号に限らずPMOSあるいは
CMOS素子でもよい。またリセット端子5に供給され
る信号も水平ブランキングパルスに限らず映像信号の非
有効期間の信号であればいずれでもよい。さらにプリチ
ャージを行う電圧はターゲット電圧に限らず、映像信号
の任意の中間電位を用いることができる。
は図示のようなNMOS信号に限らずPMOSあるいは
CMOS素子でもよい。またリセット端子5に供給され
る信号も水平ブランキングパルスに限らず映像信号の非
有効期間の信号であればいずれでもよい。さらにプリチ
ャージを行う電圧はターゲット電圧に限らず、映像信号
の任意の中間電位を用いることができる。
【0028】
【発明の効果】従って請求項1の発明によれば、信号線
の電位を映像信号の反転ごとにその中間電位にプリチャ
ージすることによって、点順次に供給される信号の変化
される幅が小さくされ、スイッチング素子にかかる負担
が小さくされて、小さい素子サイズでも表示画像の画質
の劣化を防止することができるものである。
の電位を映像信号の反転ごとにその中間電位にプリチャ
ージすることによって、点順次に供給される信号の変化
される幅が小さくされ、スイッチング素子にかかる負担
が小さくされて、小さい素子サイズでも表示画像の画質
の劣化を防止することができるものである。
【0029】これによって、従来の装置では素子のオン
抵抗が低くなければならず、素子のサイズを大きくする
ために設計上の制約が厳しくなったり、また素子のサイ
ズが不充分な場合には表示画像のコントラストが低下さ
れるなど画質が極めて劣化されてしまうなどの問題点が
あったものを、本願の発明においてこれらの問題点を容
易に解消することができるものである。
抵抗が低くなければならず、素子のサイズを大きくする
ために設計上の制約が厳しくなったり、また素子のサイ
ズが不充分な場合には表示画像のコントラストが低下さ
れるなど画質が極めて劣化されてしまうなどの問題点が
あったものを、本願の発明においてこれらの問題点を容
易に解消することができるものである。
【図1】本発明の適用される液晶ディスプレイ装置の一
例の構成図である。
例の構成図である。
【図2】その動作の説明のための図である。
【図3】従来の液晶ディスプレイ装置の構成図である。
【図4】その説明のための図である。
【図5】その説明のための図である。
【符号の説明】 L1 〜Lm …垂直信号線、G1 〜Gn はゲート線、M1
〜Mm ,MR1〜MRm,M11〜Mnmはスイッチング素子、
C11〜Cnm…液晶セル、1…入力端子、2,4…シフト
レジスタ、3ターゲット端子、5…リセット端子
〜Mm ,MR1〜MRm,M11〜Mnmはスイッチング素子、
C11〜Cnm…液晶セル、1…入力端子、2,4…シフト
レジスタ、3ターゲット端子、5…リセット端子
Claims (1)
- 【請求項1】 垂直方向に平行に配設された複数の第1
の信号線と、 水平方向に平行に配設された複数の第2の信号線と、 これら第1および第2の信号線の各交点にそれぞれ選択
素子を介して設けられた液晶セルと、 上記第2の信号線を順次走査して1行分の画素を選択す
るシフトレジスタと、 上記選択された1行分の画素に画像信号を書き込むため
のパルス信号を生成するシフトレジスタとを有する液晶
ディスプレイ装置において、 上記第1の信号線に供給される画像信号の極性を所定期
間ごとに反転する手段と、 点順次に供給される上記画像信号の上記反転ごとにその
反転されたそれぞれの期間の映像信号の任意の中間電位
を、上記選択された1行分の画素に画像信号を書き込む
ためのパルス信号を生成するシフトレジスタとは異なる
スイッチング素子により上記第1の信号線にプリチャー
ジする手段を設けた、 ことを特徴とする液晶ディスプレイ装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP09330198A JP3080054B2 (ja) | 1997-12-01 | 1997-12-01 | 液晶ディスプレイ装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP09330198A JP3080054B2 (ja) | 1997-12-01 | 1997-12-01 | 液晶ディスプレイ装置 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1024512A Division JP2830004B2 (ja) | 1989-02-02 | 1989-02-02 | 液晶ディスプレイ装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH10148814A JPH10148814A (ja) | 1998-06-02 |
JP3080054B2 true JP3080054B2 (ja) | 2000-08-21 |
Family
ID=18229940
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP09330198A Expired - Lifetime JP3080054B2 (ja) | 1997-12-01 | 1997-12-01 | 液晶ディスプレイ装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3080054B2 (ja) |
-
1997
- 1997-12-01 JP JP09330198A patent/JP3080054B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH10148814A (ja) | 1998-06-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080623 Year of fee payment: 8 |
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