JP2913634B2 - Synchronization adjustment device - Google Patents
Synchronization adjustment deviceInfo
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、異なるフオーマツトで記録されたデジタル
オーデオテープ等のダビングに用いられる同期調整装置
に関する。
〔発明の概要〕
本発明は同期調整装置に関し、複数のPLLを用いてフ
レーム同期信号の変換等を行うことにより、異なるフオ
ーマツトで記録されたテープに対しても良好なダビング
を行うことができるようにするものである。
〔従来の技術〕
いわゆる業務用のデジタルオーデオテープにおいて
は、記録再生装置としてVTRが使用されるために、各国
のテレビ標準方式に合せて種々のフオーマツトが存在し
ている。すなわちフレーム同期周波数として25Hz,30Hz
及び29.97Hzがあり、また音声信号のサンプリング周波
数sには48kHz44.1kHz、44.056kHzなどのフオーマツ
トが存在している。
一方このような業務用VTRを用いた信号の編集等にお
いては、いわゆるタイムコードが使用されるが、このタ
イムコードも上述の信号のフオーマツトに応じて例えば
タイムコードクロツク周波数tが2kHz、2.4kHz、2.39
76kHzなど種々のフオーマツトが存在している。
ところが編集等においては、上述の異るフオーマツト
においてもこれを編集し任意のフオーマツトのVTRにダ
ビングする必要が生じる。
そこで従来このような異なるフオーマツト間のダビン
グにおいては、任意のフオーマツトで記録されたテープ
をいわゆるフレーム数変換装置を用いてダビングする相
手のVTRのフレーム周波数に変換して2次的なテープを
作成し、その後この2次テープを用いてデータの変換を
行いながらダビングすることが行われていた。
しかしながらこのような方法では、2次テープを作成
するために時間がかかり、またダビング回数が増すため
にエラーの発生が増加して信号が劣化するなどのおそれ
があつた。
〔発明が解決しようとする問題点〕
以上述べたように従来の技術では、フオーマツトの異
なるテープのダビングを行う場合に、処理時間が多く必
要となつたり、信号劣化を生じるおそれが増加するなど
の問題点があつた。
〔問題点を解決するための手段〕
本発明は、フォーマットの異なる再生装置と記録装置
との間で同期調整を行う同期調整装置に関し、基準のフ
レーム同期信号が入力(端子(1))されて所望のサン
プリング信号(出力端子(4))を形成する第1のPLL
回路(2)と、上記第1のPLL回路の出力を受けて上記
記録装置の記録タイムコードに対応したタイミング信号
を出力(端子(8))する第2のPLL回路(6)と、上
記再生装置から得られる再生タイムコード(入力端子
(9))から分離(回路(10))した再生フレーム同期
信号を受けて前記再生フレーム同期信号を目標タイムコ
ードである上記記録装置の記録タイムコード(入力端子
(14))から分離(回路(15))された記録フレーム同
期信号と等しい周波数の信号になるように変換する第3
のPLL回路(11)と、上記第3のPLL回路の出力と上記目
標タイムコードから分離された記録フレーム同期信号と
の位相を比較する位相比較手段(13)とを有し、上記位
相比較手段の出力信号を用いて上記再生装置と上記記録
装置との調速制御(出力端子(16))を行うと共に、上
記再生装置からの再生タイムコードを上記タイミング信
号を用いて上記記録装置のフォーマットの記録タイムコ
ード(出力端子(18))に変換(回路(17))するよう
にした同期調整装置である。
〔作 用〕
これによれば、フオーマツトを任意に変換することが
できるので、異なるフオーマツト間の調速制御等が可能
となり、それによつてフオーマツトの異なるテープ間の
ダビングを良好に行うことができる。
〔実施例〕
図において、(1)は基準のフレーム同期信号の供給
される入力端子であつて、この入力端子(1)が第1の
PLL(2)を構成する位相比較回路(2a)の第1の入力
に接続される。この比較回路(2a)の出力がVCXO(2b)
の制御入力に接続され、このVCXO(2b)の出力が1/aの
分周回路(2c)、1/bの分周回路(2d)を通じて比較回
路(2a)の第2の入力に接続される。さらにVCXO(2b)
の出力が1/100の分周回路(3)を通じてサンプリング
クロツクの出力端子(4)に接続される。
また分周回路(2c)の出力が1/cの分周回路(5)を
通じて第2のPLL(6)を構成する位相比較回路(6a)
の第1の入力に接続される。この比較回路(6a)の出力
がVCXO(6b)の制御入力に接続され、このVCXO(6b)の
出力が1/dの分周回路(6c)を通じて比較回路(6a)の
第2の入力に接続される。さらにVCXO(6b)の出力が1/
eの分周回路(7)を通じてタイムコードクロツクの出
力端子(8)に接続される。
さらにダビングされる信号の再生装置からの再生タイ
ムコードの供給される入力端子(9)がタイムコード読
出回路(10)に接続され、ここで分離されたフレーム同
期信号の出力が第3のPLL(11)を構成する位相比較回
路(11a)の第1の入力に接続される。この比較回路(1
1a)の出力がVCO(11b)の制御入力に接続され、このVC
O(11b)の出力が1/nの分周回路(11c)を通じて比較回
路(11a)の第2の入力に接続される。さらにVCO(11
b)の出力が1/mの分周回路(12)を通じて調速制御用の
位相比較回路(13)の第1の入力に接続される。
また記録装置からの目標タイムコードの供給される入
力端子(14)がタイムコード読出回路(15)に接続さ
れ、ここで分離されたフレーム同期信号の出力が比較回
路(13)の第2の入力に接続される。そして比較回路
(13)の出力が調速制御信号の出力端子(16)に接続さ
れる。
さらに読出回路(10)のタイムコードの出力がタイム
コード変換回路(17)に接続されると共に、上述の分周
回路(7)の出力が変換回路(17)に接続され、この変
換回路(17)の出力が記録タイムコードの出力端子(1
8)に接続される。
そしてこの装置において、入力端子(1)に供給され
る基準のフレーム有働期信号の周波数が25Hzのときは、
分周回路(2c)(2d)(5)(6c)(7)の分周比a,b,
c,d,eをそれぞれ次の表Iのようにすることにより、出
力端子(4)(8)にそれぞれ所望の周波数s,tの
サンプリングクロツク及びタイムコードクロツクが出力
される。
また基準のフレーム同期信号の周波数が29.97Hzのと
きは、同様に表IIのようにしてs,tのクロツク信号
を得ることができる。 さらに基準のフレーム同期信号の周波数が30Hzのとき
は、同様に表IIIのようにしてs,tのクロツク信号
を得ることができる。
これによつてそれぞれの基準のフレーム同期信号の周
波数に対して、それぞれ所望の周波数s,tのサンプ
リングクロツク及びタイムコードクロツクを得ることが
できる。
そしてさらに入力端子(9)(14)に供給されるタイ
ムコードのフレーム周波数が表IVの左側に示すような組
合せて異なつているときは、分周回路(11c)(12)の
分周比n,mを右側に示すように定める。
これによつて再生タイムコードのフレーム同期信号を
目標タイムコードのフレーム同期信号の周波数に変換す
ることができ、これらを位相比較することによつて調速
制御を行うことができる。なおフレーム同期信号の周波
数が一致しているときは、PLL(11)は不動作で信号は
そのまま通過されるものとする。
また読出回路(10)からのタイムコードが変換回路
(17)に供給され、この変換回路(17)に分周回路
(7)からのタイムコードクロツクが供給されることに
よつて、再生信号のタイムコードが記録装置のタイムコ
ードのタイミングで変換されて出力端子(18)に取出さ
れる。
従つてこの装置において、異なるフオーマツトのテー
プ間で調速が行われると共に、タイムコードが変換され
て記録装置に供給される。
こうして異なるフオーマツト間の調速が行われ、この
状態でダビングを行うことができるわけであるが、上述
の装置によれば、2次テープ等を作成する必要がないの
で処理を迅速に伝えると共に、それによる信号劣化等の
おそれもない。
〔発明の効果〕
この発明によれば、フオーマツトを任意に変換するこ
とができるので、異なるフオーマツト間の調速制御等が
可能となり、それによつてフオーマツトの異なるテープ
間のダビングを良好に行うことができるようになつた。Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a synchronization adjustment device used for dubbing digital audio tapes or the like recorded in different formats. [Summary of the Invention] The present invention relates to a synchronization adjustment device, and by performing conversion of a frame synchronization signal using a plurality of PLLs, it is possible to perform good dubbing even on tapes recorded in different formats. It is to be. 2. Description of the Related Art In a so-called professional digital audio tape, since a VTR is used as a recording / reproducing device, various formats exist according to a television standard system in each country. That is, 25Hz, 30Hz as frame synchronization frequency
And the sampling frequency s of the audio signal has a format of 48 kHz, 44.1 kHz, 44.056 kHz, or the like. On the other hand, so-called time codes are used in the editing of signals using such a commercial VTR, and the time codes also have a time code clock frequency t of 2 kHz or 2.4 kHz in accordance with the format of the above-mentioned signals. , 2.39
There are various formats such as 76kHz. However, in editing or the like, it is necessary to edit the above-mentioned different formats and dub them to a VTR of an arbitrary format. Conventionally, in dubbing between such different formats, a tape recorded in an arbitrary format is converted to the frame frequency of the VTR to be dubbed using a so-called frame number conversion device to create a secondary tape. Thereafter, dubbing has been performed while performing data conversion using the secondary tape. However, in such a method, it takes time to prepare the secondary tape, and the number of dubbing increases, so that the occurrence of errors increases and the signal may deteriorate. [Problems to be Solved by the Invention] As described above, in the related art, when dubbing a tape having a different format, a long processing time is required, and the possibility of signal deterioration is increased. There was a problem. [Means for Solving the Problems] The present invention relates to a synchronization adjustment device for performing synchronization adjustment between a reproducing device and a recording device having different formats, and receives a reference frame synchronization signal (terminal (1)). A first PLL for forming a desired sampling signal (output terminal (4))
A circuit (2), a second PLL circuit (6) that receives an output of the first PLL circuit, and outputs (terminal (8)) a timing signal corresponding to a recording time code of the recording device; Upon receiving a playback frame synchronization signal separated (circuit (10)) from a playback time code (input terminal (9)) obtained from the device, the playback frame synchronization signal is converted into a target time code and the recording time code (input A third conversion is performed so that the signal has the same frequency as the recording frame synchronization signal separated (circuit (15)) from the terminal (14).
And a phase comparing means (13) for comparing the phase of the output of the third PLL circuit with the recording frame synchronization signal separated from the target time code. Speed control (output terminal (16)) between the reproducing apparatus and the recording apparatus using the output signal of the recording apparatus, and the reproduction time code from the reproducing apparatus is converted into the format of the recording apparatus using the timing signal. This is a synchronization adjusting device that converts (circuit (17)) to recording time code (output terminal (18)). [Operation] According to this, since the format can be converted arbitrarily, speed control between different formats can be performed, and thereby dubbing between tapes having different formats can be performed well. [Embodiment] In the figure, (1) is an input terminal to which a reference frame synchronization signal is supplied, and this input terminal (1) is a first terminal.
It is connected to a first input of a phase comparison circuit (2a) constituting the PLL (2). The output of this comparator (2a) is VCXO (2b)
And the output of this VCXO (2b) is connected to the second input of the comparison circuit (2a) through a 1 / a divider circuit (2c) and a 1 / b divider circuit (2d). You. VCXO (2b)
Is connected to the output terminal (4) of the sampling clock through a 1/100 frequency divider (3). Further, a phase comparator (6a) constituting a second PLL (6) through a frequency divider (5) whose output of the frequency divider (2c) is 1 / c.
Connected to a first input of The output of the comparator (6a) is connected to the control input of the VCXO (6b), and the output of the VCXO (6b) is connected to the second input of the comparator (6a) through a 1 / d frequency divider (6c). Connected. Furthermore, the output of VCXO (6b) is 1 /
e is connected to the output terminal (8) of the time code clock through the frequency dividing circuit (7). Further, an input terminal (9) to which a playback time code is supplied from a playback device for a signal to be dubbed is connected to a time code reading circuit (10), and an output of the separated frame synchronization signal is supplied to a third PLL ( 11) is connected to the first input of the phase comparison circuit (11a). This comparison circuit (1
The output of 1a) is connected to the control input of VCO (11b) and this VC
The output of O (11b) is connected to the second input of the comparison circuit (11a) through the 1 / n frequency dividing circuit (11c). In addition, VCO (11
The output of b) is connected to a first input of a phase control circuit (13) for speed control through a 1 / m frequency dividing circuit (12). An input terminal (14) to which a target time code is supplied from the recording device is connected to a time code reading circuit (15), and an output of the separated frame synchronization signal is supplied to a second input of a comparison circuit (13). Connected to. The output of the comparison circuit (13) is connected to the output terminal (16) of the speed control signal. Further, the output of the time code of the reading circuit (10) is connected to the time code conversion circuit (17), and the output of the frequency dividing circuit (7) is connected to the conversion circuit (17). ) Output is the recording time code output terminal (1
8) Connected to. In this device, when the frequency of the reference frame active period signal supplied to the input terminal (1) is 25 Hz,
Frequency division ratios a, b, of the frequency divider circuits (2c) (2d) (5) (6c) (7)
By setting c, d, and e as shown in Table I below, sampling clocks and time code clocks of desired frequencies s and t are output to output terminals (4) and (8), respectively. When the frequency of the reference frame synchronization signal is 29.97 Hz, clock signals s and t can be obtained similarly as shown in Table II. Further, when the frequency of the reference frame synchronization signal is 30 Hz, clock signals s and t can be obtained similarly as shown in Table III. As a result, sampling clocks and time code clocks of desired frequencies s and t can be obtained for the respective reference frame synchronization signal frequencies. If the frame frequencies of the time codes supplied to the input terminals (9) and (14) are different from each other in combination as shown on the left side of Table IV, the dividing ratio n of the dividing circuits (11c) and (12) is n. , m are determined as shown on the right. As a result, the frame synchronization signal of the reproduction time code can be converted into the frequency of the frame synchronization signal of the target time code, and the speed can be controlled by comparing the phases. When the frequencies of the frame synchronization signals match, it is assumed that the PLL (11) does not operate and the signal is passed as it is. The time code from the readout circuit (10) is supplied to the conversion circuit (17), and the conversion circuit (17) is supplied with the time code clock from the frequency dividing circuit (7), so that the reproduced signal is reproduced. Is converted at the timing of the time code of the recording device and is taken out to the output terminal (18). Therefore, in this apparatus, speed control is performed between tapes of different formats, and the time code is converted and supplied to the recording apparatus. In this way, speed control between different formats is performed, and dubbing can be performed in this state. However, according to the above-described apparatus, it is not necessary to create a secondary tape or the like, so that processing is quickly transmitted, and There is no risk of signal deterioration or the like due to this. [Effects of the Invention] According to the present invention, since the format can be arbitrarily converted, speed control between different formats can be performed, whereby dubbing between tapes having different formats can be performed well. I can do it.
【図面の簡単な説明】
図は本発明の一例の構成図である。
(1)(9)(14)は入力端子、(2)(6)(11)は
PLL、(3)(5)(7)(12)は分周回路、(4)
(8)(16)(18)は出力端子、(10)(15)はタイム
コード読出回路、(13)は位相比較回路、(17)はタイ
ムコード変換回路である。BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a configuration diagram of an example of the present invention. (1) (9) (14) are input terminals, (2) (6) (11)
PLL, (3) (5) (7) (12) is frequency divider, (4)
(8), (16) and (18) are output terminals, (10) and (15) are time code reading circuits, (13) is a phase comparison circuit, and (17) is a time code conversion circuit.
Claims (1)
同期調整を行う同期調整装置に関し、 基準のフレーム同期信号が入力されて所望のサンプリン
グ信号を形成する第1のPLL回路と、 上記第1のPLL回路の出力を受けて上記記録装置の記録
タイムコードに対応したタイミング信号を出力する第2
のPLL回路と、 上記再生装置から得られる再生タイムコードから分離し
た再生フレーム同期信号を受けて前記再生フレーム同期
信号を目標タイムコードである上記記録装置の記録タイ
ムコードから分離された記録フレーム同期信号と等しい
周波数の信号になるように変換する第3のPLL回路と、 上記第3のPLL回路の出力と上記目標タイムコードから
分離された記録フレーム同期信号との位相を比較する位
相比較手段と を有し、 上記位相比較手段の出力信号を用いて上記再生装置と上
記記録装置との調速制御を行うと共に、 上記再生装置からの再生タイムコードを上記タイミング
信号を用いて上記記録装置のフォーマットの記録タイム
コードに変換するようにした同期調整装置。(57) [Claims] A synchronization adjustment device for adjusting synchronization between a reproducing device and a recording device having different formats, a first PLL circuit to which a reference frame synchronization signal is input to form a desired sampling signal, and the first PLL circuit And outputs a timing signal corresponding to the recording time code of the recording apparatus
A PLL circuit, receiving a playback frame synchronization signal separated from the playback time code obtained from the playback device, and receiving the playback frame synchronization signal from the recording time code of the recording device as a target time code. A third PLL circuit for converting the signal into a signal having a frequency equal to the following, and phase comparing means for comparing the phase of the output of the third PLL circuit with the recording frame synchronization signal separated from the target time code. The speed control of the reproducing apparatus and the recording apparatus is performed by using an output signal of the phase comparing means, and a reproduction time code from the reproducing apparatus is converted into a format of the recording apparatus by using the timing signal. Synchronization adjustment device that converts to recording time code.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21566986A JP2913634B2 (en) | 1986-09-12 | 1986-09-12 | Synchronization adjustment device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21566986A JP2913634B2 (en) | 1986-09-12 | 1986-09-12 | Synchronization adjustment device |
Publications (2)
Publication Number | Publication Date |
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JPS6370987A JPS6370987A (en) | 1988-03-31 |
JP2913634B2 true JP2913634B2 (en) | 1999-06-28 |
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ID=16676206
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP21566986A Expired - Fee Related JP2913634B2 (en) | 1986-09-12 | 1986-09-12 | Synchronization adjustment device |
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Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03130437U (en) * | 1990-04-11 | 1991-12-27 |
-
1986
- 1986-09-12 JP JP21566986A patent/JP2913634B2/en not_active Expired - Fee Related
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JPS6370987A (en) | 1988-03-31 |
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