JP2670918B2 - エンファシス補正回路 - Google Patents
エンファシス補正回路Info
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- JP2670918B2 JP2670918B2 JP3150416A JP15041691A JP2670918B2 JP 2670918 B2 JP2670918 B2 JP 2670918B2 JP 3150416 A JP3150416 A JP 3150416A JP 15041691 A JP15041691 A JP 15041691A JP 2670918 B2 JP2670918 B2 JP 2670918B2
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- Japan
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- Television Signal Processing For Recording (AREA)
Description
【0001】
【産業上の利用分野】本発明は、ビデオテープレコーダ
などにおいて、再生信号のS/N比を改善するために、
記録時に高域成分を強調し、再生時に高域成分を減衰さ
せるビデオエンファシスに関する。
などにおいて、再生信号のS/N比を改善するために、
記録時に高域成分を強調し、再生時に高域成分を減衰さ
せるビデオエンファシスに関する。
【0002】
【従来の技術】図3は、従来例のブロック図であり、同
図(A)は記録系、同図(B)は再生系をそれぞれ示し
ており、また、図4は図3の各部の信号波形図である。
図(A)は記録系、同図(B)は再生系をそれぞれ示し
ており、また、図4は図3の各部の信号波形図である。
【0003】先ず、記録時には、図4(A)に示される
ビデオ信号は、クランプ回路15でシンクチップレベル
v1にクランプされた後、プリエンファシス回路16に
よって図4(B)に示されるように高域成分が強調され
る。さらに、反転現象を防止するために、クリップ回路
17によって図4(C)に示されるように所定のレベル
v2でクリップされ、FM変調回路18でFM変調され
てヘッドを介してテープに記録される。
ビデオ信号は、クランプ回路15でシンクチップレベル
v1にクランプされた後、プリエンファシス回路16に
よって図4(B)に示されるように高域成分が強調され
る。さらに、反転現象を防止するために、クリップ回路
17によって図4(C)に示されるように所定のレベル
v2でクリップされ、FM変調回路18でFM変調され
てヘッドを介してテープに記録される。
【0004】一方、再生時には、ヘッドからの再生信号
をFM復調回路19でビデオ信号に復調し、デエンファ
シス回路20で高域成分を減衰させて図4(D)の信号
を得るものである。
をFM復調回路19でビデオ信号に復調し、デエンファ
シス回路20で高域成分を減衰させて図4(D)の信号
を得るものである。
【0005】
【発明が解決しようとする課題】ところが、このような
従来例のビデオエンファシスでは、デエンファシス回路
20で高域成分が減衰された図4(D)の再生信号の波
形は、図4(C)に示されるクリップ回路17でホワイ
トクリップされた箇所が欠落しており、画質を損なうと
いう難点がある。
従来例のビデオエンファシスでは、デエンファシス回路
20で高域成分が減衰された図4(D)の再生信号の波
形は、図4(C)に示されるクリップ回路17でホワイ
トクリップされた箇所が欠落しており、画質を損なうと
いう難点がある。
【0006】本発明は、上述の点に鑑みて為されたもの
であって、記録時のクリップによって生じる再生波形の
歪を補正することを目的とする。
であって、記録時のクリップによって生じる再生波形の
歪を補正することを目的とする。
【0007】
【課題を解決するための手段】本発明では、上述の目的
を達成するために、次のように構成している。
を達成するために、次のように構成している。
【0008】すなわち、本発明のエンファシス補正回路
は、再生時にFM復調回路で復調されたビデオ信号の高
域成分を減衰させるデエンファシス回路と、前記デエン
ファシス回路の入出力信号の差信号を取り出す第1減算
回路と、前記第1減算回路の出力信号を、前記デエンフ
ァシス回路の出力信号の輝度レベルに対応したレベルで
クリップするクリップ手段と、前記第1減算回路の出力
信号と前記クリップ手段の出力信号の差信号を取り出す
第2減算回路と、前記デエンファシス回路の出力信号と
前記第2減算回路の出力信号とを加算する加算回路と、
を備えている。
は、再生時にFM復調回路で復調されたビデオ信号の高
域成分を減衰させるデエンファシス回路と、前記デエン
ファシス回路の入出力信号の差信号を取り出す第1減算
回路と、前記第1減算回路の出力信号を、前記デエンフ
ァシス回路の出力信号の輝度レベルに対応したレベルで
クリップするクリップ手段と、前記第1減算回路の出力
信号と前記クリップ手段の出力信号の差信号を取り出す
第2減算回路と、前記デエンファシス回路の出力信号と
前記第2減算回路の出力信号とを加算する加算回路と、
を備えている。
【0009】
【作用】上記構成によれば、記録時にクリップされた信
号と同等の信号を、デエンファシス回路の入出力信号に
基づいて、第1減算回路、クリップ手段および第2減算
回路によって形成し、この信号をデエンファシス回路の
出力信号に加算するので、記録時のクリップによって生
じる再生波形の歪が補正されることになる。
号と同等の信号を、デエンファシス回路の入出力信号に
基づいて、第1減算回路、クリップ手段および第2減算
回路によって形成し、この信号をデエンファシス回路の
出力信号に加算するので、記録時のクリップによって生
じる再生波形の歪が補正されることになる。
【0010】
【実施例】以下、図面によって本発明の実施例につい
て、詳細に説明する。
て、詳細に説明する。
【0011】図1は、本発明の一実施例のブロック図で
あり、図2は動作説明に供する信号波形図である。
あり、図2は動作説明に供する信号波形図である。
【0012】この実施例のエンファシス補正回路1は、
VTRに搭載されており、記録系の構成は、図3(A)
の従来例と同様である。
VTRに搭載されており、記録系の構成は、図3(A)
の従来例と同様である。
【0013】すなわち、記録時には、ビデオ信号が、ク
ランプ回路15でクランプされた後、プリエンファシス
回路16によって高域成分が強調され、さらに、反転現
象を防止するために、クリップ回路17によって所定の
レベルでクリップされ、FM変調回路18でFM変調さ
れてヘッドを介してテープに記録される。
ランプ回路15でクランプされた後、プリエンファシス
回路16によって高域成分が強調され、さらに、反転現
象を防止するために、クリップ回路17によって所定の
レベルでクリップされ、FM変調回路18でFM変調さ
れてヘッドを介してテープに記録される。
【0014】今、例えば、図2(A)に示されるビデオ
信号S1が入力されたとする。このビデオ信号S1は、
Y1とY2の輝度信号からなり、輝度信号Y2は、白1
00%(Y:S=100:40)であり、輝度信号Y1
は、輝度信号Y2よりもα%小さいものとする。
信号S1が入力されたとする。このビデオ信号S1は、
Y1とY2の輝度信号からなり、輝度信号Y2は、白1
00%(Y:S=100:40)であり、輝度信号Y1
は、輝度信号Y2よりもα%小さいものとする。
【0015】このビデオ信号S1は、図3(A)に示さ
れるように、クランプ回路15でシンクチップレベルv
1にクランプされた後、プリエンファシス回路16によ
って図2(B)に示されるように高域成分が強調され
る。さらに、反転現象を防止するために、クリップ回路
17によって図2(C)に示されるように所定のレベル
v2でクリップされる。このクリップレベルv2を、ホ
ワイトピークからシンクチップまでのレベルBのA%と
する。クリップ回路17の出力S3は、FM変調回路1
8でFM変調されてヘッドを介してテープに記録され
る。
れるように、クランプ回路15でシンクチップレベルv
1にクランプされた後、プリエンファシス回路16によ
って図2(B)に示されるように高域成分が強調され
る。さらに、反転現象を防止するために、クリップ回路
17によって図2(C)に示されるように所定のレベル
v2でクリップされる。このクリップレベルv2を、ホ
ワイトピークからシンクチップまでのレベルBのA%と
する。クリップ回路17の出力S3は、FM変調回路1
8でFM変調されてヘッドを介してテープに記録され
る。
【0016】再生時には、ヘッドからの再生信号は、図
1に示されるように、FM復調回路2で復調され、デエ
ンファシス回路3で高域成分が減衰されるが、その際
に、本発明のエンファシス補正回路1によって、記録時
のクリップによって生じる再生波形の歪が後述のように
して補正される。
1に示されるように、FM復調回路2で復調され、デエ
ンファシス回路3で高域成分が減衰されるが、その際
に、本発明のエンファシス補正回路1によって、記録時
のクリップによって生じる再生波形の歪が後述のように
して補正される。
【0017】この実施例のエンファシス補正回路1は、
再生時にFM復調回路2で復調されたビデオ信号S3の
高域成分を減衰させるデエンファシス回路3と、このデ
エンファシス回路3の入出力信号S3,S4の差信号S
5を取り出す第1減算回路4と、この第1減算回路4の
出力信号S5を、前記デエンファシス回路3の出力信号
S4の輝度レベルに対応したレベルでクリップするクリ
ップ手段5と、前記第1減算回路4の出力信号S5と前
記クリップ手段5の出力信号S6の差信号S7を取り出
す第2減算回路6と、前記デエンファシス回路3の出力
信号S4と前記第2減算回路6の出力信号S7とを加算
する加算回路7とを備えている。
再生時にFM復調回路2で復調されたビデオ信号S3の
高域成分を減衰させるデエンファシス回路3と、このデ
エンファシス回路3の入出力信号S3,S4の差信号S
5を取り出す第1減算回路4と、この第1減算回路4の
出力信号S5を、前記デエンファシス回路3の出力信号
S4の輝度レベルに対応したレベルでクリップするクリ
ップ手段5と、前記第1減算回路4の出力信号S5と前
記クリップ手段5の出力信号S6の差信号S7を取り出
す第2減算回路6と、前記デエンファシス回路3の出力
信号S4と前記第2減算回路6の出力信号S7とを加算
する加算回路7とを備えている。
【0018】デエンファシス回路3は、従来例と同様
に、FM復調回路2で復調された図2(C)のビデオ信
号S3の高域成分を減衰させて図2(D)に示されるビ
デオ信号S4を出力する。このビデオ信号S4は、記録
時にクリップされた箇所が欠落している。
に、FM復調回路2で復調された図2(C)のビデオ信
号S3の高域成分を減衰させて図2(D)に示されるビ
デオ信号S4を出力する。このビデオ信号S4は、記録
時にクリップされた箇所が欠落している。
【0019】第1減算回路4では、デエンファシス回路
3の入出力信号S3,S4の差信号S5、すなわち、図
2(C)に示される入力信号S3と図2(D)に示され
る出力信号S4とを減算して図2(E)に示される差信
号S5を取り出すものであり、この差信号S5は、エン
ファシス量に対応したものとなる。
3の入出力信号S3,S4の差信号S5、すなわち、図
2(C)に示される入力信号S3と図2(D)に示され
る出力信号S4とを減算して図2(E)に示される差信
号S5を取り出すものであり、この差信号S5は、エン
ファシス量に対応したものとなる。
【0020】この第1減算回路4の出力信号S5を、デ
エンファシス回路3の出力信号S4の輝度レベルに対応
したレベルでクリップするクリップ手段5は、輝度レベ
ルに応じたクリップレベルを検知するクリップレベル検
知回路8と、検知されたクリップレベルになるようにク
リップレベルを可変するクリップレベル可変回路9と、
可変されるクリップレベルで第1減算回路4の出力信号
S5をクリップするクリップ回路10とを備えている。
エンファシス回路3の出力信号S4の輝度レベルに対応
したレベルでクリップするクリップ手段5は、輝度レベ
ルに応じたクリップレベルを検知するクリップレベル検
知回路8と、検知されたクリップレベルになるようにク
リップレベルを可変するクリップレベル可変回路9と、
可変されるクリップレベルで第1減算回路4の出力信号
S5をクリップするクリップ回路10とを備えている。
【0021】クリップレベル検知回路8によるクリップ
レベルの検知は、次のようにして行われる。
レベルの検知は、次のようにして行われる。
【0022】すなわち、図2(D)に示されるデエンフ
ァシス回路3の出力信号S4から輝度信号Y’と同期信
号S’との比を求め、入力された輝度信号が、白100
%の信号を基準として、どの位のレベルにあるかを検知
する。この例では、輝度信号Y2’は、白100%、輝
度信号Y1’は、輝度信号Y2’よりもα%小さいこと
が検知される。
ァシス回路3の出力信号S4から輝度信号Y’と同期信
号S’との比を求め、入力された輝度信号が、白100
%の信号を基準として、どの位のレベルにあるかを検知
する。この例では、輝度信号Y2’は、白100%、輝
度信号Y1’は、輝度信号Y2’よりもα%小さいこと
が検知される。
【0023】これに応じて、輝度信号Y2’に対応する
図2(E)の信号Dは、図2(C)に示される記録時の
レベルB(ホワイトピークからシンクチップまでのレベ
ル)に対するA%と同一比率(Y’+S’)に対する
A’%が、図2(F)の一点鎖線に示されるようにクリ
ップレベルとされ、また、輝度信号Y1’に対応する図
2(E)の信号Eは、白100%からの差αと同一比率
α’だけA’よりも高いレベルが、図2(F)の一点鎖
線に示されるようにクリップレベルとされる。
図2(E)の信号Dは、図2(C)に示される記録時の
レベルB(ホワイトピークからシンクチップまでのレベ
ル)に対するA%と同一比率(Y’+S’)に対する
A’%が、図2(F)の一点鎖線に示されるようにクリ
ップレベルとされ、また、輝度信号Y1’に対応する図
2(E)の信号Eは、白100%からの差αと同一比率
α’だけA’よりも高いレベルが、図2(F)の一点鎖
線に示されるようにクリップレベルとされる。
【0024】このようにして検知されるクリップレベル
に応じてクリップレベルが可変されてクリップ回路10
で第1減算回路4の出力信号S5がクリップされて図2
(F)に示される信号S6が出力される。
に応じてクリップレベルが可変されてクリップ回路10
で第1減算回路4の出力信号S5がクリップされて図2
(F)に示される信号S6が出力される。
【0025】第2減算回路6では、第1減算回路4の出
力信号S5からクリップ手段5の出力信号S6を減算
し、図2(G)に示される信号S7を出力する。この信
号S7は、記録時にクリップされた信号と同等の信号で
あり、この信号S7が、第1加算回路7でデエンファシ
ス回路3の出力信号S4と加算され、図2(G)に示さ
れるように、波形歪が補正された信号S8が出力される
ことになる。
力信号S5からクリップ手段5の出力信号S6を減算
し、図2(G)に示される信号S7を出力する。この信
号S7は、記録時にクリップされた信号と同等の信号で
あり、この信号S7が、第1加算回路7でデエンファシ
ス回路3の出力信号S4と加算され、図2(G)に示さ
れるように、波形歪が補正された信号S8が出力される
ことになる。
【0026】
【発明の効果】以上のように本発明によれば、ディエン
ファシス回路の入出力信号に基づいて第1減算回路、ク
リップ手段および第2減算回路によって記録時にクリッ
プされた信号の欠落部分と同等の信号を形成し、この信
号をディエンファシス回路の出力信号に加算するので、
比較的簡単な回路構成でもって、記録時のクリップによ
って生じる再生波形の歪みが正確に補正されることにな
り、これによって、画質が改善されることになる。
ファシス回路の入出力信号に基づいて第1減算回路、ク
リップ手段および第2減算回路によって記録時にクリッ
プされた信号の欠落部分と同等の信号を形成し、この信
号をディエンファシス回路の出力信号に加算するので、
比較的簡単な回路構成でもって、記録時のクリップによ
って生じる再生波形の歪みが正確に補正されることにな
り、これによって、画質が改善されることになる。
【図1】本発明の一実施例のブロック図である。
【図2】動作説明に供する信号波形図である。
【図3】従来例のブロック図である。
【図4】従来例の信号波形図である。
1 エンファシス補正回路 3 デエンファシス回路 4,6 第1,第2減算回路 5 クリップ手段 7 加算回路
Claims (1)
- 【請求項1】再生時にFM復調回路で復調されたビデオ
信号の高域成分を減衰させるデエンファシス回路と、前
記デエンファシス回路の入出力信号の差信号を取り出す
第1減算回路と、前記第1減算回路の出力信号を、前記
デエンファシス回路の出力信号の輝度レベルに対応した
レベルでクリップするクリップ手段と、前記第1減算回
路の出力信号と前記クリップ手段の出力信号との差信号
を取り出す第2減算回路と、前記デエンファシス回路の
出力信号と前記第2減算回路の出力信号とを加算する加
算回路と、を備えることを特徴とするエンファシス補正
回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3150416A JP2670918B2 (ja) | 1991-06-21 | 1991-06-21 | エンファシス補正回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3150416A JP2670918B2 (ja) | 1991-06-21 | 1991-06-21 | エンファシス補正回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04372771A JPH04372771A (ja) | 1992-12-25 |
JP2670918B2 true JP2670918B2 (ja) | 1997-10-29 |
Family
ID=15496467
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3150416A Expired - Lifetime JP2670918B2 (ja) | 1991-06-21 | 1991-06-21 | エンファシス補正回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2670918B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP4008577A1 (en) | 2020-12-01 | 2022-06-08 | Volvo Truck Corporation | A method for controlling a vehicle combination |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6172485A (ja) * | 1984-09-18 | 1986-04-14 | Victor Co Of Japan Ltd | 映像信号記録再生装置 |
JPS6435775A (en) * | 1987-07-31 | 1989-02-06 | Nippon Denki Home Electronics | Video tape recorder |
-
1991
- 1991-06-21 JP JP3150416A patent/JP2670918B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH04372771A (ja) | 1992-12-25 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
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